RU2621281C1 - Логический преобразователь - Google Patents
Логический преобразователь Download PDFInfo
- Publication number
- RU2621281C1 RU2621281C1 RU2015152654A RU2015152654A RU2621281C1 RU 2621281 C1 RU2621281 C1 RU 2621281C1 RU 2015152654 A RU2015152654 A RU 2015152654A RU 2015152654 A RU2015152654 A RU 2015152654A RU 2621281 C1 RU2621281 C1 RU 2621281C1
- Authority
- RU
- Russia
- Prior art keywords
- inputs
- input
- majority
- elements
- converter
- Prior art date
Links
Images
Classifications
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F7/00—Methods or arrangements for processing data by operating upon the order or content of the data handled
- G06F7/38—Methods or arrangements for performing computations using exclusively denominational number representation, e.g. using binary, ternary, decimal representation
- G06F7/48—Methods or arrangements for performing computations using exclusively denominational number representation, e.g. using binary, ternary, decimal representation using non-contact-making devices, e.g. tube, solid state device; using unspecified devices
- G06F7/57—Arithmetic logic units [ALU], i.e. arrangements or devices for performing two or more of the operations covered by groups G06F7/483 – G06F7/556 or for performing logical operations
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03K—PULSE TECHNIQUE
- H03K19/00—Logic circuits, i.e. having at least two inputs acting on one output; Inverting circuits
- H03K19/20—Logic circuits, i.e. having at least two inputs acting on one output; Inverting circuits characterised by logic function, e.g. AND, OR, NOR, NOT circuits
- H03K19/23—Majority or minority circuits, i.e. giving output having the state of the majority or the minority of the inputs
Landscapes
- Engineering & Computer Science (AREA)
- Physics & Mathematics (AREA)
- General Physics & Mathematics (AREA)
- Theoretical Computer Science (AREA)
- Computational Mathematics (AREA)
- Computing Systems (AREA)
- Mathematical Analysis (AREA)
- Mathematical Optimization (AREA)
- Pure & Applied Mathematics (AREA)
- General Engineering & Computer Science (AREA)
- Logic Circuits (AREA)
Abstract
Изобретение относится к вычислительной технике. Технический результат заключается в повышении быстродействия. Логический преобразователь предназначен для реализации любой из простых симметричных булевых функций τ1, τ2, τn-1, τn, зависящих от n аргументов - входных двоичных сигналов, при n=5, и может быть использован в системах цифровой вычислительной техники как средство преобразования кодов. Логический преобразователь содержит восемь мажоритарных элементов (11, …, 18), а максимальное время задержки распространения сигнала в нем равно 5×ΔtM, где ΔtM - время задержки мажоритарного элемента. В результате достигнуто повышение быстродействия при сохранении аппаратурного состава и функциональных возможностей прототипа. 1 ил.
Description
Изобретение относится к вычислительной технике и может быть использовано для построения средств автоматики, функциональных узлов систем управления и др.
Известны логические преобразователи (см., например, патент РФ 2281545, кл. G06F 7/57, 2006 г.), которые с помощью константной настройки реализуют любую из простых симметричных булевых функций τ1, τ2, τn-1, τn, зависящих от n аргументов - входных двоичных сигналов, при n=4.
К причине, препятствующей достижению указанного ниже технического результата при использовании известных логических преобразователей, относятся ограниченные функциональные возможности, обусловленные тем, что не допускается обработка пяти входных сигналов.
Наиболее близким устройством того же назначения к заявленному изобретению по совокупности признаков является принятый за прототип логический преобразователь (патент РФ 2542895, кл. G06F 7/57, 2015 г.), который содержит восемь мажоритарных элементов и с помощью константной настройки реализует любую из простых симметричных булевых функций τ1, τ2, τn-1, τn, зависящих от n аргументов - входных двоичных сигналов, при n=5.
К причине, препятствующей достижению указанного ниже технического результата при использовании прототипа, относится низкое быстродействие, обусловленное тем, что максимальное время задержки распространения сигнала в прототипе определяется выражением 6×ΔTM, где ΔtM есть время задержки мажоритарного элемента.
Техническим результатом изобретения является повышение быстродействия при сохранении аппаратурного состава и функциональных возможностей прототипа.
Указанный технический результат при осуществлении изобретения достигается тем, что в логическом преобразователе, содержащем восемь мажоритарных элементов, выход i-го (i∈{1,2,3,5}) мажоритарного элемента и первые входы четвертого, седьмого мажоритарных элементов соединены соответственно с вторым входом (i+1)-го мажоритарного элемента и вторым настроечным входом логического преобразователя, первый, j-й () информационные и первый настроечный входы которого подключены соответственно к второму входу первого, третьему входу (j-1)-го мажоритарных элементов и первым входам первого, второго, третьего, шестого мажоритарных элементов, особенность заключается в том, что второй, третий входы k-го (), первый вход и выход восьмого мажоритарных элементов соединены соответственно с выходами (k-1)-го, (2×k-12)-го мажоритарных элементов, первым настроечным входом и выходом логического преобразователя, первый, второй, третий и четвертый информационные входы которого подключены соответственно к первому, второму, третьему входам пятого и третьему входу шестого мажоритарных элементов.
На чертеже представлена схема предлагаемого логического преобразователя.
Логический преобразователь содержит мажоритарные элементы 11, …, 18, причем выход элемента 1i (i∈{1, 2, 3, 5}) и первые входы элементов 14, 17 соединены соответственно с вторым входом элемента 1i+1 и вторым настроечным входом логического преобразователя, первый, j-й (J=2,5) информационные и первый настроечный входы которого подключены соответственно к второму входу элемента 11, третьему входу элемента 1j-1 и первым входам элементов 11, 12, 13, 16, второй, третий входы элемента 1k (), первый вход и выход элемента 18 соединены соответственно с выходами элементов 1k-1 и 12×k-12, первым настроечным входом и выходом логического преобразователя, первый, второй, третий и четвертый информационные входы которого подключены соответственно к первому, второму, третьему входам элемента 15 и третьему входу элемента 16.
Работа предлагаемого логического преобразователя осуществляется следующим образом. На его первом, втором настроечных входах фиксируются соответственно необходимые сигналы константной настройки ƒ1,ƒ2∈{0,1}. На его первый, …, пятый информационные входы подаются соответственно двоичные сигналы x1, …, x5∈{0,1}. На выходе мажоритарного элемента 1m () имеем , где am1, am2, am3 и , есть соответственно сигналы на его первом, втором, третьем входах и символы операций ИЛИ, И. Следовательно, сигнал на выходе элемента 18 определяется выражением
где τ1, τ2, τ4, τ5 есть простые симметричные булевы функции пяти аргументов x1, …, x5 (см. стр. 126 в книге Поспелов Д.А. Логические методы анализа и синтеза схем. -М.: Энергия, 1974 г.). При этом указанный преобразователь содержит восемь мажоритарных элементов, а максимальное время задержки распространения в нем сигнала равно 5×ΔtM, где ΔtM - время задержки мажоритарного элемента.
Вышеизложенные сведения позволяют сделать вывод, что предлагаемый логический преобразователь с помощью константой настройки реализует любую из простых симметричных булевых функций τ1, τ2, τn-1, τn, зависящих от n аргументов - входных двоичных сигналов, при n=5, имеет аппаратурный состав прототипа и обладает более высоким по сравнению с ним быстродействием.
Claims (1)
- Логический преобразователь, предназначенный для реализации простых симметричных булевых функций, содержащий восемь мажоритарных элементов, причем выход i-го (i∈{1, 2, 3, 5}) мажоритарного элемента и первые входы четвертого, седьмого мажоритарных элементов соединены соответственно с вторым входом (i+1)-го мажоритарного элемента и вторым настроечным входом логического преобразователя, первый, j-й информационные и первый настроечный входы которого подключены соответственно к второму входу первого, третьему входу (j-1)-го мажоритарных элементов и первым входам первого, второго, третьего, шестого мажоритарных элементов, отличающийся тем, что второй, третий входы k-го первый вход и выход восьмого мажоритарных элементов соединены соответственно с выходами (k-1)-го, (2×k-12)-го мажоритарных элементов, первым настроечным входом и выходом логического преобразователя, первый, второй, третий и четвертый информационные входы которого подключены соответственно к первому, второму, третьему входам пятого и третьему входу шестого мажоритарных элементов.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
RU2015152654A RU2621281C1 (ru) | 2015-12-08 | 2015-12-08 | Логический преобразователь |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
RU2015152654A RU2621281C1 (ru) | 2015-12-08 | 2015-12-08 | Логический преобразователь |
Publications (1)
Publication Number | Publication Date |
---|---|
RU2621281C1 true RU2621281C1 (ru) | 2017-06-01 |
Family
ID=59032190
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
RU2015152654A RU2621281C1 (ru) | 2015-12-08 | 2015-12-08 | Логический преобразователь |
Country Status (1)
Country | Link |
---|---|
RU (1) | RU2621281C1 (ru) |
Cited By (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
RU2689815C2 (ru) * | 2017-11-14 | 2019-05-29 | федеральное государственное бюджетное образовательное учреждение высшего образования "Ульяновский государственный технический университет" | Логический преобразователь |
RU2701464C1 (ru) * | 2018-09-24 | 2019-09-26 | федеральное государственное бюджетное образовательное учреждение высшего образования "Ульяновский государственный технический университет" | Логический преобразователь |
RU2709663C1 (ru) * | 2019-03-13 | 2019-12-19 | федеральное государственное бюджетное образовательное учреждение высшего образования "Ульяновский государственный технический университет" | Логический преобразователь |
RU2758185C1 (ru) * | 2020-10-28 | 2021-10-26 | федеральное государственное бюджетное образовательное учреждение высшего образования "Ульяновский государственный технический университет" | Логический преобразователь |
Citations (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6417692B2 (en) * | 1997-08-20 | 2002-07-09 | Altera Corporation | Programmable I/O cells with multiple drivers |
RU2281545C1 (ru) * | 2005-05-11 | 2006-08-10 | Государственное образовательное учреждение высшего профессионального образования "Ульяновский государственный технический университет" | Логический преобразователь |
RU2393527C2 (ru) * | 2008-05-19 | 2010-06-27 | Закрытое акционерное общество "ИВЛА-ОПТ" | Логический преобразователь |
RU2542895C1 (ru) * | 2013-11-06 | 2015-02-27 | Федеральное государственное бюджетное образовательное учреждение высшего профессионального образования "Ульяновский государственный технический университет" | Логический преобразователь |
-
2015
- 2015-12-08 RU RU2015152654A patent/RU2621281C1/ru not_active IP Right Cessation
Patent Citations (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6417692B2 (en) * | 1997-08-20 | 2002-07-09 | Altera Corporation | Programmable I/O cells with multiple drivers |
RU2281545C1 (ru) * | 2005-05-11 | 2006-08-10 | Государственное образовательное учреждение высшего профессионального образования "Ульяновский государственный технический университет" | Логический преобразователь |
RU2393527C2 (ru) * | 2008-05-19 | 2010-06-27 | Закрытое акционерное общество "ИВЛА-ОПТ" | Логический преобразователь |
RU2542895C1 (ru) * | 2013-11-06 | 2015-02-27 | Федеральное государственное бюджетное образовательное учреждение высшего профессионального образования "Ульяновский государственный технический университет" | Логический преобразователь |
Cited By (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
RU2689815C2 (ru) * | 2017-11-14 | 2019-05-29 | федеральное государственное бюджетное образовательное учреждение высшего образования "Ульяновский государственный технический университет" | Логический преобразователь |
RU2701464C1 (ru) * | 2018-09-24 | 2019-09-26 | федеральное государственное бюджетное образовательное учреждение высшего образования "Ульяновский государственный технический университет" | Логический преобразователь |
RU2709663C1 (ru) * | 2019-03-13 | 2019-12-19 | федеральное государственное бюджетное образовательное учреждение высшего образования "Ульяновский государственный технический университет" | Логический преобразователь |
RU2758185C1 (ru) * | 2020-10-28 | 2021-10-26 | федеральное государственное бюджетное образовательное учреждение высшего образования "Ульяновский государственный технический университет" | Логический преобразователь |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
RU2393527C2 (ru) | Логический преобразователь | |
RU2647639C1 (ru) | Логический преобразователь | |
RU2517720C1 (ru) | Логический преобразователь | |
RU2281545C1 (ru) | Логический преобразователь | |
RU2621281C1 (ru) | Логический преобразователь | |
RU2559708C1 (ru) | Логический преобразователь | |
RU2542895C1 (ru) | Логический преобразователь | |
RU2443009C1 (ru) | Логический преобразователь | |
RU2641454C2 (ru) | Логический преобразователь | |
RU2580799C1 (ru) | Логический преобразователь | |
RU2629451C1 (ru) | Логический преобразователь | |
RU2472209C1 (ru) | Логический модуль | |
RU2518669C1 (ru) | Логический преобразователь | |
RU2701464C1 (ru) | Логический преобразователь | |
RU2549151C1 (ru) | Логический преобразователь | |
RU2704735C1 (ru) | Пороговый модуль | |
RU2703675C1 (ru) | Логический преобразователь | |
RU2621376C1 (ru) | Логический модуль | |
RU2634229C1 (ru) | Логический преобразователь | |
RU2580798C1 (ru) | Логический преобразователь | |
RU2700557C1 (ru) | Логический преобразователь | |
RU2629452C1 (ru) | Логический преобразователь | |
RU2630394C2 (ru) | Логический модуль | |
RU2549158C1 (ru) | Логический преобразователь | |
RU2700556C1 (ru) | Логический преобразователь |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
MM4A | The patent is invalid due to non-payment of fees |
Effective date: 20171209 |