KR960038638A - 디지탈 신호 프로세서 - Google Patents
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Abstract
본 발명은 단순한 구성으로 디지탈 신호 정보가 손상되지 않게 되는 디지탈신호 프로세서를 제공한다. 본 발명에 따른 디지탈 신호 프로세서는 제1샘플링 클릭 신호 및 제2샘플링 클릭 신호와 동기화되어 제1 및 제2어드레스 영역의 초기 어드레스 값으로부터 증분되는 제1 및 제2카운터, 상기 제1카운터의 값에 따라서 상기 제1어드레스 영역에서 제1어드레스 번호를 발생하고 상기 제2카운터의 카운터 값에 따라서 상기 제2어드레스 영역에서 제2어드레스 번호를 발생하는 어드레스 발생 수단, 상기 어드레스 발생 수단이 발생한 제1 및 제2어드레스 번호에 상기 제1 및 제2샘플링 클럭 신호와 동기화되어 공급된 정보 신호를 저장하는 데이타 메모리, 및 상기 데이타 메모리에 저장된 정보 신호를 판독하고 상기 정보 신호에 대해 수치 연산을 수행하는 수치 연산 수단을 포함한다.
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명의 디지탈 신호 프로세서가 장착되는 DAT의 개략 구성도이다, 제2도는 상기 DAT 및 재생 특화 모드의 기록/재생 모드의 주요부의 표준을 도시한 다이어그램이다. 제3A, 3B, 3C도는 상기 DAT의 메인 데이타의 1블럭 포맷의 개략 구성도로서 제3A도는 메인 데이타 영역의 구성도이고 제3B, 제3C도는 메인 데이타 영역의 빈영역에 인스톨된 하위 데이타 영역의 구성도이다. 제4A, 4B, 4C도는 상기 DAT의 메인 데이타의 1블록 포맷의 개략 구성도로서, 제4A도는 전체 도면이고 제4B도는 메인 ID의 구성도이고 제4C도는 각각의 메인 ID의 기능을 도시한 도면이다. 제4C도는 각각의 메인 ID의 기능을 도시한 도이다.
Claims (7)
- 제1샘플링 클럭 신호와 동기화되어 제1어드레스 영역의 초기 어드레스 값으로부터 증분되는 제1카운터, 제2샘플링 클럭 신호와 동기화되어 제2어드레스 영역의 초기 어드레스 값으로부터 증분되는 제2카운터, 상기 제1카운터의 카운터 값에 따라서 상기 제1어드레스 영역에서 제1어드레스 번호를 발생하고 상기 제2카운터의 카운터 값에 따라서 상기 제2어드레스 영역에서 제2어드레스 번호를 발생하는 어드레스 발생 수단, 상기 어드레스 발생 수단이 발생한 제1 및 제2 어드레스 번호에 상기 제1 및 제2샘플링 클럭 신호와 동기화되어 공급된 정보 신호를 저장하는 데이타 메모리, 및 상기 데이타 메모리에 저장된 정보 신호를 판독하고 상기 정보 신호에 대해 수치 연산을 수행하는 수치 연산 수단을 포함하는 것을 특징으로 하는 디지탈 신호 프로세서
- 제1항에 있어서, 상기 데이타 메모리가 최소한 제1어드레스 영역 및 제2어드레스 영역을 포함하고 데이타가 상기 제1샘플링 클럭 신호 및 상기 제2샘플링 클럭 신호에 응답하여 상기 어드레스 영역 내에 개별적으로 저장되는 것을 특징으로 하는 디지탈 신호 프로세서
- 제1항에 있어서, 상기 어드레스 발생 수단이 제1 및 제2카운터 값에 의해 특정화된 어드레스들의 합산 출력에 따라서 어드레스 영역을 검출하는 영역 검출 수단 및 상기 영역 검출 수단의 검출 결과에 따라서 제1어드레스 값을 마스크하는 제1마스크 수단을 포함하는 것을 특징으로 하는 디지탈 신호 프로세서
- 제3항에 있어서, 상기 어드레스 발생 수단이 제1 및 제2카운터 값에 의해 특정화된 어드레스들의 합산 출력에 따라서 어드레스 영역을 검출하는 영역 검출 수단 및 상기 영역 검출 수단의 검출 결과에 따라서 제2어드레스 값을 마스크하는 제2마스크 수단을 포함하는 것을 특징으로 하는 디지탈 신호 프로세서
- 제4항에 있어서, 상기 어드레스 발생 수단이 제1 및 제2카운터 값에 의해 특정화된 어드레스들의 합산 출력에 따라서 어드레스 영역을 검출하는 영역 검출 수단 및 상기 영역 검출 수단의 검출 결과에 따라서 제2어드레스 값을 오프셋하는 오프셋 수단을 포함하는 것을 특징으로 하는 디지탈 신호 프로세서
- 제1항에 있어서, 상기 수치 연산 수단이 상기 데이타 메모리로부터 판독된 정보 신호를 계수 설정 수단으로부터 공급된 계수와 승산하는 승산기를 포함하는 것을 특징으로 하는 디지탈 신호 프로세서
- 제6항에 있어서, 상기 수치 연산 수단이 상기 데이타 메모리로부터 판독된 정보 신호를 계수 설정 수단으로부터 공급된 계수와 승산하는 승산기의 출력 결과를 특정화된 워드 길이만큼 라운드(round)하는 클리퍼를 포함하는 것을 특징으로 하는 디지탈 신호 프로세서
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