KR940017155A - 기준 전압 발생기 - Google Patents

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Abstract

소위 대역 갭 조정기 형태의 기준 전압 발생기가 기술되는데, 한 쌍의 바이폴라 트랜지스터와, 상기 트랜지스터간의 베이스-에미터 전압의 차이에 비례하게 전압을 발생시켜 서로가 상이한 전류 세기로 작동하도록 만들기 위해 바이폴라 트랜지스터에 결합된 저항기 회로 및, 상기 저항기 회로를 통해 흐르는 전류를 제어하기 위해 전압을 수신하도록 결합된 연산 증폭기를 포함하고, 저항기 회로로부터의 전압을 수신 및 시프트시키기 위해 저항기 회로와 연산 증폭기간의 삽입된 레벨 시프트도 포함하는데, 전압을 시프팅하는 레벨시프터가 레벨 시프트된 전압을 발생시키고 그 시프트된 전압을 연산 증폭기가 수신한다.

Description

기준 전압 발생기
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제2도는 본 발명의 실시예에 따른 기준 전압 발생기를 도시한 회로도, 제3도는 본 발명의 또 다른 실시예에 따른 기준 전압 발생기를 도시한 회로도, 제4도는 제2도 및 제3도에 각각 도시된 연산 증폭기를 도시한 회로도.

Claims (13)

  1. 제1및 제2바이폴라 트랜지스터와; 상기 제1및 제2바이폴라 트랜지스터에 결합되어, 상기 제1및 제2바이폴라 트랜지스터간의 베이스-에미터 전압의 차이에 비례하게 선정된 전압을 발생시키기 위해 서로가 상이한 전류 세기로 동작하는 제1및 제2바이폴라 트랜지스터를 만드는 저항기 회로와; 상기 선정된 전압을 수신 및 시프팅하여 레벨시프트된 전압을 발생시키는 레벨 시프트 회로 및; 전계 효과 트랜지스터로 구성되고, 상기 레벨 시프트된 전압을 수신하고 이에 응답하여 상기 저항기 회로를 통해 흐르는 전류를 제어하기 위한 연산 증폭기로 구성된 기준 전압 발생기.
  2. 제1항에 있어서, 상기 저항기 회로는 상기 제1바이폴라 트랜지스터의 에미터와 기준 전위 라인간에 접속된 제1저항기 및, 상기 제2바이폴라 트랜지스터의 에미터에 직렬로 접속된 제2및 제3저항기를 포함하는데, 각각의 상기 제1및 제2바이폴라 트랜지스터는 상기 연산 증폭기의 출력 전압에 비례하게 전압이 공급되는 베이스를 구비하는 기준 전압 발생기.
  3. 제2항에 있어서, 상기 레벨 시프트 회로는 상기 제1바이폴라 트랜지스터의 에미터에 접속된 제1입력 노드와, 상기 제2 및 제3저항기의 접속점에 접속된 제2입력 노드와, 상기 연산 증폭기의 제1입력 단자에 접속된 제1출력 노드 및 상기 연상 증폭기의 제2입력 단자에 접속된 제2출력 노드를 포함하고, 기준 전압은 상기 연산 증폭기의 출력 단자로부터 파생되는 기준 전압 발생기.
  4. 제3항에 있어서, 상기 레벨 시프터는 상기 연산 증폭기의 제1입력 단자와 상기 기준 전위 라인간에 접속되고 상기 제1입력 노드에 접속된 게이트를 구비한 제1전계 효과 트랜지스터와, 상기 연산 증폭기의 제2입력 단자와 상기 기준 전위 라인간의 접속되고 상기 제2입력 노드에 접속된 게이트를 구비한 제2전계효과 트랜지스터와, 상기 제1입력 단자와 전원 공급 라인간에 접속되고 바이어스 전압이 공급되는 게이트를 구비한 제3전계 효과 트랜지스터 및, 상기 제2입력 단자와 상기 전원 공급 라인간에 접속되고 상기 바이어스 전압이 공급된 게이트를 구비한 제4전계효과 트랜지스터를 포함하는 기준 전압 발생기.
  5. 제2항에 있어서, 상기 연산 증폭기의 출력 전압에 비례하게 전압이 공급되는 게이트를 각각 구비한 제1및 제2전계효과 트랜지스터를 포함하는데, 상기 저항기 회로는 상기 제1전계효과 트랜지스터와 상기 제1바이폴라 트랜지스터간에 접속된 제1저항기 및, 상기 제2전계효과 트랜지스터와 상기 제2바이폴라 트랜지스터간에 직렬로 접속된 제2 및 제3저항기를 포함하는 기준 전압 발생기.
  6. 제5항에 있어서, 각각의 상기 제1및 제2바이폴라 트랜지스터는 기준 전위 라인에 접속된 베이스 및 콜렉터를 구비하는 기준 전압 발생기.
  7. 제6항에 있어서, 기준 전압은 상기 제2전계효과 트랜지스터와 상기 제3저항기의 접속점으로부터 파생되는 기준 전압 발생기.
  8. 제7항에 있어서, 상기 연산 증폭기는 제1및 제2입력 단자를 구비하고 상기 레벨 시프터는 상기 제1입력 단자와 상기 기준 전위 라인간에 접속되고 상기 제1바이폴라 트랜지스터의 에미터에 접속된 게이트를 구비한 제3전계효과 트랜지스터 및, 상기 제2입력 단자와 상기 기준 전위 라인간에 접속되고 상기 제2및 제3저항기의 접속점에 접속된 게이트를 구비한 제4전계효과 트랜지스터를 포함하는 기준 전압 발생기.
  9. 제1및 제2전원 라인과; 상기 제1전원 라인, 에미터 및 베이스에 접속된 콜렉터를 구비한 제1바이폴라 트랜지스터와; 상기 제1전원 라인, 에미터 및 베이스에 접속된 콜렉터를 구비한 제2바이폴라 트랜지스터와; 상기 제1바이폴라 트랜지스터의 에미터와 상기 제2전력 라인간에 접속된 제1저항기와; 상기 제2바이폴라 트랜지스터의 에미터와 상기 제2전원 라인간에 직렬로 접속된 제2및 제3저항기와; 제1입력 단자와, 제2입력단자 및 출력단자를 구비한 연산 증폭기와; 상기 연산 증폭기의 출력단자를 상기 제1및 제2바이폴라 트랜지스터의 베이스에 접속시키는 수단과; 상기 연산 증폭기의 제1입력 단자와 상기 제2전원 라인간에 접속되고 상기 제1바이폴라 트랜지스터의 에미터에 접속된 게이트를 구비한 제1전계효과 트랜지스터 및; 상기 연산 증폭기의 제2입력 단자와 상기 제2입력라인간에 접속되고 상기 제2및 제3저항기의 접속점에 접속된 게이트를 구비한 제2전계효과 트랜지스터를 포함하는 기준 전압 발생기.
  10. 제9항에 있어서, 상기 접속 수단은 상기 연산 증폭기의 출력 단자와 상기 제2전원 라인간에 직렬로 접속된 제4및 제5저항기를 포함하는데, 상기 제1및 제2바이폴라 트랜지스터의 게이트가 상기 제4및 제5항기의 접속점에 접속되어지는 기준 전압 발생기.
  11. 제9항에 있어서, 상기 연산 증폭기의 제1입력 단자와 상기 제1전원 라인간에 접속된 제1전류원 및, 상기 연산 증폭기의 제2입력 단자와 상기 제1전원 라인간에 접속된 제2전류원을 포함하는 기준 전압 발생기.
  12. 제1및 제2전원 라인과; 상기 제1전원 라인과 제1노드간에 접속된 제1전계효과 트랜지스터와; 상기 제1전원라인과 제2노드간에 접속된 제2전계효과 트랜지스터와; 상기 제2전원 라인 및 에미터에 접속된 베이스 및 콜렉터를 구비한 제1바이폴라 트랜지스터와; 상기 제2전원 라인 및 에미터에 접속된 베이스 및 콜렉터를 구비한 제2바이폴라 트랜지스터와; 상기 제1노드와 상기 제1바이폴라 트랜지스터의 에미터간에 접속된 제1저항기와; 상기 제2노드와 상기 제2바이폴라 트랜지스터의 에미터간에 직렬로 접속된 제2및 제3저항기와; 제1입력 단자, 제2입력단자 및, 출력 단자를 구비한 연산증폭기와; 상기 연산 증폭기의 출력 단자를 상기 제1및 제2전계효과 트랜지스터의 게이트에 접속시키는 수단과; 상기 연산 증폭기의 제1입력 단자와 상기 제2전원 라인간에 접속되고 상기 제1바이폴라 트랜지스터의 에미터에 접속된 게이트를 구비한 제3전계효과 트랜지스터 및, 상기 연산 증폭기의 제2입력단자와 상기 제2전원 라인간에 접속되고 상기 제2및 제3저항기의 접속점에 접속된 게이트를 구비한 제4전계효과 트랜지스터를 포함하는 기준 전압 발생기.
  13. 제12항에 있어서, 상기 연산 증폭기의 제1입력 단자와 상기 제1전원 라인간에 접속된 제1전류원 및, 상기 연산 증폭기의 제2입력 단자와 상기 제1전원 라인간에 접속된 제2전류원을 포함하는 기준 전압 발생기.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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