KR910014812A - 내부 메모리 맵 레지스터를 관측하는 방법 및 장치 - Google Patents
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Abstract
내용 없음
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제2도는 통합된 제어기를 사용하는 전형적인 마이크로프로세서 칩을 예시한 블록 다이어 그램, 제3도는 메모리 맵 주소 지정을 사용하는 마이크로프로세서의 메모리 할당을 예시한 블록 다이어 그램, 제4도는 본 발명에 따른 마이크로 프로세서의 내부 판독 및 기록 사이클을 예시한 타이밍 타이어 그램.
Claims (4)
- 주소 버스 및 데이타 버스를 포함하는 시스템 버스에 의하여 외부 디바이스에 위치한 외부 레지스터를 지니는 적어도 한 외부 디바이스에 접속되어있으며 상기 시스템 버스가 상기 외부 레지스터와 통신할 수 있도록 제1신호를 활성화시킴으로써 상기 시스템 버스를 거쳐 상기 외부 레지스터와 통신하는 외부 버스 사이클을 초기화하고 상기 시스템 버스상에 있는 오부 레지스터와의 통신 방향을 결정하는 값으로서 제2신호를 발생시키는 중앙 처리 유니트(CPU)를 포함하며 전송될 데이타가 상기 데이타 버스상에 제공되는 통합된 데이타 처리 시스템에 있어서, 메모리 맵 레지스터(내부 메모리 맵 레지스터)로서 기준되는 상태 및 제어 레지스터를 포함하는 적어도 한개가 통합된 주변 시스템 구성 요소, 상기 외부 레지스터와의 시스템 버스 통신이 디세이블 되도록 상기 제1신호를 불활성화시키는 수단, 상기 시스템 버스가 상기 내부 메모리 맵 레지스터와 통신할 수 있는 제3신호를 활성화시키는 수단, 상기 내부 메모리 맵 레지스터를 호출하며 상기 내부 메모리 맵 레지스터에 포함된 정보를 상기 데이타 버스상에 배치하는 수단을 포함하는 데이타 처리 시스템.
- 제1항에 있어서, 상기 통합된 주변 시스템 구성 요소가 코프로세서인 데이타 처리 시스템.
- 제1항에 있어서, 상기 통합된 주변 시스템 구성 요소가 제어기인 데이타 처리 시스템.
- 주소 버스 및 데이타 버스를 포함하는 시스템 버스에 의하여 외부 버스에 위치한 외부 레지스터를 지니는 적어도 하나의 외부 디바이스에 접속되며 상기 시스템 버스가 상기 외부 레지스터와 통신할 수 있도록 제1신호를 활성화시킴으로써 상기 시스템 버스를 거쳐 상기 외부 레지스터와 통신하는 외부 버스 사이클을 초기화하고 상기 시스템 버스상에 있는 외부 레지스터와의 통신 방향을 결정하는 값으로서 제2신호를 발생시키는 중앙 처리 유니트(CPU)를 포함하며 전송될 데이타가 상기 데이타 버스상에 제공되는 통합된 데이타 처리 시스템의 내부 메모리 맵 레지스터 내용을 관축하는 방법에 있어서, 메모리 맵 레지스터(내부 메모리 맵 레지스터)로서 기준되는 상태 및 제어 레지스터를 포함하며 상기 CPU온 칩과 함께 사용하는 적어도 하나의 주변 시스템 구성 요소를 통합시키는 단계, 상기 외부 레지스터와의 시스템 버스 통신이 디세이블 되도록 상기 제1신호를 불활성화시키는 단계, 상기 내부 메모리 맵 레지스터를 호출하며 상기 내부 메모리 맵 레지스터에 포함된 정보를 상기 데이타 버스상에 배치하는 단계를 포함하는 방법.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
US46102390A | 1990-01-04 | 1990-01-04 | |
US461,023 | 1990-01-04 |
Publications (2)
Publication Number | Publication Date |
---|---|
KR910014812A true KR910014812A (ko) | 1991-08-31 |
KR100223096B1 KR100223096B1 (ko) | 1999-10-15 |
Family
ID=23830931
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
KR1019900022362A KR100223096B1 (ko) | 1990-01-04 | 1990-12-29 | 내부 메모리 맵 레지스터를 관측하는 방법 및 장치 |
Country Status (4)
Country | Link |
---|---|
EP (1) | EP0436211B1 (ko) |
JP (1) | JPH0773132A (ko) |
KR (1) | KR100223096B1 (ko) |
DE (1) | DE69033759T2 (ko) |
Families Citing this family (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2669300B2 (ja) * | 1993-06-11 | 1997-10-27 | 日本電気株式会社 | プログラムトレース回路およびプログラムトレース方法 |
US5860161A (en) * | 1996-08-14 | 1999-01-12 | Advanced Micro Devices, Inc. | Microcontroller configured to indicate internal memory accesses externally |
US5903912A (en) * | 1996-08-14 | 1999-05-11 | Advanced Micro Devices, Inc. | Microcontroller configured to convey data corresponding to internal memory accesses externally |
US5862148A (en) * | 1997-02-11 | 1999-01-19 | Advanced Micro Devices, Inc. | Microcontroller with improved debug capability for internal memory |
US6601189B1 (en) * | 1999-10-01 | 2003-07-29 | Stmicroelectronics Limited | System and method for communicating with an integrated circuit |
Family Cites Families (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US4674089A (en) * | 1985-04-16 | 1987-06-16 | Intel Corporation | In-circuit emulator |
US5084814A (en) * | 1987-10-30 | 1992-01-28 | Motorola, Inc. | Data processor with development support features |
-
1990
- 1990-12-22 DE DE69033759T patent/DE69033759T2/de not_active Expired - Lifetime
- 1990-12-22 EP EP90125335A patent/EP0436211B1/en not_active Expired - Lifetime
- 1990-12-28 JP JP2418536A patent/JPH0773132A/ja active Pending
- 1990-12-29 KR KR1019900022362A patent/KR100223096B1/ko not_active IP Right Cessation
Also Published As
Publication number | Publication date |
---|---|
KR100223096B1 (ko) | 1999-10-15 |
DE69033759D1 (de) | 2001-08-16 |
JPH0773132A (ja) | 1995-03-17 |
EP0436211A2 (en) | 1991-07-10 |
EP0436211A3 (en) | 1992-03-18 |
DE69033759T2 (de) | 2002-05-08 |
EP0436211B1 (en) | 2001-07-11 |
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