KR910005582A - 아날로그 디지탈 pll - Google Patents

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KR910005582A
KR910005582A KR1019900012542A KR900012542A KR910005582A KR 910005582 A KR910005582 A KR 910005582A KR 1019900012542 A KR1019900012542 A KR 1019900012542A KR 900012542 A KR900012542 A KR 900012542A KR 910005582 A KR910005582 A KR 910005582A
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controlled oscillator
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알버트 케네디 리챠드
죤 만로브 그레고리
죠셉 마라 제프리
Original Assignee
마이클 죤 덴튼
델코 엘렉트로닉스 코포레이션
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    • H—ELECTRICITY
    • H03—ELECTRONIC CIRCUITRY
    • H03L—AUTOMATIC CONTROL, STARTING, SYNCHRONISATION OR STABILISATION OF GENERATORS OF ELECTRONIC OSCILLATIONS OR PULSES
    • H03L7/00—Automatic control of frequency or phase; Synchronisation
    • H—ELECTRICITY
    • H03—ELECTRONIC CIRCUITRY
    • H03D—DEMODULATION OR TRANSFERENCE OF MODULATION FROM ONE CARRIER TO ANOTHER
    • H03D1/00—Demodulation of amplitude-modulated oscillations
    • H03D1/22—Homodyne or synchrodyne circuits
    • H03D1/2209—Decoders for simultaneous demodulation and decoding of signals composed of a sum-signal and a suppressed carrier, amplitude modulated by a difference signal, e.g. stereocoders
    • H03D1/2236—Decoders for simultaneous demodulation and decoding of signals composed of a sum-signal and a suppressed carrier, amplitude modulated by a difference signal, e.g. stereocoders using a phase locked loop

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  • Engineering & Computer Science (AREA)
  • Power Engineering (AREA)
  • Stabilization Of Oscillater, Synchronisation, Frequency Synthesizers (AREA)

Abstract

내용 없음

Description

아날로그 디지탈 PPL
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제2도는 본 발명의 블럭 다이아그램.
제3도는 제2도에 도시된 아날로그 디지탈 합성 VCO의 아날로그 단계도.
제4도는 제2도에 도시된 아날로그 디지탈 합성 VCO의 디지탈 단계의 블럭 다이아그램.

Claims (5)

  1. 제1의 위상검출기(10), 아날로그 전압 제어 발진기(14), 상기 아날로그 전압제어 발진기에 입력을 제공하기 위하여 상기 제1의 위상검출기 출력에 응답하는 제1의 필터수단(12)과, 상기 아날로그 전압제어 발진기의 출력을 제1의 입력으로서 제1의 위상검출기에 연결하는 연결수단(16)으로 구성된 아날로그 PPL(28)을 구성되고, 아날로그/디지탈 전압제어 발진기(26), 파일롯트 신호를 포함하는 FM컴포지트 입력신호를 수신하기 위하여 채택된 제2의 위상검출기(20), 아날로그 제어입력을 상기 아날로그/디지탈 전압제어 발진기에 제공하기 위하여 상기 제2의 위상검출기 출력에 응답하는 제2의 필터수단(22,24), 기준 발진원으로부터 기준 입력주파수 신호를 수신하고 평균적으로 상기 파일롯트 신호와 같은 출력신호를 제공하는 수단(50)를 포함하는 아날로그/디지탈 전압제어 발진기로 구성되며, 상기 아날로그 PPL은 상기 아날로그/디지탈 전압제어 발진기와 상기 아날로그/디지탈 전압제어발진기의 출력을 평균내기 위한 제2의 위상검출기 사이의 피드백 선로에 연결되고, 상기 아날로그/디지탈 전압제어 발진기의 출력을 수신하기 위하여 채택된 제1의 위상검출기에 연결되며, 제1의 입력을 제2의 위상검출기에 제공하는 연결수단에도 연결된 것을 특징으로 하는 아날로그/디지탈 PLL.
  2. 제1항에 있어서, 상기 아날로그/디지탈 전압제어 발진기(26)는 파일롯트 신호의 주파수와 같은 중심주파수를 갖고 수정발진기의 출력에 기준되는 것을 특징으로 하는 PLL.
  3. 제1항에 있어서, 상기 파일롯트 신호는 FM컴포지트 입력신호의 19MHz 파일롯트 신호인 것을 특징으로 하는 PPL.
  4. 제1항 내지 제3항에 있어서, 상기 파일롯트 신호와 평균적으로 같은 출력신호를 제공하는 상기 수단은 분배기수단(50)을 포함하는 것을 특징으로 하는 PPL.
  5. 제4항에 있어서, 상기 분배기 수단은 미리 설정된 주파수에 기준 입력주파수 신호를 제공하기 위한 기준 발진원과 연결된 지터 분배기(52)로 구성되고, 상기 아날로그/디지탈 전압 제어 발진기(26)는 아날로그 제어입력에 응답하여 상기 지터 분배기를 제어하기 위한 주파수 제어수단(54)을 포함하는 것을 특징으로 하는 PLL.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019900012542A 1989-08-14 1990-08-14 아날로그 디지탈 pll KR940005513B1 (ko)

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Application Number Priority Date Filing Date Title
US07/393,496 US4970474A (en) 1989-08-14 1989-08-14 Analog/digital phase locked loop
US393496 1989-08-14
US393,496 1989-08-14

Publications (2)

Publication Number Publication Date
KR910005582A true KR910005582A (ko) 1991-03-30
KR940005513B1 KR940005513B1 (ko) 1994-06-20

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EP (1) EP0413475A3 (ko)
JP (1) JPH03192821A (ko)
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AU (1) AU615848B2 (ko)

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Also Published As

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EP0413475A3 (en) 1991-09-11
JPH03192821A (ja) 1991-08-22
EP0413475A2 (en) 1991-02-20
AU6029390A (en) 1991-02-14
AU615848B2 (en) 1991-10-10
US4970474A (en) 1990-11-13
KR940005513B1 (ko) 1994-06-20

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