KR880011669A - 데이터 처리 방법과 장치 - Google Patents

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KR880011669A
KR880011669A KR1019880003268A KR880003268A KR880011669A KR 880011669 A KR880011669 A KR 880011669A KR 1019880003268 A KR1019880003268 A KR 1019880003268A KR 880003268 A KR880003268 A KR 880003268A KR 880011669 A KR880011669 A KR 880011669A
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히로유끼 기다
투루 고마가와
히데오 마에지마
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미쓰다 가쓰시게
가부시끼가이샤 히다찌 세이사꾸쇼
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    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F13/00Interconnection of, or transfer of information or other signals between, memories, input/output devices or central processing units
    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F15/00Digital computers in general; Data processing equipment in general
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    • G06F15/78Architectures of general purpose stored program computers comprising a single central processing unit
    • G06F15/7839Architectures of general purpose stored program computers comprising a single central processing unit with memory
    • G06F15/7842Architectures of general purpose stored program computers comprising a single central processing unit with memory on one IC chip (single chip microcontrollers)
    • G06F15/786Architectures of general purpose stored program computers comprising a single central processing unit with memory on one IC chip (single chip microcontrollers) using a single memory module

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Abstract

내용 없음

Description

데이터 처리 방법과 장치
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명의 관한 데이터 처리장치의 한 실시예를 표시하는 블록도.
제2도는 칩 외부에 위치한 메모리의 억세스 타이밍을 표시하는 타임 챠트.
제3도는 같은 칩에 위치한 메모리의 억세스 타이밍을 표히한 타임 챠트.
제4도는 다른 메모리와 메모리의 억세스 타이밍을 표시하는 타이밍 챠트.

Claims (8)

  1. 같은 칩에서 오퍼랜드 처리를 위한 중앙처이 장치와 오퍼랜드를 기억하는 메모리 장치를 가지고 있는 데이터처리 장치에서 명령에 부합하는 오퍼랜드 처리하기 위한 데이터 처리 시스템을 작동하는 방법이 ; 상기 메모리 장치 혹은 상기 칩 밖에 위치하는 장치에서 또 다른 메모리 장치의 하나를 판독하는 매크로인스트럭션을 기억하고 ; 상기 매크로인스트럭션을 디코딩하고 ; 디코드된 신호에 기반을 둔 상기 중앙처리 장치를 제어하기 위한 명령 출력을 하며 ; 상기 중앙처리 장치를 제어하기 위한 상기 명령에 기반을 둔 상기의 또 다른 메모리 장치에 상기 오퍼랜드가 상기 메모리장치에 기억되어 있는가 어떤가를 식별하고 ; 식별된 결과에 기반을 둔 상기 또다른 메모리에서 상기 오퍼랜드 검색을 위한 첫째 오퍼랜드 검색과 ; 식별된 결과에 기반을 둔 상기 메모리에서 상기 오퍼랜드 검색을 위한 두번째 오퍼랜드 검색과 ; 그리고 상기 오퍼랜드가 상기 또 다른 메모리 장치에 위치한 것이 식별될 때 상기 첫째 오퍼랜드 검색을 실행하고 그리고 상기오퍼랜드가 상기 메모리 장치에 위치하고 있는 것이 식별될 때 사기 두번째 검색을 실시한 후 상기 중앙처리 장치에 의해 작동을 이행하기 위하여 레지스터에 상기 오퍼랜드를 판독하는 것을 특징으로 하는 데이터 처리방법.
  2. 갑은 칩에서 오퍼랜드 처리를 위한 중앙처리 장치와 오퍼랜드를 기억하는 메모리장치를 가지고 있는 데이트 처리 장치에서 명령에 부합하는 오퍼랜드를 처리하기 위한 데이터처리 시스템을 작동하는 방법이 ; 상기 메모리 장치 혹은 상기 칩밖에 위치하는 또 다른 메모리 장치의 하나를 판독하는 매크로인스트럭션을 기억하고 ; 상기 매크로인스트럭션을 디코딩하고 ; 디코드된 신호에 기반을 둔 상기 중앙처리 장치를 제어하기 위한 명령을 출력하고 ; 상기 중앙처리 장치를 제어하는 상기 명령에 각각 기반을 둔 상기 메모리 장치와 상기 또 다른 메모리 장치 둘다에 상기 오퍼랜드가 기억되어 있는지를 식별하고; 식별된 결과에 기반을 둔상기 메모리 장치와 상기 또 다른 메모리장치 둘다에서 연속적으로 오퍼렌드 검색을 실행하며 ; 그리고 상기 중앙처리장치에 의해 작동을 실행하는 것을 위한 레지스터에 상기 오퍼랜드를 판독하는 것을 특징으로 하는 데이터 처리방법.
  3. 같은 칩에 메모리 장치와 명령에 부합하는 오퍼랜드를 처리하기 위한 중앙처리 장치를 가지고 있는 데이터 처리장치는 ; 상기 오퍼랜드가 상기 메모리 장치에 기억되었는가 혹은 상기 칩 밖에 위치한 또 다른 메모리 장치에 기억되어 있는 가를 식별하기 위한 식별 수단과 ; 상기 식별 수단의 식별된 결과를 기초로 한 또 다른 메모리 장치에서 상기 오퍼랜드를 건색하는 것을 위한 첫째 오퍼랜드 검색 수단과 ; 그리고 상기 식별 수단의 식별된 결과를 기초로한 상기 메모리 장치에서 상기 오퍼랜드 검색을 위한 두 번째 오퍼랜드검색 방법과 ; 그곳에서 상기 식별 수단이 상기 오퍼랜드가 상기 칩 밖에 위치해 있다는 것이 식별되었을 때, 상기 식별 수단은 첫째 오퍼랜드 검색 수단을 작동하고 그리고 상기 식별 수단이 상기 오퍼랜드가 상기 칩에 위치하고 있는 것이 식별될때에는 상기 두 번째 오퍼랜드 검색 수단을 작동하고 그리고 상기 또 다른 메모리장치와 상기 메모리장치에 검색된 오퍼랜드는 상기 중앙처리 장치를 판독하는 것을 포함하는 데이터 처리 장치.
  4. 제3항에 있어서, 상기 검색 수단은 상기 오퍼랜드가 상기 또 다른 메모리 장치와 상기 메모리 자치에 각각 위치해 있는가를 검출하기 위한 경계 검출수단을 가지고 있고, 그리고 경계 검출수단이 상기 오퍼랜드가 상기 또 다른 메모리 장치와 상기 메모리 장치에 각각 위치하고 있고 상기 첫째 오퍼랜드 검색 수단과 상기 둘째 오퍼랜드 검색 수단이 상기 또 다른 메모리 장치의 첫째 오퍼랜드 검색과 그리고 상기 중앙처리 장치에 상기 오퍼랜드 판독을 위해 연속적으로 살기 메모리 장치의 두 번째 오퍼랜드 검색을 실행하는 것을 특징으로 하는 데이터 처리장치.
  5. 같은 칩에 메모리 장치와 명령에 부합하는 오퍼랜드를 처리하기 위한 중앙처리 장치를 가지고 있는 데이터 처리 장치가 상기 칩이나 혹은 상기 메모리 장치밖에 위치한 장치에서 또 다른 메모리 장치의 하나를 판독하는 매크로인스트럭션을 기억하기 위한 명령 레지스터와 ; 상기 명령 레지스터에 기억된 상기 매크토은스트럭션을 디코딩하기 위한 마이크로 프로그램 메모리장치와 ; 상기 마이클로푸로그램 메모리 장치에서 명령에 기초를 둔 상기 중앙처리 장치를 제어하는 마이클로 인스트럭션 디코더와 ; 상기 메모리 장치와 상기 칩 밖에 기억된 또 다른 메모리 장치의 어드레스를 기억하기 위한 메모리 어드레스 레지스터에 의해 형성된 상기 오퍼랜드의 위치를 식별하기 위한 식별회로를 포함하는 연산장치와 메모리 어드레스 레지스터와 메모리 베이스 레지스터의 출력 신호가 둘다 일치할 때 그 작동하는 일치 검출회로와 ; 상기 메모리 장치와 상기 또 다른 메모리장치의 판독하는 오퍼랜드를 기억하기 위한 데이터 버스 레지스터와 ; 그리고 연산과 논리장치와 ; 상기 또다른 메모리 장치에서 상기 데이터 비스 레지스터까지 상기 오퍼랜드를 검색하기 위한 그리고 상기 일치 검출회로의 식별된 결과를 기초로 한 상기 또 다른 메모리에서 상기 오퍼랜드를 검색하기위한 외부 메모리 제어기와 ; 그리고 상기 ; 메모리에서 상기 데이터 버스 레지스터까지 상기 오퍼랜드 판독괴 상기 일치 검출회로의 식별결과에 기초를 둔 상기 메모리에서 상기 오퍼랜드를 검색하기 위한 내부 메모리 제어기를 포함하는 데어티 처리 장치.
  6. 제5항에 있어서, 상기 연산장치가 상기 메모리 어드레스 레지스터와 상기 메모리 베이스 레지스터의 출력신호에 기초를 둔 상기 메모리와 상기 또 다른 메모리 장치 둘다를 각각 상기 오퍼랜드가 기억되어 있는가를 검출하는 경계 검출회로를 가지고 있고 그중에서 상기 경계 검출회로의 출력 신호가 상기 데이터버스 레지스터에 상기 오퍼랜드를 판독하고 그리고 계속적으로 상기 메모리 장치와 상기 또 다른 메모리 장치에서 상기 오퍼랜드를 검색하기 위한 상기 내부메모리 제어기와 상기 외부 메모리 제어기로 도입되는 데이터 처리장치.
  7. 제5항에 있어서, 상기 명령 레지스터는 선입선출 버퍼 메모리로 구성된 데이터 처리장치.
  8. 제5항에 있어서, 상기 연산장치는 종종 고속으로 사용되는 상기 메모리를 기억하는 레지스터를 가지고 있는 데이터 처리 장치.
    ※참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019880003268A 1987-03-31 1988-03-25 데이터 처리 방법과 장치 KR920007904B1 (ko)

Applications Claiming Priority (2)

Application Number Priority Date Filing Date Title
JP62-78198 1987-03-31
JP62078198A JPS63245547A (ja) 1987-03-31 1987-03-31 デ−タ処理装置

Publications (2)

Publication Number Publication Date
KR880011669A true KR880011669A (ko) 1988-10-29
KR920007904B1 KR920007904B1 (ko) 1992-09-19

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ID=13655312

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KR1019880003268A KR920007904B1 (ko) 1987-03-31 1988-03-25 데이터 처리 방법과 장치

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JP (1) JPS63245547A (ko)
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US4979103A (en) 1990-12-18
JPS63245547A (ja) 1988-10-12
KR920007904B1 (ko) 1992-09-19

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