KR840006269A - 단일동축도선을통해수신되는데이타비트스트림의동기화장치 - Google Patents
단일동축도선을통해수신되는데이타비트스트림의동기화장치 Download PDFInfo
- Publication number
- KR840006269A KR840006269A KR1019830004672A KR830004672A KR840006269A KR 840006269 A KR840006269 A KR 840006269A KR 1019830004672 A KR1019830004672 A KR 1019830004672A KR 830004672 A KR830004672 A KR 830004672A KR 840006269 A KR840006269 A KR 840006269A
- Authority
- KR
- South Korea
- Prior art keywords
- signal
- value
- binary
- binary signals
- signals
- Prior art date
Links
Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L7/00—Arrangements for synchronising receiver with transmitter
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F13/00—Interconnection of, or transfer of information or other signals between, memories, input/output devices or central processing units
- G06F13/10—Program control for peripheral devices
- G06F13/12—Program control for peripheral devices using hardware independent of the central processor, e.g. channel or peripheral processor
- G06F13/124—Program control for peripheral devices using hardware independent of the central processor, e.g. channel or peripheral processor where hardware is a sequential transfer control unit, e.g. microprocessor, peripheral processor or state-machine
- G06F13/128—Program control for peripheral devices using hardware independent of the central processor, e.g. channel or peripheral processor where hardware is a sequential transfer control unit, e.g. microprocessor, peripheral processor or state-machine for dedicated transfers to a network
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F13/00—Interconnection of, or transfer of information or other signals between, memories, input/output devices or central processing units
- G06F13/38—Information transfer, e.g. on bus
- G06F13/42—Bus transfer protocol, e.g. handshake; Synchronisation
Landscapes
- Engineering & Computer Science (AREA)
- Theoretical Computer Science (AREA)
- Physics & Mathematics (AREA)
- General Engineering & Computer Science (AREA)
- General Physics & Mathematics (AREA)
- Computer Hardware Design (AREA)
- Microelectronics & Electronic Packaging (AREA)
- Computer Networks & Wireless Communication (AREA)
- Signal Processing (AREA)
- Communication Control (AREA)
- Synchronisation In Digital Transmission Systems (AREA)
- Small-Scale Networks (AREA)
Abstract
내용 없음
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 상호 작용식 터미널 데이타 처리 시스템의 블록 다이어그 램.
제2도는 고속 링크 콘크롤러(HSLC)의 블록 다이어그램.
* 도면의 주요부분에 대한 부호의 설명
12 : 고속 링크 콘트롤러(HSLC) 14 : 디바이스 콘트롤러
20 : 주 컴퓨터 72 : 통신 콘트롤러
75 : 데이타 회복 논리회로 75-18 : 비교기
75-14 : 가산기 75-16 : 카운터
Claims (10)
- 데이타 비트 신호의 전송을 위해 단일 도체 동축 버스(12-1,12-2)에 공통으로 결합된 고속 링크 콘트롤러(HSLC)(12)와 다수의 작업대(16-17 내지 16-48)를 포함하고, 상기 HSLC(12)는 상기 데이타 비트 신호를 수신하는 데이타 회복 논리(75)를 포함하며, 상기 데이타 회복 논리(75)는 상기 다수의 작업대중의 하나로부터 수신된 상기 데이타 비트 신호를 동기시키기 위해 동기화 장치를 포함하는 상호 작용식 터미널 시스템에 있어서, 상기 동기화 장치는 연속적인 번호의 반복순서를 나타내는 제1의 다수의 2진수 신호를 발생하기 위한 제1의 수단(75-16)과, 입력단자의 제1세트로 인가되는 제1의 다수의 2진수 신호와 입력단자의 제2세트로 인가되는 제2다수의 2진수 신호를 포함하고 상기 제1 및 제2의 다수의 2진수 신호가 같지 않다는 수치인 제1신호(A>B, A<B)와, 제1의 다수의 2진수 신호가 제2의 다수의 2진수 신호보다 작은 수치를 가질 때 제2신호(A<B)를 발생하는 제2의 수단(75-18)과, 입력단자의 제3세트로 인가되는 제1의 다수의 2진수 신호와 제3의 다수의 2진수 신호를 포함하고, 그중 하나의 신호가 입력단자의 제4세트로 인가되는 제2의 신호가 되고 상기 제1 및 제3의 다수의 2진수의 합을 나타내는 제4의 다수의2진수 신호를 발생하는 제3의 수단(75-14)과, 제3의 신호를 발생키 위한 제1의 신호와 0데이타 비트를 대표하는 데이타 비트 신호에 반응하고, 상기 제1수단(75-16)은 상기 제4의 다수의 2진 신호와 동일한 값을 갖는 제1의 다수의 2진 신호를 발생키 위해 상기 제3의 신호에 반응하고, 거기서 제1의 다수의 2진수 신호가 제2의 다수의 2진수 신호보다 적을 때 상기 제2의 신호의 2진수 값으로 상기 제1의 다수의 2진수 신호의 수치를 증가시키고 또한 제1 및 제2의 다수의 데이타 신호가 동일한 수치에서 상기 0데이타 비트 신호를 수신하기 위하여 상기 제1다수의 2진수 신호가 제2다수의 2진수 신호보다 클 때 상기 제1의 다수의 2진수 신호의 값을 감소시키는 게이팅 수단(76-36)을 포함하고 있는 것을 특징으로 하는 단일 동축도선을 통해 수신되는 데이타 비트 스트림의 동기화 장치.
- 제1항에 있어서, 상기 제1다수의 2진수 신호는 십진수 0에서 15까지의 반복순서를 나타내는 것을 특징으로 하는 단일 동축도선을 통해 수신되는 데이타 비트 스트림의 동기화 장치.
- 제1항에 있어서, 상기 제2다수의 2진수 신호는 십진수 8의 값을 갖는 것을 특징으로 하는 단일 동축도선을 통해 수신되는 데이타 비트 스트림의 동기화 장치.
- 제1항에 있어서, 상기 제3다수의 2진수 신호는 제1다수의 2진수 신호가 십진수 8보다 큰 값을 가릴때 십진수 0의 값을 가지며, 상기 제3다수의 2진수 신호는 제1다수의 2진수 신호가 십진수 8보다 작은값을 가질때 십진수 2의 값을 가지는 것을 특징으로 하는 단일 동축도선을 통해 수신되는 데이타 비트 스트림의 동기화 장치.
- 제1항에 있어서, 상기 제1의 다수의 2진수 신호는 상기 제1의 0데이타 비트가 상기 게이팅 수단(75-36)으로 인가될때 십진수 8보다 작은 값을 가지며, 다수의 2진수 신호가 십진수 8의 값일때 상기 0데이타 비트의 후속비트를 수신할때까지 십진수 1로 증가된 제1의 다수의 2진수 신호의 값을 제2의 제1다수의 2진수 신호가 가지면서 상기 제2의 0데이타 비트가 상기 게이팅 수단(75-36)에 의해 수신될때 십진수 8다 작은 값을 가지는 것을 특징으로 하는 단일 동축도선을 통해 수신되는 데이타 비트 스트림의 동기화 장치.
- 제1항에 있어서, 상기 제3의 다수의 2진수 신호는 상기 제3의 0데이타 비트가 상기 게이팅 수단(75-36)에 의해 수신되고 상기 제4의 0데이타 비트가 상기 게이팅 수단(75-36)에 의해 수신될때 십진수8보다 큰 값을 가지는 것을 특징으로 하는 단일 동축도선을 통해 수신되는 데이타 비트 스트림의 동기화 장치.
- 제6항에 있어서, 상기 제1수단은 카운터(75-16)인 것을 특징으로 하는 단일 동축도선을 통해 수신되는 데이타 비트 스트림의 동기화 장치.
- 제7항에 있어서, 상기 제2수단은 비교기(75-18)인 것을 특징으로 하는 단일 동축도선을 통해 수신되는 데이타 비트 스트림의 동기화 장치.
- 제8항에 있어서, 상기 제3수단은 가산기(75-14)인 것을 특징으로 하는 단일 동축도선을 통해 수신되는 데이타 비트 스트림의 동기화 장치.
- 2진 디지탈 데이타로 표시된 수신신호를 갖는 데이타 입력장치의 클럭유닛을 동기화하며, 상기 클럭유닛이 복수의 수신신호가 존재하는 주파수에서 동작하는 클럭신호 발생기를 포함하는 장치에 있어서 ; 상기 클럭신호를 수신하도록 결합되고 수신된 클럭신호가 순환적으로 카운트하게금 증가되며, 산출된 카운트의 전류 값을 표시하는 제1신호세트(QA-QD)를 전달하고, 제어신호(CTRLD)를 수신하는 입력단자세트에 인가된 제2신호세트에 따른 상기 카운트 값을 설정하기 위한 입력단자세트(A-D)를 갖는 순환카운터(S1-S4)와 ; 상기 제1신호세트를 수신하고 소정의 번호로서 표시된 카운트 값을 비교하며 상기 카운트 값이 상기 번호와 동일할때 제1신호를 전달하고 상기 카운트 값이 상기 번호보다 작을때에 제2신호를 전달하는 비교기(75-18)와 ; 상기 제1신호세트를 수신하고, 상기 제2신호로서 제어될때 소정량을 제1신호세트로 표시된 상기 카운트 값에 추가하며, 발생된 합성값으로 표시된 상기 제2신호세트(51-54)를 형성하도록 상기 카운터에 결합되는 가산기(75-14) 및 ; 수신된 2진 디지탈 데이타 신호의 발생에 대응한 상기 제1신호의 부재에 의해서 상기 제어신호의 발생을 가능하도록 하는 게이트 회로(75-36)를 구비함으로써 상기 제1신호세트의 적어도 하나의 신호가 수신 데이타를 클럭하도록 사용되는 것을 특징으로 하는 데이터 입력장치의 클럭유닛 동기화 장치.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
US431410 | 1982-09-30 | ||
US06/431,410 US4509121A (en) | 1982-09-30 | 1982-09-30 | Apparatus for synchronizing a stream of data bits received over a single coaxial conductor |
Publications (2)
Publication Number | Publication Date |
---|---|
KR840006269A true KR840006269A (ko) | 1984-11-22 |
KR910001404B1 KR910001404B1 (ko) | 1991-03-04 |
Family
ID=23711819
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
KR1019830004672A KR910001404B1 (ko) | 1982-09-30 | 1983-09-30 | 단일동축도선을통해수신되는데이타비트스트림의동기화장치 |
Country Status (5)
Country | Link |
---|---|
US (1) | US4509121A (ko) |
JP (1) | JPS59131242A (ko) |
KR (1) | KR910001404B1 (ko) |
AU (1) | AU574332B2 (ko) |
CA (1) | CA1196405A (ko) |
Families Citing this family (10)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
DE3374964D1 (en) * | 1982-09-29 | 1988-01-28 | Toshiba Kk | Decentralized information processing system and initial program loading method therefor |
US4603385A (en) * | 1983-05-11 | 1986-07-29 | International Business Machines Corp. | Integrated data processing/text processing system having a terminal with dual emulation and enhanced function capabilities |
EP0176975A3 (en) * | 1984-10-04 | 1989-01-18 | Bull HN Information Systems Inc. | Programmable universal synchronization byte dectector |
DE3537477A1 (de) * | 1985-10-22 | 1987-04-23 | Porsche Ag | Anordnung zur individuellen anpassung einer seriellen schnittstelle eines datenverarbeitenden systems an eine datenuebertragungsgeschwindigkeit eines kommunikationspartners |
US4751635A (en) * | 1986-04-16 | 1988-06-14 | Bell Communications Research, Inc. | Distributed management support system for software managers |
US5333301A (en) * | 1990-12-14 | 1994-07-26 | International Business Machines Corporation | Data transfer bus system and method serving multiple parallel asynchronous units |
US5404457A (en) * | 1992-02-14 | 1995-04-04 | Advanced Micro Devices, Inc. | Apparatus for managing system interrupt operations in a computing system |
US5898890A (en) * | 1992-03-27 | 1999-04-27 | Ast Research, Inc. | Method for transferring data between devices by generating a strobe pulse and clamping a clock line |
US5625563A (en) * | 1995-01-09 | 1997-04-29 | Lsi Logic Corporation | Method and system for reducing the number of connections between a plurality of semiconductor devices |
US8570178B2 (en) * | 2007-09-24 | 2013-10-29 | Ppc Broadband, Inc. | Coaxial cable connector with internal floating ground circuitry and method of use thereof |
Family Cites Families (6)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US3680057A (en) * | 1970-11-02 | 1972-07-25 | Honeywell Inf Systems | Data communications subchannel |
US3898373A (en) * | 1971-09-09 | 1975-08-05 | Leo F Walsh | Data communication system |
US3849254A (en) * | 1973-05-31 | 1974-11-19 | Univ Virginia | Process for effecting enzymatic reactions in aerosols |
JPS5733850A (en) * | 1980-08-07 | 1982-02-24 | Matsushita Electric Ind Co Ltd | Non-return-to-zero code receiving device |
US4405979A (en) * | 1980-10-06 | 1983-09-20 | Honeywell Information Systems Inc. | Data processing system having apparatus in a communications subsystem for establishing byte synchronization |
JPS57157658A (en) * | 1981-03-25 | 1982-09-29 | Fujitsu Ltd | Bit sampling controling system |
-
1982
- 1982-09-30 US US06/431,410 patent/US4509121A/en not_active Expired - Fee Related
-
1983
- 1983-08-25 AU AU18415/83A patent/AU574332B2/en not_active Ceased
- 1983-09-29 CA CA000437966A patent/CA1196405A/en not_active Expired
- 1983-09-29 JP JP58181762A patent/JPS59131242A/ja active Granted
- 1983-09-30 KR KR1019830004672A patent/KR910001404B1/ko not_active IP Right Cessation
Also Published As
Publication number | Publication date |
---|---|
JPH0326581B2 (ko) | 1991-04-11 |
JPS59131242A (ja) | 1984-07-28 |
AU574332B2 (en) | 1988-07-07 |
KR910001404B1 (ko) | 1991-03-04 |
AU1841583A (en) | 1984-04-05 |
US4509121A (en) | 1985-04-02 |
CA1196405A (en) | 1985-11-05 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
ES8608755A1 (es) | Un metodo de transmision de datos | |
WO1997013347A3 (en) | Transition-controlled digital encoding and signal transmission system | |
JPS554691A (en) | Tree-type coupled logic circuit | |
KR840006269A (ko) | 단일동축도선을통해수신되는데이타비트스트림의동기화장치 | |
US3308434A (en) | Synchronization circuit for signal generators using comparison of a specific data message | |
US3340514A (en) | Delay line assembler of data characters | |
KR970068365A (ko) | 통신제어장치 및 그것을 사용한 통신시스템 | |
EP0016604A1 (en) | Apparatus for converting successive digital values to analog form | |
US5282210A (en) | Time-division-multiplexed data transmission system | |
US6430198B1 (en) | Apparatus and method of reducing packet length count processing | |
US3805042A (en) | Multiplication of a binary-coded number having an even radix with a factor equal to half the radix | |
JPS62264785A (ja) | 並列処理回路 | |
KR0155718B1 (ko) | 동기 데이타 발생장치 | |
EP0280216A3 (en) | A pattern recognition apparatus using a composite similarity method | |
KR100202943B1 (ko) | 다치논리데이터송신시스템 | |
KR100210394B1 (ko) | 다치논리데이터송신시스템 | |
US5631926A (en) | Apparatus for compressing data by providing a coded message indicative of the data and method of using same | |
JPS5685127A (en) | Digital signal processor | |
JPH02185131A (ja) | カウンタ装置 | |
JP2580641B2 (ja) | ブロック同期回路 | |
SU809145A1 (ru) | Устройство дл сопр жени электрон-НыХ ВычиСлиТЕльНыХ МАшиН | |
JPS60236535A (ja) | 可変フレ−ムパルス方式 | |
JPS51117845A (en) | Electronic computer fault diagnostic equipment | |
EP0649223A1 (en) | Data compression | |
JPS62299133A (ja) | デイジタル信号多重化装置 |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
A201 | Request for examination | ||
G160 | Decision to publish patent application | ||
E701 | Decision to grant or registration of patent right | ||
GRNT | Written decision to grant | ||
FPAY | Annual fee payment |
Payment date: 19940103 Year of fee payment: 4 |
|
LAPS | Lapse due to unpaid annual fee |