KR20220138796A - 션트 레귤레이터 - Google Patents
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Abstract
[과제] 동작시에 큰 전류가 흐르는 회로를 구비하고 있어도, 통상 동작시의 소비 전류를 줄이는 것이 가능한 션트 레귤레이터를 제공한다.
[해결수단] 출력 단자와 접지 단자 사이에 접속되는 콘덴서(112); 출력 단자와 접지 단자 사이에 접속되는 분압 회로 및 출력 트랜지스터(15); 분압 회로의 출력 단자(FB)의 전압과 기준 전압(Vref)에 기초하여 출력 트랜지스터(15)를 제어하는 에러 앰프(12); 비휘발성 메모리(16); 비휘발성 메모리(16)에 데이터의 독출 신호(Vcnt)를 출력하는 메모리 제어 회로(17); 및 출력 단자의 전압이 비휘발성 메모리(16)의 데이터 독출 동작을 허가하는 소정의 전압이 되었음을 검출하여 메모리 제어 회로(17)에 검출 신호(Vdet)를 출력하는 전압 검출 회로(20);를 구비하고, 비휘발성 메모리(16)의 동작 전류는 콘덴서(112)로부터 공급되는 것을 특징으로 한다.
[해결수단] 출력 단자와 접지 단자 사이에 접속되는 콘덴서(112); 출력 단자와 접지 단자 사이에 접속되는 분압 회로 및 출력 트랜지스터(15); 분압 회로의 출력 단자(FB)의 전압과 기준 전압(Vref)에 기초하여 출력 트랜지스터(15)를 제어하는 에러 앰프(12); 비휘발성 메모리(16); 비휘발성 메모리(16)에 데이터의 독출 신호(Vcnt)를 출력하는 메모리 제어 회로(17); 및 출력 단자의 전압이 비휘발성 메모리(16)의 데이터 독출 동작을 허가하는 소정의 전압이 되었음을 검출하여 메모리 제어 회로(17)에 검출 신호(Vdet)를 출력하는 전압 검출 회로(20);를 구비하고, 비휘발성 메모리(16)의 동작 전류는 콘덴서(112)로부터 공급되는 것을 특징으로 한다.
Description
본 발명은 션트 레귤레이터에 관한 것이다.
도 5는 종래의 션트 레귤레이터를 보여주는 회로도이다.
도 5의 션트 레귤레이터는, 기준 전압 회로(101)와, 에러 앰프(error amplifier; 102)와, NMOS 트랜지스터(103)와, 분압 저항(R1, R2)을 구비하고 있다.
션트 레귤레이터는, 전원 전압(Vin)이 입력되면, 외부 저항(110)에 전류가 흐름으로써 발생한 출력 전압(Vout)으로 부하(111)를 구동한다. 저항값(R)의 외부 저항(110)에 흐르는 전류를 Ir, 부하(111)에 흐르는 전류를 Io, 션트 레귤레이터(IC)에 흐르는 전류를 Ic로 하면, 출력 전압(Vout)은 이하의 식으로 표기된다.
Vout=Vin-Ir/R=Vin-(Io+Ic)/R
션트 레귤레이터는, NMOS 트랜지스터(103)가 전류(Ic)를 조정하여 원하는 출력 전압(Vout)을 얻는다. 즉, 션트 레귤레이터는, Ir=Io+Ic이기 때문에, 션트 레귤레이터(IC)에 흐르는 전류(Ic)를 예상하여 전류(Ir)를 결정할 필요가 있다(예를 들어, 특허문헌 1 참조).
그러나 상술한 션트 레귤레이터는, 동작시에 큰 전류가 흐르는 회로(예를 들어 비휘발성 메모리)를 구비하고 있는 경우, 그 회로의 동작 전류도 예상하여 전류(Ir)를 결정할 필요가 있기 때문에, 그 회로가 동작하지 않을 때에 NMOS 트랜지스터(103)가 그만큼 전류를 흘려보낼 필요가 있다. 따라서, 종래의 션트 레귤레이터는, 그 회로가 동작하지 않는 통상 동작시에 큰 전류가 쓸데없이 흐른다는 과제가 있었다.
본 발명은 상기 과제를 감안하여 이루어지며, 동작시에 큰 전류가 흐르는 회로를 구비하고 있어도, 통상 동작시의 소비 전류를 줄일 수 있는 션트 레귤레이터를 제공하는 것을 목적으로 한다.
본 발명의 일 실시형태의 션트 레귤레이터는, 외부 저항을 통해 전원 단자에 접속되는 출력 단자; 상기 출력 단자와 접지 단자 사이에 접속되는 콘덴서; 상기 출력 단자와 상기 접지 단자 사이에 직렬로 접속되는 분압 회로; 상기 출력 단자와 상기 접지 단자 사이에 접속된 출력 트랜지스터; 제1 기준 전압을 출력하는 제1 기준 전압 회로; 상기 분압 회로의 출력 단자의 전압과 상기 제1 기준 전압에 기초하여 상기 출력 트랜지스터를 제어하는 에러 앰프; 비휘발성 메모리; 상기 비휘발성 메모리에 데이터의 독출 신호를 출력하는 메모리 제어 회로; 및 상기 출력 단자의 전압이 상기 비휘발성 메모리의 데이터 독출 동작을 허가하는 소정의 전압이 되었음을 검출하여 상기 메모리 제어 회로에 검출 신호를 출력하는 전압 검출 회로;를 구비하고, 상기 비휘발성 메모리의 동작 전류는 상기 콘덴서로부터 공급되는 것을 특징으로 한다.
본 발명의 션트 레귤레이터에 의하면, 출력 단자에 콘덴서를 마련하고, 출력 전압을 검출하는 전압 검출 회로를 구비하였으므로, 동작시에 큰 전류가 흐르는 회로를 구비하고 있어도, 통상 동작시의 소비 전류를 줄이는 것이 가능해진다.
도 1은 본 실시형태의 션트 레귤레이터를 보여주는 블록도이다.
도 2는 본 실시형태의 전압 검출 회로의 일 예를 보여주는 회로도이다.
도 3은 본 실시형태의 전압 검출 회로의 다른 예를 보여주는 회로도이다.
도 4는 본 실시형태의 전압 검출 회로의 다른 예를 보여주는 회로도이다.
도 5는 종래의 션트 레귤레이터를 보여주는 블록도이다.
도 2는 본 실시형태의 전압 검출 회로의 일 예를 보여주는 회로도이다.
도 3은 본 실시형태의 전압 검출 회로의 다른 예를 보여주는 회로도이다.
도 4는 본 실시형태의 전압 검출 회로의 다른 예를 보여주는 회로도이다.
도 5는 종래의 션트 레귤레이터를 보여주는 블록도이다.
이하, 본 발명의 션트 레귤레이터에 대해, 도면을 참조하여 설명한다.
도 1은 본 실시형태의 션트 레귤레이터(100)를 보여주는 블록도이다.
션트 레귤레이터(100)는, 예로서, 데이터 독출시에 큰 전류가 흐르는 비휘발성 메모리를 구비하고 있다. 그리고, 외부 저항이 흘려보내는 전류는 비휘발성 메모리의 동작 전류를 고려하지 않은 양으로 설정되어 있다.
도 1의 션트 레귤레이터(100)는, 기준 전압 회로(11)와, 에러 앰프(12)와, 분압 회로를 구성하는 저항(13, 14)과, 출력 트랜지스터인 NMOS 트랜지스터(15)와, 비휘발성 메모리(16)와, 메모리 제어 회로(17)와, 전압 검출 회로(20)와, 외부 저항(110) 및 콘덴서(112)를 구비하고 있다.
저항(13, 14)은 출력 단자와 접지 단자 사이에 직렬로 접속되어 있다. 에러 앰프(12)는, 반전 입력 단자(-)에 기준 전압 회로(11)의 출력 단자가 접속되며, 비반전 입력 단자(+)에 분압 회로의 출력 단자(FB)(저항(13)과 저항(14)의 접속점)가 접속되고, 출력 단자가 NMOS 트랜지스터(15)의 게이트에 접속되어 있다. 전압 검출 회로(20)는, 입력 단자가 션트 레귤레이터(100)의 출력 단자에 접속되며, 출력 단자가 메모리 제어 회로(17)의 입력 단자에 접속되어 있다. 메모리 제어 회로(17)의 출력 단자는 비휘발성 메모리(16)의 입력 단자에 접속되어 있다. 비휘발성 메모리(16)의 출력 단자는, 예를 들어, 분압 회로의 제어 단자나 기준 전압 회로(11)의 제어 단자에 접속되어 있다. 콘덴서(112)는 션트 레귤레이터(100)의 출력 단자와 접지 단자 사이에 접속되어 있다. 외부 저항(110)은, 전원 전압(Vin)이 입력되는 전원 단자와 션트 레귤레이터(100)의 출력 단자 사이에 접속되어 있다. 부하(111)는 션트 레귤레이터(100)의 출력 단자와 접지 단자 사이에 접속되어 있다.
비휘발성 메모리(16)는, 션트 레귤레이터(100)의 회로 파라미터의 데이터, 예를 들어 기준 전압 회로(11)나 분압 회로의 조정용 데이터가 저장되어 있다. 비휘발성 메모리(16)는, 데이터의 독출이 가능한 전압의 범위가 있기 때문에, 독출 최저 전압 이하에서 독출한 데이터는 보장되지 않는다. 메모리 제어 회로(17)는, 전압 검출 회로(20)의 검출 신호(Vdet)에 따라, 비휘발성 메모리(16)의 데이터를 독출하는 제어 신호(Vcnt)를 출력한다. 전압 검출 회로(20)는, 션트 레귤레이터(100)의 출력 전압(Vout)이 비휘발성 메모리(16)의 동작을 허가하는 소정의 전압이 되었음을 검출하여, 검출 신호(Vdet)를 출력한다.
도 2는 본 실시형태의 전압 검출 회로(20)의 일 예를 보여주는 회로도이다.
전압 검출 회로(20)는, 분압 회로를 구성하는 저항(21, 22)과, 기준 전압 회로(23)와, 컴퍼레이터(comparator; 24)를 구비하고 있다.
저항(21, 22)은 출력 단자와 접지 단자 사이에 접속된다. 컴퍼레이터(24)는, 비반전 입력 단자(+)에 분압 회로의 출력 단자(FB2)(저항(21, 22)의 접속점)가 접속되며, 반전 입력 단자(-)에 기준 전압 회로(23)의 출력 단자가 접속되며, 출력 단자로부터 검출 신호(Vdet)를 출력한다.
상술한 바와 같이 구성된 션트 레귤레이터(100)는 이하와 같이 동작한다.
전원 전압(Vin)이 입력되면, 외부 저항(110)에 전류가 흘러 출력 단자에 출력 전압(Vout)을 출력한다. 출력 전압(Vout)은 출력 단자에 접속된 콘덴서(112)에 전하(電荷)가 충전됨으로써 서서히 상승한다. 따라서, 전압 검출 회로(20)의 분압 회로의 출력 단자(FB2)의 전압도 서서히 상승한다. 컴퍼레이터(24)는, 비반전 입력 단자(+)에 입력되는 출력 단자(FB2)의 전압이 기준 전압 회로(23)의 기준 전압(Vref1) 이상이 되면 Hi 레벨의 검출 신호(Vdet)를 출력한다.
메모리 제어 회로(17)는, 입력 단자에 전압 검출 회로(20)의 출력 단자로부터 Hi 레벨의 검출 신호(Vdet)가 입력되면 래치(latch)하여, 출력 단자로부터 비휘발성 메모리(16)의 입력 단자에 Hi 레벨의 제어 신호(Vcnt)를 출력한다. 비휘발성 메모리(16)는, Hi 레벨의 제어 신호(Vcnt)가 입력되면, 데이터의 독출을 개시한다.
비휘발성 메모리(16)의 데이터 독출 동작에는 큰 전류를 필요로 하는데, 그 전류는 콘덴서(112)에 축적된 전하로부터 공급된다. 이 때문에, 콘덴서(112)의 전압, 즉 출력 단자의 출력 전압(Vout)은, 비휘발성 메모리(16)의 데이터 독출 동작에 따라 서서히 저하된다. 여기서, 기준 전압(Vref1)은, 비휘발성 메모리(16)의 데이터 독출 동작이 종료될 때까지 출력 전압(Vout)이 독출 최저 전압을 밑돌지 않는 전압으로 설정되어 있다. 그리고, 비휘발성 메모리(16)의 데이터 독출 동작이 종료되면, 콘덴서(112)의 전압과 함께 출력 단자의 출력 전압(Vout)은 서서히 상승하여, 통상적인 동작 상태로 이행한다. 또한, 메모리 제어 회로(17)는, 전압 검출 회로(20)의 검출 신호(Vdet)의 래치를 해제하여 다시 검출 신호(Vdet)를 받아도, 제어 신호(Vcnt)를 출력하지 않도록 구성된다.
이상 설명한 바와 같이, 본 실시형태의 션트 레귤레이터(100)는, 전압 검출 회로(20)가 출력 단자의 출력 전압(Vout)이 비휘발성 메모리(16)의 데이터 독출 동작에 필요한 전압에 도달하였음을 검출하여, 데이터 독출 동작에 필요한 전류를 콘덴서(112)가 공급하는 구성으로 하였기 때문에, 통상 동작시의 소비 전류를 줄일 수 있다.
도 3은 본 실시형태의 전압 검출 회로(20)의 다른 예를 보여주는 회로도이다.
전압 검출 회로(20)는, 분압 회로를 구성하는 저항(21, 22)과, 상한 전압 검출 회로를 구성하는 기준 전압 회로(23) 및 컴퍼레이터(24)와, 하한 전압 검출 회로를 구성하는 기준 전압 회로(25) 및 컴퍼레이터(26)와, SR 래치 회로(27)를 구비하고 있다.
저항(21, 22)은 출력 단자와 접지 단자 사이에 접속된다. 컴퍼레이터(24)는, 비반전 입력 단자(+)에 분압 회로의 출력 단자(FB2)(저항(21, 22)의 접속점)가 접속되며, 반전 입력 단자(-)에 기준 전압 회로(23)의 출력 단자가 접속되며, 출력 단자로부터 상한 검출 신호를 출력한다. 컴퍼레이터(26)는, 반전 입력 단자(-)에 분압 회로의 출력 단자(FB2)(저항(21, 22)의 접속점)가 접속되며, 비반전 입력 단자(+)에 기준 전압 회로(25)의 출력 단자가 접속되며, 출력 단자로부터 하한 검출 신호를 출력한다. SR 래치 회로(27)는, 세트 단자(S)에 컴퍼레이터(24)의 출력 단자가 접속되며, 리셋 단자(R)에 컴퍼레이터(26)의 출력 단자가 접속되며, 출력 단자(Q)로부터 검출 신호(Vdet)를 출력한다.
상술한 바와 같이 구성된 션트 레귤레이터(100)는 이하와 같이 동작한다.
전원 전압(Vin)이 입력되면, 외부 저항(110)에 전류가 흘러 출력 단자에 출력 전압(Vout)을 출력한다. 출력 전압(Vout)은, 출력 단자에 접속된 콘덴서(112)에 전하가 충전됨으로써 서서히 상승한다. 따라서, 전압 검출 회로(20)의 분압 회로의 출력 단자(FB2)의 전압도 서서히 상승한다. 컴퍼레이터(24)는, 비반전 입력 단자(+)에 입력되는 출력 단자(FB2)의 전압이 기준 전압 회로(23)의 기준 전압(Vref1) 이상이 되면 Hi 레벨의 상한 검출 신호를 출력한다.
SR 래치 회로(27)는, 세트 단자(S)에 Hi 레벨의 상한 검출 신호가 입력되면 출력 단자(Q)로부터 Hi 레벨의 검출 신호(Vdet)를 출력한다. 메모리 제어 회로(17)는, 입력 단자에 전압 검출 회로(20)의 출력 단자로부터 Hi 레벨의 검출 신호(Vdet)가 입력되면, 출력 단자로부터 비휘발성 메모리(16)의 입력 단자에 Hi 레벨의 제어 신호(Vcnt)를 출력한다. 비휘발성 메모리(16)는, Hi 레벨의 제어 신호(Vcnt)가 입력되면, 데이터의 독출을 개시한다.
도 3의 전압 검출 회로(20)는 컴퍼레이터(26)와 기준 전압 회로(25)를 구비하고 있다. 기준 전압 회로(25)는, 출력 단자의 출력 전압(Vout)이 비휘발성 메모리(16)의 독출 최저 전압을 밑돌지 않는 전압으로 설정되어 있다. 따라서, 컴퍼레이터(26)는, 분압 회로의 출력 단자(FB2)의 전압이 기준 전압(Vref2)을 밑돌면, 출력 단자로부터 Hi 레벨의 하한 검출 신호를 출력한다.
SR 래치 회로(27)는, 리셋 단자(R)에 Hi 레벨의 하한 검출 신호가 입력되면 출력 단자(Q)로부터 Lo 레벨의 검출 신호(Vdet)를 출력한다. 메모리 제어 회로(17)는, 입력 단자에 전압 검출 회로(20)의 출력 단자로부터 Lo 레벨의 검출 신호(Vdet)가 입력되면, 비휘발성 메모리(16)에의 Hi 레벨의 제어 신호(Vcnt)의 출력을 정지한다. 따라서, 비휘발성 메모리(16)는 데이터의 독출을 정지한다. 여기서, 메모리 제어 회로(17)는, 도 3의 전압 검출 회로(20)가 하한 검출 신호에 기초하여 Lo 레벨의 검출 신호(Vdet)를 출력하기 때문에, 래치하는 기능은 구비하지 않아도 된다.
데이터의 독출을 정지하면 출력 단자의 출력 전압(Vout)이 상승하고, 컴퍼레이터(24)는, 비반전 입력 단자(+)에 입력되는 출력 단자(FB2)의 전압이 기준 전압 회로(23)의 기준 전압(Vref1) 이상이 되면 Hi 레벨의 상한 검출 신호를 출력한다. 따라서, 비휘발성 메모리(16)는 데이터의 독출을 재개한다.
도 3의 전압 검출 회로(20)는, 상기한 동작을 반복함으로써, 출력 단자의 출력 전압(Vout)이 비휘발성 메모리(16)의 독출 최저 전압을 밑돌지 않는 전압 범위에서 독출 동작을 하는 것이 가능해진다. 따라서, 도 3의 전압 검출 회로(20)를 구비한 션트 레귤레이터(100)는, 비휘발성 메모리(16)의 독출 동작 중의 출력 단자의 출력 전압(Vout)의 변동 등 예기치 못한 상태에도 대응하는 것이 가능하다.
이상, 본 발명의 실시형태에 대해 설명하였지만, 본 발명은 상기 실시형태에 한정되지 않고, 본 발명의 취지를 벗어나지 않는 범위에서 여러 가지 변경이 가능하다. 동작시에 큰 전류가 흐르는 회로로서 비휘발성 메모리를 예로 설명하였지만, 상시 동작하지 않는 회로이면 이에 한정되지 않는다. 또한, 예를 들어, 도 2에 도시된 전압 검출 회로(20)는, 도 4에 도시된 바와 같은 정전류 회로(28)와 NMOS 트랜지스터(29)로 구성한 전류 비교 회로로 구성해도 된다. 이 회로는 도 3에 도시된 전압 검출 회로(20)에도 적용할 수 있다. 또한, 예를 들어, 도 3에 도시된 전압 검출 회로(20)는, SR 래치 회로에 상한 검출 신호와 하한 검출 신호를 출력할 수 있으면 되기 때문에, 기준 전압 회로를 공통으로 하고, 분압 회로의 출력 단자를 2개 마련하여 구성해도 된다. 또한, 기능을 만족하면 SR 래치 회로에 한정되지 않는다. 또한, 예를 들어, 전압 검출 회로(20)의 상한 검출 신호와 하한 검출 신호는, Hi 레벨의 검출 신호라고 설명하였지만, 논리는 자유롭게 설계하는 것이 가능하다.
11, 23, 25 기준 전압 회로
12 에러 앰프
13, 14, 21, 22 저항
15, 29 NMOS 트랜지스터
16 비휘발성 메모리
17 메모리 제어 회로
20 전압 검출 회로
24, 26 컴퍼레이터
27 SR 래치 회로
28 정전류 회로
100 션트 레귤레이터
110 외부 저항
111 부하
112 콘덴서
12 에러 앰프
13, 14, 21, 22 저항
15, 29 NMOS 트랜지스터
16 비휘발성 메모리
17 메모리 제어 회로
20 전압 검출 회로
24, 26 컴퍼레이터
27 SR 래치 회로
28 정전류 회로
100 션트 레귤레이터
110 외부 저항
111 부하
112 콘덴서
Claims (7)
- 외부 저항을 통해 전원 단자에 접속되는 출력 단자;
상기 출력 단자와 접지 단자 사이에 접속되는 콘덴서;
상기 출력 단자와 상기 접지 단자 사이에 직렬로 접속되는 분압 회로;
상기 출력 단자와 상기 접지 단자 사이에 접속된 출력 트랜지스터;
제1 기준 전압을 출력하는 제1 기준 전압 회로;
상기 분압 회로의 출력 단자의 전압과 상기 제1 기준 전압에 기초하여 상기 출력 트랜지스터를 제어하는 에러 앰프;
비휘발성 메모리;
상기 비휘발성 메모리에 데이터의 독출 신호를 출력하는 메모리 제어 회로; 및
상기 출력 단자의 전압이 상기 비휘발성 메모리의 데이터 독출 동작을 허가하는 소정의 전압이 되었음을 검출하여 상기 메모리 제어 회로에 검출 신호를 출력하는 전압 검출 회로;를 구비하고,
상기 비휘발성 메모리의 동작 전류는 상기 콘덴서로부터 공급되는 것을 특징으로 하는, 션트 레귤레이터. - 청구항 1에 있어서,
상기 전압 검출 회로는,
상기 출력 단자와 상기 접지 단자 사이에 직렬로 접속되는 제2 분압 회로;
제2 기준 전압을 출력하는 제2 기준 전압 회로; 및
상기 제2 분압 회로의 출력 단자의 전압과 상기 제2 기준 전압에 기초하여 상기 검출 신호를 출력하는 제1 컴퍼레이터;를 구비한 것을 특징으로 하는, 션트 레귤레이터. - 청구항 1에 있어서,
상기 전압 검출 회로는,
상기 출력 단자와 상기 접지 단자 사이에 직렬로 접속되는 제2 분압 회로;
한쪽의 단자가 상기 출력 단자에 접속된 정전류 회로; 및
상기 제2 분압 회로의 출력 단자가 게이트에 접속되며, 상기 정전류 회로의 다른 쪽의 단자가 드레인에 접속되며, 접지 단자가 소스에 접속된 NMOS 트랜지스터;를 구비한 것을 특징으로 하는, 션트 레귤레이터. - 청구항 1에 있어서,
상기 전압 검출 회로는,
상기 출력 단자와 상기 접지 단자 사이에 직렬로 접속되는 제2 분압 회로;
제2 기준 전압을 출력하는 제2 기준 전압 회로;
상기 제2 분압 회로의 출력 단자의 전압과 상기 제2 기준 전압에 기초하여 상한 검출 신호를 출력하는 제1 컴퍼레이터;
제3 기준 전압을 출력하는 제3 기준 전압 회로; 및
상기 제2 분압 회로의 출력 단자의 전압과 상기 제3 기준 전압에 기초하여 하한 검출 신호를 출력하는 제2 컴퍼레이터;를 구비하고,
상기 상한 검출 신호 및 상기 하한 검출 신호에 기초하여 상기 검출 신호를 출력하는 것을 특징으로 하는, 션트 레귤레이터. - 청구항 1에 있어서,
상기 전압 검출 회로는,
상기 출력 단자와 상기 접지 단자 사이에 직렬로 접속되는 제2 분압 회로;
제2 기준 전압을 출력하는 제2 기준 전압 회로;
상기 제2 분압 회로의 제1 출력 단자의 전압과 상기 제2 기준 전압에 기초하여 상한 검출 신호를 출력하는 제1 컴퍼레이터; 및
상기 제2 분압 회로의 제2 출력 단자의 전압과 상기 제2 기준 전압에 기초하여 하한 검출 신호를 출력하는 제2 컴퍼레이터;를 구비하고,
상기 상한 검출 신호 및 상기 하한 검출 신호에 기초하여 상기 검출 신호를 출력하는 것을 특징으로 하는, 션트 레귤레이터. - 청구항 4 또는 청구항 5에 있어서,
상기 전압 검출 회로는,
상기 상한 검출 신호가 세트 단자에 입력되며, 상기 하한 검출 신호가 리셋 단자에 입력되며, 출력 단자로부터 상기 검출 신호를 출력하는 래치 회로를 구비한 것을 특징으로 하는, 션트 레귤레이터. - 외부 저항을 통해 전원 단자에 접속되는 출력 단자;
상기 출력 단자와 접지 단자 사이에 접속되는 콘덴서;
상기 출력 단자와 상기 접지 단자 사이에 직렬로 접속되는 분압 회로;
상기 출력 단자와 상기 접지 단자 사이에 접속된 출력 트랜지스터;
제1 기준 전압을 출력하는 제1 기준 전압 회로;
상기 분압 회로의 출력 단자의 전압과 상기 제1 기준 전압에 기초하여 상기 출력 트랜지스터를 제어하는 에러 앰프;
동작시에 큰 전류가 흐르는 회로; 및
상기 출력 단자의 전압이 상기 동작시에 큰 전류가 흐르는 회로의 동작을 허가하는 소정의 전압이 되었음을 검출하여 그 회로에 동작 허가 신호를 출력하는 전압 검출 회로;를 구비하고,
상기 동작시에 큰 전류가 흐르는 회로의 동작 전류는 상기 콘덴서로부터 공급되는 것을 특징으로 하는, 션트 레귤레이터.
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