KR20220096871A - 표시 장치 및 이의 구동 방법 - Google Patents

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Abstract

본 발명의 일 실시예에 따른 표시 장치는 복수의 표시 영역으로 구분되는 표시 패널, 복수의 표시 영역 각각에 배치된 복수의 화소에 데이터 전압을 공급하는 데이터 구동부 및 데이터 구동부에 구동 전류를 제어하기 위한 파워 제어 신호를 출력하는 타이밍 제어부를 포함하고, 복수의 표시 영역 각각은 복수의 표시 영역 각각에 배치된 복수의 화소 열 중 중앙부에 위치한 복수의 화소 열이 배치되는 중앙 표시 영역 및 복수의 표시 영역 각각에 배치된 복수의 화소 열 중 외측부에 위치한 복수의 화소 열이 배치되는 엣지 표시 영역으로 구분되고, 데이터 구동부는 복수의 표시 영역 각각에 데이터 전압을 공급하는 복수의 소스 구동 집적 회로를 포함하고, 타이밍 제어부는, 복수의 표시 영역 각각에 배치된 인접 화소 행 끼리의 최대 데이터 전환 값인 비교 데이터와 복수의 엣지 표시 영역에 배치된 인접 화소 행 끼리의 최대 데이터 전환 값인 엣지 비교 데이터의 차이 값에 따라 파워 제어 신호를 생성하여, 표시 영역 경계의 화상 품질을 향상시킬 수 있다.

Description

표시 장치 및 이의 구동 방법{DISPLAY DEVICE AND DRIVING METHOD THREROF}
본 발명은 표시 장치 및 이의 구동 방법에 관한 것으로서, 보다 상세하게는 구동 전류를 제어할 수 있는 표시 장치에 관한 것이다.
컴퓨터의 모니터나 TV, 핸드폰 등에 사용되는 표시 장치에는 스스로 광을 발광하는 유기 발광 표시 장치(Organic Light Emitting Display; OLED) 등과 별도의 광원을 필요로 하는 액정 표시 장치(Liquid Crystal Display; LCD) 등이 있다.
이러한 다양한 표시 장치 중 유기 발광 표시 장치는 복수의 서브 화소를 포함하는 표시 패널과 표시 패널을 구동하는 구동부를 포함한다. 구동부는 표시 패널에 게이트 전압을 공급하는 게이트 구동부 및 데이터 전압을 공급하는 데이터 구동부를 포함한다. 유기 발광 표시 장치의 서브 화소에 게이트 전압 및 데이터 전압이 등의 신호가 공급되면, 선택된 서브 화소가 발광함으로써 영상을 표시할 수 있다.
데이터 구동부는 복수의 소스 구동 집적 회로(Source Driving Integrated Circuit; SDIC)를 포함하고, 복수의 소스 구동 집적 회로(SDIC) 각각은 복수의 표시 영역 각각에 데이터 전압을 공급한다.
그리고, 데이터 전환(Data Transition)이 잦은 소스 구동 집적 회로(SDIC)가 제어하는 표시 영역과 데이터 전환(Data Transition)이 없는 소스 구동 집적 회로(SDIC)가 제어하는 표시 영역의 경계 부분에서, 동일 계조를 표현하는 데이터 전압이 인가되더라도 소스 구동 집적 회로(SDIC) 간의 구동 전류의 차이로 인해, 블락 딤(Block Dim)과 같은 불량이 초래될 수 있다.
본 발명이 해결하고자 하는 과제는 복수의 표시 영역 사이의 블락 딤(Block Dim) 불량을 최소화 시킬 수 있는 표시 장치 및 이의 구동 방법을 제공하는 것이다.
본 발명이 해결하고자 하는 다른 과제는 구동 전류를 조정하여 소비 전력을 저감할 수 있는 표시 장치 및 이의 구동 방법을 제공하는 것이다.
본 발명의 과제들은 이상에서 언급한 과제들로 제한되지 않으며, 언급되지 않은 또 다른 과제들은 아래의 기재로부터 당업자에게 명확하게 이해될 수 있을 것이다.
전술한 바와 같은 과제를 해결하기 위하여 본 발명의 일 실시예에 따른 표시 장치는 복수의 표시 영역으로 구분되는 표시 패널, 복수의 표시 영역 각각에 배치된 복수의 화소에 데이터 전압을 공급하는 데이터 구동부 및 데이터 구동부에 구동 전류를 제어하기 위한 파워 제어 신호를 출력하는 타이밍 제어부를 포함하고, 복수의 표시 영역 각각은 복수의 표시 영역 각각에 배치된 복수의 화소 열 중 중앙부에 위치한 복수의 화소 열이 배치되는 중앙 표시 영역 및 복수의 표시 영역 각각에 배치된 복수의 화소 열 중 외측부에 위치한 복수의 화소 열이 배치되는 엣지 표시 영역으로 구분되고, 데이터 구동부는 복수의 표시 영역 각각에 데이터 전압을 공급하는 복수의 소스 구동 집적 회로를 포함하고, 타이밍 제어부는, 복수의 표시 영역 각각에 배치된 인접 화소 행 끼리의 최대 데이터 전환 값인 비교 데이터와 복수의 엣지 표시 영역에 배치된 인접 화소 행 끼리의 최대 데이터 전환 값인 엣지 비교 데이터의 차이 값에 따라 파워 제어 신호를 생성하여, 표시 영역 경계의 화상 품질을 향상시킬 수 있다.
본 발명의 일 실시예에 따른 표시 장치의 구동 방법은 비디오 데이터를 1 수평 기간만큼 지연시켜, 지연된 비디오 데이터를 출력하는 데이터 지연 단계, 비디오 데이터와 지연된 비디오 데이터를 비교하여, 비교 데이터와 엣지 비교 데이터를 생성하는 데이터 비교 단계, 교 데이터를 제1 LUT(1st Look-Up Table)에 적용하여, 제1 기준 값을 설정하는 제1 기준 값 설정 단계, 엣지 비교 데이터를 제2 LUT(2nd Look-Up Table)에 적용하여, 제2 기준 값을 설정하는 제2 기준 값 설정 단계, 해당 표시 영역에 대응하는 제1 기준 값과 해당 표시 영역에 인접하는 엣지 표시 영역에 대응하는 제2 기준 값의 차이 값을 제3 LUT(3rd Look-Up Table)에 적용하여, 보상 값을 설정하는 보상 값 도출 단계 및 해당 표시 영역에 대응하는 제1 기준 값에 보상 값을 더하여, 파워 제어 신호로 출력하는 파워 제어 신호 출력 단계를 포함할 수 있다.
기타 실시예의 구체적인 사항들은 상세한 설명 및 도면들에 포함되어 있다.
본 발명에서 복수의 표시 영역에 동일 계조를 표현하는 데이터 전압이 인가될 때, 경계 영역에서 블락 딤(Block Dim)과 같은 불량을 방지할 수 있다.
본 발명에서 표시 영역 마다 최적의 구동 전력을 결정할 수 있으므로, 표시 장치의 소비 전력은 최적화될 수 있다.
본 발명에 따른 효과는 이상에서 예시된 내용에 의해 제한되지 않으며, 더욱 다양한 효과들이 본 발명 내에 포함되어 있다.
도 1은 본 발명의 일 실시예에 따른 표시 장치의 개략도이다.
도 2는 본 발명의 일 실시예에 따른 표시 장치의 복수의 표시 영역을 설명하기 위한 도면이다.
도 3은 본 발명의 일 실시예에 따른 표시 장치의 타이밍 제어부를 설명하기 위한 도면이다.
도 4는 본 발명의 일 실시예에 따른 표시 장치의 서브 데이터 인에이블 신호 및 엣지 데이터 인에이블 신호를 나타내는 파형도이다.
도 5는 본 발명의 일 실시예에 따른 표시 장치의 파워 제어 신호 생성부의 LUT(Look-Up Table)을 나타내는 도면이다.
도 6은 본 발명의 일 실시예에 따른 표시 장치의 소스 구동 집적 회로를 설명하기 위한 도면이다.
도 7은 본 발명의 일 실시예에 따른 표시 장치의 파워 제어 회로 및 버퍼를 설명하기 위한 회로도이다.
도 8은 본 발명의 일 실시예에 따른 표시 장치의 구동 방법을 설명하기 위한 흐름도이다.
본 발명의 이점 및 특징, 그리고, 그것들을 달성하는 방법은 첨부되는 도면과 함께 상세하게 후술되어 있는 실시예들을 참조하면 명확해질 것이다. 그러나, 본 발명은 이하에서 개시되는 실시예들에 제한되는 것이 아니라 서로 다른 다양한 형상으로 구현될 것이며, 단지 본 실시예들은 본 발명의 개시가 완전하도록 하며, 본 발명이 속하는 기술 분야에서 통상의 지식을 가진 자에게 발명의 범주를 완전하게 알려주기 위해 제공되는 것이며, 본 발명은 청구항의 범주에 의해 정의될 뿐이다.
본 발명의 실시예를 설명하기 위한 도면에 개시된 형상, 면적, 비율, 각도, 개수 등은 예시적인 것이므로 본 발명이 도시된 사항에 제한되는 것은 아니다. 명세서 전체에 걸쳐 동일 참조 부호는 동일 구성 요소를 지칭한다. 또한, 본 발명을 설명함에 있어서, 관련된 공지 기술에 대한 구체적인 설명이 본 발명의 요지를 불필요하게 흐릴 수 있다고 판단되는 경우 그 상세한 설명은 생략한다. 본 발명 상에서 언급된 '포함한다', '갖는다', '이루어진다' 등이 사용되는 경우 '~만'이 사용되지 않는 이상 다른 부분이 추가될 수 있다. 구성 요소를 단수로 표현한 경우에 특별히 명시적인 기재 사항이 없는 한 복수를 포함하는 경우를 포함한다.
구성 요소를 해석함에 있어서, 별도의 명시적 기재가 없더라도 오차 범위를 포함하는 것으로 해석한다.
위치 관계에 대한 설명일 경우, 예를 들어, '~상에', '~상부에', '~하부에', '~옆에' 등으로 두 부분의 위치 관계가 설명되는 경우, '바로' 또는 '직접'이 사용되지 않는 이상 두 부분 사이에 하나 이상의 다른 부분이 위치할 수도 있다.
소자 또는 층이 다른 소자 또는 층 "위 (on)"로 지칭되는 것은 다른 소자 바로 위에 또는 중간에 다른 층 또는 다른 소자를 개재한 경우를 모두 포함한다.
또한 제 1, 제 2 등이 다양한 구성 요소들을 서술하기 위해서 사용되나, 이들 구성 요소들은 이들 용어에 의해 제한되지 않는다. 이들 용어들은 단지 하나의 구성 요소를 다른 구성 요소와 구별하기 위하여 사용하는 것이다. 따라서, 이하에서 언급되는 제 1 구성 요소는 본 발명의 기술적 사상 내에서 제 2 구성 요소일 수도 있다.
명세서 전체에 걸쳐 동일 참조 부호는 동일 구성 요소를 지칭한다.
도면에서 나타난 각 구성의 면적 및 두께는 설명의 편의를 위해 도시된 것이며, 본 발명이 도시된 구성의 면적 및 두께에 반드시 한정되는 것은 아니다.
본 발명의 여러 실시예들의 각각 특징들이 부분적으로 또는 전체적으로 서로 결합 또는 조합 가능하고, 기술적으로 다양한 연동 및 구동이 가능하며, 각 실시예들이 서로에 대하여 독립적으로 실시 가능할 수도 있고 연관 관계로 함께 실시할 수도 있다.
이하에서는 첨부된 도면을 참조하여 본 발명의 다양한 실시예들을 상세히 설명한다.
도 1은 본 발명의 일 실시예에 따른 표시 장치의 개략도이다. 도 1을 참조하면, 표시 장치(100)는 표시 패널(110), 게이트 구동부(120), 데이터 구동부(130) 및 타이밍 제어부(140)를 포함한다.
표시 패널(110)은 영상을 표시하기 위한 패널이다. 표시 패널(110)은 기판 상에 배치된 다양한 회로, 배선 및 발광 소자를 포함할 수 있다. 표시 패널(110)은 상호 교차하는 복수의 데이터 배선(DL) 및 복수의 게이트 배선(GL)에 의해 구분되며, 복수의 데이터 배선(DL) 및 복수의 게이트 배선(GL)에 연결된 복수의 화소(PX)을 포함할 수 있다.
표시 패널(110)은 복수의 화소(PX)에 의해 정의되는 복수의 표시 영역(AA)과 각종 신호 배선들이나 패드 등이 형성되는 비표시 영역(NA)을 포함할 수 있다. 그리고, 복수의 표시 영역(AA)은 제1 표시 영역(AA1) 내지 제m 표시 영역(AA(m))으로 구분될 수 있다.
복수의 화소(PX) 각각은 복수의 서브 화소를 포함할 수 있다. 복수의 서브 화소는 서로 다른 색을 발광하기 위한 서브 화소일 수 있다. 예를 들어, 복수의 서브 화소는 각각 적색 서브 화소, 녹색 서브 화소 및 청색 서브 화소일 수 있으나, 이에 제한되는 것은 아니다. 이러한 복수의 서브 화소는 화소(PX)을 구성할 수 있다. 즉, 적색 서브 화소, 녹색 서브 화소 및 청색 서브 화소는 하나의 화소(PX)을 구성할 수 있고, 표시 패널(110)은 복수의 화소(PX)을 포함할 수 있다.
표시 패널(110)은 액정 표시 장치, 유기 발광 표시 장치, 전기 영동 표시 장치 등과 같은 다양한 표시 장치에서 사용되는 표시 패널(110)로 구현될 수 있다.
타이밍 제어부(140)는 호스트 시스템에 연결된 LVDS 또는 TMDS 인터페이스 등의 수신 회로를 통해 수직 동기 신호(Vertical Sync signal; Vsync), 수평 동기 신호(Horizontal Sync signal; Hsync), 데이터 인에이블 신호(Data Enable signal; DE), 데이터 클럭 신호(Data Clock signal; DCLK) 등의 타이밍 신호를 입력 받는다. 타이밍 제어부(140)는 입력된 타이밍 신호를 기준으로 데이터 구동부(130)와 게이트 구동부(120)를 제어하기 위한 제어 신호(DCS, GCS)들을 발생시킨다.
예를 들어, 타이밍 제어부(140)는 게이트 구동부(120)를 제어하기 위하여, 게이트 스타트 펄스(Gate Start Pulse), 게이트 쉬프트 클럭(Gate Shift Clock), 게이트 출력 인에이블 신호(Gate Output Enable) 등을 포함하는 다양한 게이트 제어 신호(Gate Control Signal; GCS)들을 출력한다.
여기서, 게이트 스타트 펄스는 게이트 구동부(120)의 동작 스타트 타이밍을 제어한다. 게이트 쉬프트 클럭은 하나 이상의 게이트 회로에 공통으로 입력되는 클럭 신호로서, 게이트 전압의 쉬프트 타이밍을 제어한다. 게이트 출력 인에이블 신호는 게이트 구동부(120)의 출력 타이밍 정보를 지정한다.
또한, 타이밍 제어부(140)는 데이터 구동부(130)를 제어하기 위하여, 소스 스타트 펄스(Source Start Pulse), 소스 샘플링 클럭(Source Sampling Clock), 소스 출력 인에이블 신호(Souce Output Enable) 등을 포함하는 다양한 데이터 제어 신호(Data Control Signal; DCS)들을 출력한다.
여기서, 소스 스타트 펄스는 데이터 구동부(130)를 구성하는 하나 이상의 소스 구동 집적 회로(SDIC)의 데이터 샘플링 시작 타이밍을 제어한다. 소스 샘플링 클럭은 데이터 회로 각각에서 데이터의 샘플링 타이밍을 제어하는 클럭 신호이다. 소스 출력 인에이블 신호는 데이터 구동부(130)의 출력 타이밍을 제어한다.
그리고, 타이밍 제어부(140)는 데이터 구동부(130)에 디지털 비디오 데이터(Data)를 전송한다. 디지털 비디오 데이터(Data)는 데이터 구동부(130)에서, 아날로그 데이터 전압으로 변환되어 표시 영역(AA)에 배치된 각 화소(PX)에 출력된다.
또한, 타이밍 제어부(140)는 데이터 구동부(130)에 파워 제어 신호(Power Control signal; PWRC)를 출력한다. 파워 제어 신호(PWRC)에 의하여, 데이터 구동부(130)를 구성하는 하나 이상의 소스 구동 집적 회로(SDIC)의 구동 전류를 제어할 수 있다.
게이트 구동부(120)는 복수의 화소(PX)에 게이트 전압을 공급한다. 게이트 구동부(120)는 게이트 제어 신호(GCS)에 대응하여 게이트 전압을 시프트하여 출력하는 복수의 스테이지로 구성될 수 있다. 게이트 구동부(120)에 포함된 복수의 스테이지는 게이트 전압을 게이트 라인(GL)을 통해 복수의 화소(PX)에 순차적으로 출력할 수 있다. 게이트 구동부(120)는 GIP 방식(Gate In Panel)에 의해 표시 패널(110)의 비표시 영역(NA)에 형성되는 게이트 구동 집적 회로(Gate Driving Integrated Circuit; GDIC)수 있으나, 이에 제한되는 것은 아니다.
데이터 구동부(130)는 복수의 화소(PX)에 데이터 전압을 공급한다. 데이터 구동부(130)는 복수의 소스 구동 집적 회로(Source Driving Integrated Circuit; SDIC)를 포함할 수 있다. 즉, 도 1에 도시된 바와 같이, 데이터 구동부(130)는 제1 표시 영역(AA1)에 데이터 전압을 공급하는 제1 소스 구동 집적 회로(SDIC#1), 제2 표시 영역(AA2)에 데이터 전압을 공급하는 제2 소스 구동 집적 회로(SDIC#2) 및 제m 표시 영역(AA(m))에 데이터 전압을 공급하는 제m 소스 구동 집적 회로(SDIC#(m))을 포함할 수 있다.
복수의 소스 구동 집적 회로(SDIC#1, SDIC#2, …,SDIC#(m)) 각각은 타이밍 제어부(140)로부터 디지털 비디오 데이터(Data), 데이터 제어 신호(DCS) 및 파워 제어 신호(PWRC)를 공급받을 수 있다. 복수의 소스 구동 집적 회로(SDIC#1, SDIC#2, …,SDIC#(m)) 각각은 데이터 제어 신호(DCS)에 응답하여 디지털 비디오 데이터(Data)를 아날로그 감마 전압을 이용하여 데이터 전압을 생성하고, 파워 제어 신호(PWRC)에 의해 구동 전류를 조절하여, 데이터 배선(DL)을 통해 복수의 화소(PX)를 구동할 수 있다.
복수의 소스 구동 집적 회로(SDIC#1, SDIC#2, …,SDIC#(m))는 COG(Chip On Glass) 공정이나 TAB(Tape Automated Bonding) 공정에 의해 표시 패널(110)의 데이터 배선(DL)에 접속될 수 있다. 또한, 복수의 소스 구동 집적 회로(SDIC#1, SDIC#2, …,SDIC#(m))는 표시 패널(110) 상에 형성되거나, 별도의 PCB 기판에 형성되어 표시 패널(110)과 연결되는 형태일 수도 있다.
도 2는 본 발명의 일 실시예에 따른 표시 장치의 복수의 표시 영역을 설명하기 위한 도면이다.
복수의 표시 영역(AA) 각각은 중앙 표시 영역(Center Acitve Area; CA)와 엣지 표시 영역(Edge Active Area; EA)으로 구분될 수 있다.
중앙 표시 영역(CA)은 각각의 표시 영역(AA)에 배치된 복수의 화소 열 중 중앙부에 위치한 복수의 화소 열이 배치되는 영역을 의미한다.
그리고, 엣지 표시 영역(EA)은 각각의 표시 영역(AA)에 배치된 복수의 화소 열 중 외측부에 위치한 복수의 화소 열이 배치되는 영역을 말한다.
그리고, 엣지 표시 영역(EA)은 이전 표시 영역(AA)에 인접하는 프론트 엣지 표시 영역(Front Edge Active Area; FEA)과 다음 표시 영역(AA)에 인접하는 백 엣지 표시 영역(Back Edge Active Area; BEA)을 포함할 수 있다. 즉, 프론트 엣지 표시 영역(FEA)은 각각의 표시 영역(AA)에 배치된 복수의 화소 열 중 이전 표시 영역(AA)에 인접하는 일측에 위치한 복수의 화소 열이 배치되는 영역을 의미하고, 백 엣지 표시 영역(BEA)은 각각의 표시 영역(AA)에 배치된 복수의 화소 열 중 다음 표시 영역(AA)에 인접하는 타측에 위치한 복수의 화소 열이 배치되는 영역을 의미한다.
이에, 이전 표시 영역(AA)의 프론트 엣지 표시 영역(FEA)은 다음 표시 영역(AA)의 백 엣지 표시 영역(BEA)과 인접될 수 있다.
예를 들어, 도 3에 도시된 바와 같이, 제k 표시 영역(AA(k))에서, 1번째 화소 열 내지 j 번째 화소 열은 제k 프론트 엣지 표시 영역(FEA(k))에 배치되고, j+1번째 화소 열 내지 2j 번째 화소 열은 제k 중앙 표시 영역(CA(k))에 배치되고, 2j+1번째 화소 열 내지 3j 번째 화소 열은 제k 백 엣지 표시 영역(BEA(k))에 배치된다.
제k-1 표시 영역(AA(k-1))에서도, 1번째 화소 열 내지 j 번째 화소 열은 제k-1 프론트 엣지 표시 영역(FEA(k-1))에 배치되고, j+1번째 화소 열 내지 2j 번째 화소 열은 제k-1 중앙 표시 영역(CA(k-1))에 배치되고, 2j+1번째 화소 열 내지 3j 번째 화소 열은 제k-1 백 엣지 표시 영역(BEA(k-1))에 배치된다.
이에, 제k-1 백 엣지 표시 영역(BEA(k-1))과 제k 프론트 엣지 표시 영역(FEA(k))은 서로 인접하게 된다.
단, 제1 표시 영역(AA1)은 이전 표시 영역이 존재하지 않으므로, 제1 프론트 엣지 표시 영역은 존재하지 않고, 마지막 표시 영역인 제m 표시 영역(AA(m))은 다음 표시 영역이 존재하지 않으므로, 제m 백 엣지 표시 영역은 존재하지 않는다.
도 3은 본 발명의 일 실시예에 따른 표시 장치의 타이밍 제어부를 설명하기 위한 도면이다.
도 4는 본 발명의 일 실시예에 따른 표시 장치의 서브 데이터 인에이블 신호 및 엣지 데이터 인에이블 신호를 나타내는 파형도이다.
타이밍 제어부(140)는 데이터 인에이블 신호 생성부(141), 데이터 지연부(142), 복수의 데이터 비교부(143), 복수의 파워 제어 신호 생성부(144)를 포함한다.
데이터 인에이블 신호 생성부(141)는 데이터 인에이블 신호(DE) 및 데이터 클럭 신호(DCLK)에 동기화되어, 복수의 데이터 비교부(143) 각각에 서브 데이터 인에이블 신호(SDE) 및 엣지 데이터 인에이블 신호(EDE)를 출력한다.
즉, 데이터 인에이블 신호 생성부(141)는 제1 데이터 비교부(143(1))에 제1 서브 데이터 인에이블 신호(SDE1) 및 제1 엣지 데이터 인에이블 신호(EDE1)를 출력한다. 그리고, 데이터 인에이블 신호 생성부(141)는 제(m-1) 데이터 비교부(143(m-1))에 제(m-1) 서브 데이터 인에이블 신호(SDE(m-1)) 및 제(m-1) 엣지 데이터 인에이블 신호(EDE(m-1))를 출력한다. 그리고, 데이터 인에이블 신호 생성부(141)는 제(m) 데이터 비교부(143(m))에 제(m) 서브 데이터 인에이블 신호(SDE(m)) 및 제(m) 엣지 데이터 인에이블 신호(EDE(m))를 출력한다.
도 4에 도시된 바와 같이, 제1 서브 데이터 인에이블 신호(SDE1) 내지 제(m) 서브 데이터 인에이블 신호(SDE(m)) 각각은 제1 소스 구동 집적 회로(SDIC#1) 내지 제(m) 소스 구동 집적 회로(SDIC#(m)) 각각이 제1 표시 영역(AA1) 내지 제m 표시 영역(AA(m)) 각각에 데이터 전압을 출력하는 타이밍을 결정하는 신호이다.
즉, 도2 를 참조하면, n번째 화소 행에는 1수평 기간 동안 데이터 전압이 인가되므로, 1 수평 기간 이내에 제1 서브 데이터 인에이블 신호(SDE1) 내지 제(m) 서브 데이터 인에이블 신호(SDE(m))는 순차적으로 턴온 레벨인 하이 레벨로 출력될 수 있다.
구체적으로, 도 4를 참조하면, t1-t3 기간에는 제1 서브 데이터 인에이블 신호(SDE1)가 턴온 레벨이므로, t1-t3 기간에는 제1 소스 구동 집적 회로(SDIC#1)가 제1 표시 영역(AA1)의 n번째 행에 배치된 복수의 화소(PX)에 데이터 전압을 출력한다.
그리고, t3-t6 기간에는 제2 서브 데이터 인에이블 신호(SDE2)가 턴온 레벨이므로, t3-t6 기간에는 제2 소스 구동 집적 회로(SDIC#2)가 제1 표시 영역(AA2)의 n번째 행에 배치된 복수의 화소(PX)에 데이터 전압을 출력한다.
그리고, t(m-3)-t(m) 기간에는 제(m-1) 서브 데이터 인에이블 신호(SDE(m-1))가 턴온 레벨이므로, t(m-3)-t(m) 기간에는 제(m-1) 소스 구동 집적 회로(SDIC#(m-1))가 제(m-1) 표시 영역(AA(m-1))의 n번째 행에 배치된 복수의 화소(PX)에 데이터 전압을 출력한다.
그리고, t(m)-t(m+3) 기간에는 제(m) 서브 데이터 인에이블 신호(SDE(m))가 턴온 레벨이므로, t(m)-t(m+3) 기간에는 제(m) 소스 구동 집적 회로(SDIC#(m))가 제(m) 표시 영역(AA(m))의 n번째 행에 배치된 복수의 화소(PX)에 데이터 전압을 출력한다.
그리고, 도 4에 도시된 바와 같이, 제1 엣지 데이터 인에이블 신호(EDE1) 내지 제(m) 엣지 데이터 인에이블 신호(EDE(m)) 각각은 제1 소스 구동 집적 회로(SDIC#1) 내지 제(m) 소스 구동 집적 회로(SDIC#(m)) 각각이 제1 엣지 표시 영역(EA1) 내지 제m 엣지 표시 영역(EA(m)) 각각에 데이터 전압을 출력하는 타이밍을 결정하는 신호이다.
그리고, 복수의 엣지 데이터 인에이블 신호(EDE)는 복수의 프론트 엣지 데이터 인에이블 신호(FEA) 및 백 엣지 데이터 인에이블 신호(BDE)를 포함할 수 있다.
다만, 전술한 바와 같이, 제1 프론트 엣지 표시 영역 및 제m 백 엣지 표시 영역은 존재하지 않으므로, 제1 프론트 엣지 데이터 인에이블 신호 및 제m 백 엣지 데이터 인에이블 신호는 출력되지 않는다.
보다 상세히는, 제2 프론트 엣지 데이터 인에이블 신호(FDE2) 내지 제(m) 프론트 엣지 데이터 인에이블 신호(FDE(m)) 각각은 제2 소스 구동 집적 회로(SDIC#2) 내지 제(m) 소스 구동 집적 회로(SDIC#(m)) 각각이 제2 프론트 엣지 표시 영역(FEA(2)) 내지 제m 프론트 엣지 표시 영역(FEA(m)) 각각에 데이터 전압을 출력하는 타이밍을 결정하는 신호이다. 그리고, 제1 백 엣지 데이터 인에이블 신호(BDE1) 내지 제(m-1) 백 엣지 데이터 인에이블 신호(BDE(m)) 각각은 제1 소스 구동 집적 회로(SDIC#1) 내지 제(m-1) 소스 구동 집적 회로(SDIC#(m-1)) 각각이 제1 백 엣지 표시 영역(BEA1) 내지 제m 백 엣지 표시 영역(BEA(m-1)) 각각에 데이터 전압을 출력하는 타이밍을 결정하는 신호이다.
구체적으로, 도 4를 참조하면, t2-t3 기간에는 제1 백 엣지 데이터 인에이블 신호(BDE1)가 턴온 레벨이므로, t2-t3 기간에는 제1 소스 구동 집적 회로(SDIC#1)가 제1 백 엣지 표시 영역(BEA1)의 n번째 행에 배치된 복수의 화소(PX)에 데이터 전압을 출력한다.
그리고, t3-t4 기간에는 제2 프론트 엣지 데이터 인에이블 신호(FDE2)가 턴온 레벨이므로, t3-t4 기간에는 제2 소스 구동 집적 회로(SDIC#2)가 제2 프론트 엣지 표시 영역(FEA2)의 n번째 행에 배치된 복수의 화소(PX)에 데이터 전압을 출력한다.
그리고, t5-t6 기간에는 제2 백 엣지 데이터 인에이블 신호(FDE2)가 턴온 레벨이므로, t5-t6 기간에는 제2 소스 구동 집적 회로(SDIC#2)가 제2 백 엣지 표시 영역(BEA2)의 n번째 행에 배치된 복수의 화소(PX)에 데이터 전압을 출력한다.
그리고, t(m-3)-t(m-2) 기간에는 제(m-1) 프론트 엣지 데이터 인에이블 신호(FDE(m-1))가 턴온 레벨이므로, t(m-3)-t(m-2) 기간에는 제(m-1) 소스 구동 집적 회로(SDIC#(m-1))가 제(m-1) 프론트 엣지 표시 영역(FEA(m-1))의 n번째 행에 배치된 복수의 화소(PX)에 데이터 전압을 출력한다.
그리고, t(m-1)-t(m) 기간에는 제(m-1) 백 엣지 데이터 인에이블 신호(BDE(m-1))가 턴온 레벨이므로, t(m-1)-t(m) 기간에는 제(m-1) 소스 구동 집적 회로(SDIC#(m-1))가 제(m-1) 백 엣지 표시 영역(BEA(m-1))의 n번째 행에 배치된 복수의 화소(PX)에 데이터 전압을 출력한다.
그리고, t(m)-t(m+1) 기간에는 제(m) 프론트 엣지 데이터 인에이블 신호(FDE(m))가 턴온 레벨이므로, t(m)-t(m+1) 기간에는 제(m) 소스 구동 집적 회로(SDIC#(m))가 제(m) 프론트 엣지 표시 영역(FEA)의 n번째 행에 배치된 복수의 화소(PX)에 데이터 전압을 출력한다.
데이터 지연부(142)는 비디오 데이터(Data)를 인가 받아, 이를 1수평 기간만큼 지연 시킨 뒤 출력한다.
데이터 지연부(142)는 비디오 데이터(Data)를 내부 메모리에 저장하여, 이를 1 수평 기간만큼 지연시킨 뒤, 지연된 비디오 데이터(D_Data)를 복수의 데이터 비교부(143) 각각에 출력한다.
예를 들어, n-1 번째 수평 기간에서, n번째 행에 해당하는 비디오 데이터(Data)를 저장한 뒤, n+1 번째 수평 기간에서, n번째 행에 해당하는 지연된 비디오 데이터(D_Data)를 출력한다.
그리고, 복수의 데이터 비교부(143) 각각은 복수의 서브 데이터 인에이블 신호(SDE)가 턴온 레벨인 동안에, 복수의 표시 영역(AA)에 대응되는 비디오 데이터(Data)와 지연된 비디오 데이터(D_Data)를 비교하여, 복수의 비교 데이터(CD) 각각을 생성한다. 그리고, 복수의 데이터 비교부(143) 각각은 비교 데이터(CD)를 파워 제어 신호 생성부(144)에 출력한다. 달리 표현하면, 상술한 비교 데이터(CD)는 복수의 표시 영역(AA) 각각에서 인접된 화소 행끼리의 최대 데이터 전환 값을 의미할 수 있다.
보다 상세히는, 제1 데이터 비교부(143(1))는 제1 서브 데이터 인에이블 신호(SDE1)가 턴온 레벨인 동안에, 제1 표시 영역(AA1)에 대응되는 비디오 데이터(Data)와 지연된 비디오 데이터(D_Data)를 비교하여, 비디오 데이터(Data)와 지연된 비디오 데이터(D_Data)의 최대값을 제1 비교 데이터(CD1)로 출력한다.
그리고, 제(m-1) 데이터 비교부(143(m-1))는 제(m-1) 서브 데이터 인에이블 신호(SDE(m-1))가 턴온 레벨이므로, 제(m-1) 표시 영역(AA(m-1))에 대응되는 비디오 데이터(Data)와 지연된 비디오 데이터(D_Data)를 비교하여, 비디오 데이터(Data)와 지연된 비디오 데이터(D_Data)의 최대값을 제(m-1) 비교 데이터(CD(m-1))로 출력한다.
그리고, 제(m) 데이터 비교부(143(m))는 제(m) 서브 데이터 인에이블 신호(SDE(m))가 턴온 레벨이므로, 제(m) 표시 영역(AA(m))에 대응되는 비디오 데이터(Data)와 지연된 비디오 데이터(D_Data)를 비교하여, 비디오 데이터(Data)와 지연된 비디오 데이터(D_Data)의 최대값을 제(m) 비교 데이터(CD(m))로 출력한다.
예를 들면, 도 4를 참조하면, t1-t2 기간에는 제1 서브 데이터 인에이블 신호(SDE1)가 턴온 레벨이므로, t1-t2 기간에는 제1 표시 영역(AA1)의 복수의 화소(PX) 열 각각에 대한 비디오 데이터(Data)와 지연된 비디오 데이터(D_Data)의 최대값을 제1 비교 데이터(CD1)로 출력한다.
그리고, t(m-3)-t(m) 기간에는 제(m-1) 서브 데이터 인에이블 신호(SDE(m-1))가 턴온 레벨이므로, t(m-3)-t(m) 기간에는 제(m-1) 표시 영역(AA(m-1))의 복수의 화소(PX) 열 각각에 대한 비디오 데이터(Data)와 지연된 비디오 데이터(D_Data)의 최대값을 제(m-1) 비교 데이터(CD(m-1))로 출력한다.
그리고, t(m)-t(m+3) 기간에는 제(m) 서브 데이터 인에이블 신호(SDE(m))가 턴온 레벨이므로, t(m)-t(m+3) 기간에는 제(m) 표시 영역(AA(m))의 복수의 화소(PX) 열 각각에 대한 비디오 데이터(Data)와 지연된 비디오 데이터(D_Data)의 최대값을 제(m) 비교 데이터(CD(m))로 출력한다.
그리고, 복수의 데이터 비교부(143) 각각은 복수의 엣지 데이터 인에이블 신호(EDE)가 턴온 레벨인 동안에, 복수의 엣지 표시 영역(EA)에서 비디오 데이터(Data)와 지연된 비디오 데이터(D_Data)를 비교하여, 복수의 엣지 비교 데이터(ECD) 각각을 생성한다. 그리고, 복수의 데이터 비교부(143) 각각은 엣지 비교 데이터(ECD)를 파워 제어 신호 생성부(144)에 출력한다. 달리 표현하면, 상술한 엣지 비교 데이터(ECD)는 복수의 엣지 표시 영역(EA) 각각에서 인접된 화소(PX) 행끼리의 최대 데이터 전환 값을 의미할 수 있다.
보다 상세히는, 제1 데이터 비교부(143(1))는 제1 엣지 데이터 인에이블 신호(EDE1)가 턴온 레벨인 동안에, 제1 엣지 표시 영역(EA1)에 대응되는 비디오 데이터(Data)와 지연된 비디오 데이터(D_Data)를 비교하여, 비디오 데이터(Data)와 지연된 비디오 데이터(D_Data)의 최대값을 제1 엣지 비교 데이터(ECD1)로 출력한다.
그리고, 제(m-1) 데이터 비교부(143(m-1))는 제(m-1) 엣지 데이터 인에이블 신호(EDE(m-1))가 턴온 레벨인 동안에, 제(m-1) 엣지 표시 영역(EA)에 대응되는 비디오 데이터(Data)와 지연된 비디오 데이터(D_Data)를 비교하여, 비디오 데이터(Data)와 지연된 비디오 데이터(D_Data)의 최대값을 제(m-1) 엣지 비교 데이터(CD(m-1))로 출력한다.
그리고, 제(m) 데이터 비교부(143(m))는 제(m) 엣지 데이터 인에이블 신호(EDE(m))가 턴온 레벨인 동안에, 제(m) 엣지 표시 영역(EA)에 대응되는 비디오 데이터(Data)와 지연된 비디오 데이터(D_Data)를 비교하여, 비디오 데이터(Data)와 지연된 비디오 데이터(D_Data)의 최대값을 제(m) 엣지 비교 데이터(ECD(m))로 출력한다.
예를 들면, 도 4를 참조하면, t2-t3 기간에는 제1 백 엣지 데이터 인에이블 신호(BDE1)가 턴온 레벨이므로, 제1 백 엣지 표시 영역(BEA1)에 대응되는 비디오 데이터(Data)와 지연된 비디오 데이터(D_Data)를 비교하여, 비디오 데이터(Data)와 지연된 비디오 데이터(D_Data)의 최대값을 제1 엣지 비교 데이터(ECD1)로 출력한다.
그리고, t(m-3)-t(m-2) 기간에는 제(m-1) 프론트 엣지 데이터 인에이블 신호(FDE(m-1))가 턴온 레벨이므로, 제(m-1) 프론트 엣지 표시 영역(FEA(m-1))에 대응되는 비디오 데이터(Data)와 지연된 비디오 데이터(D_Data)를 비교하여, 비디오 데이터(Data)와 지연된 비디오 데이터(D_Data)의 최대값을 제(m-1) 엣지 비교 데이터(ECD(m-1))로 출력한다.
그리고, t(m-1)-t(m) 기간에는 제(m-1) 백 엣지 데이터 인에이블 신호(BDE(m-1))가 턴온 레벨이므로, 제(m-1) 백 엣지 표시 영역(BEA(m-1))에 대응되는 비디오 데이터(Data)와 지연된 비디오 데이터(D_Data)를 비교하여, 비디오 데이터(Data)와 지연된 비디오 데이터(D_Data)의 최대값을 제(m-1) 엣지 비교 데이터(ECD(m-1))로 출력한다.
그리고, t(m)-t(m+1) 기간에는 제(m) 프론트 엣지 데이터 인에이블 신호(FDE(m))가 턴온 레벨이므로, 제(m) 프론트 엣지 표시 영역(FEA(m))에 대응되는 비디오 데이터(Data)와 지연된 비디오 데이터(D_Data)를 비교하여, 비디오 데이터(Data)와 지연된 비디오 데이터(D_Data)의 최대값을 제(m) 엣지 비교 데이터(ECD(m))로 출력한다.
한편, 복수의 데이터 비교부(143) 각각은 생성한 비교 데이터(CD)와 엣지 비교 데이터(ECD)를 해당 표시 영역에 대응하는 파워 제어 신호 생성부(144) 및 인접한 표시 영역에 대응하는 파워 제어 신호 생성부(144)에 출력한다.
구체적으로, 제1 데이터 비교부(143(1))는 제1 비교 데이터(CD1)와 제1 엣지 비교 데이터(ECD1)를 제1 표시 영역에 대응하는 제1 파워 제어 신호 생성부(144(1)) 및 제1 표시 영역에 인접한 제2 표시 영역에 대응하는 제2 파워 제어 신호 생성부에 출력한다.
그리고, 제(m-1) 데이터 비교부(143(m-1))는 제(m-1) 비교 데이터(CD(m-1))와 제(m-1) 엣지 비교 데이터(ECD(m-1))를 제(m-1) 표시 영역에 대응하는 제(m-1) 파워 제어 신호 생성부(144(m-1)), 제(m-1) 표시 영역에 인접한 제(m-2) 표시 영역에 대응하는 제(m-2) 파워 제어 신호 생성부(144(m-2)) 및 제(m-1) 표시 영역에 인접한 제(m) 표시 영역에 대응하는 제(m) 파워 제어 신호 생성부(144(m))에 출력한다.
그리고, 제(m) 데이터 비교부(143(m))는 제(m) 비교 데이터(CD(m))와 제(m) 엣지 비교 데이터(ECD(m))를 제(m) 표시 영역에 대응하는 제(m) 파워 제어 신호 생성부(144(m)) 및 제(m) 표시 영역에 인접한 제(m-1) 표시 영역에 대응하는 제(m-1) 파워 제어 신호 생성부(144(m-1))에 출력한다.
도 5는 본 발명의 일 실시예에 따른 표시 장치의 파워 제어 신호 생성부의 LUT(Look-Up Table)을 나타내는 도면이다.
파워 제어 신호 생성부(144)는 비교 데이터(CD)와 엣지 비교 데이터(ECD)를 이용하여, 파워 제어 신호(PWRC)를 생성한다.
구체적으로, 파워 제어 신호 생성부(144) 각각은 인가 받은 복수의 비교 데이터(CD) 각각을 제1 LUT(1st Look-Up Table)에 적용하여, 인가 받은 복수의 비교 데이터(CD) 각각에 대하여 제1 기준 값(SV1)을 설정한다.
그리고, 파워 제어 신호 생성부(144) 각각은 인가 받은 복수의 엣지 비교 데이터(ECD) 각각을 제2 LUT(2nd Look-Up Table)에 적용하여, 인가 받은 복수의 엣지 비교 데이터(ECD) 각각에 대하여 제2 기준 값(SV2)을 설정한다.
그리고, 파워 제어 신호 생성부(144)는 해당 표시 영역의 제1 기준 값(SV1)과 인접 엣지 표시 영역의 제2 기준 값(SV2)의 차이 값(DV)을 도출하여, 차이 값(DV)을 제3 LUT(3rd Look-Up Table)에 적용하여, 보상 값(CV)을 설정한다.
그리고, 파워 제어 신호 생성부(144)는 해당 표시 영역의 제1 기준 값(SV1)에 보상 값(CV)을 더하여, 파워 제어 신호(PWRC)로 출력한다.
도 3 및 도 5를 참조하면, 제1 파워 제어 신호 생성부(144(1)), 제(m-1) 파워 제어 신호 생성부(144(m-1)) 및 제(m) 파워 제어 신호 생성부(144(m)) 각각은 비교 데이터(CD)를 제1 LUT(1st Look-Up Table)에 저장된 복수의 임계 값(Threshold)과 비교하여, 제1 기준 값(SV1)을 설정한다. 예를 들어, 비교 데이터(CD)가 제1 임계 값(Th 1) 이하일 경우에는 제1 기준 값(SV1)을 0(LLL)으로 설정하고, 비교 데이터(CD)가 제1 임계 값(Th 1) 초과 내지 제2 임계 값(Th 2) 이하일 경우에는 제1 기준 값(SV1)을 1(LLH)으로 설정하고, 비교 데이터(CD)가 제2 임계 값(Th 2) 초과 내지 제3 임계 값(Th 3) 이하일 경우에는 제1 기준 값(SV1)을 1(LLH)으로 설정하고, 비교 데이터(CD)가 제3 임계 값(Th 3) 초과 내지 제4 임계 값(Th 4) 이하일 경우에는 제1 기준 값(SV1)을 2(LHL)으로 설정하고, 비교 데이터(CD)가 제4 임계 값(Th 4) 초과 내지 제5 임계 값(Th 5) 이하일 경우에는 제1 기준 값(SV1)을 2(LHL)으로 설정하고, 비교 데이터(CD)가 제5 임계 값(Th 5) 초과 내지 제6 임계 값(Th 6) 이하일 경우에는 제1 기준 값(SV1)을 3(LHH)으로 설정하고, 비교 데이터(CD)가 제6 임계 값(Th 6) 초과 내지 제7 임계 값(Th 7) 이하일 경우에는 제1 기준 값(SV1)을 4(HLL)으로 설정하고, 비교 데이터(CD)가 제7 임계 값(Th 7) 초과 내지 제8 임계 값(Th 8) 이하일 경우에는 제1 기준 값(SV1)을 4(HLL)으로 설정하고, 비교 데이터(CD)가 제8 임계 값(Th 8) 초과 일 경우에는 제1 기준 값(SV1)을 4(HLL)으로 설정한다. 상술한 제1 임계 값(Th 1) 내지 제8 임계 값(Th 8)은 제1 파워 제어 신호 생성부(144(1)), 제(m-1) 파워 제어 신호 생성부(144(m-1)) 및 제(m) 파워 제어 신호 생성부(144(m)) 각각의 메모리에 저장된 값으로서, 설정에 따라 달라질 수 있다.
그리고, 제1 파워 제어 신호 생성부(144(1)), 제(m-1) 파워 제어 신호 생성부(144(m-1)) 및 제(m) 파워 제어 신호 생성부(144(m)) 각각은 엣지 비교 데이터(ECD)를 제2 LUT(2nd Look-Up Table)에 저장된 복수의 임계 값과 비교하여, 제2 기준 값(SV2)을 설정한다. 예를 들어, 엣지 비교 데이터(ECD)가 제1 임계 값(Th 1) 이하일 경우에는 제2 기준 값(SV2)을 0(LLL)으로 설정하고, 엣지 비교 데이터(ECD)가 제1 임계 값(Th 1) 초과 내지 제2 임계 값(Th 2) 이하일 경우에는 제2 기준 값(SV2)을 1(LLH)으로 설정하고, 엣지 비교 데이터(ECD)가 제2 임계 값(Th 2) 초과 내지 제3 임계 값(Th 3) 이하일 경우에는 제2 기준 값(SV2)을 1(LLH)으로 설정하고, 엣지 비교 데이터(ECD)가 제3 임계 값(Th 3) 초과 내지 제4 임계 값(Th 4) 이하일 경우에는 제2 기준 값(SV2)을 2(LHL)으로 설정하고, 엣지 비교 데이터(ECD)가 제4 임계 값(Th 4) 초과 내지 제5 임계 값(Th 5) 이하일 경우에는 제2 기준 값(SV2)을 2(LHL)으로 설정하고, 엣지 비교 데이터(ECD)가 제5 임계 값(Th 5) 초과 내지 제6 임계 값(Th 6) 이하일 경우에는 제2 기준 값(SV2)을 3(LHH)으로 설정하고, 엣지 비교 데이터(ECD)가 제6 임계 값(Th 6) 초과 내지 제7 임계 값(Th 7) 이하일 경우에는 제2 기준 값(SV2)을 4(HLL)으로 설정하고, 엣지 비교 데이터(ECD)가 제7 임계 값(Th 7) 초과 내지 제8 임계 값(Th 8) 이하일 경우에는 제2 기준 값(SV2)을 4(HLL)으로 설정하고, 엣지 비교 데이터(ECD)가 제8 임계 값(Th 8) 초과 일 경우에는 제2 기준 값(SV2)을 4(HLL)으로 설정한다. 상술한 제1 임계 값(Th 1) 내지 제8 임계 값(Th 8)은 제1 파워 제어 신호 생성부(144(1)), 제(m-1) 파워 제어 신호 생성부(144(m-1)) 및 제(m) 파워 제어 신호 생성부(144(m)) 각각의 메모리에 저장된 값으로서, 설정에 따라 달라질 수 있다.
다음으로 제1 파워 제어 신호 생성부(144(1)), 제(m-1) 파워 제어 신호 생성부(144(m-1)) 및 제(m) 파워 제어 신호 생성부(144(m)) 각각은 해당 표시 영역에 대응하는 제1 기준 값(SV1)과 인접 엣지 표시 영역의 제2 기준 값(SV2)의 차이 값(DV)을 도출하고, 차이 값(DV)을 제3 LUT(3rd Look-Up Table)에 적용하여, 보상 값(CV)을 설정한다.
보다 구체적으로, 해당 표시 영역에 대응하는 제1 기준 값(SV1)과 인접 엣지 표시 영역에 대응하는 제2 기준 값(SV2)의 차이 값(DV)이 0(LLL)인 경우에는 보상 값(CV)을 0(LLL)으로 설정하고, 해당 표시 영역에 대응하는 제1 기준 값(SV1)과 인접 엣지 표시 영역에 대응하는 제2 기준 값(SV2)의 차이 값(DV)이 1(LLH)인 경우에는 보상 값(CV)을 0(LLL)으로 설정하고, 해당 표시 영역에 대응하는 제1 기준 값(SV1)과 인접 엣지 표시 영역에 대응하는 제2 기준 값(SV2)의 차이 값(DV)이 2(LHL)인 경우에는 보상 값(CV)을 1(LLH)으로 설정하고, 해당 표시 영역에 대응하는 제1 기준 값(SV1)과 인접 엣지 표시 영역에 대응하는 제2 기준 값(SV2)의 차이 값(DV)이 3(LHH)인 경우에는 보상 값(CV)을 1(LLH)으로 설정하고, 해당 표시 영역에 대응하는 제1 기준 값(SV1)과 인접 엣지 표시 영역에 대응하는 제2 기준 값(SV2)의 차이 값(DV)이 3(LHH)인 경우에는 보상 값(CV)을 1(LLH)으로 설정하고, 해당 표시 영역에 대응하는 제1 기준 값(SV1)과 인접 엣지 표시 영역에 대응하는 제2 기준 값(SV2)의 차이 값(DV)이 4(HLL)인 경우에는 보상 값(CV)을 2(LHL)으로 설정한다.
그리고, 제1 파워 제어 신호 생성부(144(1)), 제(m-1) 파워 제어 신호 생성부(144(m-1)) 및 제(m) 파워 제어 신호 생성부(144(m)) 각각은 제1 기준 값(SV1)에 보상 값(CV)을 더하여, 파워 제어 신호(PWRC)로 출력한다.
예를 들어, 제1 파워 제어 신호 생성부(144(1))는 제1 표시 영역에 대응하는 제1 기준 값(SV1)과 제2 프론트 엣지 표시 영역에 대응하는 제2 기준 값(SV2)의 차이 값(DV)에 따라, 보상 값(CV)을 설정한다. 그리고, 제1 표시 영역에 대응하는 제1 기준 값(SV1)에 보상 값(CV)을 더하여, 제1 파워 제어 신호(PWRC1)로 출력한다.
제(m-1) 파워 제어 신호 생성부(144(m-1))는 제(m-1) 표시 영역에 대응하는 제1 기준 값(SV1)과 제m 프론트 엣지 표시 영역에 대응하는 제2 기준 값(SV2)의 차이 값(DV)에 따라, 보상 값(CV)을 설정한다. 그리고, 제(m-1) 표시 영역에 대응하는 제1 기준 값(SV1)에 보상 값(CV)을 더하여, 제(m-1) 파워 제어 신호(PWRC(m-1))로 출력한다.
제(m) 파워 제어 신호 생성부(144(m))는 제(m) 표시 영역에 대응하는 제1 기준 값(SV1)과 제(m-1) 백 엣지 표시 영역에 대응하는 제2 기준 값(SV2)의 차이 값(DV)에 따라, 보상 값(CV)을 설정한다. 그리고, 제(m) 표시 영역에 대응하는 제1 기준 값(SV1)에 보상 값(CV)을 더하여, 제(m) 파워 제어 신호(PWRC(m))로 출력한다.
구체적으로 수치를 대입하면, 제(m) 표시 영역에 대응하는 제1 기준 값(SV1)이 0(LLL)이고, 제(m-1) 백 엣지 표시 영역에 대응하는 제2 기준 값(SV2)이 4(HLL) 인 경우, 차이 값(DV)는 4(HLL)이므로, 보상 값(CV)은 2(LHL)일 수 있다. 이에, 제(m) 파워 제어 신호 생성부(144(m))는 제(m) 표시 영역에 대응하는 제1 기준 값(SV1)인 0(LLL)에 보상 값(CV)인 2(LHL)를 더하여, 제(m) 파워 제어 신호(PWRC(m))를 2(LHL)로 출력할 수 있다.
도 6은 본 발명의 일 실시예에 따른 표시 장치의 소스 구동 집적 회로를 설명하기 위한 도면이다.
복수의 소스 구동 집적 회로(SDIC) 각각은 쉬프트 레지스터(131), 래치(132), 디지털 아날로그 컨버터(Digital-Analog Converter; DAC)(133), 버퍼(134) 및 파워 제어 회로(135)를 포함한다.
쉬프트 레지스터(131)는 소스 스타트 펄스(Source Start Pulse), 소스 샘플링 클럭(Source Sampling Clock)를 포함하는 데이터 제어 신호(DCS)를 타이밍 제어부(140)로부터 전송받아, 순차적인 데이터 샘플링 시점을 결정한다.
래치(132)는 쉬프트 레지스터(131)으로부터 전송된 샘플링신호에 응답하여 타이밍 제어부(140)로부터 전송된 적색, 녹색 및 청색의 디지털 비디오 데이터(Data)를 순차적으로 래치하여 동시에 출력한다.
디지털 아날로그 컨버터(133)는 래치부(132)로부터의 적색, 녹색 및 청색의 디지털 비디오 데이터(Data)를 아날로그 감마 전압을 이용하여 아날로 데이터 전압(Vdata)으로 변환한다.
버퍼(134)는 디지털 아날로그 컨버터(133)로부터 전송되어온 아날로그 데이터 전압(Vdata)을 데이터 라인에 출력할 수 잇다.
파워 제어 회로(Power Control Circuit; PWRC Circuit, 135)는 타이밍 제어부(140)로부터 전송되어온 파워 제어 신호(PWRC)에 따라 스위칭되어, 버퍼(134)로 인가되는 전류의 양을 제어함으로써, 데이터 구동부의 소비전력을 제어할 수 있다.
도 7은 본 발명의 일 실시예에 따른 표시 장치의 파워 제어 회로 및 버퍼를 설명하기 위한 회로도이다.
도 7을 참조하면, 버퍼(134)는 적어도 하나의 증폭기(operating amplifier)로 구성될 수 있으며, 복수의 데이터 라인(DL)에 각각 대응하여 배치된다.
버퍼(134)는 비반전 입력 단자(+)로 수신된 아날로그 데이터 전압(Vdata)를 증폭하여 출력할 수 있다. 버퍼(134)의 반전 입력 단자(-)는 출력 단자에 연결된 데이터 라인(DL)과 연결되어 있고, 버퍼(134)의 VCC 단자는 구동 전원(VDD)에 연결되고, VEE 단자는 파워 제어 회로(135)에 연결된다.
파워 제어 회로(135)는 버퍼(134)에 인가되는 구동 전류(ISUM)의 세기를 결정한다.
PWRC 제어 회로(135)는 복수의 전류원(I1, … ,I7, I8), 복수의 스위치(SW1, … , SW7, SW8) 및 전류 미러 회로(current mirror circuit) 를 구성하는 제1 미러 트랜지스터(MT1)와 제2 미러 트랜지스터(MT2)를 포함한다.
복수의 스위치(SW1, …, SW7, SW8)와 복수의 전류원(I1, …,I7, I8) 각각은 서로 직렬 연결된다. 그리고, 직렬 연결된 복수의 스위치(SW1, …, SW7, SW8)와 전류원(I1, …,I7, I8)은 서로 병렬 연결된다. 따라서, 복수의 스위치(SW1, …, SW7, SW8)의 온 상태에 따라, 전류 미러 회로(current mirror circuit)에 출력되는 구동 전류(ISUM)의 크기가 결정된다.
제1 미러 트랜지스터(MT1)와 제2 미러 트랜지스터(MT2)는 전류 미러 회로(current mirror circuit) 를 구성한다.
제1 미러 트랜지스터(MT1)의 게이트 전극과 소스 전극은 복수의 스위치에 연결되어, 구동 전류(ISUM)가 인가된다.
그리고, 제2 미러 트랜지스터(MT2)의 게이트 전극은 제1 미러 트랜지스터(MT1)의 게이트 전극과 연결되고, 제2 미러 트랜지스터(MT2)의 드레인 전극은 버퍼(134)의 VEE 단자에 연결된다.
이에, 구동 전류(ISUM)에 의하여, 제2 미러 트랜지스터(MT2)의 소스-드레인 전류가 구동 전류(ISUM)로 결정된다. 그리고, 제2 미러 트랜지스터(MT2)에 의해 출력된 구동 전류(ISUM)는 버퍼(134)의 VEE 단자에 출력된다.
이에, 파워 제어 회로(135)는 버퍼(134)의 증폭비(amplification ratio)를 제어 함으로써, 버퍼(134)의 소비 전력을 제어할 수 있다.
전술한 바와 같이, 본 발명의 일 실시예에 따른 표시 장치는 복수의 표시 영역 각각에 배치된 인접 화소 행끼리의 최대 데이터 전환 값인 비교 데이터와 복수의 엣지 표시 영역에 배치된 인접 화소 행끼리의 최대 데이터 전환 값인 엣지 비교 데이터의 차이 값에 따라 파워 제어 신호를 생성함으로써, 복수의 소스 구동 집적 회로의 구동 전류의 세기를 제어할 수 있다.
구동 전류의 세기에 엣지 표시 영역의 데이터 전환 정도가 반영됨으로써, 복수의 표시 영역에 동일 계조를 표현하는 데이터 전압이 인가될 때, 경계 영역에서 블락 딤(Block Dim)과 같은 불량을 방지할 수 있다.
또한, 본 발명의 일 실시예에 따른 표시 장치는 복수의 표시 영역 각각에 배치된 인접 화소 행끼리의 최대 데이터 전환 값인 비교 데이터를 이용하여, 복수의 소스 구동 집적 회로의 구동 전류의 세기를 조절할 수 있으므로, 각 표시 영역별 최적 구동 전류 세기를 셋팅할 수 있다.
이에, 각 표시 영역 마다 최적의 구동 전력을 결정할 수 있으므로, 본 발명의 일 실시예에 따른 표시 장치의 소비 전력은 최적화될 수 있다.
이하에서는 본 발명의 일 실시예에 따른 표시 장치의 구동 방법에 대해서 설명한다. 본 발명의 일 실시예에 따른 표시 장치의 구동 방법은 전술한 본 발명의 일 실시예에 따른 표시 장치를 전제로 설명한다.
도 8은 본 발명의 일 실시예에 따른 표시 장치의 구동 방법을 설명하기 위한 흐름도이다.
도 8에 도시된 바와 같이, 발명의 일 실시예에 따른 표시 장치의 구동 방법(S100)은 데이터 인에이블 신호 생성 단계(S110), 데이터 지연 단계(S120), 데이터 비교 단계(S130), 제1 기준 값 설정 단계(S140), 제2 기준 값 설정 단계(S150), 보상 값 도출 단계(S160) 및 파워 제어 신호 출력 단계(S170)를 포함한다.
데이터 인에이블 신호 생성 단계(S110)에서, 데이터 인에이블 신호(DE) 및 데이터 클럭 신호(DCLK)에 동기화되어, 서브 데이터 인에이블 신호(SDE) 및 엣지 데이터 인에이블 신호(EDE)를 생성한다.
도 4에 도시된 바와 같이, 제1 서브 데이터 인에이블 신호(SDE1) 내지 제(m) 서브 데이터 인에이블 신호(SDE(m)) 각각은 제1 소스 구동 집적 회로(SDIC#1) 내지 제(m) 소스 구동 집적 회로(SDIC#(m)) 각각이 제1 표시 영역(AA1) 내지 제m 표시 영역(AA(m)) 각각에 데이터 전압을 출력하는 타이밍을 결정하는 신호이다.
즉, 도2 를 참조하면, n번째 화소 행에는 1수평 기간 동안 데이터 전압이 인가되므로, 1 수평 기간 이내에 제1 서브 데이터 인에이블 신호(SDE1) 내지 제(m) 서브 데이터 인에이블 신호(SDE(m))는 순차적으로 턴온 레벨인 하이 레벨로 출력될 수 있다.
구체적으로, 도 4를 참조하면, t1-t3 기간에는 제1 서브 데이터 인에이블 신호(SDE1)가 턴온 레벨이므로, t1-t3 기간에는 제1 소스 구동 집적 회로(SDIC#1)가 제1 표시 영역(AA1)의 n번째 행에 배치된 복수의 화소(PX)에 데이터 전압을 출력한다.
그리고, t3-t6 기간에는 제2 서브 데이터 인에이블 신호(SDE2)가 턴온 레벨이므로, t3-t6 기간에는 제2 소스 구동 집적 회로(SDIC#2)가 제1 표시 영역(AA2)의 n번째 행에 배치된 복수의 화소(PX)에 데이터 전압을 출력한다.
그리고, t(m-3)-t(m) 기간에는 제(m-1) 서브 데이터 인에이블 신호(SDE(m-1))가 턴온 레벨이므로, t(m-3)-t(m) 기간에는 제(m-1) 소스 구동 집적 회로(SDIC#(m-1))가 제(m-1) 표시 영역(AA(m-1))의 n번째 행에 배치된 복수의 화소(PX)에 데이터 전압을 출력한다.
그리고, t(m)-t(m+3) 기간에는 제(m) 서브 데이터 인에이블 신호(SDE(m))가 턴온 레벨이므로, t(m)-t(m+3) 기간에는 제(m) 소스 구동 집적 회로(SDIC#(m))가 제(m) 표시 영역(AA(m))의 n번째 행에 배치된 복수의 화소(PX)에 데이터 전압을 출력한다.
그리고, 도 4에 도시된 바와 같이, 제1 엣지 데이터 인에이블 신호(EDE1) 내지 제(m) 엣지 데이터 인에이블 신호(EDE(m)) 각각은 제1 소스 구동 집적 회로(SDIC#1) 내지 제(m) 소스 구동 집적 회로(SDIC#(m)) 각각이 제1 엣지 표시 영역(EA1) 내지 제m 엣지 표시 영역(EA(m)) 각각에 데이터 전압을 출력하는 타이밍을 결정하는 신호이다.
그리고, 복수의 엣지 데이터 인에이블 신호(EDE)는 복수의 프론트 엣지 데이터 인에이블 신호(FEA) 및 백 엣지 데이터 인에이블 신호(BDE)를 포함할 수 있다.
다만, 전술한 바와 같이, 제1 프론트 엣지 표시 영역 및 제m 백 엣지 표시 영역은 존재하지 않으므로, 제1 프론트 엣지 데이터 인에이블 신호 및 제m 백 엣지 데이터 인에이블 신호는 출력되지 않는다.
보다 상세히는, 제2 프론트 엣지 데이터 인에이블 신호(FDE2) 내지 제(m) 프론트 엣지 데이터 인에이블 신호(FDE(m)) 각각은 제2 소스 구동 집적 회로(SDIC#2) 내지 제(m) 소스 구동 집적 회로(SDIC#(m)) 각각이 제2 프론트 엣지 표시 영역(FEA(2)) 내지 제m 프론트 엣지 표시 영역(FEA(m)) 각각에 데이터 전압을 출력하는 타이밍을 결정하는 신호이다. 그리고, 제1 백 엣지 데이터 인에이블 신호(BDE1) 내지 제(m-1) 백 엣지 데이터 인에이블 신호(BDE(m)) 각각은 제1 소스 구동 집적 회로(SDIC#1) 내지 제(m-1) 소스 구동 집적 회로(SDIC#(m-1)) 각각이 제1 백 엣지 표시 영역(BEA1) 내지 제m 백 엣지 표시 영역(BEA(m-1)) 각각에 데이터 전압을 출력하는 타이밍을 결정하는 신호이다.
구체적으로, 도 4를 참조하면, t2-t3 기간에는 제1 백 엣지 데이터 인에이블 신호(BDE1)가 턴온 레벨이므로, t2-t3 기간에는 제1 소스 구동 집적 회로(SDIC#1)가 제1 백 엣지 표시 영역(BEA1)의 n번째 행에 배치된 복수의 화소(PX)에 데이터 전압을 출력한다.
그리고, t3-t4 기간에는 제2 프론트 엣지 데이터 인에이블 신호(FDE2)가 턴온 레벨이므로, t3-t4 기간에는 제2 소스 구동 집적 회로(SDIC#2)가 제2 프론트 엣지 표시 영역(FEA2)의 n번째 행에 배치된 복수의 화소(PX)에 데이터 전압을 출력한다.
그리고, t5-t6 기간에는 제2 백 엣지 데이터 인에이블 신호(FDE2)가 턴온 레벨이므로, t5-t6 기간에는 제2 소스 구동 집적 회로(SDIC#2)가 제2 백 엣지 표시 영역(BEA2)의 n번째 행에 배치된 복수의 화소(PX)에 데이터 전압을 출력한다.
그리고, t(m-3)-t(m-2) 기간에는 제(m-1) 프론트 엣지 데이터 인에이블 신호(FDE(m-1))가 턴온 레벨이므로, t(m-3)-t(m-2) 기간에는 제(m-1) 소스 구동 집적 회로(SDIC#(m-1))가 제(m-1) 프론트 엣지 표시 영역(FEA(m-1))의 n번째 행에 배치된 복수의 화소(PX)에 데이터 전압을 출력한다.
그리고, t(m-1)-t(m) 기간에는 제(m-1) 백 엣지 데이터 인에이블 신호(BDE(m-1))가 턴온 레벨이므로, t(m-1)-t(m) 기간에는 제(m-1) 소스 구동 집적 회로(SDIC#(m-1))가 제(m-1) 백 엣지 표시 영역(BEA(m-1))의 n번째 행에 배치된 복수의 화소(PX)에 데이터 전압을 출력한다.
그리고, t(m)-t(m+1) 기간에는 제(m) 프론트 엣지 데이터 인에이블 신호(FDE(m))가 턴온 레벨이므로, t(m)-t(m+1) 기간에는 제(m) 소스 구동 집적 회로(SDIC#(m))가 제(m) 프론트 엣지 표시 영역(FEA)의 n번째 행에 배치된 복수의 화소(PX)에 데이터 전압을 출력한다.
데이터 지연 단계(S120)에서 비디오 데이터(Data)를 인가 받아, 이를 1수평 기간만큼 지연 시킨 뒤 출력한다.
데이터 지연 단계(S120)에서 비디오 데이터(Data)를 내부 메모리에 저장하여, 이를 1 수평 기간만큼 지연시킨 뒤, 지연된 비디오 데이터(D_Data)를 출력한다.
예를 들어, n-1 번째 수평 기간에서, n번째 행에 해당하는 비디오 데이터(Data)를 저장한 뒤, n+1 번째 수평 기간에서, n번째 행에 해당하는 지연된 비디오 데이터(D_Data)를 출력한다.
그리고, 데이터 비교 단계(S130)에서는 복수의 서브 데이터 인에이블 신호(SDE)가 턴온 레벨인 동안에, 복수의 표시 영역(AA)에 대응되는 비디오 데이터(Data)와 지연된 비디오 데이터(D_Data)를 비교하여, 복수의 비교 데이터(CD) 각각을 생성한다. 달리 표현하면, 상술한 비교 데이터(CD)는 복수의 표시 영역(AA) 각각에서 인접된 화소 행끼리의 최대 데이터 전환 값을 의미할 수 있다.
보다 상세히는, 데이터 비교 단계(S130)에서는 제1 서브 데이터 인에이블 신호(SDE1)가 턴온 레벨인 동안에, 제1 표시 영역(AA1)에 대응되는 비디오 데이터(Data)와 지연된 비디오 데이터(D_Data)를 비교하여, 비디오 데이터(Data)와 지연된 비디오 데이터(D_Data)의 최대값을 제1 비교 데이터(CD1)로 출력한다.
그리고, 데이터 비교 단계(S130)에서는 제(m-1) 서브 데이터 인에이블 신호(SDE(m-1))가 턴온 레벨이므로, 제(m-1) 표시 영역(AA(m-1))에 대응되는 비디오 데이터(Data)와 지연된 비디오 데이터(D_Data)를 비교하여, 비디오 데이터(Data)와 지연된 비디오 데이터(D_Data)의 최대값을 제(m-1) 비교 데이터(CD(m-1))로 출력한다.
그리고, 데이터 비교 단계(S130)에서는 제(m) 서브 데이터 인에이블 신호(SDE(m))가 턴온 레벨이므로, 제(m) 표시 영역(AA(m))에 대응되는 비디오 데이터(Data)와 지연된 비디오 데이터(D_Data)를 비교하여, 비디오 데이터(Data)와 지연된 비디오 데이터(D_Data)의 최대값을 제(m) 비교 데이터(CD(m))로 출력한다.
예를 들면, 도 4를 참조하면, t1-t2 기간에는 제1 서브 데이터 인에이블 신호(SDE1)가 턴온 레벨이므로, t1-t2 기간에는 제1 표시 영역(AA1)의 복수의 화소(PX) 열 각각에 대한 비디오 데이터(Data)와 지연된 비디오 데이터(D_Data)의 최대값을 제1 비교 데이터(CD1)로 출력한다.
그리고, t(m-3)-t(m) 기간에는 제(m-1) 서브 데이터 인에이블 신호(SDE(m-1))가 턴온 레벨이므로, t(m-3)-t(m) 기간에는 제(m-1) 표시 영역(AA(m-1))의 복수의 화소(PX) 열 각각에 대한 비디오 데이터(Data)와 지연된 비디오 데이터(D_Data)의 최대값을 제(m-1) 비교 데이터(CD(m-1))로 출력한다.
그리고, t(m)-t(m+3) 기간에는 제(m) 서브 데이터 인에이블 신호(SDE(m))가 턴온 레벨이므로, t(m)-t(m+3) 기간에는 제(m) 표시 영역(AA(m))의 복수의 화소(PX) 열 각각에 대한 비디오 데이터(Data)와 지연된 비디오 데이터(D_Data)의 최대값을 제(m) 비교 데이터(CD(m))로 출력한다.
그리고, 데이터 비교 단계(S130)에서는 복수의 엣지 데이터 인에이블 신호(EDE)가 턴온 레벨인 동안에, 복수의 엣지 표시 영역(EA)에서 비디오 데이터(Data)와 지연된 비디오 데이터(D_Data)를 비교하여, 복수의 엣지 비교 데이터(ECD) 각각을 생성한다. 달리 표현하면, 상술한 엣지 비교 데이터(ECD)는 복수의 엣지 표시 영역(EA) 각각에서 인접된 화소(PX) 행끼리의 최대 데이터 전환 값을 의미할 수 있다.
보다 상세히는, 데이터 비교 단계(S130)에서는 제1 엣지 데이터 인에이블 신호(EDE1)가 턴온 레벨인 동안에, 제1 엣지 표시 영역(EA1)에 대응되는 비디오 데이터(Data)와 지연된 비디오 데이터(D_Data)를 비교하여, 비디오 데이터(Data)와 지연된 비디오 데이터(D_Data)의 최대값을 제1 엣지 비교 데이터(ECD1)로 출력한다.
그리고, 데이터 비교 단계(S130)에서는 제(m-1) 엣지 데이터 인에이블 신호(EDE(m-1))가 턴온 레벨인 동안에, 제(m-1) 엣지 표시 영역(EA)에 대응되는 비디오 데이터(Data)와 지연된 비디오 데이터(D_Data)를 비교하여, 비디오 데이터(Data)와 지연된 비디오 데이터(D_Data)의 최대값을 제(m-1) 엣지 비교 데이터(CD(m-1))로 출력한다.
그리고, 데이터 비교 단계(S130)에서는 제(m) 엣지 데이터 인에이블 신호(EDE(m))가 턴온 레벨인 동안에, 제(m) 엣지 표시 영역(EA)에 대응되는 비디오 데이터(Data)와 지연된 비디오 데이터(D_Data)를 비교하여, 비디오 데이터(Data)와 지연된 비디오 데이터(D_Data)의 최대값을 제(m) 엣지 비교 데이터(ECD(m))로 출력한다.
예를 들면, 도 4를 참조하면, t2-t3 기간에는 제1 백 엣지 데이터 인에이블 신호(BDE1)가 턴온 레벨이므로, 제1 백 엣지 표시 영역(BEA1)에 대응되는 비디오 데이터(Data)와 지연된 비디오 데이터(D_Data)를 비교하여, 비디오 데이터(Data)와 지연된 비디오 데이터(D_Data)의 최대값을 제1 엣지 비교 데이터(ECD1)로 출력한다.
그리고, t(m-3)-t(m-2) 기간에는 제(m-1) 프론트 엣지 데이터 인에이블 신호(FDE(m-1))가 턴온 레벨이므로, 제(m-1) 프론트 엣지 표시 영역(FEA(m-1))에 대응되는 비디오 데이터(Data)와 지연된 비디오 데이터(D_Data)를 비교하여, 비디오 데이터(Data)와 지연된 비디오 데이터(D_Data)의 최대값을 제(m-1) 엣지 비교 데이터(ECD(m-1))로 출력한다.
그리고, t(m-1)-t(m) 기간에는 제(m-1) 백 엣지 데이터 인에이블 신호(BDE(m-1))가 턴온 레벨이므로, 제(m-1) 백 엣지 표시 영역(BEA(m-1))에 대응되는 비디오 데이터(Data)와 지연된 비디오 데이터(D_Data)를 비교하여, 비디오 데이터(Data)와 지연된 비디오 데이터(D_Data)의 최대값을 제(m-1) 엣지 비교 데이터(ECD(m-1))로 출력한다.
그리고, t(m)-t(m+1) 기간에는 제(m) 프론트 엣지 데이터 인에이블 신호(FDE(m))가 턴온 레벨이므로, 제(m) 프론트 엣지 표시 영역(FEA(m))에 대응되는 비디오 데이터(Data)와 지연된 비디오 데이터(D_Data)를 비교하여, 비디오 데이터(Data)와 지연된 비디오 데이터(D_Data)의 최대값을 제(m) 엣지 비교 데이터(ECD(m))로 출력한다.
제1 기준 값 설정 단계(S140)에서는 비교 데이터(CD)를 제1 LUT(1st Look-Up Table)에 저장된 복수의 임계 값(Threshold)과 비교하여, 제1 기준 값(SV1)을 설정한다. 예를 들어, 비교 데이터(CD)가 제1 임계 값(Th 1) 이하일 경우에는 제1 기준 값(SV1)을 0(LLL)으로 설정하고, 비교 데이터(CD)가 제1 임계 값(Th 1) 초과 내지 제2 임계 값(Th 2) 이하일 경우에는 제1 기준 값(SV1)을 1(LLH)으로 설정하고, 비교 데이터(CD)가 제2 임계 값(Th 2) 초과 내지 제3 임계 값(Th 3) 이하일 경우에는 제1 기준 값(SV1)을 1(LLH)으로 설정하고, 비교 데이터(CD)가 제3 임계 값(Th 3) 초과 내지 제4 임계 값(Th 4) 이하일 경우에는 제1 기준 값(SV1)을 2(LHL)으로 설정하고, 비교 데이터(CD)가 제4 임계 값(Th 4) 초과 내지 제5 임계 값(Th 5) 이하일 경우에는 제1 기준 값(SV1)을 2(LHL)으로 설정하고, 비교 데이터(CD)가 제5 임계 값(Th 5) 초과 내지 제6 임계 값(Th 6) 이하일 경우에는 제1 기준 값(SV1)을 3(LHH)으로 설정하고, 비교 데이터(CD)가 제6 임계 값(Th 6) 초과 내지 제7 임계 값(Th 7) 이하일 경우에는 제1 기준 값(SV1)을 4(HLL)으로 설정하고, 비교 데이터(CD)가 제7 임계 값(Th 7) 초과 내지 제8 임계 값(Th 8) 이하일 경우에는 제1 기준 값(SV1)을 4(HLL)으로 설정하고, 비교 데이터(CD)가 제8 임계 값(Th 8) 초과 일 경우에는 제1 기준 값(SV1)을 4(HLL)으로 설정한다. 상술한 제1 임계 값(Th 1) 내지 제8 임계 값(Th 8)은 제1 파워 제어 신호 생성부(144(1)), 제(m-1) 파워 제어 신호 생성부(144(m-1)) 및 제(m) 파워 제어 신호 생성부(144(m)) 각각의 메모리에 저장된 값으로서, 설정에 따라 달라질 수 있다.
그리고, 제2 기준 값 설정 단계(S150)에서는 엣지 비교 데이터(ECD)를 제2 LUT(2nd Look-Up Table)에 저장된 복수의 임계 값과 비교하여, 제2 기준 값(SV2)을 설정한다. 예를 들어, 엣지 비교 데이터(ECD)가 제1 임계 값(Th 1) 이하일 경우에는 제2 기준 값(SV2)을 0(LLL)으로 설정하고, 엣지 비교 데이터(ECD)가 제1 임계 값(Th 1) 초과 내지 제2 임계 값(Th 2) 이하일 경우에는 제2 기준 값(SV2)을 1(LLH)으로 설정하고, 엣지 비교 데이터(ECD)가 제2 임계 값(Th 2) 초과 내지 제3 임계 값(Th 3) 이하일 경우에는 제2 기준 값(SV2)을 1(LLH)으로 설정하고, 엣지 비교 데이터(ECD)가 제3 임계 값(Th 3) 초과 내지 제4 임계 값(Th 4) 이하일 경우에는 제2 기준 값(SV2)을 2(LHL)으로 설정하고, 엣지 비교 데이터(ECD)가 제4 임계 값(Th 4) 초과 내지 제5 임계 값(Th 5) 이하일 경우에는 제2 기준 값(SV2)을 2(LHL)으로 설정하고, 엣지 비교 데이터(ECD)가 제5 임계 값(Th 5) 초과 내지 제6 임계 값(Th 6) 이하일 경우에는 제2 기준 값(SV2)을 3(LHH)으로 설정하고, 엣지 비교 데이터(ECD)가 제6 임계 값(Th 6) 초과 내지 제7 임계 값(Th 7) 이하일 경우에는 제2 기준 값(SV2)을 4(HLL)으로 설정하고, 엣지 비교 데이터(ECD)가 제7 임계 값(Th 7) 초과 내지 제8 임계 값(Th 8) 이하일 경우에는 제2 기준 값(SV2)을 4(HLL)으로 설정하고, 엣지 비교 데이터(ECD)가 제8 임계 값(Th 8) 초과 일 경우에는 제2 기준 값(SV2)을 4(HLL)으로 설정한다. 상술한 제1 임계 값(Th 1) 내지 제8 임계 값(Th 8)은 제1 파워 제어 신호 생성부(144(1)), 제(m-1) 파워 제어 신호 생성부(144(m-1)) 및 제(m) 파워 제어 신호 생성부(144(m)) 각각의 메모리에 저장된 값으로서, 설정에 따라 달라질 수 있다.
다음으로 보상 값 설정 단계(S160)에서는 해당 표시 영역에 대응하는 제1 기준 값(SV1)과 인접 엣지 표시 영역의 제2 기준 값(SV2)의 차이 값(DV)을 도출하고, 차이 값(DV)을 제3 LUT(3rd Look-Up Table)에 적용하여, 보상 값(CV)을 설정한다.
보다 구체적으로, 보상 값 설정 단계(S160)에서는 해당 표시 영역에 대응하는 제1 기준 값(SV1)과 인접 엣지 표시 영역에 대응하는 제2 기준 값(SV2)의 차이 값(DV)이 0(LLL)인 경우에는 보상 값(CV)을 0(LLL)으로 설정하고, 해당 표시 영역에 대응하는 제1 기준 값(SV1)과 인접 엣지 표시 영역에 대응하는 제2 기준 값(SV2)의 차이 값(DV)이 1(LLH)인 경우에는 보상 값(CV)을 0(LLL)으로 설정하고, 해당 표시 영역에 대응하는 제1 기준 값(SV1)과 인접 엣지 표시 영역에 대응하는 제2 기준 값(SV2)의 차이 값(DV)이 2(LHL)인 경우에는 보상 값(CV)을 1(LLH)으로 설정하고, 해당 표시 영역에 대응하는 제1 기준 값(SV1)과 인접 엣지 표시 영역에 대응하는 제2 기준 값(SV2)의 차이 값(DV)이 3(LHH)인 경우에는 보상 값(CV)을 1(LLH)으로 설정하고, 해당 표시 영역에 대응하는 제1 기준 값(SV1)과 인접 엣지 표시 영역에 대응하는 제2 기준 값(SV2)의 차이 값(DV)이 3(LHH)인 경우에는 보상 값(CV)을 1(LLH)으로 설정하고, 해당 표시 영역에 대응하는 제1 기준 값(SV1)과 인접 엣지 표시 영역에 대응하는 제2 기준 값(SV2)의 차이 값(DV)이 4(HLL)인 경우에는 보상 값(CV)을 2(LHL)으로 설정한다.
그리고, 파워 제어 신호 출력 단계(S170)에서는 제1 기준 값(SV1)에 보상 값(CV)을 더하여, 파워 제어 신호(PWRC)로 출력한다.
예를 들어, 파워 제어 신호 출력 단계(S170)에서는 제1 표시 영역에 대응하는 제1 기준 값(SV1)과 제2 프론트 엣지 표시 영역에 대응하는 제2 기준 값(SV2)의 차이 값(DV)에 따라, 보상 값(CV)을 설정한다. 그리고, 제1 표시 영역에 대응하는 제1 기준 값(SV1)에 보상 값(CV)을 더하여, 제1 파워 제어 신호(PWRC1)로 출력한다.
파워 제어 신호 출력 단계(S170)에서는 제(m-1) 표시 영역에 대응하는 제1 기준 값(SV1)과 제m 프론트 엣지 표시 영역에 대응하는 제2 기준 값(SV2)의 차이 값(DV)에 따라, 보상 값(CV)을 설정한다. 그리고, 제(m-1) 표시 영역에 대응하는 제1 기준 값(SV1)에 보상 값(CV)을 더하여, 제(m-1) 파워 제어 신호(PWRC(m-1))로 출력한다.
파워 제어 신호 출력 단계(S170)에서는 제(m) 표시 영역에 대응하는 제1 기준 값(SV1)과 제(m-1) 백 엣지 표시 영역에 대응하는 제2 기준 값(SV2)의 차이 값(DV)에 따라, 보상 값(CV)을 설정한다. 그리고, 제(m) 표시 영역에 대응하는 제1 기준 값(SV1)에 보상 값(CV)을 더하여, 제(m) 파워 제어 신호(PWRC(m))로 출력한다.
구체적으로 수치를 대입하면, 제(m) 표시 영역에 대응하는 제1 기준 값(SV1)이 0(LLL)이고, 제(m-1) 백 엣지 표시 영역에 대응하는 제2 기준 값(SV2)이 4(HLL) 인 경우, 차이 값(DV)는 4(HLL)이므로, 보상 값(CV)은 2(LHL)일 수 있다. 이에, 제(m) 파워 제어 신호 생성부(144(m))는 제(m) 표시 영역에 대응하는 제1 기준 값(SV1)인 0(LLL)에 보상 값(CV)인 2(LHL)를 더하여, 제(m) 파워 제어 신호(PWRC(m))를 2(LHL)로 출력할 수 있다.
이에, 파워 제어 신호(PWRC)에 따라, 소스 구동 집적 회로(SDIC)의 버퍼(134)의 증폭비(amplification ratio)를 제어 함으로써, 소스 구동 집적 회로(SDIC)의 버퍼(134)의 소비 전력을 제어할 수 있다.
전술한 바와 같이, 본 발명의 일 실시예에 따른 표시 장치의 구동 방법에 따르면, 복수의 표시 영역 각각에 배치된 인접 화소 행끼리의 최대 데이터 전환 값인 비교 데이터와 복수의 엣지 표시 영역에 배치된 인접 화소 행끼리의 최대 데이터 전환 값인 엣지 비교 데이터의 차이 값에 따라 파워 제어 신호를 생성함으로써, 복수의 소스 구동 집적 회로의 구동 전류의 세기를 제어할 수 있다.
구동 전류의 세기에 엣지 표시 영역의 데이터 전환 정도가 반영됨으로써, 복수의 표시 영역에 동일 계조를 표현하는 데이터 전압이 인가될 때, 경계 영역에서 블락 딤(Block Dim)과 같은 불량을 방지할 수 있다.
또한, 본 발명의 일 실시예에 따른 표시 장치의 구동 방법에 따르면 복수의 표시 영역 각각에 배치된 인접 화소 행끼리의 최대 데이터 전환 값인 비교 데이터를 이용하여, 복수의 소스 구동 집적 회로의 구동 전류의 세기를 조절할 수 있으므로, 각 표시 영역별 최적 구동 전류 세기를 셋팅할 수 있다.
이에, 각 표시 영역 마다 최적의 구동 전력을 결정할 수 있으므로, 본 발명의 일 실시예에 따른 표시 장치의 소비 전력은 최적화될 수 있다.
본 발명의 실시예들에 따른 표시 장치는 다음과 같이 설명될 수 있다.
본 발명의 일 실시예에 따른 표시 장치는 복수의 표시 영역으로 구분되는 표시 패널, 복수의 표시 영역 각각에 배치된 복수의 화소에 데이터 전압을 공급하는 데이터 구동부 및 데이터 구동부에 구동 전류를 제어하기 위한 파워 제어 신호를 출력하는 타이밍 제어부를 포함하고, 복수의 표시 영역 각각은 복수의 표시 영역 각각에 배치된 복수의 화소 열 중 중앙부에 위치한 복수의 화소 열이 배치되는 중앙 표시 영역 및 복수의 표시 영역 각각에 배치된 복수의 화소 열 중 외측부에 위치한 복수의 화소 열이 배치되는 엣지 표시 영역으로 구분되고, 데이터 구동부는 복수의 표시 영역 각각에 데이터 전압을 공급하는 복수의 소스 구동 집적 회로를 포함하고, 타이밍 제어부는, 복수의 표시 영역 각각에 배치된 인접 화소 행 끼리의 최대 데이터 전환 값인 비교 데이터와 복수의 엣지 표시 영역에 배치된 인접 화소 행 끼리의 최대 데이터 전환 값인 엣지 비교 데이터의 차이 값에 따라 파워 제어 신호를 생성하여, 표시 영역 경계의 화상 품질을 향상시킬 수 있다.
본 발명의 다른 특징에 따르면, 타이밍 제어부는 복수의 표시 영역 각각에 데이터 전압을 출력하는 타이밍을 결정하는 서브 데이터 인에이블 신호 및 복수의 엣지 표시 영역 각각에 데이터 전압을 출력하는 타이밍을 결정하는 엣지 데이터 인에이블 신호를 생성하는 데이터 인에이블 신호 생성부, 비디오 데이터를 1 수평 기간만큼 지연시켜, 지연된 비디오 데이터출력하는 데이터 지연부, 비디오 데이터와 지연된 비디오 데이터를 비교하여, 비교 데이터와 엣지 비교 데이터를 생성하는 데이터 비교부 및 비교 데이터와 엣지 비교 데이터를 이용하여, 파워 제어 신호를 생성하는 파워 제어 신호 생성부를 포함할 수 있다.
본 발명의 또 다른 특징에 따르면, 파워 제어 신호 생성부는 비교 데이터를 제1 LUT(1st Look-Up Table)에 적용하여, 제1 기준 값을 설정하고, 엣지 비교 데이터를 제2 LUT(2nd Look-Up Table)에 적용하여, 제2 기준 값을 설정하고, 해당 표시 영역에 대응하는 제1 기준 값과 상기 해당 표시 영역에 인접하는 엣지 표시 영역에 대응하는 제2 기준 값의 차이 값을 제3 LUT(3rd Look-Up Table)에 적용하여, 보상 값을 설정하고, 해당 표시 영역에 대응하는 제1 기준 값에 상기 보상 값을 더하여, 상기 파워 제어 신호로 출력할 수 있다.
본 발명의 또 다른 특징에 따르면, 데이터 비교부는, 서브 데이터 인에이블 신호가 턴온 레벨인 동안에, 복수의 표시 영역에 대응되는 비디오 데이터와 지연된 비디오 데이터를 비교하여, 복수의 비교 데이터 각각을 생성할 수 있다.
본 발명의 또 다른 특징에 따르면, 데이터 비교부는 엣지 데이터 인에이블 신호가 턴온 레벨인 동안에, 복수의 엣지 표시 영역에 대응되는 비디오 데이터와 지연된 비디오 데이터를 비교하여, 복수의 엣지 비교 데이터 각각을 생성할 수 있다.
본 발명의 또 다른 특징에 따르면, 복수의 소스 구동 집적 회로 각각은 데이터 제어 신호에 따라, 순차적으로 데이터 샘플링 시점을 결정하는 쉬프트 레지스터, 데이터 샘플링 시점에 따라, 디지털 비디오 데이터를 순차적으로 정렬하는 래치, 디지터 비디오 데이터를 아날로그 감마 전압을 이용하여 데이터 전압으로 변환하는 디지털 아날로그 컨버터, 데이터 전압을 데이터 라인에 출력하는 버퍼 및 파워 제어 신호에 따라 버퍼에 구동 전류를 공급하는 파워 제어 회로를 포함할 수 있다.
본 발명의 또 다른 특징에 따르면, 파워 제어 회로는 복수의 전류원, 복수의 전류원 각각에 연결되어, 복수의 전류원을 제어하는 복수의 스위치 및 복수의 스위치의 온 상태에 따라 결정된 구동 전류를 버퍼에 출력하는 전류 미러 회로를 포함할 수 있다.
본 발명의 일 실시예에 따른 표시 장치의 구동 방법은 비디오 데이터를 1 수평 기간만큼 지연시켜, 지연된 비디오 데이터를 출력하는 데이터 지연 단계, 비디오 데이터와 지연된 비디오 데이터를 비교하여, 비교 데이터와 엣지 비교 데이터를 생성하는 데이터 비교 단계, 교 데이터를 제1 LUT(1st Look-Up Table)에 적용하여, 제1 기준 값을 설정하는 제1 기준 값 설정 단계, 엣지 비교 데이터를 제2 LUT(2nd Look-Up Table)에 적용하여, 제2 기준 값을 설정하는 제2 기준 값 설정 단계, 해당 표시 영역에 대응하는 제1 기준 값과 해당 표시 영역에 인접하는 엣지 표시 영역에 대응하는 제2 기준 값의 차이 값을 제3 LUT(3rd Look-Up Table)에 적용하여, 보상 값을 설정하는 보상 값 도출 단계 및 해당 표시 영역에 대응하는 제1 기준 값에 보상 값을 더하여, 파워 제어 신호로 출력하는 파워 제어 신호 출력 단계를 포함할 수 있다.
본 발명의 다른 특징에 따르면, 본 발명의 일 실시예에 따른 표시 장치는 데이터 비교 단계 이전에, 복수의 표시 영역 각각에 데이터 전압을 출력하는 타이밍을 결정하는 서브 데이터 인에이블 신호 및 복수의 엣지 표시 영역 각각에 데이터 전압을 출력하는 타이밍을 결정하는 엣지 데이터 인에이블 신호를 생성하는 데이터 인에이블 신호 생성 단계를 더 포함할 수 있다.
본 발명의 또 다른 특징에 따르면, 데이터 비교 단계에서, 서브 데이터 인에이블 신호가 턴온 레벨인 동안에 복수의 표시 영역에 대응되는 비디오 데이터와 지연된 비디오 데이터를 비교하여, 복수의 비교 데이터 각각을 생성할 수 있다.
본 발명의 또 다른 특징에 따르면, 데이터 비교 단계에서, 엣지 데이터 인에이블 신호가 턴온 레벨인 동안에, 복수의 엣지 표시 영역에 대응되는 비디오 데이터와 지연된 비디오 데이터를 비교하여, 복수의 엣지 비교 데이터 각각을 생성할 수 있다.
본 발명의 또 다른 특징에 따르면, 엣지 표시 영역은 이전 표시 영역에 인접하는 프론트 엣지 표시 영역 및 다음 표시 영역에 인접하는 백 엣지 표시 영역을 포함할 수 있다.
본 발명의 또 다른 특징에 따르면, 파워 제어 신호 생성부는 보상 값 도출 단계에서, 해당 표시 영역에 대응하는 제1 기준 값과 이전 표시 영역의 백 엣지 표시 영역에 대응하는 제2 기준 값의 차이 값을 제3 LUT(3rd Look-Up Table)에 적용하여, 보상 값을 설정할 수 있거나, 해당 표시 영역에 대응하는 제1 기준 값과 다음 표시 영역의 프론트 엣지 표시 영역에 대응하는 제2 기준 값의 차이 값을 제3 LUT(3rd Look-Up Table)에 적용하여, 보상 값을 설정할 수 있다.
이상 첨부된 도면을 참조하여 본 발명의 실시예들을 더욱 상세하게 설명하였으나, 본 발명은 반드시 이러한 실시예로 국한되는 것은 아니고, 본 발명의 기술사상을 벗어나지 않는 범위 내에서 다양하게 변형실시될 수 있다. 따라서, 본 발명에 개시된 실시예들은 본 발명의 기술 사상을 제한하기 위한 것이 아니라 설명하기 위한 것이고, 이러한 실시예에 의하여 본 발명의 기술 사상의 범위가 제한되는 것은 아니다. 그러므로, 이상에서 기술한 실시예들은 모든 면에서 예시적인 것이며 제한적이 아닌 것으로 이해해야만 한다. 본 발명의 보호 범위는 아래의 청구범위에 의하여 해석되어야 하며, 그와 동등한 범위 내에 있는 모든 기술 사상은 본 발명의 권리범위에 포함되는 것으로 해석되어야 할 것이다.
100: 표시 장치
110: 표시 패널
120: 게이트 구동부
130: 데이터 구동부
131: 쉬프트 레지스터
132: 래치
133: 디지털 아날로그 컨버터(Digital-Analog Converter; DAC)
134: 버퍼
135: 파워 제어 회로
140: 타이밍 제어부
141: 데이터 인에이블 신호 생성부
142: 데이터 지연부
143: 데이터 비교부
144: 파워 제어 신호 생성부
SDE: 서브 데이터 인에이블 신호
EDE: 엣지 데이터 인에이블 신호
FDE: 프론트 엣지 데이터 인에이블 신호
BDE: 백 엣지 데이터 인에이블 신호
CD: 비교 데이터
ECD: 엣지 비교 데이터
PWRC: 파워 제어 신호
PX: 화소
AA: 표시 영역
NA: 비표시 영역
SDIC: 소스 구동 집적 회로
DL: 데이터 라인
GL: 게이트 라인
EA: 엣지 표시 영역
FEA: 프론트 엣지 표시 영역
BEA: 백 엣지 표시 영역
I: 전류원
SW: 스위치
MT1: 제1 미러 트랜지스터
MT2: 제2 미러 트랜지스터
S110: 데이터 인에이블 신호 생성 단계
S120: 데이터 지연 단계
S130: 데이터 비교 단계
S140: 제1 기준 값 설정 단계
S150: 제2 기준 값 설정 단계
S160: 보상 값 도출 단계
S170: 파워 제어 신호 출력 단계

Claims (16)

  1. 복수의 표시 영역으로 구분되는 표시 패널;
    상기 복수의 표시 영역 각각에 배치된 복수의 화소에 데이터 전압을 공급하는 데이터 구동부; 및
    상기 데이터 구동부의 구동 전류를 제어하기 위한 파워 제어 신호를 출력하는 타이밍 제어부;를 포함하고,
    상기 복수의 표시 영역 각각은,
    상기 복수의 표시 영역 각각에 배치된 복수의 화소 열 중 중앙부에 위치한 복수의 화소 열이 배치되는 중앙 표시 영역 및
    상기 복수의 표시 영역 각각에 배치된 복수의 화소 열 중 외측부에 위치한 복수의 화소 열이 배치되는 엣지 표시 영역으로 구분되고,
    상기 데이터 구동부는 상기 복수의 표시 영역 각각에 상기 데이터 전압을 공급하는 복수의 소스 구동 집적 회로를 포함하고,
    상기 타이밍 제어부는, 상기 복수의 표시 영역 각각에 배치된 인접 화소 행 끼리의 최대 데이터 전환 값인 비교 데이터와 상기 복수의 엣지 표시 영역에 배치된 인접 화소 행 끼리의 최대 데이터 전환 값인 엣지 비교 데이터의 차이 값에 따라 상기 파워 제어 신호를 생성하는, 표시 장치.
  2. 제1항에 있어서,
    상기 타이밍 제어부는,
    상기 복수의 표시 영역 각각에 상기 데이터 전압을 출력하는 타이밍을 결정하는 서브 데이터 인에이블 신호 및 상기 복수의 엣지 표시 영역 각각에 상기 데이터 전압을 출력하는 타이밍을 결정하는 엣지 데이터 인에이블 신호를 생성하는 데이터 인에이블 신호 생성부;
    비디오 데이터를 1 수평 기간만큼 지연시켜, 지연된 비디오 데이터를 출력하는 데이터 지연부;
    상기 비디오 데이터와 상기 지연된 비디오 데이터를 비교하여, 상기 비교 데이터와 상기 엣지 비교 데이터를 생성하는 데이터 비교부; 및
    상기 비교 데이터와 상기 엣지 비교 데이터를 이용하여, 상기 파워 제어 신호를 생성하는 파워 제어 신호 생성부를 포함하는, 표시 장치.
  3. 제2항에 있어서,
    상기 파워 제어 신호 생성부는
    상기 비교 데이터를 제1 LUT(1st Look-Up Table)에 적용하여, 제1 기준 값을 설정하고,
    상기 엣지 비교 데이터를 제2 LUT(2nd Look-Up Table)에 적용하여, 제2 기준 값을 설정하고,
    해당 표시 영역에 대응하는 제1 기준 값과 상기 해당 표시 영역에 인접하는 엣지 표시 영역에 대응하는 제2 기준 값의 차이 값을 제3 LUT(3rd Look-Up Table)에 적용하여, 보상 값을 설정하고,
    상기 해당 표시 영역에 대응하는 제1 기준 값에 상기 보상 값을 더하여, 상기 파워 제어 신호로 출력하는, 표시 장치.
  4. 제3항에 있어서,
    상기 엣지 표시 영역은 이전 표시 영역에 인접하는 프론트 엣지 표시 영역 및 다음 표시 영역에 인접하는 백 엣지 표시 영역을 포함하는, 표시 장치.
  5. 제4항에 있어서,
    상기 파워 제어 신호 생성부는
    상기 해당 표시 영역에 대응하는 제1 기준 값과 이전 표시 영역의 백 엣지 표시 영역에 대응하는 제2 기준 값의 차이 값을 제3 LUT(3rd Look-Up Table)에 적용하여, 상기 보상 값을 설정하는, 표시 장치.
  6. 제4항에 있어서,
    상기 파워 제어 신호 생성부는
    상기 해당 표시 영역에 대응하는 제1 기준 값과 다음 표시 영역의 프론트 엣지 표시 영역에 대응하는 제2 기준 값의 차이 값을 제3 LUT(3rd Look-Up Table)에 적용하여, 상기 보상 값을 설정하는, 표시 장치.
  7. 제2항에 있어서,
    상기 데이터 비교부는,
    상기 서브 데이터 인에이블 신호가 턴온 레벨인 동안에,
    상기 복수의 표시 영역에 대응되는 비디오 데이터와 지연된 비디오 데이터를 비교하여, 복수의 비교 데이터 각각을 생성하는, 표시 장치.
  8. 제2항에 있어서,
    상기 데이터 비교부는
    상기 엣지 데이터 인에이블 신호가 턴온 레벨인 동안에,
    상기 복수의 엣지 표시 영역에 대응되는 비디오 데이터와 지연된 비디오 데이터를 비교하여, 복수의 엣지 비교 데이터 각각을 생성하는, 표시 장치.
  9. 제1항에 있어서,
    복수의 소스 구동 집적 회로 각각은,
    상기 데이터 제어 신호에 따라, 순차적으로 데이터 샘플링 시점을 결정하는 쉬프트 레지스터,
    상기 데이터 샘플링 시점에 따라, 디지털 비디오 데이터를 순차적으로 정렬하는 래치,
    상기 디지터 비디오 데이터를 아날로그 감마 전압을 이용하여 상기 데이터 전압으로 변환하는 디지털 아날로그 컨버터,
    상기 데이터 전압을 데이터 라인에 출력하는 버퍼 및
    상기 파워 제어 신호에 따라 상기 버퍼에 구동 전류를 공급하는 파워 제어 회로를 포함하는, 표시 장치.
  10. 제9항에 있어서,
    상기 파워 제어 회로는
    복수의 전류원;
    상기 복수의 전류원 각각에 연결되어, 복수의 전류원을 제어하는 복수의 스위치; 및
    복수의 스위치의 온 상태에 따라 결정된 구동 전류를 상기 버퍼에 출력하는 전류 미러 회로를 포함하는, 표시 장치.
  11. 복수의 표시 영역으로 구분되는 표시 패널; 및
    상기 복수의 표시 영역 각각에 배치된 복수의 화소에 데이터 전압을 공급하는 데이터 구동부를 포함하고,
    상기 복수의 표시 영역 각각은,
    상기 복수의 표시 영역 각각에 배치된 복수의 화소 열 중 중앙부에 위치한 복수의 화소 열이 배치되는 중앙 표시 영역 및
    상기 복수의 표시 영역 각각에 배치된 복수의 화소 열 중 외측부에 위치한 복수의 화소 열이 배치되는 엣지 표시 영역으로 구분되고,
    상기 데이터 구동부는 파워 신호에 의해 구동 전류가 제어되는 복수의 소스 구동 집적 회로를 포함하는 표시 장치의 구동 방법에 있어서,
    비디오 데이터를 1 수평 기간만큼 지연시켜, 지연된 비디오 데이터를 출력하는 데이터 지연 단계,
    상기 비디오 데이터와 상기 지연된 비디오 데이터를 비교하여, 상기 비교 데이터와 상기 엣지 비교 데이터를 생성하는 데이터 비교 단계,
    상기 비교 데이터를 제1 LUT(1st Look-Up Table)에 적용하여, 제1 기준 값을 설정하는 제1 기준 값 설정 단계,
    상기 엣지 비교 데이터를 제2 LUT(2nd Look-Up Table)에 적용하여, 제2 기준 값을 설정하는 제2 기준 값 설정 단계,
    해당 표시 영역에 대응하는 제1 기준 값과 상기 해당 표시 영역에 인접하는 엣지 표시 영역에 대응하는 제2 기준 값의 차이 값을 제3 LUT(3rd Look-Up Table)에 적용하여, 보상 값을 설정하는 보상 값 도출 단계 및
    상기 해당 표시 영역에 대응하는 제1 기준 값에 상기 보상 값을 더하여, 상기 파워 제어 신호로 출력하는 파워 제어 신호 출력 단계를 포함하는, 표시 장치의 구동 방법.
  12. 제11항에 있어서,
    상기 엣지 표시 영역은 이전 표시 영역에 인접하는 프론트 엣지 표시 영역 및 다음 표시 영역에 인접하는 백 엣지 표시 영역을 포함하고,
    상기 보상 값 도출 단계에서,
    상기 해당 표시 영역에 대응하는 제1 기준 값과 이전 표시 영역의 백 엣지 표시 영역에 대응하는 제2 기준 값의 차이 값을 제3 LUT(3rd Look-Up Table)에 적용하여, 상기 보상 값을 설정하는, 표시 장치의 구동 방법.
  13. 제11항에 있어서,
    상기 엣지 표시 영역은 이전 표시 영역에 인접하는 프론트 엣지 표시 영역 및 다음 표시 영역에 인접하는 백 엣지 표시 영역을 포함하고,
    상기 보상 값 도출 단계에서,
    상기 해당 표시 영역에 대응하는 제1 기준 값과 다음 표시 영역의 프론트 엣지 표시 영역에 대응하는 제2 기준 값의 차이 값을 제3 LUT(3rd Look-Up Table)에 적용하여, 상기 보상 값을 설정하는, 표시 장치의 구동 방법.
  14. 제11항에 있어서,
    상기 데이터 비교 단계 이전에, 상기 복수의 표시 영역 각각에 상기 데이터 전압을 출력하는 타이밍을 결정하는 서브 데이터 인에이블 신호 및 상기 복수의 엣지 표시 영역 각각에 상기 데이터 전압을 출력하는 타이밍을 결정하는 엣지 데이터 인에이블 신호를 생성하는 데이터 인에이블 신호 생성 단계를 더 포함하는, 표시 장치의 구동 방법
  15. 제14항에 있어서,
    상기 데이터 비교 단계에서,
    상기 서브 데이터 인에이블 신호가 턴온 레벨인 동안에,
    상기 복수의 표시 영역에 대응되는 비디오 데이터와 지연된 비디오 데이터를 비교하여, 복수의 비교 데이터 각각을 생성하는, 표시 장치의 구동 방법.
  16. 제14항에 있어서,
    상기 데이터 비교 단계에서,
    상기 엣지 데이터 인에이블 신호가 턴온 레벨인 동안에,
    상기 복수의 엣지 표시 영역에 대응되는 비디오 데이터와 지연된 비디오 데이터를 비교하여, 복수의 엣지 비교 데이터 각각을 생성하는, 표시 장치의 구동 방법.
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