KR20190059667A - 아발란치 광검출기 및 이를 포함하는 이미지 센서 - Google Patents

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KR20190059667A
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Abstract

작은 폼 팩터를 가지면서 가시광과 적외선에 대해 모두 높은 검출 효율을 갖는 광검출기 및 이를 포함하는 이미지 센서가 제공된다. 개시된 광검출기는, 제 1 전극, 상기 제 1 전극 상에 배치된 콜렉터층, 상기 콜렉터층 상에 배치된 터널 장벽층, 상기 터널 장벽층 상에 배치된 그래핀층, 상기 그래핀층 상에 배치된 이미터층, 및 상기 이미터층 상에 배치된 제 2 전극을 포함할 수 있다.

Description

아발란치 광검출기 및 이를 포함하는 이미지 센서 {Avalanche photodetector and image sensor including the same}
개시된 실시예들은 아발란치 광검출기 및 이를 포함하는 이미지 센서에 관한 것으로, 더욱 상세하게는 그래핀의 광도핑 효과(photo-doping effect)를 이용한 아발란치 광검출기 및 이를 포함하는 이미지 센서에 관한 것이다.
실리콘 기반의 CMOS(complementary metal oxide semiconductor) 이미지 센서는 가장 보편적인 이미지 센서이다. 그러나, 광검출기 및 이미지 센서에서 통상적으로 사용하고 있는 실리콘은 적외선 대역에 대한 양자 효율(quantum efficiency)이 가시광 대역에 대한 양자 효율에 비하여 현저하게 낮다. 최근에는 생체 인증 센서, 저조도 감도 향상 장비, 야시경, LiDAR(light detection and ranging)와 같은 자율주행 센서, 3D 센서 등에서 800~900nm 파장 대역의 근적외선(NIR)을 사용하고 있어서, 가시광과 함께 적외선을 감지할 수 있는 광검출기 또는 이미지 센서의 중요성이 증가하고 있다. 또한, 스마트폰이나 웨어러블 장치에 적용을 위해 적외선 광검출기가 작은 폼 팩터(form factor)를 갖도록 제작하는 것이 중요하다.
작은 폼 팩터를 가지면서 가시광과 적외선에 대해 모두 높은 검출 효율을 갖는 광검출기 및 이를 포함하는 이미지 센서를 제공한다.
일 실시예에 따른 광검출기는, 제 1 전극; 상기 제 1 전극 상에 배치된 콜렉터층; 상기 콜렉터층 상에 배치된 터널 장벽층; 상기 터널 장벽층 상에 배치된 그래핀층; 상기 그래핀층 상에 배치된 이미터층; 및 상기 이미터층 상에 배치된 제 2 전극;을 포함할 수 있다.
예를 들어, 상기 제 1 전극은 도전성을 갖는 금속 재료로 이루어질 수 있다.
상기 콜렉터층과 상기 이미터층은 반도체 재료로 이루어질 수 있다.
예를 들어, 상기 반도체 재료는 실리콘(Si), 게르마늄(Ge), 유기 반도체, 화합물 반도체, 양자점, 또는 밴드갭을 갖는 이차원 결정을 포함할 수 있다.
예를 들어, 상기 밴드갭을 갖는 2차원 결정은 전이금속과 칼코겐 원소의 화합물인 전이금속 디칼코게나이드를 포함할 수 있다.
예를 들어, 상기 전이금속 디칼코게나이드는 MoS2, WS2, TaS2, HfS2, ReS2, TiS2, NbS2, SnS2, MoSe2, WSe2, TaSe2, HfSe2, ReSe2, TiSe2, NbSe2, SnSe2, MoTe2, WTe2, TaTe2, HfTe2, ReTe2, TiTe2, NbTe2, SnTe2 중에서 적어도 하나를 포함할 수 있다.
예를 들어, 상기 밴드갭을 갖는 이차원 결정은 TiOx, NbOx, MnOx, VaOx, MnO3, TaO3, WO3, MoCl2, CrCl3, RuCl3, BiI3, PbCl4, GeS, GaS, GeSe, GaSe, PtSe2, In2Se3, GaTe, InS, InSe, InTe 중에서 적어도 하나를 포함할 수 있다.
상기 터널 장벽층은 전자와 정공의 터널링이 가능한 두께를 갖는 절연성 재료로 이루어질 수 있다.
예를 들어, 상기 터널 장벽층은 SiO2, SiN, Al2O3, HfO2, h-BN(hexagonal BN) 중에서 적어도 하나를 포함할 수 있다.
상기 제 2 전극은 투명한 도전성 재료로 이루어질 수 있다.
예를 들어, 상기 그래핀층은 단층 그래핀 또는 다층 그래핀을 포함하며, 0.3 nm 내지 1 ㎛의 두께를 가질 수 있다.
예를 들어, 상기 이미터층 및 상기 터널 장벽층은 0.3 nm 내지 1 ㎛의 두께를 가질 수 있다.
한편, 일 실시예에 따른 이미지 센서는, 기판; 상기 기판 상에 배치된 절연층; 상기 절연층 상에 배치된 제 1 전극; 상기 제 1 전극 상에 배치된 제 1 광검출기; 및 상기 제 1 광검출기 위에 배치된 제 2 광검출기;를 포함할 수 있으며, 여기서 상기 제 1 및 제 2 광검출기는 각각, 콜렉터층; 상기 콜렉터층 상에 배치된 터널 장벽층; 상기 터널 장벽층 상에 배치된 그래핀층; 상기 그래핀층 상에 배치된 이미터층; 및 상기 이미터층 상에 배치된 제 2 전극;을 포함할 수 있다.
상기 콜렉터층과 상기 이미터층은 반도체 재료로 이루어질 수 있다.
상기 제 1 광검출기의 이미터층의 반도체 재료의 밴드갭과 상기 제 2 광검출기의 이미터층의 반도체 재료의 밴드갭이 상이할 수 있다.
또한, 다른 실시예에 따른 이미지 센서는, 기판; 상기 기판 상에 배치된 절연층; 및 상기 절연층 상에 인접하여 배치된 제 1 광검출기 및 제 2 광검출기;를 포함할 수 있으며, 여기서 상기 제 1 및 제 2 광검출기는 각각, 상기 절연층 상에 배치된 제 1 전극; 상기 제 1 전극 상에 배치된 콜렉터층; 상기 콜렉터층 상에 배치된 터널 장벽층; 상기 터널 장벽층 상에 배치된 그래핀층; 상기 그래핀층 상에 배치된 이미터층; 및 상기 이미터층 상에 배치된 제 2 전극;을 포함할 수 있다.
개시된 실시예들에 따른 아발란치 광검출기는 그래핀의 광도핑 효과를 이용하여 가시광과 적외선에 대해 모두 높은 검출 효율을 가질 수 있다. 특히, 개시된 실시예들에 따른 아발란치 광검출기는 비교적 낮은 구동 전압으로도 전자 사태 현상(avalanche phenomenon)을 발생시킬 수 있어서 높은 감도를 가질 수 있으며, 또한 암전류(dark current)를 효과적으로 억제하여 노이즈를 줄임으로써 높은 신호대 잡음비를 달성할 수 있다. 이러한 전자 사태 현상은 매우 빠르게 일어나는 현상이므로 개시된 실시예들에 따른 아발란치 광검출기는 매우 짧은 광 응답 시간(photo-response time)을 갖는다.
또한, 개시된 실시예들에 따른 아발란치 광검출기의 경우, 이미터층을 형성하는 반도체 종류에 따라 감지할 수 있는 빛의 파장 대역을 쉽게 선택할 수 있다.
또한, 일반적인 반도체 공정을 통해 소형으로 제작이 가능하다.
도 1은 일 실시예에 따른 아발란치 광검출기의 개략적인 구조를 보이는 단면도이다.
도 2는 다른 실시예에 따른 아발란치 광검출기의 개략적인 구조를 보이는 사시도이다.
도 3a 및 3b는 도 1 및 도 2에 도시된 아발란치 광검출기의 동작을 설명하기 위한 개략적인 에너지 밴드 다이어그램이다.
도 4 내지 도 6은 박리법(exfoliation)을 통해 형성된 그래핀층과 이미터층을 갖는 아발란치 광검출기의 효과를 설명하기 위한 그래프이다.
도 7은 다양한 파장 대역에 대한 아발란치 광검출기의 광응답을 보이는 그래프이다.
도 8 내지 도 13은 직성장법으로 형성된 그래핀층과 이미터층을 갖는 아발란치 광검출기의 효과를 설명하기 위한 그래프이다.
도 14는 일 실시예에 따른 이미지 센서의 개략적인 구조를 보이는 단면도이다.
도 15는 다른 실시예에 따른 이미지 센서의 개략적인 구조를 보이는 단면도이다.
이하, 첨부된 도면들을 참조하여, 아발란치 광검출기 및 이를 포함하는 이미지 센서에 대해 상세하게 설명한다. 이하의 도면들에서 동일한 참조부호는 동일한 구성요소를 지칭하며, 도면상에서 각 구성요소의 크기는 설명의 명료성과 편의상 과장되어 있을 수 있다. 또한, 이하에 설명되는 실시예는 단지 예시적인 것에 불과하며, 이러한 실시예들로부터 다양한 변형이 가능하다. 또한 이하에서 설명하는 층 구조에서, "상부" 또는 "상"이라고 기재된 표현은 접촉하여 바로 위/아래/좌/우에 있는 것뿐만 아니라 비접촉으로 위/아래/좌/우에 있는 것도 포함할 수 있다.
도 1은 일 실시예에 따른 아발란치 광검출기의 개략적인 구조를 보이는 단면도이다. 도 1을 참조하면, 일 실시예에 따른 아발란치 광검출기(10)는 반도체 재료로 이루어진 콜렉터층(12), 콜렉터층(12)의 상부 표면 위에 배치된 절연성을 갖는 터널 장벽층(13), 터널 장벽층(13)의 상부 표면 위에 배치된 그래핀층(14), 및 그래핀층(14)의 상부 표면 위에 배치된 반도체 재료로 이루어진 이미터층(15)을 포함할 수 있다. 또한, 아발란치 광검출기(10)는 콜렉터층(12)의 하부 표면에 배치된 하부 전극(11) 및 이미터층(15)의 상부 표면에 배치된 상부 전극(16)을 더 포함할 수 있다.
이미터층(15)은 빛을 흡수하여 전자-정공 쌍(electron hole pair)을 생성하는 광흡수층으로서 역할을 한다. 콜렉터층(12)는 이미터층(15)에서 발생한 전자 또는 정공을 흡수하는 역할을 한다. 또한, 콜렉터층(12)은 높은 전계에서 가속된 전자 또는 정공과 충돌하여 전자와 정공을 다량으로 발생시키는 전자 사태 현상(avalanche phenomenon)이 일어나는 층이다. 이러한 이미터층(15)과 콜렉터층(12)은 밴드갭을 갖는 어떠한 반도체 재료로도 이루어질 수 있다. 특히, 이미터층(15)의 반도체 재료의 밴드갭에 따라 흡수하는 빛의 파장 대역이 달라질 수도 있다. 이미터층(15)과 콜렉터층(12)은 동일한 반도체 재료로 이루어질 수도 있고 또는 상이한 반도체 재료로 이루어질 수도 있다. 또한, 이미터층(15)과 콜렉터층(12)은 도핑된 반도체 재료로 이루어질수도 있지만 도핑되지 않은 반도체 재료로 이루어질 수 있다.
예를 들어, 반도체 재료는 실리콘(Si), 게르마늄(Ge) 등의 IV족 반도체, GaAs, GaP 등의 III-V족 화합물 반도체, CdS, ZnTe 등의 II-VI족 화합물 반도체, PbS 등의 IV-VI족 화합물 반도체, SiC 등의 IV-IV족 화합물 반도체, IGZO 등의 산화물 반도체, 양자점, 유기 반도체 및 밴드갭을 갖는 이차원 결정 구조의 반도체 중에서 적어도 하나를 포함할 수 있다. 이차원 결정 구조의 반도체로서 대표적으로 전이금속과 칼코겐 원소의 화합물인 전이금속 디칼코게나이드(transition metal dichalcogenide, TMD)가 있다. 예를 들어, 전이금속 디칼코게나이드는 MoS2, WS2, TaS2, HfS2, ReS2, TiS2, NbS2, SnS2, MoSe2, WSe2, TaSe2, HfSe2, ReSe2, TiSe2, NbSe2, SnSe2, MoTe2, WTe2, TaTe2, HfTe2, ReTe2, TiTe2, NbTe2, SnTe2를 포함할 수 있다. 또한, 전이금속 디칼코게나이드 외에도 이차원 결정 구조의 반도체가 있다. 예를 들어, 이차원 결정 구조의 반도체는 TiOx, NbOx, MnOx, VaOx, MnO3, TaO3, WO3, MoCl2, CrCl3, RuCl3, BiI3, PbCl4, GeS, GaS, GeSe, GaSe, PtSe2, In2Se3, GaTe, InS, InSe, InTe 등을 더 포함할 수 있다.
콜렉터층(12)의 두께는 전자를 충분히 흡수할 수 있도록 특별한 제한이 없다. 이미터층(15)은 빛을 효율적으로 흡수하면서 전자와 정공을 용이하게 이동시킬 수 있도록 약 0.3 nm 내지 1 ㎛의 두께를 가질 수 있다.
터널 장벽층(13)은 전자 사태 현상을 발생시키기 위하여 콜렉터층(12)의 밴드 갭(band gap)보다 훨씬 큰 밴드 갭을 갖도록 구성된다. 이를 위해, 터널 장벽층(13)은 전자와 정공의 터널링이 가능한 두께를 갖는 절연성 재료로 이루어질 수 있다. 예를 들어, 터널 장벽층(13)은 SiO2, SiN, Al2O3, HfO2 등의 절연성 재료로 이루어질 수 있다. 또한, 터널 장벽층(13)은 h-BN(hexagonal BN)과 같은 2차원 절연성 재료로 이루어질 수도 있다. h-BN은 붕소(B)와 질소(N)가 결합하여 육방 결정 구조로 형성된 것이다. 터널 장벽층(13)은 터널링이 가능하도록 약 0.3 nm 내지 1 ㎛의 두께를 가질 수 있다.
그래핀층(14)은 터널 장벽층(13)과 이미터층(15) 사이에 배치되어 암전류를 억제하는 역할을 한다. 또한, 그래핀층(14)은 광검출기(10)에 빛이 입사될 때 이미터층(15)에서 생성된 전자나 정공에 의한 광도핑 효과를 일으켜 이미터층(15)에서 생성된 전자나 정공이 터널 장벽층(13)을 넘어 콜렉터층(12)으로 이동하는 것을 용이하게 만든다. 이러한 그래핀층(14)은 단층 그래핀 또는 다층 그래핀으로 이루어질 수 있다. 예를 들어, 그래핀층(14)은 약 0.3 nm 내지 1 ㎛의 두께를 가질 수 있다.
하부 전극(11)은 도전성을 갖는 금속 재료로 이루어질 수 있다. 예를 들어, 하부 전극(11)은 마그네슘(Mg), 알루미늄(Al), 스칸듐(Sc), 티타늄(Ti), 바나듐(V), 크롬(Cr), 망간(Mn), 니켈(Ni), 구리(Cu), 아연(Zn), 갈륨(Ga), 지르코늄(Zr), 니오븀(Nb), 몰리브덴(Mo), 납(Pd), 은(Ag), 카드뮴(Cd), 인듐(In), 주석(Sn), 란탄(La), 하프늄(Hf), 탄탈륨(Ta), 텅스텐(W), 이리듐(Ir), 백금(Pt), 금(Au), 비스무스(Bi) 등과 같은 금속 또는 이들의 합금으로 이루어질 수 있다.
상부 전극(16)은 빛이 투과할 수 있도록 투명한 도전성 재료로 이루어질 수 있다. 예를 들어, 상부 전극(16)은 ITO, IZO, ZnO와 같은 투명한 전도성 산화물이나 그래핀으로 이루어질 수 있다.
도 2는 다른 실시예에 따른 아발란치 광검출기(10)의 개략적인 구조를 보이는 사시도이다. 도 1에서는 하부 전극(11), 콜렉터층(12), 터널 장벽층(13), 그래핀층(14), 이미터층(15) 및 상부 전극(16)이 모두 동일한 면적을 갖는 것으로 도시되었다. 그러나, 예를 들어, 실리콘 웨이퍼 위에 터널 장벽층(13), 그래핀층(14), 이미터층(15) 및 상부 전극(16)을 순차적으로 형성한 후에, 그래핀층(14), 이미터층(15) 및 상부 전극(16)을 에칭하여 패터닝할 수도 있다. 그러면, 도 2에 도시된 바와 같이, 그래핀층(14), 이미터층(15) 및 상부 전극(16)은 다른 층들에 비해 작은 면적을 가질 수도 있다. 이 경우, 실리콘 웨이퍼가 콜렉터층(12)으로서 기능을 할 수 있다.
도 3a 및 3b는 도 1 및 도 2에 도시된 아발란치 광검출기(10)의 동작을 설명하기 위한 개략적인 에너지 밴드 다이어그램이다. 구체적으로, 도 3a는 아발란치 광검출기(10)에 빛이 입사하지 않을 때의 에너지 밴드 다이어그램이며, 도 3b는 아발란치 광검출기(10)에 빛이 입사할 때의 에너지 밴드 다이어그램이다. 도 3a 및 도 3b에서 각각의 층에 수평 방향으로 표시된 점선은 각 층의 페르미 에너지 준위를 나타낸다. 또한, 도 3a 및 도 3b의 에너지 밴드 다이어그램은 아발란치 광검출기(10)에 역방향 바이어스를 인가한 경우이다. 예를 들어, 하부 전극(11)에 양(+)의 전압을 인가하고 상부 전극(16)에 음(-)의 전압을 인가한 경우이다.
먼저, 도 3a를 참조하면, 터널 장벽층(13)은 콜렉터층(12)과 이미터층(15) 사이에 매우 큰 에너지 장벽을 형성한다. 또한, 아발란치 광검출기(10)에 빛이 입사하지 않으면, 상부 전극(16)으로부터 나온 캐리어(예를 들어, 상부 전극(16)에 음(-)의 전압을 인가한 경우에는 전자)가 이미터층(15)에서 반사되거나, 또는 터널 전도로 그래핀층(14)에 도달하더라도 그래핀층(14)의 페르미 에너지 준위와 터널 장벽층(13)의 전도대 사이의 에너지 차이로 인하여, 그래핀층(14)으로부터 콜렉터층(12)으로의 캐리어(예를 들어, 전자)의 이동이 제한된다. 그 결과, 암전류(dark current)가 효과적으로 억제될 수 있다.
또한, 도 3b를 참조하면, 아발란치 광검출기(10)에 빛이 입사할 경우, 이미터층(15)에서 전자와 정공이 발생하게 된다. 예를 들어, 하부 전극(11)에 양(+)의 전압을 인가하고 상부 전극(16)에 음(-)의 전압을 인가하면, 정공은 상부 전극(16)으로 이동하고 전자는 그래핀층(14)으로 이동하게 된다. 그러면, 그래핀층(14)에 많은 수의 전자가 쌓이게 되면서, 그래핀층(14)의 페르미 에너지 준위가 높아지게 되고, 또한 그래핀층(14)과 콜렉터층(12) 사이에 전압을 걸어주는 것과 같은 효과가 발생한다. 그 결과, 그래핀층(14)과 터널 장벽층(13) 사이의 에너지 장벽이 도 3a의 경우에 비하여 상대적으로 낮아지게 되고 좁아지게 되어, 전계전자방출(field electron emission) 효과가 매우 커지게 된다. 따라서, 많은 양의 전자가 터널 장벽층(13)을 넘어 콜렉터층(12)으로 이동하게 되고, 그래핀층(14)에서 빛을 흡수하여 생성된 전자의 상당수도 마찬가지로 콜렉터층(12)으로 이동하게 된다. 이때, 터널 장벽층(13)을 통과한 전자는 터널 장벽층(13)에 걸린 큰 전압 덕분에 충분한 에너지를 가지게 되어 콜렉터층(12)에서 충돌 이온화(impact ionization)를 일으키게 된다. 이러한 충돌 이온화로 인해, 새로운 전자와 정공이 다량으로 발생하는 전자 사태 현상이 발생하여 광전류가 증폭될 수 있다.
상술한 바와 같이, 본 실시예에 따른 아발란치 광검출기(10)는 그래핀층(14)의 광도핑 효과를 이용하여 가시광과 적외선에 대해 모두 높은 검출 효율을 가질 수 있다. 특히, 아발란치 광검출기(10)는 비교적 낮은 구동 전압으로도 전자 사태 현상을 발생시킬 수 있어서 저전력으로도 높은 감도를 가질 수 있으며, 암전류를 효과적으로 억제하여 노이즈를 줄임으로써 높은 신호대 잡음비를 달성할 수 있다. 이러한 전자 사태 현상은 매우 빠르게 일어나는 현상이므로 본 실시예들에 따른 아발란치 광검출기(10)는 매우 짧은 광 응답 시간(photo-response time)을 갖는다. 또한, 본 실시예들에 따른 아발란치 광검출기(10)는 이미터층(15)을 형성하는 반도체 재료의 종류에 따라 감지할 수 있는 빛의 파장 대역을 용이하게 선택할 수 있으며, 일반적인 반도체 공정을 통해 소형으로 제작이 가능하다.
도 4 내지 도 13은 상술한 구조를 갖는 아발란치 광검출기(10)의 효과를 설명하기 위한 그래프이다.
먼저, 도 4 내지 도 6은 박리법(exfoliation)을 통해 형성된 그래핀층(14)과 이미터층(15)을 갖는 아발란치 광검출기(10)의 효과를 설명하기 위한 그래프이다. 하부 전극(11)으로는 금(Au)을 사용하였고, 콜렉터층(12)으로 n-도핑된 실리콘(n-Si)을 사용하였고, 터널 장벽층(13)으로는 SiO2를 사용하였고, 그래핀층(14)은 박리법으로 형성된 그래핀을 터널 장벽층(13) 위에 다층 구조로 적층하여 형성하고, 이미터층(15)은 박리법으로 형성된 MoS2를 그래핀층(14) 위에 다층 구조로 적층하여 형성하였고, 상부 전극(16)으로서 그래핀을 사용하였다. 또한, 터널 장벽층(13)의 두께는 5.6 nm, 그래핀층(14)의 두께는 17 nm, 이미터층(15)의 두께는 16.2 nm이었다.
도 4는 인가 전압에 따른 암전류와 광전류(photocurrent)의 변화를 보이는 그래프이다. 도 4를 참조하면, 근적외선 영역인 850 nm 파장의 빛이 110 nW의 세기로 입사할 때, 인가 전압이 약 -6 V를 넘어서면서 전자 사태 현상이 발생하여 광전류가 급격히 증가하는 것을 알 수 있다. 반면, 빛이 입사하지 않을 때는 전자 사태 현상이 발생하지 않아서 인가 전압이 약 -6 V를 넘어도 암전류가 급격하게 증가하지 않는다. 또한, 도 5는 인가 전압에 따른 반응도(R; responsivity)와 외부 양자효율(EQE; external quantum efficiency)의 변화를 보이는 그래프이다. 여기서, 반응도(R)는 입사광의 세기에 대한 광전류의 비율을 나타내며, 외부 양자 효율(EQE)은 아발란치 광검출기(10)에 입사하는 광자 하나 당 콜렉터층(12)에서 발생하는 전자의 개수를 나타낸다. 도 5에 도시된 바와 같이, 850 nm 파장의 빛이 110 nW의 세기로 입사할 때, 인가 전압이 약 -6 V를 넘으면서 전자 사태 현상이 발생하여 R > 100 A/W, EQE > 10000 %를 달성할 수 있었다. 또한, 도 6은 인가 전압에 따른 특이성 검출도(D*; specific detectivity)의 변화를 보이는 그래프이다. 특이성 검출도(D*)는 암전류와 감광 영역의 면적을 고려한 반응도이다. 도 6을 참조하면, 낮은 암전류와 높은 반응도로 인해 1013 Jones 이상의 특이성 검출도(D*)를 얻을 수 있었다.
도 7은 다양한 파장 대역에 대한 아발란치 광검출기(10)의 광응답을 보이는 그래프이다. 도 7을 참조하면, 입사광의 파장 대역에 따라 전자 사태 현상이 일어나는 전압이 조금씩 다르지만, 가시광(635 nm)부터 적외선(850~1050 nm)에 이르는 파장 대역에서 전자 사태 현상에 의해 높은 광전류를 얻을 수 있었다.
또한, 도 8 내지 도 10은 직성장법(direct growth) 또는 직성장 물질의 전사 방법으로 형성된 그래핀층(14)과 이미터층(15)을 갖는 아발란치 광검출기(10)의 효과를 설명하기 위한 그래프이다. 하부 전극(11)으로는 금(Au)을 사용하였고, 콜렉터층(12)으로 n-도핑된 실리콘(n-Si)을 사용하였고, 터널 장벽층(13)으로는 SiO2를 사용하였고, 그래핀층(14)은 터널 장벽층(13) 위에 그래핀을 다층 구조로 직접 성장 또는 전사(transfer)시켜 형성하였으며, 이미터층(15)은 그래핀층(14) 위에 MoS2를 다층 구조로 직접 성장 또는 전사시켜 형성하였고, 상부 전극(16)으로서 그래핀을 직접 성장 또는 전사시켜 사용하였다.
도 8은 인가 전압에 따른 암전류와 광전류의 변화를 보이는 그래프이다. 도 8을 참조하면, 근적외선 영역인 850 nm 파장의 빛이 0.5 uW의 세기로 입사할 때, 인가 전압이 약 -4 V를 넘으면서 전자 사태 현상이 발생하여 광전류가 급격히 증가하는 것을 알 수 있다. 반면, 빛이 입사하지 않을 때는 전자 사태 현상이 발생하지 않아서 인가 전압이 약 -4 V를 넘어도 암전류가 급격하게 증가하지 않는다. 또한, 도 9는 인가 전압에 따른 반응도(R)와 외부 양자효율(EQE)의 변화를 보이는 그래프이다. 도 9를 참조하면, 850 nm 파장의 빛이 0.5 uW의 세기로 입사할 때, 인가 전압이 약 -4 V를 넘으면서 전자 사태 현상이 발생하여 R > 100 A/W, EQE > 10000 %를 달성할 수 있었다. 또한, 도 10은 인가 전압에 따른 특이성 검출도(D*)의 변화를 보이는 그래프이다. 도 10을 참조하면, 1013 Jones 이상의 특이성 검출도(D*)를 얻을 수 있었다.
마지막으로, 도 11 내지 도 13은 직성장법 또는 직성장 물질의 전사 방법으로 형성된 그래핀층(14)과 이미터층(15)을 갖는 아발란치 광검출기(10)의 효과를 설명하기 위한 그래프이다. 도 11 내지 도 13의 그래프에서, 아발란치 광검출기(10)의 구성은 도 8 내지 도 10에서 설명한 것과 동일하며, 단지 입사광의 파장과 세기만이 다르다. 도 11 내지 도 13은 가시광 영역인 635 nm 파장의 빛을 420 nW의 세기로 아발란치 광검출기(10)에 입사시켜 얻었다.
도 11은 인가 전압에 따른 암전류와 광전류의 변화를 보이는 그래프이다. 도 11을 참조하면, 가시광 영역인 635 nm 파장의 빛이 420 nW의 세기로 입사할 때, 인가 전압이 약 -4.5 V를 넘으면서 전자 사태 현상이 발생하여 광전류가 급격히 증가하는 것을 알 수 있다. 반면, 빛이 입사하지 않을 때는 전자 사태 현상이 발생하지 않아서 암전류가 급격하게 증가하지 않는다. 또한, 도 12는 인가 전압에 따른 반응도(R)와 외부 양자효율(EQE)의 변화를 보이는 그래프이다. 도 12를 참조하면, 635 nm 파장의 빛이 420 nW의 세기로 입사할 때, 인가 전압이 약 -4.5 V를 넘으면서 전자 사태 현상이 발생하여 R > 100 A/W, EQE > 10000 %를 달성할 수 있었다. 또한, 도 13은 인가 전압에 따른 특이성 검출도(D*)의 변화를 보이는 그래프이다. 도 13을 참조하면, 1012 Jones 이상의 특이성 검출도(D*)를 얻을 수 있었다.
상술한 아발란치 광검출기(10)는 생체 인증 센서, 저조도 감도 향상 장비, 야시경, LiDAR, 3D 센서 등에 적용될 수 있다. 또한, 아발란치 광검출기(10)는 가시광 영상과 적외선광을 영상을 동시에 얻을 수 있는 이미지 센서에 적용될 수도 있다.
예컨대, 도 14는 일 실시예에 따른 이미지 센서의 개략적인 구조를 보이는 단면도이다. 도 14를 참조하면, 일 실시예에 따른 이미지 센서(100)는 기판(101), 기판(101) 상에 배치된 절연층(102), 및 절연층(102) 상에 인접하여 배열된 다수의 아발란치 광검출기(10a, 10b, 10c)를 포함할 수 있다. 기판(101)은 반도체 기판, 유리 기판, 또는 유연한 플라스틱 기판일 수도 있다. 자세히 도시하지는 않았지만, 기판(101) 내에는 데이터의 입출력을 위한 회로가 더 배치될 수 있다. 또한, 절연층(102)으로는 SiO2, SiN, Al2O3, HfO2 등과 같은 일반적인 절연성 재료가 사용될 수 있다.
각각의 아발란치 광검출기(10a, 10b, 10c)는 도 1 또는 도 2에서 설명한 구조를 가질 수 있다. 예를 들어, 제 1 아발란치 광검출기(10a)는 절연층(102) 위에 배치된 제 1 하부 전극(11a), 제 1 하부 전극(11a) 위에 배치된 제 1 콜렉터층(12a), 제 1 콜렉터층(12a) 위에 배치된 제 1 터널 장벽층(13a), 제 1 터널 장벽층(13a) 위에 배치된 제 1 그래핀층(14a), 제 1 그래핀층(14a) 위에 배치된 제 1 이미터층(15a), 및 제 1 이미터층(15a) 위에 배치된 제 1 상부 전극(16a)을 포함할 수 있다. 또한, 제 2 아발란치 광검출기(10b)는 절연층(102) 위에 배치된 제 2 하부 전극(11b), 제 2 하부 전극(11b) 위에 배치된 제 2 콜렉터층(12b), 제 2 콜렉터층(12b) 위에 배치된 제 2 터널 장벽층(13b), 제 2 터널 장벽층(13b) 위에 배치된 제 2 그래핀층(14b), 제 2 그래핀층(14b) 위에 배치된 제 2 이미터층(15b), 및 제 2 이미터층(15b) 위에 배치된 제 2 상부 전극(16b)을 포함할 수 있다. 또한, 제 3 아발란치 광검출기(10c)는 절연층(102) 위에 배치된 제 3 하부 전극(11c), 제 3 하부 전극(11c) 위에 배치된 제 3 콜렉터층(12c), 제 3 콜렉터층(12c) 위에 배치된 제 3 터널 장벽층(13c), 제 3 터널 장벽층(13c) 위에 배치된 제 3 그래핀층(14c), 제 3 그래핀층(14c) 위에 배치된 제 3 이미터층(15c), 및 제 3 이미터층(15c) 위에 배치된 제 3 상부 전극(16c)을 포함할 수 있다.
제 1 내지 제 3 아발란치 광검출기(10a, 10b, 10c)가 함께 이미지 센서(100)의 하나의 화소를 구성할 수 있으며, 제 1 내지 제 3 아발란치 광검출기(10a, 10b, 10c)의 각각은 특정한 파장의 빛을 검출하기 위한 서브 화소의 역할을 할 수 있다. 이를 위해, 제 1 이미터층(15a), 제 2 이미터층(15b) 및 제 3 이미터층(15c)은 밴드갭이 상이한 반도체 재료로 이루어질 수 있다. 대신에, 제 1 내지 제 3 이미터층(15a, 15b, 15c)은 넓은 파장 대역의 빛을 검출할 수 있는 동일한 반도체 재료로 이루어지고, 제 1 내지 제 3 아발란치 광검출기(10a, 10b, 10c)의 광입사면에 컬러 필터를 더 배치할 수도 있다. 비록 도 14에는 3개의 아발란치 광검출기(10a, 10b, 10c)가 도시되었지만, 검출하고자 하는 파장 대역의 분류에 따라 4개 또는 그 이상의 아발란치 광검출기를 사용할 수도 있다.
도 15는 다른 실시예에 따른 이미지 센서의 개략적인 구조를 보이는 단면도이다. 도 15를 참조하면, 이미지 센서(200)는 기판(101), 기판(101) 위에 배치된 절연층(102), 절연층(102) 위에 배치된 하부 전극(11), 하부 전극(11) 위에 배치된 제 1 아발란치 광검출기(10a), 제 1 아발란치 광검출기(10a) 위에 배치된 제 2 아발란치 광검출기(10b), 및 제 2 아발란치 광검출기(10b) 위에 배치된 제 3 아발란치 광검출기(10c)를 포함할 수 있다. 따라서, 도 15에 도시된 이미지 센서(200)는 다수의 아발란치 광검출기(10a, 10b, 10c)가 수직 방향으로 적층된 적층형 이미지 센서이다.
각각의 아발란치 광검출기(10a, 10b, 10c)는 하부 전극(11)을 제외하고 도 1 또는 도 2에서 설명한 구조를 가질 수 있다. 예를 들어, 제 1 아발란치 광검출기(10a)는 하부 전극(11) 위에 배치된 제 1 콜렉터층(12a), 제 1 콜렉터층(12a) 위에 배치된 제 1 터널 장벽층(13a), 제 1 터널 장벽층(13a) 위에 배치된 제 1 그래핀층(14a), 제 1 그래핀층(14a) 위에 배치된 제 1 이미터층(15a), 및 제 1 이미터층(15a) 위에 배치된 제 1 상부 전극(16a)을 포함할 수 있다. 또한, 제 2 아발란치 광검출기(10b)는 제 1 상부 전극(16a) 위에 배치된 제 2 콜렉터층(12b), 제 2 콜렉터층(12b) 위에 배치된 제 2 터널 장벽층(13b), 제 2 터널 장벽층(13b) 위에 배치된 제 2 그래핀층(14b), 제 2 그래핀층(14b) 위에 배치된 제 2 이미터층(15b), 및 제 2 이미터층(15b) 위에 배치된 제 2 상부 전극(16b)을 포함할 수 있다. 제 3 아발란치 광검출기(10c)는 제 2 상부 전극(16b) 위에 배치된 제 3 콜렉터층(12c), 제 3 콜렉터층(12c) 위에 배치된 제 3 터널 장벽층(13c), 제 3 터널 장벽층(13c) 위에 배치된 제 3 그래핀층(14c), 제 3 그래핀층(14c) 위에 배치된 제 3 이미터층(15c), 및 제 3 이미터층(15c) 위에 배치된 제 3 상부 전극(16c)을 포함할 수 있다.
제 1 내지 제 3 상부 전극(16a, 16b, 16c)은 모두 투명 전극일 수 있다. 여기서, 제 1 상부 전극(16a)은 제 1 아발란치 광검출기(10a)의 상부 전극과 제 2 아발란치 광검출기(10b)의 하부 전극의 역할을 할 수 있으며, 제 2 상부 전극(16b)은 제 2 아발란치 광검출기(10b)의 상부 전극과 제 3 아발란치 광검출기(10c)의 하부 전극의 역할을 할 수 있다. 이러한 구조에서, 이미지 센서(200)의 동작시에 제 3 상부 전극(16c)에 가장 낮은 전압이 인가되고, 제 2 상부 전극(16b), 제 1 상부 전극(16a) 및 하부 전극(11)으로 점차 더 높은 전압이 인가될 수 있다. 예컨대, 제 3 상부 전극(16c)과 제 2 상부 전극(16b) 사이의 전압차, 제 2 상부 전극(16b)과 제 1 상부 전극(16a) 사이의 전압차, 제 1 상부 전극(16a)과 하부 전극(11) 사이의 전압차는 각각 제 1 내지 제 3 아발란치 광검출기(10a, 10b, 10c)에서 전자 사태 현상이 발생하기 위한 전압보다 클 수 있다.
도 14에서 설명한 것과 마찬가지로, 이미지 센서(200)의 제 1 내지 제 3 아발란치 광검출기(10a, 10b, 10c)가 함께 이미지 센서(200)의 하나의 화소를 구성할 수 있으며, 제 1 내지 제 3 아발란치 광검출기(10a, 10b, 10c)의 각각은 특정한 파장의 빛을 검출하기 위한 서브 화소의 역할을 할 수 있다. 이를 위해, 제 1 이미터층(15a), 제 2 이미터층(15b) 및 제 3 이미터층(15c)은 밴드갭이 상이한 반도체 재료로 이루어질 수 있다. 또한, 도 15에는 도시되지 않았지만, 제 1 상부 전극(16a)과 제 2 콜렉터층(12b) 사이 및 제 2 상부 전극(16b)과 제 3 콜렉터층(12c) 사이에 컬러 필터가 더 배치될 수도 있다.
상술한 아발란치 광검출기 및 이를 포함하는 이미지 센서는 도면에 도시된 실시예를 참고로 설명되었으나, 이는 예시적인 것에 불과하며, 당해 분야에서 통상적 지식을 가진 자라면 이로부터 다양한 변형 및 균등한 타 실시예가 가능하다는 점을 이해할 것이다. 그러므로 개시된 실시예들은 한정적인 관점이 아니라 설명적인 관점에서 고려되어야 한다. 권리범위는 전술한 설명이 아니라 특허청구범위에 나타나 있으며, 그와 동등한 범위 내에 있는 모든 차이점은 권리범위에 포함된 것으로 해석되어야 할 것이다.
10.....아발란치 광검출기 11, 16.....전극
12.....콜렉터층 13.....터널 장벽층
14.....그래핀층 15.....이미터층
100, 200.....이미지 센서

Claims (18)

  1. 제 1 전극;
    상기 제 1 전극 상에 배치된 콜렉터층;
    상기 콜렉터층 상에 배치된 터널 장벽층;
    상기 터널 장벽층 상에 배치된 그래핀층;
    상기 그래핀층 상에 배치된 이미터층; 및
    상기 이미터층 상에 배치된 제 2 전극;을 포함하는 광검출기.
  2. 제 1 항에 있어서,
    상기 제 1 전극은 도전성을 갖는 금속 재료로 이루어지는 광검출기.
  3. 제 1 항에 있어서,
    상기 콜렉터층과 상기 이미터층은 반도체 재료로 이루어지는 광검출기.
  4. 제 3 항에 있어서,
    상기 반도체 재료는 실리콘(Si), 게르마늄(Ge), 유기 반도체, 화합물 반도체, 양자점, 또는 밴드갭을 갖는 이차원 결정을 포함하는 광검출기.
  5. 제 4 항에 있어서,
    상기 밴드갭을 갖는 2차원 결정은 전이금속과 칼코겐 원소의 화합물인 전이금속 디칼코게나이드를 포함하는 광검출기.
  6. 제 5 항에 있어서,
    상기 전이금속 디칼코게나이드는 MoS2, WS2, TaS2, HfS2, ReS2, TiS2, NbS2, SnS2, MoSe2, WSe2, TaSe2, HfSe2, ReSe2, TiSe2, NbSe2, SnSe2, MoTe2, WTe2, TaTe2, HfTe2, ReTe2, TiTe2, NbTe2, SnTe2 중에서 적어도 하나를 포함하는 광검출기.
  7. 제 4 항에 있어서,
    상기 밴드갭을 갖는 이차원 결정은 TiOx, NbOx, MnOx, VaOx, MnO3, TaO3, WO3, MoCl2, CrCl3, RuCl3, BiI3, PbCl4, GeS, GaS, GeSe, GaSe, PtSe2, In2Se3, GaTe, InS, InSe, InTe 중에서 적어도 하나를 포함하는 광검출기.
  8. 제 1 항에 있어서,
    상기 터널 장벽층은 전자와 정공의 터널링이 가능한 두께를 갖는 절연성 재료로 이루어지는 광검출기.
  9. 제 8 항에 있어서,
    상기 터널 장벽층은 SiO2, SiN, Al2O3, HfO2, h-BN(hexagonal BN) 중에서 적어도 하나를 포함하는 광검출기.
  10. 제 1 항에 있어서,
    상기 제 2 전극은 투명한 도전성 재료로 이루어지는 광검출기.
  11. 제 1 항에 있어서,
    상기 그래핀층은 단층 그래핀 또는 다층 그래핀을 포함하며, 0.3 nm 내지 1 ㎛의 두께를 갖는 광검출기.
  12. 제 1 항에 있어서,
    상기 이미터층 및 상기 터널 장벽층은 0.3 nm 내지 1 ㎛의 두께를 갖는 광검출기.
  13. 기판;
    상기 기판 상에 배치된 절연층;
    상기 절연층 상에 배치된 제 1 전극;
    상기 제 1 전극 상에 배치된 제 1 광검출기; 및
    상기 제 1 광검출기 위에 배치된 제 2 광검출기;를 포함하며,
    상기 제 1 및 제 2 광검출기는:
    콜렉터층;
    상기 콜렉터층 상에 배치된 터널 장벽층;
    상기 터널 장벽층 상에 배치된 그래핀층;
    상기 그래핀층 상에 배치된 이미터층; 및
    상기 이미터층 상에 배치된 제 2 전극;을 포함하는 이미지 센서.
  14. 제 13 항에 있어서,
    상기 콜렉터층과 상기 이미터층은 반도체 재료로 이루어지는 이미지 센서.
  15. 제 14 항에 있어서,
    상기 제 1 광검출기의 이미터층의 반도체 재료의 밴드갭과 상기 제 2 광검출기의 이미터층의 반도체 재료의 밴드갭이 상이한 이미지 센서.
  16. 기판;
    상기 기판 상에 배치된 절연층; 및
    상기 절연층 상에 인접하여 배치된 제 1 광검출기 및 제 2 광검출기;를 포함하며,
    상기 제 1 및 제 2 광검출기는:
    상기 절연층 상에 배치된 제 1 전극;
    상기 제 1 전극 상에 배치된 콜렉터층;
    상기 콜렉터층 상에 배치된 터널 장벽층;
    상기 터널 장벽층 상에 배치된 그래핀층;
    상기 그래핀층 상에 배치된 이미터층; 및
    상기 이미터층 상에 배치된 제 2 전극;을 포함하는 이미지 센서.
  17. 제 16 항에 있어서,
    상기 콜렉터층과 상기 이미터층은 반도체 재료로 이루어지는 이미지 센서.
  18. 제 16 항에 있어서,
    상기 제 1 광검출기의 이미터층의 반도체 재료의 밴드갭과 상기 제 2 광검출기의 이미터층의 반도체 재료의 밴드갭이 상이한 이미지 센서.
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