KR20170126051A - 표시 장치 - Google Patents

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KR20170126051A
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Abstract

제1 기판, 상기 제1 기판에 대향되게 배치된 제2 기판, 상기 제1 기판 및 상기 제2 기판 사이에 배치된 액정층, 상기 제1 기판 상에 배치된 복수의 화소, 및 상기 제1 기판 및 상기 제2 기판 중 적어도 하나 상에 배치되어 표시부와 비표시부를 정의하며, 곡률부를 갖는 제1 테두리 차광 부재를 포함하며, 상기 복수의 화소는 상기 곡률부와 중첩되지 않는 제1 화소, 및 상기 곡률부와 적어도 일부가 중첩되는 제2 화소를 포함하며, 상기 제1 화소의 화소 전극은 상기 제2 화소의 화소 전극과 서로 다른 형태를 갖는 표시 장치를 제공한다.

Description

표시 장치{DISPLAY DEVICE}
본 발명은 표시 장치에 관한 것으로, 특히 곡률을 갖는 표시부를 포함하는 액정 표시 장치에 대한 것이다.
표시 장치는 발광 방식에 따라 액정 표시 장치(liquid crystal display, LCD), 유기 발광 표시 장치(organic light emitting diode display, OLED display), 플라즈마 표시 장치(plasma display panel, PDP) 및 전기 영동 표시 장치(electrophoretic display) 등으로 분류된다.
액정 표시 장치는 전극이 형성되어 있는 표시 기판, 대향 기판, 및 표시 기판과 대향 기판 사이에 배치된 액정층을 포함한다. 최근 표시 기판에 색필터를 배치하여 투과율을 높인 COA(Color-filter On Array) 구조를 채용하고 있다.
또한, 색필터가 배치된 표시 기판과 차광 부재가 배치된 대향 기판의 결합 공정에서 얼라인 미스가 발생되는 것을 방지하기 위하여 표시 기판에 색필터와 차광 부재를 배치한 BOA(Black matrix On Array) 구조를 채용하고 있다.
최근 스마트 워치(smart watch) 또는 헤드 마운트 디스플레이(Head Mount Display)와 같은 웨어러블(wearable) 장치가 다양한 분야에 이용됨에 따라, 곡률을 갖는 표시부를 포함하는 액정 표시 장치에 관한 수요가 증가하고 있다.
곡률을 갖는 표시부는 계단 형태로 배열된 화소 및 소정의 곡률을 갖는 차광 부재를 이용하여 구현할 수 있다. 다만, 이 경우 차광 부재가 계단 형태로 배열된 화소 위에 배치됨에 따라 차광 부재의 단차로 인하여 액정이 원하는 방향으로 배열되지 못하게 되고, 이로 인해 얼룩이 발생할 수 있다.
이에 본 발명은 곡률을 갖는 표시부를 포함하는 표시 장치에 있어서, 곡률부에서 발생하는 얼룩을 방지하고자 한다.
제1 기판, 상기 제1 기판에 대향되게 배치된 제2 기판, 상기 제1 기판 및 상기 제2 기판 사이에 배치된 액정층, 상기 제1 기판 상에 배치된 복수의 화소, 및 상기 제1 기판 및 상기 제2 기판 중 적어도 하나 상에 배치되어 표시부와 비표시부를 정의하며, 곡률부를 갖는 제1 테두리 차광 부재를 포함하며, 상기 복수의 화소는 상기 곡률부와 중첩되지 않는 제1 화소, 및 상기 곡률부와 적어도 일부가 중첩되는 제2 화소를 포함하며, 상기 제1 화소의 화소 전극은 상기 제2 화소의 화소 전극과 서로 다른 형태를 갖는 표시 장치를 제공한다.
상기 제2 화소는 계단 형태로 배치될 수 있다.
상기 제1 화소는 상기 제2 화소보다 많은 액정 도메인을 가질 수 있다.
상기 제1 테두리 차광 부재와 상기 제2 화소의 화소 전극의 중첩 면적은 상기 제1 화소의 화소 전극의 면적보다 작을 수 있다.
상기 제1 화소의 화소 전극은 십자형 줄기부 및 상기 십자형 줄기부로부터 서로 다른 방향으로 경사지게 연장된 복수의 가지부들을 각각 포함하는 제1 부화소 전극 및 제2 부화소 전극을 포함할 수 있다.
상기 제2 화소의 화소 전극은 줄기부 및 상기 줄기부로부터 하나의 방향으로 경사지게 연장된 복수의 가지부들을 포함하는 제3 부화소 전극, 및 십자형 줄기부 및 상기 십자형 줄기부로부터 서로 다른 방향으로 서로 다른 방향으로 경사지게 연장된 복수의 가지부들을 포함하는 제4 부화소 전극을 포함할 수 있다.
상기 제3 부화소 전극의 가지부는 상기 곡률부와 실질적으로 수직을 이룰 수 있다.
상기 제3 부화소 전극의 가지부는 상기 곡률부와 실질적으로 평행을 이룰 수 있다.
제1 기판, 상기 제1 기판에 대향되게 배치된 제2 기판, 상기 제1 기판 및 상기 제2 기판 사이에 배치된 액정층, 상기 제1 기판 상에 배치된 복수의 화소, 및 상기 제1 기판 및 상기 제2 기판 중 적어도 하나 상에 상기 복수의 화소의 가장자리를 따라 배치된 제1 테두리 차광 부재를 포함하며, 상기 복수의 화소는 모서리부를 제외한 영역에 배치된 제1 화소, 및 모서리부에 배치된 제2 화소를 포함하는 표시 장치를 제공한다.
상기 제2 화소는 계단 형태로 배치될 수 있다.
상기 제2 화소는 표시부와 비표시부를 정의하는 제2 테두리 차광 부재를 포함할 수 있다.
상기 제1 테두리 차광 부재와 상기 제2 테두리 차광 부재는 중첩되지 않을 수 있다.
상기 제2 테두리 차광 부재는 평면상에서 경사부를 가질 수 있다.
상기 복수의 화소는 상기 제1 기판 상에 배치되며, 제1 방향으로 연장된 게이트 라인, 상기 제1 기판 상에 상기 게이트 라인과 절연되어 배치되며, 상기 제1 방향과 교차하는 제2 방향으로 연장된 데이터 라인, 및 상기 제1 기판 및 상기 제2 기판 중 적어도 하나 상에 상기 게이트 라인 및 상기 데이터 라인과 절연되어 배치된 색 필터를 포함할 수 있다.
상기 제2 테두리 차광 부재는 상기 게이트 라인과 동일층 상에 배치될 수 있다.
상기 제2 테두리 차광 부재는 상기 게이트 라인과 동일한 물질을 포함할 수 있다.
상기 제2 테두리 차광 부재는 상기 데이터 라인과 동일층 상에 배치될 수 있다.
상기 제2 테두리 차광 부재는 상기 데이터 라인과 동일한 물질을 포함할 수 있다.
상기 제2 테두리 차광 부재는 상기 색 필터와 동일층 상에 배치될 수 있다.
상기 제2 테두리 차광 부재는 적어도 하나 이상의 색 필터를 포함할 수 있다.
제1 기판, 상기 제1 기판에 대향되게 배치된 제2 기판, 상기 제1 기판 및 상기 제2 기판 사이에 배치된 액정층, 상기 제1 기판 상에 배치된 복수의 화소, 및 상기 제1 기판 및 상기 제2 기판 중 적어도 하나 상에 배치되어 표시부와 비표시부를 정의하며, 곡률부를 갖는 제1 테두리 차광 부재를 포함하며, 상기 복수의 화소는 상기 제1 기판 상에 배치되며, 제1 방향으로 연장된 게이트 라인, 상기 제1 기판 상에 상기 게이트 라인과 절연되어 배치되며, 상기 제1 방향과 교차하는 제2 방향으로 연장된 데이터 라인, 상기 제1 기판 상에 상기 게이트 라인 및 상기 데이터 라인과 절연되어 배치된 색 필터, 및 상기 색 필터 상에 배치된 보호층을 포함하며, 상기 보호층은 상기 제1 테두리 차광 부재와 중첩되는 제1 보호층 및 상기 제1 테두리 차광 부재와 중첩되지 않는 제2 보호층을 포함하며, 상기 제1 보호층은 상기 제2 보호층보다 낮은 높이를 가질 수 있다.
상기 표시 장치는 상기 제1 보호층 하부에 색 필터가 생략될 수 있다.
상기 제1 테두리 차광 부재는 상기 색 필터와 동일층 상에 배치될 수 있다.
상기 제1 테두리 차광 부재는 적어도 하나 이상의 색 필터를 포함할 수 있다.
곡률을 갖는 표시부를 포함하는 표시 장치에 있어서, 곡률부에서 발생하는 얼룩을 방지할 수 있다.
도 1은 본 발명의 일실시예에 따른 액정 표시 장치의 평면도이다.
도 2는 본 발명의 일실시예에 따른 액정 표시 장치의 사시도이다.
도 3 내지 도 5는 본 발명의 다른 일실시예에 따른 액정 표시 장치의 사시도이다.
도 6은 도 1의 "A"영역을 확대한 부분 확대도이다.
도 7은 본 발명의 일실시예에 따른 액정 표시 장치 표시부의 크기와 곡률부의 곡률 반경에 대한 그래프이다.
도 8은 본 발명의 일실시예에 따른 제1 화소(PX1)를 나타낸 평면도이다.
도 9는 도 8의 Ⅰ-Ⅰ'을 따라 절단한 단면도이다.
도 10은 본 발명의 일실시예에 따른 제2 화소(PX2)를 나타낸 평면도이다.
도 11은 도 10의 Ⅱ-Ⅱ'을 따라 절단한 단면도이다.
도 12 및 도 13은 본 발명의 다른 일실시예에 따른 제2 화소(PX2)를 나타낸 평면도이다.
도 14는 본 발명의 다른 일실시예에 따른 제1 화소(PX1)를 나타낸 평면도이다.
도 15 및 도 16은 본 발명의 다른 일실시예에 따른 제2 화소(PX2)를 나타낸 평면도이다.
도 17은 본 발명의 다른 일실시예에 따른 액정 표시 장치의 평면도이다.
도 18은 도 17의 Ⅲ-Ⅲ'을 따라 절단한 단면도이다.
도 19는 본 발명의 다른 일실시예에 다른 액정 표시 장치의 평면도이다.
도 20은 도 12의 Ⅳ-Ⅳ'을 따라 절단한 단면도이다.
도 21은 본 발명의 다른 일실시예에 따른 단면도이다.
도 22는 본 발명의 다른 일실시예에 따른 액정 표시 장치의 부분 확대도이다.
이하, 첨부도면을 참조하여 본 발명을 상세히 설명한다.
본 발명은 다양한 변경이 가능하고, 여러 가지 형태로 실시될 수 있는 바, 특정의 실시예만을 도면에 예시하고 본문은 이를 주로 설명한다. 그렇다고 하여 본 발명의 범위가 상기 특정한 실시예로 한정되는 것은 아니다. 본 발명의 사상 및 기술 범위에 포함되는 모든 변경, 균등물 또는 대체물은 본 발명의 범위에 포함되는 것으로 이해되어야 한다.
도면에서, 각 구성요소와 그 형상 등이 간략하게 그려지거나 또는 과장되어 그려지기도 하며, 실제 제품에 있는 구성요소가 표현되지 않고 생략되기도 한다. 따라서, 도면은 발명의 이해를 돕기 위한 것으로 해석되어야 한다. 또한, 동일한 기능을 하는 구성요소는 동일한 부호로 표시된다.
어떤 층이나 구성요소가 다른 층이나 구성요소의 '상'에 있다 라고 기재되는 것은 어떤 층이나 구성요소가 다른 층이나 구성요소와 직접 접촉하여 배치된 경우뿐만 아니라, 그 사이에 제3의 층이 개재되어 배치된 경우까지 모두 포함하는 의미이다.
본 명세서에서 어떤 부분이 다른 부분과 연결되어 있다고 할 때, 이는 직접적으로 연결되어 있는 경우뿐 아니라, 그 중간에 다른 구성요소를 두고 전기적으로 연결되어 있는 경우도 포함한다. 또한, 어떤 부분이 어떤 구성 요소를 포함한다고 할 때, 이는 특별히 반대되는 기재가 없는 한 다른 구성요소를 제외하는 것이 아니라 다른 구성요소를 더 포함할 수 있는 것을 의미한다.
본 명세서에서 제1, 제2, 제3 등의 용어는 다양한 구성 요소들을 설명하는데 사용될 수 있지만, 이러한 구성 요소들은 상기 용어들에 의해 한정되는 것은 아니다. 상기 용어들은 하나의 구성 요소를 다른 구성 요소들로부터 구별하는 목적으로 사용된다. 예를 들어, 본 발명의 권리 범위로부터 벗어나지 않고, 제1 구성 요소가 제2 또는 제3 구성 요소 등으로 명명될 수 있으며, 유사하게 제2 또는 제3 구성 요소도 교호적으로 명명될 수 있다.
본 발명을 명확하게 설명하기 위해 설명과 관계없는 부분은 도면에서 생략되었으며, 명세서 전체를 통하여 동일 또는 유사한 구성요소에 대해서는 동일한 참조 부호가 붙여진다.
본 발명의 일실시예에 따른 표시 장치는 액정 표시 장치인 것을 전제로 설명한다. 다만, 본 발명의 적용 범위가 액정 표시 장치에 한정되는 것은 아니며, 예를 들어 본 발명은 유기 발광 표시 장치에도 적용될 수 있다.
도 1은 본 발명의 일실시예에 따른 액정 표시 장치의 평면도이고, 도 2는 본 발명의 일실시예에 따른 액정 표시 장치의 사시도이고, 도 3 내지 도 5는 본 발명의 다른 일실시예에 따른 액정 표시 장치의 사시도이다.
도 1을 참조하면, 본 발명의 일실시예에 따른 액정 표시 장치(10)는 영상을 표시하는 액정 표시 패널(110), 액정 표시 패널(110)에 게이트 전압을 출력하는 게이트 구동부(210), 및 액정 표시 패널(110)에 데이터 전압을 출력하는 데이터 구동부(310)를 포함한다.
도 2를 참조하면, 액정 표시 패널(110)은 제1 기판(111), 제1 기판(111)과 마주보는 제2 기판(미도시) 및 제1 기판(111)과 제2 기판(미도시)과의 사이에 개재된 액정층(미도시)을 포함한다.
액정 표시 패널(110)은 평면상에서 실질적으로 사각 형태를 가질 수 있으며, 액정 표시 패널(110)의 평면상에서 소정의 곡률을 갖는 모서리부를 포함할 수 있다. 다만, 이에 한정되는 것은 아니며, 액정 표시 패널(110)은 평면상에서 사각 형태를 가질 수도 있다.
액정 표시 패널(110)은 영상이 표시되는 표시부(DA)와 표시부(DA) 주변의 비표시부(NDA)를 포함할 수 있으며, 표시부(DA)는 액정 표시 패널(110)의 평면상 형태와 실질적으로 동일한 형태를 가질 수 있다.
또한, 도 3을 참조하면, 액정 표시 패널(110)은 평면상에서 실질적으로 사각 형태를 가질 수 있으며, 액정 표시 패널(110)은 소정의 곡률을 갖는 적어도 하나 이상의 모서리부를 가질 수 있다.
예를 들어, 액정 표시 패널(110)는 상단 또는 하단에 소정의 곡률을 갖는 두 모서리부를 가질 수 있다. 또한, 액정 표시 패널(110)는 좌단 또는 우단에 소정의 곡률을 갖는 두 모서리부를 가질 수도 있다.
또한, 도 4를 참조하면, 액정 표시 패널(110)은 평면상에서 실질적으로 원 형태를 가질 수 있으며, 도 5를 참조하면, 액정 표시 패널(110)은 평면상에서 실질적으로 타원 형태를 가질 수도 있다.
다시 도 1을 참조하면, 액정 표시 패널(110)은 제1 기판(111) 상에 배치된 복수의 게이트 라인(GL1~GLm, 또는 GL), 복수의 게이트 라인(GL1~GLm)과 절연되어 교차하는 복수의 데이터 라인(DL1~DLn, 또는 DL), 및 게이트 라인(GL1~GLm) 및데이터 라인(DL1 ~ DLn)과 연결되어 화상을 표시하는 복수의 화소(PX)를 포함한다.
게이트 구동부(210)는 복수의 게이트 라인(GL1~GLm)의 일단부에 인접하여 배치된다. 게이트 구동부(210)는 복수의 게이트 라인(GL1~GLm)의 일단부에 전기적으로 연결되어 게이트 전압을 복수의 게이트 라인(GL1~GLm)에 순차적으로 인가한다. 도 1에서 게이트 구동부(210)는 제1 기판(111)의 일측(예를 들어, 좌측)에 배치된 것으로 도시되어 있으나, 이에 한정되는 것은 아니며, 게이트 구동부(210)는 제1 기판(111)의 타측(예를 들어, 우측)에 배치될 수도 있고, 일측 및 타측에 배치될 수도 있다.
데이터 구동부(310)는 복수의 데이터 라인(DL1~DLn)의 일단부에 인접하여 배치된다. 데이터 구동부(310)는 복수의 구동 회로 기판(320a, 320b, 320c)을 포함한다. 예를 들어, 복수의 구동 회로 기판(320a, 320b, 320c)은 테이프 캐리어 패키지(Tape Carrier Package, TCP) 또는 칩 온 필름(Chip On Film, COF)일 수 있다. 복수의 구동 회로 기판(320a, 320b, 320c)상에 복수의 데이터 구동 집적 회로(321a, 321b, 321c)가 실장된다. 복수의 데이터 구동 집적 회로(321a, 321b, 321c)는 복수의 데이터 라인(DL1~DLn)의 일단부에 전기적으로 연결되어 복수의 데이터 라인(DL1~DLn)에 데이터 전압을 출력한다.
액정 표시 장치(10)는 게이트 구동부(210)와 복수의 데이터 구동 집적 회로(321a, 321b, 321c)의 구동을 제어하기 위한 컨트롤 인쇄 회로 기판(330)을 더 포함한다. 컨트롤 인쇄 회로 기판(330)은 복수의 데이터 구동 집적 회로(321a, 321b, 321c)의 구동을 제어하는 데이터 제어 신호와 영상 데이터를 출력하고, 게이트 구동부(210)의 구동을 제어하는 게이트 제어 신호를 출력한다.
컨트롤 인쇄 회로 기판(330)은 외부로부터 영상 데이터를 입력 받아 데이터 제어 신호와 게이트 제어 신호를 생성하는 타이밍 컨트롤러(331) 및 게이트 제어 신호를 생성하는 게이트 제어회로(332)를 포함한다. 그러나, 본 발명의 일실시예가 이에 한정되는 것은 아니며, 컨트롤 인쇄 회로 기판(330)은 타이밍 컨트롤러를 포함하는 또 다른 인쇄 회로 기판으로부터 제어 신호를 수신하고 데이터 제어 신호를 생성하여 출력하는 데이터 인쇄 회로 기판일 수도 있다.
타이밍 컨트롤러(331)는 복수의 데이터 구동 집적 회로(321a, 321b, 321c)와 게이트 구동부(210)의 구동을 제어한다. 게이트 제어회로(332)는 게이트 구동부(210)의 구동을 위한 클럭 신호, 게이트 신호의 개시를 알리는 개시 신호 등을 생성한다.
컨트롤 인쇄 회로 기판(330)은 데이터 제어신호와 영상 데이터를 복수의 구동 회로 기판(320a, 320b, 320c)을 통해 복수의 데이터 구동 집적 회로(321a, 321b, 321c)로 인가한다. 또한, 컨트롤 인쇄 회로 기판(330)은 게이트 제어 신호를 게이트 구동부(210)에 인접하는 구동 회로 기판(320a)을 통해 게이트 구동부(210)에 인가한다.
그러나, 본 발명의 일실시예가 이에 한정되는 것은 아니며, 복수의 데이터 구동 집적 회로(321a, 321b, 321c)는 액정 표시 패널(110)에 직접 장착되거나, 가요성 인쇄 회로막(flexible printed circuit film)(미도시) 위에 장착되어 액정 표시 패널(110)에 부착되거나, 별도의 인쇄 회로 기판(printed circuit board)(미도시) 상에 장착될 수도 있다. 또한, 복수의 데이터 구동 집적 회로(321a, 321b, 321c)는 게이트 라인(GL1 ~ GLm) 및 박막 트랜지스터(미도시)와 함께 액정 표시 패널(110)에 집적될 수도 있다. 또한, 복수의 데이터 구동 집적 회로(321a, 321b, 321c), 타이밍 컨트롤러(331), 및 게이트 제어회로(332)는 단일 칩으로 집적될 수 있다.
도 6은 도 1의 "A"영역을 확대한 부분 확대도이고, 도 7은 본 발명의 일실시예에 다른 액정 표시 장치 표시부의 크기와 곡률부의 곡률 반경에 대한 그래프이다.
도 1 및 도 6을 참조하면, 액정 표시 패널(110)은 제1 기판(111) 상에 배치된 차광 부재(190)를 더 포함한다. 본 발명의 일실시예에 따른 액정 표시 패널(110)은 차광 부재(190)가 제1 기판(111) 상에 배치되는 것을 전제로 설명하나 이에 한정되는 것은 아니며, 차광 부재(190)는 제2 기판(미도시) 상에 배치될 수도 있다.
차광 부재(190)는 제1 방향(D1)으로 연장된 제1 차광 부재(191), 제1 방향(D1)과 교차하는 제2 방향(D2)으로 연장된 제2 차광 부재(192), 및 제1 테두리 차광 부재(195) 등을 포함한다. 제2 차광 부재(192)는 후술할 색필터들의 배치에 따라 생략될 수도 있다. 이와 관련된 내용은 후술한다.
차광 부재(190)는 검은색 안료 또는 블랙 수지(black resin) 등이 사용될 수 있으며, 적색 필터 및 청색 필터의 조합 등이 사용될 수 있다. 예를 들어, 적색 필터 및 청색 필터가 적층되어 사용될 수 있다.
제1 테두리 차광부재(195)는 평면상에서 소정의 곡률을 갖는 적어도 하나 이상의 곡률부(CP)를 포함한다. 제1 테두리 차광부재(195)에 의해 영상이 표시되는 표시부(DA)와 영상이 표시되지 않는 비표시부(NDA)가 정의된다.
표시부(DA)의 대각선의 길이가 "D"mm 이고, 곡률부(CP)의 곡률 반경이 "R"mm 일 때, "D"와 "R"은, 예를 들어, 다음 식 1을 만족할 수 있다.
[식 1]
0.01 x D + 5 ≤ R ≤ 0.01 x D + 15
또한, 표시부(DA)의 대각선의 길이가 "d"inch 이고, 곡률부(CP)의 곡률 반경이 "R"mm 일 때, "d"와 "R"은 다음 식 2를 만족할 수 있다.
[식 2]
0.25 x d + 5 ≤ R ≤ 0.25 x d + 15
표시부(DA)의 대각선의 길이(단위 inch)에 대한 곡률부(CP)의 곡률 반경 (단위 mm)은 도 7의 그래프로 표시될 수 있다.
도 1 및 도 6을 참조하면, 복수의 화소(PX)는 제1 테두리 차광 부재(195)의 곡률부(CP)와 중첩하지 않는 제1 화소(PX1), 및 제1 테두리 차광 부재(195)의 곡률부(CP)와 적어도 일부가 중첩하는 제2 화소(PX2)를 포함한다.
본 발명의 일실시예에서 제2 화소(PX2)가 평면상에서 계단 형태로 배열된 것으로 도시되어 있으나 이에 한정되는 것은 아니며, 제2 화소(PX2)는 매트릭스 형태로 배열될 수도 있음은 물론이다.
본 발명의 일실시예에서 제2 화소(PX2)가 평면상에서 계단 형태로 배열됨에 따라 제2 화소(PX2)와 연결된 게이트 구동부(210) 및 데이터 라인(DL1 ~ DLn)들도 계단 형태로 배치될 수 있다.
구체적으로, 게이트 구동부(210)는 각 게이트 라인(GL1~GLm)과 연결되는 복수의 스테이지(ST1~ST4)를 포함하는데, 제2 화소(PX2)와 연결된 스테이지는 제2 화소(PX2) 쪽으로 돌출되어 배치될 수 있다. 이와 같이, 복수의 스테이지가 계단 형태로 배치됨으로써 비표시부(NDA)의 면적을 최소화할 수 있다.
또한, 제2 화소(PX2)와 연결되는 데이터 라인(DL1 ~ DLn)은 계단 형태로 절곡되어 연장될 수 있다. 다만, 이에 한정되는 것은 아니며 사선 또는 곡선 형태로 절곡되어 연장될 수도 있다.
제1 화소(PX1)의 화소 전극은 제2 화소(PX2)의 화소 전극과 서로 다른 형태를 갖는다.
도 8은 본 발명의 일실시예에 따른 제1 화소(PX1)를 나타낸 평면도이고, 도 9는 도 8의 Ⅰ-Ⅰ'을 따라 절단한 단면도이다.
도 8을 참조하면, 본 발명의 일실시예에 따른 제1 화소(PX1)는 제1 부화소(SPX1) 및 제2 부화소(SPX2)를 포함한다.
제1 부화소(SPX1)는 제1 박막 트랜지스터(TR1), 제1 부화소 전극(PE1) 및 제1 스토리지 전극(STE1)을 포함한다. 제2 부화소(SPX2)는 제2 박막 트랜지스터(TR2), 제2 부화소 전극(PE2), 제2 스토리지 전극(STE2) 및 제3 박막 트랜지스터(TR3)를 포함한다.
제1 부화소(SPX1)는 상부 화소(high pixel)라 불려지고, 제2 부화소(SPX2)는 하부 화소(low pixel)라 불려지기도 한다.
제1 부화소(SPX1)의 제1 박막 트랜지스터(TR1)는 게이트 라인(GL)으로부터 분기된 제1 게이트 전극(GE1), 제1 게이트 전극(GE1)과 중첩하여 배치된 제1 반도체층(SM1), 데이터 라인(DL)으로부터 분기되며 제1 반도체층(SM1)과 중첩하여 배치된 제1 소스 전극(SE1), 제1 소스 전극(SE1)과 이격되어 제1 반도체층(SM1)과 중첩하여 배치된 제1 드레인 전극(DE1)을 포함한다. 제1 드레인 전극(DE1)은 제1 부화소 전극(PE1)과 연결된다. 구체적으로, 제1 드레인 전극(DE1)은 제1 부화소 전극(PE1)쪽으로 연장되어 제1 컨택홀(H1)을 통해 제1 부화소 전극(PE1)으로부터 분기된 제1 연결 전극(CNE1)과 전기적으로 연결된다.
제1 스토리지 전극(STE1)은 제1 스토리지 라인(SL1)과 연결된다. 제1 부화소 전극(PE1)은 제1 스토리지 라인(SL1), 제1 스토리지 전극(STE1)과 부분적으로 중첩되어 제1 스토리지 커패시터를 형성한다. 제1 스토리지 전극(STE1)는 스토리지 전압을 인가받는다.
제2 부화소(SPX2)의 제2 박막 트랜지스터(TR2)는 게이트 라인(GL)으로부터 분기된 제2 게이트 전극(GE2), 제2 게이트 전극(GE2)과 중첩하여 배치된 제2 반도체층(SM2), 데이터 라인(DL)으로부터 분기되며 제2 반도체층(SM2)과 중첩하여 배치된 제2 소스 전극(SE2) 및 제2 소스 전극(SE2)과 이격되어 제2 반도체층(SM2)과 중첩하여 배치된 제2 드레인 전극(DE2)을 포함한다. 제2 드레인 전극(DE2)은 제2 부화소 전극(PE2)과 연결된다. 구체적으로, 제2 드레인 전극(DE2)은 제2 부화소 전극(PE2)쪽으로 연장되어 제2 컨택홀(H2)을 통해 제2 부화소 전극(PE2)으로부터 분기된 제2 연결 전극(CNE2)과 전기적으로 연결된다.
제2 부화소(SPX2)의 제3 박막 트랜지스터(TR3)는 게이트 라인(GL)으로부터 분기된 제3 게이트 전극(GE3), 제3 컨택홀(H3)을 통해 제1 스토리지 전극(STE1)과 전기적으로 연결된 제3 소스 전극(SE3), 제2 드레인 전극(DE2)으로부터 연장된 제3 드레인 전극(DE3) 및 제3 반도체층(SM3)을 포함한다. 제3 소스 전극(SE3)과 제1 스토리지 전극(STE1)은 제3 컨택홀(H3)을 통해 서로 전기적으로 연결된다. 또한, 제3 드레인 전극(DE3)은 제2 컨택홀(H2)을 통해 제2 부화소 전극(PE2)에 전기적으로 연결된다.
제2 스토리지 전극(STE2)은 제2 스토리지 라인(SL2)과 연결된다. 제2 부화소 전극(PE2)은 제2 스토리지 라인(SL2) 및 제2 스토리지 전극(STE2)과 부분적으로 중첩되어 제2 스토리지 커패시터를 형성한다. 제2 스토리지 전극(STE2) 스토리지 전압을 인가받는다.
도 8 및 도 9를 참조하면, 제1 기판(111)상에 게이트 라인(GL), 게이트 라인(GL)으로부터 분기된 제1, 제2 및 제3 게이트 전극(GE1, GE2, GE3), 제1 스토리지 라인(SL1), 제1 스토리지 전극(STE1), 제2 스토리지 라인(SL2) 및 제2 스토리지 전극(STE2)이 배치된다.
제1 기판(111) 상에 게이트 라인(GL), 제1, 제2 및 제3 게이트 전극(GE1, GE2, GE3), 제1 및 제2 스토리지 라인(SL1, SL2), 및 제1 및 제2 스토리지 전극(STE1, STE2)을 덮는 게이트 절연막(130)이 배치된다.
게이트 절연막(130)상에, 제1, 제2 및 제3 반도체층(SM1, SM2, SM3)이 배치된다. 제1, 제2 및 제3 반도체층(SM1, SM2, SM3)은 비정질 실리콘(amorphous Silicon)으로 이루어지거나, 또는, 갈륨(Ga), 인듐(In), 주석(Sn), 아연(Zn) 중 적어도 하나 이상의 원소를 포함하는 산화물 반도체(oxide semiconductor)로 이루어 질 수 있다. 예를 들면, 산화물 반도체는 산화 아연(ZnO), 아연-주석 산화물(ZTO), 아연-인듐 산화물(ZIO), 인듐 산화물(InO), 티타늄 산화물(TiO), 인듐-갈륨-아연 산화물(IGZO), 인듐-아연-주석 산화물(IZTO)로 이루어진 군에서 선택된 적어도 하나 이상을 포함할 수 있다. 도면에 도시되지 않았으나, 제1, 제2 및 제3 반도체층(SM1, SM2, SM3)상에 오믹 콘택층이 배치될 수 있다.
데이터 라인(DL)은 세로 방향으로 연장되어 게이트 절연막(130) 상에 배치된다. 제1, 제2 및 제3 반도체층(SM1, SM2, SM3)과 중첩되어 제1, 제2 및 제3 소스 전극(SE1, SE2, SE3)이 각각 배치되고, 제1, 제2 및 제3 드레인 전극(DE1, DE2, DE3)이 각각 배치되어, 제1, 제2 및 제3 박막 트랜지스터(TR1, TR2, TR3)가 이루어진다.
제3 박막 트랜지스터(TR3)의 제3 소스 전극(SE3)은 게이트 절연막(130)을 관통하여 형성된 제3 컨택홀(H3)을 통해 제1 스토리지 전극(STE1)과 전기적으로 연결된다.
데이터 라인(DL), 제1, 제2 및 제3 박막 트랜지스터(TR1, TR2, TR3)를 덮도록 층간절연막(169)이 배치된다. 층간절연막(169)은 노출된 제1, 제2 및 제3 반도체층(SM1, SM2, SM3)의 상부를 커버한다. 층간절연막(169)은, 예를 들어, 실리콘 산화물, 실리콘 질화물, 감광성(photosensitivity) 유기물 또는 실리콘계 저유전율 절연 물질을 포함하는 단일막 또는 다중막 구조를 가질 수 있다.
층간절연막(169) 상에 색필터(CF)가 배치된다.
색필터(CF)는 제1 및 제2 부화소 전극(PE1, PE2)과 중첩하여 배치되며, 화소를 투과하는 광에 색을 제공한다. 색필터는 적색 색필터, 녹색 색필터, 및 청색 색필터 중 어느 하나일 수 있다. 색필터는 백색 색필터일 수도 있다.
색필터(CF)는 제1 및 제2 부화소 전극(PE1, PE2) 상에 아일랜드(island) 형태로 배치되거나, 제2 방향(D2)을 따라 연장된 형태로 배치될 수도 있다.
또한, 제1 방향(D1)을 따라 서로 다른 색상의 색필터(CF)가 배치될 수 있으며, 이때 제1 방향(D1)으로 배치된 색필터(CF)가 중첩하거나 중첩하지 않을 수 있다. 제1 방향(D1)으로 배치된 색필터(CF)가 중첩하는 경우, 전술한 제2 차광 부재(192, 도 6 참조)가 생략될 수도 있다.
층간절연막(169) 및 색필터(CF)상에 보호층(175)이 배치된다. 보호층(175)은 실리콘 산화물, 실리콘 질화물, 감광성(photosensitivity)의 유기물 또는 실리콘계 저유전율 절연 물질 등을 포함하는 단일막 또는 다중막 구조를 가질 수 있다.
보호층(175)은 제1, 제2 및 제3 박막 트랜지스터(TR1, TR2, TR3)와 색필터(CF)의 상부를 평탄화하는 역할을 한다. 따라서 보호층(175)은 평탄화막이라고도 불려진다.
층간절연막(169) 및 보호층(175)의 일부가 제거되어, 제1 드레인 전극(DE1)의 일부를 드러내는 제1 컨택홀(H1) 및 제2 드레인 전극(DE2)의 일부를 드러내는 제2 컨택홀(H2)이 만들어진다.
보호층(175)상에 제1 부화소 전극(PE1) 및 제2 부화소 전극(PE2)이 배치된다. 제1 부화소 전극(PE1)은 제1 컨택홀(H1)을 통하여 제1 드레인 전극(DE1)과 전기적으로 연결된다. 제2 화소전극(PE2)은 제2 컨택홀(H2)을 통하여 제2 드레인 전극(DE2)과 전기적으로 연결된다.
도 8을 참조하면, 제1 및 제2 부화소 전극(PE1, PE2)은 각각 십자형 줄기부 및 십자형 줄기부로부터 서로 다른 방향으로 경사지게 연장된 복수의 가지부들을 포함한다. 제1 및 제2 부화소 전극(PE1, PE2)은 투명 도전성 물질로 만들어질 수 있다. 예를 들어, 제1 및 제2 부화소 전극(PE1, PE2)은 ITO(indium tin oxide), IZO(indium zinc oxide), ITZO(indium tin zinc oxide), AZO(aluminum zinc oxide) 등의 투명 도전성 물질로 만들어 질 수 있다.
도 9를 참조하면, 보호층(175) 상에 제1 방향(D1)으로 연장된 제1 차광 부재(191)가 배치된다. 또한, 컬럼 스페이서(193)가 제1 차광 부재(191) 상에 더 배치될 수 있다.
본 발명의 일실시예에 따르면, 차광 부재(190)와 컬럼 스페이서(193)는 단일 공정에 의해 동시에 형성된다. 이러한 차광 부재(190)와 컬럼 스페이서(193)는 블랙 컬럼 스페이서(BCS)라고 불려지기도 한다. 또한, 동일 기판에 배치된 차광 부재(190)와 박막 트랜지스터(TR1, TR2, TR3)를 포함하는 구조는 BOA (Black Matirx on Array) 구조라고도 불려진다.
도시되지 않았지만, 제1 및 제2 부화소 전극(PE1, PE2) 및 차광 부재(190) 상에 하부 배향막이 배치될 수 있다. 하부 배향막은 수직 배향막일 수 있고, 광반응 물질을 포함할 수 있다.
제2 기판(112)은 투명한 유리 또는 플라스틱 등으로 된 절연 기판이다.
공통 전극(CE)은 제2 기판(112) 상에 배치된다. 공통 전극(CE)은 ITO (indium tin oxide), IZO(indium zinc oxide) 또는 AZO(aluminum zinc oxide)와 같은 투명도전성산화물(Transparent Conductive Oxide)로 만들어질 수 있다.
도시되지 않았지만, 공통 전극(CE)상에 상부 배향막이 배치될 수 있다. 상부 배향막은 전술된 하부 배향막과 동일한 물질로 만들어질 수 있다.
제1 기판(111)과 제2 기판(112) 사이의 마주보는 면들을 각각 해당 기판의 상부면으로 정의하고, 그 상부면들의 반대편에 위치한 면들을 각각 해당 기판의 하부면으로 정의할 때, 제1 기판(111)의 하부면과 제2 기판(112)의 하부면에 각각 편광판이 배치될 수 있다.
컬럼 스페이서(193)에 의하여 확보된 제1 기판(111)과 제2 기판(112) 사이의 이격 공간에 액정층(LC)이 개재된다.
액정층(LC)은 액정 분자를 포함할 수 있다. 액정층(LC)의 액정 분자는 그 장축 방향이 제1 기판(111)과 제2 기판(112) 중 어느 하나와 평행하게 배열되어 있고, 그 방향이 제1 기판(111)의 배향막의 러빙 방향으로부터 제2 기판(112)에 이르기까지 나선상으로 90도 비틀린 구조를 가질 수 있다. 또는, 액정층(LC)은 수직 배향된 액정 분자들을 포함할 수도 있다.
도 10은 본 발명의 일실시예에 따른 제2 화소(PX2)를 나타낸 평면도이고, 도 11은 도 10의 Ⅱ-Ⅱ'을 따라 절단한 단면도이다. 도 12 및 도 13은 본 발명의 다른 일실시예에 따른 제2 화소(PX2)를 나타낸 평면도이다. 제2 화소(PX2)와 관련된 설명 가운데 제1 화소(PX1)와 관련된 설명과 중복되는 내용은 생략한다.
도 10을 참조하면, 본 발명의 일실시예에 따른 제2 화소(PX2)는 제3 부화소(SPX3) 및 제4 부화소(SPX4)를 포함한다.
제3 부화소(SPX3)는 제1 박막 트랜지스터(TR1), 제1 부화소 전극(PE3) 및 제1 스토리지 전극(STE1)을 포함한다. 제4 부화소(SPX4)는 제2 박막 트랜지스터(TR2), 제4 부화소 전극(PE4), 제2 스토리지 전극(STE2) 및 제3 박막 트랜지스터(TR3)를 포함한다.
본 발명의 일실시예에서, 제3 부화소 전극(PE3)은 제1 테두리 차광 부재(195)의 곡률부(CP)와 중첩하고, 제4 부화소 전극(PE4)은 중첩하지 않는 경우를 전제로 설명한다.
제3 부화소 전극(PE3)은 줄기부 및 줄기부로부터 하나의 방향으로 경사지게 연장된 복수의 가지부들을 포함할 수 있으며, 제4 부화소 전극(PE4)은 십자형 줄기부 및 십자형 줄기부로부터 경사지게 연장된 복수의 가지부들을 포함할 수 있다.
이 경우, 제1 테두리 차광 부재(195)와 중첩하는 제3 부화소 전극(PE3)은 하나의 도메인을 포함한다. 다만, 이에 한정되는 것은 아니며 제4 부화소 전극(PE4)이 제1 테두리 차광 부재(195)와 중첩하는 경우, 제4 부화소 전극(PE4)도 하나의 도메인을 가질 수 있다.
따라서, 제3 부화소 전극(PE3) 상에 배치된 액정 분자는 모두 동일한 방향으로 초기 배향될 수 있다. 이와 같이, 본 발명의 일실시예에 따른 액정 표시 장치는 제1 테두리 차광 부재(195)로 인해 단차가 발생하더라도 제1 테두리 차광 부재(195)와 중첩하는 제2 화소(PX2)가 하나의 도메인만을 갖도록 하여 얼룩이 발생하는 것을 방지할 수 있다.제3 부화소 전극(PE3)의 가지부는 제1 테두리 차광 부재(195)와 실질적으로 수직하거나(도 10 참조), 실질적으로 평행하게(도 12 참조) 연장될 수 있다.
또한, 도 8 및 도 13을 참조하면, 제2 화소(PX2)의 제3 부화소 전극(PE3)은 제1 화소(PX1)의 제1 부화소 전극(PE1)의 면적보다 작을 수 있다.
도 14는 본 발명의 다른 일실시예에 따른 제1 화소(PX1)를 나타낸 평면도이다. 본 발명의 다른 일실시예에 따른 제1 화소(PX1)에 관한 설명 가운데 본 발명의 일실시예에 따른 제1 화소(PX1)에 관한 설명과 중복되는 내용은 생략한다.
도 14를 참조하면, 본 발명의 다른 일실시예에 따른 제1 화소(PX1)는 제1 기판(111), 게이트 라인(GL), 게이트 전극(GE), 반도체층(SM), 데이터 라인(DL), 소스 전극(SE), 드레인 전극(DE), 화소 전극(PE) 및 공통 전극(CE) 등을 포함할 수 있다.
화소 전극(PE) 및 공통 전극(CE)은 동일층 상에 배치되거나 서로 다른 층 상에 배치될 수도 있다. 화소 전극(PE)은 공통 전극(CE)과 함께 수평 전계를 생성한다.
화소 전극(PE) 및 공통 전극(CE)은 평면상에서 직선 형태로 교차되게 형성할 수 있고, 도 14에 도시된 바와 같이 평면상에서 적어도 1회 이상 꺽어지는 형태로 형성하여 멀티 도메인을 형성할 수도 있다. 화소 전극(PE) 및 공통 전극(CE)이 꺽인 형태에 따라 데이터 라인(DL)도 동일한 형태로 절곡된 형태를 가질 수 있다.
화소 전극(PE) 및 공통 전극(CE)이 멀티 도메인을 가짐에 따라 광시야각을 구현할 수 있다.
도 15 및 도 16은 본 발명의 다른 일실시예에 따른 제2 화소(PX2)를 나타낸 평면도이다. 본 발명의 다른 일실시예에 따른 제2 화소(PX2)에 관한 설명 가운데 본 발명의 다른 일실시예에 따른 제1 화소(PX1)에 관한 설명과 중복되는 내용은 생략한다.
도 15를 참조하면, 본 발명의 다른 일실시예에 따른 제2 화소(PX2)의 화소 전극(PE) 및 공통 전극(CE)은 평면상에서 직선 형태로 교차되게 형성할 수 있다.
즉, 제1 테두리 차광 부재(195)와 중첩하는 제2 화소(PX2)는 하나의 도메인을 포함하고, 제2 화소(PX2) 상에 배치된 액정 분자는 모두 동일한 방향으로 초기 배향될 수 있다.
이와 같이, 본 발명의 다른 일실시예에 따른 액정 표시 장치는 제1 테두리 차광 부재(195)로 인해 단차가 발생하더라도 제1 테두리 차광 부재(195)와 중첩하는 제2 화소(PX2)가 하나의 도메인만을 갖도록 하여 얼룩이 발생하는 것을 방지할 수 있다.
또한, 도 16을 참조하면, 제2 화소(PX2)의 화소 전극(PE) 및 공통 전극(CE)은 제1 화소(PX1)의 화소 전극(PE) 및 공통 전극(CE)의 면적보다 작을 수 있다.
도 17은 본 발명의 다른 일실시예에 따른 액정 표시 장치의 평면도이고, 도 18은 도 17의 Ⅲ-Ⅲ'을 따라 절단한 단면도이다. 본 발명의 다른 일실시예에 따른 액정 표시 장치에 관한 설명 가운데 본 발명의 일실시예에 따른 액정 표시 장치에 관한 설명과 중복되는 내용은 생략한다.
도 17 및 도 18을 참조하면, 본 발명의 다른 일실시예에 따른 액정 표시 패널(110)은 제1 기판(111) 상에 배치된 복수의 게이트 라인(GL1~GLm, 또는 GL), 복수의 게이트 라인(GL1~GLm)과 절연되어 교차하는 복수의 데이터 라인(DL1~DLn, 또는 DL), 및 복수의 게이트 라인(GL1~GLm)과 복수의 데이터 라인(DL1 ~ DLn)과 연결되어 화상을 표시하는 복수의 화소(PX)를 포함한다.
게이트 구동부(210)는 복수의 게이트 라인(GL1~GLm)의 일단부에 인접하여 배치되어 게이트 전압을 복수의 게이트 라인(GL1~GLm)에 순차적으로 인가한다.
데이터 구동부(미도시)는 복수의 데이터 라인(DL1~DLn)의 일단부에 인접하여 배치되며, 복수의 구동 회로 기판(320a)을 포함한다.
액정 표시 패널(110)은 제1 기판(111) 상에 배치된 차광 부재(190)를 더 포함한다. 차광 부재(190)는 제1 방향(D1)으로 연장된 제1 차광 부재(191), 제1 방향(D1)과 교차하는 제2 방향(D2)으로 연장된 제2 차광 부재(192), 및 복수의 화소(PX)들의 가장자리를 따라 배치된 제1 테두리 차광 부재(195) 등을 포함한다.
본 발명의 다른 일실시예에서, 제1 테두리 차광 부재(195)는 복수의 화소(PX)들의 가장자리를 따라 계단 형태로 배치될 수 있으나, 이에 한정되는 것은 아니다.
복수의 화소(PX)는 모서리부를 제외한 영역에 배치된 제1 화소(PX1) 및 모서리부에 배치된 제2 화소(PX2)로 구분될 수 있다.
제2 화소(PX2)에 포함된 복수의 화소(PX)는 표시부(DA)와 비표시부(NDA)를 정의하는 제2 테두리 차광 부재(196)을 포함할 수 있다. 제2 테두리 차광 부재(196)는 제2 화소(PX2) 당 하나씩 배치되는 것을 전제로 설명하지만 이에 한정되는 것은 아니며, 제2 테두리 차광 부재(196)는 인접하게 배치된 복수의 제2 화소(PX2) 당 하나씩 배치될 수도 있다. 또한, 제2 테두리 차광 부재(196)는 제2 화소(PX2)로부터 제1 기판(111)의 가장자리까지 연장되어 배치될 수도 있다.
제2 화소(PX2)들에 배치되는 제2 테두리 차광 부재(196)는 서로 다른 면적을 가질 수 있다. 또한, 제2 테두리 차광 부재(196) 각각은 표시부(DA)와 비표시부(NDA)를 구분하기 위한 경사부(SP)를 가질 수 있으며, 각 제2 테두리 차광 부재(196)의 경사부(SP)들을 연결하면 곡률부(CP)를 이룰 수 있다.
제2 테두리 차광 부재(196)은 게이트 라인 및 게이트 전극을 포함하는 게이트 배선과 동일한 층에 배치될 수 있으며, 게이트 배선과 서로 이격되어 배치될 수 있다. 또한, 제2 테두리 차광 부재(196)는 게이트 배선과 동일한 물질을 포함하며, 동일한 공정으로 동시에 형성될 수 있다.
다만, 이에 한정되는 것은 아니며, 제2 테두리 차광 부재(196)는 데이트 라인, 소스 전극 및 드레인 전극을 포함하는 데이터 배선과 동일한 층에 배치될 수 있으며, 데이터 배선과 서로 이격되어 배치될 수 있다. 또한, 제2 테두리 차광 부재(196)는 데이터 배선과 동일한 물질을 포함하며, 동일한 공정으로 동시에 형성될 수 있다.
또한, 제2 테두리 차광 부재(196)는 색필터(CF)와 동일한 층에 배치될 수 있으며, 이 경우, 제2 테두리 차광 부재(196)는 적색 필터 및 청색 필터를 포함할 수 있다.
도 19는 본 발명의 다른 일실시예에 다른 액정 표시 장치의 평면도이고, 도 20은 도 12의 Ⅳ-Ⅳ'을 따라 절단한 단면도이다. 본 발명의 다른 일실시예에 따른 액정 표시 장치에 관한 설명 가운데 본 발명의 일실시예에 따른 액정 표시 장치에 관한 설명과 중복되는 내용은 생략한다.
도 19 및 도 20을 참조하면, 본 발명의 다른 일실시예에 따른 액정 표시 패널(110)은 제1 기판(111) 상에 배치된 복수의 게이트 라인(GL1~GLm, 또는 GL), 복수의 게이트 라인(GL1~GLm)과 절연되어 교차하는 복수의 데이터 라인(DL1~DLn, 또는 DL), 및 복수의 게이트 라인(GL1~GLm)과 복수의 데이터 라인(DL1 ~ DLn)과 연결되어 화상을 표시하는 복수의 화소(PX)를 포함한다.
게이트 구동부(210)는 복수의 게이트 라인(GL1~GLm)의 일단부에 인접하여 배치되어 게이트 전압을 복수의 게이트 라인(GL1~GLm)에 순차적으로 인가한다.
데이터 구동부(미도시)는 복수의 데이터 라인(DL1~DLn)의 일단부에 인접하여 배치되며, 복수의 구동 회로 기판(320a)을 포함한다.
액정 표시 패널(110)은 제1 기판(111) 상에 배치된 차광 부재(190)를 더 포함한다. 차광 부재(190)는 제1 방향(D1)으로 연장된 제1 차광 부재(191), 제1 방향(D1)과 교차하는 제2 방향(D2)으로 연장된 제2 차광 부재(192), 및 제1 테두리 차광 부재(195) 등을 포함한다.
제1 테두리 차광부재(195)는 평면상에서 소정의 곡률을 갖는 적어도 하나 이상의 곡률부(CP)를 포함한다. 제1 테두리 차광부재(195)에 의해 영상이 표시되는 표시부(DA)와 영상이 표시되지 않는 비표시부(NDA)가 정의된다.
복수의 화소(PX)는 제1 테두리 차광 부재(195)의 곡률부(CP)와 중첩하지 않는 제1 화소(PX1), 및 제1 테두리 차광 부재(195)의 곡률부(CP)와 적어도 일부가 중첩하는 제2 화소(PX2)을 포함한다.
보호층(175)은 제1 테두리 차광 부재(195)와 중첩하는 제1 보호층(175a), 및 제1 테두리 차광 부재(195)와 중첩하지 않는 제2 보호층(175b)을 포함한다. 제1 보호층(175a)은 제2 보호층(175b)보다 낮은 높이를 가질 수 있다.
그 결과, 제1 테두리 차광 부재(195)로 인한 단차를 줄여 얼룩이 발생하는 것을 방지할 수 있다.
도 21은 본 발명의 다른 일실시예에 따른 단면도이다.
도 21을 참조하면, 본 발명의 다른 일실시예에서, 보호층(175)은 제1 테두리 차광 부재(195)와 중첩하는 제1 보호층(175a), 및 제1 테두리 차광 부재(195)와 중첩하지 않는 제2 보호층(175b)을 포함한다. 제1 보호층(175a)은 제2 보호층(175b)보다 낮은 높이를 가질 수 있다.
또한, 제1 보호층(175a) 하부의 색필터(CF)가 생략될 수 있다.
이와 같이, 본 발명의 다른 일실시예에 따른 표시 장치는 제1 테두리 차광 부재(195)로 인한 단차 형성을 방지함으로써, 제1 테두리 차광 부재(195)의 단차로 인해 발생하는 얼룩을 방지할 수 있다.
도 22는 본 발명의 다른 일실시예에 따른 액정 표시 장치의 부분 확대도이다. 본 발명의 다른 일실시예에 따른 액정 표시 장치에 관한 설명 가운데 본 발명의 일실시예에 따른 액정 표시 장치에 관한 설명과 중복되는 내용은 생략한다.
도 22를 참조하면, 본 발명의 다른 일실시예에 따른 액정 표시 장치는 제1 방향(D1)으로의 길이가 제2 방향(D2)으로의 길이보다 큰 복수의 화소(PX)를 포함할 수 있다.
액정 표시 패널(110)은 제1 기판(111) 상에 배치된 차광 부재(190)를 포함한다. 차광 부재(190)는 제1 방향(D1)으로 연장된 제1 차광 부재(191), 제1 방향(D1)과 교차하는 제2 방향(D2)으로 연장된 제2 차광 부재(192), 및 제1 테두리 차광 부재(195) 등을 포함한다.
제1 테두리 차광부재(195)는 평면상에서 소정의 곡률을 갖는 적어도 하나 이상의 곡률부(CP)를 포함한다. 제1 테두리 차광부재(195)에 의해 영상이 표시되는 표시부(DA)와 영상이 표시되지 않는 비표시부(NDA)가 정의된다.
복수의 화소(PX)는 제1 테두리 차광 부재(195)의 곡률부(CP)와 중첩하지 않는 제1 화소(PX1), 및 제1 테두리 차광 부재(195)의 곡률부(CP)와 적어도 일부가 중첩하는 제2 화소(PX2)를 포함한다.
제2 화소(PX2)가 평면상에서 계단 형태로 배열됨에 따라 제2 화소(PX2)와 연결된 게이트 구동부(210) 및 데이터 라인(DL1 ~ DLn)들도 계단 형태로 배치될 수 있다.
구체적으로, 게이트 구동부(210)는 각 게이트 라인(GL1~GLm)과 연결되는 복수의 스테이지(ST1~ST12)를 포함하는데, 제2 화소(PX2)와 연결된 스테이지는 제2 화소(PX2) 쪽으로 돌출되어 배치될 수 있다. 이와 같이, 복수의 스테이지가계단 형태로 배치됨으로써 비표시부(NDA)의 면적을 최소화할 수 있다.
또한, 제2 화소(PX2)와 연결되는 데이터 라인(DL1 ~ DLn)은 계단 형태로 절곡되어 연장될 수 있다. 다만, 이에 한정되는 것은 아니며 사선 또는 곡선 형태로 절곡되어 연장될 수도 있다.
제1 화소(PX1)의 화소 전극은 제2 화소(PX2)의 화소 전극과 서로 다른 형태를 갖는다. 구체적으로, 제2 화소(PX2)는 하나의 도메인을 가질 수 있다. 그 결과, 제1 테두리 차광 부재(195)의 단차로 인해 얼룩이 발생하는 것을 방지할 수 있다.
본 발명의 일실시예에 따른 액정 표시 장치는 제1 테두리 차광 부재로 인해 단차가 발생하더라도 제1 테두리 차광 부재와 중첩하는 화소가 하나의 도메인만을 갖도록 하여 얼룩이 발생하는 것을 방지할 수 있다.
본 발명의 다른 일실시예에 따른 액정 표시 장치는 제1 테두리 차광 부재와 모서리부에 배치된 화소가 중첩되는 것을 방지하여 얼룩이 발생하는 것을 방지하고, 제2 테두리 차광 부재를 이용하여 곡률을 갖는 표시부를 구현할 수 있다.
본 발명의 다른 일실시예에 따른 액정 표시 장치는 제1 테두리 차광 부재로 인해 발생하는 단차를 보호층 및 색필터 등을 이용하여 보완함으로써, 얼룩이 발생하는 것을 방지할 수 있다.
이상에서 설명한 본 발명은 상술한 실시예 및 첨부된 도면에 한정되는 것이 아니고, 본 발명의 기술적 사상을 벗어나지 않는 범위 내에서 여러 가지 치환, 변형 및 변경이 가능하다는 것이 본 발명이 속하는 기술 분야에서 통상의 지식을 가진 자에게 있어 명백할 것이다.
DA: 표시부 NDA: 비표시부
PX: 화소 PX1: 제1 화소
PX2: 제2 화소 GL: 게이트 라인
DL: 데이터 라인 SM: 반도체층
TR: 박막 트랜지스터 111: 제1 기판
112: 제2 기판 210: 게이트 구동부
190: 차광 부재 191: 제1 차광 부재
192: 제2 차광 부재 193: 컬럼 스페이서
195: 제1 테두리 차광 부재 196: 제2 테두리 차광 부재

Claims (24)

  1. 제1 기판;
    상기 제1 기판에 대향되게 배치된 제2 기판;
    상기 제1 기판 및 상기 제2 기판 사이에 배치된 액정층;
    상기 제1 기판 상에 배치된 복수의 화소; 및
    상기 제1 기판 및 상기 제2 기판 중 적어도 하나 상에 배치되어 표시부와 비표시부를 정의하며, 곡률부를 갖는 제1 테두리 차광 부재;를 포함하며,
    상기 복수의 화소는,
    상기 곡률부와 중첩되지 않는 제1 화소; 및
    상기 곡률부와 적어도 일부가 중첩되는 제2 화소;를 포함하며,
    상기 제1 화소의 화소 전극은 상기 제2 화소의 화소 전극과 서로 다른 형태를 갖는 표시 장치.
  2. 제1 항에 있어서, 상기 제2 화소는 계단 형태로 배치된 표시 장치.
  3. 제1 항에 있어서, 상기 제1 화소는 상기 제2 화소보다 많은 액정 도메인을 갖는 표시 장치.
  4. 제1 항에 있어서, 상기 제1 테두리 차광 부재와 상기 제2 화소의 화소 전극의 중첩 면적은 상기 제1 화소의 화소 전극의 면적보다 작은 표시 장치.
  5. 제3 항에 있어서, 상기 제1 화소의 화소 전극은 십자형 줄기부 및 상기 십자형 줄기부로부터 서로 다른 방향으로 경사지게 연장된 복수의 가지부들을 각각 포함하는 제1 부화소 전극 및 제2 부화소 전극을 포함하는 표시 장치.
  6. 제5 항에 있어서, 상기 제2 화소의 화소 전극은,
    줄기부 및 상기 줄기부로부터 하나의 방향으로 경사지게 연장된 복수의 가지부들을 포함하는 제3 부화소 전극; 및
    십자형 줄기부 및 상기 십자형 줄기부로부터 서로 다른 방향으로 서로 다른 방향으로 경사지게 연장된 복수의 가지부들을 포함하는 제4 부화소 전극;을 포함하는 표시 장치.
  7. 제6 항에 있어서, 상기 제3 부화소 전극의 가지부는 상기 곡률부와 실질적으로 수직한 표시 장치.
  8. 제6 항에 있어서, 상기 제3 부화소 전극의 가지부는 상기 곡률부와 실질적으로 평행한 표시 장치.
  9. 제1 기판;
    상기 제1 기판에 대향되게 배치된 제2 기판;
    상기 제1 기판 및 상기 제2 기판 사이에 배치된 액정층;
    상기 제1 기판 상에 배치된 복수의 화소; 및
    상기 제1 기판 및 상기 제2 기판 중 적어도 하나 상에 상기 복수의 화소의 가장자리를 따라 배치된 제1 테두리 차광 부재;를 포함하며,
    상기 복수의 화소는,
    모서리부를 제외한 영역에 배치된 제1 화소; 및
    모서리부에 배치된 제2 화소;를 포함하는 표시 장치.
  10. 제9 항에 있어서, 상기 제2 화소는 계단 형태로 배치된 표시 장치.
  11. 제9 항에 있어서, 상기 제2 화소는 표시부와 비표시부를 정의하는 제2 테두리 차광 부재를 포함하는 표시 장치.
  12. 제11 항에 있어서, 상기 제1 테두리 차광 부재와 상기 제2 테두리 차광 부재는 중첩되지 않는 표시 장치.
  13. 제11 항에 있어서, 상기 제2 테두리 차광 부재는 평면상에서 경사부를 갖는 표시 장치.
  14. 제9 항에 있어서, 상기 복수의 화소는,
    상기 제1 기판 상에 배치되며, 제1 방향으로 연장된 게이트 라인;
    상기 제1 기판 상에 상기 게이트 라인과 절연되어 배치되며, 상기 제1 방향과 교차하는 제2 방향으로 연장된 데이터 라인; 및
    상기 제1 기판 및 상기 제2 기판 중 적어도 하나 상에 상기 게이트 라인 및 상기 데이터 라인과 절연되어 배치된 색 필터;를 포함하는 표시 장치.
  15. 제14 항에 있어서, 상기 제2 테두리 차광 부재는 상기 게이트 라인과 동일층 상에 배치된 표시 장치.
  16. 제15 항에 있어서, 상기 제2 테두리 차광 부재는 상기 게이트 라인과 동일한 물질을 포함하는 표시 장치.
  17. 제14 항에 있어서, 상기 제2 테두리 차광 부재는 상기 데이터 라인과 동일층 상에 배치된 표시 장치.
  18. 제17 항에 있어서, 상기 제2 테두리 차광 부재는 상기 데이터 라인과 동일한 물질을 포함하는 표시 장치.
  19. 제14 항에 있어서, 상기 제2 테두리 차광 부재는 상기 색 필터와 동일층 상에 배치된 표시 장치.
  20. 제19 항에 있어서, 상기 제2 테두리 차광 부재는 적어도 하나 이상의 색 필터를 포함하는 표시 장치.
  21. 제1 기판;
    상기 제1 기판에 대향되게 배치된 제2 기판;
    상기 제1 기판 및 상기 제2 기판 사이에 배치된 액정층;
    상기 제1 기판 상에 배치된 복수의 화소; 및
    상기 제1 기판 및 상기 제2 기판 중 적어도 하나 상에 배치되어 표시부와 비표시부를 정의하며, 곡률부를 갖는 제1 테두리 차광 부재;를 포함하며,
    상기 복수의 화소는,
    상기 제1 기판 상에 배치되며, 제1 방향으로 연장된 게이트 라인;
    상기 제1 기판 상에 상기 게이트 라인과 절연되어 배치되며, 상기 제1 방향과 교차하는 제2 방향으로 연장된 데이터 라인;
    상기 제1 기판 상에 상기 게이트 라인 및 상기 데이터 라인과 절연되어 배치된 색 필터; 및
    상기 색 필터 상에 배치된 보호층;을 포함하며,
    상기 보호층은,
    상기 제1 테두리 차광 부재와 중첩되는 제1 보호층; 및
    상기 제1 테두리 차광 부재와 중첩되지 않는 제2 보호층;을 포함하며,
    상기 제1 보호층은 상기 제2 보호층보다 낮은 높이를 갖는 표시 장치.
  22. 제21 항에 있어서, 상기 제1 보호층 하부에 색 필터가 생략된 표시 장치.
  23. 제21 항에 있어서, 상기 제1 테두리 차광 부재는 상기 색 필터와 동일층 상에 배치된 표시 장치.
  24. 제23 항에 있어서, 상기 제1 테두리 차광 부재는 적어도 하나 이상의 색 필터를 포함하는 표시 장치.
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