KR20110133248A - 표시 장치의 구동 장치 및 방법 - Google Patents

표시 장치의 구동 장치 및 방법 Download PDF

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Abstract

본 발명의 한 실시예에 따른 표시 장치의 구동 장치는 외부로부터 영상 신호와 입력 제어 신호를 입력 받는 신호 제어부, 상기 입력 제어 신호의 오류를 판단하는 신호 오류 판단부, 상기 신호 제어부로부터 출력된 신호를 인가받는 데이터 구동부 및 게이트 구동부를 포함하고, 상기 신호 오류 판단부는 상기 입력 제어 신호의 오류 신호가 발생 후, 임의의 오류 판단 보류 시간 동안에는 입력 신호의 오류를 판단하지 않고, 상기 오류 판단 보류 시간 동안 입력 제어 신호의 오류 신호가 지속될 경우, 상기 오류 판단 보류 시간 종료와 동시에 입력 신호의 오류를 판단한다.

Description

표시 장치의 구동 장치 및 방법{DRIVING APPARATUS AND METHOD OF DISPLAY DEVICE}
본 발명은 표시 장치의 구동 장치 및 방법에 관한 것이다.
액정 표시 장치는 현재 가장 널리 사용되고 있는 평판 표시 장치 중 하나로서, 화소 전극과 공통 전극 등 전기장 생성 전극이 형성되어 있는 두 장의 표시판과 그 사이에 삽입되어 있는 액정층으로 이루어지며, 전기장 생성 전극에 전압을 인가하여 액정층에 전기장을 생성하고 이를 통하여 액정층의 액정 분자들의 배향을 결정하고 입사광의 편광을 제어함으로써 영상을 표시한다.
액정 표시 장치와 같은 평판 표시 장치에 입력되는 제어 신호 및 영상 신호는 신호 제어부에서 적절하게 제어되어 표시 패널에 입력된다. 이때, 신호 제어부에 입력 되는 제어 신호가 비정상적인(abnormal) 신호인 경우, 신호의 결함을 방지하기 위하여, 결함 시 일정한 보정 신호를 입력하는 등의 여러 방법이 제안되었다.
그러나, 정전기 등의 영향으로 입력 신호의 결함이 사용자가 시인할 수 없는 매우 짧은 시간 동안 발생하는 경우에도, 신호의 결함을 방지하기 위하여, 일정한 보정 신호를 입력하게 되면, 사용자가 이러한 보정 신호에 의해, 미세 결함까지 시인할 수 있다.
본 발명이 이루고자 하는 기술적 과제는 비정상적인 신호 결함의 판단 여부를 조절하여, 사용자가 시인할 수 없는 시간 동안 발생하는 신호의 결함을 검출하지 않음으로써, 불필요한 신호 결함 검출에 따른 화질 저하를 방지할 수 있는 구동 장치 및 구동 방법을 제공하는 것이다.
본 발명의 한 실시예에 따른 표시 장치의 구동 장치는 외부로부터 영상 신호와 입력 제어 신호를 입력 받는 신호 제어부, 상기 입력 제어 신호의 오류를 판단하는 신호 오류 판단부, 상기 신호 제어부로부터 출력된 신호를 인가받는 데이터 구동부 및 게이트 구동부를 포함하고, 상기 신호 오류 판단부는 상기 입력 제어 신호의 오류 신호가 발생 후, 임의의 오류 판단 보류 시간 동안에는 입력 신호의 오류를 판단하지 않고, 상기 오류 판단 보류 시간 동안 입력 제어 신호의 오류 신호가 지속될 경우, 상기 오류 판단 보류 시간 종료와 동시에 입력 신호의 오류를 판단한다.
상기 신호 오류 판단부는 상기 신호 제어부 내에 포함될 수 있다.
상기 입력 제어 신호는 수직 동기 신호(Vsync)와 수평 동기 신호(Hsync), 메인 클록 신호(MCLK), 데이터 인에이블 신호(DE), 그리고 클록 락 신호 중 적어도 하나일 수 있다.
상기 오류 판단 보류 시간은 상기 신호 오류 판단부에 배치되어 있는 플립 플랍의 수로 조절될 수 있다.
상기 오류 판단 보류 시간은 상기 신호 오류 판단부에 배치되어 있는 발진기 분주 클록 수에 의해 조절될 수 있다.
상기 발진기 분주 클록 수는 상기 신호 오류 판단부 내의 메모리에 저장될 수 있다.
상기 신호 오류 판단부가 입력 신호의 오류를 판단한 경우, 상기 신호 제어부는 소정의 영상 신호를 출력할 수 있다.
본 발명의 한 실시예에 따른 표시 장치의 구동 방법은 외부로부터 신호 제어부에 영상 신호와 입력 제어 신호를 입력하는 단계, 상기 입력 제어 신호의 오류를 판단하는 단계, 상기 입력 제어 신호가 오류인 경우, 소정의 영상 신호를 출력하는 단계를 포함하고, 상기 신호 오류 판단부는 상기 입력 제어 신호의 오류 신호가 발생하면, 임의의 오류 판단 보류 시간을 카운팅한 후, 상기 오류 판단 보류 시간 동안 입력 제어 신호의 오류 신호가 지속될 경우, 상기 오류 판단 보류 시간 종료와 동시에 입력 신호의 오류를 판단한다.
본 발명의 실시예에 따르면, 비정상적인 신호 결함의 판단 여부를 조절하여, 사용자가 시인할 수 없는 시간 동안 발생하는 신호의 결함을 검출하지 않음으로써, 불필요한 신호 결함 검출에 따른 화질 저하를 방지할 수 있다.
도 1은 본 발명의 한 실시예에 따른 표시 장치의 블록도이다.
도 2는 본 발명의 한 실시예에 따른 표시 장치에서 한 화소의 등가 회로도이다.
도 3은 본 발명의 실시예에 따른 오류 판단부(650)의 동작을 나타내는 블록도이다.
도 4a 및 도 4b는 본 발명의 실시예에 따른 표시 장치의 구동부의 신호 오류 판단 동작을 나타내는 파형도이다.
도 5a 및 도 5b는 입력 신호의 오류 판단 보류 시간의 설정을 설명하기 위한 도면이다.
도 6a 내지 도 6c는 본 발명의 다른 한 실시예에 따른 제어 신호 오류 판단 동작을 설명하기 위한 파형도이다.
도 7은 본 발명의 다른 한 실시예에 따른 제어 신호 오류 판단 동작을 설명하기 위한 파형도이다.
그러면 첨부한 도면을 참고로 하여 본 발명의 실시예에 대하여 본 발명이 속하는 기술 분야에서 통상의 지식을 가진 자가 용이하게 실시할 수 있도록 상세히 설명한다. 그러나 본 발명은 여러 가지 상이한 형태로 구현될 수 있으며 여기에서 설명하는 실시예에 한정되지 않는다.
도면에서 여러 층 및 영역을 명확하게 표현하기 위하여 두께를 확대하여 나타내었다. 명세서 전체를 통하여 유사한 부분에 대해서는 동일한 도면 부호를 붙였다. 층, 막, 영역, 판 등의 부분이 다른 부분 "위에" 있다고 할 때, 이는 다른 부분 "바로 위에" 있는 경우뿐 아니라 그 중간에 또 다른 부분이 있는 경우도 포함한다. 반대로 어떤 부분이 다른 부분 "바로 위에" 있다고 할 때에는 중간에 다른 부분이 없는 것을 뜻한다.
이제 본 발명의 한 실시예에 따른 액정 표시 장치에 대하여 도면을 참고하여 상세하게 설명한다.
먼저, 도 1 및 도 2를 참고하여 본 발명의 한 실시예에 따른 표시 장치에 대하여 상세하게 설명한다.
도 1은 본 발명의 한 실시예에 따른 표시 장치의 블록도이고, 도 2는 본 발명의 한 실시예에 따른 표시 장치에서 한 화소의 등가 회로도이다.
도 1을 참고하면, 본 발명의 한 실시예에 따른 표시 장치는 표시판 조립체(display panel assembly)(300), 게이트 구동부(gate driver)(400), 데이터 구동부(data driver)(500), 계조 전압 생성부(gray voltage generator)(800), 그리고 신호 제어부(signal controller)(600)를 포함한다. 신호 제어부(600)는 신호 오류 판단부(650)를 포함한다.
도 1을 참고하면, 표시판 조립체(300)는 등가 회로로 볼 때 복수의 신호선(signal line)(G1-Gn, D1-Dm)과 이에 연결되어 있으며 대략 행렬의 형태로 배열된 복수의 화소(pixel)(PX)를 포함한다. 반면, 도 2에 도시한 구조로 볼 때 표시판 조립체(300)는 서로 마주하는 하부 및 상부 표시판(100, 200)과 그 사이에 들어 있는 액정층(3)을 포함한다. 도시한 실시예에서, 액정 표시 장치를 예를 들어 설명하였지만, 본 발명의 모든 실시예는 액정 표시 장치 외에, 플라즈마 디스플레이(PDP), 유기 발광 다이오드(OLED) 표시 장치 등의 모든 평판 표시 장치에 적용가능하다.
신호선(G1-Gn, D1-Dm)은 게이트 신호("주사 신호"라고도 함)를 전달하는 복수의 게이트선(G1-Gn)과 데이터 전압을 전달하는 복수의 데이터선(D1-Dm)을 포함한다. 게이트선(G1-Gn)은 대략 행 방향으로 뻗으며 서로가 거의 평행하고, 데이터선(D1-Dm)은 대략 열 방향으로 뻗으며 서로가 거의 평행하다.
각 화소(PX), 예를 들면 i번째(i=1, 2, …, n) 게이트선(Gi)과 j번째(j=1, 2, …, m) 데이터선(Dj)에 연결된 화소(PX)는 신호선(Gi, Dj)에 연결된 스위칭 소자와 이에 연결된 액정 축전기(liquid crystal capacitor)(Clc) 및 유지 축전기(storage capacitor)(Cst)를 포함한다. 유지 축전기는 필요에 따라 생략할 수 있다.
스위칭 소자는 하부 표시판(100)에 구비되어 있는 박막 트랜지스터 등의 삼단자 소자로서, 그 제어 단자는 게이트선(Gi)과 연결되어 있고, 입력 단자는 데이터선(Dj)과 연결되어 있으며, 출력 단자는 액정 축전기(Clc) 및 유지 축전기와 연결되어 있다.
액정 축전기(Clc)는 하부 표시판(100)의 화소 전극(190)과 상부 표시판(200)의 공통 전극(270)을 두 단자로 하며 두 전극(191, 270) 사이의 액정층(3)은 유전체로서 기능한다. 화소 전극(190)은 스위칭 소자와 연결되며, 공통 전극(270)은 상부 표시판(200)의 전면에 형성되어 있고 공통 전압(Vcom)을 인가받는다. 도 2에서와는 달리 공통 전극(270)이 하부 표시판(100)에 구비되는 경우도 있으며 이때에는 두 전극(191, 270) 중 적어도 하나가 선형 또는 막대형으로 만들어질 수 있다.
액정 축전기(Clc)의 보조적인 역할을 하는 유지 축전기는 하부 표시판(100)에 구비된 별개의 신호선(도시하지 않음)과 화소 전극(190)이 절연체를 사이에 두고 중첩되어 이루어지며 이 별개의 신호선에는 공통 전압(Vcom) 따위의 정해진 전압이 인가된다. 그러나 유지 축전기는 화소 전극(190)이 절연체를 매개로 바로 위의 전단 게이트선(Gi-1)과 중첩되어 이루어질 수 있다.
한편, 색 표시를 구현하기 위해서는 각 화소(PX)가 기본색(primary color) 중 하나를 고유하게 표시하거나(공간 분할) 각 화소(PX)가 시간에 따라 번갈아 기본색을 표시하게(시간 분할) 하여 이들 기본색의 공간적, 시간적 합으로 원하는 색상이 인식되도록 한다. 기본색의 예로는 적색, 녹색, 청색 등 삼원색을 들 수 있다.
액정 표시판 조립체(300)에는 적어도 하나의 편광자(도시하지 않음)가 구비되어 있다.
그러면, 본 발명의 실시예에 따른 표시 장치의 구동 장치에 대하여 더욱 상세하게 설명한다.
다시 도 1을 참고하면, 계조 전압 생성부(800)는 화소(PX)의 투과율과 관련된 전체 계조 전압 또는 한정된 수효의 계조 전압을 생성한다. 계조 전압은 공통 전압(Vcom)에 대하여 양의 값을 가지는 것과 음의 값을 가지는 것을 포함할 수 있다.
게이트 구동부(400)는 액정 표시판 조립체(300)의 게이트선(G1-Gn)과 연결되어 게이트 온 전압(Von)과 게이트 오프 전압(Voff)의 조합으로 이루어진 게이트 신호를 게이트선(G1-Gn)에 인가한다.
데이터 구동부(500)는 액정 표시판 조립체(300)의 데이터선(D1-Dm)과 연결되어 있으며, 계조 전압 생성부(800)로부터의 계조 전압을 선택하고 이를 데이터 전압으로서 데이터선(D1-Dm)에 인가한다. 그러나 계조 전압 생성부(800)가 계조 전압을 모두 제공하는 것이 아니라 한정된 수효의 계조 전압만을 제공하는 경우에, 데이터 구동부(500)는 제공된 계조 전압을 분압하여 원하는 데이터 전압을 생성한다.
신호 제어부(600)는 게이트 구동부(400) 및 데이터 구동부(500) 등을 제어한다. 신호 제어부(600)는 신호 오류 판단부(650)를 포함한다.
이러한 구동 장치(400, 500, 600, 800) 각각은 적어도 하나의 집적 회로 칩의 형태로 액정 표시판 조립체(300) 위에 직접 장착되거나, 가요성 인쇄 회로막(flexible printed circuit film)(도시하지 않음) 위에 장착되어 TCP(tape carrier package)의 형태로 액정 표시판 조립체(300)에 부착되거나, 별도의 인쇄 회로 기판(printed circuit board)(도시하지 않음) 위에 장착될 수도 있다. 이와는 달리, 이들 구동 장치(400, 500, 600, 800)가 신호선(G1-Gn, D1-Dm) 및 박막 트랜지스터 스위칭 소자 따위와 함께 액정 표시판 조립체(300)에 집적될 수도 있다. 또한, 구동 장치(400, 500, 600, 800)는 단일 칩으로 집적될 수 있으며, 이 경우 이들 중 적어도 하나 또는 이들을 이루는 적어도 하나의 회로 소자가 단일 칩 바깥에 있을 수 있다.
그러면 이러한 표시 장치의 동작에 대하여 상세하게 설명한다.
신호 제어부(600)는 외부의 그래픽 제어기(도시하지 않음)로부터 입력 영상 신호(R, G, B) 및 이의 표시를 제어하는 입력 제어 신호를 수신한다. 입력 영상 신호(R, G, B)는 각 화소(PX)의 휘도(luminance) 정보를 담고 있으며 휘도는 정해진 수효, 예를 들면 1024(=210), 256(=28) 또는 64(=26) 개의 계조(gray)를 가지고 있다. 입력 제어 신호의 예로는 수직 동기 신호(Vsync)와 수평 동기 신호(Hsync), 메인 클록 신호(MCLK), 데이터 인에이블 신호(DE) 등이 있다.
신호 제어부(600)는 입력 제어 신호를 기초로 입력 영상 신호(R, G, B)를 액정 표시판 조립체(300)의 동작 조건에 맞게 적절히 처리하고 게이트 제어 신호(CONT1) 및 데이터 제어 신호(CONT2) 등을 생성한 후, 게이트 제어 신호(CONT1)를 게이트 구동부(400)로 내보내고 데이터 제어 신호(CONT2)와 처리한 영상 신호(R', G', B')를 데이터 구동부(500)로 내보낸다.
이때, 신호 제어부(600)의 신호 오류 판단부(650)는 입력 제어 신호의 오류를 판단 및 검출하여, 오류 발생 시 소정의 보정 신호를 내보낼 수 있는데, 이에 대해서는 뒤에서 상세하게 설명한다.
게이트 제어 신호(CONT1)는 주사 시작을 지시하는 주사 시작 신호(STV)와 게이트 온 전압(Von)의 출력 주기를 제어하는 적어도 하나의 클록 신호를 포함한다. 게이트 제어 신호(CONT1)는 또한 게이트 온 전압(Von)의 지속 시간을 한정하는 출력 인에이블 신호(OE)를 더 포함할 수 있다.
데이터 제어 신호(CONT2)는 한 행의 화소(PX)에 대한 디지털 영상 신호(DAT)의 전송 시작을 알리는 수평 동기 시작 신호(STH)와 데이터선(D1-Dm)에 아날로그 데이터 전압을 인가하라는 로드 신호(LOAD) 및 데이터 클록 신호(HCLK)를 포함한다. 데이터 제어 신호(CONT2)는 또한 공통 전압(Vcom)에 대한 데이터 전압의 극성(이하 "공통 전압에 대한 데이터 전압의 극성"을 줄여 "데이터 전압의 극성"이라 함)을 반전시키는 반전 신호(RVS)를 더 포함할 수 있다.
신호 제어부(600)로부터의 데이터 제어 신호(CONT2)에 따라, 데이터 구동부(500)는 한 행의 화소(PX)에 대한 영상 신호(R', G', B')를 수신하고, 각 처리한 영상 신호(R', G', B')에 대응하는 계조 전압을 선택함으로써 영상 신호(R', G', B')를 아날로그 데이터 전압으로 변환한 다음, 이를 해당 데이터선(D1-Dm)에 인가한다.
게이트 구동부(400)는 신호 제어부(600)로부터의 게이트 제어 신호(CONT1)에 따라 게이트 온 전압(Von)을 게이트선(G1-Gn)에 인가하여 이 게이트선(G1-Gn)에 연결된 스위칭 소자를 턴온시킨다. 그러면, 데이터선(D1-Dm)에 인가된 데이터 전압이 턴온된 스위칭 소자를 통하여 해당 화소(PX)에 인가된다.
화소(PX)에 인가된 데이터 전압과 공통 전압(Vcom)의 차이는 액정 축전기(Clc)의 충전 전압, 즉 화소 전압으로서 나타난다. 액정 분자들은 화소 전압의 크기에 따라 그 배열을 달리하며 이에 따라 액정층(3)을 통과하는 빛의 편광이 변화한다. 이러한 편광의 변화는 편광자에 의하여 빛의 투과율 변화로 나타나며, 이를 통해 화소(PX)는 영상 신호(DAT)의 계조가 나타내는 휘도를 표시한다.
1 수평 주기["1H"라고도 쓰며, 수평 동기 신호(Hsync) 및 데이터 인에이블 신호(DE)의 한 주기와 동일함]를 단위로 하여 이러한 과정을 되풀이함으로써, 모든 게이트선(G1-Gn)에 대하여 차례로 게이트 온 전압(Von)을 인가하고 모든 화소(PX)에 데이터 전압을 인가하여 한 프레임(frame)의 영상을 표시한다.
한 프레임이 끝나면 다음 프레임이 시작되고 각 화소(PX)에 인가되는 데이터 전압의 극성이 이전 프레임에서의 극성과 반대가 되도록 데이터 구동부(500)에 인가되는 반전 신호(RVS)의 상태가 제어된다("프레임 반전"). 이때, 한 프레임 내에서도 반전 신호(RVS)의 특성에 따라 한 데이터선을 통하여 흐르는 데이터 전압의 극성이 주기적으로 바뀌거나(보기: 행 반전, 점 반전), 한 화소행에 인가되는 데이터 전압의 극성도 서로 다를 수 있다(보기: 열 반전, 점 반전).
그러면, 도 3 내지 도 6c를 참고하여, 본 발명의 실시예에 따른 표시 장치의 신호 제어부(600)의 신호 오류 판단부(650)의 신호 오류 판단 및 보정에 대하여 설명한다.
도 3은 본 발명의 실시예에 따른 오류 판단부(650)의 동작을 나타내는 블록도이다.
도 3을 참고하면, 신호 제어부(600)는 외부 인터페이스로부터 입력 영상 신호(R, G, B) 및 이의 표시를 제어하는 입력 제어 신호를 수신한다. 입력 제어 신호의 예로는 수직 동기 신호(Vsync)와 수평 동기 신호(Hsync), 메인 클록 신호(MCLK), 데이터 인에이블 신호(DE), 클록 락(clock Lock) 신호 등이 있다.
신호 제어부(600)의 신호 오류 판단부(650)는 입력된 입력 제어 신호가 정상적(normal) 신호인 지, 비정상적(abnormal) 신호인 지 여부를 판단하여, 입력 제어 신호가 정상적 신호인 경우(A), 신호 제어부(600)는 입력된 입력 제어 신호를 기초로 입력 영상 신호(R, G, B)를 처리하여, 게이트 제어 신호(CONT1) 및 데이터 제어 신호(CONT2)와 처리된 영상 신호(R', G', B')를 내보낸다.
만일, 입력 제어 신호가 비정상적 신호인 경우(B), 신호 제어부(600)는 보정 게이트 제어 신호(CONT1') 및 보정 데이터 제어 신호(CONT2), 그리고 보정 영상 신호(R'', G'', B'')를 내보낸다.
보정 영상 신호(R'', G'', B'')는 신호 제어부(600) 내에 설정되어 있는 신호로, 표시판(300)의 모든 화소를 화이트 또는 블랙으로 표시하거나, 현재 프레임의 영상 신호와 동일한 값을 가지는 신호일 수도 있으며, 그 외에 임의의 값을 가지는 신호일 수 있다.
그러면, 본 발명의 실시예에 따른 신호 오류 판단부(650)의 동작에 대하여, 도 4a 및 도 4b를 참고로 상세하게 설명한다. 도 4a 및 도 4b는 본 발명의 실시예에 따른 표시 장치의 구동부의 신호 오류 판단 동작을 나타내는 파형도이다. 본 실시예에서는 클록 락(clock lock) 신호를 예를 들어 설명한다.
도 4a에 도시한 바와 같이, 본 발명의 실시예에 따른 표시 장치의 구동 장치의 신호 오류 판단부(650)는 입력된 제어 신호, 예를 들어, 클록 락 신호(c_lock)가 정상 범위(high)이었다가 비정상 범위(low)로 변화하는 경우, 비정상 범위로 변화한 후, 임의의 일정 시간, 입력 신호의 오류 판단 보류 시간 동안 판단을 보류하고, 입력 신호의 오류 판단 보류 시간이 지난 순간에도 입력되는 신호가 계속 비정상 범위에 있을 경우, 입력 신호가 오류임을 판단하게 된다.
입력 신호의 오류 판단 보류 시간은 신호 제어부(600) 내부에 배치되어 있는 발진기를 이용하여, 발진기의 클록수를 조절함으로써, 설정가능하다. 도 4a에 도시한 실시예에서, 입력 신호의 오류 판단 보류 시간은 약 256 클록으로 설정된 경우이다.
도시하지는 않았지만, 본 발명의 다른 실시예에서는 플립 플랍(flip-flop)을 이용하여 입력 신호의 오류 판단 보류 시간을 설정할 수 있다. 이 경우, 플립 플랍의 수에 따라, 오류 판단 보류 시간이 변화하게 되는데, 플립 플랍의 수가 많아질수록 오류 판단 보류 시간은 길어지게 된다.
도 4a에 도시한 바와 같이, 입력된 클록 락 신호(c_lock)가 비정상 범위(low)로 변화한 후, 발진기의 클록 수가 256 진행할 때까지는 오류 판단 신호(cfailo)는 오프(OFF) 상태이다가, 입력된 클록 락 신호(c_lock)가 발진기의 클록 수가 256이후에도 계속 비정상 범위(low)인 경우, 오류 판단 신호(cfailo)는 온(ON) 상태로 변화하여, 입력된 클록 락 신호(c_lock) 신호가 오류 임을 신호 제어부(600)가 판단하게 되는 것이다.
도 4b를 참고하면, 입력된 클록 락 신호(c_lock)가 정상 범위(high)에서 비정상 범위(low)로 변화하고, 발진기의 클록 수가 설정된 값, 256 클록이 되기 전, 예를 들어, 244 클록 지점에서 다시 정상 범위(high)로 복귀하게 되면, 오류 판단 신호(cfailo)는 계속 오프(OFF) 상태를 유지하게 됨으로써, 입력 신호의 오류 판단 보류 시간 내에 발생하였다가 다시 정상 범위로 복귀하는 오류는 감지하지 않게 된다.
따라서, 사용자가 오류임을 판단하지 못하는 소정의 짧은 시간 동안 발생하는 미세한 제어 신호의 오류를 오류로 판단하지 않아, 정상적인 신호를 전달하고 지나갈 수 있다. 이처럼, 본 발명의 실시예에 따른 표시 장치의 구동 장치의 신호 오류 판단부(650)는 사용자가 시인할 수 없는 시간 동안 발생하는 신호의 결함을 검출하지 않음으로써, 불필요한 신호 결함 검출에 따른 화질 저하를 방지할 수 있다.
그러면, 도 5a 및 도 5b를 참고하여, 입력 신호의 오류 판단 보류 시간의 설정에 대하여 설명한다. 도 5a 및 도 5b는 입력 신호의 오류 판단 보류 시간의 설정을 설명하기 위한 도면이다.
본 발명의 실시예에 따른 표시 장치의 구동 장치의 신호 오류 판단부의 오류 판단 보류 시간은 신호 제어부 내의 발진자의 클록을 분주한 클록 수를 이용하여 설정할 수 있다. 그러나, 앞서 설명하였듯이, 본 발명의 다른 실시예에서는 플립 플랍(flip-flop)을 이용하여 입력 신호의 오류 판단 보류 시간을 설정할 수 있다. 이 경우, 플립 플랍의 수에 따라, 오류 판단 보류 시간이 변화하게 되는데, 플립 플랍의 수가 많아질수록 오류 판단 보류 시간은 길어지게 된다.
발진자의 클록을 분주한 클록 수를 설정하는 한 예로 신호 제어부(600) 내의 메모리에 3비트(bit)의 메모리 레지스터를 할당한 경우, 7개의 설정이 가능하다. 도 5a에 도시한 실시예에서는 발진자의 클록을 8분주한 것이다. 도 5a에 도시한 바와 같이, 발진자의 클록을 분주한 클록 수를 3에서 2048까지 설정할 수 있으며, 이에 따라, 입력 신호의 오류 판단 보류 시간은 0.4㎲ 내지 271.97㎲까지 설정가능하다.
이처럼, 신호 제어부 내의 메모리의 레지스터를 할당하여, 발진자의 클록 수를 설정함으로써, 추가적인 장치나 비용 없이, 입력 신호의 오류 판단 보류 시간을 원하는 시간으로 설정 가능하다.
도 5b를 참고하면, 신호 제어부 내의 발진자의 클록을 8 분주한 경우와 16분주한 경우를 비교하여 나타낸 것이다. 도 5b의 위에는 발진자의 클록을 8 분주한 경우를 도시하고, 아래에는 발진자의 클록을 16 분주한 경우를 도시한다. 발진자의 클록을 8분주한 경우에 비하여 16분주한 경우, 한 클록 지속 시간은 길어지게 된다. 따라서, 작은 발진자의 분주 클록 수를 이용하여, 원하는 입력 신호의 오류 판단 보류 시간을 설정할 수 있다. 이처럼, 발진자의 클록 분주 수를 8, 16, 32 등으로 설정함으로써, 입력 신호의 오류 판단 보류 시간을 원하는 시간으로 설정 가능하다.
다음으로, 도 6a 내지 도 6c를 참고하여, 본 발명의 다른 한 실시예에 따른 제어 신호 오류 판단 동작에 대하여 설명한다. 도 6a 내지 도 6c는 본 발명의 다른 한 실시예에 따른 제어 신호 오류 판단 동작을 설명하기 위한 파형도이다.
도 6a를 참고하면, 본 실시예에 따른 표시 장치의 구동 장치는 입력 클록을 변화할 수 있다. 예를 들어, 동영상 등과 같이, 연속적으로 변화하는 영상을 표시하는 경우, 제1 클록으로 영상 신호를 전달하다가, 정지 영상과 같이, 변화가 적은 영상을 표시하는 경우, 제1 클록 보다 낮은 프레임 주파수를 나타내는 제2 클록으로 영상 신호를 전달하는 것이다. 이러한 구동 주파수 변경을 통해, 구동 전력이 절약될 수 있다.
구동 주파수 변경은 수직 블랭크(vertical blank) 기간 동안 이루어지는 것이 바람직하다. 도시한 실시예에서, 제1 프레임의 마지막 라인에 영상 신호를 입력하기 위한 데이터 인에이블 신호(DE)가 오프된 후 제1 시간(T1) 후에, 수직 블랭크 기간(T4)이 시작되고, 수직 블랭크 기간(T4) 시작 후, 제2 시간(T2) 후에 입력 주파수가 변경된 후, 제3 시간(T3)이 지난 후에 수직 블랭크 기간(T4)이 끝나게 된다.
이때, 제2 시간(T2)는 수직 블랭크 기간(T4) 시작 후 주파수 변경을 위한 안정화 구간으로 최대 약 100㎲의 시간일 수 있다.
이처럼, 구동 주파수가 변화하는 경우, 주파수 변경 구간에 안정화 구간이 필요하고, 이 안정화 구간에서는 클록 신호가 입력되지 않기 때문에, 구동 장치의 신호 오류 판단부(650)는 이 안정화 구간을 비정상 입력 제어 신호로 판단할 수 있다. 그러나, 본 발명의 실시예에 따른 표시 장치의 구동 장치는 수직 블랭크 기간(T4) 동안에는 주파수 변경 구간의 안정화 구간의 시간보다 긴 오류 판단 보류 시간을 설정함으로써, 안정화 구간 동안에는 입력 신호의 오류 판단을 보류함으로써, 안정화 구간을 비정상 신호로 판단하지 않을 수 있다.
이에 대하여, 도 6b 및 도 6c를 참고로 설명한다.
도 6b를 참고하면, 구동 주파수 변경 동작 시, 신호 오류 판단부(650)의 동작을 설명한다. 클록 주파수가 제1 주파수(60Hz)에서 제2 주파수(40Hz)로 변경된다고 가정한다. 이때, 제1 주파수와 제2 주파수 사이에는 클록 주파수 변경을 위한 안정화 구간(T2)은 약 100㎲ 이하의 시간이 필요하다. 이때, 입력 신호의 오류 판단을 보류하기 위한 오류 판단 보류 시간은 안정화 구간(T2)보다 긴 것이 바람직하다.
따라서, 클록 주파수가 제1 주파수에서 제2 주파수로 변경되기 전 안정화 구간(T2)에서 클록 신호가 입력되지 않더라도, 안정화 구간(T2)은 오류 판단 보류 시간보다 짧기 때문에, 신호 오류 판단부(650)는 이 시간 동안 클록 신호가 오류라고 판단하지 않게 된다.
다음으로, 도 6c를 보면, 주파수 변경 구간이 아니라, 실제 클록 신호의 비정상 구간이 발생한 경우에는 클록 신호가 입력되지 않은 후에 오류 판단 보류 시간이 지난 후까지 클록 신호가 입력되지 않기 때문에, 이 때에는 오류 판단 보류 시간이 끝나는 동시에 클록 신호 오류 신호(Clock fail)가 온(ON)이 되게 되고, 이에 의해, 클록 신호의 오류를 판단하게 된다.
다음으로, 도 7을 참고하여, 본 발명의 다른 한 실시예에 따른 제어 신호 오류 판단 동작에 대하여 설명한다. 도 7은 본 발명의 다른 한 실시예에 따른 제어 신호 오류 판단 동작을 설명하기 위한 파형도이다.
도 7은 클록 주파수가 제1 주파수에서 제2 주파수로 변경되는 수직 블랭크(vertical blank) 구간 내에서 데이터 인에이블 신호(DE)의 순간적 오류가 발생한 경우를 나타낸다. 도시한 실시예에서, 블랭크 구간임에도 데이터 인에이블 신호(DE)의 순간적 오류로, 데이터 인에이블 신호(DE)가 온(ON) 됨으로써, 수직 동기 신호(Vsync)와 수평 동기 신호(Hsync)가 입력되는 것으로 잘못 인식하게 된다. 이때, 블랭크 구간이기 때문에, 실제 수직 동기 신호(Vsync)와 수평 동기 신호(Hsync)는 입력되지 않기 때문에, 구동 장치의 신호 오류 판단부(650)는 수직 동기 신호(Vsync)와 수평 동기 신호(Hsync)가 오류임을 판단할 수 있다.
그러나, 본 발명의 실시예에 따른 표시 장치의 구동 장치의 신호 오류 판단부(650)는 일정한 오류 판단 보류 시간 동안 신호의 입력이 없더라도 신호가 오류라는 판단을 보류하기 때문에, 이 경우에도 수직 동기 신호(Vsync)와 수평 동기 신호(Hsync)가 오류라는 판단을 하지 않게 된다.
이처럼, 정전기 등과 같은 순간적인 요인으로 짧은 시간 동안 발생하는 제어 신호의 오류를 신호의 오류로 판단하지 않도록, 오류 판단 보류 시간을 임의로 설정할 수 있기 때문에, 추가적인 장치나 비용 없이, 불필요한 신호 결함 검출에 따른 화질 저하를 방지할 수 있다.
위에서는 액정 표시판을 포함하는 표시 장치를 예를 들어 설명하였지만, 본 발명의 실시예는 영상 신호와 제어 신호를 이용하여 영상을 표시하는 모든 표시 장치에 적용 가능하다.
이상에서 본 발명의 바람직한 실시예에 대하여 상세하게 설명하였지만 본 발명의 권리범위는 이에 한정되는 것은 아니고 다음의 청구범위에서 정의하고 있는 본 발명의 기본 개념을 이용한 당업자의 여러 변형 및 개량 형태 또한 본 발명의 권리범위에 속하는 것이다.

Claims (22)

  1. 외부로부터 영상 신호와 입력 제어 신호를 입력 받는 신호 제어부,
    상기 입력 제어 신호의 오류를 판단하는 신호 오류 판단부,
    상기 신호 제어부로부터 출력된 신호를 인가받는 데이터 구동부 및 게이트 구동부를 포함하고,
    상기 신호 오류 판단부는 상기 입력 제어 신호의 오류 신호가 발생 후, 임의의 오류 판단 보류 시간 동안에는 입력 신호의 오류를 판단하지 않고, 상기 오류 판단 보류 시간 동안 입력 제어 신호의 오류 신호가 지속될 경우, 상기 오류 판단 보류 시간 종료와 동시에 입력 신호의 오류를 판단하는 표시 장치의 구동 장치.
  2. 제1항에서,
    상기 신호 오류 판단부는 상기 신호 제어부 내에 포함되어 있는 표시 장치의 구동 장치.
  3. 제2항에서,
    상기 입력 제어 신호는 수직 동기 신호(Vsync)와 수평 동기 신호(Hsync), 메인 클록 신호(MCLK), 데이터 인에이블 신호(DE), 그리고 클록 락 신호 중 적어도 하나인 구동 장치.
  4. 제2항에서,
    상기 오류 판단 보류 시간은 상기 신호 오류 판단부에 배치되어 있는 플립 플랍의 수로 조절되는 표시 장치의 구동 장치.
  5. 제2항에서,
    상기 오류 판단 보류 시간은 상기 신호 오류 판단부에 배치되어 있는 발진기 분주 클록 수에 의해 조절되는 표시 장치의 구동 장치.
  6. 제5항에서,
    상기 발진기 분주 클록 수는 상기 신호 오류 판단부 내의 메모리에 저장되어 있는 표시 장치의 구동 장치.
  7. 제2항에서,
    상기 신호 오류 판단부가 입력 신호의 오류를 판단한 경우, 상기 신호 제어부는 소정의 영상 신호를 출력하는 표시 장치의 구동 장치.
  8. 제1항에서,
    상기 입력 제어 신호는 수직 동기 신호(Vsync)와 수평 동기 신호(Hsync), 메인 클록 신호(MCLK), 데이터 인에이블 신호(DE), 그리고 클록 락 신호 중 적어도 하나인 구동 장치.
  9. 제1항에서,
    상기 오류 판단 보류 시간은 상기 신호 오류 판단부에 배치되어 있는 플립 플랍의 수로 조절되는 표시 장치의 구동 장치.
  10. 제1항에서,
    상기 오류 판단 보류 시간은 상기 신호 오류 판단부에 배치되어 있는 발진기 분주 클록 수에 의해 조절되는 표시 장치의 구동 장치.
  11. 제10항에서,
    상기 발진기 분주 클록 수는 상기 신호 오류 판단부 내의 메모리에 저장되어 있는 표시 장치의 구동 장치.
  12. 제1항에서,
    상기 신호 오류 판단부가 입력 신호의 오류를 판단한 경우, 상기 신호 제어부는 소정의 영상 신호를 출력하는 표시 장치의 구동 장치.
  13. 외부로부터 신호 제어부에 영상 신호와 입력 제어 신호를 입력하는 단계,
    상기 입력 제어 신호의 오류를 판단하는 단계,
    상기 입력 제어 신호가 오류인 경우, 소정의 영상 신호를 출력하는 단계를 포함하고,
    상기 신호 오류 판단부는 상기 입력 제어 신호의 오류 신호가 발생하면, 임의의 오류 판단 보류 시간을 카운팅한 후, 상기 오류 판단 보류 시간 동안 입력 제어 신호의 오류 신호가 지속될 경우, 상기 오류 판단 보류 시간 종료와 동시에 입력 신호의 오류를 판단하는 표시 장치의 구동 방법.
  14. 제13항에서,
    상기 신호 오류 판단부는 상기 신호 제어부 내에 포함되어 있는 표시 장치의 구동 방법.
  15. 제14항에서,
    상기 입력 제어 신호는 수직 동기 신호(Vsync)와 수평 동기 신호(Hsync), 메인 클록 신호(MCLK), 데이터 인에이블 신호(DE), 그리고 클록 락 신호 중 적어도 하나인 구동 방법.
  16. 제14항에서,
    상기 오류 판단 보류 시간은 상기 신호 오류 판단부에 배치되어 있는 플립 플랍의 수로 조절되는 표시 장치의 구동 방법.
  17. 제16항에서,
    상기 오류 판단 보류 시간은 상기 신호 오류 판단부에 배치되어 있는 발진기 분주 클록 수에 의해 조절되는 표시 장치의 구동 방법.
  18. 제17항에서,
    상기 발진기 분주 클록 수는 상기 신호 오류 판단부 내의 메모리에 저장되어 있는 표시 장치의 구동 방법.
  19. 제13항에서,
    입력 제어 신호는 수직 동기 신호(Vsync)와 수평 동기 신호(Hsync), 메인 클록 신호(MCLK), 데이터 인에이블 신호(DE), 그리고 클록 락 신호 중 적어도 하나인 구동 방법.
  20. 제13항에서,
    상기 오류 판단 보류 시간은 상기 신호 오류 판단부에 배치되어 있는 플립 플랍의 수로 조절되는 표시 장치의 구동 방법.
  21. 제13항에서,
    상기 오류 판단 보류 시간은 상기 신호 오류 판단부에 배치되어 있는 발진기 분주 클록 수에 의해 조절되는 표시 장치의 구동 방법.
  22. 제21항에서,
    상기 발진기 분주 클록 수는 상기 신호 오류 판단부 내의 메모리에 저장되어 있는 표시 장치의 구동 방법.
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