KR20110048119A - Chip comprising conductive bump and its fabrication method and electronic application having the same and its fabrication method - Google Patents
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Abstract
Description
이 발명은 전도성 범프를 갖는 칩 및 그 제조방법에 관한 것으로서, 더욱 상세하게는 전도성 범프의 구조를 단순화함에 따라 웨이퍼 레벨(상태)에서 전도성 범프를 보다 효율적으로 제조할 수 있어 생산성을 향상시킬 수 있는 전도성 범프를 갖는 칩 및 그 제조방법에 관한 것이다. 또한, 이 발명은 상기의 전도성 범프를 갖는 칩을 기판에 접합하여 구성한 전자부품 및 그 제조방법에 관한 것이기도 하다.The present invention relates to a chip having a conductive bump and a method of manufacturing the same, and more particularly, by simplifying the structure of the conductive bump, it is possible to more efficiently manufacture the conductive bump at the wafer level (state), thereby improving productivity. A chip having a conductive bump and a method of manufacturing the same. The present invention also relates to an electronic component formed by bonding a chip having the above conductive bumps to a substrate and a manufacturing method thereof.
전자부품을 접합함에 있어서는 이방성 전도 필름(Anisotropic Conductive Film, 이하 ACF)이 사용되고 있다. ACF는 직경이 3~5㎛인 미세한 전도성 입자가 접착제 필름의 내부에 균일하게 분포된 형태를 갖는다. 전도성 입자는 구형 폴리머의 표면에 금속층이 코팅된 구조로서, 다수의 전도성 입자는 전자부품과 기판의 전극 역할을 하는 돌출된 금속패드(pad) 사이에 밀착되어 전기적 연결부를 형성한다. ACF는 접착제를 이용하여 접합하기 때문에, 디스플레이, 통신 장비, 반도체 칩 등과 같은 다양한 전자부품의 저온 접합에 사용되고 있다.In joining electronic components, an anisotropic conductive film (ACF) is used. The ACF has a form in which fine conductive particles having a diameter of 3 to 5 μm are uniformly distributed in the adhesive film. The conductive particles have a structure in which a metal layer is coated on the surface of the spherical polymer, and the plurality of conductive particles are closely contacted between the protruding metal pads serving as electrodes of the electronic component and the substrate to form electrical connections. Since ACF is bonded using an adhesive, it is used for low temperature bonding of various electronic components such as displays, communication equipment, semiconductor chips, and the like.
그러나 전자부품의 패드 사이의 간격이 감소하면서 ACF의 전도성 입자에 의해 패드 사이에 전기적 단락이 발생하거나, 패드에 압착된 전도성 입자의 개수가 일정하지 않음에 따라 전기 전도도가 불균일한 문제점이 발생하고 있다. 이러한 ACF의 문제점은 접합과정에서 접착제 내부에 분포된 전도성 입자들이 이동하기 때문에 발생한다.However, as the spacing between the pads of electronic components decreases, electrical shorts occur between the pads due to ACF conductive particles, or the number of conductive particles pressed onto the pads is not constant, resulting in uneven electrical conductivity. . This problem of ACF occurs because the conductive particles distributed inside the adhesive move during the bonding process.
ACF의 문제점을 보완하기 위하여 전도성 입자와 유사한 구조의 전도성 폴리머 범프를 칩의 패드에 고정시키는 방법들이 제안되었으며, 이와 같은 방법에 의해 폴리머 범프가 칩의 패드에 고정되면 접합과정에서 폴리머 범프가 이동하지 않고 전기 전도도가 일정하다는 장점이 있다.In order to solve the problem of ACF, a method of fixing a conductive polymer bump having a structure similar to a conductive particle to a pad of a chip has been proposed. When the polymer bump is fixed to the pad of the chip by this method, the polymer bump does not move during the bonding process. The advantage is that the electrical conductivity is constant.
미국특허 제5,578,527호의 "Connection construction and method of manufacturing the same", 미국특허 제5,707,902호의 "Composite bump structure and methods of fabrication", 미국특허 제5,508,228호의 "Compliant electrically connective bumps for an adhesive flip chip integrated circuit device and method for forming same", 미국특허 제5,783,465호의 "Compliant bump technology"에는, 칩의 패드에 하나의 폴리머 범프를 형성하고 폴리머 범프의 표면에 금속층을 코팅한 범프 구조가 개시되어 있다. 그리고, 미국특허 제6,972,490호의 "Bonding structure with compliant bumps"에는 폴리머 범프의 균열을 방지하기 위하여 스토퍼(stopper)를 설치하는 구조가 개시되어 있다. 또한, 기술보고서(Technology News Line, No.24, 2007년 11월)에는 Seiko-Epson사에서 개발한 칩의 패드 주위에 스트립 형상의 전도성 폴리머 범프인 레진 코어드 범프(resin cored bump)를 제조하는 방법에 대해 공개되어 있다."Connection construction and method of manufacturing the same" in U.S. Patent 5,578,527, "Composite bump structure and methods of fabrication" in U.S. Patent 5,707,902, "Compliant electrically connective bumps for an adhesive flip chip integrated circuit device and U.S. Patent 5,508,228" "Compliant bump technology" of U.S. Patent No. 5,783,465 discloses a bump structure in which one polymer bump is formed on a pad of a chip and a metal layer is coated on the surface of the polymer bump. In addition, "Bonding structure with compliant bumps" of US Pat. No. 6,972,490 discloses a structure for installing a stopper to prevent cracking of polymer bumps. In addition, a technology report (Technology News Line, No. 24, November 2007) describes the production of resin cored bumps, which are strip-shaped conductive polymer bumps around pads of chips developed by Seiko-Epson. The method is open to the public.
그러나 상기의 특허문헌 및 기술문헌의 방법들은, 칩의 패드 표면에 ACF와 동일한 구조의 전도성 폴리머 범프를 형성하기 위해, 폴리머 범프를 형성하고 폴리머 범프의 표면에 금속층을 코팅한 후 전도성 폴리머 범프를 가공하기 때문에 리소그래피와 에칭공정을 여러 번 사용해야 하며, 이로 인하여 제조공정이 복잡하고 생산비용이 증가하는 단점이 있다. 또한, 칩의 패드 또는 패드의 주위에 전도성 폴리머 범프를 형성하기 때문에 정밀도가 높은 가공이 요구되는 단점이 있다.However, the methods of the above patent documents and technical documents, in order to form a conductive polymer bump of the same structure as the ACF on the pad surface of the chip, forming a polymer bump and coating a metal layer on the surface of the polymer bump and then processing the conductive polymer bump Therefore, the lithography and etching process must be used several times, which results in a complicated manufacturing process and an increase in production cost. In addition, since a conductive polymer bump is formed around the pad or the pad of the chip, high precision processing is required.
따라서, 이 발명은 앞서 설명한 바와 같은 종래기술의 문제점을 해결하기 위하여 안출된 것으로서, 전도성 범프의 구조를 단순화함에 따라 웨이퍼 레벨(상태)에서 전도성 범프를 보다 효율적으로 제조할 수 있어 생산성을 향상시킬 수 있는 전도성 범프를 갖는 칩 및 그 제조방법을 제공하는 데 그 목적이 있다. Accordingly, the present invention has been made to solve the problems of the prior art as described above, and by simplifying the structure of the conductive bumps, it is possible to more efficiently manufacture the conductive bumps at the wafer level (state), thereby improving productivity. It is an object of the present invention to provide a chip having a conductive bump and a method of manufacturing the same.
또한, 이 발명은 상기의 전도성 범프를 갖는 칩을 기판에 접합하여 구성하므로, 전기적 단락을 방지할 수 있을 뿐만 아니라 균일하고 높은 전기 전도도를 얻을 수 있는 전자부품 및 그 제조방법을 제공하는 데 다른 목적이 있다.In addition, since the present invention is configured by bonding the chip having the conductive bumps to a substrate, it is possible to provide an electronic component and a method for manufacturing the same, which can prevent electrical short-circuit as well as obtain uniform and high electrical conductivity. There is this.
이 발명의 전도성 범프를 갖는 칩의 제조방법은, 표면에 다수의 전극이 형성된 웨이퍼의 상면에 감광층을 코팅한 후 감광층에 다수의 구멍을 가공하되 전극이 형성된 부위에 구멍을 가공하는 제1 단계와, 감광층과 다수의 구멍의 표면에 금속층을 코팅하는 제2 단계와, 감광층이 상부로 노출되는 위치까지 금속층의 일부분을 기계적인 가공방법으로 제거해 웨이퍼의 상면에 서로 간에 전기적으로 절연되는 금속 범프와 외부 폴리머로 구성되는 다수의 전도성 범프를 형성하는 제3 단계와, 외부 폴리머의 상부 일부분을 제거해 금속 범프의 상단을 외부 폴리머의 상면으로 돌출시키는 제4 단계, 및 절단선을 따라 웨이퍼를 절단함으로써 전도성 범프를 갖는 칩을 제조하는 제5 단계를 포함하는 것을 특징으로 한다. In the method of manufacturing a chip having a conductive bump according to the present invention, a photosensitive layer is coated on an upper surface of a wafer having a plurality of electrodes formed thereon, and then a plurality of holes are processed in the photosensitive layer, but a hole is formed in a portion where the electrode is formed. And a second step of coating the metal layer on the surface of the photosensitive layer and the plurality of holes, and by removing a part of the metal layer by a mechanical processing method to the position where the photosensitive layer is exposed to the upper side, the upper surface of the wafer is electrically insulated from each other. A third step of forming a plurality of conductive bumps consisting of the metal bumps and the outer polymer, a fourth step of removing the upper portion of the outer polymer to protrude the top of the metal bumps to the top surface of the outer polymer, and a wafer along the cutting line And a fifth step of manufacturing the chip with conductive bumps by cutting.
이 발명은 제2 단계와 제3 단계 사이에서, 금속층이 코팅된 다수의 구멍의 내부에 감광성 재질의 폴리머를 채우고 경화시켜 내부 폴리머를 형성하는 단계를 더 포함할 수 있다. The present invention may further include filling the polymer of the photosensitive material into the inside of the plurality of holes coated with the metal layer between the second step and the third step to form an internal polymer.
이 발명은 내부 폴리머의 상부 일부분을 제거함으로써 내부 폴리머의 높이가 감광층의 높이보다 낮도록 가공하는 단계를 더 포함할 수 있다. The invention may further comprise processing such that the height of the inner polymer is lower than the height of the photosensitive layer by removing the upper portion of the inner polymer.
이 발명의 다수의 구멍은 전극이 형성되지 않는 부위에도 더 형성될 수 있다. A plurality of holes of the present invention can be further formed in the portion where the electrode is not formed.
이 발명의 금속층의 일부분을 제거하는 기계적인 가공방법은, 그라인딩, 폴리싱 또는 화학적-기계적 폴리싱(Chemical Mechanical Polishing) 방법일 수 있다. The mechanical processing method for removing a part of the metal layer of the present invention may be a grinding, polishing or chemical mechanical polishing method.
이 발명의 금속층은 구리, 금, 은, 알루미늄, 니켈, 주석 또는 이들의 합금 재질로 구성될 수 있다. The metal layer of the present invention may be made of copper, gold, silver, aluminum, nickel, tin or alloys thereof.
이 발명의 전도성 범프를 갖는 칩은, 표면에 1개 이상의 패드를 갖는 칩과, 패드의 상면에 1개 이상씩 형성되는 제1 전도성 범프를 포함하며, 제1 전도성 범프는 상부가 개방된 금속 범프와, 금속 범프의 외측 둘레를 감싸는 외부 폴리머를 구비하되, 금속 범프의 상단이 외부 폴리머의 상면으로 돌출되어 노출되는 구조를 갖는 것을 특징으로 한다. A chip having a conductive bump of the present invention includes a chip having one or more pads on a surface thereof, and a first conductive bump formed on at least one top surface of the pad, wherein the first conductive bumps have a metal bump with an open top portion. And an outer polymer surrounding the outer circumference of the metal bump, wherein the upper end of the metal bump protrudes from the upper surface of the outer polymer to be exposed.
이 발명은 패드 이외의 칩의 표면에 형성되는 다수의 제2 전도성 범프를 더 포함할 수 있다. The invention may further comprise a plurality of second conductive bumps formed on the surface of the chip other than the pad.
이 발명은 금속 범프의 내부에 채워지는 내부 폴리머를 더 포함하며, 내부 폴리머의 높이가 외부 폴리머의 높이보다 낮은 구조를 가질 수 있다. The present invention further includes an inner polymer filled in the inside of the metal bump, and the height of the inner polymer may have a structure lower than that of the outer polymer.
이 발명은 금속 범프의 내부에 채워지는 내부 폴리머를 더 포함하며, 내부 폴리머와 외부 폴리머가 동일한 높이를 가질 수 있다. The invention further includes an inner polymer filled inside the metal bumps, wherein the inner polymer and the outer polymer can have the same height.
이 발명은 외부 폴리머의 상면으로 돌출되는 금속 범프의 돌출 길이가 제1 전도성 범프 사이의 간격의 1/2 보다 작은 것이 바람직하다. In the present invention, it is preferable that the protruding length of the metal bumps projecting to the upper surface of the outer polymer is smaller than 1/2 of the gap between the first conductive bumps.
이 발명의 전자부품의 제조방법은, 상기와 같이 구성된 전도성 범프를 갖는 칩의 표면 중에서 제1 전도성 범프가 형성된 표면이나 기판의 표면 중에서 패드가 형성된 표면에 절연성 재질의 접착제를 도포하는 단계와, 제1 전도성 범프가 패드에 접촉하도록 위치시킨 상태에서 압력을 가해 금속 범프의 상단을 휘어지게 변형시켜 패드에 접촉시킴과 더불어 열을 가해 접착제를 경화시켜 칩을 기판에 접합함 으로써 전자부품을 제조하는 단계를 포함하는 것을 특징으로 한다. The method of manufacturing an electronic component of the present invention includes the steps of applying an adhesive of an insulating material to a surface having a first conductive bump formed on the surface of a chip having the conductive bumps configured as described above or a surface having a pad formed on the surface of the substrate; (1) manufacturing an electronic component by bonding a chip to a substrate by applying pressure to harden the adhesive by contacting the pad by deforming the top of the metal bump by applying pressure while placing the conductive bump in contact with the pad. Characterized in that it comprises a.
이 발명의 전자부품은, 상기와 같은 전자부품의 제조방법에 의해 제조되는 것을 특징으로 한다. The electronic component of this invention is manufactured by the manufacturing method of the above-mentioned electronic component. It is characterized by the above-mentioned.
이 발명은 전도성 범프의 구조를 단순화함에 따라 웨이퍼 레벨(상태)에서 전도성 범프를 보다 효율적으로 제조할 수 있으므로 생산성을 향상시키는 장점이 있다.The present invention has the advantage of improving productivity since the conductive bumps can be manufactured more efficiently at the wafer level (state) by simplifying the structure of the conductive bumps.
또한, 이 발명은 전도성 범프를 전기적으로 절연시키기 위해 그라인딩이나 폴리싱과 같은 기계적인 가공방법을 사용하므로 가공속도가 빠르고 균일한 높이의 범프를 가공할 수 있는 장점이 있다.In addition, since the present invention uses a mechanical processing method such as grinding or polishing to electrically insulate the conductive bumps, there is an advantage that the processing speed is fast and the bumps of uniform height can be processed.
또한, 이 발명은 전도성 범프를 갖는 칩을 단지 기판에 접합하여 구성하므로, 전자부품의 접합과정에서 전기적 단락을 방지할 수 있을 뿐만 아니라 균일하고 높은 전기 전도도를 얻을 수 있는 장점이 있다.In addition, since the present invention is configured by bonding a chip having a conductive bump to a substrate, it is possible not only to prevent an electrical short circuit during the bonding process of an electronic component, but also to obtain a uniform and high electrical conductivity.
또한, 이 발명은 전도성 범프에서 돌출된 금속 범프가 열압착 접합시 압력에 의해 휘어짐에 따라 탄성 복원력이 발생하여 금속 범프와 기판의 패드 사이에 접촉이 유지됨과 더불어 접촉 면적을 증가시켜 전기 저항을 감소시키는 장점이 있다.In addition, the present invention provides an elastic restoring force as the metal bumps protruding from the conductive bumps are bent by pressure during thermocompression bonding, thereby maintaining contact between the metal bumps and the pads of the substrate and increasing the contact area to reduce electrical resistance. It has the advantage of letting.
또한, 이 발명은 전도성 범프의 내부 폴리머와 외부 폴리머가 접합시 탄성 복원력을 증가시키고, 금속 범프의 과도한 변형을 제한하여 전도성 범프가 파괴되는 것을 방지하는 장점이 있다.In addition, the present invention has an advantage in that the inner polymer and the outer polymer of the conductive bumps increase elastic restoring force upon bonding and limit the excessive deformation of the metal bumps to prevent the conductive bumps from being destroyed.
또한, 이 발명은 내부 폴리머의 높이가 외부 폴리머의 높이보다 낮도록 가공함에 따라 돌출된 금속 범프가 내부로 휘도록 변형시켜 전기적 단락을 더 효율적으로 방지하는 장점이 있다.In addition, the present invention has an advantage of preventing the electrical short circuit more efficiently by deforming the protruding metal bumps to the inside as the inner polymer is processed to be lower than the height of the outer polymer.
또한, 이 발명은 웨이퍼 레벨(상태)에서 한 번의 리소그래피와 에칭 및 기계적인 가공으로 전도성 범프를 가공하므로 가공비를 절감하는 장점이 있다.In addition, the present invention has the advantage of reducing the processing cost because the conductive bump is processed by one lithography, etching and mechanical processing at the wafer level (state).
또한, 이 발명은 웨이퍼의 전체 표면에 전도성 범프를 균일한 패턴으로 형성할 경우, 리소그래피에 사용되는 마스크를 칩의 패드 형상이나 분포와 무관하게 공통적으로 활용할 수 있으므로 원가를 절감할 수 있는 장점이 있다.In addition, when the conductive bumps are formed in a uniform pattern on the entire surface of the wafer, the mask used for lithography can be commonly used irrespective of the pad shape or distribution of the chip, thereby reducing the cost. .
또한, 이 발명은 전도성 범프를 칩의 패드 부위에 다수개 형성하고 패드 사이의 부위에 형성하지 않을 경우, 전도성 범프 간의 전기적 단락을 더 효율적으로 방지할 수 있는 장점이 있다. In addition, the present invention has the advantage of preventing the electrical short between the conductive bumps more efficiently if a plurality of conductive bumps are formed in the pad portion of the chip and not formed in the portion between the pads.
아래에서, 이 발명에 따른 전도성 범프를 갖는 칩 및 그 제조방법과, 칩을 구비한 전자부품 및 그 제조방법의 양호한 실시예를 첨부한 도면을 참조하여 상세히 설명한다. Hereinafter, a chip having a conductive bump and a method of manufacturing the same according to the present invention, an electronic component having a chip, and a preferred embodiment of the method of manufacturing the same will be described in detail with reference to the accompanying drawings.
도 1은 이 발명의 한 실시예에 따른 전도성 범프를 갖는 칩을 웨이퍼 레벨(상태)로부터 제조하는 과정을 나타낸 흐름도로서, 내부 폴리머의 높이가 외부 폴리머의 높이보다 낮은 전도성 범프의 제조 과정을 나타낸 흐름도이고, 도 2는 도 1에 나타낸 방법에 의해 제조된 이 발명에 따른 전도성 범프를 갖는 칩의 개략도이 다.1 is a flowchart illustrating a process of manufacturing a chip having conductive bumps from a wafer level according to an embodiment of the present invention, wherein the height of an inner polymer is lower than that of an outer polymer. 2 is a schematic view of a chip with conductive bumps according to the invention produced by the method shown in FIG. 1.
도 1에 나타낸 바와 같이, 이 실시예에 따른 전도성 범프를 갖는 칩의 제조 과정은 다음과 같다. As shown in FIG. 1, the manufacturing process of the chip having the conductive bumps according to this embodiment is as follows.
제1 단계에서는, 일정 간격으로 다수의 전극(101)이 형성된 웨이퍼(100)의 상면에 감광성 재질로 구성된 감광층(110)을 코팅한 후, 리소그래피와 에칭공정을 이용해 감광층(110)을 식각해 다수의 구멍(120) 패턴을 가공한다. 이때, 다수의 구멍(120)은 전극(101)이 형성되거나 형성되지 않는 부위 및 그 경계라인에 각각 형성되도록 패턴 가공된다. 여기서, 구멍(120)은 원통형 또는 직육면체 등 다양한 형상으로 가공해 사용할 수 있다.In the first step, the
제2 단계에서는, 증착공정 또는 도금공정을 이용해 감광층(110)과 다수의 구멍(120)의 표면에 금속층(130)을 코팅한다. 이때, 금속층(130)은 전기 전도성이 높은 구리, 금, 은, 알루미늄, 니켈, 주석 또는 이들의 합금 재질을 사용하는 것이 바람직하다. In the second step, the
제3 단계에서는, 스핀 코팅이나 스크린 프린팅 또는 스퀴지를 이용해 금속층(130)이 코팅된 다수의 구멍(120)의 내부에 감광성 재질의 폴리머를 채우고 경화시켜 내부 폴리머(140)를 형성한다.In the third step, the
제4 단계에서는, 에칭방법을 이용해 내부 폴리머(140)의 일부를 제거함으로써 내부 폴리머(140)의 높이가 감광층(110)의 높이보다 낮도록 가공한다.In the fourth step, by removing a part of the
제5 단계에서는, 금속층(130)의 상부로부터 일정 깊이 지점, 즉 내부 폴리머(140)가 절단되지 않으면서 감광층(110)이 상부로 노출되는 지점을 가공선(150) 으로 하여, 가공선(150)의 상부에 위치하는 금속층(130)의 일부분을 기계적인 가공방법으로 제거한다. 여기에 사용되는 기계적인 가공방법으로는 그라인딩이나 폴리싱 또는 화학적-기계적 폴리싱(Chemical Mechanical Polishing) 방법을 사용할 수 있다. 이렇게 함으로써, 웨이퍼(100)의 상면에는 일정 간격을 두고 서로 간에 전기적으로 절연되는 다수의 전도성 범프(160)가 균일하게 형성된다. 여기서, 전도성 범프(160)는 가공선(150)을 따라 금속층(130)의 일부분을 제거함에 따라, 금속층(130)에 의해 형성되는 금속 범프(170)와, 감광층(110)에 의해 형성되는 외부 폴리머(180), 및 금속 범프(170) 내에 채워지는 내부 폴리머(140)로 구성된다. In the fifth step, the
제6 단계에서는, 에칭방법을 이용해 내부 폴리머(140)와 외부 폴리머(180)의 상부 일부분을 제거해 금속 범프(170)의 상단이 내외부 폴리머(140, 180)의 상면으로 돌출되는 전도성 범프(190)를 형성한다. In a sixth step, an upper portion of the
제7 단계에서는, 다이싱(dicing) 공정으로 절단선(도시안됨)을 따라 웨이퍼(100)를 절단함으로써 도 2의 (a)와 같은 이 발명에 따른 전도성 범프를 갖는 칩을 각각 제조한다. In the seventh step, each chip having a conductive bump according to the present invention as shown in FIG. 2A is manufactured by cutting the
이 실시예에 따른 전도성 범프를 갖는 칩의 제조방법은, 상기 제조과정의 일부분을 변경함으로써, 도 2의 (b)와 (c)에 각각 도시된 구조의 전도성 범프를 갖는 칩의 제조가 가능하다.In the method of manufacturing a chip having conductive bumps according to this embodiment, by changing a part of the manufacturing process, it is possible to manufacture a chip having conductive bumps having the structures shown in FIGS. 2B and 2C, respectively. .
즉, 도 2의 (b)에 도시된 내부 폴리머가 없는 전도성 범프를 갖는 칩을 제조하려면, 상기의 제조과정 중에서 제3 단계와 제4 단계를 생략하면 된다. 그리고, 도 2의 (c)에 도시된 바와 같이 높이가 동일한 내외부 폴리머가 형성된 전도성 범 프를 갖는 칩을 제조하려면, 상기의 제조과정 중에서 제4 단계를 생략하면 된다. That is, to manufacture the chip having the conductive bump without the internal polymer shown in FIG. 2 (b), the third step and the fourth step may be omitted in the above manufacturing process. As illustrated in FIG. 2C, to manufacture a chip having conductive bumps having inner and outer polymers having the same height, the fourth step may be omitted in the manufacturing process.
도 2의 (a)에 도시된 바와 같이, 이 발명에 따른 전도성 범프를 갖는 칩(200)은 그 표면에 적어도 1개 이상의 패드(210)가 형성되어 있다. 패드(210)의 상면에는 다수의 제1 전도성 범프(220)가 형성되어 있고, 패드(210) 이외의 패드(210)에 인접한 칩(200)의 표면에도 다수의 제2 전도성 범프(230)가 균일하게 분포되어 있다.As shown in FIG. 2A, at least one
다수의 제1 전도성 범프(220) 중에서 일부분은 패드(210) 내에 위치하고, 나머지 부분은 패드(210)의 표면과 칩(200)의 표면 간의 경계라인을 덮는 위치에 형성된다. 제1, 제2 전도성 범프(220, 230)는 상부가 개방된 금속 범프(270)와, 금속 범프(270)의 내부에 채워지는 내부 폴리머(240), 및 금속 범프(270)의 외측 둘레를 감싸는 외부 폴리머(280)로 구성된다. 여기서, 제1, 제2 전도성 범프(220, 230)는 금속 범프(270)의 상단이 내외부 폴리머(240, 280)의 상면으로 돌출되어 노출되며, 내부 폴리머(240)의 높이가 외부 폴리머(280)의 높이보다 낮은 구조를 갖는다.A portion of the plurality of first
도 2의 (b)에 도시된 제1, 제2 전도성 범프(220a, 230a)는 금속 범프(270a)와 외부 폴리머(280a)로 구성되는 것으로서, 금속 범프(270a)의 내부에는 폴리머를 형성하지 않고 금속 범프(270a)의 상단이 외부 폴리머(280a)의 상면으로 돌출되는 구조를 갖는다.The first and second
도 2의 (c)에 도시된 제1, 제2 전도성 범프(220b, 230b)는 금속 범프(270b)의 내외부에 각각 위치하는 내부 폴리머(240b)와 외부 폴리머(280b)가 동일한 높이 를 갖는 것으로서, 금속 범프(270b)의 상단이 내외부 폴리머(240b, 280b)의 상면으로 돌출되어 노출되는 구조를 갖는다.In FIG. 2C, the first and second
이 실시예의 전도성 범프는 칩의 전체 표면에 균일한 패턴으로 형성되고, 칩의 패드에 다수의 전도성 범프가 형성된다. 이 실시예의 금속 범프의 재질로는 전기 전도성이 높은 구리, 금, 은, 알루미늄, 니켈, 주석 또는 이들의 합금 재질을 사용하고, 내부 폴리머와 외부 폴리머의 재질로는 감광성 재질을 사용한다. The conductive bumps of this embodiment are formed in a uniform pattern on the entire surface of the chip, and a plurality of conductive bumps are formed on the pad of the chip. As the material of the metal bumps of this embodiment, copper, gold, silver, aluminum, nickel, tin or alloys thereof having high electrical conductivity are used, and a photosensitive material is used as the material of the inner polymer and the outer polymer.
이 발명에서는, 전도성 범프를 칩의 표면에 균일한 패턴 또는 특정한 패턴으로 형성할 수 있다. 따라서, 전도성 범프의 패턴이 균일하면 리소그래피 공정에 사용되는 마스크를 1개만 제작하여 공통적으로 사용하면 되므로 생산비를 감소시킬 수 있는 장점이 있다. 한편, 전도성 범프의 패턴이 특정한 경우에는 다수의 전도성 범프를 칩의 패드 부위에만 형성하고 패드 사이의 부위에는 형성하지 않을 수 있다. 이 경우에는 패드 사이에 전도성 범프가 존재하지 않는 부위가 형성되어 전기적 단락을 방지할 수 있는 장점이 있지만, 칩의 패드 형상에 따라 마스크를 제작해야 하고 정밀한 정렬 장비가 필요하기 때문에 생산비가 증가하는 단점이 있다.In this invention, a conductive bump can be formed in a uniform pattern or a specific pattern on the surface of a chip. Therefore, if the pattern of the conductive bumps is uniform, since only one mask used in the lithography process is manufactured and commonly used, there is an advantage of reducing the production cost. On the other hand, in the case where the pattern of the conductive bumps is specific, a plurality of conductive bumps may be formed only on the pad portion of the chip, but not on the portion between the pads. In this case, there is an advantage of preventing the electrical short circuit due to the formation of a portion where no conductive bumps exist between the pads. However, the production cost increases because a mask must be manufactured according to the pad shape of the chip and precise alignment equipment is required. There is this.
도 3은 도 2의 (a)에 도시된 전도성 범프를 갖는 칩을 구비한 전자부품의 제조과정을 도시한 개략도이며, 도 4는 도 3의 제조과정에 의해 제조된 이 발명에 따른 전자부품의 개략도이다.FIG. 3 is a schematic diagram illustrating a manufacturing process of an electronic component having a chip having a conductive bump illustrated in FIG. 2A, and FIG. 4 illustrates an electronic component manufactured by the manufacturing process of FIG. 3. Schematic diagram.
도 2 및 도 3에 나타낸 바와 같이, 먼저 칩(200) 및/또는 기판(300)의 표면에 접착제(310)를 코팅한다. 이때, 접착제(310)는 칩(200)의 표면 중에서 다수의 제1, 제2 전도성 범프(220, 230)가 형성된 표면에 코팅하거나, 기판(300)의 표면 중에서 패드(320)가 형성된 표면에 코팅한다. 여기에 사용되는 접착제(310)는 절연성 재질로서 포토레지스트(photoresist) 계통의 접착제를 사용하는 것이 바람직하다. As shown in FIGS. 2 and 3, first, the adhesive 310 is coated on the surface of the
그런 다음, 칩(200)을 기판(300)의 상면에 위치시키고 압력을 가해, 칩(200)의 제1, 제2 전도성 범프(220, 230)를 기판(300)의 패드(320) 및 기판(300)의 표면에 밀착시킨 상태에서, 열을 가해 접착제(310)를 경화시킴으로써 칩(200)이 기판(300)에 접합된다. Then, the
그러면, 칩(200)의 제1 전도성 범프(220)는 가해진 압력에 의해 기판(300)의 표면으로 돌출된 패드(320)와 밀착되어 변형되면서 전기적 통로 역할을 한다. 즉, 금속 범프(270)의 상단이 변형되어 휘어지면서 탄성 복원력을 발생시켜 금속 범프(270)와 기판(300)의 패드(320) 사이에 접촉을 유지시킴과 더불어, 기판(300)의 패드(320)와 접촉 면적이 증가하여 전기 저항을 감소시킨다. 한편, 제1 전도성 범프(220)의 내부 폴리머(240)와 외부 폴리머(280)는 금속 범프(270)가 과도하게 변형되는 것을 방지하고, 접합 완료 후에 금속 범프(270)의 탄성 복원력을 증가시키는 역할을 한다. Then, the first
이 실시예에 따른 열압착 방법을 이용한 접합과정을 수행함에 있어서, 전도성 범프 사이에 전기적 단락이 발생할 수 있다. 따라서, 전기적 단락을 방지하기 위해 외부 폴리머(280)의 상단으로 돌출되는 금속 범프(270)의 돌출 길이(L)가 제1 전도성 범프(220) 사이의 간격(G)의 1/2 보다 작도록 가공하는 것이 바람직하다. 한편, 기판(300)의 패드(320) 또는 칩(200)의 패드(210)를 1~2㎛ 높이의 금속 범프 로 가공하면, 제1 전도성 범프(220)는 칩(200)과 기판(300)의 돌출된 패드(210, 320) 사이에 선택적으로 접촉하는 장점이 있다. 또한, 내부 폴리머(240)의 높이가 외부 폴리머(280)의 높이보다 낮도록 가공하면 돌출된 금속 범프(270)가 내부로 휘어지도록 변형되므로 전기적 단락을 더 효율적으로 방지할 수 있다. In performing the bonding process using the thermocompression method according to this embodiment, an electrical short may occur between the conductive bumps. Accordingly, the protruding length L of the metal bumps 270 protruding to the top of the
이렇게 칩(200)을 기판(300)에 접합하면, 제1 전도성 범프(220)를 매개로 칩(200)의 패드(210)와 기판(300)의 패드(320)는 전기적으로 연결되지만, 그 이외의 부분은 절연성 재질의 접착제(310)에 의해 절연된다. 이렇게 함으로써 도 4와 같은 이 발명에 따른 전자부품(400)이 제조된다.When the
이상에서 이 발명의 전도성 범프를 갖는 칩 및 그 제조방법과, 칩을 구비한 전자부품 및 그 제조방법에 대한 기술사항을 첨부도면과 함께 서술하였지만 이는 이 발명의 가장 양호한 실시예를 예시적으로 설명한 것이지 이 발명을 한정하는 것은 아니다. In the above description, the chip having the conductive bumps of the present invention, a method of manufacturing the same, and technical details of the electronic component having the chip and the method of manufacturing the same have been described together with the accompanying drawings. It does not limit this invention.
또한, 이 기술분야의 통상의 지식을 가진 자이면 누구나 이 발명의 기술사상의 범주를 이탈하지 않고 첨부한 특허청구범위 내에서 다양한 변형 및 모방이 가능함은 명백한 사실이다.In addition, it is obvious that any person skilled in the art can make various modifications and imitations within the scope of the appended claims without departing from the scope of the technical idea of the present invention.
도 1은 이 발명의 한 실시예에 따른 전도성 범프를 갖는 칩을 웨이퍼 레벨(상태)로부터 제조하는 과정을 나타낸 흐름도이고, 1 is a flowchart illustrating a process of manufacturing a chip having a conductive bump from a wafer level according to an embodiment of the present invention.
도 2는 도 1에 나타낸 방법에 의해 제조된 이 발명에 따른 전도성 범프를 갖는 칩의 개략도이고, FIG. 2 is a schematic view of a chip with conductive bumps according to the invention produced by the method shown in FIG. 1,
도 3은 도 2의 (a)에 도시된 전도성 범프를 갖는 칩을 구비한 전자부품의 제조과정을 도시한 개략도이며, FIG. 3 is a schematic diagram illustrating a manufacturing process of an electronic component having a chip having a conductive bump shown in FIG.
도 4는 도 3의 제조과정에 의해 제조된 이 발명에 따른 전자부품의 개략도이다.4 is a schematic diagram of an electronic component according to the present invention manufactured by the manufacturing process of FIG.
♠ 도면의 주요부분에 대한 부호의 설명 ♠♠ Explanation of symbols on the main parts of the drawing ♠
200 : 칩 210 : 패드200: chip 210: pad
220 : 제1 전도성 범프 230 : 제2 전도성 범프220: first conductive bump 230: second conductive bump
240 : 내부 폴리머 270 : 금속 범프240: internal polymer 270: metal bump
280 : 외부 폴리머280: outer polymer
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