KR20090074477A - 플라즈마 디스플레이 장치 - Google Patents

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Abstract

본 발명은 플라즈마 디스플레이 장치에 관한 것으로서, 계조 표현력을 높여 영상의 화질을 개선하고, 저계조 영상의 화질을 더욱 개선하는 효과가 있다.
본 발명의 일실시예에 따른 플라즈마 디스플레이 장치는 서로 나란한 스캔 전극과 서스테인 전극이 배치되는 플라즈마 디스플레이 패널과 구동부를 포함하고,
구동부는 복수의 서브필드 중 제 1 서브필드의 어드레스 기간에서 서스테인 전극에 제 1 서스테인 바이어스 신호(Vzb1)를 공급하고, 어드레스 기간 이후의 서스테인 기간에서 스캔 전극 및 서스테인 전극에 서스테인 신호를 공급하지 않거나 서스테인 기간을 생략하고, 제 1 서브필드 이후의 제 2 서브필드의 어드레스 기간에서 서스테인 전극에 제 2 서스테인 바이어스 신호(Vzb2)를 공급하고, 어드레스 기간 이후의 서스테인 기간에는 스캔 전극 또는 서스테인 전극 중 적어도 하나에 서스테인 신호를 공급하고, 제 1 서스테인 바이어스 신호의 전압은 제 2 서스테인 바이어스 신호의 전압보다 낮거나, 그라운드 레벨의 전압일 수 있다.
플라즈마 디스플레이 장치, 저계조, 서스테인 바이어스 신호, 어드레스 기간

Description

플라즈마 디스플레이 장치{Plasma Display Apparatus}
본 발명은 플라즈마 디스플레이 장치(Plasma Display Apparatus)에 관한 것이다.
본 발명은 플라즈마 디스플레이 장치(Plasma Display Apparatus)에 관한 것이다.
일반적으로 플라즈마 디스플레이 장치는 복수의 전극들이 형성된 플라즈마 디스플레이 패널과 이러한 플라즈마 디스플레이 패널의 전극을 구동시키기 위한 구동부를 포함하여 이루어진다.
플라즈마 디스플레이 패널은 전면 기판을 포함하는 전면 패널과 후면 기판을 포함하는 후면 패널이 합착되어 이루어진다.
그리고 전면 기판과 후면 기판의 사이에서 방전 셀이 형성된다.
구동부는 프레임(Frame)의 복수의 서브필드(Subfield)에서 이러한 플라즈마 디스플레이 패널의 방전 셀에 소정의 구동 전압을 공급한다. 그러면, 이러한 구동 전압에 의해 플라즈마 디스플레이 패널의 방전 셀 내에서 리셋 방전, 어드레스 방전, 서스테인 방전 등의 방전이 발생한다.
이와 같이, 소정의 구동 전압이 공급되어 방전 셀 내에서 방전이 될 때, 방전 셀 내에 충진되어 있는 방전 가스는 진공 자외선(Vacuum Ultraviolet rays) 등의 고주파 광을 발생시킨다.
이러한 고주파 광이 방전 셀 내에 형성된 형광체를 발광시키고, 여기서 형광체 층이 가시광선을 발생시킴으로써 영상이 구현된다.
이와 같은 플라즈마 디스플레이 장치는 얇고 가벼운 구성이 가능하므로 차세대 표시장치로서 각광받고 있다.
일반적으로 플라즈마 디스플레이 장치에서는 프레임의 모든 서브필드에서 서스테인 기간에 한 쌍 이상의 서스테인 펄스를 사용하여 영상의 계조(Gray Level)를 구현한다.
이에 따라 일반적인 플라즈마 디스플레이 장치에서 구현 가능한 계조는 모두 정수 계조이다. 예를 들면, 1, 2, 3 등의 정수 계조만을 구현할 수 있어서, 구현할 수 있는 계조의 가지 수가 적어 영상의 계조 표현력이 떨어지는 문제점이 있었다. 이러한 문제점을 해결하기 위해 종래에는 어드레스 기간 이후의 서스테인 기간에서 구동부(110)는 스캔 전극(Y) 및 서스테인 전극(Z) 중 어느 하나에 서스테인 펄스(Sus)가 공급되지 않게 하였다.
도 4는 종래의 저계조 서브필드를 구현하기 위한 방식의 플라즈마 디스플레이 장치의 구동부의 동작을 설명하기 위한 도면이다.
도 4를 참조하면, 서스테인 전극(Z)에는 서스테인 전압(Vs)을 갖는 서스테인 펄스(Sus)를 공급하고 스캔 전극(Y)에는 서스테인 펄스의 공급을 생략하는 것이다.
도시하지는 않았지만, 도 4에 도시된 것과는 반대로,스캔 전극(Y)에는 서스테인 전압(Vs)을 갖는 서스테인 펄스(Sus)를 공급하고 서스테인 전극(Z)에는 서스테인 펄스의 공급을 생략하는 것이다.
이러한 저계조 서브필드, 즉 제 1 서브필드에서는 스캔 펄스와 데이터 펄스 간에 발생하는 방전에 의한 광, 서스테인 전극(Z)에 공급되는 서스테인 펄스에 의한 광이 합산되어 영상의 계조를 구현하였다.
그러나, 종래의 저계조 구현 방식만으로는 구현할 수 있는 계조의 가지 수가 부족하여 더욱 섬세한 영상 계조의 구현이 어려운 문제점이 있었다.
상술한 문제점을 해결하기 위해 본 발명의 목적은 계조 표현력을 높여 구현되는 영상의 화질을 개선하는 플라즈마 디스플레이 장치를 제공하는 것이다.
특히, 본 발명의 목적은 저계조에서의 계조 표현력을 높여 저계조에서의 영상의 화질을 개선하는 플라즈마 디스플레이 장치를 제공하는 것이다.
본 발명의 일실시예에 따른 플라즈마 디스플레이 장치는 서로 나란한 스캔 전극과 서스테인 전극이 배치되는 플라즈마 디스플레이 패널과 구동부를 포함하고,
구동부는 복수의 서브필드 중 제 1 서브필드의 어드레스 기간에서 서스테인 전극에 제 1 서스테인 바이어스 신호(Vzb1)를 공급하고, 어드레스 기간 이후의 서스테인 기간에서 스캔 전극 및 서스테인 전극에 서스테인 신호를 공급하지 않거나 서스테인 기간을 생략하고, 제 1 서브필드 이후의 제 2 서브필드의 어드레스 기간에서 서스테인 전극에 제 2 서스테인 바이어스 신호(Vzb2)를 공급하고, 어드레스 기간 이후의 서스테인 기간에는 스캔 전극 또는 서스테인 전극 중 적어도 하나에 서스테인 신호를 공급하고, 제 1 서스테인 바이어스 신호의 전압은 제 2 서스테인 바이어스 신호의 전압보다 낮은 것을 특징으로 한다.
혹은 제 1 서스테인 바이어스 신호의 전압은 그라운드 레벨의 전압일 수도 있고, 제 1 서브필드에서는 서스테인 전극의 전압이 일정하게 유지된다고 달리 표현할 수도 있다.
상기 구동부는 제 1 서브필드의 리셋 기간에서 스캔 전극에 제 1 상승 램프 신호를 공급하고, 제 1 서브필드 이후의 제 2 서브필드의 리셋 기간에서 스캔 전극에 제 2 상승 램프 신호를 공급하고, 제 1 상승 램프 신호의 전압 최대치는 제 2 상승 램프 신호의 전압 최대치보다 낮은 것을 특징으로 한다.
혹은 제 1 상승 램프 신호의 전압 최대치는 서스테인 신호의 전압과 동일할 수 있다.
본 발명의 플라즈마 디스플레이 장치는 계조 표현력을 높여 영상의 화질을 개선하고, 저계조 영상의 화질을 더욱 개선하는 효과가 있다.
이하, 첨부된 도면을 참조하여 본 발명의 플라즈마 디스플레이 장치를 상세히 설명하기로 한다.
도 1은 본 발명의 플라즈마 디스플레이 장치의 구성을 설명하기 위한 도면이다.
도 1을 살펴보면, 본 발명의 플라즈마 디스플레이 장치는 플라즈마 디스플레이 패널(100)과 구동부(110)를 포함한다.
플라즈마 디스플레이 패널(100)은 스캔 전극(Y)과 서스테인 전극(Z)을 포함한다. 여기서 스캔 전극(Y)과 서스테인 전극(Z)은 서로 나란히 배치된다.
구동부(110)는 영상을 구현하기 위한 프레임(Frame)의 복수의 서브필드(Subfield) 중 저계조 서브필드에서는 플라즈마 디스플레이 패널(100)의 전극들을 구동시킨다.
예를 들면, 플라즈마 디스플레이 패널(100)의 어드레스 전극(X)에 데이터 펄스(Data)의 데이터 전압(Vd)을 공급하는 방법 등을 통해 어드레스 전극(X)을 구동시킬 수 있다.
또한, 구동부(110)는 플라즈마 디스플레이 패널(100)의 스캔 전극(Y)에 리셋 전압, 스캔 펄스의 스캔 전압(-Vy), 서스테인 펄스의 전압(Vs)을 공급하는 방법 등 을 통해 스캔 전극(Y)을 구동시킬 수 있다.
또한, 구동부(110)는 플라즈마 디스플레이 패널(100)의 서스테인 전극(Z)에 서스테인 바이어스 전압(Vz) 등을 통해 서스테인 전극(Z)을 구동시킬 수 있다.
여기서, 본 발명의 플라즈마 디스플레이 장치의 주요 특징인 구동부(110)는 이후의 설명을 통해 보다 명확히 될 것이다.
이러한, 본 발명의 플라즈마 디스플레이 장치에 포함되는 플라즈마 디스플레이 패널에 대해 첨부된 도 2a 내지 도 2b를 결부하여 상세히 살펴보면 다음과 같다.
도 2a 내지 도 2b는 본 발명의 플라즈마 디스플레이 장치에 포함되는 플라즈마 디스플레이 패널의 구조의 일례를 설명하기 위한 도면이다.
먼저, 도 2a를 살펴보면 본 발명의 플라즈마 디스플레이 패널은 전극(Electrode), 바람직하게는 스캔 전극(202, Y)과 서스테인 전극(203, Z)이 형성되는 전면 기판(201)을 포함하는 전면 패널(200)과, 전술한 스캔 전극(202, Y) 및 서스테인 전극(203, Z)과 교차하는 전극, 바람직하게는 어드레스 전극(213, X)이 형성되는 후면 기판(211)을 포함하는 후면 패널(210)이 합착되어 이루어진다.
여기서, 전면 기판(201) 상에 형성되는 전극, 바람직하게는 스캔 전극(202, Y)과 서스테인 전극(203, Z)은 방전 공간, 즉 방전 셀(Cell)에서 방전을 발생시키고 아울러 방전 셀의 방전을 유지한다.
이러한 스캔 전극(202, Y)과 서스테인 전극(203, Z)이 형성된 전면 기판(201)의 상부에는 스캔 전극(202, Y)과 서스테인 전극(203, Z)을 덮도록 유전체 층, 바람직하게는 상부 유전체 층(204)이 형성된다.
이러한, 상부 유전체 층(204)은 스캔 전극(202, Y) 및 서스테인 전극(203, Z)의 방전 전류를 제한하며 스캔 전극(202, Y)과 서스테인 전극(203, Z) 간을 절연시킨다.
이러한, 상부 유전체 층(204) 상면에는 방전 조건을 용이하게 하기 위한 보호 층(205)이 형성된다. 이러한 보호 층(205)은 산화마그네슘(MgO) 등의 재료를 상부 유전체 층(204) 상부에 증착하는 방법 등을 통해 형성된다.
한편, 후면 기판(211) 상에 형성되는 전극, 바람직하게는 어드레스 전극(213, X)은 방전 셀에 데이터(Data)를 공급한다.
이러한 어드레스 전극(213, X)이 형성된 후면 기판(211)의 상부에는 어드레스 전극(213, X)을 덮도록 유전체 층, 바람직하게는 하부 유전체 층(215)이 형성된다.
이러한, 하부 유전체 층(215)은 어드레스 전극(213, X)을 절연시킨다.
이러한 하부 유전체 층(215)의 상부에는 방전 공간 즉, 방전 셀을 구획하기 위한 스트라이프 타입(Stripe Type) 또는 웰 타입(Well Type) 등의 격벽(212)이 형성된다. 이에 따라, 전면 기판(201)과 후면 기판(211)의 사이에서 적색(Red : R), 녹색(Green : G), 청색(Blue : B) 등의 방전 셀이 형성된다.
여기서, 격벽(212)에 의해 구획된 방전 셀 내에는 소정의 방전 가스가 채워진다.
아울러, 격벽(212)에 의해 구획된 방전 셀 내에는 어드레스 방전 시 화상표 시를 위한 가시 광을 방출하는 형광체 층(214)이 형성된다. 예를 들면, 적색(Red : R), 녹색(Green : G), 청색(Blue : B) 형광체 층이 형성될 수 있다.
이상에서 설명한 본 발명의 플라즈마 디스플레이 패널은 스캔 전극(202, Y), 서스테인 전극(203, Z) 또는 어드레스 전극(213, X) 중 적어도 하나 이상의 전극으로 구동 전압이 공급되면, 격벽(212)에 의해 구획된 방전 셀 내에서 방전이 발생한다.
그러면, 방전 셀 내에 채워진 방전 가스에서 진공 자외선이 발생하고, 이러한 진공 자외선이 방전 셀 내에 형성된 형광체 층(214)에 가해진다. 그러면, 형광체 층(214)에서 소정의 가시광선이 발생되고, 이렇게 발생된 가시광선이 상부 유전체 층(204)이 형성된 전면 기판(201)을 통해 외부로 방출되고, 이에 따라 전면 기판(201)의 외부 면에 소정의 영상이 표시된다.
한편, 도 2a의 설명에서는 스캔 전극(202, Y) 및 서스테인 전극(203, Z)이 각각 하나의 층(Layer)으로 이루어지는 경우만을 도시하고 설명하였지만, 이와는 다르게 스캔 전극(202, Y) 또는 서스테인 전극(203, Z) 중 하나 이상이 복수의 층으로 이루어지는 것도 가능하다. 이에 대해 도 2b를 참조하여 살펴보면 다음과 같다.
도 2b를 살펴보면, 스캔 전극(202, Y)과 서스테인 전극(203, Z)은 각각 두 개의 층(Layer)으로 이루어질 수 있다.
특히, 광 투과율 및 전기 전도도를 고려하면 방전 셀 내에서 발생한 광을 외부로 방출시키며 아울러 구동 효율을 확보하는 차원에서 스캔 전극(202, Y)과 서스 테인 전극(203, Z)은 불투명한 은(Ag) 재질의 버스 전극(202b, 203b)과 투명한 인듐 틴 옥사이드(Indium Tin Oxide : ITO) 재질의 투명 전극(202a, 203a)을 포함하는 것이 바람직하다.
이와 같이, 스캔 전극(202, Y)과 서스테인 전극(203, Z)이 투명 전극(202a, 203a)을 포함하도록 하는 이유는, 방전 셀 내에서 발생한 가시 광이 플라즈마 디스플레이 패널의 외부로 방출될 때 효과적으로 방출되도록 하기 위해서이다.
아울러, 스캔 전극(202, Y)과 서스테인 전극(203, Z)이 버스 전극(202b, 203b)을 포함하도록 하는 이유는, 스캔 전극(202, Y)과 서스테인 전극(203, Z)이 투명 전극(202a, 203a)만을 포함하는 경우에는 투명 전극(202a, 203a)의 전기 전도도가 상대적으로 낮기 때문에 구동 효율이 감소할 수 있어서, 이러한 구동 효율의 감소를 야기할 수 있는 투명 전극(202a, 203a)의 낮은 전기 전도도를 보상하기 위해서이다.
이상의 도 2a 내지 도 2b에서는 본 발명의 플라즈마 디스플레이 패널의 일례만을 도시하고 설명한 것으로써, 본 발명이 여기 도 2a 내지 도 2b와 같은 구조의 플라즈마 디스플레이 패널에 한정되는 것은 아님을 밝혀둔다. 예를 들면, 여기 도 2a 내지 도 2b의 플라즈마 디스플레이 패널에는 상부 유전체 층(204) 및 하부 유전체 층(215)이 각각 하나의 층(Layer)인 경우만을 도시하고 있지만, 상부 유전체 층(204) 및 하부 유전체 층(215) 중 적어도 하나 이상은 복수의 층으로 이루지는 것도 가능한 것이다.
다음, 플라즈마 디스플레이 장치에서 구동부(110)의 동작에 대해 살펴보면 다음과 같다.
구동부(110)는 상술한 구조의 플라즈마 디스플레이 패널(100)을 복수의 서브필드로 이루어지는 프레임으로 구동시켜 플라즈마 디스플레이 패널(100)의 화면상에 영상을 구현한다.
도 3은 본 발명의 플라즈마 디스플레이 장치에서 영상의 계조를 구현하기 위한 프레임(Frame)에 대해 설명하기 위한 도면이다.
또한, 도 5 내지 도 6은 본 발명의 저계조 영상을 구현하기 위한 플라즈마 디스플레이 장치의 구동부의 동작의 일례에 대해 설명하기 위한 도면이다.
먼저, 도 3을 살펴보면 본 발명의 플라즈마 디스플레이 장치에서 영상의 계조(Gray Level)를 구현하기 위한 프레임은 발광횟수가 다른 여러 서브필드로 나누어진다. 또한, 도시하지는 않았지만 각 서브필드는 다시 모든 방전 셀을 초기화시키기 위한 리셋 기간(Reset Period), 방전될 방전 셀을 선택하기 위한 어드레스 기간(Address Period) 및 방전횟수에 따라 계조를 구현하는 서스테인 기간(Sustain Period)으로 나누어진다.
예를 들어, 256 계조로 영상을 표시하고자 하는 경우에 1/60 초에 해당하는 프레임기간(16.67ms)은 예컨대, 도 3과 같이 8개의 서브필드들(SF1 내지 SF8)로 나누어지고, 8개의 서브 필드들(SF1 내지 SF8) 각각은 리셋 기간, 어드레스 기간 및 서스테인 기간으로 다시 나누어지게 된다.
여기서, 각 서브필드의 리셋 기간 및 어드레스 기간은 각 서브필드마다 동일하다.
한편, 서스테인 기간에 공급되는 서스테인 펄스의 개수를 조절하여 해당 서브필드의 계조 가중치를 설정할 수 있다. 즉, 서스테인 기간을 이용하여 각각의 서브필드에 소정의 계조 가중치를 부여할 수 있다. 예를 들면, 제 1 서브필드의 계조 가중치를 20 으로 설정하고, 제 2 서브필드의 계조 가중치를 21 으로 설정하는 방법으로 각 서브필드의 계조 가중치가 2n(단, n = 0, 1, 2, 3, 4, 5, 6, 7)의 비율로 증가되도록 각 서브필드의 계조 가중치를 결정할 수 있다. 이와 같이 각 서브필드에서 계조 가중치에 따라 각 서브필드의 서스테인 기간에서 공급되는 서스테인 펄스의 개수를 조절함으로써, 다양한 영상의 계조를 구현하게 된다.
이러한 본 발명의 플라즈마 디스플레이 장치는 1초의 영상을 표시하기 위해 복수의 프레임을 사용한다. 예를 들면, 1초의 영상을 표시하기 위해 60개의 프레임을 사용하는 것이다.
도 3에서는 하나의 프레임이 8개의 서브필드로 이루어진 경우만으로 도시하고 설명하였지만, 이와는 다르게 하나의 프레임을 이루는 서브필드의 개수는 다양하게 변경될 수 있다. 예를 들면, 제 1 서브필드부터 제 12 서브필드까지의 12개의 서브필드로 하나의 프레임을 구성할 수도 있고, 10개의 서브필드로 하나의 프레임을 구성할 수도 있는 것이다.
이러한, 프레임으로 영상의 계조를 구현하는 플라즈마 디스플레이 장치가 구현하는 영상의 화질은 프레임에 포함되는 서브필드의 개수에 따라 결정될 수 있다. 즉, 프레임에 포함되는 서브필드가 12개인 경우는 212 가지의 영상의 계조를 표현할 수 있고, 프레임에 포함되는 서브필드가 8개인 경우는 28 가지의 영상의 계조를 구현할 수 있게 되는 것이다.
또한, 도 3에서는 하나의 프레임에서 계조 가중치의 크기가 증가하는 순서에 따라 서브필드들이 배열되었지만, 이와는 다르게 하나의 프레임에서 서브필드들이 계조 가중치가 감소하는 순서에 따라 배열될 수도 있거나 계조 가중치에 관계없이 서브필드들이 배열될 수도 있는 것이다.
다음, 도 5를 살펴보면 도 3과 같은 프레임에 포함된 복수의 서브필드 중 소정의 서브필드에서의 구동부의 동작의 일례가 나타나 있다.
도 5를 살펴보면, 도 1의 본 발명의 플라즈마 디스플레이 장치에서 구동부(110)는 저계조 서브필드, 즉 제 1 서브필드에서는 리셋 기간의 셋업 기간에서 스캔 전극(Y)에 전압이 점진적으로 상승하는 제 1 상승 램프(Ramp-Up) 신호를 공급할 수 있다.
제 1 서브필드의 리셋 기간에서 스캔 전극에 공급되는 제 1 상승 램프 신호의 전압은 제 1 서브필드 이후의 제 2 서브필드의 리셋 기간에서 스캔 전극에 공급되는 제 2 상승 램프 신호의 전압보다 낮을 수 있다.
혹은 제 1 상승 램프 신호의 전압은 제 2 서브필드의 서스테인 기간에 공급되는 서스테인 신호의 전압(Vs)과 동일할 수 있다.
이러한 상승 램프 파형에 의해 방전 셀 내에는 약한 암방전(Dark Discharge), 즉 셋업 방전이 일어난다. 이 셋업 방전에 의해 방전 셀 내에는 어느 정도의 벽 전하(Wall Charge)가 쌓이게 된다.
또한, 셋업 기간 이후의 셋다운 기간에서는 스캔 전극(Y)에 상승 램프 파형을 공급한 후, 상승 램프 파형의 피크 전압보다 낮은 소정의 정극성 전압에서부터 전압이 점진적으로 하강하는 하강 램프(Ramp-Down) 신호를 공급할 수 있다.
이에 따라, 방전 셀 내에서 미약한 소거 방전(Erase Discharge), 즉 셋다운 방전이 발생한다. 이 셋다운 방전에 의해 이전의 셋업 방전에 의해 방전 셀 내에 쌓여있던 벽 전하의 일부가 소거되어 방전 셀 내에는 어드레스 방전이 안정되게 일어날 수 있을 정도의 벽전하가 균일하게 잔류된다.
이러한, 셋업 기간과 셋다운 기간을 포함하는 리셋 기간 이후의 어드레스 기간에서는 스캔 기준 전압(Vsc) 및 이러한 스캔 기준 전압(Vsc)으로부터 하강하는 부극성 스캔 펄스(Scan)의 전압(-Vy)을 스캔 전극(Y)에 공급할 수 있다.
아울러, 구동부(110)는 부극성 스캔 펄스의 전압(-Vy)을 스캔 전극(Y)으로 공급할 때, 이에 대응되게 어드레스 전극(X)에 데이터 펄스(Data)의 전압(Vd)을 공급한다.
어드레스 기간에서는 부극성 스캔 펄스(Scan)의 전압(-Vy)과 데이터 펄스(Data)의 전압(Vd) 간의 전압 차와 리셋 기간에 생성된 벽전하들에 의한 벽전압이 더해지면서 데이터 펄스(Data)의 전압(Vd)이 인가되는 방전 셀 내에는 어드레스 방전이 발생한다.
이러한, 어드레스 방전에 의해 선택된 방전 셀 내에는 서스테인 펄스(Sus)의 서스테인 전압(Vs)이 인가될 때 방전이 일어날 수 있게 하는 정도의 벽전하가 형성 된다.
도 4에 도시된 종래 기술을 다시 참조하면, 어드레스 기간에서 서스테인 전극(Z)의 간섭으로 인한 오방전의 발생을 방지하기 위해 어드레스 기간에서 서스테인 전극(Z)에 서스테인 바이어스 전압(Vzb)을 공급하였다.
반면에, 도 5에 도시된 본 발명의 일실시예에 따르면, 제 1 서브필드에서는 어드레스 기간에서 서스테인 전극(Z)에 서스테인 바이어스 전압을 생략한다.
즉, 본 발명의 일실시예에서는 종래의 저계조 구현 방식과는 달리, 제 1 서브필드의 어드레스 기간에서는 서스테인 전극(Z)에 인가하는 제 1 서스테인 바이어스 전압(Vzb1)을 0V 또는 그라운드 레벨의 전압을 유지하고, 그외 나머지 서브필드의 어드레스 기간에서는 서스테인 전극(Z)에 원래대로 제 2 서스테인 바이어스 전압(Vzb2)을 인가한다.
한편, 도 5를 살펴보면, 도 4와는 달리 어드레스 기간 이후의 서스테인 기간에서 구동부(110)는 스캔 전극(Y) 및 서스테인 전극(Z)에 모두 서스테인 펄스가 공급되지 않게 한다.
즉, 제 1 서브필드의 어드레스 기간에서는 서스테인 전극(Z)에 인가하는 제 1 서스테인 바이어스 전압(Vzb1)을 0V 또는 그라운드 레벨의 전압을 유지하면서, 동시에 서스테인 전극(Z)에는 서스테인 전압(Vs)을 갖는 서스테인 펄스의 공급을 생략하고, 아울러 스캔 전극(Y)에도 서스테인 펄스의 공급을 생략하는 것이다.
이에 따라, 모든 서브필드에서 한 쌍 이상의 서스테인 펄스를 공급하는 종래에 비해 더 세밀한 계조를 구현할 수 있다.
도 4와 도 5의 경우 전체 최소 광량의 차이는 다음과 같다.
도 4의 경우와 같이 서스테인 전극(Z)에 제 1 서스테인 바이어스 전압(Vzb1)을 공급하는 종래 기술의 경우, 암부 휘도는 0.30 Cd/㎡ 이고, 반계조 광량은 0.18 Cd/㎡로 측정되어, 전체 최소 광량은 0.48Cd/㎡가 된다.
반면에, 도 5의 경우와 같이 서스테인 전극(Z)에 인가하는 제 1 서스테인 바이어스 전압(Vzb1)을 0V 또는 그라운드 전압을 유지함과 동시에 서스테인 전극(Z) 및 스캔 전극(Y)에 서스테인 펄스의 공급을 생략하는 본 발명의 일실시예를 적용할 경우, 암부 휘도는 0.30 Cd/㎡이지만, 반계조 광량은 0.08 Cd/㎡로 측정되어, 전체 최소 광량은 0.38 Cd/㎡가 된다.
따라서, 서스테인 전극(Z)에 인가하는 제 1 서스테인 바이어스 전압(Vzb1)을 0V 또는 그라운드 레벨의 전압을 유지하는 경우는 서스테인 전극(Z)에 제 1 서스테인 바이어스 전압(Vzb1)을 공급하는 경우에 비해 0.1 Cd/㎡ 만큼 차이가 발생한다.
0.1 Cd/㎡ 만큼 광량이 감소함으로써 종래의 저계조 방식에 비해 저계조를 더욱 섬세하게 구현할 수 있다.
도 6을 참조하면, 본 발명의 다른 실시예로서 저계조 서브필드, 즉 제 1 서브필드의 어드레스 기간에서 서스테인 전극(Z)에 공급되는 제 1 서스테인 바이어스 신호(Vzb1)의 전압이 제 1 서브필드 이후의 제 2 서브필드의 어드레스 기간에서 서스테인 전극에 공급되는 제 2 서스테인 바이어스 신호(Vzb2)의 전압보다 낮은 경우도 가능하다.
한편, 이상의 도 5 내지 도 6에서는 저계조 서브필드를 서스테인 기간에 스 캔 전극(Y) 및 서스테인 전극(Z) 모두에 서스테인 펄스(Sus)의 공급을 생략하는 것으로 설정하였지만, 이와는 다르게 서스테인 기간이 포함되지 않도록 저계조 서브필드를 설정하는 것도 가능하다.
이와 같이, 상술한 본 발명의 기술적 구성은 본 발명이 속하는 기술분야의 당업자가 본 발명의 그 기술적 사상이나 필수적 특징을 변경하지 않고서 다른 구체적인 형태로 실시될 수 있다는 것을 이해할 수 있을 것이다.
그러므로 이상에서 기술한 실시예들은 모든 면에서 예시적인 것이며 한정적인 것이 아닌 것으로서 이해되어야 하고, 본 발명의 범위는 전술한 상세한 설명보다는 후술하는 특허청구범위에 의하여 나타내어지며, 특허청구범위의 의미 및 범위 그리고 그 등가개념으로부터 도출되는 모든 변경 또는 변형된 형태가 본 발명의 범위에 포함되는 것으로 해석되어야 한다.
도 1은 본 발명의 플라즈마 디스플레이 장치의 구성을 설명하기 위한 도면.
도 2a 내지 도 2b는 본 발명의 플라즈마 디스플레이 장치에 포함되는 플라즈마 디스플레이 패널의 구조의 일례를 설명하기 위한 도면.
도 3은 본 발명의 플라즈마 디스플레이 장치에서 영상의 계조를 구현하기 위한 프레임(Frame)에 대해 설명하기 위한 도면.
도 4는 종래의 저계조 서브필드를 구현하기 위한 방식의 플라즈마 디스플레이 장치의 구동부의 동작을 설명하기 위한 도면;및
도 5 내지 도 6은 본 발명의 저계조 영상을 구현하기 위한 플라즈마 디스플레이 장치의 구동부의 동작의 일례에 대해 설명하기 위한 도면이다.
<도면의 주요 부분에 대한 부호의 설명>
100 : 플라즈마 디스플레이 패널 110 : 구동부

Claims (5)

  1. 서로 나란한 스캔 전극과 서스테인 전극이 배치되는 플라즈마 디스플레이 패널과 구동부를 포함하고,
    상기 구동부는 복수의 서브필드 중 제 1 서브필드의 어드레스 기간에서 상기 서스테인 전극에 제 1 서스테인 바이어스 신호(Vzb1)를 공급하고, 상기 어드레스 기간 이후의 서스테인 기간에서 상기 스캔 전극 및 상기 서스테인 전극에 서스테인 신호를 공급하지 않거나 서스테인 기간을 생략하고,
    상기 제 1 서브필드 이후의 제 2 서브필드의 어드레스 기간에서 상기 서스테인 전극에 제 2 서스테인 바이어스 신호(Vzb2)를 공급하고, 상기 어드레스 기간 이후의 서스테인 기간에는 상기 스캔 전극 또는 상기 서스테인 전극 중 적어도 하나에 서스테인 신호를 공급하고,
    상기 제 1 서스테인 바이어스 신호의 전압은 상기 제 2 서스테인 바이어스 신호의 전압보다 낮은 플라즈마 디스플레이 장치.
  2. 제 1 항에 있어서,
    상기 제 1 서스테인 바이어스 신호의 전압은 그라운드 레벨의 전압인 플라즈마 디스플레이 장치.
  3. 제 1 항에 있어서,
    상기 제 1 서브필드에서는 상기 서스테인 전극의 전압이 일정하게 유지되는 플라즈마 디스플레이 장치.
  4. 제 1 항에 있어서,
    상기 구동부는 상기 제 1 서브필드의 리셋 기간에서 상기 스캔 전극에 제 1 상승 램프 신호를 공급하고,
    상기 제 1 서브필드 이후의 제 2 서브필드의 리셋 기간에서 상기 스캔 전극에 제 2 상승 램프 신호를 공급하고,
    상기 제 1 상승 램프 신호의 전압 최대치는 상기 제 2 상승 램프 신호의 전압 최대치보다 낮은 플라즈마 디스플레이 장치.
  5. 제 4 항에 있어서,
    상기 제 1 상승 램프 신호의 전압 최대치는 상기 서스테인 신호의 전압과 동일한 플라즈마 디스플레이 장치.
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