KR20080072255A - The method for etching insulating layer of semiconductor devices - Google Patents
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Abstract
Description
도 1은 본 발명의 실시예에 의한 반도체 소자의 절연막을 식각하는 방법을 설명하기 위해서 개략적으로 도시한 단면도이다.1 is a cross-sectional view schematically illustrating a method of etching an insulating film of a semiconductor device according to an embodiment of the present invention.
<도면의 주요 부분에 관한 부호의 설명> <Explanation of symbols on main parts of the drawings>
100: 반도체 기판 200: 절연막100: semiconductor substrate 200: insulating film
300: 콘택홀 400: 마스크300: contact hole 400: mask
본 발명은 반도체 소자의 식각 공정에 관한 것으로, 특히 새로운 가스를 주입하여 형성된 플라즈마를 이용하여 절연막을 건식 식각 하는 방법에 관한 것이다.The present invention relates to an etching process of a semiconductor device, and more particularly to a method of dry etching an insulating film using a plasma formed by injecting a new gas.
고집적 반도체 메모리 소자에서는 높은 종횡비(high aspect ratio)를 갖는 작고 깊은 콘택(small and deep contact)을 형성하는 실리콘 산화막 및 실리콘 질화막 등의 절연막 식각 공정이 요구되고 있다.BACKGROUND ART In an integrated semiconductor memory device, an insulating film etching process such as a silicon oxide film and a silicon nitride film that forms small and deep contacts having a high aspect ratio is required.
절연막의 식각 공정 특히, 절연막을 식각하여 콘택홀을 형성하는 공정에서는 높은 온도로 인하여 마스크 상에 전하 축적이 발생할 수 있다. 이로 인해 콘택홀 내부에 전하 축적이 비대칭이 되어 이온 운동 방향에 영향을 주어 보윙(bowing)현상이 발생할 수 있다.In the etching process of the insulating layer, in particular, in the process of forming the contact hole by etching the insulating layer, charge accumulation may occur on the mask due to the high temperature. As a result, charge accumulation becomes asymmetrical in the contact hole, which affects the direction of ion movement, which may cause bowing.
본 발명이 이루고자 하는 기술적 과제는 보윙 현상을 감소시킬 수 있는 절연막 식각 방법을 제공하는 것이다.The present invention is to provide an insulating film etching method that can reduce the bowing phenomenon.
본 발명이 이루고자 하는 기술적 과제는 이상에서 언급한 과제에 제한되지 않으며, 언급되지 않은 또 다른 과제들은 아래의 기재로부터 당업자에게 명확하게 이해될 수 있을 것이다.The technical problem to be achieved by the present invention is not limited to the above-mentioned problem, and other problems not mentioned will be clearly understood by those skilled in the art from the following description.
상기 기술적 과제들을 달성하기 위한 본 발명의 일 실시예에 따른 반도체 소자의 절연막 식각 방법은 반도체 기판 상에 절연막을 형성하는 단계 및 제논 가스, 아르곤 가스, 플루오로카본계의 가스(CxFy), 하이드로플루오로카본계 가스(CHxFy) 및 산소 가스를 포함하는 가스를 이용하여 상기 절연막을 건식 식각하는 것을 포함한다.According to an embodiment of the present disclosure, an insulating film etching method of a semiconductor device may include forming an insulating film on a semiconductor substrate, a xenon gas, an argon gas, a fluorocarbon gas (CxFy), and a hydrofluoric acid. And dry etching the insulating layer using a gas including a hydrocarbon-based gas (CHxFy) and an oxygen gas.
기타 실시예의 구체적인 사항들은 상세한 설명 및 도면들에 포함되어 있다.Specific details of other embodiments are included in the detailed description and drawings.
본 발명의 이점 및 특징, 그리고 그것들을 달성하는 방법은 첨부되는 도면과 함께 상세하게 후술되어 있는 실시예들을 참조하면 명확해질 것이다. 그러나 본 발명은 이하에서 개시되는 실시예들에 한정되는 것이 아니라 서로 다른 다양한 형태로 구현될 것이며, 단지 본 실시예들은 본 발명의 개시가 완전하도록 하며, 본 발명이 속하는 기술분야에서 통상의 지식을 가진 자에게 발명의 범주를 완전하게 알 려주기 위해 제공되는 것이며, 본 발명은 청구항의 범주에 의해 정의될 뿐이다. Advantages and features of the present invention and methods for achieving them will be apparent with reference to the embodiments described below in detail with the accompanying drawings. However, the present invention is not limited to the embodiments disclosed below, but will be implemented in various forms, and only the present embodiments are intended to complete the disclosure of the present invention, and the general knowledge in the art to which the present invention pertains. It is provided to fully convey the scope of the invention to those skilled in the art, and the present invention is defined only by the scope of the claims.
따라서, 몇몇 실시예에서 잘 알려진 공정 단계들, 잘 알려진 구조 및 잘 알려진 기술들은 본 발명이 모호하게 해석되는 것을 피하기 위하여 구체적으로 설명되지 않는다. Thus, in some embodiments well known process steps, well known structures and well known techniques are not described in detail in order to avoid obscuring the present invention.
본 명세서에서 사용된 용어는 실시예들을 설명하기 위한 것이며 본 발명을 제한하고자 하는 것은 아니다. 본 명세서에서, 단수형은 문구에서 특별히 언급하지 않는한 복수형도 포함한다. 명세서에서 사용되는 포함한다(comprises) 및/또는 포함하는(comprising)은 언급된 구성요소, 단계, 동작 및/또는 소자 이외의 하나 이상의 다른 구성요소, 단계, 동작 및/또는 소자의 존재 또는 추가를 배제하지 않는 의미로 사용한다. 또, 이하 명세서 전체에 걸쳐 동일 참조 부호는 동일 구성 요소를 지칭한다. The terminology used herein is for the purpose of describing particular embodiments only and is not intended to be limiting of the invention. In this specification, the singular also includes the plural unless specifically stated otherwise in the phrase. As used herein, including and / or comprising includes the presence or addition of one or more other components, steps, operations and / or elements other than the components, steps, operations and / or elements mentioned. Use in the sense that does not exclude. In addition, like reference numerals refer to like elements throughout the following specification.
또한, 본 명세서에서 기술하는 실시예들은 본 발명의 이상적인 예시도인 단면도 및/또는 개략도들을 참고하여 설명될 것이다. 따라서, 제조 기술 및/또는 허용 오차 등에 의해 예시도의 형태가 변형될 수 있다. 따라서, 본 발명의 실시예들은 도시된 특정 형태로 제한되는 것이 아니라 제조 공정에 따라 생성되는 형태의 변화도 포함하는 것이다. 또한 본 발명에 도시된 각 도면에 있어서 각 구성 요소들은 설명의 편의를 고려하여 다소 확대 또는 축소되어 도시된 것일 수 있다.In addition, the embodiments described herein will be described with reference to cross-sectional and / or schematic views, which are ideal illustrations of the invention. Accordingly, shapes of the exemplary views may be modified by manufacturing techniques and / or tolerances. Accordingly, the embodiments of the present invention are not limited to the specific forms shown, but also include variations in forms generated by the manufacturing process. In addition, each component in each drawing shown in the present invention may be shown to be somewhat enlarged or reduced in view of the convenience of description.
이하, 첨부된 도면들을 참조하여 본 발명의 일 실시예에 반도체 소자의 절연막 식각 방법에 대하여 설명한다. Hereinafter, an insulating film etching method of a semiconductor device will be described with reference to the accompanying drawings.
도 1은 본 발명의 실시예에 의한 반도체 소자의 절연막을 식각하는 방법을 설명하기 위해서 개략적으로 도시한 단면도이다. 1 is a cross-sectional view schematically illustrating a method of etching an insulating film of a semiconductor device according to an embodiment of the present invention.
구체적으로, 본 발명의 실시예에 의한 반도체 소자의 절연막 식각 방법은 제논 가스, 아르곤 가스, 플루오로카본계의 가스(CxFy), 하이드로플루오로카본계 가스(CHxFy) 및 산소 가스를 포함하는 가스를 이용하여 절연막을 건식 식각하는 것을 포함한다.Specifically, the insulating film etching method of a semiconductor device according to an embodiment of the present invention comprises a gas containing xenon gas, argon gas, fluorocarbon gas (CxFy), hydrofluorocarbon gas (CHxFy) and oxygen gas Dry etching the insulating film by using the same.
절연막(200)은 실리콘 질화물 또는 실리콘 산화물로 이루어질 수 있으나, 이에 제한되지 않음은 물론이다.The
우선, 절연막(200)을 식각하는 데 사용되는 가스 중 CxFy에 대하여 설명한다. 플루오로카본(fluorocarbon: CxFy)계의 가스, 예를 들어 C3F8 가스 또는 C4F8 가스 등과 같은 탄소와 불소의 비가 높은 가스들이 절연막(200)의 건식 식각에 사용될 수 있다. 보다 구체적으로, 30 내지 70sccm(standard cubic centimeter per minute)의 C4F6이 사용될 수 있다.First, CxFy among the gases used to etch the
다음으로, 절연막(200)의 식각에 사용될 수 있는 하이드로플루오로카본(hydrofluorocarbon; CxHyFz)계의 가스들을 설명한다. 하이드로플루오로카본은 절연막(200)의 식각에 첨가되어 식각선택비를 증가시킬 수 있다. 보다 구체적으로, 30 내지 70sccm의 CHF3이 사용될 수 있다.Next, the hydrofluorocarbon (CxHyFz) -based gases that can be used for etching the
또한, 절연막(200)의 식각시 산소 가스 또는 일산화 탄소와 같은 산소를 함유하는 가스가 첨가될 수 있다. 이러한 산소 가스 또는 일산화탄소 가스는 식각 멈춤(etching stopping) 방지 또는 형성되는 콘택홀의 프로파일(profile)을 제어하기 위해서 첨가될 수 있다. 예를 들어, 30 내지 100sccm의 산소 가스를 사용할 수 있다.In addition, during etching of the
절연막(200)을 식각하여 종횡비가 크고 미세한 콘택홀(300)을 형성하는 경우에 있어서, 식각 공정이 진행되는 동안 보윙 현상이 발생할 수 있다. 보윙이란 콘택홀 측벽으로 국부적으로 식각이 더 진행되어 식각 프로파일이 수직(vertical)을 유지하지 않는 것을 말할 수 있다. 보윙은 이후 갭필(gapfill)을 어렵게 만들 수 있다. 식각 공정시 높은 온도로 인하여 마스크(400) 상에 전하가 축적될 수 있고, 이로 인해 콘택홀(300) 내부의 전하의 축적도 비대칭이 될 수 있다. 그 결과 콘택홀(300) 내부에 전기장이 형성될 수 있으며 이는 이온의 운동 방향에 영향을 주어 보윙 현상을 일으킬 수 있다. When the insulating
절연막(200)을 식각시의 사용되는 가스에는 아르곤(Ar) 가스 및 제논(Xe) 가스를 포함한다. 식각 공정에서 불활성 가스를 사용하는 것은 건식 식각시 이온 충돌 효과를 높이기 위한 것이다. 뿐만 아니라, 절연막(200) 식각시 아르곤 가스 및 제논 가스를 함께 사용함으로써, 상기 설명한 보윙현상을 감소시킬 수 있다. 불활성화 가스의 이온화 에너지 또는 전리 에너지는 원자량이 클수록 작아진다. 이온화 에너지가 작은 원자량이 큰 불활성 가스를 사용함으로써 마스크(400) 및 콘택홀(300) 내부의 전하의 축적을 감소시킬 수 있다. 전하의 축적이 감소될 수록, 이온의 운동 방향에 주는 영향이 적어지므로, 보윙 현상을 감소시킬 수 있는 것이다. 불활성 가스로는 헬륨 가스, 네온 가스, 아르곤 가스, 크립톤 가스, 제논 가스 및 라돈 가스 등이 있고 원자량이 커질수록 이온화 에너지 또는 전리 에너지는 작게 되고, 운동성도 작아진다. 따라서, 아르곤 가스보다는 제논 가스의 이온화 에너지 또는 전리 에너지가 작고 아르곤 가스 보다 제논 가스의 운동성이 작다. 불활성 가스인 아르곤(Ar)과 제논(Xe)을 함께 사용함으로써, 아르곤 가스만을 사용하는 경우에 비하여 높은 식각 선택비를 얻을 수 있다. 제논 가스는 이온화 에너지가 낮기 때문에 마스크(400) 및 콘택홀(300) 내부의 전하의 축적을 감소시킬 수 있으므로 이온의 운동 방향에 미치는 영향이 적어지기 때문이다. 그 결과, 절연막(200)의 콘택홀(300)의 측벽으로 발생되는 국부적인 식각인 보윙 현상이 감소될 수 있다. 즉, 식각 프로파일은 더욱 정교해지고, 콘택홀(300)의 프로파일은 수직(vertical)이 될 수 있다.Gas used to etch the
제논 가스 대 아르곤 가스의 유량비는 0.5 내지 2일 수 있으나, 이에 제한되지 않는다. 제논 가스 대 아르곤 가스의 비가 클수록 이온화 에너지는 작아지므로 식각 선택비는 높아지고 프로파일은 더욱 정교해진다. 절연막(200)의 건식 식각은 예를 들어, 300nm 웨이퍼 산화막 식각 금속 콘택 공정에 있어서, 20 내지 50mTorr의 압력하에서 이루어질 수 있다.The flow rate ratio of xenon gas to argon gas may be 0.5 to 2, but is not limited thereto. The larger the ratio of xenon gas to argon gas, the smaller the ionization energy, so the etch selectivity is higher and the profile is more sophisticated. Dry etching of the
이상, 첨부된 도면을 참조하여 본 발명의 실시예를 설명하였지만, 본 발명이 속하는 기술분야에서 통상의 지식을 가진 자는 본 발명이 그 기술적 사상이나 필수적인 특징을 변경하지 않고서 다른 구체적인 형태로 실시될 수 있다는 것을 이해할 수 있을 것이다. 그러므로 이상에서 기술한 실시예에는 모든 면에서 예시적인 것이며 한정적이 아닌 것으로 이해해야만 한다. 또한, 본 발명의 특징이 몇 개의 실시예들중 단지 하나와 관련하여 설명되었지만, 이러한 특징은 다른 실시예들의 하나 이상의 특징들과 결합될 수 있다.Although the embodiments of the present invention have been described above with reference to the accompanying drawings, those skilled in the art to which the present invention belongs may be embodied in other specific forms without changing the technical spirit or essential features of the present invention. You will understand that. Therefore, it should be understood that the embodiments described above are exemplary in all respects and not restrictive. In addition, while a feature of the invention has been described with reference to only one of several embodiments, this feature may be combined with one or more features of other embodiments.
상기한 바와 같이 본 발명은 보윙 현상을 감소시켜 절연막의 식각시 식각 프로파일을 더욱 정교하게 한다.As described above, the present invention reduces the bowing phenomenon to further refine the etching profile during etching of the insulating layer.
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KR1020070010753A KR20080072255A (en) | 2007-02-01 | 2007-02-01 | The method for etching insulating layer of semiconductor devices |
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US11581326B2 (en) | 2019-11-28 | 2023-02-14 | Samsung Electronics Co., Ltd. | Three-dimensional semiconductor memory device |
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2007
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