KR20060070348A - Liquid crystal display - Google Patents

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이정호
송영구
최상건
홍권삼
이계헌
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삼성전자주식회사
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Abstract

본 발명은 액정 표시 장치에 관한 것이다.The present invention relates to a liquid crystal display device.

기판, 상기 기판 위에 형성되어 있는 공통 전압 전달 배선, 상기 공통 전압 전달 배선 위에 형성되어 있는 절연막, 상기 절연막에 형성되어 있으며 상기 공통 전압 전달 배선을 드러내는 접촉 구멍, 상기 절연막 위에 형성되어 있으며 상기 접촉 구멍을 통하여 상기 공통 전압 전달 부재와 연결되는 연결 부재, 그리고 상기 연결 부재 위에 형성되어 있는 단락 부재를 포함한다.A substrate, a common voltage transfer wiring formed on the substrate, an insulating film formed on the common voltage transfer wiring, a contact hole formed in the insulating film and exposing the common voltage transfer wiring, a contact hole formed on the insulating film, And a connection member connected to the common voltage transmission member through the connection member, and a shorting member formed on the connection member.

이러한 방식으로, 밀봉선의 안쪽에 접촉 구멍을 형성하고 보호막 위에 단락점을 형성하며 연결 부재를 통하여 단락점으로 공통 전압을 전달한다. 따라서, 보호막 아래의 배선이 드러나지 않으므로 습기 등에 의한 부식을 예방할 수 있다.In this way, a contact hole is formed inside the sealing line, a short point is formed on the protective film, and a common voltage is transmitted to the short point through the connecting member. Therefore, since the wiring under the protective film is not exposed, corrosion by moisture or the like can be prevented.

액정표시장치, 단락부재, 보호막, 밀봉선, 접촉구멍, 절개부LCD, short circuit member, protective film, sealing line, contact hole, cutout

Description

액정 표시 장치 {LIQUID CRYSTAL DISPLAY}Liquid crystal display {LIQUID CRYSTAL DISPLAY}

도 1은 본 발명의 한 실시예에 따른 액정 표시 장치의 블록도이다.1 is a block diagram of a liquid crystal display according to an exemplary embodiment of the present invention.

도 2는 본 발명의 한 실시예에 따른 액정 표시 장치의 한 화소에 대한 등가 회로도이다.2 is an equivalent circuit diagram of one pixel of a liquid crystal display according to an exemplary embodiment of the present invention.

도 3은 본 발명의 한 실시예에 따른 액정 표시 장치의 개략도이다.3 is a schematic diagram of a liquid crystal display according to an exemplary embodiment of the present invention.

도 4는 도 3에 도시한 액정 표시 장치의 일부를 확대하여 나타낸 도면이다.FIG. 4 is an enlarged view of a portion of the liquid crystal display shown in FIG. 3.

도 5는 도 4에 도시한 액정 표시 장치를 V-V' 선을 따라 잘라 도시한 단면도이다.FIG. 5 is a cross-sectional view of the liquid crystal display of FIG. 4 taken along the line VV ′. FIG.

본 발명은 액정 표시 장치에 관한 것이다.The present invention relates to a liquid crystal display device.

일반적인 액정 표시 장치(liquid crystal display, LCD)는 화소 전극 및 공통 전극이 구비된 두 표시판과 그 사이에 들어 있는 유전율 이방성(dielectric anisotropy)을 갖는 액정층을 포함한다. 화소 전극은 행렬의 형태로 배열되어 있고 박막 트랜지스터(TFT) 등 스위칭 소자에 연결되어 한 행씩 차례로 데이터 전압을 인가 받는다. 공통 전극은 표시판의 전면에 걸쳐 형성되어 있으며 공통 전압을 인가 받는다. 화소 전극과 공통 전극 및 그 사이의 액정층은 회로적으로 볼 때 액정 축전기를 이루며, 액정 축전기는 이에 연결된 스위칭 소자와 함께 화소를 이루는 기본 단위가 된다.A typical liquid crystal display (LCD) includes two display panels provided with pixel electrodes and a common electrode, and a liquid crystal layer having dielectric anisotropy interposed therebetween. The pixel electrodes are arranged in a matrix and connected to switching elements such as thin film transistors (TFTs) to receive data voltages one by one in sequence. The common electrode is formed over the entire surface of the display panel and receives a common voltage. The pixel electrode, the common electrode, and the liquid crystal layer therebetween form a liquid crystal capacitor, and the liquid crystal capacitor becomes a basic unit that forms a pixel together with a switching element connected thereto.

이러한 액정 표시 장치에서는 두 전극에 전압을 인가하여 액정층에 전계를 생성하고, 이 전계의 세기를 조절하여 액정층을 통과하는 빛의 투과율을 조절함으로써 원하는 화상을 얻는다. 이때, 액정층에 한 방향의 전계가 오랫동안 인가됨으로써 발생하는 열화 현상을 방지하기 위하여 프레임별로, 행별로, 또는 화소별로 공통 전압에 대한 데이터 전압의 극성을 반전시킨다.In such a liquid crystal display, a voltage is applied to two electrodes to generate an electric field in the liquid crystal layer, and the intensity of the electric field is adjusted to adjust the transmittance of light passing through the liquid crystal layer to obtain a desired image. In this case, in order to prevent degradation caused by an electric field applied to the liquid crystal layer for a long time, the polarity of the data voltage with respect to the common voltage is inverted frame by frame, row by pixel, or pixel by pixel.

이러한 공통 전압이 인가되는 공통 전압은 두 표시판 중 주로 상부 표시판에 마련되고, 단락점(short point)을 통하여 하부 표시판으로부터 공통 전압을 인가받는다. 이러한 단락점의 재료로서 은 페이스트(silver paste)를 사용하거나 탄성체인 볼 간격재(ball spacer)에 금이나 니켈과 같은 도전성 금속을 코팅한 재료를 사용한다.The common voltage to which the common voltage is applied is mainly provided on the upper panel of the two display panels, and the common voltage is applied from the lower panel through a short point. As a material of such a short point, a silver paste is used or a material coated with a conductive metal such as gold or nickel on an elastic ball spacer is used.

또한, 밀봉재(sealant)를 가장자리를 따라 도포하여 상부 표시판과 하부 표시판을 결합시키는데, 밀봉재의 재료로는 에폭시 수지 또는 자외선 경화선 수지를 사용하며, 이 밀봉재와 함께 유리 섬유(glass fiber)등을 사용하여 두 표시판의 간격을 유지한다.In addition, a sealant is applied along the edge to bond the upper display panel and the lower display panel. An epoxy resin or an ultraviolet curable resin is used as the sealing material, and a glass fiber is used together with the sealing material. To keep the distance between the two display panels.

그런데, 단락점은 밀봉선(seal line) 바깥쪽에 위치하여 습기 등에 취약하고 더욱이 보호막을 절개하여 형성하므로 단락점 부근이 부식될 위험성이 있다. However, since the short point is located outside the seal line and is vulnerable to moisture, and is formed by cutting the protective film, there is a risk that the short point is corroded.                         

따라서, 본 발명이 이루고자 하는 기술적 과제는 종래 기술의 이러한 문제점을 해결할 수 있는 액정 표시 장치를 제공하는 것이다.Therefore, the technical problem to be achieved by the present invention is to provide a liquid crystal display device that can solve such problems of the prior art.

이러한 기술적 과제를 이루기 위한 본 발명의 한 실시예에 따른 액정 표시 장치는, 기판, 상기 기판 위에 형성되어 있는 공통 전압 전달 배선, 상기 공통 전압 전달 배선 위에 형성되어 있는 절연막, 상기 절연막에 형성되어 있으며 상기 공통 전압 전달 배선을 드러내는 접촉 구멍, 상기 절연막 위에 형성되어 있으며 상기 접촉 구멍을 통하여 상기 공통 전압 전달 부재와 연결되는 연결 부재, 그리고 상기 연결 부재 위에 형성되어 있는 단락 부재를 포함한다.According to an exemplary embodiment of the present invention, a liquid crystal display device includes a substrate, a common voltage transfer wiring formed on the substrate, an insulating film formed on the common voltage transfer wiring, and an insulating film. And a contact hole exposing a common voltage transfer wiring, a connection member formed on the insulating layer and connected to the common voltage transfer member through the contact hole, and a short circuit member formed on the connection member.

이때, 상기 공통 전압 전달 배선은 상기 단락점을 향하여 뻗은 돌출부를 포함하는 것이 바람직하며, 상기 돌출부와 교차하여 뻗어 있는 밀봉선을 더 포함하는 것이 바람직하다.In this case, the common voltage transmission line preferably includes a protrusion extending toward the shorting point, and preferably further includes a sealing line extending to cross the protrusion.

또한, 상기 단락 부재는 상기 밀봉선과 일부가 중첩하고 일부는 노출되어 있을 수 있다.In addition, the shorting member may partially overlap with the sealing line and may be partially exposed.

한편, 상기 연결 부재는 적어도 하나의 절개부를 갖는 것이 바람직하며, 상기 접촉 구멍과 상기 단락 부재는 상기 밀봉선을 사이에 두고 형성되어 있는 것이 바람직하다.On the other hand, it is preferable that the said connection member has at least 1 cut | disconnected part, It is preferable that the said contact hole and the said short circuit member are formed through the said sealing line.

여기서, 상기 연결 부재는 ITO 또는 IZO로 이루어질 수 있다.Here, the connecting member may be made of ITO or IZO.

첨부한 도면을 참고로 하여 본 발명의 실시예에 대하여 본 발명이 속하는 기술 분야에서 통상의 지식을 가진 자가 용이하게 실시할 수 있도록 상세히 설명한 다. DETAILED DESCRIPTION Embodiments of the present invention will be described in detail with reference to the accompanying drawings so that those skilled in the art may easily practice the present invention.

도면에서 여러 층 및 영역을 명확하게 표현하기 위하여 두께를 확대하여 나타내었다. 명세서 전체를 통하여 유사한 부분에 대해서는 동일한 도면 부호를 붙였다. 층, 막, 영역, 판 등의 부분이 다른 부분 "위에" 있다고 할 때, 이는 다른 부분 "바로 위에" 있는 경우뿐 아니라 그 중간에 또다른 부분이 있는 경우도 포함한다. 반대로 어떤 부분이 다른 부분 "바로 위에" 있다고 할 때에는 중간에 다른 부분이 없는 것을 뜻한다.In the drawings, the thickness of layers, films, panels, regions, etc., are exaggerated for clarity. Like parts are designated by like reference numerals throughout the specification. When a portion of a layer, film, region, plate, etc. is said to be "on top" of another part, this includes not only when the other part is "right on" but also another part in the middle. On the contrary, when a part is "just above" another part, there is no other part in the middle.

이제 본 발명의 실시예에 따른 액정 표시 장치에 대하여 도면을 참고로 하여 상세하게 설명한다.A liquid crystal display according to an exemplary embodiment of the present invention will now be described in detail with reference to the accompanying drawings.

도 1은 본 발명의 한 실시예에 따른 액정 표시 장치의 블록도이고, 도 2는 본 발명의 한 실시예에 따른 액정 표시 장치의 한 화소에 대한 등가 회로도이다. 도 3은 본 발명의 한 실시예에 따른 액정 표시 장치의 개략도이고, 도 4는 도 3에 도시한 액정 표시 장치를 일부 확대한 도면이다.1 is a block diagram of a liquid crystal display according to an exemplary embodiment of the present invention, and FIG. 2 is an equivalent circuit diagram of one pixel of the liquid crystal display according to an exemplary embodiment of the present invention. 3 is a schematic diagram of a liquid crystal display according to an exemplary embodiment of the present invention, and FIG. 4 is an enlarged view of a portion of the liquid crystal display shown in FIG. 3.

도 1에 도시한 바와 같이, 본 발명의 한 실시예에 따른 액정 표시 장치는 액정 표시판 조립체(liquid crystal panel assembly)(300)와 이에 연결된 게이트 구동부(400) 및 데이터 구동부(500), 데이터 구동부(500)에 연결된 계조 전압 생성부(800) 그리고 이들을 제어하는 신호 제어부(600)를 포함한다.As shown in FIG. 1, a liquid crystal display according to an exemplary embodiment of the present invention includes a liquid crystal panel assembly 300, a gate driver 400, a data driver 500, and a data driver 500 connected thereto. The gray voltage generator 800 connected to the signal generator 500 and a signal controller 600 for controlling the gray voltage generator 800 are included.

액정 표시판 조립체(300)는 등가 회로로 볼 때 복수의 표시 신호선(G1-Gn, D1-Dm)과 이에 연결되어 있으며 대략 행렬의 형태로 배열된 복수의 화소(pixel)를 포함한다.The liquid crystal panel assembly 300 includes a plurality of display signal lines G 1 -G n , D 1 -D m and a plurality of pixels connected to the plurality of display signal lines G 1 -G n , D 1 -D m , and arranged in a substantially matrix form. .

표시 신호선(G1-Gn, D1-Dm)은 게이트 신호("주사 신호"라고도 함)를 전달하는 복수의 게이트선(G1-Gn)과 데이터 신호를 전달하는 데이터선(D1-Dm )을 포함한다. 게이트선(G1-Gn)은 대략 행 방향으로 뻗어 있으며 서로가 거의 평행하고 데이터선(D 1-Dm)은 대략 열 방향으로 뻗어 있으며 서로가 거의 평행하다.The display signal lines G 1 -G n and D 1 -D m are a plurality of gate lines G 1 -G n for transmitting a gate signal (also called a “scan signal”) and a data line D for transmitting a data signal. 1 -D m ). The gate lines G 1 -G n extend substantially in the row direction and are substantially parallel to each other, and the data lines D 1 -D m extend substantially in the column direction and are substantially parallel to each other.

각 화소는 표시 신호선(G1-Gn, D1-Dm)에 연결된 스위칭 소자(Q)와 이에 연결된 액정 축전기(liquid crystal capacitor)(CLC) 및 유지 축전기(storage capacitor)(CST)를 포함한다. 유지 축전기(CST)는 필요에 따라 생략할 수 있다.Each pixel includes a switching element Q connected to a display signal line G 1 -G n , D 1 -D m , and a liquid crystal capacitor C LC and a storage capacitor C ST connected thereto. It includes. The holding capacitor C ST can be omitted as necessary.

박막 트랜지스터 등 스위칭 소자(Q)는 하부 표시판(100)에 구비되어 있으며, 삼단자 소자로서 그 제어 단자 및 입력 단자는 각각 게이트선(G1-Gn) 및 데이터선(D1-Dm)에 연결되어 있으며, 출력 단자는 액정 축전기(CLC) 및 유지 축전기(C ST)에 연결되어 있다.The switching element Q, such as a thin film transistor, is provided in the lower panel 100, and the control terminal and the input terminal are three-terminal elements, respectively, with gate lines G 1 -G n and data lines D 1 -D m . The output terminal is connected to a liquid crystal capacitor (C LC ) and a holding capacitor (C ST ).

액정 축전기(CLC)는 하부 표시판(100)의 화소 전극(190)과 상부 표시판(200)의 공통 전극(270)을 두 단자로 하며 두 전극(190, 270) 사이의 액정층(3)은 유전체로서 기능한다. 화소 전극(190)은 스위칭 소자(Q)에 연결되며 공통 전극(270)은 상부 표시판(200)의 전면에 형성되어 있고 공통 전압(Vcom)을 인가받는다. 도 2에서와는 달리 공통 전극(270)이 하부 표시판(100)에 구비되는 경우도 있으며 이때에 는 두 전극(190, 270) 중 적어도 하나가 선형 또는 막대형으로 만들어질 수 있다.The liquid crystal capacitor C LC has two terminals, the pixel electrode 190 of the lower panel 100 and the common electrode 270 of the upper panel 200, and the liquid crystal layer 3 between the two electrodes 190 and 270. It functions as a dielectric. The pixel electrode 190 is connected to the switching element Q, and the common electrode 270 is formed on the front surface of the upper panel 200 and receives a common voltage V com . Unlike in FIG. 2, the common electrode 270 may be provided in the lower panel 100. In this case, at least one of the two electrodes 190 and 270 may be formed in a linear or bar shape.

액정 축전기(CLC)의 보조적인 역할을 하는 유지 축전기(CST)는 하부 표시판(100)에 구비된 별개의 신호선(도시하지 않음)과 화소 전극(190)이 절연체를 사이에 두고 중첩되어 이루어지며 이 별개의 신호선에는 공통 전압(Vcom) 따위의 정해진 전압이 인가된다. 그러나 유지 축전기(CST)는 화소 전극(190)이 절연체를 매개로 바로 위의 전단 게이트선과 중첩되어 이루어질 수 있다.The storage capacitor C ST , which serves as an auxiliary part of the liquid crystal capacitor C LC , is formed by overlapping a separate signal line (not shown) and the pixel electrode 190 provided on the lower panel 100 with an insulator interposed therebetween. A predetermined voltage such as the common voltage V com is applied to this separate signal line. However, the storage capacitor C ST may be formed such that the pixel electrode 190 overlaps the front end gate line directly above the insulator.

한편, 색 표시를 구현하기 위해서는 각 화소가 삼원색 중 하나를 고유하게 표시하거나(공간 분할) 각 화소가 시간에 따라 번갈아 삼원색을 표시하게(시간 분할) 하여 이들 삼원색의 공간적, 시간적 합으로 원하는 색상이 인식되도록 한다. 도 2는 공간 분할의 한 예로서 각 화소가 화소 전극(190)에 대응하는 영역에 적색, 녹색, 또는 청색의 색 필터(230)를 구비함을 보여주고 있다. 도 2와는 달리 색 필터(230)는 하부 표시판(100)의 화소 전극(190) 위 또는 아래에 형성할 수도 있다.On the other hand, to implement color display, each pixel uniquely displays one of the three primary colors (spatial division) or each pixel alternately displays the three primary colors over time (time division) so that the desired color can be selected by the spatial and temporal sum of these three primary colors. To be recognized. 2 shows that each pixel includes a red, green, or blue color filter 230 in a region corresponding to the pixel electrode 190 as an example of spatial division. Unlike FIG. 2, the color filter 230 may be formed above or below the pixel electrode 190 of the lower panel 100.

액정 표시판 조립체(300)의 두 표시판(100, 200) 중 적어도 하나의 바깥 면에는 빛을 편광시키는 편광자(도시하지 않음)가 부착되어 있다.A polarizer (not shown) for polarizing light is attached to an outer surface of at least one of the two display panels 100 and 200 of the liquid crystal panel assembly 300.

한편, 도 3을 참조하면, 하부 표시판(100)의 가장자리를 따라 밀봉선(SL)이 형성되어 있고, 안쪽에는 공통 전압(Vcom)을 전달하는 공통 전압 전달선(231, 232)이 배치되어 있으며, 공통 전압 전달선(231, 232)에는 단락점(SP)이 연결되어 있다.Meanwhile, referring to FIG. 3, a sealing line SL is formed along an edge of the lower panel 100, and common voltage transmission lines 231 and 232 are disposed inside the common line Vcom. The short point SP is connected to the common voltage transmission lines 231 and 232.

공통 전압 전달선(231, 232)은 공통 전압 생성부(도시하지 않음)로부터의 크 기가 같거나 동일한 공통 전압(Vcom)을 단락점(SP)을 통하여 상부 표시판(200)에 위치한 공통 전극(270)으로 전달한다.The common voltage transmission lines 231 and 232 have a common voltage Vcom having the same or the same magnitude from the common voltage generator (not shown) on the upper panel 200 through the short point SP. To pass).

도 4 및 도 5에 도시한 것처럼, 기판(110) 위에 공통 전압 전달선(232)이 형성되어 있다.As shown in FIGS. 4 and 5, a common voltage transmission line 232 is formed on the substrate 110.

공통 전압 전달선(232, 231)은 가로 또는 세로 방향으로 주로 뻗어 있고 단락점(SP)을 향하여 일부가 확장된 돌출부(242)를 갖는다. The common voltage transmission lines 232 and 231 have protrusions 242 extending mainly in the horizontal or vertical direction and partially extending toward the short point SP.

밀봉선(SL)은 아래 부분에 위치한 게이트선(G1-Gn) 및 데이터선(D1-Dm ) 등의 표시 신호선과의 교차 부분에서 단차가 형성되는데, 돌출부(242)는 밀봉선(SL)이 전체적으로 일정한 단차를 갖도록 한다.The sealing line SL is formed at the intersection of display signal lines, such as the gate line G 1 -G n and the data line D 1 -D m , which are located below, and the protrusion 242 is a sealing line. Make sure that SL has a constant step as a whole.

또한, 공통 전압 전달선(232) 위에는 게이트 절연막(140)이 형성되어 있다.In addition, a gate insulating layer 140 is formed on the common voltage transmission line 232.

게이트 절연막(140) 위에는 보호막(180)이 형성되어 있고, 보호막(180)에는 복수의 접촉 구멍(182)이 형성되어 있다.A passivation layer 180 is formed on the gate insulating layer 140, and a plurality of contact holes 182 are formed in the passivation layer 180.

보호막(180) 위에는 투명 도전체, 예를 들어 ITO(indium tin oxide) 또는 IZO(indium zinc oxide)로 이루어진 연결 부재(80)가 형성되어 있다.The connection member 80 made of a transparent conductor, for example, indium tin oxide (ITO) or indium zinc oxide (IZO), is formed on the passivation layer 180.

연결 부재(80)는 복수의 접촉 구멍(180)을 통하여 단락점(SP)과 연결되어 있으며, 직사각형의 절개부(81)를 갖는다. 이러한 절개부(81)는 밀봉선(SL)과 연결 부재(80)와의 접착성을 강화하며 하나 이상 형성될 수 있다.The connecting member 80 is connected to the shorting point SP through the plurality of contact holes 180 and has a rectangular cutout 81. The cutout 81 may enhance the adhesion between the sealing line SL and the connection member 80 and may be formed at least one.

연결 부재(80) 위에는 가로 방향으로 뻗은 밀봉선(SL)이 교차하고 있다. 또한, 연결 부재(80) 위에는 밀봉선(SL)과 일부가 중첩하고 일부가 노출된 단락점 (SP)이 형성되어 있다. The sealing line SL extending in the horizontal direction intersects on the connecting member 80. In addition, a shorting point SP is formed on the connecting member 80 in which a portion overlaps the sealing line SL and a portion is exposed.

이렇게 하면, 단락점(SP)이 밀봉선(SL) 바깥에 위치하더라도 보호막(180) 위에 위치하므로 보호막 아래의 공통 전압 전달선(242)이 드러나지 않아 습기 등에 의한 부식을 예방할 수 있다.In this case, even if the short point SP is located outside the sealing line SL, the common voltage transmission line 242 under the protection layer is not exposed because the short point SP is located outside the sealing line SL, thereby preventing corrosion due to moisture.

다시 도 1을 참조하면, 계조 전압 생성부(800)는 화소의 투과율과 관련된 두 벌의 복수 계조 전압을 생성한다. 두 벌 중 한 벌은 공통 전압(Vcom)에 대하여 양의 값을 가지고 다른 한 벌은 음의 값을 가진다.Referring back to FIG. 1, the gray voltage generator 800 generates two sets of gray voltages related to transmittance of a pixel. One of the two sets has a positive value for the common voltage (V com ) and the other set has a negative value.

게이트 구동부(400)는 액정 표시판 조립체(300)의 게이트선(G1-Gn)에 연결되어 외부로부터의 게이트 온 전압(Von)과 게이트 오프 전압(Voff)의 조합으로 이루어진 게이트 신호를 게이트선(G1-Gn)에 인가하며 통상 복수의 집적 회로로 이루어진다.The gate driver 400 is connected to the gate lines G 1 -G n of the liquid crystal panel assembly 300 to receive a gate signal formed by a combination of a gate on voltage V on and a gate off voltage V off from the outside. It is applied to the gate lines G 1 -G n and usually consists of a plurality of integrated circuits.

데이터 구동부(500)는 액정 표시판 조립체(300)의 데이터선(D1-Dm)에 연결되어 계조 전압 생성부(800)로부터의 계조 전압을 선택하여 데이터 신호로서 화소에 인가하며 통상 복수의 집적 회로로 이루어진다.The data driver 500 is connected to the data lines D 1 -D m of the liquid crystal panel assembly 300 to select the gray voltage from the gray voltage generator 800 and apply the gray voltage to the pixel as a data signal. It consists of a circuit.

복수의 게이트 구동 집적 회로 또는 데이터 구동 집적 회로는 칩의 형태로 TCP(tape carrier package)(도시하지 않음)에 실장하여 TCP를 액정 표시판 조립체(300)에 부착할 수도 있고, TCP를 사용하지 않고 유리 기판 위에 이들 집적 회로 칩을 직접 부착할 수도 있으며(chip on glass, COG 실장 방식), 이들 집적 회로 칩 과 같은 기능을 수행하는 회로를 액정 표시판 조립체(300)에 직접 형성할 수도 있다.The plurality of gate driving integrated circuits or data driving integrated circuits may be mounted in a tape carrier package (TCP) (not shown) in the form of a chip to attach the TCP to the liquid crystal panel assembly 300, and may be advantageous without using TCP. These integrated circuit chips may be directly attached onto a substrate (chip on glass, COG mounting method), and a circuit performing the same function as those integrated circuit chips may be directly formed on the liquid crystal panel assembly 300.

신호 제어부(600)는 게이트 구동부(400) 및 데이터 구동부(500) 등의 동작을 제어한다.The signal controller 600 controls operations of the gate driver 400 and the data driver 500.

그러면 이러한 액정 표시 장치의 표시 동작에 대하여 상세하게 설명한다.The display operation of such a liquid crystal display device will now be described in detail.

신호 제어부(600)는 외부의 그래픽 제어기(도시하지 않음)로부터 입력 영상 신호(R, G, B) 및 이의 표시를 제어하는 입력 제어 신호, 예를 들면 수직 동기 신호(Vsync)와 수평 동기 신호(Hsync), 메인 클록(MCLK), 데이터 인에이블 신호(DE) 등을 제공받는다. 신호 제어부(600)는 입력 영상 신호(R, G, B)와 입력 제어 신호를 기초로 영상 신호(R, G, B)를 액정 표시판 조립체(300)의 동작 조건에 맞게 적절히 처리하고 게이트 제어 신호(CONT1) 및 데이터 제어 신호(CONT2) 등을 생성한 후, 게이트 제어 신호(CONT1)를 게이트 구동부(400)로 내보내고 데이터 제어 신호(CONT2)와 처리한 영상 신호(DAT)는 데이터 구동부(500)로 내보낸다.The signal controller 600 may control the input image signals R, G, and B and their display from an external graphic controller (not shown), for example, a vertical sync signal V sync and a horizontal sync signal. (H sync ), a main clock (MCLK), a data enable signal (DE) is provided. The signal controller 600 properly processes the image signals R, G, and B according to the operating conditions of the liquid crystal panel assembly 300 based on the input image signals R, G, and B and the input control signal, and controls the gate control signal. After generating the CONT1 and the data control signal CONT2, the gate control signal CONT1 is sent to the gate driver 400, and the data control signal CONT2 and the processed image signal DAT are transmitted to the data driver 500. Export to

게이트 제어 신호(CONT1)는 게이트 온 전압(Von)의 출력 시작을 지시하는 수직 동기 시작 신호(STV), 게이트 온 전압(Von)의 출력 시기를 제어하는 게이트 클록 신호(CPV) 및 게이트 온 전압(Von)의 지속 시간을 한정하는 출력 인에이블 신호(OE) 등을 포함한다.The gate control signal (CONT1) includes a gate-on voltage vertical synchronization start signal (STV) for instructing the start of output of the (V on), the gate-on voltage gated clock signal that controls the output timing of the (V on) (CPV) and the gate-on An output enable signal OE or the like that defines the duration of the voltage V on .

데이터 제어 신호(CONT2)는 영상 데이터(DAT)의 입력 시작을 알리는 수평 동 기 시작 신호(STH)와 데이터선(D1-Dm)에 해당 데이터 전압을 인가하라는 로드 신호(LOAD), 공통 전압(Vcom)에 대한 데이터 전압의 극성(이하 "공통 전압에 대한 데이터 전압의 극성"을 줄여 "데이터 전압의 극성"이라 함)을 반전시키는 반전 신호(RVS) 및 데이터 클록 신호(HCLK) 등을 포함한다.The data control signal CONT2 is a horizontal synchronous start signal STH indicating the start of input of the image data DAT, a load signal LOAD for applying a corresponding data voltage to the data lines D 1 -D m , and a common voltage. The inversion signal RVS and the data clock signal HCLK for inverting the polarity of the data voltage with respect to (V com ) (hereinafter referred to as the "polarity of the data voltage by reducing the polarity of the data voltage with respect to the common voltage"). Include.

데이터 구동부(500)는 신호 제어부(600)로부터의 데이터 제어 신호(CONT2)에 따라 한 행의 화소에 대한 영상 데이터(DAT)를 차례로 입력받아 시프트시키고, 계조 전압 생성부(800)로부터의 계조 전압 중 각 영상 데이터(DAT)에 대응하는 계조 전압을 선택함으로써 영상 데이터(DAT)를 해당 데이터 전압으로 변환한 후, 이를 해당 데이터선(D1-Dm)에 인가한다.The data driver 500 sequentially receives and shifts the image data DAT for one row of pixels according to the data control signal CONT2 from the signal controller 600, and the gray voltage from the gray voltage generator 800. The grayscale voltage corresponding to each image data DAT is selected to convert the image data DAT into a corresponding data voltage, and then apply the grayscale voltage to the corresponding data lines D 1 -D m .

게이트 구동부(400)는 신호 제어부(600)로부터의 게이트 제어 신호(CONT1)에 따라 게이트 온 전압(Von)을 게이트선(G1-Gn)에 인가하여 이 게이트선(G 1-Gn)에 연결된 스위칭 소자(Q)를 턴온시키며, 이에 따라 데이터선(D1-Dm)에 인가된 데이터 전압이 턴온된 스위칭 소자(Q)를 통하여 해당 화소에 인가된다. The gate driver 400 applies the gate-on voltage V on to the gate lines G 1 -G n in response to the gate control signal CONT1 from the signal controller 600, thereby applying the gate lines G 1 -G n. ) Turns on the switching element Q connected thereto, so that the data voltage applied to the data lines D 1 -D m is applied to the corresponding pixel through the turned-on switching element Q.

화소에 인가된 데이터 전압과 공통 전압(Vcom)의 차이는 액정 축전기(CLC)의 충전 전압, 즉 화소 전압으로서 나타난다. 액정 분자들은 화소 전압의 크기에 따라 그 배열을 달리하며, 이에 따라 액정층(3)을 통과하는 빛의 편광이 변화한다. 이러한 편광의 변화는 표시판(100, 200)에 부착된 편광자(도시하지 않음)에 의하여 빛의 투과율 변화로 나타난다. The difference between the data voltage applied to the pixel and the common voltage V com is shown as the charging voltage of the liquid crystal capacitor C LC , that is, the pixel voltage. The arrangement of the liquid crystal molecules varies according to the magnitude of the pixel voltage, thereby changing the polarization of light passing through the liquid crystal layer 3. The change in polarization is represented by a change in transmittance of light by a polarizer (not shown) attached to the display panels 100 and 200.

1 수평 주기(또는 "1H")[수평 동기 신호(Hsync), 데이터 인에이블 신호(DE), 게이트 클록(CPV)의 한 주기]가 지나면 데이터 구동부(500)와 게이트 구동부(400)는 다음 행의 화소에 대하여 동일한 동작을 반복한다. 이러한 방식으로, 한 프레임(frame) 동안 모든 게이트선(G1-Gn)에 대하여 차례로 게이트 온 전압(Von)을 인가하여 모든 화소에 데이터 전압을 인가한다. 한 프레임이 끝나면 다음 프레임이 시작되고 각 화소에 인가되는 데이터 전압의 극성이 이전 프레임에서의 극성과 반대가 되도록 데이터 구동부(500)에 인가되는 반전 신호(RVS)의 상태가 제어된다("프레임 반전"). 이때, 한 프레임 내에서도 반전 신호(RVS)의 특성에 따라 한 데이터선을 통하여 흐르는 데이터 전압의 극성이 바뀌거나(보기: "행 반전", "점 반전"), 한 화소행에 인가되는 데이터 전압의 극성도 서로 다를 수 있다(보기: "열 반전", "점 반전").After one horizontal period (or “1H”) (one period of the horizontal sync signal H sync , the data enable signal DE, and the gate clock CPV), the data driver 500 and the gate driver 400 are next. The same operation is repeated for the pixels in the row. In this manner, the gate-on voltages V on are sequentially applied to all the gate lines G 1 -G n during one frame to apply data voltages to all the pixels. At the end of one frame, the next frame starts and the state of the inversion signal RVS applied to the data driver 500 is controlled so that the polarity of the data voltage applied to each pixel is opposite to that of the previous frame ("frame inversion). "). At this time, the polarity of the data voltage flowing through one data line is changed according to the characteristics of the inversion signal RVS even in one frame (eg, "row inversion", "point inversion"), or the voltage of the data voltage applied to one pixel row. The polarities can also be different (eg "heat inversion", "point inversion").

앞서 설명한 바와 같이, 밀봉선(SL)의 안쪽에 접촉 구멍(182)을 형성하고 보호막(180) 위에 단락점(SP)을 형성하며 연결 부재(80)를 통하여 단락점(SP)으로 공통 전압(Vcom)을 전달한다. 따라서, 보호막(180) 아래의 배선이 드러나지 않으므로 습기 등에 의한 부식을 예방할 수 있다.As described above, a contact hole 182 is formed inside the sealing line SL, a short point SP is formed on the passivation layer 180, and a common voltage (V) is formed as a short point SP through the connection member 80. Vcom). Therefore, since the wiring under the protective layer 180 is not exposed, corrosion due to moisture or the like can be prevented.

이상에서 본 발명의 바람직한 실시예에 대하여 상세하게 설명하였지만 본 발명의 권리범위는 이에 한정되는 것은 아니고 다음의 청구범위에서 정의하고 있는 본 발명의 기본 개념을 이용한 당업자의 여러 변형 및 개량 형태 또한 본 발명의 권리범위에 속하는 것이다.
Although the preferred embodiments of the present invention have been described in detail above, the scope of the present invention is not limited thereto, and various modifications and improvements of those skilled in the art using the basic concepts of the present invention defined in the following claims are also provided. It belongs to the scope of right.

Claims (7)

기판, Board, 상기 기판 위에 형성되어 있는 공통 전압 전달 배선, A common voltage transfer wiring formed on the substrate; 상기 공통 전압 전달 배선 위에 형성되어 있는 절연막, An insulating film formed on the common voltage transfer wiring, 상기 절연막에 형성되어 있으며 상기 공통 전압 전달 배선을 드러내는 접촉 구멍, A contact hole formed in the insulating film and exposing the common voltage transfer wiring; 상기 절연막 위에 형성되어 있으며 상기 접촉 구멍을 통하여 상기 공통 전압 전달 부재와 연결되는 연결 부재, 그리고A connection member formed on the insulating layer and connected to the common voltage transmission member through the contact hole; and 상기 연결 부재 위에 형성되어 있는 단락 부재Shorting member formed on the connecting member 를 포함하는 액정 표시 장치. Liquid crystal display comprising a. 제1항에서,In claim 1, 상기 공통 전압 전달 배선은 상기 단락점을 향하여 뻗은 돌출부를 포함하는 액정 표시 장치.The common voltage transmission line includes a protrusion extending toward the short point. 제2항에서,In claim 2, 상기 돌출부와 교차하여 뻗어 있는 밀봉선을 더 포함하는 액정 표시 장치.And a sealing line extending to intersect the protrusion. 제3항에서,In claim 3, 상기 단락 부재는 상기 밀봉선과 일부가 중첩하여 일부는 노출되어 있는 액정 표시 장치.The short circuit member partially overlaps with the sealing line, and a portion thereof is exposed. 제4항에서,In claim 4, 상기 연결 부재는 적어도 하나의 절개부를 갖는 액정 표시 장치.The connection member has at least one cutout. 제5항에서,In claim 5, 상기 접촉 구멍과 상기 단락 부재는 상기 밀봉선을 사이에 두고 형성되어 있는 액정 표시 장치.And the contact hole and the shorting member are formed with the sealing line therebetween. 제1항에서,In claim 1, 상기 연결 부재는 ITO 또는 IZO로 이루어지는 액정 표시 장치.The connecting member is made of ITO or IZO.
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