KR20060064410A - 플라즈마 디스플레이 패널의 구동방법 - Google Patents

플라즈마 디스플레이 패널의 구동방법 Download PDF

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Abstract

본 발명은 플라즈마 디스플레이 패널의 구동방법에 관한 것이다.
이와 같은 본 발명은 발광횟수가 다른 다수개의 서브필드가 리셋 구간, 어
드레스 구간, 서스테인 구간으로 나뉘고, 각 구간에서 스캔 전극, 서스테인 전극, 어드레스 전극에 소정의 전압을 인가하여 화상을 표현하는 플라즈마 디스플레이 패널의 구동방법에 있어서, 서스테인 구간 동안 스캔 전극에 인가되는 첫번째 서스테인 펄스의 크기는 두번째 이후의 서스테인 펄스들의 크기보다 큰 것을 특징으로 한다.
또한 본 발명은 발광횟수가 다른 다수개의 서브필드가 리셋 구간, 어드레스 구간, 서스테인 구간으로 나뉘고, 각 구간에서 스캔 전극, 서스테인 전극, 어드레스 전극에 소정의 펄스 전압을 인가하여 화상을 표현하는 플라즈마 디스플레이 패널의 구동방법에 있어서, 서스테인 구간 동안 스캔 전극에 정극성의 첫번째서스테인 구동펄스가 인가되는 동시에 서스테인 전극에 부극성의 서스테인 구동펄스가 인가되는 것을 특징으로 한다.
이와 같은 본 발명은 서브 필드의 첫번째 서스테인 방전이 안정적으로 일어나도록 함으로써 전체적으로 서스테인 방전이 원활하게 일어나도록 한다.

Description

플라즈마 디스플레이 패널의 구동방법{Driving Method of Plasma DisplayPanel}
도 1은 일반적인 플라즈마 디스플레이 패널의 구조를 도시한 도.
도 2는 종래 플라즈마 디스플레이 패널의 화상 계조를 표현하는 방법을 나타낸 도.
도 3은 종래의 플라즈마 디스플레이 패널의 구동파형을 나타낸 도.
도 4는 본 발명의 제 1 실시예에 따른 플라즈마 디스플레이 패널의 구동파형을 나타낸 도.
도 5는 본 발명의 제 2 실시예에 따른 플라즈마 디스플레이 패널의 구동파형을 나타낸 도.
본 발명은 플라즈마 디스플레이 패널에 관한 것으로, 보다 상세하게는 서스테인 구동펄스의 크기를 조절하여 각 서브 필드의 첫번째 서스테인 방전이 원활하게 일어나도록 함으로써 전체적으로 서스테인 방전이 안정적으로 일어나도록 하는 플라즈마 디스플레이 패널의 구동방법에 관한 것이다.
일반적으로 플라즈마 디스플레이 패널은 전면기판과 후면기판 사이에 형성된 격벽 사이의 공간이 하나의 단위 셀을 이루는 것으로, 각 셀 내에는 네온(Ne),헬륨(He) 또는 네온 및 헬륨의 혼합기체(Ne+He)와 같은 주 방전 기체와 소량의 크세논을 함유하는 불활성 가스가 충진되어 있다. 고주파 전압에 의해 방전이 될 때, 불활성 가스는 진공자외선(Vacuum Ultraviolet rays)을 발생하고 격벽 사이에 형성된 형광체를 발광시켜 화상이 구현된다. 이와 같은 플라즈마 디스플레이 패널은 얇고 가벼운 구성이 가능하므로 차세대 표시장치로서 각광받고 있다.
도 1은 일반적인 플라즈마 디스플레이 패널의 구조를 도시한 도이다. 도시된 바와 같이, 플라즈마 디스플레이 패널은 화상이 디스플레이 되는 표시면인 전면기판(100) 및 배면을 이루는 후면기판(110)이 일정거리를 사이에 두고 평행하게결합된다.
전면기판(100)은 하나의 방전셀에서 상호 방전시키고 셀의 발광을 유지하기 위한 스캔 전극(101, Y 전극) 및 서스테인 전극(102, Z 전극), 즉 투명한 ITO물질로 형성된 투명 전극(a)과 금속재질로 제작된 버스 전극(b)으로 구비된 Y 전극(101) 및 Z 전극(102)이 쌍을 이뤄 형성된다. Y 전극(101) 및 Z 전극(102)은 방전 전류를 제한하며 전극 쌍 간을 절연시켜주는 하나 이상의 유전체층(103)에 의해 덮혀지고, 유전체층(103) 상면에는 방전 조건을 용이하게 하기 위하여 산화마그네슘(MgO)을 증착한 보호층(104)이 형성된다.
후면기판(110)은 복수개의 방전 공간 즉, 방전셀을 형성시키기 위한 스트라이프 타입(또는 웰 타입)의 격벽(111)이 평행을 유지하여 배열된다. 또한, 어드레 스 방전을 수행하여 진공자외선을 발생시키는 다수의 어드레스 전극(112, X 전극)이 격벽(111)에 대해 평행하게 배치된다. 후면기판(110)의 상측면에는 어드레스 방전시 화상표시를 위한 가시광선을 방출하는 R, G, B 형광체(113)가 도포된다. 어드레스 전극(112) 및 형광체(113) 사이에는 어드레스 전극(112)을 보호하고형광체(113)에서 방출되는 가시광선을 전면기판(100)으로 반사시키는 백색 유전체(114)가 형성된다.
이와 같은 플라즈마 디스플레이 패널에서 화상 계조를 구현하는 방법은 다음 도 2와 같다.
도 2는 종래 플라즈마 디스플레이 패널의 화상 계조를 구현하는 방법을 나타낸 도이다. 도시된 바와 같이, 종래 플라즈마 디스플레이 패널의 화상 계조(Gray Level) 표현 방법은 한 프레임을 발광횟수가 다른 여러 서브필드로 나누고,각 서브필드는 다시 모든 셀들을 초기화시키기 위한 리셋기간(RPD), 방전될 셀을선택하기 위한 어드레스기간(APD) 및 방전횟수에 따라 계조를 구현하는 서스테인기간(SPD)으로 나뉘어진다. 예를 들어, 256 계조로 화상을 표시하고자 하는 경우에 1/60 초에 해당하는 프레임기간(16.67ms)은 8개의 서브필드들(SF1 내지 SF8)로나누어지고, 8개의 서브 필드들(SF1 내지 SF8) 각각은 리셋기간, 어드레스기간 및서스테인 기간으로 다시 나누어지게 된다.
각 서브필드의 리셋기간 및 어드레스기간은 각 서브필드마다 동일하다. 방전될 셀을 선택하기 위한 어드레스방전은 X 전극과 Y 전극인 투명전극 사이의 전압차에 의해 일어난다. 여기서, Y 전극은 스캔 전극을 의미한다. 서스테인 기간은각 서 브필드에서 2n(단, n = 0, 1, 2, 3, 4, 5, 6, 7)의 비율로 증가된다. 이와같이 각 서브필드에서 서스테인 기간이 달라지게 되므로 각 서브필드의 서스테인기간 즉, 서스테인 방전 횟수를 조절하여 화상의 계조를 표현하게 된다. 이러한플라즈마 디스플레이 패널의 구동 방법에 따른 구동파형을 살펴보면 다음 도 3과같다.
도 3은 종래 플라즈마 디스플레이 패널의 구동 방법에 따른 구동파형을 나타낸 도면이다. 도시된 바와 같이, 플라즈마 디스플레이 패널은 모든 셀들을 초기화시키기 위한 리셋 구간, 방전할 셀을 선택하기 위한 어드레스 구간, 선택된 셀의 방전을 유지시키기 위한 서스테인 구간 및 방전된 셀 내의 벽전하를 소거하기위한 소거 구간으로 나뉘어 구동된다.
리셋 구간에 있어서, 셋업 구간에는 모든 Y 전극들에 상승 램프파형(Rampup)이 동시에 인가된다. 이 상승 램프파형에 의해 전화면의 방전셀들 내에는 약한 암방전(Dark Discharge)이 일어난다. 이 셋업 방전에 의해 X 전극과 Z 전극상에는 정극성 벽전하가 쌓이게 되며, Y 전극 상에는 부극성의 벽전하가 쌓이게 된다. 여기서, X 전극은 어드레스 전극, Y전극은 스캔 전극, Z 전극은 서스테인 전극을 의미한다.
셋 다운 구간에는 상승 램프파형이 공급된 후, 상승 램프파형의 피크전압보다 낮은 정극성 전압에서 떨어지기 시작하여 그라운드(GND)레벨 전압 이하의 특정 전압레벨까지 떨어지는 하강 램프파형(Ramp-down)이 셀들 내에 미약한 소거방전을 일으킴으로써 Y 전극에 과도하게 형성된 벽 전하를 충분히 소거시키게 된다.
이 셋다운 방전에 의해 어드레스 방전이 안정되게 일어날 수 있을 정도의 벽전하가 셀들 내에 균일하게 잔류된다.
어드레스 구간에는 부극성 스캔(Scan) 신호가 Y 전극들에 순차적으로 인가됨과 동시에 스캔 신호에 동기되어 X 전극에 정극성의 데이터(data) 신호가 인가된다. 이 스캔 신호와 데이터 신호의 전압 차와 리셋 구간에 생성된 벽 전압이 더해지면서 데이터 신호가 인가되는 방전셀 내에는 어드레스 방전이 발생된다. 어드레스 방전에 의해 선택된 셀들 내에는 서스테인 전압(Vs)이 인가될 때 방전이 일어날 수 있게 하는 정도의 벽전하가 형성된다. Z 전극에는 셋다운 구간과 어드레스 구간 동안에 Y 전극과의 전압차를 줄여 Y 전극과의 오방전이 일어나지 않도록정극성 전압(Vz)이 공급된다.
서스테인 구간에는 Y 전극과 Z 전극들에 교번적으로 서스테인 신호(Sus)가인가된다. 어드레스 방전에 의해 선택된 셀은 셀 내의 벽 전압과 서스테인 신호가더해지면서 매 서스테인 신호가 인가될 때 마다 Y 전극과 Z 전극 사이에 서스테인방전 즉, 표시방전이 일어나게 된다.
서스테인 방전이 완료된 후, 소거 구간에서는 펄스 폭과 전압 레벨이 작은소거 램프파형(Ramp-ers)의 전압이 Z 전극에 공급되어 전화면의 셀들 내에 잔류하는 벽 전하를 소거시킨다.
이와 같이 함으로써, 하나의 서브 필드에서의 플라즈마 디스플레이 패널의구동과정이 완성된다.
한편, 서스테인 방전을 위한 서스테인 구간에 있어서, 서스테인 방전은 서스 테인 구간 동안 인가되는 서스테인 구동펄스중 첫번째로 가해지는 서스테인 구동펄스의 영향을 크게 받는다.
즉, 첫번째 서스테인 방전은 어드레스 방전에 의해 형성된 셀 내의 벽 전하에 의한 벽 전압과 서스테인 구동펄스의 전압이 더해지면서 일어나는데 이때, 어드레스 방전시 셀 내에 충분한 양의 벽전하가 형성되지 않는 경우 즉, 서스테인펄스의 전압과 벽전하에 의한 벽전압을 합한 전압이 방전 개시 전압보다 작은 경우에는 첫번째 서스테인 방전이 일어나지 않거나 약하게 일어나서 화상을 제대로표현하지 못하게 된다.
또한 첫번째 서스테인 방전이 일어나지 않거나 미약할 경우에는 셀 내에 충분한 양의 벽전하가 형성되지 않아 두번째 서스테인 방전도 첫번째 서스테인 방전과 마찬가지로 일어나지 않거나 약하게 일어나서 화상을 제대로 표현하지 못하게 된다.
이러한 현상은 이 후의 나머지 서스테인 방전에 있어서도 마찬가지이다.
이와 같이 서스테인 방전이 안정적이지 못할 경우 플라즈마 디스플레이 패널의 휘도 및 콘트라스트 비 특성은 저하될 수 밖에 없으므로 실로 커다란 문제점이라 아니할 수 없다.
이러한 문제점을 해결하기 위한 본 발명은 서브 필드의 첫번째 서스테인방전이 원활하게 일어나도록 함으로써 전체적으로 서스테인 방전이 안정적으로 일어나도록 하는 플라즈마 디스플레이 패널의 구동방법을 제공하는데 그 목적이 있다.
이와 같은 목적을 달성하기 위한 본 발명은, 발광횟수가 다른 다수개의 서브필드가 리셋 구간, 어드레스 구간, 서스테인 구간으로 나뉘고, 각 구간에서 스캔 전극, 서스테인 전극, 어드레스 전극에 소정의 펄스 전압을 인가하여 화상을 표현하는 플라즈마 디스플레이 패널의 구동방법에 있어서, 서스테인 구간 동안 스캔 전극에 인가되는 첫번째 서스테인 구동펄스의 크기는 두번째 이후의 나머지 서스테인 구동펄스들의 크기보다 큰 것을 특징으로 한다.
첫번째 서스테인 구동펄스의 크기와 두번째 이후의 나머지 서스테인 구동펄스들의 크기의 차이는 40 V 이상 75 V 이하인 것을 특징으로 한다.
첫번째 서스테인 구동펄스는 적어도 하나 이상의 서브 필드에서 인가되는것을 특징으로 한다.
또한 본 발명은, 발광횟수가 다른 다수개의 서브필드가 리셋 구간, 어드레스 구간, 서스테인 구간으로 나뉘고, 각 구간에서 스캔 전극, 서스테인 전극, 어드레스 전극에 소정의 펄스 전압을 인가하여 화상을 표현하는 플라즈마 디스플레이 패널의 구동방법에 있어서, 서스테인 구간 동안 스캔 전극에 정극성의 첫번째서스테인 구동펄스가 인가되는 동시에 서스테인 전극에 부극성의 펄스가 인가되는것을 특징으로 한다.
부극성의 펄스의 크기는 40 V 이상 75 V 이하인 것을 특징으로 한다.
부극성의 펄스는 적어도 하나 이상의 서브 필드에서 인가되는 것을 특징으로 한다.
이하에서는 첨부된 도면을 참조하여 본 발명에 따른 플라즈마 디스플레이패널의 구동방법을 상세히 설명한다.
도 4는 본 발명의 제 1 실시예에 따른 플라즈마 디스플레이 패널의 구동파형을 나타낸 도이다.
도 4에 도시된 바와 같이, 본 발명에 따른 플라즈마 디스플레이 패널은 모든 셀들을 초기화시키기 위한 리셋 구간, 방전할 셀을 선택하기 위한 어드레스 구간, 선택된 셀의 방전을 유지시키기 위한 서스테인 구간 및 방전된 셀 내의 벽전하를 소거하기 위한 소거 구간으로 나뉘어 구동된다.
리셋 구간에 있어서, 셋업 구간에는 모든 Y 전극들에 상승 램프파형(Rampup)이 동시에 인가된다. 이 상승 램프파형에 의해 전화면의 방전셀들 내에는 약한 암방전(Dark Discharge)이 일어난다. 이 셋업 방전에 의해 X 전극과 Z 전극상에는 정극성 벽전하가 쌓이게 되며, Y 전극 상에는 부극성의 벽전하가 쌓이게 된다. 여기서, X 전극은 어드레스 전극, Y전극은 스캔 전극, Z 전극은 서스테인 전극을 의미한다.
셋 다운 구간에는 상승 램프 파형이 공급된 후, 상승 램프 파형의 피크 전압보다 낮은 정극성 전압에서 떨어지기 시작하여 그라운드(GND) 레벨 전압 이하의 특정 전압 레벨까지 떨어지는 하강 램프 파형(Ramp-down)이 셀들 내에 미약한 소거방전을 일으킴으로써 Y 전극에 과도하게 형성된 벽 전하를 충분히 소거시키게 된다. 이 셋다운 방전에 의해 어드레스 방전이 안정되게 일어날 수 있을 정도의 벽전하가 셀들 내에 균일하게 잔류된다.
어드레스 구간에는 부극성 스캔(Scan) 신호가 Y 전극들에 순차적으로 인가됨과 동시에 스캔 신호에 동기되어 X 전극에 정극성의 데이터(data) 신호가 인가된다. 이 스캔 신호와 데이터 신호의 전압 차와 리셋 구간에 생성된 벽 전압이 더해지면서 데이터 신호가 인가되는 방전셀 내에는 어드레스 방전이 발생된다. 어드레스 방전에 의해 선택된 셀들 내에는 서스테인 전압(Vs)이 인가될 때 방전이 일어날 수 있게 하는 정도의 벽전하가 형성된다. Z 전극에는 셋다운 구간과 어드레스 구간 동안에 Y 전극과의 전압차를 줄여 Y 전극과의 오방전이 일어나지 않도록정극성 전압(Vz)이 공급된다.
서스테인 구간에는 Y 전극과 Z 전극들에 교번적으로 서스테인 신호(Sus)가인가된다. 어드레스 방전에 의해 선택된 셀은 셀 내의 벽 전압과 서스테인 신호가더해지면서 매 서스테인 신호가 인가될 때 마다 Y 전극과 Z 전극 사이에 서스테인방전 즉, 표시방전이 일어나게 된다.
이와 같은 본 발명에 따른 플라즈마 디스플레이 패널의 서스테인 구동방법을 보다 상세히 살펴보면, 먼저 서스테인 방전을 위해 스캔 전극에 인가되는 서스테인 구동펄스들중 첫번째로 인가되는 서스테인 구동펄스의 크기를 두번째 이후의서스테인 구동펄스들 보다 크게 조정하여 서스테인 전극에 인가한다.
기본적으로 서스테인 방전은 서스테인 구동펄스의 전압과 서스테인 구동펄스가 인가되는 시점에 셀(Cell) 내부에 형성되어 있는 기존의 벽전하에 의한 벽전압이 더해짐으로써 생기는 서스테인 전극과 스캔전극간의 전위차에 의해 발생한다.
이와 같은 서스테인 방전을 하나의 서브 필드의 관점에서 보면 서스테인 구 간동안 스캔전극 및 서스테인 전극에 교번적으로 인가되는 서스테인 구동펄스의 수만큼의 서스테인 방전이 발생한다.
이와 같은 서스테인 방전의 메카니즘을 하나의 서브 필드에서 인가되는 본발명에 따른 서스테인 구동파형과 관련하여 보다 상세히 살펴보면 다음과 같다.
먼저 첫째, 어드레스 방전에 의해 벽전하가 형성된 셀의 스캔 전극에 첫번째 서스테인 구동펄스를 인가한다. 이때, 서스테인 전극은 그라운드(GND)상태를 유지한다.
스캔전극에 인가되는 첫번째 서스테인 구동펄스의 크기는 어드레스 방전의강도가 미흡하여 서스테인 방전에 기여하는 벽전하량이 불충분한 경우를 고려하여첫번째 서스테인 방전에 충분할 정도의 크기(Vs+V1)로 조정하여 인가한다.
이와 같은 첫번째 서스테인 구동펄스와 어드레스 방전에 의해 형성된 벽전하에 의한 벽전압에 의해 셀 내부에서 첫번째 서스테인 방전이 발생한다.
이와 같은 첫번째 서스테인 방전에 의해 셀 내부에는 두번째 서스테인 방전에 활용될 충분한 양의 벽전하가 형성된다.
둘째, 스캔 전극을 그라운드(GND) 시키고 서스테인 전극에 두번째 서스테인 구동펄스를 인가한다.
첫번째 서스테인 방전에 의해 셀 내부에 두번째 서스테인 방전에 활용될 충분한 양의 벽전하가 형성된 점을 고려하여, 두번째 서스테인 구동펄스의 크기(Vs)는 첫번째 서스테인 구동펄스의 크기보다 작게 조정하여 인가한다.
이와 같은 두번째 서스테인 구동펄스와 첫번째 서스테인 방전에 의해 형성된 벽전하에 의한 벽전압에 의해 셀 내부에서 두번째 서스테인 방전이 원활하게 발생한다.
이와 같은 두번째 서스테인 방전에 의해 셀 내부에는 세번째 서스테인 방전에 활용될 충분한 양의 벽전하가 형성된다.
세번째 이후의 나머지 서스테인 방전도 이와 같은 동작 원리하에 원활하게발생한다.
이와 같은 첫번째 서스테인 구동펄스의 크기(Vs+V1)와 두번째 이후의 서스테인 구동펄스들의 크기(Vs)의 차이(V1)는 40 V 이상 75 V 이하로 조정하는 것이바람직하다.
또한 이와 같은 크기를 갖는 첫번째 서스테인 구동펄스는 적어도 하나 이상의 서브 필드에서 인가한다.
이상에서 상세히 살펴본 바와 같이, 플라즈마 디스플레이 패널의 서스테인방전에 있어서, 어드레스 방전의 강도가 미흡한 경우를 대비한 본 발명은 서스테인 구간중 첫번째로 인가되는 서스테인 구동펄스의 크기를 충분히 크게하여 첫번째 서스테인 방전을 안정적으로 발생시킴으로써, 두번째 이후의 나머지 서스테인방전들 또한 원활하게 발생시킨다.
서스테인 방전이 완료된 후, 소거 구간에서는 펄스 폭과 전압 레벨이 작은소거 램프파형(Ramp-ers)의 전압이 Z 전극에 공급되어 전화면의 셀들 내에 잔류하는 벽 전하를 소거시킨다.
이와 같이 함으로써, 하나의 서브 필드에서의 플라즈마 디스플레이 패널의구 동과정이 완성된다.
도 5는 본 발명의 제 2 실시예에 따른 플라즈마 디스플레이 패널의 구동파형을 나타낸 도이다.
도 5에 도시된 바와 같이, 본 발명에 따른 플라즈마 디스플레이 패널은 모든 셀들을 초기화시키기 위한 리셋 구간, 방전할 셀을 선택하기 위한 어드레스 구간, 선택된 셀의 방전을 유지시키기 위한 서스테인 구간 및 방전된 셀 내의 벽전하를 소거하기 위한 소거 구간으로 나뉘어 구동된다.
리셋 구간에 있어서, 셋업 구간에는 모든 Y 전극들에 상승 램프파형(Rampup)이 동시에 인가된다. 이 상승 램프파형에 의해 전화면의 방전셀들 내에는 약한 암방전(Dark Discharge)이 일어난다. 이 셋업 방전에 의해 X 전극과 Z 전극상에는 정극성 벽전하가 쌓이게 되며, Y 전극 상에는 부극성의 벽전하가 쌓이게 된다. 여기서, X 전극은 어드레스 전극, Y전극은 스캔 전극, Z 전극은 서스테인 전극을 의미한다.
셋 다운 구간에는 상승 램프 파형이 공급된 후, 상승 램프 파형의 피크 전압보다 낮은 정극성 전압에서 떨어지기 시작하여 그라운드(GND) 레벨 전압 이하의 특정 전압 레벨까지 떨어지는 하강 램프 파형(Ramp-down)이 셀들 내에 미약한 소거방전을 일으킴으로써 Y 전극에 과도하게 형성된 벽 전하를 충분히 소거시키게 된다. 이 셋다운 방전에 의해 어드레스 방전이 안정되게 일어날 수 있을 정도의 벽전하가 셀들 내에 균일하게 잔류된다.
어드레스 구간에는 부극성 스캔(Scan) 신호가 Y 전극들에 순차적으로 인가됨 과 동시에 스캔 신호에 동기되어 X 전극에 정극성의 데이터(data) 신호가 인가된다. 이 스캔 신호와 데이터 신호의 전압 차와 리셋 구간에 생성된 벽 전압이 더해지면서 데이터 신호가 인가되는 방전셀 내에는 어드레스 방전이 발생된다. 어드레스 방전에 의해 선택된 셀들 내에는 서스테인 전압(Vs)이 인가될 때 방전이 일어날 수 있게 하는 정도의 벽전하가 형성된다. Z 전극에는 셋다운 구간과 어드레스 구간 동안에 Y 전극과의 전압차를 줄여 Y 전극과의 오방전이 일어나지 않도록 정극성 전압(Vz)이 공급된다.
서스테인 구간에는 Y 전극과 Z 전극들에 교번적으로 서스테인 신호(Sus)가인가된다. 어드레스 방전에 의해 선택된 셀은 셀 내의 벽 전압과 서스테인 신호가더해지면서 매 서스테인 신호가 인가될 때 마다 Y 전극과 Z 전극 사이에 서스테인방전 즉, 표시방전이 일어나게 된다.
이와 같은 본 발명에 따른 플라즈마 디스플레이 패널의 서스테인 구동방법을 보다 상세히 살펴보면, 먼저 서스테인 구간 동안 스캔 전극에 정극성의 첫번째서스테인 구동펄스가 인가되는 동시에 서스테인 전극에 부극성의 펄스가 인가된다.
기본적으로 서스테인 방전은 서스테인 구동펄스의 전압과 상기 서스테인구동펄스가 인가되는 시점에 셀(Cell) 내부에 형성되어 있는 기존의 벽전하에 의한 벽전압이 더해짐으로써 생기는 스캔전극과 서스테인 전극간의 전위차에 의해 발생한다.
이와 같은 서스테인 방전을 하나의 서브 필드의 관점에서 보면 서스테인 구간동안 스캔전극 및 서스테인 전극에 교번적으로 인가되는 서스테인 구동펄스의수 만큼의 서스테인 방전이 발생한다.
이와 같은 서스테인 방전의 메카니즘을 하나의 서브 필드에서 인가되는 본 발명에 따른 서스테인 구동파형과 관련하여 보다 상세히 살펴보면 다음과 같다.
먼저 첫째, 어드레스 방전에 의해 벽전하가 형성된 셀의 스캔 전극에 첫번째 서스테인 구동펄스를 인가한다. 이때, 동시에 서스테인 전극에 소정의 크기(V2)를 갖는 부극성의 펄스를 인가한다.
어드레스 방전의 강도가 미흡하여 첫번째 서스테인 방전에 기여하는 벽전하량이 불충분한 경우를 고려하여 스캔전극에 첫번째 서스테인 구동펄스를 인가하는 동시에 서스테인 전극에 소정의 크기를 갖는 부극성의 펄스를 인가하는 것이다.
이와 같이, 스캔 전극에 인가되는 첫번째 서스테인 구동펄스와 동시에 서스테인 전극에 인가되는 소정의 크기(V2)를 갖는 부극성의 펄스간의 전위차에 의한 전압과 어드레스 방전에 의해 형성된 벽전하에 의한 벽전압에 의해 셀 내부에서 첫번째 서스테인 방전이 발생한다.
이와 같은 첫번째 서스테인 방전에 의해 셀 내부에는 두번째 서스테인 방전에 활용될 충분한 양의 벽전하가 형성된다.
둘째, 스캔 전극을 그라운드(GND) 시키고 서스테인 전극에 두번째 서스테인 구동펄스를 인가한다.
이때 첫번째 서스테인 방전에 의해 셀 내부에 두번째 서스테인 방전에 활용될 충분한 양의 벽전하가 형성된 점을 고려하여, 상기 두번째 서스테인 구동펄스의 크기(Vs)는 첫번째 서스테인 방전에 기여한 스캔 전극 과 서스테인 전극간의전위차 (Vs+V2)보다 작게 조정하여 인가한다.
이와 같은 두번째 서스테인 구동펄스와 첫번째 서스테인 방전에 의해 형성된 벽전하에 의한 벽전압에 의해 셀 내부에서 두번째 서스테인 방전이 원활하게발생한다.
이와 같은 두번째 서스테인 방전에 의해 셀 내부에는 세번째 서스테인 방전에 활용될 충분한 양의 벽전하가 형성된다.
세번째 이후의 나머지 서스테인 방전도 이와 같은 동작 원리하에 원활하게발생한다.
이와 같이 스캔전극에 첫번째 서스테인 구동펄스가 인가됨과 동시에 서스테인 전극에 인가되는 부극성의 펄스의 크기(V2)는 40 V 이상 75 V 이하로 조정하는 것이 바람직하다.
또한 스캔전극에 첫번째 서스테인 구동펄스가 인가됨과 동시에 서스테인전극에 인가되는 부극성의 펄스는 적어도 하나 이상의 서브 필드에서 인가한다.
이상에서 상세히 살펴본 바와 같이, 플라즈마 디스플레이 패널의 서스테인방전에 있어서, 어드레스 방전의 강도가 미흡한 경우를 대비한 본 발명은 서스테인 구간중 스캔전극에 첫번째 서스테인 구동펄스가 인가됨과 동시에 서스테인 전극에 소정의 크기를 갖는 부극성의 펄스를 인가함으로써 스캔전극과 서스테인 전극 간의 전위차를 충분히 크게함으로써 첫번째 서스테인 방전을 안정적으로 발생시킴으로써, 두번째 이후의 나머지 서스테인 방전들 또한 원활하게 발생시킨다.
서스테인 방전이 완료된 후, 소거 구간에서는 펄스 폭과 전압 레벨이 작은소 거 램프파형(Ramp-ers)의 전압이 Z 전극에 공급되어 전화면의 셀들 내에 잔류하는 벽 전하를 소거시킨다.
이와 같이 함으로써, 하나의 서브 필드에서의 플라즈마 디스플레이 패널의구동과정이 완성된다.
이상에서 보는 바와 같이, 상술한 본 발명의 기술적 구성은 본 발명이 속하는 기술분야의 당업자가 본 발명의 그 기술적 사상이나 필수적 특징을 변경하지않고서 다른 구체적인 형태로 실시될 수 있다는 것을 이해할 수 있을 것이다.
그러므로 이상에서 기술한 실시예들은 모든 면에서 예시적인 것이며 한정적인 것이아닌 것으로서 이해되어야 하고, 본 발명의 범위는 상기 상세한 설명보다는 후술하는 특허청구범위에 의하여 나타내어지며, 특허청구범위의 의미 및 범위 그리고 그 등가개념으로부터 도출되는 모든 변경 또는 변형된 형태가 본 발명의 범위에 포함되는 것으로 해석되어야 한다.
상술한 바와 같이, 본 발명은 서브 필드의 첫번째 서스테인 방전이 안정적으로 일어나도록 함으로써 전체적으로 서스테인 방전이 원활하게 일어나도록 한다.

Claims (6)

  1. 발광횟수가 다른 다수개의 서브필드가 리셋 구간, 어드레스 구간, 서스테인 구간으로 나뉘고, 각 구간에서 스캔 전극, 서스테인 전극, 어드레스 전극에 소정의 펄스 전압을 인가하여 화상을 표현하는 플라즈마 디스플레이 패널의 구동방법에 있어서,
    상기 서스테인 구간 동안 상기 스캔 전극에 인가되는 첫번째 서스테인 구동펄스의 크기는 두번째 이후의 나머지 서스테인 구동펄스들의 크기보다 큰 것을특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  2. 제 1 항에 있어서,
    상기 첫번째 서스테인 구동펄스의 크기와 상기 두번째 이후의 나머지 서스테인 구동펄스들의 크기의 차이는 40 V 이상 75 V 이하인 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  3. 제 1 항 또는 제 2 항에 있어서,
    상기 첫번째 서스테인 구동펄스는 적어도 하나 이상의 서브 필드에서 인가되는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  4. 발광횟수가 다른 다수개의 서브필드가 리셋 구간, 어드레스 구간, 서스테인 구간으로 나뉘고, 각 구간에서 스캔 전극, 서스테인 전극, 어드레스 전극에 소정의 펄스 전압을 인가하여 화상을 표현하는 플라즈마 디스플레이 패널의 구동방법에 있어서,
    상기 서스테인 구간 동안 상기 스캔 전극에 정극성의 첫번째 서스테인 구동펄스가 인가되는 동시에 상기 서스테인 전극에 부극성의 펄스가 인가되는 것을특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  5. 제 2 항에 있어서,
    상기 부극성의 펄스의 크기는 40 V 이상 75 V 이하인 것을 특징으로 하는플라즈마 디스플레이 패널의 구동방법.
  6. 제 4 항 또는 제 5 항에 있어서,
    상기 부극성의 펄스는 적어도 하나 이상의 서브 필드에서 인가되는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
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