KR20060040311A - 플라즈마 표시 장치 및 그의 구동 방법 - Google Patents

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Abstract

본 발명에 따른 플라즈마 표시 장치의 구동 방법은 유지 기간에서, 주사 전극 및 유지 전극에 유지방전을 위한 펄스를 교대로 인가한다. 이 때, 유지방전 펄스의 수가 작아 프라이밍이 적게 형성되는 서브필드의 유지 기간에서는 유지 전극에 인가되는 마지막 유지방전 펄스의 폭을 나머지 유지방전 펄스의 폭보다 길게 한다. 이렇게 하면, 다음 서브필드에서의 어드레스 방전 지연이 단축된다.
PDP, 전극, 방전, 어드레스, 지연, 유지방전 펄스

Description

플라즈마 표시 장치 및 그의 구동 방법{PLASMA DISPLAY DEVICE AND DRIVING METHOD THEREOF}
도 1은 본 발명의 실시 예에 따른 플라즈마 표시 장치를 나타내는 도면이다.
도 2는 본 발명의 실시 예에 따른 플라즈마 표시 장치의 구동 파형도이다.
도 3은 유지 전극(X)에 마지막으로 인가되는 유지방전 펄스의 폭을 가변시키면서 어드레스 방전 지연을 측정한 결과를 나타내는 도면이다.
본 발명은 플라즈마 표시 패널(plasma display panel, PDP)을 포함하는 플라즈마 표시 장치 및 그 구동 방법에 관한 것이다.
플라즈마 표시 장치는 기체 방전에 의해 생성된 플라즈마를 이용하여 문자 또는 영상을 표시하는 평면 표시 장치로서, 그 크기에 따라 수십에서 수백 만개 이상의 픽셀(pixel)이 매트릭스(matrix) 형태로 배열되어 있다.
이러한 플라즈마 표시 장치의 패널에는 그 한쪽 면에 서로 평행인 주사 전극 및 유지 전극이 형성되고 다른 쪽 면에 이들 전극과 직교하는 방향으로 어드레스 전극이 형성된다. 그리고 유지 전극은 각 주사 전극에 대응해서 형성되며, 그 일단 이 서로 공통으로 연결되어 있다.
플라즈마 표시 장치의 구동 방법에 따르면, 각 서브필드는 리셋 기간(reset period), 어드레스 기간(address period) 및 유지 기간(sustain period)으로 이루어진다.
리셋 기간은 이전의 유지방전으로 형성된 벽 전하를 소거하고 다음의 어드레스 방전을 안정적으로 수행하기 위해 벽 전하를 셋업(setup) 하는 역할을 한다. 어드레스 기간은 패널에서 켜지는 셀과 켜지지 않는 셀을 선택하여 켜지는 셀(어드레싱된 셀)에 벽 전하를 쌓아두는 동작을 수행하는 기간이다. 그리고 유지 기간은 어드레싱된 셀에 실제로 화상을 표시하기 위한 유지방전을 수행하는 기간이다.
한편, 어드레스 기간에서는 주사 전극(Y)과 어드레스 전극에 각각 주사 펄스 및 어드레스 펄스를 인가하여 주사 전극(Y)과 어드레스 전극(A) 사이에서 어드레스 방전을 일으켜 켜질 셀을 선택한다.
그런데, 두 전극 사이에 전압을 인가하여 수행되는 방전은 전압이 인가된 시점보다 시간적으로 지연되어 방전이 발생하게 된다. 특히, 앞서 설명한 어드레스 방전은 일정한 주사 펄스와 어드레스 펄스의 폭 내에서 방전이 수행되어야 하므로 방전 지연 시간이 주사 펄스와 어드레스 펄스의 폭보다 길어지면 방전이 일어나지 않는 문제점이 발생하게 된다.
본 발명이 이루고자 하는 기술적 과제는 어드레스 방전 지연 시간을 단축시켜 안정적인 어드레스 방전을 일으킬 수 있는 플라즈마 표시 장치 및 그의 구동 방 법을 제공하고자 하는 것이다.
본 발명의 한 특징에 따르면, 복수의 제1 전극 및 복수의 제2 전극을 포함하는 플라즈마 표시 장치의 구동 방법이 제공된다. 이 구동 방법은, 한 프레임을 각각 리셋 기간, 어드레스 기간 및 유지 기간을 포함하는 복수의 서브필드로 나누어 구동하며, 상기 복수의 서브필드 중 제1 서브필드의 유지 기간에서, 상기 제1 전극 및 제2 전극에 유지방전을 위한 복수의 유지방전 펄스를 교대로 인가하며, 상기 제2 전극에 인가되는 마지막 유지방전 펄스의 폭을 나머지 유지방전 펄스의 폭보다 길게 한다. 이 때, 상기 제2 전극에 인가되는 마지막 유지방전 펄스의 폭이
Figure 112004051255040-PAT00001
보다 클 수도 있으며, 상기 제2 전극에 인가되는 마지막 유지방전 펄스의 폭이
Figure 112004051255040-PAT00002
보다 클 수도 있다. 또한 상기 제1 서브필드는 상기 유지 기간에서의 총 유지방전 펄스 수가 15개 이하인 서브필드일 수 있다.
또한 유지 기간에서 마지막 유지방전 펄스는 상기 제1 전극에 인가되며, 상기 유지 기간과 이어지는 리셋 기간에서, 상기 제1 전극에 마지막 유지방전 펄스의 높은 전압이 인가된 상태에서 상기 제1 전극의 전압을 점진적으로 감소시킬 수 있다. 이 때, 상기 제1 전극은 주사 전극이고, 상기 제2 전극은 유지 전극일 수 있다.
본 발명의 다른 한 특징에 따르면, 복수의 주사 전극 및 복수의 유지 전극 사이에 방전 셀이 형성되는 플라즈마 표시 패널, 그리고 상기 플라즈마 표시 패널에서 한 프레임을 리셋 기간, 어드레스 기간 및 유지 기간으로 이루어지는 복수의 서브필드로 나누고, 상기 주사 전극 및 유지 전극에 구동 전압을 인가하는 구동 회로를 포함하는 플라즈마 표시 장치가 제공된다. 이 때, 상기 구동 회로는, 각 서브필드의 상기 유지 기간에서, 상기 주사 전극 및 유지 전극에 유지방전을 위한 유지방전 펄스를 교대로 인가하고, 상기 복수의 서브필드를 상기 유지방전 펄스의 수에 따라 제1 및 제2 그룹으로 나눌 때, 상기 제1 그룹의 서브필드의 유지 기간에서, 상기 유지 전극에 인가되는 마지막 유지방전 펄스의 폭을 나머지 유지방전 펄스의 폭보다 길게 한다.
아래에서는 첨부한 도면을 참고로 하여 본 발명의 실시 예에 대하여 본 발명이 속하는 기술 분야에서 통상의 지식을 가진 자가 용이하게 실시할 수 있도록 상세히 설명한다. 그러나 본 발명은 여러 가지 상이한 형태로 구현될 수 있으며 여기에서 설명하는 실시 예에 한정되지 않는다. 도면에서 본 발명을 명확하게 설명하기 위해서 설명과 관계없는 부분은 생략하였다. 명세서 전체를 통하여 유사한 부분에 대해서는 동일한 도면 부호를 붙였다.
이제 본 발명의 실시 예에 따른 플라즈마 표시 패널의 구동 방법에 대하여 도면을 참고로 하여 상세하게 설명한다.
먼저, 본 발명의 실시 예에 따른 플라즈마 표시 장치의 개략적인 구조에 대해서 도 1을 참조하여 자세하게 설명한다.
도 1은 본 발명의 실시 예에 따른 플라즈마 표시 장치를 나타내는 도면이다.
도 1에 나타낸 바와 같이, 본 발명의 실시 예에 따른 플라즈마 표시 장치는 플라즈마 표시 패널(100), 제어부(200), 어드레스 전극 구동부(300), 유지전극 구 동부(400) 및 주사전극 구동부(500)를 포함한다.
플라즈마 표시 패널(100)은 열 방향으로 뻗어 있는 복수의 어드레스 전극(A1∼Am), 그리고 행 방향으로 서로 쌍을 이루면서 뻗어 있는 복수의 유지 전극(X1∼Xn) 및 주사 전극(Y1∼Yn)을 포함한다. X 전극(X1∼Xn)은 각 Y 전극(Y1∼Yn)에 대응해서 형성되며, 일반적으로 그 일단이 서로 공통으로 연결되어 있다. 그리고 플라즈마 표시 패널(100)은 유지 및 주사 전극(X1∼Xn, Y1∼Yn)이 배열된 기판(도시하지 않음)과 어드레스 전극(A1∼Am)이 배열된 기판(도시하지 않음)으로 이루어진다. 두 기판은 주사 전극(Y1∼Yn)과 어드레스 전극(A1∼Am) 및 유지 전극(X1∼Xn)과 어드레스 전극(A1∼Am)이 각각 직교하도록 방전 공간을 사이에 두고 대향하여 배치된다. 이때, 어드레스 전극(A1∼Am)과 유지 및 주사 전극(X1∼Xn, Y1∼Yn)의 교차부에 있는 방전 공간이 방전 셀을 형성한다. 이러한 플라즈마 표시 패널(100)의 구조는 일 예이며, 아래에서 설명하는 구동 파형이 적용될 수 있는 다른 구조의 패널도 본 발명에 적용될 수 있다.
제어부(200)는 외부로부터 영상신호를 수신하여 어드레스 전극(A) 구동 제어 신호, 유지 전극(X) 구동 제어신호 및 주사 전극(Y) 구동 제어신호를 출력한다. 그리고 제어부(200)는 한 프레임을 복수의 서브필드로 분할하여 구동하며, 각 서브필드는 시간적인 동작 변화로 표현하면 리셋 기간, 어드레스 기간 및 유지 기간으로 이루어진다.
어드레스 전극 구동부(300)는 제어부(200)로부터 어드레스 전극(A) 구동 제어신호를 수신하여 표시하고자 하는 방전 셀을 선택하기 위한 표시 데이터 신호를 각 어드레스 전극에 인가한다.
유지전극 구동부(400)는 제어부(200)로부터 유지 전극(X) 구동 제어신호를 수신하여 유지 전극(X)에 구동 전압을 인가한다.
주사전극 구동부(500)는 제어부(200)로부터 주사 전극(Y) 구동 제어신호를 수신하여 주사 전극(Y)에 구동 전압을 인가한다.
아래에서는 도 2를 참조하여 각 서브필드에서 어드레스 전극(A1∼Am) 및 유지 전극(X1∼Xn) 및 주사 전극(Y1∼Yn)에 인가되는 구동 파형에 대하여 설명한다. 그리고 아래에서는 하나의 어드레스 전극, 유지 전극 및 주사 전극에 의해 형성되는 방전 셀을 기준으로 설명한다. 그리고 아래에서 언급되는 벽 전하란 각 전극에 가깝게 방전 셀의 벽(예를 들어, 유전체층)에 형성되어 전극에 축적되는 전하를 말한다. 이러한 벽 전하는 실제로 전극 자체에 접촉되지는 않지만, 여기서는 벽 전하가 전극에 "형성됨", "축적됨" 또는 "쌓임"과 같이 설명된다. 또한 벽 전압은 벽 전하에 의해서 방전 셀의 벽에 형성되는 전위 차를 말한다.
도 2는 본 발명의 실시 예에 따른 플라즈마 표시 패널의 구동 파형도이다. 도 2에서는 하나의 프레임이 8개의 서브필드로 이루어졌으며, 각각의 서브필드를 제1 내지 제8 서브필드로 도시하였다. 그리고 제1 서브필드의 리셋 기간은 상승 기간과 하강 기간으로 이루어지고, 제2 내지 제8 서브필드의 리셋 기간이 하강 기간으로 이루어지는 것으로 도시하였다. 여기서, 상승 기간과 하강 기간으로 이루어지는 제1 서브필드의 리셋 기간을 “메인 리셋 기간”으로 정의하고, 하강 기간으로 이루어지는 제2 서브필드의 리셋 기간을 “보조 리셋 기간”으로 정의할 수 있다.
도 2에 나타낸 바와 같이, 각 서브필드는 리셋 기간, 어드레스 기간 및 유지 기간으로 이루어진다.
제1 서브필드의 리셋 기간의 상승 기간에서는 유지 전극(X)을 0V로 유지한 상태에서 주사 전극(Y)에 Vs 전압에서 Vset 전압까지 증가시킨다. 그러면, 주사 전극(Y)으로부터 어드레스 전극(A) 및 유지 전극(X)으로 각각 미약한 리셋 방전이 일어나면서, 주사 전극(Y)에 (-)의 벽 전하가 형성되고 어드레스 전극(A) 및 유지 전극(X)에 (+)의 벽 전하가 형성된다.
그리고 제1 서브필드의 리셋 기간의 하강 기간에서는 유지 전극(X)을 Ve 전압으로 유지한 상태에서 주사 전극(Y)에 Vs 전압에서 Vnf 전압까지 감소시킨다. 그러면, 주사 전극(Y)의 전압이 감소하는 중에 주사 전극(Y)과 유지 전극(X) 사이 및 주사 전극(Y)과 어드레스 전극(A) 사이에서 미약한 리셋 방전이 일어나면서, 주사 전극(Y)에 형성된 (-) 벽 전하와 유지 전극(X) 및 어드레스 전극(A)에 형성된 (+) 벽 전하가 소거된다.
다음, 제1 서브필드의 어드레스 기간에서 켜질 셀을 선택하기 위해 주사 전극(Y)과 어드레스 전극(A)에 각각 VscL 전압을 가지는 주사 펄스 및 Va 전압을 가지는 어드레스 펄스를 인가한다. 그리고 선택되지 않는 주사 전극(Y)은 VscL 전압보다 높은 VscH 전압으로 바이어스하고, 켜지지 않을 셀의 어드레스 전극에는 기준 전압을 인가한다. 그러면, 어드레스 전압(Va)과 주사 전압(VscL)의 차이 및 어드레스 전극(A) 및 주사 전극(Y)에 형성된 벽 전하에 의한 벽 전압에 의해 어드레스 방전이 일어난다. 그 결과 주사 전극(Y)에는 (+)의 벽 전하가 형성되고 유지 전극(X) 에는 (-) 벽 전하가 형성된다. 또한 어드레스 전극(A)에도 (-) 벽 전하가 형성된다.
이어서, 제1 서브필드의 유지 기간에서는 주사 전극(Y)과 유지 전극(X)에 차례로 Vs 전압의 유지 방전 펄스를 인가한다. 이 때, 유지방전 펄스는 주사 전극(Y)과 유지 전극(X)의 전압 차가 교대로 Vs 전압 및 -Vs 전압이 되도록 하는 펄스이며, 주사 전극(Y)과 유지 전극(X)에 인가되는 유지방전 펄스의 폭(T2)은 서로 동일하다. 그러면, 어드레스 기간에서 어드레스 방전에 의해 주사 전극(Y)과 유지 전극(X) 사이에 벽 전압이 형성되어 있으면, 벽 전압과 Vs 전압에 의해 주사 전극(Y)과 유지 전극(X)에서 방전이 일어난다.
이후, 주사 전극(Y)에 Vs 전압의 유지방전 펄스를 인가하는 과정과 유지 전극(X)에 Vs 전압의 유지방전 펄스를 인가하는 과정을 해당 서브필드가 표시하는 가중치에 대응하는 횟수만큼 반복한다.
본 발명의 실시 예에 따르면, 제1 서브필드와 같이 유지 기간에서의 총 유지방전 펄스의 수가 작아 프라이밍이 적게 형성되는 서브필드의 유지 기간에서는 유지 전극(X)에 인가되는 유지방전 펄스의 폭(T2)을 나머지 유지방전 펄스의 폭(T1)보다 길게 한다. 여기서, 총 유지방전 펄스는 한 서브필드의 유지 기간에서 주사 전극(Y)과 유지 전극(X)에 각각 인가되는 유지방전 펄스의 총 개수를 의미한다. 또한 여기서 말하는 유지방전 펄스의 폭(T1, T2)은 유지방전 펄스의 하이 레벨에서의 폭 즉, Vs 전압 유지 시간을 의미한다. 그리고 프라이밍이 적게 형성되는 서브필드라 함은 실험적으로 유지 기간에서의 총 유지방전 펄스의 수가 15개 이하인 서브필 드를 말한다. 그러나 패널의 특성에 따라 유지방전 펄스의 수가 달라질 수도 있다.
이와 같이 하여 제1 서브필드의 유지 기간이 종료되면, 제2 서브필드가 시작된다. 제2 서브필드의 리셋 기간은 앞서 설명한 것처럼 하강 기간으로만 이루어진다.
제2 서브필드의 리셋 기간에서는 제1 서브필드의 유지 기간에서 Vs 전압의 유지방전 펄스가 주사 전극(Y)에 인가된 상태에서 주사 전극(Y)의 전압을 Vnf 전압까지 점진적으로 감소시킨다.
이 때, 제1 서브필드의 유지 기간에서 유지방전이 일어난 경우에는 주사 전극(Y)에 (-) 벽 전하, 유지 전극(X)과 어드레스 전극(A)에 (+) 벽 전하가 형성되어 있으므로, 주사 전극(Y)의 전압이 점진적으로 감소하는 중에 셀에 형성된 벽 전압과 함께 방전 개시 전압을 넘게 되면 제1 서브필드의 리셋 기간의 하강 기간에서와 같이 약 방전이 일어난다. 그리고 주사 전극(Y)의 최종 전압(Vnf)이 제1 서브필드의 하강 기간의 최종 전압(Vnf)과 동일하므로, 제2 서브필드의 하강 기간 종료 후의 셀의 벽 전하 상태는 제1 서브필드의 하강 기간 종료 후의 벽 전하 상태와 실질적으로 동일해진다.
그리고 제1 서브필드의 유지 기간에서 유지방전이 일어나지 않은 경우에는 어드레스 기간에서도 어드레스 방전이 일어나지 않았으므로, 셀의 벽 전하 상태는 제1 서브필드의 하강 기간 종료 후의 상태를 그대로 유지한다. 제1 서브필드의 하강 기간 종료 후에 셀에 형성된 벽 전압은 인가 전압과 함께 방전 개시 전압 근처로 형성되어 있으므로, 주사 전극(Y)의 전압이 Vnf 전압까지 감소하는 경우에는 방 전이 일어나지 않는다. 따라서, 제2 서브필드의 리셋 기간에서 방전이 일어나지 않으므로 제1 서브필드의 리셋 기간에서 설정된 벽 전하 상태를 그대로 유지한다.
이와 같이, 리셋 기간이 하강 기간으로 이루어진 서브필드는 직전 서브필드에서 유지방전이 있는 경우에는 리셋 방전이 일어나고 유지방전이 없는 경우에는 리셋 방전이 일어나지 않는다.
그리고 제2 서브필드의 어드레스 기간 및 유지 기간은 제1 서브필드와 동일하며, 단, 제2 서브필드의 유지 기간에서는 주사 전극(Y) 및 유지 전극(X)에 제2 서브필드가 표시하고자 하는 가중치에 대응하여 인가되는 유지방전 펄스의 수가 다르다는 점에서 차이가 있다.
아래에서는 유지 기간에서 유지 전극(X)에 인가되는 마지막 유지 방전 펄스의 폭을 나머지 유지방전 펄스의 폭보다 길게 하는 이유에 대해서 도 3을 참고로 하여 설명한다.
앞서 설명한 것처럼 두 전극 사이에 전압을 인가하여 수행되는 방전은 전압이 인가된 시점보다 시간적으로 지연되어 방전이 발생하게 된다. 특히, 어드레스 방전은 주사 펄스와 어드레스 펄스의 폭 내에서 방전이 수행되어야 하므로, 어드레스 방전은 방전 지연 시간에 큰 영향을 받는다. 이러한 어드레스 방전은 리셋 기간 종료 후 방전 공간에 형성된 벽 전하에 의한 벽 전압에 의하여 결정되므로, 어드레스 방전 지연은 리셋 기간 종료 후의 벽 전하 상태에 영향을 받게 된다. 또한 리셋 기간 종료 후의 벽 전하 상태는 직전 서브필드의 마지막 유지 방전 이후의 벽 전하 상태에 따라 결정되므로, 어드레스 방전 지연이 직전 서브필드의 벽 전하 상태에 영향을 받는다는 것을 알 수 있다.
그리고 일반적으로 유지 기간에서 각 전극에 각각 하나의 유지방전 펄스가 인가되는 시간(T1;이하, 주기라 함)은
Figure 112004051255040-PAT00003
정도이고, 주사 전극(Y)과 유지 전극(X)에 각각 인가되는 유지방전 펄스의 폭(T1)은 서로 동일하며, 대략적으로
Figure 112004051255040-PAT00004
정도이다. 이러한 유지방전 펄스를 유지 기간 동안 주사 전극(Y)과 유지 전극(X)에 각각 교대로 인가하는데, 유지 기간의 총 유지방전 펄스의 수가 적은 서브필드에서는 유지방전 펄스의 폭(T1)으로 벽 전하가 적절한 수준까지 형성되지 못하기 때문에 보조 리셋 동작이 불안정해진다.
따라서, 본 발명의 실시 예처럼 유지 기간에서 유지 전극(Y)에 마지막으로 인가되는 유지방전 펄스의 폭(T2)을 나머지 유지방전 펄스의 폭(T1)보다 길게 한다.
도 3은 유지 전극(X)에 인가되는 마지막 유지방전 펄스의 폭을 가변시키면서 어드레스 방전 지연을 측정한 도면이다. 도 3에서는 유지 기간에서의 총 유지방전 펄스의 수를 3개로 하고 유지 전극(X)에 인가되는 마지막 유지방전 펄스의 폭을 가변하면서 어드레스 방전 지연을 측정하였다.
도 3을 보면, 유지 기간에서 유지 전극(X)에 인가되는 마지막 유지방전 펄스의 폭(T2)을 길게 할수록 어드레스 방전 지연이 작아진다는 것을 알 수 있다.
특히, R 형광체는 유지 전극(X)에 인가되는 마지막 유지방전 펄스의 폭이 어드레스 방전 지연에 거의 영향을 미치지 않으나 G 형광체는 유지 전극(X)에 인가되 는 마지막 유지방전 펄스의 폭을 길게 할수록 어드레스 방전 지연이 작아진다는 것을 알 수 있다.
예를 들면, 도 2에 나타낸 바와 같이 유지방전 펄스의 폭이
Figure 112004051255040-PAT00005
일 때 어드레스 방전 지연은 1302ns이고, 유지방전 펄스의 폭이
Figure 112004051255040-PAT00006
일 때 어드레스 방전 지연이 1390ns 이다. 만약 주사 라인이 480이고, 서브필드가 12개라고 하면, 한 프레임에서 대략적으로
Figure 112004051255040-PAT00007
(88×480×12)의 시간을 확보할 수 있게 된다.
즉, 본 발명의 실시 예에 따르면 복수의 서브필드를 각 서브필드에서의 총 유지방전 펄스의 수에 따라 복수의 그룹으로 나누고 예를 들면, 유지방전 펄스의 수가 15개를 기준으로 제1 그룹 및 제2 그룹의 서브필드로 나누고 유지방전 펄스의 수가 15개 이하인 서브필드의 유지 기간에서는 유지 전극(X)에 인가되는 마지막 유지방전 펄스의 폭을 길게 하면 어드레스 방전 지연을 단축시킬 수 있게 된다.
이상에서 본 발명의 바람직한 실시 예에 대하여 상세하게 설명하였지만 본 발명의 권리범위는 이에 한정되는 것은 아니고 다음의 청구범위에서 정의하고 있는 본 발명의 기본 개념을 이용한 당업자의 여러 변형 및 개량 형태 또한 본 발명의 권리범위에 속하는 것이다.
본 발명에 의하면, 유지방전 펄스의 수가 작아 프라이밍이 적게 형성되는 서브필드의 유지 기간에서 유지 전극(X)에 인가되는 마지막 유지방전 펄스의 폭을 길게 한다. 그러면, 다음 서브필드의 어드레스 기간에서 어드레스 방전 지연이 단축 된다.

Claims (13)

  1. 복수의 제1 전극 및 복수의 제2 전극을 포함하는 플라즈마 표시 장치의 구동 방법에 있어서,
    한 프레임을 각각 리셋 기간, 어드레스 기간 및 유지 기간을 포함하는 복수의 서브필드로 나누어 구동하며,
    상기 복수의 서브필드 중 제1 서브필드의 유지 기간에서,
    상기 제1 전극 및 제2 전극에 유지방전을 위한 복수의 유지방전 펄스를 교대로 인가하며,
    상기 제2 전극에 인가되는 마지막 유지방전 펄스의 폭을 나머지 유지방전 펄스의 폭보다 길게 하는 플라즈마 표시 장치의 구동 방법.
  2. 제 1항에 있어서,
    상기 제1 서브필드는 유지 기간에서의 총 유지방전 펄스의 수가 15개 이하의 서브필드인 플라즈마 표시 장치의 구동 방법.
  3. 제 2항에 있어서,
    상기 제2 전극에 인가되는 마지막 유지방전 펄스의 폭이
    Figure 112004051255040-PAT00008
    보다 큰 플라즈마 표시 장치의 구동 방법.
  4. 제 2항에 있어서,
    상기 제2 전극에 인가되는 마지막 유지방전 펄스의 폭이
    Figure 112004051255040-PAT00009
    보다 큰 플라즈마 표시 장치의 구동 방법.
  5. 제 1항 내지 제 4항 중 어느 한 항에 있어서,
    상기 복수의 서브필드 중 제2 서브필드의 유지 기간에서는 상기 제1 전극 및 제2 전극에 인가되는 유지방전 펄스의 폭이 서로 동일한 플라즈마 표시 장치의 구동 방법.
  6. 제 5항에 있어서,
    유지 기간에서 마지막 유지방전 펄스는 상기 제1 전극에 인가되는 플라즈마 표시 장치의 구동 방법.
  7. 제 6항에 있어서,
    상기 유지 기간과 이어지는 리셋 기간에서,
    상기 제1 전극에 마지막 유지방전 펄스의 높은 전압이 인가된 상태에서 상기 제1 전극의 전압을 점진적으로 감소시키는 플라즈마 표시 장치의 구동 방법.
  8. 제 7항에 있어서,
    상기 제1 전극은 주사 전극이고, 상기 제2 전극은 유지 전극인 플라즈마 표 시 장치의 구동 방법.
  9. 복수의 주사 전극 및 복수의 유지 전극 사이에 방전 셀이 형성되는 플라즈마 표시 패널, 그리고
    상기 플라즈마 표시 패널에서 한 프레임을 리셋 기간, 어드레스 기간 및 유지 기간으로 이루어지는 복수의 서브필드로 나누고, 상기 주사 전극 및 유지 전극에 구동 전압을 인가하는 구동 회로를 포함하며,
    상기 구동 회로는,
    각 서브필드의 상기 유지 기간에서,
    상기 주사 전극 및 유지 전극에 유지방전을 위한 유지방전 펄스를 교대로 인가하고,
    상기 복수의 서브필드를 상기 유지방전 펄스의 수에 따라 제1 및 제2 그룹으로 나눌 때,
    상기 제1 그룹의 서브필드의 유지 기간에서, 상기 유지 전극에 인가되는 마지막 유지방전 펄스의 폭을 나머지 유지방전 펄스의 폭보다 길게 하는 플라즈마 표시 장치.
  10. 제 9항에 있어서,
    상기 제1 그룹의 서브필드의 유지 기간에서, 상기 유지 전극에 인가되는 마지막 유지방전 펄스의 폭이
    Figure 112004051255040-PAT00010
    보다 큰 플라즈마 표시 장치.
  11. 제 10항에 있어서,
    상기 유지 기간에서 상기 주사 전극 및 유지 전극에 인가되는 총 유지방전 펄스의 수가 15개에서 그룹이 분할되는 플라즈마 표시 장치.
  12. 제 9항 내지 제 11항 중 어느 한 항에 있어서,
    상기 유지 기간과 이어지는 리셋 기간에서는, 유지 기간에서 유지 방전이 일어난 방전 셀에 대해서 초기화를 수행하는 플라즈마 표시 장치.
  13. 제 12항에 있어서,
    상기 유지 기간에서의 마지막 유지방전 펄스는 상기 주사 전극에 인가되는 플라즈마 표시 장치.
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