KR20030079501A - 플라즈마 디스플레이 패널 및 그 구동방법 - Google Patents

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Abstract

본 발명은 프라이밍 방전을 이용함으로써 어드레스방전의 오방전을 방지할 수 있는 플라즈마 디스플레이 패널 및 그 구동방법에 관한 것이다.
본 발명에 따른 플라즈마 디스플레이 패널은 델타형 격벽과 어드레스방전을 일으키는 주사전극 및 어드레스전극을 포함하는 플라즈마 디스플레이 패널에 있어서, 상기 어드레스전극은 방전셀 내에 두개 설치되며 그 중 하나의 어드레스전극은 상하로 인접한 방전셀에 공유되는 것을 특징으로 한다.

Description

플라즈마 디스플레이 패널 및 그 구동방법{PLASMA DISPLAY PANEL AND METHOD OF DRIVING THE SAME}
본 발명은 플라즈마 디스플레이 패널에 관한 것으로, 특히 방전셀 내에 어드레스전극을 두개 배치하고 이 중 상하 방전셀을 동시에 공유하는 어드레스전극에 프라이밍방전을 일으킴으로써 어드레스방전의 미스라이팅과 오방전을 방지할 수 있는 플라즈마 디스플레이 패널 및 그 구동방법에 관한 것이다.
최근 들어, 음극선관(Cathode Ray Tube)의 단점인 무게와 부피를 줄일 수 있는 각종 평판 표시장치들이 개발되고 있다. 이러한 평판 표시장치는 액정표시장치(Liquid Crystal Display : LCD), 전계 방출 표시장치(Field Emission Display : FED), 플라즈마 디스플레이 패널(Plasma Display Panel : PDP) 및 일렉트로 루미네센스(Electro-Luminescence : EL) 표시장치 등이 있다. 이 중에서 PDP는 기체방전을 이용한 표시소자로서 대형패널의 제작이 용이하다는 장점이 있다. PDP에는 도 1에 도시된 바와 같이 3전극을 구비하고 교류전압에 의해 구동되는 3전극 교류 면방전형 PDP가 대표적이다.
도 1을 참조하면, 3전극 교류 면방전 PDP의 방전셀은 상부기판(10)상에 형성되는 유지전극쌍(12Y, 12Z)과, 하부기판(18)상에 형성되는 어드레스전극(12X)을 구비한다.
유지전극쌍(12Y, 12Z)은 주사전극(12Y)과 유지전극(12Z)으로 구성됨과 아울러 각각의 유지전극쌍(12Y, 12Z)은 투명전극(12a)과 버스전극(12b)으로 이루어진다. 유지전극쌍(12Y,12Z)이 형성되는 상부기판(10)에는 상부 유전체층(14)과 보호막(16)이 형성된다. 상부 유전체층(14)은 플라즈마 방전시 발생된 벽전하가 축적된다. 보호막(16)은 플라즈마 방전시 발생된 스퍼터링에 의한 상부 유전체층(14)의 손상을 방지하고 아울러 2차 전자의 방출 효율을 높이게 한다. 보호막(16)으로는 통상 산화마그네슘(MgO)이 이용된다.
어드레스전극(12X)이 형성된 하부기판(18) 상에는 벽전하 축적을 위한 하부 유전층(22)이 형성된다. 하부 유전층(22) 상에는 격벽(24)이 형성되며, 하부 유전층(22)과 격벽(24)의 표면에는 형광체(20)가 도포된다. 격벽(24)은 데타형구조로 방전에 의해 생성된 자외선 및 가시광선이 인접한 방전셀에 누설되는 것을 방지한다. 형광체(20)는 플라즈마 방전시 발생된 자외선에 의해 여기되어 적색, 녹색 또는 청색 중 어느 하나의 가시광선을 발생하게 된다. 상/하부기판(10)(18)과 격벽(24) 사이에 마련된 방전공간에는 가스방전을 위한 불활성 가스가 주입된다.
이러한 PDP의 격벽(24)은 스트라입 형태의 격벽구조로서 방전가스의 배기가 용이하지만 형광체(20)의 도포 면적이 적어 휘도가 낮은 단점을 가지고 있다.
이와 같은 스트라입 형태의 격벽이 가지는 문제점을 해결하기 위하여 도 2에 도시된 바와 같은 델타형 격벽구조가 제안되었다.
델타형 격벽을 가지는 PDP는 제1 및 제2 버스전극(32Y, 32Z)과, 제1 버스전극(32Y)으로부터 신장된 제1 투명전극(34Y)과, 제2 버스전극(32Z)으로부터 신장된 제2 투명전극(34Z)을 구비한다. 제1 투명전극(34Y)과 제1 버스전극(32Y)은 주사전극으로 이용되며, 제2 투명전극(34Z)과 제2 버스전극(32Z)은 유지전극으로 이용된다.
델타형 격벽(42)은 제1 버스전극(32Y)과 나란하게 형성된 다수의 제1 격벽(36)과, 제1 격벽(36)들을 연결시키도록 상기 제1 격벽(36)과 교차하는 방향으로 형성된 제2 격벽(38)을 구비한다. 여기서, 델타형 격벽에 의해 R, G, B 서브픽셀들은 삼각형태로 배치된다.
이렇게 델타형 격벽(42)을 가지는 PDP에서 어드레스전극(30)은 도 3에 도시된 바와 같이 사각 델타형 격벽(42)에 의해 마련된 방전공간과 대응되는 부분에서 전극면적(30A)이 넓게 형성되고, 그 이외의 영역에서는 어드레스전극(30) 폭이 좁게끔 형성된다. 어드레스전극(30)의 폭이 좁은 부분은 사각 델타형 격벽(42)의 아래에 위치하여 이웃하는 셀과의 크로스토크(cross-talk)를 방지하는 역할을 한다.
도 4는 종래의 3전극 교류 면방전형 플라즈마 디스플레이의 구동장치를 나타내는 도면이다.
도 4를 참조하면, 종래의 3전극 교류 면방전형 PDP의 구동장치는 m×n 개의 방전셀들(51)이 주사전극라인들(Y1 내지 Ym), 유지전극라인들(Z1 내지 Zm) 및 어드레스전극라인들(X1 내지 Xn)과 접속되게끔 매트릭스 형태로 배치된 PDP(50)와, 주사전극라인들(Y1 내지 Ym)을 구동하기 위한 주사/서스테인 구동부(52)와, 유지전극라인들(Z1 내지 Zm)을 구동하기 위한 공통서스테인 구동부(54)와, 기수 번째 어드레스전극라인들(X1,X3,…,Xn-3,Xn-1)과 우수 번째 어드레스전극라인들(X2,X4,… ,Xn-2,Xn)을 분할 구동하기 위한 제1 및 제2 어드레스 구동부(56A, 56B)를 구비한다.
주사/서스테인 구동부(52)는 주사전극라인들(Y1 내지 Ym)에 스캔펄스를 순차적으로 공급한다. 또한, 주사/서스테인 구동부(52)는 주사전극라인들(Y1 내지 Ym)에 공통적으로 서스테인펄스를 공급한다. 공통서스테인 구동부(54)는 유지전극라인들(Z1 내지 Zm) 모두에 서스테인 펄스를 공급한다.
제1 및 제2 어드레스 구동부(56A, 56B)는 스캔펄스에 동기되게끔 영상 데이터를 어드레스전극라인들(X1 내지 Xn)에 공급하게 된다. 제1 어드레스 구동부(56A)는 기수 번째 어드레스전극라인들(X1,X3,…,Xn-3,Xn-1)에 영상데이터를 공급한다. 제 2 어드레스 구동부(56B)는 우수 번째 어드레스전극라인들(X2,X4,…,Xn-2,Xn)에 영상데이터를 공급한다.
이와 같은 PDP는 화상의 계조(Gray Level)를 표현하기 위하여 한 프레임을 방전횟수가 다른 여러 서브필드로 나누어 구동하고 있다. 각 서브필드는 다시 방전을 균일하게 일으키기 위한 초기화 기간, 방전셀을 선택하기 위한 어드레스 기간및 방전횟수에 따라 계조를 표현하는 서스테인 기간으로 나뉘어진다.
예를 들어, 256 계조로 화상을 표시하고자 하는 경우에 1/60 초에 해당하는 프레임 기간(16.67㎳)은 도 5과 같이 8개의 서브필드들(SF1 내지 SF8)로 나누어지게 된다. 아울러, 8개의 서브 필드별(SF1 내지 SF8) 각각은 어드레스기간과 서스테인기간으로 다시 나누어지게 된다. 여기서, 각 서브필드의 리셋기간 및 어드레스기간은 각 서브필드마다 동일한 반면에 서스테인기간은 각 서브필드에서 2n(n=0,1,2,3,4,5,6,7)의 비율로 증가된다.
도 6은 종래의 3전극 교류 면방전형 PDP의 구동방법을 나타내는 파형도이다.
도 6을 참조하면, 하나의 서브필드는 전 화면을 초기화하는 리셋 기간, 전 화면을 선순차 방식으로 스캔하면서 데이터를 기입하는 어드레스기간, 데이터가 기입된 셀들의 발광상태를 유지시키는 서스테인기간 및 서스테인 방전을 소거시키는 소거기간으로 나뉘어진다.
먼저 리셋기간에는 주사전극라인들(Y1 내지 Ym)에 리셋 파형(RP)이 공급된다. 제1 전극라인들(Y1 내지 Ym)에 리셋 파형(RP)이 공급되면 주사전극라인들(Y1 내지 Ym)과 유지전극라인들(Z1 내지 Zm) 간에 리셋 방전이 발생되어 방전셀이 초기화된다.
어드레스기간에는 주사전극라인들(Y1 내지 Ym)에 스캔펄스(SP)가 순차적으로 인가된다. 어드레스전극라인들(X1 내지 Xn)에는 스캔펄스(SP)에 동기되는 데이터펄스(DP)가 인가된다. 이때, 데이터펄스(DP) 및 스캔펄스(SP)가 인가된 방전셀들에서는 어드레스 방전이 일어난다.
서스테인기간에는 주사전극라인들(Y1 내지 Ym) 및 유지전극라인들(Z1 내지 Zm)에 제1 및 제2 서스테인펄스(SUSPy, SUSPz)가 공급된다. 이때, 어드레스 방전이 발생된 방전셀들에서는 서스테인 방전이 발생된다.
소거기간에는 유지전극라인들(Z1 내지 Zm)에 소거펄스(EP)가 공급된다. 유지전극라인들(Z1 내지 Zm)에 소거펄스(EP)가 공급되면 서스테인 방전이 소거된다.
이와 같은 종래의 PDP의 효율을 증대시키기 위하여 Xe를 많이 첨가하는 경우 어드레스방전이 미스라이팅된다. 또한, 플라즈마 방전을 안정적으로 유지시키기 위해서는 이러한 전극들의 길이가 어느 정도 적정 수준으로 유지되어야 하는데, 종래의 구동방법에서는 주사전극라인들(Y1 내지 Ym)과 유지전극라인들(Z1 내지 Zm)의 길이가 짧기 때문에 효과적인 방전을 일으키기 쉽지 않다. 다시 말하면, PDP의 해상도가 높아질수록 방전셀의 크기가 작아지고 델타형 격벽을 포함한 방전셀은 좌우보다 상하의 길이가 짧아져 어드레스전극과 직교하는 방향으로 마주보는 주사전극라인들(Y1 내지 Ym)과 유지전극라인들(Z1 내지 Zm) 사이의 방전패스가 짧아진다. 이에 따라, 구동전압이 상승함으로써 휘도가 떨어지게 된다. 해상도가 높아질수록 주사 및 유지전극라인들의 수가 증가하여 각 라인을 주사하기 위한 주사시간이 줄어들게 되어 어드레스 방전시 미스라이팅 현상이 발생한다. 상기와 같은 현상을 막기 위해서는 프라이밍방전을 이용하여 어드레스방전 형성시간을 단축할 필요가 있다.
따라서, 본 발명의 목적은 방전셀 내에 어드레스전극을 두개 배치하고 이 중 상하 방전셀을 동시에 공유하는 어드레스전극에 프라이밍방전을 일으킴으로써 어드레스방전의 미스라이팅과 오방전을 방지할 수 있는 플라즈마 디스플레이 패널 및 그 구동방법에 관한 것이다.
도 1은 종래의 3전극 교류 면방전형 플라즈마 디스플레이 패널을 나타내는 단면도.
도 2는 종래 델타형 격벽을 갖는 플라즈마 디스플레이 패널을 나타내는 평면도.
도 3은 도 2에 도시된 델타형 격벽을 가지는 플라즈마 디스플레이 패널의 어드레스전극 구조를 나타내는 도면.
도 4는 종래의 플라즈마 디스플레이의 구동장치를 나타내는 도면.
도 5는 종래의 플라즈마 디스플레이 패널의 한 프레임을 나타내는 도면.
도 6은 종래의 플라즈마 디스플레이 패널의 한 서브필드에 공급되는 구동파형도.
도 7은 본 발명의 실시 예에 따른 플라즈마 디스플레이 패널을 나타내는 평면도.
도 8은 도 7에 도시된 플라즈마 디스플레이 패널의 구동파형도.
< 도면의 주요 부분에 대한 부호의 설명 >
10 : 상부기판12X : 어드레스전극
12Y : 주사전극12Z : 유지전극
14, 22 : 유전체층16 : 보호막
18 : 하부기판20 : 형광체
24, 42 : 격벽52 : 주사/서스테인 구동부
54 : 공통서스테인 구동부56 : 어드레스 구동부
상기 목적을 달성하기 위하여, 본 발명에 따른 플라즈마 디스플레이 패널은 델타형 격벽과 어드레스방전을 일으키는 주사전극 및 어드레스전극을 포함하는 플라즈마 디스플레이 패널에 있어서, 어드레스전극은 방전셀 내에 두개 설치되며 그 중 하나의 어드레스전극은 상하로 인접한 방전셀에 공유되는 것을 특징으로 한다.
상기 델타형 격벽은 상기 주사전극과 나란한 방향으로 형성되는 제1 격벽들과, 제1 격벽들과 교차하는 방향으로 상기 제1 격벽들을 연결함과 아울러 방전셀에 해당하는 상기 제1 격벽 길이의 1/3 지점에서 형성되는 제2 격벽을 추가로 구비하는 것을 특징으로 한다.
본 발명에 따른 플라즈마 디스플레이 패널의 구동방법은 방전셀을 초기화하는 리셋방전과 상기 리셋방전 후 켜질 방전셀을 선택하기 위한 어드레스방전을 포함하는 플라즈마 디스플레이 패널의 구동방법에 있어서, 어드레스방전 전 소정 기간동안 상기 상하로 인접한 방전셀에 동시에 어드레스전압을 공급하여 프라이밍방전을 일으키는 단계를 포함하는 것을 특징으로 한다.
상기 어드레스방전에 사용되는 어드레스전극은 상기 방전셀 내에 두개 설치되며 그 중 하나의 어드레스전극이 상하 인접된 방전셀에 공유되어 어드레스방전이 일어나기 전에 미리 프라이밍 방전이 일어나는 것을 특징으로 한다.
상기 프라이밍 방전은 n = 3k(n은 1이상의 자연수, k는 0이상의 자연수)의 조건을 만족하는 주사전극라인들(Y1 내지 Yn)과 m = 3k(m은 1이상의 자연수, k는 0이상의 자연수)의 조건을 만족하는 어드레스전극들(D1 내지 Dm) 사이에서 일어나는 것을 특징으로 한다.
상기 프라이밍 방전은 n = 3k+1(n은 1이상의 자연수, k는 0이상의 자연수)을 만족하는 주사전극라인들(Y1 내지 Yn)과 m = 3k+2(m은 1이상의 자연수, k는 0이상의 자연수)를 만족하는 어드레스전극들(D1 내지 Dm) 사이에서 일어나는 것을 특징으로 한다.
상기 프라이밍 방전은 n = 3k+2(n은 1이상의 자연수, k는 0이상의 자연수)를 만족하는 주사전극라인들(Y1 내지 Yn)과 m = 3k+1(m은 1이상의 자연수, k는 0이상의 자연수)을 만족하는 어드레스전극들(D1 내지 Dm) 사이에서 일어나는 것을 특징으로 한다.
상기 목적 외에 본 발명의 다른 목적 및 특징들은 첨부도면을 참조한 실시예에 대한 설명을 통하여 명백하게 드러나게 될 것이다.
이하, 도 7 및 도 8을 참조하여 본 발명의 바람직한 실시 예에 대하여 설명하기로 한다.
도 7은 본 발명의 실시 예에 따른 어드레스전극을 포함하는 PDP를 나타내는평면도이다.
도 7을 참조하면, 본 발명에 따른 PDP의 하판에는 방전셀마다 두개를 포함하도록 설치된 어드레전극들(D1 내지 Dm)과, 상하 방전셀이 방전셀의 가로길이의 1/3 위치만큼 어긋나게끔 배치되는 델타형 격벽(50)을 구비한다.
상판에는 어드레스전극(D1 내지 Dm)과 교차하도록 형성된 주사전극들(Y1 내지 Yn)과 유지전극들(Z1 내지 Zn)을 구비한다. 주사전극들(Y1 내지 Yn)에는 패널 주사를 위한 주사신호와 방전유지를 위한 유지신호가 주로 공급되고, 유지전극들(Z1 내지 Zn)에는 유지신호가 주로 공급된다.
어드레스전극(D1 내지 Dm)은 한 방전셀 내에 두개가 배치되는데, 그 중 한 어드레스전극은 상하로 인접한 방전셀에 공유된다. 이렇게 상하 인접된 방전셀에 공유된 어드레스전극에는 어드레스기간 바로 전의 소정시간동안 프라이밍 전압을 인가하여 프라이밍 방전을 일으킨다. 그리고, 나머지 어드레스전극에는 어드레스기간동안 위한 어드레스전압을 인가하여 어드레스방전을 일으킨다. 예를 들어 설명하면, 제1 주사전극(Y1)에 스캔펄스가 공급되는 경우 제1 주사전극(Y1)을 기준으로 상하 방전셀에 공유되는 제2 어드레스전극(D2)은 어드레스방전 전에 일어나는 프라이밍 방전에 사용된다. 이와 아울러 제1 주사전극(Y1)을 기준으로 윗쪽에 위치하는 제1, 4, 7 …어드레스전극(D1, D4, D7, …)은 상부 방전셀의 어드레스방전을 일으키는데 사용되며, 제1 주사전극(Y1)을 기준으로 아래쪽에 위치하는 제3, 6, 9 …어드레스전극(D3, D6, D9, …)은 하부 방전셀의 어드레스방전을 일으키는데 사용된다.
델타형 격벽(50)은 주사 및 유지전극(Y, Z)과 나란하게 형성된 제1 격벽(50a)과, 제1 격벽(50a)들을 상하로 연결시키도록 제1 격벽(50a)과 교차하는 방향으로 형성된 제2 격벽(50b)을 구비한다. 여기서, 델타형 격벽(50)에 의해 R, G, B 서브픽셀들은 삼각형태로 배치된다.
제2 격벽(50b)은 방전셀 내에서 3등분한 제1 격벽(50a)의 1/3의 위치에 형성되어 방전셀 내에 형성된 두개의 어드레스전극들(D) 중 어느 하나가 상하 인접셀에서 공유되도록 한다.
이러한 구조를 가지는 PDP의 구동방법을 도 8과 결부하여 살펴보기로 한다. 여기서, 도 8은 어드레스기간 동안 공급되는 구동파형을 나타낸다.
도 8을 참조하면, 주사전극라인들(Y1 내지 Yn)이 선택되는 시간보다 프라이밍시간(t1)만큼 먼저 스캔펄스가 주사전극라인들(Y1 내지 Yn)에 공급된다. 이에 따라, 어드레스방전이 되기 전에 프라이밍시간(t1) 동안 프라이밍 방전이 발생된다. 프라이밍 방전은 주사전극라인들(Y1 내지 Yn) 중 상하 인접셀과 공유되는 주사전극들과 어드레스전극들(D1 내지 Dm) 사이에서 일어나게 된다.
주사전극라인들(Y1 내지 Yn) 중 n = 3k(k는 0이상의 자연수)을 만족하는 주사전극라인들(Y1 내지 Yn)은 어드레스전극들(D1 내지 Dm) 중 m = 3k(k는 0이상의 자연수)를 만족하는 어드레스전극들(D1 내지 Dm)과 프라이밍 방전을 일으킨다. 또한, 주사전극라인들(Y1 내지 Yn) 중 n = 3k+1(k는 0이상의 자연수)을 만족하는 주사전극라인들(Y1 내지 Yn)은 어드레스전극들(D1 내지 Dm) 중 m = 3k+2(k는 0이상의 자연수)를 만족하는 어드레스전극들(D1 내지 Dm)과 프라이밍 방전을 일으킨다. 이와 마찬가지로, 주사전극라인들(Y1 내지 Yn) 중 n = 3k+2(k는 0이상의 자연수)를 만족하는 주사전극라인들(Y1 내지 Yn)은 어드레스전극들(D1 내지 Dm) 중 m = 3k+1(k는 0이상의 자연수)을 만족하는 어드레스전극들(D1 내지 Dm)과 프라이밍 방전을 일으킨다.
예를 들어 설명하면, 프라이밍방전은 제1 주사전극(Y1)이 선택되는 경우에 제2,5,8 …어드레스전극(D2, D5, D8, …)이 선택되며, 제2 주사전극(Y2)이 선택되는 경우에는 제1,4,7 …어드레스전극(D1, D4, D7, …)이 선택된다.
방전셀 내에 프라이밍 방전을 일으킨 주사전극이 아닌 다른 주사전극의 스캔펄스와 동기되어 어드레스전극들에는 데이터펄스가 인가되어 어드레스방전이 일어난다. 어드레스전극들(D1 내지 Dm)에 공급되는 어드레스전압을 제2 시간(t2)만큼 유지시킨다. 이 어드레스전압이 공급되는 제2 시간(t2)이 짧게 되면 미스라이팅될 수 있으며, 반면에 너무 길게 되면 어드레스전극들(D1 내지 Dm)이 오방전될 수 있다. 따라서, 제2 시간(t2)을 적절하게 설정하여 어드레스방전을 일으킨다.
이렇게 프라이밍방전을 일으킴으로써 다음 어드레스방전하는데 필요한 시간을 단축시킴과 아울러 어드레스방전시 미스라이팅되거나 오방전될 확률을 줄이게 된다. 또한, 먼저 프라이밍방전을 일으킴으로써 어드레스방전에 필요한 어드레스전압을 낮출 수도 있다.
상술한 바와 같이, 본 발명에 따른 PDP는 방전셀마다 어드레스전극이 두개설치됨과 아울러 상하로 인접한 방전셀은 방전셀의 세로격벽이 가로길이의 1/3 위치만큼 어긋나게끔 배치되는 델타형 격벽을 구비한다. 이에 따라, 방전셀 내에 설치된 어드레스전극 중 하나의 어드레스전극은 상하로 인접한 방전셀에서 공유된다. 이 상하 방전셀에서 공유되는 어드레스전극을 프라이밍시간동안 주사전극과 방전시킴으로써 프라임밍방전을 일으킨다. 따라서, 본 발명에 따른 PDP는 어드레스방전 전에 미리 프라이밍방전을 일으킴으로써 어드레스방전의 미스라이팅 또는 오방전이 일어날 확률을 감소시킬 수 있다. 나아가, 본 발명에 따른 PDP는 어드레스방전 시간을 단축시킬 수 있으므로 어드레스전극에 공급되는 어드레스전압을 낮출 수 있다.
이상 설명한 내용을 통해 당업자라면 본 발명의 기술사상을 일탈하지 아니하는 범위에서 다양한 변경 및 수정이 가능함을 알 수 있을 것이다. 따라서, 본 발명의 기술적 범위는 명세서의 상세한 설명에 기재된 내용으로 한정되는 것이 아니라 특허 청구의 범위에 의해 정하여져야만 할 것이다.

Claims (7)

  1. 델타형 격벽과 어드레스방전을 일으키는 주사전극 및 어드레스전극을 포함하는 플라즈마 디스플레이 패널에 있어서,
    상기 어드레스전극은 방전셀 내에 두개 설치되며 그 중 하나의 어드레스전극은 상하로 인접한 방전셀에 공유되는 것을 특징으로 하는 플라즈마 디스플레이 패널.
  2. 제 1 항에 있어서,
    상기 델타형 격벽은 상기 주사전극과 나란한 방향으로 형성되는 제1 격벽들과,
    상기 제1 격벽들과 교차하는 방향으로 상기 제1 격벽들을 연결함과 아울러 방전셀에 해당하는 상기 제1 격벽 길이의 1/3 지점에서 형성되는 제2 격벽을 추가로 구비하는 것을 특징으로 하는 플라즈마 디스플레이 패널.
  3. 방전셀을 초기화하는 리셋방전과 상기 리셋방전 후 켜질 방전셀을 선택하기 위한 어드레스방전을 포함하는 플라즈마 디스플레이 패널의 구동방법에 있어서,
    상기 어드레스방전 전 소정 기간동안 상기 상하로 인접한 방전셀에 동시에 어드레스전압을 공급하여 프라이밍방전을 일으키는 단계를 포함하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  4. 제 3 항에 있어서,
    상기 어드레스방전에 사용되는 어드레스전극은 상기 방전셀 내에 두개 설치되며 그 중 하나의 어드레스전극이 상하 인접된 방전셀에 공유되어 어드레스방전이 일어나기 전에 미리 프라이밍 방전이 일어나는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  5. 제 4 항에 있어서,
    상기 프라이밍 방전은 n = 3k(k는 1이상의 자연수)의 조건을 만족하는 주사전극라인들(Y1 내지 Yn)과 m = 3k(k는 1이상의 자연수)의 조건을 만족하는 어드레스전극들(D1 내지 Dm) 사이에서 일어나는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  6. 제 4 항에 있어서,
    상기 프라이밍 방전은 n = 3k+1(k는 0이상의 자연수)을 만족하는 주사전극라인들(Y1 내지 Yn)과 m = 3k+2(k는 0이상의 자연수)를 만족하는 어드레스전극들(D1 내지 Dm) 사이에서 일어나는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  7. 제 4 항에 있어서,
    상기 프라이밍 방전은 n = 3k+2(k는 0이상의 자연수)를 만족하는 주사전극라인들(Y1 내지 Yn)과 m = 3k+1(k는 0이상의 자연수)을 만족하는 어드레스전극들(D1 내지 Dm) 사이에서 일어나는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
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