KR102581299B1 - 표시장치 및 파워 모니터링 회로 - Google Patents

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Abstract

본 실시예들은, 표시장치 및 파워 모니터링 회로에 관한 것으로서, 더욱 상세하게는, 파워 관리 집적회로 제1 전원이 정상적으로 출력되는지를 모니터링 하여 파워 관리 집적회로 제1 전원이 정상적으로 출력되지 않는 경우, 파워 관리 집적회로의 비 정상 상태를 나타내는 에러 감지 신호를 메인 컨트롤러로 출력하는 파워 모니터링 회로와, 이를 포함하는 표시장치에 관한 것이다.
본 실시예들에 의하면, 표시패널 구동에 필요한 전원을 공급하는 파워 관리 집적회로의 동작 상태를 모니터링 할 수 있다.

Description

표시장치 및 파워 모니터링 회로{ORGANIC LIGHT EMITTING DISPLAY DEVICE AND POWER MONITORING CIRCUIT}
본 실시예들은 표시장치 및 파워 모니터링 회로에 관한 것이다.
정보화 사회가 발전함에 따라 화상을 표시하기 위한 표시장치에 대한 요구가 다양한 형태로 증가하고 있으며, 근래에는 액정표시장치(LCD: Liquid Crystal Display), 플라즈마 표시장치(PDP: Plasma Display Panel), 유기발광표시장치(OLED: Organic Light Emitting Display Device) 등과 같은 여러 가지 표시장치가 활용되고 있다.
이러한 표시장치는 다수의 데이터 라인들 및 다수의 게이트 라인들에 의해 정의되는 다수의 서브픽셀들이 배열된 표시패널과, 다수의 데이터 라인들을 구동하기 위한 데이터 드라이버와, 다수의 게이트 라인들을 구동하기 위한 게이트 드라이버 등을 포함한다.
또한, 표시장치는 표시패널 구동을 위하여, 데이터 드라이버, 게이트 드라이버, 또는 표시패널 등으로 패널 구동에 필요한 각종 전원이 공급되어야 한다.
하지만, 전원 공급원에서 전원이 정상적으로 공급되지 못하는 경우, 표시패널 구동이 정상적으로 이루어지지 못하여 화상 품질 저하 또는 패널 번트 현상 등이 발생할 수 있다.
본 실시예들의 목적은, 표시패널 구동에 필요한 전원을 공급하는 파워 관리 집적회로의 동작 상태를 모니터링 할 수 있는 표시장치 및 파워 모니터링 회로를 제공하는 데 있다.
본 실시예들의 다른 목적은, 표시패널 구동에 필요한 전원을 공급하는 파워 관리 집적회로가 비정상적인 상태(예: 셧 다운 상태)가 되어 패널 컨트롤러가 파워 관리 집적회로의 비정상 상태를 인식하지 못하더라도, 파워 관리 집적회로의 비정상 상태를 모니터링 할 수 있는 표시장치 및 파워 모니터링 회로를 제공하는 데 있다.
일 측면에서, 본 실시예들은, 다수의 데이터 라인들과 다수의 게이트 라인들이 배치된 표시패널과, 다수의 데이터 라인들을 구동하는 데이터 드라이버와, 다수의 게이트 라인들을 구동하는 게이트 드라이버와, 데이터 드라이버 및 게이트 드라이버를 제어하는 패널 컨트롤러와, 데이터 드라이버, 게이트 드라이버, 표시패널, 또는 패널 컨트롤러에 공급될 제1 전원을 출력하는 파워 관리 집적회로를 포함하는 표시장치를 제공할 수 있다.
이러한 표시장치는, 파워 관리 집적회로로부터 제1 전원이 정상적으로 출력되는지를 판단하여, 파워 관리 집적회로의 비 정상 상태를 나타내는 에러 감지 신호를 출력하되, 제1 전원의 비 정상 시, 제2 전원 또는 제2 전원의 대응 전압에 응답하여 에러 감지 신호를 출력하는 파워 모니터링 회로와, 파워 모니터링 회로로 제2 전원을 출력하고, 파워 모니터링 회로로부터 에러 감지 신호를 수신하는 메인 컨트롤러를 더 포함할 수 있다.
다른 측면에서, 본 실시예들은, 파워 관리 집적회로로부터 출력되는 제1 전원을 입력 받는 제1 입력 노드와, 제2 전원을 입력 받는 제2 입력 노드와, 제1 전원의 정상 입력 유무에 따라 파워 관리 집적회로의 비 정상 상태를 나타내는 에러 감지 신호를 출력하는 에러 감지 신호 출력 노드와, 제1 전원의 비 정상 시, 제2 전원 또는 제2 전원의 대응 전압에 대응되는 에러 감지 신호를 출력하는 에러 감지 회로부를 포함하는 파워 모니터링 회로를 제공할 수 있다.
또 다른 측면에서, 본 실시예들은, 다수의 데이터 라인들과 다수의 게이트 라인들이 배치된 표시패널과, 다수의 데이터 라인들을 구동하는 데이터 드라이버와, 다수의 게이트 라인들을 구동하는 게이트 드라이버와, 데이터 드라이버 및 게이트 드라이버를 제어하는 패널 컨트롤러와, 데이터 드라이버, 게이트 드라이버, 표시패널, 또는 패널 컨트롤러에 공급될 제1 전원을 출력하는 파워 관리 집적회로를 포함하는 표시장치를 제공할 수 있다.
이러한 표시장치는, 파워 관리 집적회로로부터 제1 전원이 정상적으로 출력되는지를 판단하여, 파워 관리 집적회로의 비 정상 상태를 나타내는 에러 감지 신호를 출력하되, 제1 전원의 비 정상 시, 제2 전원 또는 제2 전원의 대응 전압에 응답하여 에러 감지 신호를 출력하는 파워 모니터링 회로를 포함할 수 있다.
이상에서 설명한 바와 같은 본 실시예들에 의하면, 표시패널 구동에 필요한 전원을 공급하는 파워 관리 집적회로의 동작 상태를 모니터링 할 수 있는 표시장치 및 파워 모니터링 회로를 제공하는 효과가 있다.
또한, 본 실시예들에 의하면, 표시패널 구동에 필요한 전원을 공급하는 파워 관리 집적회로가 비정상적인 상태(예: 셧 다운 상태)가 되어 패널 컨트롤러가 파워 관리 집적회로의 비정상 상태를 인식하지 못하더라도, 파워 관리 집적회로의 비정상 상태를 모니터링 할 수 있는 표시장치 및 파워 모니터링 회로를 제공하는 효과가 있다.
도 1은 본 실시예들에 따른 유기발광표시장치의 개략적인 시스템 구성도이다.
도 2는 본 실시예들에 따른 유기발광표시장치의 서브픽셀 구조의 예시도이다.
도 3은 본 실시예들에 따른 유기발광표시장치의 서브픽셀 구조의 다른 예시도이다.
도 4는 본 실시예들에 따른 유기발광표시장치의 시스템 구현 예시도이다.
도 5은 본 실시예들에 따른 유기발광표시장치의 패널 컨트롤러, 메인 컨트롤러 및 파워 관리 집적회로를 나타낸 도면이다.
도 6은 본 실시예들에 따른 유기발광표시장치에서, 파워 관리 집적회로의 셧 다운 상황을 나타낸 도면이다.
도 7은 본 실시예들에 따른 유기발광표시장치에서, 파워 관리 집적회로 비정상 상태 검출 회로를 나타낸 도면이다.
도 8은 본 실시예들에 따른 파워 관리 집적회로 비정상 상태 검출 회로 내 파워 모니터링 회로를 나타낸 도면이다.
도 9는 파워 관리 집적회로의 셧 다운 미 발생 시, 파워 모니터링 회로의 동작 상태를 나타낸 도면이다.
도 10은 파워 관리 집적회로의 셧 다운 발생 시, 파워 모니터링 회로의 동작 상태를 나타낸 도면이다.
이하, 본 발명의 일부 실시예들을 예시적인 도면을 참조하여 상세하게 설명한다. 각 도면의 구성요소들에 참조부호를 부가함에 있어서, 동일한 구성요소들에 대해서는 비록 다른 도면상에 표시되더라도 가능한 한 동일한 부호를 가질 수 있다. 또한, 본 발명을 설명함에 있어, 관련된 공지 구성 또는 기능에 대한 구체적인 설명이 본 발명의 요지를 흐릴 수 있다고 판단되는 경우에는 그 상세한 설명은 생략할 수 있다.
또한, 본 발명의 구성 요소를 설명하는 데 있어서, 제 1, 제 2, A, B, (a), (b) 등의 용어를 사용할 수 있다. 이러한 용어는 그 구성 요소를 다른 구성 요소와 구별하기 위한 것일 뿐, 그 용어에 의해 해당 구성 요소의 본질, 차례, 순서 또는 개수 등이 한정되지 않는다. 어떤 구성 요소가 다른 구성요소에 "연결", "결합" 또는 "접속"된다고 기재된 경우, 그 구성 요소는 그 다른 구성요소에 직접적으로 연결되거나 또는 접속될 수 있지만, 각 구성 요소 사이에 다른 구성 요소가 "개재"되거나, 각 구성 요소가 다른 구성 요소를 통해 "연결", "결합" 또는 "접속"될 수도 있다고 이해되어야 할 것이다.
도 1은 본 실시예들에 따른 표시장치(100)의 개략적인 시스템 구성도이다.
도 1을 참조하면, 본 실시예들에 따른 표시장치(100)는, 다수의 데이터 라인(DL) 및 다수의 게이트 라인(GL)이 배치되고, 다수의 데이터 라인(DL) 및 다수의 게이트 라인(GL)에 의해 정의되는 다수의 서브픽셀(SP: Sub Pixel)이 배열된 표시패널(110)과, 다수의 데이터 라인(DL)을 구동하는 데이터 드라이버(120)와, 다수의 게이트 라인(GL)을 구동하는 게이트 드라이버(130)와, 데이터 드라이버(120) 및 게이트 드라이버(130)를 제어하는 패널 컨트롤러(140) 등을 포함한다.
패널 컨트롤러(140)는, 데이터 드라이버(120) 및 게이트 드라이버(130)로 각종 제어신호를 공급하여, 데이터 드라이버(120) 및 게이트 드라이버(130)를 제어할 수 있다.
이러한 패널 컨트롤러(140)는, 각 프레임에서 구현하는 타이밍에 따라 스캔을 시작하고, 외부에서 입력되는 입력 영상 데이터를 데이터 드라이버(120)에서 사용하는 데이터 신호 형식에 맞게 전환하여 전환된 영상 데이터를 출력하고, 스캔에 맞춰 적당한 시간에 데이터 구동을 통제한다.
이러한 패널 컨트롤러(140)는, 통상의 디스플레이 기술에서 이용되는 타이밍 컨트롤러(Timing Controller)이거나, 타이밍 컨트롤러(Timing Controller)를 포함하여 다른 제어 기능도 더 수행하는 제어장치일 수 있다.
이러한 패널 컨트롤러(140)는, 데이터 드라이버(120)와 별도의 부품으로 구현될 수도 있고, 데이터 드라이버(120)와 함께 집적회로로 구현될 수 있다.
데이터 드라이버(120)는, 다수의 데이터 라인(DL)으로 데이터 전압을 공급함으로써, 다수의 데이터 라인(DL)을 구동한다. 여기서, 데이터 드라이버(120)는 '소스 드라이버'라고도 한다.
이러한 데이터 드라이버(120)는, 적어도 하나의 소스 드라이버 집적회로(SDIC: Source Driver Integrated Circuit)를 포함하여 다수의 데이터 라인(DL)을 구동할 수 있다.
각 소스 드라이버 집적회로(SDIC)는, 쉬프트 레지스터(Shift Register), 래치 회로(Latch Circuit), 디지털 아날로그 컨버터(DAC: Digital to Analog Converter), 출력 버퍼(Output Buffer) 등을 포함할 수 있다.
각 소스 드라이버 집적회로(SDIC)는, 경우에 따라서, 아날로그 디지털 컨버터(ADC: Analog to Digital Converter)를 더 포함할 수 있다.
게이트 드라이버(130)는, 다수의 게이트 라인(GL)으로 스캔 신호를 순차적으로 공급함으로써, 다수의 게이트 라인(GL)을 순차적으로 구동한다. 여기서, 게이트 드라이버(130)는 '스캔 드라이버'라고도 한다.
이러한 게이트 드라이버(130)는, 적어도 하나의 게이트 드라이버 집적회로(GDIC: Gate Driver Integrated Circuit)를 포함할 수 있다.
각 게이트 드라이버 집적회로(GDIC)는 쉬프트 레지스터(Shift Register), 레벨 쉬프터(Level Shifter) 등을 포함할 수 있다.
게이트 드라이버(130)는, 패널 컨트롤러(140)의 제어에 따라, 온(On) 전압 또는 오프(Off) 전압의 스캔 신호를 다수의 게이트 라인(GL)으로 순차적으로 공급한다.
데이터 드라이버(120)는, 게이트 드라이버(130)에 의해 특정 게이트 라인이 열리면, 패널 컨트롤러(140)로부터 수신한 영상 데이터를 아날로그 형태의 데이터 전압으로 변환하여 다수의 데이터 라인(DL)으로 공급한다.
데이터 드라이버(120)는, 도 1에서와 같이, 표시패널(110)의 일측(예: 상측 또는 하측)에만 위치할 수도 있고, 경우에 따라서는, 구동 방식, 패널 설계 방식 등에 따라 표시패널(110)의 양측(예: 상측과 하측)에 모두 위치할 수도 있다.
게이트 드라이버(130)는, 도 1에서와 같이, 표시패널(110)의 일 측(예: 좌측 또는 우측)에만 위치할 수도 있고, 경우에 따라서는, 구동 방식, 패널 설계 방식 등에 따라 표시패널(110)의 양측(예: 좌측과 우측)에 모두 위치할 수도 있다.
전술한 패널 컨트롤러(140)는, 입력 영상 데이터와 함께, 수직 동기 신호(Vsync), 수평 동기 신호(Hsync), 입력 데이터 인에이블(DE: DATA Enable) 신호, 클럭 신호(CLK) 등을 포함하는 각종 타이밍 신호들을 외부(예: 호스트 시스템)로부터 수신한다.
패널 컨트롤러(140)는, 데이터 드라이버(120) 및 게이트 드라이버(130)를 제어하기 위하여, 수직 동기 신호(Vsync), 수평 동기 신호(Hsync), 입력 DE 신호, 클럭 신호 등의 타이밍 신호를 입력 받아, 각종 제어 신호들을 생성하여 데이터 드라이버(120) 및 게이트 드라이버(130)로 출력한다.
예를 들어, 패널 컨트롤러(140)는, 게이트 드라이버(130)를 제어하기 위하여, 게이트 스타트 펄스(GSP: Gate Start Pulse), 게이트 쉬프트 클럭(GSC: Gate Shift Clock), 게이트 출력 인에이블 신호(GOE: Gate Output Enable) 등을 포함하는 각종 게이트 제어 신호(GCS: Gate Control Signal)를 출력한다.
여기서, 게이트 스타트 펄스(GSP)는 게이트 드라이버(130)를 구성하는 하나 이상의 게이트 드라이버 집적회로의 동작 스타트 타이밍을 제어한다. 게이트 쉬프트 클럭(GSC)은 하나 이상의 게이트 드라이버 집적회로에 공통으로 입력되는 클럭 신호로서, 스캔 신호(게이트 펄스)의 쉬프트 타이밍을 제어한다. 게이트 출력 인에이블 신호(GOE)는 하나 이상의 게이트 드라이버 집적회로의 타이밍 정보를 지정하고 있다.
또한, 패널 컨트롤러(140)는, 데이터 드라이버(120)를 제어하기 위하여, 소스 스타트 펄스(SSP: Source Start Pulse), 소스 샘플링 클럭(SSC: Source Sampling Clock), 소스 출력 인에이블 신호(SOE: Source Output Enable) 등을 포함하는 각종 데이터 제어 신호(DCS: DATA Control Signal)를 출력한다.
여기서, 소스 스타트 펄스(SSP)는 데이터 드라이버(120)를 구성하는 하나 이상의 소스 드라이버 집적회로의 데이터 샘플링 시작 타이밍을 제어한다. 소스 샘플링 클럭(SSC)은 소스 드라이버 집적회로 각각에서 데이터의 샘플링 타이밍을 제어하는 클럭 신호이다. 소스 출력 인에이블 신호(SOE)는 데이터 드라이버(120)의 출력 타이밍을 제어한다.
본 실시예들에 따른 표시장치(100)는, 액정표시장치, 표시장치, 플라즈마 표시장치 등의 다양한 종류의 디스플레이일 수 있다.
본 실시예들에 따른 표시장치(100)의 종류에 따라 표시패널(110)에 배열된 각 서브픽셀(SP)의 구조도 달라질 수 있다.
예를 들어, 본 실시예들에 따른 표시장치(100)가 표시장치인 경우, 표시패널(110)에 배열된 각 서브픽셀(SP)은 자체 발광 소자인 유기발광다이오드(OLED: Organic Light Emitting Diode)와, 유기발광다이오드(OLED)를 구동하기 위한 구동 트랜지스터(Driving Transistor) 등을 포함하여 구성될 수 있다.
각 서브픽셀(SP)을 구성하는 회로 소자의 종류 및 개수는, 제공 기능 및 설계 방식 등에 따라 다양하게 정해질 수 있다.
아래에서는, 본 실시예들에 따른 표시장치(100)가 표시장치인 경우, 표시패널(110)에 배열된 각 서브픽셀(SP)의 구조를 도 2 및 도 3을 참조하여 예시적으로 설명한다.
도 2는 본 실시예들에 따른 표시장치(100)의 서브픽셀 구조의 예시도이다.
도 2를 참조하면, 본 실시예들에 따른 표시장치(100)에서, 각 서브픽셀(SP)은, 기본적으로, 유기발광다이오드(OLED)와, 유기발광다이오드(OLED)를 구동하는 구동 트랜지스터(DRT: Driving Transistor)와, 구동 트랜지스터(DRT)의 게이트 노드에 해당하는 제1 노드(N1)로 데이터 전압을 전달해주기 위한 제1 트랜지스터(T1)와, 영상 신호 전압에 해당하는 데이터 전압 또는 이에 대응되는 전압을 한 프레임 시간 동안 유지하는 스토리지 캐패시터(Cst: Storage Capacitor)를 포함하여 구성될 수 있다.
유기발광다이오드(OLED)는 제1전극(예: 애노드 전극 또는 캐소드 전극), 유기층 및 제2전극(예: 캐소드 전극 또는 애노드 전극) 등으로 이루어질 수 있다.
유기발광다이오드(OLED)의 제2전극에는 기저 전압(EVSS)이 인가될 수 있다.
구동 트랜지스터(DRT)는 유기발광다이오드(OLED)로 구동 전류를 공급해줌으로써 유기발광다이오드(OLED)를 구동해준다.
구동 트랜지스터(DRT)는 제1 노드(N1), 제2 노드(N2) 및 제3노드(N3)를 갖는다.
구동 트랜지스터(DRT)의 제1 노드(N1)는 게이트 노드에 해당하는 노드로서, 제1 트랜지스터(T1)의 소스 노드 또는 드레인 노드와 전기적으로 연결될 수 있다.
구동 트랜지스터(DRT)의 제2 노드(N2)는 유기발광다이오드(OLED)의 제1전극과 전기적으로 연결될 수 있으며, 소스 노드 또는 드레인 노드일 수 있다.
구동 트랜지스터(DRT)의 제3노드(N3)는 구동 전압(EVDD)이 인가되는 노드로서, 구동 전압(EVDD)을 공급하는 구동전압 라인(DVL: Driving Voltage Line)과 전기적으로 연결될 수 있으며, 드레인 노드 또는 소스 노드일 수 있다.
제1 트랜지스터(T1)는 데이터 라인(DL)과 구동 트랜지스터(DRT)의 제1 노드(N1) 사이에 전기적으로 연결되고, 게이트 라인을 통해 스캔 신호(SCAN)를 게이트 노드로 인가 받아 제어될 수 있다.
이러한 제1 트랜지스터(T1)는 스캔 신호(SCAN)에 의해 턴-온 되어 데이터 라인(DL)으로부터 공급된 데이터 전압(Vdata)을 구동 트랜지스터(DRT)의 제1 노드(N1)로 전달해줄 수 있다.
스토리지 캐패시터(Cst)는 구동 트랜지스터(DRT)의 제1 노드(N1)와 제2 노드(N2) 사이에 전기적으로 연결될 수 있다.
도 3은 본 실시예들에 따른 표시장치(100)의 서브픽셀 구조의 다른 예시도이다.
도 3을 참조하면, 본 실시예들에 따른 표시패널(110)에 배치된 각 서브픽셀은, 일 예로, 유기발광다이오드(OLED), 구동 트랜지스터(DRT), 제1 트랜지스터(T1) 및 스토리지 캐패시터(Cst) 이외에, 제2 트랜지스터(T2)를 더 포함할 수 있다.
도 3을 참조하면, 제2 트랜지스터(T2)는 구동 트랜지스터(DRT)의 제2 노드(N2)와 기준 전압(VREF: Reference Voltage)을 공급하는 기준 전압 라인(RVL: Reference Voltage Line) 사이에 전기적으로 연결되고, 게이트 노드로 스캔 신호의 일종인 센싱 신호(SENSE)를 인가 받아 제어될 수 있다.
전술한 제2 트랜지스터(T2)를 더 포함함으로써, 서브픽셀(SP) 내 구동 트랜지스터(DRT)의 제2 노드(N2)의 전압 상태를 효과적으로 제어해줄 수 있다.
이러한 제2 트랜지스터(T2)는 센싱 신호(SENSE)에 의해 턴-온 되어 기준 전압 라인(RVL)을 통해 공급되는 기준 전압(VREF)을 구동 트랜지스터(DRT)의 제2 노드(N2)에 인가해준다.
또한, 제2 트랜지스터(T2)는 구동 트랜지스터(DRT)의 제2 노드(N2)에 대한 전압 센싱 경로 중 하나로 활용될 수 있다.
한편, 스캔 신호(SCAN) 및 센싱 신호(SENSE)는 별개의 게이트 신호일 수 있다. 이 경우, 스캔 신호(SCAN) 및 센싱 신호(SENSE)는, 서로 다른 게이트 라인을 통해, 제1 트랜지스터(T1)의 게이트 노드 및 제2 트랜지스터(T2)의 게이트 노드로 각각 인가될 수도 있다.
경우에 따라서는, 스캔 신호(SCAN) 및 센싱 신호(SENSE)는 동일한 게이트 신호일 수도 있다. 이 경우, 스캔 신호(SCAN) 및 센싱 신호(SENSE)는 동일한 게이트 라인을 통해 제1 트랜지스터(T1)의 게이트 노드 및 제2 트랜지스터(T2)의 게이트 노드에 공통으로 인가될 수도 있다.
도 2 및 도 3을 참조하면, 구동 트랜지스터(DRT), 제1 트랜지스터(T1) 및 제2 트랜지스터(T2) 각각은, n 타입 또는 p 타입으로도 구현될 수도 있다.
도 2 및 도 3을 참조하면, 스토리지 캐패시터(Cst)는, 구동 트랜지스터(DRT)의 제1 노드(N1)와 제2 노드(N2) 사이에 존재하는 내부 캐패시터(Internal Capacitor)인 기생 캐패시터(예: Cgs, Cgd)가 아니라, 구동 트랜지스터(DRT)의 외부에 의도적으로 설계한 외부 캐패시터(External Capacitor)이다.
도 4는 본 실시예들에 따른 표시장치(100)의 시스템 구현 예시도이다.
데이터 드라이버(120)는, 적어도 하나의 소스 드라이버 집적회로(SDIC: Source Driver Integrated Circuit)를 포함하여 다수의 데이터 라인을 구동할 수 있다.
각 소스 드라이버 집적회로(SDIC)는, 테이프 오토메티드 본딩(TAB: Tape Automated Bonding) 방식 또는 칩 온 글래스(COG: Chip On Glass) 방식으로 표시패널(110)의 본딩 패드(Bonding Pad)에 연결되거나, 표시패널(110)에 직접 배치될 수도 있으며, 경우에 따라서, 표시패널(110)에 집적화되어 배치될 수도 있다.
또한, 각 소스 드라이버 집적회로(SDIC)는, 표시패널(110)에 연결된 필름(SF) 상에 실장 되는 칩 온 필름(COF: Chip On Film) 방식으로 구현될 수도 있다.
게이트 드라이버(130)는, 적어도 하나의 게이트 드라이버 집적회로(GDIC: Gate Driver Integrated Circuit)를 포함할 수 있다.
각 게이트 드라이버 집적회로(GDIC)는, 테이프 오토메티드 본딩(TAB) 방식 또는 칩 온 글래스(COG) 방식으로 표시패널(110)의 본딩 패드(Bonding Pad)에 연결되거나, GIP(Gate In Panel) 타입으로 구현되어 표시패널(110)에 직접 배치될 수도 있으며, 경우에 따라서, 표시패널(110)에 집적화되어 배치될 수도 있다.
또한, 각 게이트 드라이버 집적회로(GDIC)는 표시패널(110)과 연결된 필름(GF) 상에 실장 되는 칩 온 필름(COF) 방식으로 구현될 수도 있다.
본 실시예들에 따른 표시장치(100)는 적어도 하나의 소스 드라이버 집적회로(SDIC)에 대한 회로적인 연결을 위해 필요한 적어도 하나의 소스 인쇄회로기판(SPCB: Source Printed Circuit Board)과 제어 부품들과 각종 전기 장치들을 실장 하기 위한 컨트롤 인쇄회로기판(CPCB: Control Printed Circuit Board)을 포함할 수 있다.
적어도 하나의 소스 인쇄회로기판(SPCB)에는, 적어도 하나의 소스 드라이버 집적회로(SDIC)가 직접 실장 되거나, 적어도 하나의 소스 드라이버 집적회로(SDIC)가 실장 된 필름(SF)이 연결될 수 있다.
컨트롤 인쇄회로기판(CPCB)에는, 데이터 드라이버(120) 및 게이트 드라이버(130) 등의 동작을 제어하는 패널 컨트롤러(140)와, 표시패널(110), 데이터 드라이버(120) 및 게이트 드라이버(130) 등으로 각종 전압 또는 전류를 공급해주거나 공급할 각종 전압 또는 전류를 제어하는 파워 관리 집적회로(PMIC: Power Management IC, 410) 등이 실장 될 수 있다.
적어도 하나의 소스 인쇄회로기판(SPCB)과 컨트롤 인쇄회로기판(CPCB)은 적어도 하나의 연결 부재를 통해 회로적으로 연결될 수 있다.
여기서, 연결 부재는 가요성 인쇄 회로(FPC: Flexible Printed Circuit), 가요성 플랫 케이블(FFC: Flexible Flat Cable) 등일 수 있다.
적어도 하나의 소스 인쇄회로기판(SPCB)과 컨트롤 인쇄회로기판(CPCB)은 하나의 인쇄회로기판으로 통합되어 구현될 수도 있다.
또한, 패널 컨트롤러(140)는 소스 드라이버 집적회로(SDIC)와 통합되어 구현될 수도 있다.
도 4를 참조하면, 본 실시예들에 따른 표시장치(100)는, 표시패널(110)과 그 구동 회로(120, 130, 140) 등을 포함하는 표시모듈을 포함하는 전체 구성들을 제어하는 메인 컨트롤러(420)를 더 포함할 수 있다.
도 5은 본 실시예들에 따른 표시장치(100)의 패널 컨트롤러(140), 메인 컨트롤러(510) 및 파워 관리 집적회로(500)를 나타낸 도면이고, 도 6은 본 실시예들에 따른 표시장치(100)에서, 파워 관리 집적회로(500)의 셧다운 상황을 나타낸 도면이다.
도 5를 참조하면, 본 실시예들에 따른 표시장치(100)는, 컨트롤 인쇄회로기판(CPCB) 내 파워 블록 축소를 위해, 패널 컨트롤러(140)에 입력되는 전원들을 파워 관리 집적회로(PMIC, 410)에서 일괄적으로 출력하는 구조를 갖는다.
도 5 및 도 6을 참조하면, 패널 컨트롤러(140)는 문제 발생 시 에러 감지 신호(EDS)를 메인 컨트롤러(420)로 출력할 수 있다.
예를 들어, 게이트 전압(VGH, VGL) 등의 과전류로 인해 파워 관리 집적회로(410)가 셧다운(Shutdown) 되는 경우, 패널 컨트롤러(140)가 사용하는 동작 전원(PS)이 오프(Off) 될 수 있다. 여기서, 게이트 전압(VGH, VGL) 등의 과전류가 발생하는 표시패널(110)가 번트 되는 현상이 발생할 수 있다.
패널 컨트롤러(140)가 사용하는 동작 전원(PS)의 오프(Off)로 인해, 패널 컨트롤러(140)는 에러 감지 신호(EDS)를 출력하지 못한다.
따라서, 파워 관리 집적회로(410)에서 문제가 발생했음에도 불구하고, 메인 컨트롤러(420)는 패널 컨트롤러(140)로부터 에러 감지 회로(EDS)를 수신하여, 파워 관리 집적회로(410)의 문제 상황에 대하여 조치를 취하지 못하여 표시패널(110)이 번트 되는 현상을 방지해줄 수 없다.
이에, 본 실시예들은, 패널 컨트롤러(140)의 동작 전원(PS)이 오프 되는 상황에서도, 파워 관리 집적회로(410)의 셧다운을 검출할 수 있는 회로를 제공한다.
아래에서는, 본 실시예들에 따른 표시장치(100)에서, 파워 관리 집적회로 비정상 상태 검출 회로를 도 7을 참조하여 설명하고, 도 8 내지 도 10을 참조하여 파워 관리 집적회로 비정상 상태 검출 회로의 내부 회로를 더욱 상세하게 설명한다.
도 7은 본 실시예들에 따른 표시장치(100)에서, 파워 관리 집적회로(410)의 비정상 상태(예: 셧다운)를 검출할 수 있는 파워 관리 집적회로 비정상 상태 검출 회로를 나타낸 도면이다.
도 7을 참조하면, 본 실시예들에 따른 표시장치(100)는, 다수의 데이터 라인들(DL)과 다수의 게이트 라인들(GL)이 배치된 표시패널(110)과, 다수의 데이터 라인들(DL)을 구동하는 데이터 드라이버(120)와, 다수의 게이트 라인들(GL)을 구동하는 게이트 드라이버(130)와, 데이터 드라이버(120) 및 게이트 드라이버(130)를 제어하는 패널 컨트롤러(140)를 포함할 수 있다.
또한, 본 실시예들에 따른 표시장치(100)는, 데이터 드라이버(120), 게이트 드라이버(130), 표시패널(110), 또는 패널 컨트롤러(140)에 공급될 제1 전원(POS)을 출력하는 파워 관리 집적회로(PMIC: Power Management IC, 410)를 포함할 수 있다.
또한, 본 실시예들에 따른 표시장치(100)는, 파워 관리 집적회로(410)로부터 출력되는 제1 전원(POS)을 모니터링 하여, 모니터링 결과를 토대로 파워 관리 집적회로(410)의 셧다운 상황이 검출되면, 에러 감지 신호(EDS)를 출력하는 파워 모니터링 회로(700)를 포함할 수 있다.
파워 모니터링 회로(700)는, 파워 관리 집적회로(410)로부터 제1 전원(POS)이 정상적으로 입력되는지를 판단하여, 파워 관리 집적회로(410)의 비 정상 상태를 나타내는 에러 감지 신호(EDS)를 출력할 수 있다.
파워 모니터링 회로(700)는, 파워 관리 집적회로(410)로부터 제1 전원(POS)을 입력 받지 못하는 상황, 또는 파워 관리 집적회로(410)로부터 입력된 제1 전원(POS)이 비정상적인 상황(예: 해당 전압 값과 다르거나, 해당 전압 값보다 너무 낮거나 너무 높은 경우)을 판단하여, 파워 관리 집적회로(140)가 비정상적 상태(셧다운 상태)로 검출하고, 에러 감지 신호(EDS)를 출력할 수 있다.
더 구체적으로, 파워 모니터링 회로(700)는, 제1 전원(POS)와는 다른 제2 전원(LS)을 입력 받아 이를 이용하여, 파워 관리 집적회로(410)로부터 제1 전원(POS)가 정상적으로 입력되는지를 판단하여, 파워 관리 집적회로(410)의 셧다운 상태를 검출할 수 있다.
파워 모니터링 회로(700)는, 파워 관리 집적회로(410)로부터 출력되는 제1 전원(POS)의 비 정상 시, 제2 전원(LS) 또는 제2 전원(LS)의 대응 전압에 응답하여 에러 감지 신호(EDS)를 출력할 수 있다.
도 7을 참조하면, 메인 컨트롤러(420)는, 파워 모니터링 회로(700)로 제2 전원(LS)을 출력하고, 파워 모니터링 회로(700)로부터 에러 감지 신호(EDS)를 수신할 수 있다.
전술한 파워 관리 집적회로 비정상 상태 검출 회로를 이용하여, 파워 관리 집적회로(410)에서 제1 전원(POS)이 정상적으로 입력되는지를 판단하여, 파워 관리 집적회로(410)의 이상 동작 여부(셧다운 여부)를 검출할 수 있다. 이에 따라, 메인 컨트롤러(420)는 파워 관리 집적회로(410)의 이상 동작(셧다운)에 대한 대응 조치(예: 전원 차단)를 취할 수 있게 되어, 파워 관리 집적회로(410)의 이상 동작(셧다운)에 따른 패널 번트 등의 심각한 문제를 사전에 방지해줄 수 있다.
도 7을 참조하면, 패널 컨트롤러(140)는, 파워 관리 집적회로(410)부터 출력되는 동작 전원(PS)을 이용하여 표시패널(110)의 구동을 제어한다.
파워 관리 집적회로(410)의 이상 발생 시, 동작 전원(PS)이 오프 되어 패널 컨트롤러(140)가 에러 감지 신호(EDS)를 출력하지 못하더라도, 파워 모니터링 회로(700)는, 패널 컨트롤러(140)의 동작 상태가 비정상적인 것으로 판단하여 에러 감지 신호(EDS)를 메인 컨트롤러(420)로 출력할 수 있다.
전술한 바에 따르면, 파워 관리 집적회로(410)의 비 정상 상태로 인해 파워 관리 집적회로(410)에서 패널 컨트롤러(140)의 동작 전원(PS)이 오프 되어 패널 컨트롤러(140)를 통해 파워 관리 집적회로(410)의 비 정상 상태를 확인하지 못하는 상황에서도, 메인 컨트롤러(420)는 파워 모니터링 회로(700)를 통해 파워 관리 집적회로(410)의 비 정상 상태를 확인할 수 있다.
파워 관리 집적회로(410)에서 출력되고 파워 모니터링 회로(700)에 의해 모니터링 되는 제1 전원(POS)은, 일 예로, 파워 관리 집적회로(410)가 게이트 드라이버(130)로 공급하는 게이트 구동 전압(예: VHG, VGL)일 수 있다.
게이트 구동 전압(예: VHG, VGL)이 파워 관리 집적회로(410)에서 출력되지 않는 경우, 게이트 드라이버(130)에서 게이트 구동이 되지 못하여 영상 표시 기능이 전혀 되지 못한다.
또한, 게이트 구동 전압(예: VHG, VGL)이 비 정상인 전압 값으로 파워 관리 집적회로(410)에서 출력되는 경우, 게이트 드라이버(130)에서 게이트 구동이 정상적으로 되지 못하여 영상 표시 기능이 정상적으로 되지 못하여 화면 이상 현상이 발생하거나, 표시패널(110)에 과전류가 발생하게 되어 표시패널(110) 또는 관련 회로가 번트 되는 현상이 발생할 수도 있다.
따라서, 파워 모니터링 회로(700)가 파워 관리 집적회로(410)에서 출력되는 제1 전원(POS)으로서 게이트 구동에 사용되는 게이트 구동 전압(예: VHG, VGL)을 모니터링 함으로써, 게이트 구동과 관련된 이상 현상이나 과전류에 의한 번트 현상을 방지할 수 있다.
다른 예로서, 파워 관리 집적회로(410)에서 출력되고 파워 모니터링 회로(700)에 의해 모니터링 되는 제1 전원(POS)은 데이터 드라이버(120) 또는 표시패널(110)로 공급하는 전원이거나 메모리(예: DDR 메모리)에 공급하는 전압일 수 있다.
데이터 드라이버(120) 또는 표시패널(110)로 공급하는 전원은, 일 예로, 기준 전압(VREF), 구동 전압(EVDD) 등일 수 있다.
전술한 바에 따르면, 파워 모니터링 회로(700)가 파워 관리 집적회로(410)에서 출력되는 제1 전원(POS)으로서 데이터 드라이버(120)의 동작에 사용되는 전원 또는 데이터 드라이버(120)를 통해 표시패널(110)로 공급되는 전원(예: VREF, EVDD) 을 모니터링 함으로써, 데이터 드라이버(120)와 관련된 이상 현상을 방지할 수 있다.
또한, 파워 모니터링 회로(700)가 파워 관리 집적회로(410)에서 출력되는 제1 전원(POS)으로서 메모리 전원을 모니터링 함으로써, 메모리 동작의 이상 현상과 이에 따른 화상 이상 현상을 방지할 수 있다.
도 8은 본 실시예들에 따른 파워 관리 집적회로 비정상 상태 검출 회로 내 파워 모니터링 회로(700)를 나타낸 도면이다. 도 9는 파워 관리 집적회로(500)의 셧다운 미 발생 시, 파워 모니터링 회로(700)의 동작 상태를 나타낸 도면이고, 도 10은 파워 관리 집적회로(500)의 셧다운 발생 시, 파워 모니터링 회로(700)의 동작 상태를 나타낸 도면이다.
단, 도 8 내지 도 10에서는, 파워 관리 집적회로(410)에서 출력되는 제1 전원(POS)이 게이트 전압의 일종인 하이 레벨 게이트 전압(VGH)인 경우를 예로 든다.
도 8을 참조하면, 파워 모니터링 회로(700)는, 게이트 노드가 파워 관리 집적회로(410)의 제1 전원 출력 지점과 연결되고 제1 전원(POS)의 정상 입력 유무에 따라 온-오프가 제어되는 제1 스위치 소자(Q1)와, 제1 스위치 소자(Q1)의 온-오프에 따라 스위칭 동작이 제어되며, 드레인 노드 또는 소스 노드에 제2 전원(LS)이 입력되고, 턴 온 되는 경우 소스 노드 또는 드레인 노드로 에러 감지 신호(EDS)를 출력하는 제2 스위치 소자(Q2)을 포함할 수 있다.
제2 스위치 소자(Q2)는, 제1 스위치 소자(Q1)가 턴-온 되는 경우, 턴-오프 되어 에러 감지 신호(EDS)를 미 출력할 수 있다.
제2 스위치 소자(Q2)는, 제1 스위치 소자(Q1)가 턴-오프 되는 경우, 턴-온 되어 드레인 노드 또는 소스 노드에 입력되는 제2 전원(LS) 또는 제2 전원(LS)의 대응 전압에 따라 에러 감지 신호(EDS)를 소스 노드 또는 드레인 노드로 출력할 수 있다.
전술한 바와 같이, 2개의 스위칭 소자(Q1, Q2)를 이용하여, 파워 관리 집적회로(410)에서 제1 전원(POS, 예: 하이 레벨 게이트 전압(VGH))이 정상적으로 출력되는지를 쉽고 정확하게 모니터링 하여 그 결과에 따라 에러 감지 신호(EDS)를 출력할 수 있는 간단한 회로를 구성할 수 있다.
도 8 및 도 9를 참조하면, 파워 관리 집적회로(410)가 정상적으로 동작하는 경우, 일 예로, 파워 관리 집적회로(410)가 셧다운 되지 않은 경우, 제1 스위치 소자(Q1)의 게이트 노드에 제1 전원(예: VGH) 또는 제1 전원(예: VGH) 의 대응 전압(A 지점의 전압으로서, 저항에 의해 분배된 전압)이 입력됨에 따라 제1 스위치 소자(Q1)가 턴-온 될 수 있다.
제1 스위치 소자(Q1)가 턴-온 된 경우, 제1 스위치 소자(Q1)의 소스 노드(또는 드레인 노드)에 입력된 기저 전압(예: Ground)이 제2 스위치 소자(Q2)의 게이트 노드에 입력됨으로써 제2 스위치 소자(Q2)가 턴-오프 될 수 있다.
도 8 및 도 10을 참조하면, 파워 관리 집적회로(410)가 비 정상적으로 동작하는 경우, 일 예로, 파워 관리 집적회로(410)가 셧다운 된 경우, 제1 스위치 소자(Q1)의 게이트 노드에 제1 전원(예: VGH) 또는 제1 전원(예: VGH)의 대응 전압(A 지점의 전압으로서, 저항에 의해 분배된 전압)이 미 입력되거나 비정상적으로 입력됨에 따라 제1 스위치 소자(Q1)가 턴-오프 될 수 있다.
제1 스위치 소자(Q1)가 턴-오프 된 경우, 제2 전원(LS) 또는 제2 전원(LS)의 대응 전압(B 지점의 전압으로서, 저항에 의해 분배된 전압)이 제2 스위치 소자(Q2)의 게이트 노드에 입력됨으로써 제2 스위치 소자(Q2)가 턴-온 될 수 있다.
파워 관리 집적회로(410)에서의 제1 전원(POS, 예: VGH)의 출력 상태에 따라 2개의 스위칭 소자(Q1, Q2)가 전술한 방식으로 동작할 수 있도록, 제1 전원(POS)은 제1 스위치 소자(Q1)의 턴-온 레벨 전압일 수 있다. 제2 전원(LS) 은 제2 스위치 소자(Q2)의 턴-온 레벨 전압일 수 있다. 기저 전압(예: Ground)은 제2 스위치 소자(Q2)의 턴-오프 레벨 전압일 수 있다.
예를 들어, 제1 전원(POS)는 게이트 드라이버(130)에 공급되는 게이트 전압(VGH, VHGL), 데이트 드라이버(120)에 공급되는 전원(예: VREF, EVDD 등), 메모리 동작 전원 등일 수 있다. 그리고 제2 전원(LS)은 로직(Logic) 전원일 수 있다.
전술한 바와 같이, 파워 관리 집적회로(410)에서 출력되는 제1 전원(POS, 예: VGH)과, 메인 컨트롤러(420)에서 입력되는 제2 전원(LS)에 따라, 2개의 스위칭 소자(Q1, Q2)의 동작 상태를 제어하여, 파워 관리 집적회로(410)에서의 제1 전원(POS, 예: 하이 레벨 게이트 전압(VGH))의 정상 출력 여부에 따라 에러 감지 신호(EDS)를 출력할 수 있게 해주는 회로를 구성해줄 수 있다.
도 8 내지 도 10을 참조하여 설명한 파워 모니터링 회로(700)에 대하여 더욱 상세하게 설명한다. 단, 도 8 내지 도 10에서는 2개의 스위칭 소자(Q1, Q2)가 n 타입의 스위칭 소자(트랜지스터)인 것으로 가정한다.
파워 모니터링 회로(700)는, 파워 관리 집적회로(410)로부터 출력되는 제1 전원(POS)을 입력 받는 제1 입력 노드(IN1)와, 제2 전원(LS)을 입력 받는 제2 입력 노드(IN2)와, 제1 전원(POS)의 정상 입력 유무에 따라 파워 관리 집적회로(410)의 비 정상 상태를 나타내는 에러 감지 신호(EDS)를 출력하는 에러 감지 신호 출력 노드(OUT)와, 제1 전원(POS)의 비 정상 시, 제2 전원(LS) 또는 제2 전원(LS)의 대응 전압에 대응되는 에러 감지 신호(EDS)를 출력하는 에러 감지 회로부(800)를 포함할 수 있다.
전술한 파워 모니터링 회로(700)를 이용하면, 표시패널(110)의 구동에 필요한 전원을 공급하는 파워 관리 집적회로(410)에서 출력되는 제1 전원(POS)의 이상 여부를 모니터링 할 수 있다.
파워 모니터링 회로(700) 내 에러 감지 회로부(800)는, 제1 스위칭 소자(Q1)와 제2 스위칭 소자(Q2)를 포함할 수 있다.
제1 스위칭 소자(Q1)는, 제1 입력 노드(IN1)와 전기적으로 연결되는 게이트 노드와, 제2 입력 노드(IN2)에 전기적으로 연결되는 드레인 노드(또는 소스 노드)와, 기저 전압 노드(Ground)와 전기적으로 연결되는 소스 노드(또는 드레인 노드)를 가질 수 있다.
제2 스위칭 소자(Q2)는, 제1 스위치 소자(Q1)의 드레인 노드(또는 소스 노드)와 전기적으로 연결된 게이트 노드와, 제2 입력 노드(IN2)와 전기적으로 연결된 드레인 노드(또는 소스 노드)와, 에러 감지 신호(EDS)의 출력 노드와 전기적으로 연결된 소스 노드(또는 드레인 노드)를 가질 수 있다.
전술한 바에 따르면, 파워 관리 집적회로(410)에서의 제1 전원(POS, 예: 하이 레벨 게이트 전압(VGH))의 출력 상태에 따라, 파워 관리 집적회로(410)에서 제1 전원(POS, 예: 하이 레벨 게이트 전압(VGH))이 비 정상적으로 출력되는 경우, 에러 감지 신호(EDS)를 출력할 수 있도록 하는 에러 감지 회로부(800)를 2개의 스위칭 소자(Q1, Q2)를 활용한 간단한 회로로 구성할 수 있다.
한편, 제1 입력 노드(IN1)에 입력되는 제1 전원(POS)은 제1 스위칭 소자(Q1)의 최대 허용 전압보다 높은 전압일 수 있다.
이러한 경우, 제1 스위칭 소자(Q1)가 정상적인 스위칭 동작을 하지 못할 수 있다.
따라서, 제1 입력 노드(IN1)에 입력되는 제1 전원(POS)이 제1 스위칭 소자(Q1)의 최대 허용 전압보다 높은 전압인 경우, 제1 입력 노드(IN1)와 기저 전압 노드(Ground) 사이에 2개의 저항(R11, R12)이 직렬로 연결될 수 있다.
제1 스위치 소자(Q1)의 게이트 노드는 2개의 저항(R11, R12)의 연결 지점(A)에 연결될 수 있다.
이에 따라, 제1 스위칭 소자(Q1)의 게이트 노드에는, 2개의 저항(R11, R12)의 전압 분배에 따라, 제1 전원(POS)의 전압보다 낮은 전압(제1 스위칭 소자(Q1)의 최대 허용 전압 이하의 전압)이 인가될 수 있다.
전술한 바에 따르면, 표시장치(100)에서 사용되는 제1 전원(POS)이 제1 스위칭 소자(Q1)의 최대 허용 전압보다 높게 사용되는 경우이더라도, 제1 스위칭 소자(Q1)가 정상적인 스위칭 동작을 할 수 있게 해준다. 이에 따라, 파워 관리 집적회로 셧다운 상황을 정상적으로 검출할 수 있다.
제1 스위치 소자(Q1)의 게이트 노드와 기저 전압 노드(Ground) 사이에 제1 캐패시터(C1)가 연결될 수 있다.
한편, 제2 입력 노드(IN2)에 입력되는 로직 전원일 수 있는 제2 전원(LS)은 제2 스위칭 소자(Q2)의 최대 허용 전압보다 높은 전압일 수 있다.
이러한 경우, 제2 스위칭 소자(Q2)가 정상적인 스위칭 동작을 하지 못할 수 있다.
따라서, 제2 입력 노드(IN2)에 입력되는 제2 전원(LS)이 제2 스위칭 소자(Q2)의 최대 허용 전압보다 높은 전압인 경우, 제2 입력 노드(IN2)와 기저 전압 노드(Ground) 사이에 2개의 저항(R21, R22)이 직렬로 연결될 수 있다.
제1 스위치 소자(Q1)의 드레인 노드(D)와 제2 스위치 소자(Q2)의 게이트 노드(G)는, 2개의 저항(R21, R22)의 연결 지점(B)에 연결될 수 있다.
이에 따라, 제2 스위칭 소자(Q2)의 게이트 노드에는, 2개의 저항(R21, R22)의 전압 분배에 따라, 제2 전원(LS)의 전압보다 낮은 전압(제2 스위칭 소자(Q2)의 최대 허용 전압 이하의 전압)이 인가될 수 있다.
전술한 바에 따르면, 표시장치(100)에서 사용되는 제2 전원(LS)이 제2 스위칭 소자(Q2)의 최대 허용 전압보다 높게 사용되는 경우이더라도, 제2 스위칭 소자(Q2)가 정상적인 스위칭 동작을 할 수 있게 해준다. 이에 따라, 파워 관리 집적회로 셧다운 상황을 정상적으로 검출할 수 있다.
제2 스위치 소자(Q2)의 게이트 노드와 기저 전압 노드(Ground) 사이에 제2 캐패시터(C2)가 연결될 수 있다.
한편, 에러 감지 신호 출력 노드(OUT)에 출력되는 에러 감지 신호(EDS)는 에러 감지 신호(EDS)를 입력 받는 메인 컨트롤러(420)의 최대 허용 전압보다 높은 전압일 수 있다.
이러한 경우, 메인 컨트롤러(420)가 에러 감지 신호(EDS)를 정상적으로 인식하지 못할 수 있다.
따라서, 에러 감지 신호 출력 노드(OUT)에서 출력되는 에러 감지 신호(EDS)가 에러 감지 신호(EDS)를 입력 받는 메인 컨트롤러(420)의 최대 허용 전압보다 높은 전압인 경우, 제2 입력 노드(IN2)와 제2 스위치 소자(Q2)의 드레인 노드(또는 소스 노드)는 저항(R31)을 통해 연결될 수 있다.
이에 따라, 제2 스위치 소자(Q2)의 소스 노드(또는 드레인 노드)에서 에러 감지 신호 출력 노드(OUT)를 통해 출력되는 에러 감지 신호(EDS)가 제2 전원(LS)보다 낮은 전압(메인 컨트롤러(420)의 최대 허용 전압 이하의 전압)의 로직 전원일 수 있다.
또한, 제2 스위치 소자(Q2)의 소스 노드(또는 드레인 노드)와 기저 전압 노드(Ground) 사이에 저항(R32)가 연결되어 있을 수 있다.
전술한 바에 따르면, 제2 전원(LS)보다 낮아져 메인 컨트롤러(420)의 최대 허용 전압 이하의 전압에 해당하는 에러 감지 신호(EDS)가 출력됨으로써, 메인 컨트롤러(420)가 에러 감지 신호(EDS)를 인식하지 못하거나 잘못 인식하는 것을 방지하여, 파워 관리 집적회로 셧다운 현상을 정확하게 검출할 수 있다.
전술한 파워 모니터링 회로(700)는 컨트롤 인쇄회로기판(CPCB) 또는 소스 인쇄회로기판(SPCB) 등에 배치될 수 있다.
이상에서 설명한 바와 같은 본 실시예들에 의하면, 표시패널 구동에 필요한 전원을 공급하는 파워 관리 집적회로(410)의 동작 상태를 모니터링 할 수 있는 표시장치(100) 및 파워 모니터링 회로(700)를 제공하는 효과가 있다.
또한, 본 실시예들에 의하면, 표시패널 구동에 필요한 전원을 공급하는 파워 관리 집적회로(410)가 비정상적인 상태(예: 셧 다운 상태)가 되어 패널 컨트롤러(140)가 파워 관리 집적회로(410)의 비정상 상태를 인식하지 못하더라도, 파워 관리 집적회로(410)의 비정상 상태를 모니터링 할 수 있는 표시장치(100) 및 파워 모니터링 회로(700)를 제공하는 효과가 있다.
이상에서의 설명 및 첨부된 도면은 본 발명의 기술 사상을 예시적으로 나타낸 것에 불과한 것으로서, 본 발명이 속하는 기술 분야에서 통상의 지식을 가진 자라면 본 발명의 본질적인 특성에서 벗어나지 않는 범위에서 구성의 결합, 분리, 치환 및 변경 등의 다양한 수정 및 변형이 가능할 것이다. 따라서, 본 발명에 개시된 실시예들은 본 발명의 기술 사상을 한정하기 위한 것이 아니라 설명하기 위한 것이고, 이러한 실시예에 의하여 본 발명의 기술 사상의 범위가 한정되는 것은 아니다. 본 발명의 보호 범위는 아래의 청구범위에 의하여 해석되어야 하며, 그와 동등한 범위 내에 있는 모든 기술 사상은 본 발명의 권리범위에 포함되는 것으로 해석되어야 할 것이다.
100: 표시장치
110: 표시패널
120: 데이터 드라이버
130: 게이트 드라이버
140: 패널 컨트롤러

Claims (13)

  1. 다수의 데이터 라인들과 다수의 게이트 라인들이 배치된 표시패널;
    상기 다수의 데이터 라인들을 구동하는 데이터 드라이버;
    상기 다수의 게이트 라인들을 구동하는 게이트 드라이버;
    상기 데이터 드라이버 및 상기 게이트 드라이버를 제어하는 패널 컨트롤러;
    상기 데이터 드라이버, 상기 게이트 드라이버, 상기 표시패널, 또는 상기 패널 컨트롤러에 공급될 제1 전원을 출력하는 파워 관리 집적회로;
    상기 파워 관리 집적회로에서 제1 전원이 정상적으로 출력되는지를 판단하여, 상기 파워 관리 집적회로의 비 정상 상태를 나타내는 에러 감지 신호를 출력하되, 상기 제1 전원의 비 정상 시, 제2 전원 또는 상기 제2 전원의 대응 전압에 응답하여 상기 에러 감지 신호를 출력하는 파워 모니터링 회로; 및
    상기 파워 모니터링 회로로 상기 제2 전원을 출력하고, 상기 파워 모니터링 회로로부터 상기 에러 감지 신호를 수신하는 메인 컨트롤러를 포함하는 표시장치.
  2. 제1항에 있어서,
    상기 파워 모니터링 회로는,
    게이트 노드로의 상기 제1 전원의 정상 입력 유무에 따라 온-오프가 제어되는 제1 스위치 소자와,
    상기 제1 스위치 소자의 온-오프에 따라 스위칭 동작이 제어되며, 드레인 노드 또는 소스 노드에 상기 제2 전원이 입력되고, 턴 온 되는 경우 소스 노드 또는 드레인 노드로 상기 에러 감지 신호를 출력하는 제2 스위치 소자를 포함하되,
    상기 제2 스위치 소자는,
    상기 제1 스위치 소자가 턴-온 되는 경우, 턴-오프 되어 상기 에러 감지 신호를 미 출력하고,
    상기 제1 스위치 소자가 턴-오프 되는 경우, 턴-온 되어 드레인 노드 또는 소스 노드에 입력되는 상기 제2 전원 또는 상기 제2 전원의 대응 전압에 따라 상기 에러 감지 신호를 소스 노드 또는 드레인 노드로 출력하는 표시장치.
  3. 제2항에 있어서,
    상기 제1 스위치 소자의 게이트 노드에 상기 제1 전원 또는 상기 제1 전원의 대응 전압이 입력됨에 따라 상기 제1 스위치 소자가 턴-온 되는 경우,
    상기 제1 스위치 소자의 소스 노드 또는 드레인 노드에 입력된 기저 전압이 상기 제2 스위치 소자의 게이트 노드에 입력됨으로써 상기 제2 스위치 소자가 턴-오프 되고,
    상기 제1 스위치 소자의 게이트 노드에 상기 제1 전원 또는 상기 제1 전원의 대응 전압이 미 입력되거나 비정상적으로 입력됨에 따라 상기 제1 스위치 소자가 턴-오프 되는 경우,
    상기 제2 전원 또는 상기 제2 전원의 대응 전압이 상기 제2 스위치 소자의 게이트 노드에 입력됨으로써 제2 스위치 소자가 턴-온 되는 표시장치.
  4. 제3항에 있어서,
    상기 제1 전원은 상기 제1 스위치 소자의 턴-온 레벨 전압이고,
    상기 제2 전원은 상기 제2 스위치 소자의 턴-온 레벨 전압이고,
    상기 기저 전압은 상기 제2 스위치 소자의 턴-오프 레벨 전압인 표시장치.
  5. 제1항에 있어서,
    상기 패널 컨트롤러는,
    상기 파워 관리 집적회로부터 출력되는 동작 전원을 이용하여 상기 표시패널의 구동을 제어하고,
    상기 파워 관리 집적회로의 이상 발생 시, 상기 패널 컨트롤러로 공급되는 동작 전원이 오프 되더라도,
    상기 파워 모니터링 회로는,
    상기 파워 관리 집적회로의 동작 상태가 비정상적인 것으로 판단하여 상기 에러 감지 신호를 상기 메인 컨트롤러로 출력하는 표시장치.
  6. 제1항에 있어서,
    상기 제1 전원은 상기 게이트 드라이버로 공급하는 게이트 구동 전압인 표시장치.
  7. 제1항에 있어서,
    상기 제1 전원은 상기 데이터 드라이버 또는 상기 표시패널로 공급하는 전원이거나 메모리에 공급하는 전원인 표시장치.
  8. 파워 관리 집적회로로부터 출력되는 제1 전원을 입력 받는 제1 입력 노드;
    제2 전원을 입력 받는 제2 입력 노드;
    상기 제1 전원의 정상 입력 유무에 따라 상기 파워 관리 집적회로의 비 정상 상태를 나타내는 에러 감지 신호를 출력하는 에러 감지 신호 출력 노드; 및
    상기 제1 전원의 비 정상 시, 상기 제2 전원 또는 상기 제2 전원의 대응 전압에 대응되는 상기 에러 감지 신호를 출력하는 에러 감지 회로부를 포함하는 파워 모니터링 회로.
  9. 제8항에 있어서,
    상기 에러 감지 회로부는,
    상기 제1 입력 노드와 전기적으로 연결되는 게이트 노드와, 상기 제2 입력 노드에 전기적으로 연결되는 드레인 노드 또는 소스 노드와, 기저 전압 노드와 전기적으로 연결되는 소스 노드 또는 드레인 노드를 갖는 제1 스위치 소자와,
    상기 제1 스위치 소자의 드레인 노드와 전기적으로 연결된 게이트 노드와, 상기 제2 입력 노드와 전기적으로 연결된 드레인 노드 또는 소스 노드와, 상기 에러 감지 신호의 출력 노드와 전기적으로 연결된 소스 노드 또는 드레인 노드를 제2 스위치 소자를 포함하는 파워 모니터링 회로.
  10. 제9항에 있어서,
    상기 제1 입력 노드에 입력되는 상기 제1 전원이 상기 제1 스위치 소자의 최대 허용 전압보다 높은 전압인 경우,
    상기 제1 입력 노드와 기저 전압 노드 사이에 2개의 저항이 직렬로 연결되고,
    상기 제1 스위치 소자의 게이트 노드는 상기 2개의 저항의 연결 지점에 연결되는 파워 모니터링 회로.
  11. 제9항에 있어서,
    상기 제2 입력 노드에 입력되는 상기 제2 전원이 상기 제2 스위치 소자의 최대 허용 전압보다 높은 전압인 경우,
    상기 제2 입력 노드와 기저 전압 노드 사이에 2개의 저항이 직렬로 연결되고,
    상기 제1 스위치 소자의 드레인 노드 또는 소스 노드와 상기 제2 스위치 소자의 게이트 노드는,
    상기 2개의 저항의 연결 지점에 연결되는 파워 모니터링 회로.
  12. 제9항에 있어서,
    상기 제2 입력 노드는 상기 제2 전원을 메인 컨트롤러로부터 입력 받고, 상기 에러 감지 신호 출력 노드는 상기 에러 감지 신호를 상기 메인 컨트롤러로 출력하고,
    상기 에러 감지 신호 출력 노드에서 출력되는 상기 에러 감지 신호가 상기 메인 컨트롤러의 최대 허용 전압보다 높은 전압인 경우,
    상기 제2 입력 노드와 상기 제2 스위치 소자의 드레인 노드 또는 소스 노드는 저항을 통해 연결되는 파워 모니터링 회로.
  13. 다수의 데이터 라인들과 다수의 게이트 라인들이 배치된 표시패널;
    상기 다수의 데이터 라인들을 구동하는 데이터 드라이버;
    상기 다수의 게이트 라인들을 구동하는 게이트 드라이버;
    상기 데이터 드라이버 및 상기 게이트 드라이버를 제어하는 패널 컨트롤러;
    상기 데이터 드라이버, 상기 게이트 드라이버, 상기 표시패널, 또는 상기 패널 컨트롤러에 공급될 제1 전원을 출력하는 파워 관리 집적회로; 및
    상기 파워 관리 집적회로에서 제1 전원이 정상적으로 출력되는지를 판단하여, 상기 파워 관리 집적회로의 비 정상 상태를 나타내는 에러 감지 신호를 출력하되, 상기 제1 전원의 비 정상 시, 제2 전원 또는 상기 제2 전원의 대응 전압에 응답하여 상기 에러 감지 신호를 출력하는 파워 모니터링 회로를 포함하는 표시장치.
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