KR102509192B1 - 액정 표시 장치 - Google Patents

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Abstract

액정 표시 장치가 개시된다. 본 발명의 일 실시예에 따른 액정 표시 장치는서로 대향되어 배치된 제1 기판 및 제2 기판, 상기 제1 기판 및 상기 제2 기판 사이에 배치된 액정층, 상기 제1 기판 상에 배치되고, 제1 방향으로 연장된 제1-1 신호선 및 제1-2 신호선을 포함하는 제1 신호선, 상기 제1 신호선 상에 배치되고, 상기 제1 방향에 수직한 제2 방향으로 연장되며, 상기 제1-1 신호선 및 상기 제1-2 신호선과 교차하는 제2 신호선, 상기 제1 기판의 화소 영역에 배치된 화소 전극, 상기 제1 기판 상에 배치되고, 상기 제1-1 신호선, 및 상기 제1-2 신호선 사이의 제1 영역에 배치되며, 상기 제2 신호선과 적어도 일부가 중첩된 제1 안착부, 상기 제1 안착부 상에 배치되고, 상기 제1 안착부의 적어도 일부와 중첩된 제2 안착부, 및 상기 제2 기판상에 배치되고, 안착면의 적어도 일부가 상기 제2 안착부와 중첩된 컬럼 스페이서를 포함하되, 상기 제1-1 신호선 및 상기 제1-2 신호선 사이에는 상기 화소 전극이 배치되지 않는다.

Description

액정 표시 장치{LIQUID CRYSTAL DISPLAY DEVICE}
본 발명은 액정 표시 장치에 관한 것이다.
표시 장치는 멀티미디어의 발달과 함께 그 중요성이 증대되고 있다. 이에 부응하여 액정 표시 장치(Liquid Crystal Display, LCD), 유기 발광 표시 장치(Organic Light Emitting Display, OLED) 등과 같은 여러 종류의 표시 장치가 사용되고 있다.
그 중 액정 표시 장치는 현재 가장 널리 사용되고 있는 평판 표시 장치 중 하나로서, 화소 전극과 공통 전극 등 전기장 생성 전극(field generating electrode)이 형성되어 있는 두 장의 기판(상판 및 하판)과 그 사이에 개재되는 액정층을 포함한다. 액정 표시 장치는 전기장 생성 전극에 전압을 인가하여 액정층에 전기장을 생성하고, 이를 통하여 액정층의 액정 분자들의 방향을 결정하고 입사광의 편광을 제어함으로써 영상을 표시한다.
상판 및 하판의 사이에 배치된 액정층의 간격을 셀 갭이라 하는데, 셀 갭은 응답속도, 대비비, 시야각, 휘도 균일성 등 액정 표시 장치의 전반적인 동작 특성에 영향을 미친다. 만약, 셀 갭이 일정하지 않으면 화면 전체에 걸쳐 균일한 영상이 표시되지 못하여 화질 불량을 초래할 수 있다. 따라서, 상/하판의 전 영역에 걸쳐서 균일한 셀 갭을 유지하기 위한 컬럼 스페이서의 배치를 고려해 볼 수 있다.
한편, 액정 표시 장치는 일반적으로 하판 상에 액정층을 배치한 후 상판을 합착시켜 제조하게 되는데, 상판과 하판을 합착할 시에 얼라인 미스가 발생할 경우, 상판 또는 하판 중 컬럼 스페이서가 안착되는 면이 불균일하게 되어 상판과 하판간 갭 차이가 발생할 수 있다. 이의 방지를 위해 컬럼 스페이서가 안착되는 면의 면적을 넓게 확보하는 방안을 고려해 볼 수 있으나, 그렇게 되면 화소의 개구부 면적이 줄어 들어 개구율이 감소할 수 있다.
이에, 본 발명이 해결하고자 하는 과제는 컬럼 스페이서의 안정적인 안착면을 확보하되 개구율의 감소를 최소화한 액정 표시 장치를 제공하는 것이다.
상술한 과제를 해결하기 위한 본 발명의 일 실시예에 따른 액정 표시 장치는 서로 대향되어 배치된 제1 기판 및 제2 기판; 상기 제1 기판 및 상기 제2 기판 사이에 배치된 액정층; 상기 제1 기판 상에 배치되고, 제1 방향으로 연장된 제1-1 신호선 및 제1-2 신호선을 포함하는 제1 신호선; 상기 제1 신호선 상에 배치되고, 상기 제1 방향에 수직한 제2 방향으로 연장되며, 상기 제1-1 신호선 및 상기 제1-2 신호선과 교차하는 제2 신호선; 상기 제1 기판의 화소 영역에 배치된 화소 전극; 상기 제1 기판 상에 배치되고, 상기 제1-1 신호선, 및 상기 제1-2 신호선 사이의 제1 영역에 배치되며, 상기 제2 신호선과 적어도 일부가 중첩된 제1 안착부; 상기 제1 안착부 상에 배치되고, 상기 제1 안착부의 적어도 일부와 중첩된 제2 안착부; 및 상기 제2 기판상에 배치되고, 안착면의 적어도 일부가 상기 제2 안착부와 중첩된 컬럼 스페이서를 포함하되, 상기 제1-1 신호선 및 상기 제1-2 신호선 사이에는 상기 화소 전극이 배치되지 않는다.
상기 제1 안착부는 상기 제1 신호선과 동일층에 배치되고, 상기 제2 안착부는 상기 제2 신호선과 동일층에 배치될 수 있다.
상기 제1 안착부는 상기 제1-1 신호선 및 상기 제1-2 신호선으로부터 상기 이격되어 배치되고, 상기 제2 안착부는 상기 제2 신호선과 일체형일 수 있다.
상기 제2 안착부는, 상기 제2 신호선으로부터 상기 제1 방향의 일측으로 분지된 제2-1 안착부, 및 상기 제2 신호선으로부터 상기 일측의 반대측인 타측으로 분지된 제2-2 안착부를 포함할 수 있다.
상기 제1 영역은 제2 방향으로의 일측 또는 상기 일측의 반대측인 타측 중 적어도 하나의 측에 배치된 확장 영역을 포함하고, 상기 제2 신호선은 상기 확장 영역을 가로지를 수 있다.
상기 제1 안착부는 상기 확장 영역의 적어도 일부와 중첩될 수 있다.
상기 제2 안착부 및 상기 안착면은 상기 제1 안착부의 내측에 배치될 수 있다.
상기 안착면은 평면 시점의 형상이 원 형상일 수 있다.
상기 제2 신호선은 상기 안착면을 가로지를 수 있다.
상기 안착면의 일부는 상기 제2 안착부 및 제2 신호선의 외측에 배치될 수 있다.
상기 제1 신호선은 게이트선이고 상기 제2 신호선은 데이터선일 수 있다.
상기 제 2 안착부로부터 제1 방향으로의 일측 및 상기 일측의 반대측인 타측으로 분지된 소스 전극을 더 포함할 수 있다.
상기 제1 신호선과 동일층에 배치된 유지 전극; 및 상기 제2 신호선 상에 배치된 화소 전극을 더 포함하고, 상기 유지 전극의 적어도 일부는 상기 화소 전극과 중첩되고, 상기 유지 전극은 상기 제1-1 신호선의 상기 제2 방향으로의 일측 및 상기 제1-2 신호선의 타측에 배치될 수 있다.
상기 제2 기판 상에 배치된 차광 패턴을 더 포함하고, 상기 차광 패턴은 상기 제1-1 신호선 및 상기 제1-2 신호선 사이 영역과 중첩될 수 있다.
상기 화소 영역의 제2 방향으로의 일측 및 상기 일측의 반대측인 타측으로는 상기 제1 신호선이 배치되고, 상기 화소 영역의 상기 제1 방향으로의 일측 또는 상기 일측의 반대측인 타측 중 어느 하나의 측에만 상기 제2 신호선이 배치되어, 상기 화소 영역은 상기 제1 신호선 및 상기 제2 신호선에 의해 둘러싸이지 않을 수 있다.
상기 제1 안착부와 동일층에 배치된 연결부를 더 포함하고, 상기 연결부의 상기 제2 방향으로의 일단은 상기 제1-1 신호선 또는 상기 제1-2 신호선 중 어느 하나와 연결되고, 상기 연결부의 상기 제2 방향으로의 타단은 상기 제1 안착부와 연결될 수 있다.
상기 제1 안착부는, 상기 제1-1 신호선의 상기 제2 방향으로의 타측으로 분지된 제1-1 안착부, 및 상기 제1-2 신호선의 상기 제2 방향으로의 일측으로 분지된 제1-2 안착부를 포함하고, 상기 제1-1 안착부와 상기 제1-2 안착부는 이격될 수 있다.
상기 제1 영역의 상기 제2 방향으로의 폭은 일정할 수 있다.
상기 제2 안착부는, 상기 제2 신호선으로부터 상기 제2 방향의 일측으로 분지된 제2-1 안착부, 및 상기 제2 신호선으로부터 상기 일측의 반대측인 타측으로 분지된 제2-2 안착부를 포함하고, 상기 제2-1 안착부 및 상기 제2-2 안착부 각각은 상기 제1-1 신호선 및 상기 1-2 신호선과 중첩될 수 있다.
상기 제1-1 안착부는 상기 제2 방향으로의 타단에 형성된 제1 돌기부 및 제1 오목부를 포함하고, 상기 제1-2 안착부는 상기 제2 방향으로의 일단에 형성된 제2 돌기부 및 제2 오목부를 포함하며 상기 제1 돌기부와 상기 제2 오목부는 대향되어 배치되고, 상기 제2 돌기부와 상기 제1 오목부는 대향되어 배치될 수 있다.
본 발명의 일 실시예에 따른 액정 표시 장치는 셀 갭 관련 불량을 개선할 수 있다.
본 발명의 일 실시예에 따른 액정 표시 장치는 개구율의 감소를 최소화하면서 컬럼 스페이서의 안정적인 안착면 확보가 가능할 수 있다.
본 발명의 실시예들에 따른 효과는 이상에서 예시된 내용에 의해 제한되지 않으며, 더욱 다양한 효과들이 본 명세서 내에 포함되어 있다.
도 1은 본 발명의 일 실시예에 따른 액정 표시 장치의 화소 구조를 설명하기 위한 평면도이다.
도 2는 본 발명의 일 실시예에 따른 액정 표시 장치의 레이아웃도이다.
도 3은 도 2의 III-III'선을 따라 절단한 단면도이다.
도 4는 본 발명의 일 실시예에 따른 액정 표시 장치의 컬럼 스페이서 안착면을 설명하기 위한 평면도이다.
도 5는 도 4의 V-V'선을 따라 절단한 단면도이다.
도 6은 본 발명의 다른 실시예에 따른 액정 표시 장치의 컬럼 스페이서 안착면을 설명하기 위한 평면도이다.
도 7 내지 도 9는 본 발명의 또 다른 실시예에 따른 액정 표시 장치의 컬럼 스페이서 안착면을 설명하기 위한 평면도이다.
본 발명의 이점 및 특징, 그리고 그것들을 달성하는 방법은 첨부되는 도면과 함께 상세하게 후술되어 있는 실시예들을 참조하면 명확해질 것이다. 그러나 본 발명은 이하에서 개시되는 실시예들에 한정되는 것이 아니라 서로 다른 다양한 형태로 구현될 것이며, 단지 본 실시예들은 본 발명의 개시가 완전하도록 하며, 본 발명이 속하는 기술분야에서 통상의 지식을 가진 자에게 발명의 범주를 완전하게 알려주기 위해 제공되는 것이며, 본 발명은 청구항의 범주에 의해 정의될 뿐이다. 도면에서 층 및 영역들의 크기 및 상대적인 크기는 설명의 명료성을 위해 과장된 것일 수 있다.
소자(elements) 또는 층이 다른 소자 또는 층의 "위(on)" 또는 "상(on)"으로 지칭되는 것은 다른 소자 또는 층의 바로 위뿐만 아니라 중간에 다른 층 또는 다른 소자를 개재한 경우를 모두 포함한다. 반면, 소자가 "직접 위(directly on)" 또는 "바로 위"로 지칭되는 것은 중간에 다른 소자 또는 층을 개재하지 않은 것을 나타낸다. "및/또는"은 언급된 아이템들의 각각 및 하나 이상의 모든 조합을 포함한다.
이하, 도면을 참조하여 본 발명의 실시예들에 대하여 설명한다.
도 1은 본 발명의 일 실시예에 따른 액정 표시 장치의 화소 구조를 설명하기 위한 평면도이다. 도 2는 본 발명의 일 실시예에 따른 액정 표시 장치의 레이아웃도이다. 도 3은 도 2의 III-III'선을 따라 절단한 단면도이다.
도 1 내지 도 3을 참조하면, 본 발명의 일 실시예에 따른 액정 표시 장치(10)는 서로 대향하는 제1 기판(100), 제2 기판(200), 및 제1 기판(100)과 제2 기판(200) 사이에 개재된 액정층(300)을 포함한다.
제1 기판(100) 및 제2 기판(200)은 투명한 유리, 석영, 세라믹, 실리콘 또는 투명 플라스틱 등의 절연 물질을 포함할 수 있으며, 당업자의 필요에 따라 적절히 선택할 수 있다. 제1 기판(100) 및 제2 기판(200)은 상호 대향하여 배치될 수 있다.
몇몇 실시예에서, 제1 기판(100) 및 제2 기판(200)은 가요성을 가질 수도 있다. 즉, 제1 기판(100) 및 제2 기판(200)은 롤링(rolling), 폴딩(folding), 벤딩(bending) 등으로 형태 변형이 가능한 기판일 수 있다.
제1 기판(100) 상에는 복수의 게이트 배선(102-1 내지 102-6, 104) 및 데이터 배선(132-1 내지 132-4, 134, 136)이 배치될 수 있다.
게이트 배선(102-1 내지 102-6, 104)은 복수의 게이트선(102-1 내지 102-6), 및 복수의 게이트 전극(104)을 포함할 수 있다. 데이터 배선(132-1 내지 132-4, 134, 136)은 복수의 데이터선(132-1 내지 132-4), 복수의 소스 전극(134), 및 복수의 드레인 전극(136)을 포함할 수 있다.
게이트 배선(102-1 내지 102-6, 104) 및 데이터 배선(132-1 내지 132-4, 134, 136)은 알루미늄(Al)과 알루미늄 합금 등 알루미늄 계열의 금속, 은(Ag)과 은 합금 등 은 계열의 금속, 구리(Cu)와 구리 합금 등 구리 계열의 금속, 몰리브덴(Mo)과 몰리브덴 합금 등 몰리브덴 계열의 금속, 크롬(Cr), 티타늄(Ti), 탄탈륨(Ta) 등으로 이루어질 수 있다. 또한, 게이트 배선(102-1 내지 102-6, 104) 및 데이터 배선(132-1 내지 132-4, 134, 136)은 물리적 성질이 다른 두 개의 도전막(미도시)을 포함하는 다중막 구조를 가질 수 있다. 예를 들어, 하나의 도전막은 알루미늄 계열 금속, 은 계열 금속, 구리 계열 금속 등으로 이루어지고, 다른 도전막은 몰리브덴 계열 금속, 크롬, 티타늄, 탄탈륨 등으로 이루어질 수 있다. 이러한 조합의 예로는, 크롬 하부막과 알루미늄 상부막 및 알루미늄 하부막과 몰리브덴 상부막을 들 수 있다. 다만, 본 발명은 이에 한정되지 않으며, 게이트 배선(102-1 내지 102-6, 104) 및 데이터 배선(132-1 내지 132-4, 134, 136)은 다양한 여러 가지 금속과 도전체로 형성될 수 있다.
각 게이트선(102-1 내지 102-6)은 제1 방향(X방향), 예를 들어 행 방향으로 화소의 경계를 따라 연장될 수 있고, 각 데이터선(132-1 내지 132-4)은 제2 방향(Y방향), 예를 들어 화소의 열 방향 경계를 따라 연장될 수 있다.
게이트선(102-1 내지 102-6) 및 데이터선(132-1 내지 132-4)은 교차 배열되어 복수의 화소 영역을 정의할 수 있다. 구체적으로, 제1 기판(100) 및 제2 기판(200)에는 홀수번째 게이트선(102-1, 102-3, 102-5)과 짝수번째 게이트선(102-2, 102-4, 102-6) 사이에 배열된 복수의 화소 영역이 정의될 수 있다. 후술하게 될 화소 전극(152)은 각 화소 영역마다 배치될 수 있다. 보다 구체적으로, 도 1 및 도 2를 참조하면, 게이트선(102-1 내지 102-6)은 제1 게이트선(102-1), 제2 게이트선(102-2), 제3 게이트선(102-3), 제4 게이트선(102-4), 제5 게이트선(102-5), 및 제6 게이트선(102-6)을 포함하고, 홀수번째 게이트선인 제 1 게이트선(102-1)과 짝수번째 게이트선인 제4 게이트선(102-4) 사이 및 짝수번째 게이트선인 제2 게이트선(102-2)과 홀수번째 게이트선인 제2 게이트선(102-2) 사이에 화소 영역이 정의될 수 있다. 다만, 홀수번째 게이트선인 제 1 게이트선(102-1)과 짝수번째 게이트선인 제2 게이트선(102-2) 사이에는 화소 영역이 배치되지 않을 수 있다. 즉, 제 1 게이트선(102-1)과 제2 게이트선(102-2) 사이에는 화소 전극(152)이 배치되지 않을 수 있다. 달리 말해, 1 게이트선(102-1)의 일측(도면상 상측)에 제1 화소 영역이 배치되고, 제2 게이트선(102-2)의 타측(도면상 하측)에 제2 화소 영역이 배치되되, 제1 화소 영역과 제2 화소 영역은 이웃한/인접한 화소 영역일 수 있다.
그리고, 제 1 게이트선(102-1)과 제2 게이트선(102-2) 사이 영역은 후술하게 될 차광 패턴(202)과 중첩될 수 있다.
도 1 및 도 2를 참조하면, 화소 영역의 제2 방향(Y방향)으로의 일측(도면상 상측) 및 위 일측의 반대측인 타측(도면상 하측)에는 게이트선(102-1 내지 102-6)이 배치되고, 화소 영역의 제1 방향(X방향)으로의 일측 또는 위 일측의 반대측인 타측 중 어느 하나의 측에만 데이터선(132-1 내지 132-4)이 배치되어, 화소 영역은 게이트선(102-1 내지 102-6) 및 데이터선(132-1 내지 132-4)에 의해 둘러싸이지 않을 수 있다.
각 화소는 게이트선(102-2, 102-4, 102-6), 데이터선(132-1 내지 132-4), 및 화소 전극(152) 각각과 접속된 박막 트랜지스터(TR)를 포함한다.
몇몇 실시예에서, 화소 매트릭스를 구성하는 복수의 화소들 각각은 적색, 녹색, 청색 화소로 구분될 수 있다. 복수의 화소들은 화소 매트릭스의 행 방향을 따라 적색, 녹색, 청색 화소의 순서가 반복되도록 배열되고, 열 방향을 따라 같은 색의 화소들이 반복되도록 배열될 수 있다.
몇몇 실시예에서, 데이터선(132-1 내지 132-4) 각각은 양측에 위치한 홀수열의 화소들 및 짝수열의 화소들과 공통 접속된다. 보다 구체적으로, 도 1을 참조하면, 각 데이터선(132-1 내지 132-4)은 그 데이터선과 인접하여 일측(예컨대, 도면상 좌측)에 위치한 홀수열의 화소들 각각과 해당 박막 트랜지스터(TR)를 통해 접속되고, 그 데이터선과 인접하여 타측(예컨대, 도면상 우측)에 위치한 짝수열의 화소들 각각과 해당 박막 트랜지스터(TR)를 통해 접속될 수 있다.
그리고, 데이터선(132-1 내지 132-4)과 접속된 홀수열의 화소들과 짝수열의 화소들은 해당 박막 트랜지스터(TR)를 통해 서로 다른 게이트선(102-1 내지 102-6)과 접속되어 순차 구동된다. 다시 말하여, 한 가로줄을 구성하는 적색, 녹색, 청색 화소들 각각은 한 쌍의 게이트선(102-1 내지 102-6), 즉 홀수번째 게이트선과 짝수번째 게이트선 사이(예를 들어, 102-1과 102-4의 사이, 102-2와 102-5의 사이)에 배치되어서, 상기 홀수번째 및 짝수번째 게이트선(102-1 내지 102-6)들 중 어느 하나와 접속될 수 있다. 이때, 동일 행 상에서 같은 데이터선(132-1 내지 132-4)과 접속된 한 쌍의 화소, 즉 홀수열의 화소와 짝수열의 화소는 상기 한 쌍의 게이트선(102-1 내지 102-6) 중 서로 다른 게이트선(102-1 내지 102-6)과 접속되어서 순차 구동될 수 있다.
이에 따라, 게이트선(102-1 내지 102-6)의 수는 2배로 증가되지만 데이터선(132-1 내지 132-4)의 수가 반감되어서, 데이터선(132-1 내지 132-4)을 구동하는 데이터 IC의 수가 절감될 수 있다.
각 게이트선(102-1 내지 102-6)에는 화소마다 적어도 하나의 게이트 전극(104)이 연결되어 배치된다. 게이트 전극(104)은 게이트선(102-1 내지 102-6)으로부터 반도체층(122) 측으로 분지되거나, 게이트선(102-1 내지 102-6)이 확장되어 형성될 수 있다. 그러나, 이에 제한되는 것은 아니며, 게이트선(102-1 내지 102-6)의 연장 경로 상에 반도체층(122)과 오버랩되는 영역에 게이트 전극(104)이 정의될 수도 있다.
각 데이터선(132-1 내지 132-4)에는 화소마다 적어도 하나의 소스 전극(134)이 연결되어 배치된다. 소스 전극(134)은 데이터선(132-1 내지 132-4)으로부터 반도체층(122) 측으로 분지되거나, 데이터선(132-1 내지 132-4)이 확장되어 형성될 수 있다. 그러나, 이에 제한되는 것은 아니며, 데이터선(132-1 내지 132-4)의 연장 경로 상에 반도체층(122)과 오버랩되는 영역에 소스 전극(104)이 정의될 수도 있다. 예를 들어, 소스 전극(104)은 데이터선(132-1 내지 132-4)으로부터 돌출되지 않고 실질적으로 데이터선(132-1 내지 132-4)과 동일선 상에 위치할 수 있다. 드레인 전극(136)은 반도체층(122)을 기준으로 소스 전극(104)과 이격되어 배치될 수 있으며, 보호층(142)을 관통하도록 형성된 컨택홀(136a)을 통해 화소 전극(152)과 전기적으로 연결될 수 있다.
게이트 배선(102-1 내지 102-6, 104)과 데이터 배선(132-1 내지 132-4, 134, 136) 사이에는 게이트 절연막(112)이 배치될 수 있다. 일 실시예에서, 게이트 절연막(112)은 게이트 배선(102-1 내지 102-6, 104) 상에 배치되고, 데이터 배선(132-1 내지 132-4, 134, 136)은 게이트 절연막(112) 상에 배치될 수 있다. 게이트 절연막(112)은 예를 들어, 질화 실리콘(SiNx), 산화 실리콘(SiO2), 실리콘 산질화물(SiON), 또는 이들의 적층막 등으로 이루어질 수 있다. 게이트 절연막(112)은 게이트 배선(102-1 내지 102-6, 104)과 이들의 상부에 위치하는 데이터선(132-1 내지 132-4) 등의 도전성 박막들과의 절연을 유지하는 역할을 할 수 있다.
반도체층(122)은 게이트 절연막(112) 상에 배치되며, 예를 들어, 수소화 비정질 실리콘(hydrogenated amorphous silicon) 또는 다결정 실리콘 등으로 이루어질 수 있다. 반도체층(122)은 게이트 전극(104)과 적어도 일부가 중첩되도록 배치된다. 반도체층(122)은 게이트 전극(104), 소스 전극(134), 및 드레인 전극(136)과 함께 박막 트랜지스터(TR)를 구성한다.
반도체층(122)은 선형 또는 섬형 등 다양한 형상을 가질 수 있으며, 도 2는 반도체층(122)이 선형으로 형성된 경우를 예시하나, 이에 한정되는 것은 아니다. 반도체층(122)이 선형으로 형성된 경우 데이터 배선(132-1 내지 132-4, 134, 136)과 오버랩될 수 있다.
반도체층(122) 상에는 n형 불순물이 고농도로 도핑된 n+ 수소화 비정질 실리콘 등으로 이루어진 저항성 접촉층(124)이 배치될 수 있다. 저항성 접촉층(124)은 하부의 반도체층(122)과 상부의 소스 전극(134) 및 드레인 전극(136) 사이에 위치하여 접촉 저항을 감소시키는 역할을 한다. 저항성 접촉층(124)은 반도체층(122)과 유사하게 섬형 또는 선형 등 다양한 형상을 가질수 있다. 반도체층(122)이 선형인 경우 저항성 접촉층(124)도 선형일 수 있으며, 반도체층(122)이 섬형인 경우 저항성 접촉층(124)도 섬형일 수 있다. 저항성 접촉층(124)은 반도체층(122)과는 달리, 소스 전극(134)과 드레인 전극(136)이 마주보며 이격되어 있는 공간이 분리되어 있어 하부의 반도체층(122)이 노출될 수 있다. 반도체층(122)은 소스 전극(134)과 드레인 전극(136)이 마주보며 이격되어 있는 영역에 채널이 형성될 수 있다.
게이트 전극(104)이 게이트 온 신호를 인가받아 반도체층(122)에 채널이 형성되면, 박막 트랜지스터가 턴온되며 드레인 전극(136)은 소스 전극 (134)으로부터 데이터 신호를 제공받아 이를 화소 전극(152)에 전달할 수 있다.
데이터 배선(132-1 내지 132-4, 134, 136) 및 노출된 반도체층(122) 상에 보호층(142)(passivation layer)이 배치된다. 보호층(142)은 드레인 전극(136)의 적어도 일부를 노출시키는 컨택홀(136a)이 형성될 수 있다. 컨택홀(136a)을 통해 노출된 드레인 전극(136)의 적어도 일부는 화소 전극(152)과 접촉될 수 있다. 이를 통해 드레인 전극(136)과 화소 전극(152)은 전기적으로 연결/접속될 수 있다.
보호층(142)은 예를 들어, 질화 실리콘 또는 산화 실리콘 등의 무기물, 플라즈마 화학 기상 증착(plasma enhanced chemical vapor deposition: PECVD)으로 형성되는 a-Si:C:O, a-Si:O:F 등의 물질 등을 포함할 수 있다.
화소 전극(152)은 보호층(142) 상에 단위 화소마다 배치될 수 있다. 화소 전극(152)의 일부는 컨택홀(136a)의 내부에 배치된다. 컨택홀(136a) 내부에 배치된 화소 전극(152)의 일부는 드레인 전극(136)과 접촉되어 이와 전기적으로 연결될 수 있다.
컨택홀(136a)를 통해 화소 전극(152)에 데이터 전압이 인가되면, 화소 전극(152)은 공통 전극(232)과 함께 전계를 형성하여 액정층(300)에 포함된 액정 분자를 회전시킬 수 있다. 화소 전극(152)은 ITO(indium tin oxide), 또는 IZO(indium zinc oxide) 등의 투명한 도전성 물질을 포함할 수 있으나, 이에 제한되는 것은 아니다.
몇몇 실시예에서, 제1 기판(100) 상에는 유지 전극(106)이 배치될 수 있다. 유지 전극(106)으로는 일정한 전압이 인가될 수 있다. 예를 들어, 유지 전극(106)으로는 공통 전압(232)에 인가되는 전압과 동일한 전압이 인가될 수 있으나, 이에 제한되는 것은 아니다.
유지 전극(106)은 화소 전극(152)의 적어도 일부와 중첩될 수 있다. 몇몇 실시예에서, 유지 전극(106)은 도 2의 실시예에서와 같이 화소 전극(152)의 가장자리와 중첩될 수 있다. 유지 전극(106)은 화소의 경계 영역에 배치될 수 있다. 유지 전극(106)은 도 2의 실시예에서와 같이 데이터선(132-1 내지 132-4)과 중첩될 수 있다.
몇몇 실시예에서, 유지 전극(106)은 게이트 배선(102-1 내지 102-6, 104)과 동일층에 위치하고 동일 물질로 이루어질 수 있다. 다만, 이는 예시적인 것으로, 유지 전극(106)의 배치가 이에 제한되는 것은 아니다.
몇몇 실시예에서, 유지 전극(106)은 제1 게이트선(102-1)의 제2 방향(Y방향)으로의 일측(도 2의 상측) 및 제2 게이트선(102-2)의 제2 방향(Y방향)으로의 타측(도 2의 하측)에 배치될 수 있다.
제2 기판(200) 상에는 차광 패턴(202), 컬러 필터(212), 오버코팅층(222), , 공통 전극(232), 및 컬럼 스페이서(242)가 배치될 수 있다.
제2 기판(200) 상에는 차광 패턴(202)이 배치될 수 있다. 차광 패턴(202)은 빛샘을 방지하는 역할을 한다. 차광 패턴(202)은 박막 트랜지스터(TR) 영역 및 비화소 영역(화소와 화소 사이, 게이트선 및 데이터선 영역)에 배치될 수 있다. 차광 패턴(202)은 화소의 경계를 따라 형성되어 화소 영역을 노출할 수 있다. 이 경우, 차광 패턴(202)은 격자형 패턴일 수 있다.
차광 패턴(202)은 입사하는 빛의 투과를 차단하는 물질로 형성될 수 있다. 차광 효과는 입사광을 반사하거나, 입사광을 흡수함으로써 구현될 수 있다. 예를 들어, 차광 패턴(202)을 크롬 등과 같은 반사율이 높은 금속으로 형성함으로써, 차광 효과를 부여할 수 있다. 다른 예로, 차광 패턴(202)을 블랙 염료나 안료 등과 같은 물질을 포함하는 유기막(블랙 유기막)으로 형성하여, 입사한 대부분의 빛을 흡수하게 함으로써, 차광 효과를 부여할 수 있다. 몇몇 실시예에서, 차광 패턴(202)을 금속막 및 블랙 유기막의 적층막으로 형성할 수도 있다.
몇몇 실시예에서, 차광 패턴(202)은 제1 게이트선(102-1) 및 제2 게이트선(102-2)의 사이 영역인 제1 영역(102a)과 중첩될 수 있다. 구체적으로, 차광 패턴(202)은 제1 영역(102a) 전체와 중첩될 수 있다. 다만, 이는 예시적인 것으로, 이에 제한되는 것은 아니다.컬러 필터(212)는 각 색상을 나타내는 염료 또는 안료를 포함하는 유기막으로 형성될 수 있다. 컬러 필터(212)는 화소 영역을 점유할 수 있다. 컬러 필터(212)는 적색 컬러 필터, 녹색 컬러 필터, 청색 컬러 필터를 포함할 수 있다. 각각의 적색, 녹색, 청색 컬러 필터는 각각 하나의 화소에 형성되어 적색, 녹색, 청색 화소를 형성한다. 컬러 필터(212)는 화소 전극(152)과 오버랩되도록 배치될 수 있다.
컬러 필터(212)는 차광 패턴(202) 상에 배치될 수 있다. 구체적으로, 컬러 필터(212)의 일부는 화소 경계에 위치하는 차광 패턴(202)까지 연장 형성되어, 차광 패턴(202)과 부분적으로 오버랩될 수 있다.
컬러 필터(212) 상에는 오버코팅층(222)이 형성될 수 있다. 오버코팅층(222)은 투명한 유기막으로 형성될 수 있다. 컬러 필터(212) 상에는 오버코팅층(222)이 배치되어 적색 컬러 필터, 녹색 컬러 필터, 청색 컬러 필터의 단차를 평탄화할 수 있다.
오버코팅층(222) 상에는 공통 전극(232)이 배치될 수 있다. 공통 전극(232)은 공통 전압을 인가 받아 화소 전극(152)과 함께 전계를 생성하여 액정층(300)에 포함된 액정 분자의 배향 방향을 제어할 수 있다.
공통 전극(232)은 화소 영역 전체에 걸쳐 일체형으로 형성될 수 있다. 공통 전극(232)은 ITO, 또는 IZO 등의 투명한 도전 물질로 구현될 수 있으나, 이에 제한되는 것은 아니다.액정층(300)을 향하는 제1 기판(100)의 일면 및 제2 기판(200)의 일면에는 도시하지 않았으나 각각 배향막이 배치될 수 있다. 배향막은 폴리이미드,　폴리아믹산,　폴리아미드,　폴리아믹이미드,　폴리에스테르,　폴리에틸렌,　폴리우레탄, 또는　폴리스티렌과 같은 수지성 고분자 또는 이들의 혼합물을 포함할 수 있다. 또한, 배향막은 위 수지성 고분자의 모노머를 포함하여 구현될 수 있다.
제1 기판(100)과 제2 기판(200)의 사이에는 액정층(300)이 개재될 수 있다.액정층(300)은 유전율 이방성을 가지는 복수의 액정 분자들을 포함할 수 있다. 상기 액정 분자들은 제1 기판(100)과 제2 기판(200) 사이에서 상기 두 기판(100, 200)에 수직한 방향으로 배열된 수직 배향형 액정 분자들일 수 있다. 제1 기판(100)과 제2 기판(200) 사이에 전계가 인가되면 상기 액정 분자들이 제1 기판(100)과 제2 기판(200) 사이에서 특정 방향으로 회전함으로써 광을 투과시키거나 차단할 수 있다. 여기서, 회전이라는 용어는 상기 액정 분자들이 실제로 회전하는 것뿐만 아니라, 상기 전계에 의해 액정 분자들의 배향이 바뀐다는 의미를 포함할 수 있다. 몇몇 실시예에서, 액정층(300)은 자외선 등의 광에 의해 중합반응을 하는 반응성 메조겐(reactive mesogen)을 포함하거나, 또는 반응성 메조겐(reactive mesogen)이 중합 반응을 하여 형성된 선경사 제공 중합체를 포함할 수 있다. 상기 선경사 제공 중합체는 제1 기판(100)과 제2 기판(200) 사이에 전계가 형성되지 않은 상태에서도 상기 액정 분자들에 선경사를 제공할 수 있다.
제1 기판(100) 및 제2 기판(200)의 사이에 배치된 액정층(300)의 간격을 셀 갭이라 하는데, 셀 갭은 응답속도, 대비비, 시야각, 휘도 균일성 등 액정 표시 장치(10)의 전반적인 동작 특성에 영향을 미친다. 만약, 셀 갭이 일정하지 않으면 화면 전체에 걸쳐 균일한 영상이 표시되지 못하여 화질 불량을 초래할 수 있다. 따라서, 제1 및 제2 기판(100, 200)의 전 영역에 걸쳐서 균일한 셀 갭을 유지하기 위해 본 발명의 일 실시예에 따른 액정 표시 장치(10)는 컬럼 스페이서를 포함한다.
도 4는 본 발명의 일 실시예에 따른 액정 표시 장치의 컬럼 스페이서 안착면을 설명하기 위한 평면도이다. 도 5는 도 4의 V-V'선을 따라 절단한 단면도이다.
도 4 및 도 5를 참조하면, 컬럼 스페이서(242)는 제1 기판(100)과 제2 기판(200) 사이의 간격을 유지하기 위한 것으로, 몇몇 실시예에서 컬럼 스페이서(242)는 제2 기판(200) 상에 배치될 수 있다. 보다 구체적으로, 컬럼 스페이서(242)는 공통 전극(232) 상에 배치될 수 있다. 컬럼 스페이서(242)의 단부는 도 5의 실시예에서와 같이 제2 기판(200) 측에 맞닿을 수 있다. 다만, 이러한 구조에 제한되는 것은 아니다.
도시하지는 않았으나, 컬럼 스페이서(242)는 단차가 상이한 복수의 컬럼 스페이서를 포함하여 구현될 수 있다. 예를 들어, 상대적으로 단차가 높은 메인 컬럼 스페이서 및 상대적으로 단차가 낮은 서브 컬럼 스페이서를 포함할 수 있다. 이 경우, 제1 기판(100)과 제2 기판(200)의 간격은 일차적으로 메인 컬럼 스페이서에 의해 유지될 수 있으며, 메인 컬럼 스페이서가 기능을 발휘하지 못하는 경우, 이차적으로 서브 컬럼 스페이서에 의해 제1 기판(100)과 제2 기판(200)의 간격이 유지될 수 있다.
몇몇 실시예에서 컬럼 스페이서(242)는 차광성 안료를 포함할 수 있으며, 차광 패턴(202)과 동일한 물질로 이루어질 수 있다. 다만, 이는 예시적인 것으로 이에 제한되는 것은 아니다.
한편, 액정 표시 장치(10)는 일반적으로 제1 기판(100) 상에 액정층(300)을 배치한 후 제2 기판(200)을 합착시켜 제조하게 되는데, 제1 기판(100)과 제2 기판(200)을 합착할 시에 얼라인 미스가 발생할 경우, 제1 기판(100) 또는 제2 기판(200) 중 컬럼 스페이서가 안착되는 면이 불균일하게 되어 제1 기판(100)과 제2 기판(200)간 갭 차이가 발생할 수 있다. 이의 방지를 위해 컬럼 스페이서가 안착되는 면의 면적을 넓게 확보하는 방안을 고려해 볼 수 있으나, 그렇게 되면 화소의 개구부 면적이 줄어 들어 개구율이 감소할 수 있다.
이에, 본 발명의 일 실시예에 따른 액정 표시 장치(10)는 개구율의 감소를 최소화하면서 컬럼 스페이서(242)의 안정적인 안착면 확보가 가능하도록 컬럼 스페이서(242)의 안착면(242a)과 적어도 일부가 중첩된 제1 안착부(108) 및 제2 안착부(132a, 132b)를 포함한다. 제1 안착부(108)는 제1 게이트선(102-1), 및 제2 게이트선(102-2) 사이의 제1 영역(102a)에 배치되며, 데이터선(132-1)과 적어도 일부가 중첩될 수 있다. 제2 안착부(132a, 132b)는 제1 안착부(108) 상에 배치되고, 제1 안착부(108)의 적어도 일부와 중첩될 수 있다. 제1 안착부(108) 및 제2 안착부(132a, 132b)는 화소 영역이 아닌 즉, 화소 전극(152)이 배치되지 않는 제1 게이트선(102-1), 및 제2 게이트선(102-2) 사이의 제1 영역(102a)에 배치됨에 따라 개구율에 미치는 영향은 최소화될 수 있으며, 도 4 및 도 5에 도시된 바와 같이 제1 안착부(108) 및 제2 안착부(132a, 132b)는 컬럼 스페이서(242)의 안착면(242a) 보다 넓은 구조를 가짐에 따라 컬럼 스페이서(242)를 안정적으로 안착시킬 수 있다.
몇몇 실시예에서, 제1 안착부(108)는 도 5의 실시예에서와 같이 게이트선(102-1 내지 102-6)과 동일층에 배치되고, 제2 안착부(132a, 132b)는 데이터선(132-1 내지 132-4)과 동일층에 배치될 수 있다. 다만, 이는 예시적인 것으로 이에 제한되는 것은 아니다.
몇몇 실시예에서, 제1 안착부(108)는 도 4의 실시예에서와 같이 상기 제1 게이트선(102-2) 및 상기 제2 게이트선(102-2)으로부터 이격되어 배치될 수 있다. 즉, 제1 안착부(108)는 상기 제1 게이트선(102-2) 및 상기 제2 게이트선(102-2)과 분리된 형태로 구현될 수 있다. 즉, 제1 안착부(108)는 섬 형상으로 구현될 수 있다.
몇몇 실시예에서, 제1 안착부(108)는 평면 시점상 형상이 도 4의 실시예에서와 같이 팔각 형상일 수 있으나, 이는 예시적인 것으로, 제1 안착부(108)는 평면 시점상 형상은 사각형 등 다각형, 원 또는 타원 등의 다양한 형상으로 구현될 수 있음은 물론이다.
몇몇 실시예에서, 제2 안착부(132a, 132b)는 데이터선(132-1)과 일체형으로 구현될 수 있다. 즉, 제2 안착부(132a, 132b)는 데이터선(132-1)으로부터 분지되어/연장되어 형성될 수 이다. 다만, 이는 예시적인 것으로 이에 제한되는 것은 아니다.
몇몇 실시예에서, 제2 안착부(132a, 132b)는 제2-1 안착부(132a) 및 제2-2 안착부(132b)를 포함할 수 있다. 제2-1 안착부(132a)는 데이터선(132-1)으로부터 제1 방향(X방향)의 일측으로 분지된 구조일 수 있고, 제2-2 안착부(132b) 데이터선(132-1)으로부터 위 일측의 반대측인 타측으로 분지된 구조일 수 있다. 다만, 이는 예시적인 것으로, 다른 실시예에서는 제2-1 안착부(132a) 또는 제2-2 안착부(132b) 중 어느 하나만 포함하여 구현될 수도 있음은 물론이다.
몇몇 실시예에서, 소스 전극(134)은 도 4의 실시예에서와 같이 제2 안착부(132a, 132b)로부터 제1 방향(X방향)으로의 일측 및 위 일측의 반대측인 타측으로 분지된 구조일 수 있다. 구체적으로, 소스 전극(134)은 제2-1 안착부(132a)로부터 제1 방향(X방향)으로의 일측으로 분지될 수 있다. 소스 전극(134)은 제2-2 안착부(132b)로부터 제1 방향(X방향)으로의 타측으로 분지될 수 있다.
제1 게이트선(102-1), 및 제2 게이트선(102-2) 사이의 제1 영역(102a)은 제1 방향(X방향)으로 연장된 형상일 수 있다. 몇몇 실시예에서, 제1 게이트선(102-1), 및 제2 게이트선(102-2) 사이의 제1 영역(102a)은 제2 방향(Y방향)으로의 일측 또는 위 일측의 반대측인 타측 중 적어도 하나의 측에 배치된 확장 영역(102a-1, 102a-2)을 포함할 수 있다. 제2 신호선(132-1)은 확장 영역(102a-1, 102a-2)을 가로지를 수 있다.
몇몇 실시예에서, 확장 영역(102a-1, 102a-2)은 도 4의 실시예에서와 같이 제1 확장 영역(102a-1) 및 제2 확장 영역(102a-2)을 포함할 수 있다. 제1 확장 영역(102a-1)은 제2 방향(Y방향)으로의 일측으로 배치되고, 제2 확장 영역(102a-2)은 제2 방향(Y방향)으로의 타측으로 배치될 수 있다. 이에 따라, 제1 영역(102a)은 부분적으로 확장된 구조로 포함할 수 있다. 다만, 이는 예시적인 것으로, 다른 실시예에서 제1 확장 영역(102a-1) 또는 제2 확장 영역(102a-2) 중 어느 하나만을 포함하여 구현될 수도 있다.
몇몇 실시예에서, 확장 영역(102a-1, 102a-2)의 적어도 일부는 도 4의 실시예에서와 같이 제1 안착부(108)와 중첩될 수 있다. 또한, 확장 영역(102a-1, 102a-2)의 적어도 일부는 제2 안착부(132a, 132b)와 중첩될 수도 있다. 또한, 도시하지는 않았으나 확장 영역(102a-1, 102a-2)의 적어도 일부는 컬럼 스페이서(242)의 안착면(242a)와 중첩될 수도 있다.
몇몇 실시예에서, 제2 안착부(132a, 132b)는 제1 안착부(108)의 내측에 배치될 수 있다. 구체적으로, 제1 안착부(108)의 평면 시점상 면적은 제2 안착부(132a, 132b)의 평면 시점상 면적보다 클 수 있고, 제2 안착부(132a, 132b)는 제1 안착부(108)의 내측에 배치되어 제1 안착부(108)와 완전 중첩될 수 있다. 다만, 이는 예시적인 것으로 제2 안착부(132a, 132b)의 평면 시점상 면적은 제1 안착부(108)의 평면 시점상 면적과 비교하여 실질적으로 같거나 또는 클 수도 있다
몇몇 실시예에서, 컬럼 스페이서(242)의 안착면(242a)은 도 4의 실시예에서와 같이 제2 안착부(132a, 132b) 및 데이터선(132-1)의 내측에 배치될 수 있다. 즉, 안착면(242a)은 제2 안착부(132a, 132b) 및 데이터선(132-1)의 내측에 배치되어 제2 안착부(132a, 132b) 및 데이터선(132-1)과 완전 중첩될 수 있다. 안착면(242a)은 제1 안착부(108)의 내측에 배치될 수 있다. 다만, 이는 예시적인 것으로, 이에 제한되는 것은 아니다.
몇몇 실시예에서, 안착면(242a)은 평면 시점상 형상은 도 4의 실시예에서와 같이 원 형상일 수 있다. 다만, 이는 예시적이 것으로 안착면(242a)은 평면 시점상 형상은 사각형 등 다각형이거나 또는 타원 형상으로 구현될 수도 있음은 물론이다.
몇몇 실시예에서, 데이터선(132-1)은 도 4의 실시예에서와 같이 안착면(242a)을 가로지를 수 있다. 구체적으로, 데이터선(132-1)은 안착면의 중심부를 가로지를 수 있다. 다만, 이는 예시적인 것으로, 이에 제한되는 것은 아니다.
도 6은 본 발명의 다른 실시예에 따른 액정 표시 장치의 컬럼 스페이서 안착면을 설명하기 위한 평면도이다.
도 6을 참조하면, 본 발명의 다른 실시예에 따른 액정 표시 장치(20)는 도 1 내지 도 5를 통해 상술한 액정 표시 장치(10)와 비교하여 컬럼 스페이서(242)의 안착면(242a) 구조가 상이하며, 그 외 나머지 구성은 동일하거나 유사할 수 있다. 이하에서는 중복된 부분을 제외한 차이점 위주로 설명한다.
도 6의 실시예에서 컬럼 스페이서(242)의 안착면(242a-2)은 도 1 내지 도 5를 통해 상술한 액정 표시 장치(10)의 안착면(242a)과 비교하여 도면상 우측으로 위치 이동된 형상이다. 이에 따라, 안착면(242a-2)의 일부는 제2 안착부(132a, 132b) 및 데이터선(132-1)의 외측에 배치될 수 있다. 즉, 안착면(242a-2)의 일부는 제2 안착부(132a, 132b)와 중첩되지 않을 수 있다.
도 7은 본 발명의 또 다른 실시예에 따른 액정 표시 장치의 컬럼 스페이서 안착면을 설명하기 위한 평면도이다.
도 7을 참조하면, 본 발명의 또 다른 실시예에 따른 액정 표시 장치(30)는 도 1 내지 도 5를 통해 상술한 액정 표시 장치(10)와 비교하여 연결부(109) 구조가 상이하며, 그 외 나머지 구성은 동일하거나 유사할 수 있다. 이하에서는 중복된 부분을 제외한 차이점 위주로 설명한다.
본 발명의 다른 실시예에 따른 액정 표시 장치(30)는 도 1 내지 도 5를 통해 상술한 액정 표시 장치(10)와 비교하여 연결부(109)를 더 포함한다. 연결부(109)는 제1 게이트선(102-1)과 동일층에 배치될 수 있다. 연결부(109)의 제2 방향(Y방향)으로의 일단은 제1 게이트선(102-1)과 연결되고, 연결부(109)의 제2 방향(Y방향)으로의 타단은 제1 안착부(108)와 연결될 수 있다. 이에 따라, 제1 게이트선(102-1), 연결부(109), 및 제1 안착부(108)는 전기적으로 연결될 수 있다. 다만 이는 예시적인 것으로, 다른 실시예에서 연결부는 제2 게이트선(102-2) 및 제1 안착부(108)와 연결되는 구조로 구현될 수도 있다.
도 8은 본 발명의 또 다른 실시예에 따른 액정 표시 장치의 컬럼 스페이서 안착면을 설명하기 위한 평면도이다.
도 8을 참조하면, 본 발명의 또 다른 실시예에 따른 액정 표시 장치(40)는 도 1 내지 도 5를 통해 상술한 액정 표시 장치(10)와 비교하여 제1 안착부(108-4a, 108-4b) 구조가 상이하며, 그 외 나머지 구성은 동일하거나 유사할 수 있다. 이하에서는 중복된 부분을 제외한 차이점 위주로 설명한다.
도 8의 실시예에서, 제1 안착부(108-4a, 108-4b)는 제1-1 안착부(108-4a) 및 제1-2 안착부(108-4b)를 포함한다. 제1-1 안착부(108-4a)는 제1 게이트선(102-1)으로부터 제2 방향(Y방향)의 타측(도면상 하측)으로 분지된 형상이고, 제1-2 안착부(108-4b)는 제2 게이트선(102-2)으로부터 제2 방향(Y방향)의 일측(도면상 상측)으로 분지된 형상일 수 있다. 제1 안착부(108-4a, 108-4b)는 제1 게이트선(102-1)과 전기적으로 연결되고, 제1-2 안착부(108-4b)는 제2 게이트선(102-2)과 전기적으로 연결될 수 있다. 다만, 이는 예시적인 것으로, 이에 제한되는 것은 아니다.
제1-1 안착부(108-4a) 및 제1-2 안착부(108-4b)는 소정 간격 이격될 수 있다. 이에 따라, 제1-1 안착부(108-4a) 및 제1-2 안착부(108-4b)는 전기적으로 분리될 수 있다. 예를 들어, 도 8의 실시예에서와 같이 제1-1 안착부(108-4a) 및 제1-2 안착부(108-4b)는 제2 방향(Y방향)으로 소정 간격 이격될 수 있다. 다만, 이는 예시적인 것으로, 다른 실시예에서 제1-1 안착부(108-4a) 및 제1-2 안착부(108-4b)는 제1 방향(X방향)으로 소정 간격 이격된 형상으로 구현될 수도 있음은 물론이다.
본 발명의 또 다른 실시예에 따른 액정 표시 장치(40)의 제1 게이트선(102-1), 및 제2 게이트선(102-2) 사이의 제1 영역(102a-4)은 도 1 내지 도 5를 통해 상술한 액정 표시 장치(10)의 제1 영역(102a)과 비교하여 확장 영역(102a-1, 102a-2)이 제외된 구조일 수 있다. 이에 따라, 제1 영역(102a-4)의 제2 방향(Y방향)으로의 폭은 일정할 수 있다.
도 9는 본 발명의 또 다른 실시예에 따른 액정 표시 장치의 컬럼 스페이서 안착면을 설명하기 위한 평면도이다.
도 9를 참조하면, 본 발명의 또 다른 실시예에 따른 액정 표시 장치(50)는 도 8을 통해 상술한 액정 표시 장치(40)와 비교하여 제1 안착부(108-5a, 108-5b) 구조가 상이하며, 그 외 나머지 구성은 동일하거나 유사할 수 있다. 이하에서는 중복된 부분을 제외한 차이점 위주로 설명한다.
도 9의 실시예에서, 제1 안착부(108-5a, 108-5b)는 제1-1 안착부(108-5a) 및 제1-2 안착부(108-5b)를 포함한다. 제1-1 안착부(108-5a)는 제1 게이트선(102-1)으로부터 제2 방향(Y방향)의 타측(도면상 하측)으로 분지된 형상이고, 제1-2 안착부(108-5b)는 제2 게이트선(102-2)으로부터 제2 방향(Y방향)의 일측(도면상 상측)으로 분지된 형상일 수 있다. 제1 안착부(108-5a, 108-5b)는 제1 게이트선(102-1)과 전기적으로 연결되고, 제1-2 안착부(108-5b)는 제2 게이트선(102-2)과 전기적으로 연결될 수 있다. 다만, 이는 예시적인 것으로, 이에 제한되는 것은 아니다.
제1-1 안착부(108-5a) 및 제1-2 안착부(108-5b)는 소정 간격 이격될 수 있다. 이에 따라, 제1-1 안착부(108-5a) 및 제1-2 안착부(108-5b)는 전기적으로 분리될 수 있다.
제1-1 안착부(108-5a)는 제2 방향(Y방향)으로의 타단에 형성된 제1 돌기부(108-5a-1) 및 제1 오목부(108-5a-2)를 포함하고, 제1-2 안착부(108-5b)는 제2 방향(Y방향)으로의 일단에 형성된 제2 돌기부(108-5b-1) 및 제2 오목부(108-5b-2)를 포함한다. 제1 돌기부(108-5a-1)와 제2 오목부(108-5b-2)는 대향되어 배치되고, 제2 돌기부(108-5b-1)와 제1 오목부(108-5a-2)는 대향되어 배치될 수 있다. 이에 따라, 제1-1 안착부(108-5a) 및 제1-2 안착부(108-5b)간 이격된 영역의 평면 시점상 형상은 도 9의 실시예에서와 같이 지그재그 형상일 수 있다.
이상에서 본 발명의 실시예를 중심으로 설명하였으나 이는 단지 예시일 뿐 본 발명을 한정하는 것이 아니며, 본 발명이 속하는 분야의 통상의 지식을 가진 자라면 본 발명의 실시예의 본질적인 특성을 벗어나지 않는 범위에서 이상에 예시되지 않은 여러 가지의 변형과 응용이 가능함을 알 수 있을 것이다. 예를 들어, 본 발명의 실시예에 구체적으로 나타난 각 구성 요소는 변형하여 실시할 수 있다. 그리고 이러한 변형과 응용에 관계된 차이점들은 첨부된 청구 범위에서 규정하는 본 발명의 범위에 포함되는 것으로 해석되어야 할 것이다.
100: 제1 기판
200: 제2 기판
300: 액정층
102-1, 102-2, 102-3, 102-4, 102-5, 102-6: 게이트선
104: 게이트 전극
106: 유지 전극
108: 제1 안착부
112: 게이트 절연막
122: 반도체층
124: 저항성 접촉층
132-1, 132-2, 132-3, 132-4: 데이터선
132a, 132b: 제2 안착부
134: 소스 전극
136: 드레인 전극
142: 보호층
152: 화소 전극
202: 차광 패턴
212: 컬러 필터
222: 오버코팅층
232: 공통 전극
242: 컬럼 스페이서

Claims (20)

  1. 서로 대향되어 배치된 제1 기판 및 제2 기판;
    상기 제1 기판 및 상기 제2 기판 사이에 배치된 액정층;
    상기 제1 기판 상에 배치되고, 제1 방향으로 연장된 제1-1 신호선 및 제1-2 신호선을 포함하는 제1 신호선;
    상기 제1 신호선 상에 배치되고, 상기 제1 방향에 수직한 제2 방향으로 연장되며, 상기 제1-1 신호선 및 상기 제1-2 신호선과 교차하는 제2 신호선;
    상기 제1 신호선은 게이트선이고 상기 제2 신호선은 데이터선이며,
    상기 제1 기판의 화소 영역에 배치된 화소 전극;
    상기 제1-1 신호선 및 상기 제1-2 신호선 사이에는 상기 화소 전극이 배치되지 않고,
    상기 제1-1 신호선 및 상기 제1-2 신호선 사이의 제1 영역;
    상기 제1 기판 상의 상기 제1 영역에 배치되고, 상기 제2 신호선과 적어도 일부가 중첩된 제1 안착부;
    상기 제1 안착부 상에 배치되고, 상기 제1 안착부의 적어도 일부와 중첩된 제2 안착부; 및
    상기 제2 기판 상에 배치되고, 적어도 안착면의 일부가 상기 제2 안착부와 중첩된 컬럼 스페이서를 포함하는 액정 표시 장치.
  2. 제1항에 있어서,
    상기 제1 안착부는 상기 제1 신호선과 동일층에 배치되고, 상기 제2 안착부는 상기 제2 신호선과 동일층에 배치된 액정 표시 장치.
  3. 제1항에 있어서,
    상기 제1 안착부는 상기 제1-1 신호선 및 상기 제1-2 신호선으로부터 이격되어 배치되고,
    상기 제2 안착부는 상기 제2 신호선과 일체형인 액정 표시 장치.
  4. 제3항에 있어서,
    상기 제2 안착부는 상기 제2 신호선으로부터 상기 제1 방향의 일측으로 분지된 제2-1 안착부; 및
    상기 제2 신호선으로부터 상기 일측의 반대측인 타측으로 분지된 제2-2 안착부를 포함하는 액정 표시 장치.
  5. 제3항에 있어서,
    상기 제1 영역은 상기 제2 방향으로의 일측 또는 상기 일측의 반대측인 타측 중 적어도 하나의 측에 배치된 확장 영역을 포함하고,
    상기 제2 신호선은 상기 확장 영역을 가로지르는 액정 표시 장치.
  6. 제5항에 있어서,
    상기 제1 안착부는 상기 확장 영역의 적어도 일부와 중첩된 액정 표시 장치.
  7. 제1항에 있어서,
    상기 제2 안착부 및 상기 안착면은 상기 제1 안착부의 내측에 배치된 액정 표시 장치.
  8. 제1항에 있어서,
    상기 안착면은 평면 시점의 형상이 원 형상인 액정 표시 장치.
  9. 제1항에 있어서,
    상기 제2 신호선은 상기 안착면을 가로 지르는 액정 표시 장치.
  10. 제1항에 있어서,
    상기 안착면의 일부는 상기 제2 안착부 및 상기 제2 신호선의 외측에 배치된 액정 표시 장치.
  11. 삭제
  12. 제1항에 있어서,
    상기 제2 안착부로부터 제1 방향으로의 일측 및 상기 일측의 반대측인 타측으로 분지된 소스 전극을 더 포함하는 액정 표시 장치.
  13. 제1항에 있어서,
    상기 제1 신호선과 동일층에 배치된 유지 전극; 및
    상기 제2 신호선 상에 배치된 화소 전극을 더 포함하고,
    상기 유지 전극의 적어도 일부는 상기 화소 전극과 중첩되고,
    상기 유지 전극은 상기 제1-1 신호선의 상기 제2 방향으로의 일측 및 상기 제1-2 신호선의 타측에 배치된 액정 표시 장치.
  14. 제1항에 있어서,
    상기 제2 기판 상에 배치된 차광 패턴을 더 포함하고,
    상기 차광 패턴은 상기 제1-1 신호선 및 상기 제1-2 신호선 사이 영역과 중첩된 액정 표시 장치.
  15. 제1항에 있어서,
    상기 화소 영역의 상기 제2 방향으로의 일측 및 상기 일측의 반대측인 타측으로는 상기 제1 신호선이 배치되고,
    상기 화소 영역의 상기 제1 방향으로의 일측 또는 상기 일측의 반대측인 타측 중 어느 하나의 측에만 상기 제2 신호선이 배치되어,
    상기 화소 영역은 상기 제1 신호선 및 상기 제2 신호선에 의해 둘러싸이지 않은 액정 표시 장치.
  16. 서로 대향되어 배치된 제1 기판 및 제2 기판;
    상기 제1 기판 및 상기 제2 기판 사이에 배치된 액정층;
    상기 제1 기판 상에 배치되고, 제1 방향으로 연장된 제1-1 신호선 및 제1-2 신호선을 포함하는 제1 신호선;
    상기 제1 신호선 상에 배치되고, 상기 제1 방향에 수직한 제2 방향으로 연장되며, 상기 제1-1 신호선 및 상기 제1-2 신호선과 교차하는 제2 신호선;
    상기 제1 신호선은 게이트선이고 상기 제2 신호선은 데이터선이며,
    상기 제1 기판의 화소 영역에 배치된 화소 전극;
    상기 제1-1 신호선 및 상기 제1-2 신호선 사이에는 상기 화소 전극이 배치되지 않고,
    상기 제1-1 신호선 및 상기 제1-2 신호선 사이의 제1 영역;
    상기 제1 기판 상의 상기 제1 영역에 배치되고, 상기 제2 신호선과 적어도 일부가 중첩된 제1 안착부;
    상기 제1 안착부 상에 배치되고, 상기 제1 안착부의 적어도 일부와 중첩된 제2 안착부; 및
    상기 제2 기판 상에 배치되고, 안착면의 적어도 일부가 상기 제2 안착부와 중첩된 컬럼 스페이서를 포함하되,
    상기 제1 안착부와 동일층에 배치된 연결부를 더 포함하고,
    상기 연결부의 상기 제2 방향으로의 일단은 상기 제1-1 신호선 또는 상기 제1-2 신호선 중 어느 하나와 연결되고,
    상기 연결부의 상기 제2 방향으로의 타단은 상기 제1 안착부와 연결된 액정 표시 장치.
  17. 서로 대향되어 배치된 제1 기판 및 제2 기판;
    상기 제1 기판 및 상기 제2 기판 사이에 배치된 액정층;
    상기 제1 기판 상에 배치되고, 제1 방향으로 연장된 제1-1 신호선 및 제1-2 신호선을 포함하는 제1 신호선;
    상기 제1 신호선 상에 배치되고, 상기 제1 방향에 수직한 제2 방향으로 연장되며, 상기 제1-1 신호선 및 상기 제1-2 신호선과 교차하는 제2 신호선;
    상기 제1 신호선은 게이트선이고 상기 제2 신호선은 데이터선이며,
    상기 제1 기판의 화소 영역에 배치된 화소 전극;
    상기 제1-1 신호선 및 상기 제1-2 신호선 사이에는 상기 화소 전극이 배치되지 않고,
    상기 제1-1 신호선 및 상기 제1-2 신호선 사이의 제1 영역;
    상기 제1 기판 상의 상기 제1 영역에 배치되고, 상기 제2 신호선과 적어도 일부가 중첩된 제1 안착부;
    상기 제1 안착부 상에 배치되고, 상기 제1 안착부의 적어도 일부와 중첩된 제2 안착부; 및
    상기 제2 기판 상에 배치되고, 안착면의 적어도 일부가 상기 제2 안착부와 중첩된 컬럼 스페이서를 포함하되,
    상기 제1 안착부는,
    상기 제1-1 신호선의 상기 제2 방향으로의 타측으로 분지된 제1-1 안착부, 및 상기 제1-2 신호선의 상기 제2 방향으로의 일측으로 분지된 제1-2 안착부를 포함하고, 상기 제1-1 안착부와 상기 제1-2 안착부는 이격된 액정 표시 장치.
  18. 제17항에 있어서,
    상기 제1 영역의 상기 제2 방향으로의 폭은 일정한 액정 표시 장치.
  19. 제17항에 있어서,
    상기 제2 안착부는 상기 제2 신호선으로부터 상기 제1 방향의 일측으로 분지된 제2-1 안착부, 및
    상기 제2 신호선으로부터 상기 일측의 반대측인 타측으로 분지된 제2-2 안착부를 포함하고,
    상기 제2-1 안착부 및 상기 제2-2 안착부 각각은 상기 제1-1 신호선 및 상기 제1-2 신호선과 중첩된 액정 표시 장치.
  20. 제19항에 있어서,
    상기 제1-1 안착부는 상기 제2 방향으로의 타단에 형성된 제1 돌기부 및 제1 오목부를 포함하고,
    상기 제1-2 안착부는 상기 제2 방향으로의 일단에 형성된 제2 돌기부 및 제2 오목부를 포함하며
    상기 제1 돌기부와 상기 제2 오목부는 대향되어 배치되고, 상기 제2 돌기부와 상기 제1 오목부는 대향되어 배치된 액정 표시 장치.
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