KR102508898B1 - 디스플레이 구동 장치 및 이를 포함하는 디스플레이 장치 - Google Patents

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Abstract

본 발명의 실시 예들에 따른 디스플레이 패널을 구동하는 디스플레이 구동 장치(display driver integrated circuit)는, 제1영상 신호를 출력하도록 구성되는 제1구동 회로, 제2영상 신호를 출력하도록 구성되는 제2구동 회로, 상기 제1구동 회로와 연결되고, 제1라인 동안 제1스위칭 신호에 기초하여 상기 제1영상 신호를 상기 디스플레이 패널에 배열되는 서브 픽셀들의 제1세트 중 일부로 전송하도록 구성되는 제1스위치 회로 및 상기 제2구동 회로와 연결되고, 상기 제1라인 동안 제2스위칭 신호에 기초하여 상기 제2영상 신호를 상기 서브 픽셀들의 제1세트와 인접하여 상기 디스플레이 패널에 배열되는 서브 픽셀들의 제2세트의 일부로 전송하도록 구성되는 제2스위치 회로를 포함하고, 상기 제1라인에서, 상기 제1스위칭 신호의 폭과 상기 제2스위칭 신호의 폭은 서로 다르다.

Description

디스플레이 구동 장치 및 이를 포함하는 디스플레이 장치{DISPLAY DRIVER DEVICE AND DISPLAY DEVICE INCLUDING THE SAME}
본 발명의 실시 예들은 디스플레이 구동 장치 및 이를 포함하는 디스플레이 장치에 관한 것으로, 상기 디스플레이 구동 장치에서 사용되는 신호들의 타이밍을 조절하여 노이즈를 감소시킬 수 있는 디스플레이 구동 장치 및 이를 포함하는 디스플레이 장치에 관한 것이다.
최근 디스플레이 구동 장치(또는 구동 회로)에서 점점 더 많은 데이터의 처리를 하게 됨으로써, 구동 장치에서 사용하는 전류량이 점점 증가하고 있다. 특히, 평판 디스플레이 장치의 표시화면 크기의 확대와 고해상도 및 패널의 화질 개선으로 인하여 패널에서의 전자기파 간섭(electro magnetic interference (EMI))로 인한 노이즈 발생 확률이 증가하고 있다.
이러한 EMI에 의해 생성된 노이즈는 디스플레이의 구동 장치를 위한 각종 신호의 일시적 출력으로 인하여 패널에서 발생하는 것으로서, 디스플레이 구동 장치의 오작동을 야기할 수 있다.
본 발명이 해결하고자 하는 과제는, 디스플레이 구동 장치에서 사용되는 신호들의 타이밍을 조절함으로써 상기 디스플레이 구동 장치에서 생성된 EMI에 의한 노이즈를 감소시킬 수 있는 디스플레이 구동 장치 및 이를 포함하는 디스플레이 장치를 제공하는 것에 있다.
본 발명의 실시 예들에 따른 디스플레이 패널을 구동하는 디스플레이 구동 장치는, 제1영상 신호를 출력하도록 구성되는 제1구동 회로, 제2영상 신호를 출력하도록 구성되는 제2구동 회로, 상기 제1구동 회로와 연결되고, 제1라인 동안 제1스위칭 신호에 기초하여 상기 제1영상 신호를 상기 디스플레이 패널에 배열되는 서브 픽셀들의 제1세트 중 일부로 전송하도록 구성되는 제1스위치 회로 및 상기 제2구동 회로와 연결되고, 상기 제1라인 동안 제2스위칭 신호에 기초하여 상기 제2영상 신호를 상기 서브 픽셀들의 제1세트와 인접하여 상기 디스플레이 패널에 배열되는 서브 픽셀들의 제2세트의 일부로 전송하도록 구성되는 제2스위치 회로를 포함하고, 상기 제1라인에서, 상기 제1스위칭 신호의 폭과 상기 제2스위칭 신호의 폭은 서로 다르다.
본 발명의 실시 예들에 따른 디스플레이 장치는, 디스플레이 패널과 상기 디스플레이 패널을 구동하는 디스플레이 구동 장치를 포함하고, 상기 디스플레이 패널은 상기 디스플레이 패널에 배열되는 서브 픽셀들을 포함하고, 상기 디스플레이 구동 장치는, 제1영상 신호를 출력하도록 구성되는 제1구동 회로, 제2영상 신호를 출력하도록 구성되는 제2구동 회로, 상기 제1구동 회로와 연결되고, 제1라인 동안 제1스위칭 신호에 기초하여 상기 제1영상 신호를 상기 서브 픽셀들의 제1세트 중 일부로 전송하도록 구성되는 제1스위치 회로 및 상기 제2구동 회로와 연결되고, 상기 제1라인 동안 제2스위칭 신호에 기초하여 상기 제2영상 신호를 상기 서브 픽셀들의 제1세트와 인접하여 배열되는 서브 픽셀들의 제2세트의 일부로 전송하도록 구성되는 제2스위치 회로를 포함하고, 상기 제1라인에서, 상기 제1스위칭 신호의 폭과 상기 제2스위칭 신호의 폭은 서로 다르다.
본 발명의 실시 예들에 따른 디스플레이 구동 장치는, 복수 개의 픽셀들이 나란히 배치되는 디스플레이 패널을 구동하고, 상기 복수 개의 픽셀들 중 홀수 번째 픽셀로 제1영상 신호를 출력하도록 구성되는 제1구동 회로부, 상기 복수 개의 픽셀들 중 짝수 번째 픽셀로 제2영상 신호를 출력하도록 구성되는 제2구동 회로부, 상기 홀수 번째 픽셀과 상기 제1구동 회로부 사이에 배치되고, 상기 홀수 번째 픽셀과 상기 제1구동 회로부를 연결하기 위한 스위칭 작동을 수행하도록 구성되는 제1스위치 회로부 및 상기 짝수 번째 픽셀과 상기 제2구동 회로부 사이에 배치되고, 상기 짝수 번째 픽셀과 상기 제2구동 회로부를 연결하기 위한 스위칭 작동을 수행하도록 구성되는 제2스위치 회로부를 포함하고, 상기 제1스위치 회로부들의 스위칭 타이밍과 상기 제2스위치 회로부들의 스위칭 타이밍은 서로 다르다.
본 발명의 실시 예들에 따른 디스플레이 구동 장치는 스위칭 신호들의 타이밍을 다르게 설정함으로써 스위치 회로부의 스위칭 타이밍을 상이하게 할 수 있으므로, EMI에 의한 노이즈가 감소하는 효과가 있다.
본 발명의 실시 예들에 따른 디스플레이 구동 장치는 선택 신호들의 타이밍을 다르게 설정함으로써 화소 데이터의 선택 타이밍을 상이하게 할 수 있으므로, EMI에 의한 노이즈가 감소하는 효과가 있다.
도 1은 본 발명의 실시 예들에 따른 디스플레이 장치를 개념적으로 나타낸다.
도 2는 본 발명의 실시 예들에 따른 디스플레이 패널과 디스플레이 구동 장치를 개념적으로 나타낸다.
도 3은 본 발명의 실시 예들에 따른 디스플레이 구동 장치에서 사용되는 스위칭 신호와 선택 신호를 나타내는 다이어그램이다.
도 4는 본 발명의 실시 예들에 따른 디스플레이 구동 장치의 작동을 설명하기 위한 타이밍 다이어그램을 나타낸다.
도 5 내지 도 8은 각 시점에서의 디스플레이 구동 장치의 상태를 나타낸다.
도 9는 본 발명의 실시 예들에 따른 디스플레이 구동 장치의 작동을 설명하기 위한 타이밍 다이어그램을 나타낸다.
도 10은 본 발명의 실시 예들에 따른 디스플레이 구동 장치의 작동을 설명하기 위한 타이밍 다이어그램을 나타낸다.
도 11은 본 발명의 실시 예들에 따른 로직 회로의 타이밍 조절 작동을 설명하기 위한 도면이다.
도 12는 본 발명의 실시 예들에 따른 로직 회로의 타이밍 조절 작동을 설명하기 위한 도면이다.
이하, 첨부된 도면들을 참조하여 본 발명의 실시 예들을 설명한다.
도 1은 본 발명의 실시 예들에 따른 디스플레이 장치를 개념적으로 나타낸다. 도 1을 참조하면, 디스플레이 장치(1000)는 디스플레이 패널(100) 및 디스플레이 구동 장치(200), 게이트 드라이버(300) 및 타이밍 컨트롤러(400)를 포함한다.
실시 예들에 따라, 디스플레이 장치(1000)는, 이미지 또는 영상을 표시할 수 있는 장치일 수 있다. 예컨대, 디스플레이 장치(1000)는 스마트 폰(smartphone), 태블릿 PC(tablet personal computer), 이동 전화기(mobile phone), 화상 전화기, 전자북 리더기(e-book reader), 컴퓨터(computer), 카메라(camera), 또는 웨어러블 장치(wearable device) 등을 의미할 수 있으나, 이에 한정되지 않는다.
디스플레이 패널(100)은 행과 열로 배열되는 다수의 서브 픽셀(PX)들을 포함할 수 있다. 예컨대, 디스플레이 패널(100)은 LED(light emitting diode) 디스플레이, OLED(organic LED) 디스플레이, AMOLED(active-matrix OLED) 디스플레이, ECD(Electrochromic Display), DMD(Digital Mirror Device), AMD(Actuated Mirror Device), GLV(Grating Light Value), PDP(Plasma Display Panel), ELD(Electro Luminescent Display), VFD(Vacuum Fluorescent Display) 중 하나로 구현될 수 있으나 이에 한정되는 것은 아니다.
디스플레이 패널(100)은 행으로 배열되는 복수의 게이트 라인들(GL1~GLn; n은 자연수), 열으로 배열되는 복수의 데이터 라인들(DL1~DLm; m은 자연수), 그리고 복수의 게이트 라인들(GL1~GLn) 및 복수의 데이터 라인들(DL1~DLm)의 교차 지점에 형성된 서브 픽셀들(PX)을 포함한다. 디스플레이 패널(100)은 복수의 수평 라인을 포함하며, 하나의 수평 라인은 하나의 게이트 라인에 연결되는 서브 픽셀들(PX)들로 구성된다. 하나의 라인(horizontal time) 동안, 하나의 수평 라인에 배열된 서브 픽셀들이 구동되며, 다음 1H 시간 동안, 다른 하나의 수평 라인에 배열된 서브 픽셀들이 구동될 수 있다.
서브 픽셀들(PX)은 발광 다이오드(Light Emitting Diode (LED))와 발광 다이오드를 독립적으로 구동하는 다이오드 구동 회로를 포함할 수 있다. 다이오드 구동 회로는 하나의 게이트 라인과 하나의 데이터 라인에 연결되고, 발광 다이오드는 다이오드 구동 회로와 전원 전압(예컨대, 접지 전압) 사이에 연결될 수 있다.
다이오드 구동 회로는 게이트 라인(GL1~GLn)에 연결된 스위칭 소자, 예컨대 박막 트랜지스터(Thin Film Transister (TFT))를 포함할 수 있다. 게이트 라인(GL1~GLn)으로부터 게이트 온 신호가 인가되어 상기 스위칭 소자가 턴온되면, 다이오드 구동 회로는 다이오드 구동 회로에 연결된 데이터 라인(DL1~DLm)으로부터 수신되는 영상 신호(또는 화소 신호라고 함)를 발광 다이오드로 공급할 수 있다. 발광 다이오드는 영상 신호에 대응하는 광 신호를 출력할 수 있다.
서브 픽셀들(PX) 각각은 적색 광을 출력하는 적색 소자(R), 녹색 광을 출력하는 녹색 소자(G), 및 청색 광을 출력하는 청색 소자(B) 중 하나일 수 있고, 디스플레이 패널(100)에서 적색 소자, 녹색 소자 및 청색 소자가 다양한 방식에 따라 배열될 수 있다. 실시 예들에 따라, 디스플레이 패널(100)의 서브 픽셀(PX)들은 R, G, B, G 또는 B, G, R, G 등의 순서로 반복 배열될 수 있다. 예컨대, 디스플레이 패널(100)의 화소(PX)들은 RGB 스트라이프 구조 또는 RGB 펜타일 구조에 따라 배열될 수 있으나, 이에 한정되는 것은 아니다.
게이트 드라이버(300)는 게이트 제어 신호(GCS)에 응답하여 복수의 게이트 라인들(GL1~GLn)에 게이트 온 신호를 순차적으로 제공할 수 있다. 예를 들어, 게이트 제어 신호(GCS)는 게이트 온 신호의 출력 시작을 지시하는 게이트 스타트 펄스 및 게이트 온 신호의 출력 시점을 제어하는 게이트 쉬프트 클록 등을 포함할 수 있다.
게이트 드라이버(300)는 게이트 스타트 펄스가 인가되면, 게이트 쉬프트 클록에 응답하여 게이트 온 신호(예를 들어, 논리 하이의 게이트 전압)을 순차적으로 생성하고, 게이트 온 신호를 복수의 게이트 라인들(GL1~GLn)에 순차적으로 제공할 수 있다. 이 때, 복수의 게이트 라인들(GL1~GLn)에 게이트 온 신호가 제공되지 않는 기간에는 게이트 오프 신호(예를 들어, 논리 로우의 게이트 전압)가 복수의 게이트 라인들(GL1~GLn)로 공급된다.
디스플레이 구동 장치(200)는 데이터 제어 신호(DCS)에 응답하여, 디지털 영상 데이터(DATA)를 아날로그 영상 신호들로 변환하고, 변환된 영상 신호들을 복수의 데이터 라인들(DL1~DLm)에 제공할 수 있다. 디스플레이 구동 장치(200)는 1H 시간 동안, 하나의 수평 라인에 해당하는 영상 신호를 복수의 데이터 라인들(DL1~DLm)에 제공할 수 있다.
디스플레이 구동 장치(200)는 스위치 회로부(210), 구동 회로부(230) 및 로직 회로(250)를 포함하는 하나의 반도체 칩으로 구현될 수 있다.
스위치 회로부(210)는 구동 회로부(230)로부터 전송되는 신호들을 디스플레이 패널(100)로 전달할 수 있다. 실시 예들에 따라, 스위치 회로부(210)는 복수의 채널들(CH1~CHk) 각각을 복수의 데이터 라인들(DL1~DLm) 중 2개의 데이터 라인들에 연결할 수 있다.
본 발명의 실시 예들에 따른 스위치 회로부(210)는 복수의 채널들(CH1~CHk)의 데이터 라인들 사이에서의 스위칭 타이밍을 조절함으로써 전자기파 간섭(electro magnetic interference (EMI))에 의한 노이즈를 감소시킬 수 있다.
구동 회로부(230)는 데이터 제어 신호(DCS)에 응답하여 영상 데이터(DATA)를 영상 신호들로 변환할 수 있다. 구동 회로부(230)는 영상 데이터(DATA)에 대응하는 계조 전압으로 영상 신호들을 출력하고, 영상 신호들을 복수의 채널들(CH1~CHk; k는 m이하의 자연수)로 출력할 수 있다. 예를 들어, 데이터 제어 신호(DCS)는 소스 스타트 신호, 소스 쉬프트 클록, 소스 출력 인에이블 신호 등을 포함할 수 있다.
로직 회로(250)는 스위치 회로부(210)와 구동 회로부(230)의 작동을 제어할 수 있다. 실시 예들에 따라, 로직 회로(250)는 스위치 회로부(210)와 구동 회로부(230)의 작동 타이밍을 제어할 수 있다. 예컨대, 후술하는 바와 같이, 로직 회로(250)는 스위치 회로부(210)와 구동 회로부(230)의 작동에 사용되는 다양한 신호들(예컨대, 도 3의 신호들)의 생성을 제어할 수 있다.
실시 예들에 따라, 로직 회로(250)는 타이밍 컨트롤러(400)로부터 생성된 신호들을 수신하고, 상기 수신된 신호들에 기초하여 스위치 회로부(210)와 구동 회로부(230)의 작동을 제어할 수 있다.
타이밍 컨트롤러(400)는 외부로부터 비디오 영상 데이터(RGB)를 수신하고, 비디오 영상 데이터(RGB)를 영상 처리하거나 또는 디스플레이 패널(100)의 구조에 맞도록 변환하여 영상 데이터(DATA)를 생성할 수 있다. 타이밍 컨트롤러(400)는 영상 데이터(DATA)를 디스플레이 구동 장치(200)로 전송할 수 있다.
타이밍 컨트롤러(400)는 외부의 호스트 장치로부터 다수의 제어 신호들을 수신할 수 있다. 상기 제어 신호들은 수평 동기 신호(Hsync), 수직 동기 신호(Vsync) 및 클럭 신호(DCLK)를 포함할 수 있다.
타이밍 컨트롤러(400)는 수신된 제어 신호들에 기초하여 게이트 드라이버(300)와 디스플레이 구동 장치(200)를 제어하기 위한 게이트 제어 신호(GCS), 데이터 제어 신호(DCS)를 생성할 수 있다. 타이밍 컨트롤러(400)는 게이트 제어 신호(GCS)와 데이터 제어 신호(DCS)에 기초하여 게이트 드라이버(300)와 디스플레이 구동 장치(200)의 다양한 작동 타이밍을 제어할 수 있다.
실시 예들에 따라, 타이밍 컨트롤러(400)는 게이트 제어 신호(GCS)에 기초하여 게이트 드라이버(300)가 복수의 게이트 라인들(GL1~GLn)을 구동하도록 게이트 드라이버(300)를 제어할 수 있다. 타이밍 콘트롤러(140)는 데이터 제어 신호(DCS)에 기초하여 디스플레이 구동 장치(200)가 복수의 데이터 라인들(DL1~DLm)에 영상 신호를 제공하도록 디스플레이 구동 장치(200)를 제어할 수 있다.
디스플레이 장치(1000)의 각 구성들은 해당하는 기능을 수행할 수 있는 회로로 구성될 수 있다.
도 2는 본 발명의 실시 예들에 따른 디스플레이 패널과 디스플레이 구동 장치를 개념적으로 나타낸다. 도 1과 2를 참조하면, 디스플레이 패널(100)은 나란히 배열된 복수개의 서브 픽셀들(P11~P14 및 P21~P24)과 복수개의 서브 픽셀들(P11~P14 및 P21~P24) 각각에 연결된 복수개의 데이터 스위치들(DSW11~DSW14 및 DSW21~DSW24)을 포함할 수 있다. 복수개의 데이터 스위치들(DSW11~DSW14 및 DSW21~DSW24)의 각 쌍은 각 채널(CH1~CH4)에 연결될 수 있다.
서브 픽셀들의 제1세트(P11~P14)와 서브 픽셀들의 제2세트(P21~P24)는 나란히 배열될 수 있고, 인접하여 배열될 수 있다. 예컨대, 서브 픽셀들의 제1세트(P11~P14)는 연속하는 4개의 서브 픽셀들이고, 서브 픽셀들의 제2세트(P21~P24)는 그 다음 연속하는 4개의 서브 픽셀들일 수 있다.
서브 픽셀들의 제1세트(P11~P14)는 제1픽셀로 정의될 수 있고, 서브 픽셀들의 제2세트(P21~P24)는 제2픽셀로 정의될 수 있다. 예컨대, 제1픽셀은 홀수 번째 픽셀일 수 있고, 제2픽셀은 짝수 번째 픽셀일 수 있다.
데이터 스위치들(DSW11~DSW14 및 DSW21~DSW24)은 데이터 스위칭 신호들(DSSa와 DSSb)에 기초하여, 대응하는 서브 픽셀과 채널 사이에서 스위칭 될 수 있다. 예컨대, 데이터 스위치(DSW11)는 제1데이터 스위칭 신호(DSSa)에 기초하여 제1채널(CH1)과 서브 픽셀(P11)을 연결시킬 수 있고, 데이터 스위치(DSW12)는 제2데이터 스위칭 신호(DSSb)에 기초하여 제1채널(CH1)과 서브 픽셀(P12)을 연결시킬 수 있다. 예컨대, 제1데이터 스위칭 신호(DSSa)가 제1레벨(예컨대, 논리 로우 레벨)일 때, 데이터 스위치들(DSW11, DSW13, DSW21 및 DSW23) 각각은 채널들(CH1, CH3, CH2 및 CH4) 각각과 픽셀들(P11, P13, P21 및 P23) 각각을 연결시킬 수 있다. 제2데이터 스위칭 신호(DSSb)가 논리 로우 레벨일 때, 데이터 스위치들(DSW12, DSW14, DSW22 및 DSW24) 각각은 채널들(CH1, CH3, CH2 및 CH4) 각각과 픽셀들(P12, P14, P22 및 P24) 각각을 연결시킬 수 있다.
실시 예들에 따라, 서로 이웃하는 데이터 스위치들(예컨대, DSW11와 DSW12)의 상태(예컨대, 턴-온 또는 턴-오프)는 서로 다를 수 있다. 즉, 데이터 스위치(DSW11)가 턴-온일 때는 데이터 스위치(DSW12)가 턴-오프일 수 있고, 데이터 스위치(DSW12)가 턴-온일 때에는 데이터 스위치(DSW11)가 턴-오프일 수 있다. 따라서, 각 채널(CH1~CH4)을 통해 전송되는 아날로그 영상 신호는, 데이터 스위칭 신호(DSSa 또는 DSSb)에 응답하여 각 채널(CH1~CH4)에 연결된 두 개의 서브 픽셀들(예컨대, P11과 P12) 중 어느 하나로 선택적으로 제공될 수 있다.
스위치 회로부(210)는 제1스위치(SW1), 제2스위치(SW2), 제3스위치(SW3) 및 제4스위치(SW4)를 포함할 수 있다. 실시 예들에 따라, 스위치 회로부(210)에 포함되는 스위치들의 개수는 채널들의 개수와 동일할 수 있다.
제1스위치 회로부는 제1스위치(SW1)와 제3스위치(SW3)를 포함할 수 있고, 제2스위치 회로부는 제2스위치(SW2)와 제4스위치(SW4)를 포함할 수 있다. 즉, 상기 제1스위치 회로부(SW1와 SW3)는 서브 픽셀들의 제1세트(P11~P14)와 연결될 수 있고, 상기 제2스위치 회로부(SW2와 SW4)는 서브 픽셀들의 제2세트(P21~P24)와 연결될 수 있다.
각 스위치(SW1~SW4)는 각 스위칭 신호(SS1~SS4)에 응답하여 각 소스 앰프(231-1~231-4)를 각 채널(CH1~CH4)에 연결하는 스위칭 작동을 수행할 수 있다. 실시 예들에 따라, 스위치들(SW1와 SW3)은 스위칭 신호들(SS1과 SS3)에 기초하여 스위칭을 수행할 수 있고, 스위치들(SW2와 SW4)은 스위칭 신호들(SS2와 SS4)에 기초하여 스위칭을 수행할 수 있다.
실시 예들에 따라, 제1스위치(SW1)는 제1스위칭 신호(SS1)에 기초하여 제1소스 앰프(231-1)를 제1채널(CH1)에 연결시키고, 제3스위칭 신호(SS3)에 기초하여 제1소스 앰프(231-1)를 제3채널(CH3)에 연결시킬 수 있다. 제3스위치(SW3)는 제1스위칭 신호(SS1)에 기초하여 제3소스 앰프(231-3)를 제3채널(CH3)에 연결시키고, 제3스위칭 신호(SS3)에 기초하여 제3소스 앰프(231-3)를 제1채널(CH1)에 연결시킬 수 있다. 이와 유사하게, 제2스위치(SW2)는 제2스위칭 신호(SS2)에 기초하여 제2소스 앰프(231-2)를 제2채널(CH2)에 연결시키고, 제4스위칭 신호(SS4)에 기초하여 제2소스 앰프(231-2)를 제4채널(CH4)에 연결시킬 수 있다. 제4스위치(SW4)는 제2스위칭 신호(SS2)에 기초하여 제4소스 앰프(231-4)를 제4채널(CH4)에 연결시키고, 제4스위칭 신호(SS4)에 기초하여 제4소스 앰프(231-4)를 제2채널(CH2)에 연결시킬 수 있다.
예컨대, 제1스위칭 신호(SS1)가 제2레벨(예컨대, 논리 하이 레벨)일 때, 제1스위치(SW1)는 제1소스 앰프(231-1)와 제1채널(CH1)을 연결시킬 수 있고, 제3스위치(SW3)는 제3소스 앰프(231-3)와 제3채널(CH3)을 연결시킬 수 있다. 제3스위칭 신호(SS3)가 논리 하이 레벨일 때, 제1스위치(SW1)는 제1소스 앰프(231-1)와 제3채널(CH3)을 연결시킬 수 있고, 제3스위치(SW3)는 제3소스 앰프(231-3)와 제1채널(CH1)을 연결시킬 수 있다. 이와 유사하게, 제2스위칭 신호(SS2)가 논리 하이 레벨일 때, 제2스위치(SW2)는 제2소스 앰프(231-2)와 제2채널(CH2)을 연결시킬 수 있고, 제4스위치(SW4)는 제4소스 앰프(231-4)와 제4채널(CH4)을 연결시킬 수 있다. 제4스위칭 신호(SS4)가 논리 하이 레벨일 때, 제2스위치(SW2)는 제2소스 앰프(231-2)와 제4채널(CH4)을 연결시킬 수 있고, 제4스위치(SW4)는 제4소스 앰프(231-4)와 제2채널(CH2)을 연결시킬 수 있다.
제1스위칭 신호(SS1)와 제3스위칭 신호(SS3)는 교번하여 활성화될 수 있고, 제2스위칭 신호(SS2)와 제4스위칭 신호(SS4)는 교번하여 활성화될 수 있다. 예컨대, 제1스위칭 신호(SS1)가 논리 하이 레벨인 구간과 제3스위칭 신호(SS3)가 논리 하이 레벨인 구간은 서로 오버랩 되지 않을 수 있다.
후술하는 바와 같이, 본 발명의 실시 예들에 따른 디스플레이 구동 장치(200)는 제1스위칭 신호(SS1)와 제2스위칭 신호(SS2)의 타이밍을 서로 다르게 설정하고, 제3스위칭 신호(SS3)와 제4스위칭 신호(SS4)의 타이밍을 서로 다르게 설정함으로써 스위치들(SW1와 SW3)과 스위치들(SW2과 SW4) 사이의 스위칭 타이밍을 상이하게 할 수 있으므로, 스위칭에 의해 발생하는 EMI에 기초한 노이즈가 감소하는 효과가 있다.
구동 회로부(230)는 소스 앰프들(231-1~231-4), 멀티플렉서들(235-1~235-4) 및 래치들(237-1~237-4)을 포함할 수 있다. 실시 예들에 따라, 구동 회로부(230)는 소스 앰프들(231-1~231-4)과 멀티플렉서들(235-1~235-4) 사이에 배열되는 디코더들(233-1~233-4)을 더 포함할 수 있다.
편의상, 제1소스 앰프(231-1), 제1디코더(233-1), 제1멀티플렉서(235-1) 및 제1래치(237-1)를 통칭하여 제1구동 회로라고 한다. 제2구동 회로, 제3구동 회로 및 제4구동 회로 또한 이와 유사한 방식으로 정의된다. 제1구동 회로부는 제1구동 회로와 제3구동 회로를 포함할 수 있고, 제2구동 회로부는 제2구동 회로와 제4구동 회로를 포함할 수 있다.
제1구동 회로부는 제1픽셀(P11~P14)로 영상 신호들을 출력하고, 제2구동 회로부는 제2픽셀(P21~P24)로 영상 신호들을 출력할 수 있다. 또한, 제1스위치 회로부(SW1와 SW3)는 제1픽셀(P11~P14)과 상기 제1구동 회로부를 연결하기 위한 스위칭 작동을 수행할 수 있고, 제2스위치 회로부(SW2와 SW4)는 제2픽셀(P21~P24)과 상기 제2구동 회로부를 연결하기 위한 스위칭 작동을 수행할 수 있다.
나아가, 본 발명의 실시 예들에 따른 디스플레이 구동 장치(200)는 디스플레이 패널(100)에 나란히 배치된 픽셀들 중 홀수 번째 픽셀들로 영상 신호들을 출력하는 홀수 번째 구동 회로부들 및 상기 홀수 번째 픽셀들과 상기 홀수 번째 구동 회로부들을 연결하는 스위칭 작동을 수행하는 홀수 번째 스위치 회로부들을 포함하고, 나란히 배치된 픽셀들 중 짝수 번째 픽셀들로 영상 신호들을 출력하는 짝수 번째 구동 회로부들 및 상기 짝수 번째 픽셀들과 상기 짝수 번째 구동 회로부들을 연결하는 스위칭 작동을 수행하는 짝수 번째 스위치 회로부들을 포함할 수 있다.
즉, 앞에서 설명한 바와 일관되듯이, 본 발명의 실시 예들에 따른 디스플레이 구동 장치(200)는 홀수 번째 스위치 회로부들의 스위칭 타이밍과 짝수 번째 스위치 회로부들의 스위칭 타이밍을 서로 다르게 설정함으로써 스위칭에 의해 발생하는 EMI에 기초한 노이즈를 감소시킬 수 있다.
각 소스 앰프(231-1~231-4)는 스위치 회로부(210)를 통해 각 영상 신호(VS1~VS4)를 디스플레이 패널(100)로 출력할 수 있다.
각 래치(237-1~237-4)는 화소 데이터를 저장할 수 있다. 실시 예들에 따라, 각 래치(237-1~237-4)는 적어도 하나의 적색 화소 데이터(R), 녹색 화소 데이터(G) 및 청색 화소 데이터(B)를 저장할 수 있다. 예컨대, 제1래치(237-1)는 적색 화소 데이터(R)와 녹색 화소 데이터(G)를 저장할 수 있다.
래치들(237-1~237-4)은 디스플레이 패널(100)의 게이트 라인들(GL1~GLn)에 연결된 서브 픽셀들(PX) 각각에 해당하는 화소 데이터를 저장할 수 있다. 예컨대, 제1게이트 라인(GL1)에 연결된 서브 픽셀들(PX)이 구동될 때, 래치(237-1~237-4)들은 제1게이트 라인(GL1)에 연결된 서브 픽셀들(PX)에 의해 출력될 광에 해당하는 화소 데이터를 저장할 수 있고, 제2게이트 라인(GL2)에 연결된 서브 픽셀들(PX)이 구동될 때, 래치(237-1~237-4)들은 제2게이트 라인(GL2)에 연결된 서브 픽셀들(PX)에 의해 출력될 광에 해당하는 화소 데이터를 저장할 수 있다.
멀티플렉서들(235-1~235-4)은 선택 신호들(SELa와 SELb)에 기초하여, 대응하는 래치들(237-1~237-4)에 저장된 화소 데이터 중 하나의 화소 데이터를 선택하고, 선택된 하나의 화소 데이터를 디코더들(233-1~233-4) 또는 소스 앰프들(231-1~231-4)로 출력할 수 있다. 예컨대, 제1멀티플렉서(235-1)는 제1선택 신호(SELa)에 기초하여 제1래치(237-1)에 저장된 화소 데이터(R과 G) 중 하나의 화소 데이터(예컨대, G)를 선택하고, 선택된 화소 데이터(예컨대, G)를 제1디코더(233-1) 또는 제1소스 앰프(231-1)로 출력할 수 있다.
후술하는 바와 같이, 본 발명의 실시 예들에 따른 디스플레이 구동 장치(200)는 제1선택 신호(SELa)와 제2선택 신호(SELb)의 타이밍을 다르게 설정함으로써 멀티플렉서들(235-1~235-4)에서의 화소 데이터의 선택 타이밍을 상이하게 할 수 있으므로, EMI에 의한 노이즈가 감소하는 효과가 있다.
즉, 앞에서 설명한 바와 일관되듯이, 본 발명의 실시 예들에 따른 디스플레이 구동 장치(200)는 홀수 번째 구동 회로부들의 데이터 선택 타이밍과 짝수 번째 구동 회로부들의 데이터 선택 타이밍을 서로 다르게 설정함으로써 스위칭에 의해 발생하는 EMI에 기초한 노이즈를 감소시킬 수 있다.
디코더들(233-1~233-4)은 멀티플렉서들(235-1~235-4)로부터 선택되어 출력된 화소 데이터에 해당하는 계조 전압을 소스 앰프들(231-1~231-4)로 출력할 수 있다. 실시 예들에 따라, 디코더들(233-1~233-4)은 화소 데이터 각각에 해당하는 계조 전압(예컨대, R 감마 전압들, G 감마 전압들 및 B 감마 전압들)을 수신하고, 멀티플렉서들(235-1~235-4)로부터 선택되어 출력된 화소 데이터에 해당하는 계조 전압을 소스 앰프들(231-1~231-4)로 출력할 수 있다.
소스 앰프들(231-1~231-4)은 멀티플렉서(235-1~235-4)들로부터 출력된 화소 데이터를 영상 신호들(VS1~VS4)로 변환(예컨대, DA(digital to analogue) 변환)하고 변환된 영상 신호들(VS1~VS4)을 채널들(CH1~CH4)로 출력하거나, 또는, 디코더(233-1~233-4)로부터 출력된 계조 전압들(즉, 화소 데이터에 해당하는 감마 전압)을 영상 신호들(VS1~VS4)로서 채널들(CH1~CH4)로 출력할 수 있다.
실시 예들에 따라, 소스 앰프들(231-1~231-4)은 연결된 스위치들(SW1~SW4)을 통해 해당하는 채널들(CH1~CH4)로 영상 신호들(VS1~VS4)을 출력할 수 있다. 예컨대, 제1소스 앰프(231-1)는 제1스위치(SW1)를 통해 제1영상 신호(VS1)를 제1채널(CH1) 또는 제3채널(CH3)로 출력하고, 제3소스 앰프(231-3)는 제3스위치(SW3)를 통해 제3영상 신호(VS3)를 제3채널(CH3) 또는 제1채널(CH1)로 출력하고, 제2소스 앰프(231-2)는 제2스위치(SW2)를 통해 제2영상 신호(VS2)를 제2채널(CH2) 또는 제4채널(CH4)로 출력하고, 제4소스 앰프(231-4)는 제4스위치(SW4)를 통해 제4영상 신호(VS4)를 제4채널(CH4) 또는 제2채널(CH2)로 출력할 수 있다.
도 3은 본 발명의 실시 예들에 따른 디스플레이 구동 장치에서 사용되는 스위칭 신호와 선택 신호를 나타내는 다이어그램이다. 도 3을 참조하면, 로직 회로(250)는 스위칭 신호들(SS1~SS4; 집합적으로 SS)과 선택 신호들(SELa와 SELb; 집합적으로 SEL)을 생성할 수 있다.
실시 예들에 따라, 하나의 수평 시간에서, 로직 회로(250)는 스위칭 신호들(SS)의 폭을 조절할 수 있고, 선택 신호들(SEL)의 위상을 조절할 수 있다. 예컨대, 로직 회로(250)는 스위칭 신호들(SS)의 하강 시점(또는 상승 시점)을 조절하고, 조절된 하강 시점(또는 상승 시점)을 가지는 스위칭 신호들(SS)을 생성할 수 있고, 선택 신호들(SEL)의 상승 시점과 하강 시점 모두를 조절하고, 조절된 상승 시점과 하강 시점을 가지는 선택 신호들(SEL)을 생성할 수 있다.
예컨대, 로직 회로(250)는 스위칭 신호들(SS)의 폭을 기준 폭으로 조절하거나(예컨대, ORIGIN의 경우), 상기 기준 폭보다 작도록 조절하거나(예컨대, MINUS의 경우), 또는 상기 기준 폭보다 크도록 조절할 수 있다(예컨대, PLUS의 경우).
예컨대, 로직 회로(250)는 선택 신호들(SEL)의 위상을 기준 위상으로 조절하거나(예컨대, ORIGIN의 경우), 상기 기준 위상보다 앞서도록 조절하거나(예컨대, MINUS의 경우), 또는 상기 기준 위상보다 늦도록 조절할 수 있다(예컨대, PLUS의 경우).
로직 회로(250)는 레지스터에 저장된 값들을 리드하고, 리드된 값들에 기초하여 스위칭 신호들(SS)과 선택 신호들(SEL)을 생성할 수 있다.
실시 예들에 따라, 로직 회로(250)는 레지스터로부터 적어도 하나의 값을 리드하고, 리드된 적어도 하나의 값을 이용하여 스위칭 신호들(SS)의 하강 시점 또는 상승 시점을 조절하여 스위칭 신호들(SS)의 폭을 조절할 수 있다.
실시 예들에 따라, 로직 회로(250)는 레지스터로부터 적어도 하나의 값을 리드하고, 리드된 적어도 하나의 값을 이용하여 선택 신호들(SEL)의 하강 시점과 상승 시점을 조절하여 선택 신호들(SEL)의 위상을 조절할 수 있다.
실시 예들에 따라, 로직 회로(250)는, 레지스터로부터 리드된 적어도 하나의 값에 기초하여, 스위칭 신호들(SS1~SS4)의 폭을 조절할지를 판단할 수 있고, 선택 신호들(SELa와 SELb)의 위상을 조절할지를 판단할 수 있고, 스위칭 신호들(SS1~SS4)의 폭을 결정할 수 있고, 선택 신호들(SELa와 SELb)의 위상을 결정할 수 있다.
도 4는 본 발명의 실시 예들에 따른 디스플레이 구동 장치의 작동을 설명하기 위한 타이밍 다이어그램을 나타내고, 도 5 내지 도 8은 각 시점에서의 디스플레이 구동 장치의 상태를 나타낸다.
라인들(1H, 2H, 3H 및 4H)은 수평 동기 신호(Hsync)에 의해 동기될 수 있다. 도 2 내지 도 4를 참조하면, 로직 회로(250)는 제1라인(1H)에서 스위칭 신호들(SS1와 SS2)의 폭이 기준 폭(ORIGIN의 경우)이거나, 상기 기준 폭보다 작거나(MINUS의 경우) 또는 상기 기준 폭보다 크도록(PLUS의 경우), 스위칭 신호들(SS1와 SS2)을 생성할 수 있다. 즉, 로직 회로(250)는 미리 설정된 기준 폭을 기준으로 스위칭 신호들(SS1와 SS2)의 폭을 조절(또는 설정)할 수 있다.
또한, 제1라인(1H)에서와 유사하게, 로직 회로(250)는 제2라인(2H)에서 제3스위칭 신호(SS3)의 폭과 제4스위칭 신호(SS4)의 폭이 서로 달라지도록 스위칭 신호들(SS3와 SS4)을 생성할 수 있다. 실시 예들에 따라, 로직 회로(250)는 제2라인(2H)에서 스위칭 신호들(SS3과 SS4)의 폭이 기준 폭(ORIGIN의 경우)이거나, 상기 기준 폭보다 작거나(MINUS의 경우) 또는 상기 기준 폭보다 크도록(PLUS의 경우), 스위칭 신호들(SS3과 SS4)을 생성할 수 있다.
실시 예들에 따라, 로직 회로(250)는 각 수평 시간에서 플로팅 구간(스위칭 신호들(SS1와 SS3 또는 SS2와 SS4) 둘 다 논리 로우 레벨인 구간)이 존재하거나 존재하지 않도록 스위칭 신호들(SS1~SS4)의 폭을 조절(또는 설정)할 수 있다. 예컨대, 도 4에 도시된 바와 같이, 제1수평 시간(1H)에서는 스위칭 신호들(SS1와 SS3)의 플로팅 구간이 존재하지만, 제3수평 시간(3H)에서는 스위칭 신호들(SS1와 SS3)의 플로팅 구간이 존재하지 않을 수 있다.
이상에서는 로직 회로(250)가 두 개의 라인들(1H와 2H)에서 스위칭 신호들(SS1~SS4)을 조절하는 것으로 예시적으로 설명하였으나, 로직 회로(250)는 일련의 라인들에서 동일한 조절을 수행할 수 있다.
실시 예들에 따라, 제1라인(1H)에서의 스위칭 신호들(SS1과 SS2)에 대한 조절 작동은 홀수 번째 라인들(3H, 5H, ...)에 대해서도 동일하게 적용될 수 있고, 제2라인(2H)에서의 스위칭 신호들(SS3과 SS4)에 대한 조절 작동은 짝수 번째 라인들(2H, 4H, ...)에 대해서도 동일하게 적용될 수 있다.
또한, 로직 회로(250)는 제1라인(1H)에서 제1선택 신호(SELa)의 위상과 제2선택 신호(SELb)의 위상이 달라지도록 선택 신호들(SELa와 SELb)을 생성할 수 있다. 예컨대, 로직 회로(250)는 제1라인(1H)에서 제1선택 신호(SELa)의 하강 시점과 상승 시점 각각이 제2선택 신호(SELb)의 하강 시점 및 상승 시점 각각과 달라지도록 선택 신호들(SELa와 SELb)을 생성할 수 있다. 이 때, 선택 신호들(SELa과 SELb)의 폭은 동일하게 유지될 수 있다.
이상에서는 하나의 라인(1H)에 대해서만 예시적으로 설명하였으나, 본 발명의 실시 예들은 일련의 라인들에 대해서 동일하게 적용될 수 있다. 실시 예들에 따라, 제1라인(1H)에서의 선택 신호들(SELa와 SELb)에 대한 조절 작동은 그 다음 연속하는 라인들(2H, 3H, ...)에 대해서도 동일하게 적용될 수 있다
편의상, 본 발명의 실시 예들에 따른 로직 회로(250)가 스위칭 신호들(SS1~SS4)의 폭을 조절하는 작동 또는 선택 신호들(SELa와 SELb)의 위상을 조절하는 작동을 타이밍 조절 작동이라 한다.
도 4의 제1시점(t0)에서의 디스플레이 드라이버 장치의 작동은 도 5를 더 참조하여 설명된다. 도 4와 도 5를 참조하면, 제1시점(t0)에서, 제1멀티플렉서(235-1)는 논리 로우 레벨의 제1선택 신호(SELa)에 기초하여 제1래치(237-1)에 저장된 화소 데이터 중 하나의 화소 데이터(예컨대, G)를 출력하고, 제2멀티플렉서(235-2)는 논리 로우 레벨의 제2선택 신호(SELb)에 기초하여 제2래치(237-2)에 저장된 하나의 화소 데이터 중에서 하나의 화소 데이터(예컨대, G)를 출력한다.
유사하게, 제3멀티플렉서(235-3)는 논리 로우 레벨의 제1선택 신호(SELa)에 기초하여 제3래치(237-3)에 저장된 화소 데이터 중에서 하나의 화소 데이터(예컨대, G)를 출력하고, 제4멀티플렉서(235-4)는 논리 로우 레벨의 제2선택 신호(SELb)에 기초하여 제4래치(237-4)에 저장된 화소 데이터 중 하나의 화소 데이터(예컨대, G)를 출력한다.
제1시점(t0)에서, 제1스위치(SW1)는 논리 하이 레벨의 제1스위칭 신호(SS1)에 기초하여 제1소스 앰프(231-1)와 제1채널(CH1)을 연결시키고, 제2스위치(SW2)는 논리 하이 레벨의 제2스위칭 신호(SS2)에 기초하여 제2소스 앰프(231-2)와 제2채널(CH2)을 연결시킨다. 유사하게, 제3스위치(SW3)는 논리 하이 레벨의 제1스위칭 신호(SS1)에 기초하여 제3소스 앰프(231-3)와 제3채널(CH3)을 연결시키고, 제4스위치(SW4)는 논리 하이 레벨의 제2스위칭 신호(SS2)에 기초하여 제4소스 앰프(231-4)와 제4채널(CH4)을 연결시킨다.
또한, 제1시점(t0)에서, 스위치들(DSW12, DSW14, DSW22 및 DSW24)은 로우 레벨의 제2데이터 선택 신호(DSSb)에 기초하여 채널들(CH1, CH3, CH2 및 CH4) 각각과 픽셀들(P11, P13, P21 및 P23) 각각을 연결시킬 수 있다.
도 4의 제2시점(t1)에서의 디스플레이 드라이버 장치의 작동은 도 6을 더 참조하여 설명된다. 도 4와 도 6을 참조하면, 제2시점(t1)에서, 제1멀티플렉서(235-1)는 논리 하이 레벨의 제1선택 신호(SELa)에 기초하여 제1래치(237-1)에 저장된 다른 하나의 화소 데이터(예컨대, R)를 출력하고, 제2멀티플렉서(235-2)는 제1시점(t0)에서와 마찬가지로 논리 로우 레벨의 제2선택 신호(SELb)에 기초하여 제2래치(237-2)에 저장된 하나의 화소 데이터(예컨대, G)를 출력한다. 즉, 논리 로우 레벨의 선택 신호들(SELa와 SELb) 중에서 제1선택 신호(SELa)만의 레벨이 바뀌고, 이에 따라 제1멀티플렉서(235-1)의 데이터의 선택만이 변화(예컨대, G에서 R로)한다. 이와 유사하게, 제3멀티플렉서(235-3)는 논리 하이 레벨의 제1선택 신호(SELa)에 기초하여 제3래치(237-3)에 저장된 다른 하나의 화소 데이터(예컨대, B)를 출력하고, 제4멀티플렉서(235-4)는 제1시점(t0)에서와 마찬가지로 논리 로우 레벨의 제2선택 신호(SELb)에 기초하여 제4래치(237-4)에 저장된 하나의 화소 데이터(예컨대, G)를 출력한다.
제1라인(1H)에서 제1선택 신호(SELa)의 위상과 제2선택 신호(SELb)의 위상이 다르므로, 서브 픽셀들의 제1세트(P11~P14)에 대응하는 멀티플렉서들(235-1과 235-3)의 데이터 선택이 변화하는 타이밍(즉, 선택 신호(SELa)의 레벨이 변화하는 타이밍)은, 인접한 서브 픽셀들의 제2세트(P21~P24)와 대응하는 다른 멀티플렉서들(235-2과 235-4)의 데이터 선택이 변화하는 타이밍과 달라진다. 그 결과, 제1 및 제3멀티플렉서(235-1와 235-3)와 제2 및 제4 멀티플렉서(235-2와 235-4)의 데이터 선택의 변화 타이밍이 동일한 경우보다 더 적은 EMI가 디스플레이 구동 장치 내에서 발생하게 되고, 이에 따라 상기 EMI에 의한 노이즈가 감소하는 효과가 있다.
또한, 제2시점(t1)에서, 제1스위치(SW1)는 논리 로우 레벨의 제1스위칭 신호(SS1)에 기초하여 제1소스 앰프(231-1)와 제1채널(CH1)사이의 연결을 해제하고, 제2스위치(SW2)는, 제1시점(t0)과 마찬가지로, 논리 하이 레벨의 제2스위칭 신호(SS2)에 기초하여 제2소스 앰프(231-2)와 제2채널(CH2)을 연결시킨다. 유사하게, 제3스위치(SW3)는 논리 로우 레벨의 제1스위칭 신호(SS1)에 기초하여 제3소스 앰프(231-3)와 제3채널(CH3)을 연결시키고, 제4스위치(SW4)는 논리 하이 레벨의 제2스위칭 신호(SS2)에 기초하여 제4소스 앰프(231-4)와 제4채널(CH4)을 연결시킨다.
제1라인(1H) 동안 제1스위칭 신호(SS1)의 폭과 제2스위칭 신호(SS2)의 폭이 다르므로 제1스위칭 신호(SS1)가 논리 로우 레벨로 진입하는 시점과 제2스위칭 신호(SS2)가 논리 로우 레벨로 진입하시는 시점이 달라지게 되고, 따라서, 서브 픽셀들의 제1세트(P11~P14)와 연결된 스위치들(SW1와 SW3)의 스위칭 타이밍(즉, 턴-오프에서 턴-온으로 또는 턴-온에서 턴-오프로의 상태 변화)은 인접한 서브 픽셀들의 제2세트(P21~P24)와 연결된 다른 스위치들(SW2와 SW4)의 스위치 타이밍과 달라진다. 그 결과, 스위치들(SW1~SW4)의 스위칭 타이밍이 동일한 경우보다 더 적은 EMI가 디스플레이 구동 장치 내에서 발생하게 되고, 이에 따라 상기 EMI에 의한 노이즈가 감소하는 효과가 있다.
도 4의 제3시점(t2)에서의 디스플레이 드라이버 장치의 작동은 도 7을 더 참조하여 설명된다. 한편, 제3시점(t2)에서의 멀티플렉서들(235-1~235-4)의 작동은 제1시점(t0)에서의 멀티플렉서들(235-1~235-4)의 작동과 동일한 바 이하 설명을 생략한다.
도 4와 도 7을 참조하면, 제3시점(t2)에서, 제1스위치(SW1)는 논리 하이 레벨의 제3스위칭 신호(SS3)에 기초하여 제1소스 앰프(231-1)와 제3채널(CH3)을 연결시키고, 제2스위치(SW2)는 논리 하이 레벨의 제4스위칭 신호(SS4)에 기초하여 제2소스 앰프(231-2)와 제4채널(CH4)을 연결시킨다. 유사하게, 제3스위치(SW3)는 논리 하이 레벨의 제3스위칭 신호(SS3)에 기초하여 제3소스 앰프(231-3)와 제1채널(CH1)을 연결시키고, 제4스위치(SW4)는 논리 하이 레벨의 제4스위칭 신호(SS4)에 기초하여 제4소스 앰프(231-4)와 제2채널(CH2)을 연결시킨다.
도 4의 제4시점(t3)에서의 디스플레이 드라이버 장치의 작동은 도 8을 더 참조하여 설명된다. 한편, 제4시점(t3)에서의 멀티플렉서들(235-1~235-4)의 작동은 제2시점(t1)에서의 멀티플렉서들(235-1~235-4)의 작동과 동일한 바 이하 설명을 생략한다.
즉, 제2라인(2H)에서 제1선택 신호(SELa)의 위상과 제2선택 신호(SELb)의 위상이 다르므로, 서브 픽셀들의 제1세트(P11~P14)에 대응하는 멀티플렉서들(235-1과 235-3)의 데이터 선택이 변화하는 타이밍(즉, 선택 신호(SELa)의 레벨이 변화하는 타이밍)은, 인접한 서브 픽셀들의 제2세트(P21~P24)와 대응하는 다른 멀티플렉서들(235-2과 235-4)의 데이터 선택이 변화하는 타이밍과 달라진다. 그 결과, 제1 및 제3멀티플렉서(235-1와 235-3)와 제2 및 제4 멀티플렉서(235-2와 235-4)의 데이터 선택의 변화 타이밍이 동일한 경우보다 더 적은 EMI가 디스플레이 구동 장치 내에서 발생하게 되고, 이에 따라 상기 EMI에 의한 노이즈가 감소하는 효과가 있다.
도 4와 도 8을 참조하면, 제4시점(t3)에서, 제1스위치(SW1)는 논리 로우 레벨의 제3스위칭 신호(SS3)에 기초하여 제1소스 앰프(231-1)와 제3채널(CH3)사이의 연결을 해제하고, 제2스위치(SW2)는, 제1시점(t0)과 마찬가지로, 논리 하이 레벨의 제4스위칭 신호(SS4)에 기초하여 제2소스 앰프(231-2)와 제4채널(CH4)을 연결시킨다. 유사하게, 제3스위치(SW3)는 논리 로우 레벨의 제3스위칭 신호(SS3)에 기초하여 제3소스 앰프(231-3)와 제1채널(CH1)의 연결을 해제하고, 제4스위치(SW4)는 논리 하이 레벨의 제4스위칭 신호(SS4)에 기초하여 제4소스 앰프(231-4)와 제2채널(CH2)을 연결시킨다.
제2라인(2H) 동안 제3스위칭 신호(SS3)의 폭과 제4스위칭 신호(SS4)의 폭이 다르므로 제3스위칭 신호(SS3)가 논리 로우 레벨로 진입하는 시점과 제4스위칭 신호(SS4)가 논리 로우 레벨로 진입하시는 시점이 달라지게 되고, 따라서, 서브 픽셀들의 제1세트(P11~P14)와 연결된 스위치들(SW1와 SW3)의 스위칭 타이밍은 인접한 서브 픽셀들의 제2세트(P21~P24)와 연결된 다른 스위치들(SW2와 SW4)의 스위칭 타이밍과 달라진다. 그 결과, 스위치들(SW1~SW4)의 스위칭 타이밍이 동일한 경우보다 더 적은 EMI가 디스플레이 구동 장치 내에서 발생하게 되고, 이에 따라 상기 EMI에 의한 노이즈가 감소하는 효과가 있다.
도 9는 본 발명의 실시 예들에 따른 디스플레이 구동 장치의 작동을 설명하기 위한 타이밍 다이어그램을 나타낸다. 앞에서 설명한 바와 같이, 하나의 수평 시간에서, 로직 회로(250)는 스위칭 신호들(SS)의 폭을 조절할 수 있고, 선택 신호들(SEL)의 위상을 조절할 수 있다.
도 4와 달리, 도 9에 도시된 제1스위칭 신호(SS1)의 폭은 기준 폭과 동일하고, 제2스위칭 신호(SS2)의 폭은 상기 기준 폭 보다 크다. 즉, 본 발명의 실시 예들에 따른 디스플레이 구동 장치(200)(또는 로직 회로(250))는 다양한 방법에 따라 스위칭 신호들(SS)의 폭을 조절할 수 있고, 선택 신호들(SEL)의 위상을 조절할 수 있다.
도 10은 본 발명의 실시 예들에 따른 디스플레이 구동 장치의 작동을 설명하기 위한 타이밍 다이어그램을 나타낸다. 도 10을 참조하면, 로직 회로(250)는 인접하는 홀수 번째 라인들 또는 인접하는 짝수 번째 라인들에서의 스위칭 신호들(SS1~SS4) 각각의 폭을 서로 다르게 조절할 수 있다. 예컨대, 도 3과 도 5에 도시된 바와 같이, 로직 회로(250)는 인접하는 홀수 번째 라인들에서의 제1스위칭 신호(SS1)의 폭을 서로 다르게 조절할 수 있고, 인접하는 짝수 번째 라인들에서의 제3스위칭 신호(SS3)의 폭을 서로 다르게 조절할수 있다.
이와 유사하게, 로직 회로(250)는 인접하는 라인들에서의 선택 신호들(SELa와 SELb) 각각의 위상을 서로 다르게 조절할 수 있다. 예컨대, 도 3과 도 5에 도시된 바와 같이, 로직 회로(250)는 인접하는 라인들에서의 제1선택 신호(SELa)의 위상을 서로 다르게 조절할 수 있다.
따라서, 인접하는 라인들(예컨대, 1H와 2H 또는 2H와 3H 등)에서의 스위치들(SW1~SW4)의 스위칭 타이밍 또는 멀티플렉서들(235-1~235-4)의 데이터 선택 타이밍이 서로 달라진다. 즉, 전반적인 스위칭 또는 데이터 선택의 주기가 균등하지 않게 된다. 그 결과, 상기 타이밍들이 동일한 경우보다 더 적은 EMI가 디스플레이 구동 장치 내에서 발생하게 되고, 이에 따라 상기 EMI에 의한 노이즈가 감소하는 효과가 있다.
도 11과 12는 본 발명의 실시 예들에 따른 로직 회로의 타이밍 조절 작동을 설명하기 위한 도면이다. 도 11에는 N번째(N은 자연수) 프레임(FR0)과 (N+1)번째 프레임(FR1)이 도시되어 있고, 도 12에는 (N+2)번째 프레임(FR2)과 (N+3)번째 프레임(FR3)이 도시되어 있다.
각 프레임들(FR0~FR3)의 각 블록은 하나의 수평 시간에서 서브 픽셀들의 하나의 세트와 관련된 타이밍에 대응할 수 있다. 예컨대, 블록(P1)은 각 프레임(FR0~FR3)내의 제1수평 시간(1H)에서의 서브 픽셀들의 제1세트(P11~P14)와 대응되는 제1멀티플렉서(235-1)와 제3멀티플렉서(235-3)의 데이터 선택 타이밍 또는 제1스위치(SW1)와 제3스위치(SW3)의 스위칭 타이밍과 대응될 수 있다. 유사하게, 블록(P1)의 오른쪽에 위치한 블록은 각 프레임(FR0~FR3)내의 제1수평 시간(1H)에서의 서브 픽셀들의 제2세트(P21~P24)와 대응되는 제2멀티플렉서(235-2)와 제4멀티플렉서(235-4)의 데이터 선택 타이밍 또는 제2스위치(SW2)와 제4스위치(SW4)의 스위칭 타이밍과 대응될 수 있다.
마찬가지로, 각 프레임(FR0~FR3)의 각 열은 복수의 수평 시간들에서 서브 픽셀들의 하나의 세트와 관련된 타이밍에 대응할 수 있다.
프레임들(FR0~FR3)의 각 블록에 도시된 "+"는 대응하는 타이밍이 기준 타이밍 보다 느린 경우를 나타낸다. 즉, "+"는 블록에 대응하는 스위칭 신호(SS)(또는 선택 신호(SEL))의 폭(또는 위상)이 기준 폭(또는 기준 위상)보다 큰 경우(늦은 경우)를 나타낸다.
프레임들(FR0~FR3)의 각 블록에 도시된 "-"는 대응하는 타이밍이 기준 타이밍 보다 빠른 경우를 나타낸다. 즉, "-"는 블록에 대응하는 스위칭 신호(SS)(또는 선택 신호(SEL))의 폭(또는 위상)이 기준 폭(또는 기준 위상)보다 작은 경우(빠른 경우)를 나타낸다.
프레임들(FR0~FR3)의 각 블록에 도시된 "0"는 대응하는 타이밍이 기준 타이밍과 동일한 경우를 나타낸다. 즉, "0"는 블록에 대응하는 스위칭 신호(SS)(또는 선택 신호(SEL))의 폭(또는 위상)이 기준 폭(또는 기준 위상)과 동일한 경우를 나타낸다.
실시 예들에 따라, 로직 회로(250)는 일정한 수의 라인들 내에서 블록들 사이의 타이밍의 차이가 균등하도록 스위칭 신호들(SS1~SS4)의 폭 또는 선택 신호들(SELa와 SELb)의 위상을 조절할 수 있다. 예컨대, 로직 회로(250)는 라인들(예컨대, 4개의 라인들)내에서 스위칭 신호들(SS1과 SS2 또는 SS3와 SS4) 사이의 폭 차이의 총합(또는 선택 신호들(SELa와 SELb) 사이의 위상 차이의 총 합이 0이 되도록 조절할 수 있다. 도 11과 도 12에 도시된 바와 같이, 1H 내지 4H 범위에서 "-"의 개수와 "+"의 개수는 동일할 수 있다.
이와 유사하게, 로직 회로(250)는 일정한 수의 프레임들 내에서 블록들 사이의 타이밍의 차이가 균등하도록 스위칭 신호들(SS1~SS4)의 폭 또는 선택 신호들(SELa와 SELb)의 위상을 조절할 수 있다. 예컨대, 로직 회로(250)는 프레임들(FR0~FR3) 내에서 스위칭 신호들(SS1과 SS2 또는 SS3와 SS4) 사이의 폭 차이의 총합(또는 선택 신호들(SELa와 SELb) 사이의 위상 차이의 총 합이 0이 되도록 조절할 수 있다. 도 11과 도 12에 도시된 바와 같이, FR0 내지 FR3 범위에서 "-"의 개수와 "+"의 개수는 동일할 수 있다.
즉, 로직 회로(250)는 동일한 라인이라 하더라도 서로 다른 프레임에 속할 경우, 대응하는 스위치 타이밍 또는 데이터 선택 타이밍을 상이하게 함으로써, 프레임 전체적으로는 그 편차가 0이 되도록 타이밍을 조절할 수 있다.
실시 예들에 따라, 로직 회로(250)는 수평 동기 신호(Hsync)에 기초하여 작동하고 4-사이클 카운터(또는 2-비트 카운터)로 구성되는 제1카운터와, 수직 동기 신호(Vsync)에 기초하여 작동하고 4-사이클 카운터(또는 2-비트 카운터)로 구성되는 제2카운터에 기초하여 스위칭 신호들(SS)의 폭을 조절하고 선택 신호들(SEL)의 위상을 조절할 수 있다. 상기 카운터들은 하드웨어 카운터 또는 소프트웨어 카운터로 구현될 수 있다.
본 명세서에서, 4-사이클 카운터라 함은, 주기적으로 4개의 카운트 값들(예컨대, '00', '01', '10', '11')을 생성하는 카운터를 의미한다. 즉, 제1카운터는 제1라인(1H)에서 제1카운트 값을 생성하면, 제5라인에는 다시 상기 제1카운트 값을 생성할 수 있다. 이와 유사하게, 제2카운터는 제1수직 시간에서 제1카운트 값을 생성하면, 제5수직 시간에는 다시 상기 제1카운트 값을 생성할 수 있다.
실시 예들에 따라, 로직 회로(250)는 라인 별 타이밍 조절 동작을 수행하기 위해, 제1카운터에 의해 생성된 카운트 값들에 따라 스위칭 신호들(SS1~SS4)의 폭을 순차적으로 조절하고 선택 신호들(SELa와 SELb)의 위상을 순차적으로 조절할 수 있다.
예컨대, 로직 회로(250)는 제1카운터가 제1라인(1H)에서 제1카운트 값(예컨대, "00")을 생성할 때 제1스위칭 신호(SS1)의 폭을 기준 폭보다 작게 설정하고, 상기 제1카운터가 제2라인(2H)에서 제2카운트 값(예컨대, "01")을 생성할 때 제1스위칭 신호(SS1)의 폭을 기준 폭으로 설정하고, 상기 제1카운터가 제3라인(3H)에서 제3카운트 값(예컨대, "10")을 생성할 때 제1스위칭 신호(SS1)의 폭을 기준 폭보다 크게 설정하고, 상기 제1카운터가 제4라인(4H)에서 제4카운트 값(예컨대, "11")을 생성할 때 제1스위칭 신호(SS1)의 폭을 기준 폭으로 설정할 수 있다.
한편, 다른 스위칭 신호들(SS2~SS4)의 폭을 조절하는 경우, 로직 회로(250)는 제1카운터에 의해 생성된 카운트 값들을 쉬프트해서 사용할 수 있다. 예컨대, 로직 회로(250)는 제1카운터가 제1라인(1H)에서 제1카운트 값을 생성할 때, 제2스위칭 신호(SS2)의 폭을 제1카운트 값을 쉬프트한 값(즉, 제2카운트 값)에 기초하여 조절할 수 있다.
예컨대, 로직 회로(250)는 제1카운터가 제1카운트 값(예컨대, "00")을 생성할 때 제1선택 신호(SELa)의 위상을 기준 위상보다 앞서도록 설정하고, 상기 제1카운터가 제2카운트 값(예컨대, "01")을 생성할 때 제1선택 신호(SELa)의 위상을 기준 위상으로 설정하고, 상기 제1카운터가 제3카운트 값(예컨대, "10")을 생성할 때 제1선택 신호(SELa)의 위상을 기준 위상보다 늦도록 설정하고, 상기 제1카운터가 제4카운트 값(예컨대, "11")을 생성할 때 제1선택 신호(SELa)의 위상을 기준 위상으로 설정할 수 있다.
로직 회로(250)는 프레임 별 타이밍 조절 작동을 수행하기 위해, 제1카운터에 의해 생성된 카운트 값과 제2카운터에 의해 생성된 값의 합에 따라 스위칭 신호들(SS)의 폭을 조절하고 선택 신호들(SEL)의 위상을 조절할 수 있다. 즉, 동일한 라인이라 하더라도 프레임이 다른 경우, 라인에 해당하는 카운트 값을 쉬프트함으로써 프레임들 내에서 블록들 사이의 타이밍의 차이가 균등하도록 스위칭 신호들(SS1~SS4)의 폭 또는 선택 신호들(SELa와 SELb)의 위상을 조절할 수 있다.
예컨대, 도 11과 도 12에 도시된 바와 같이, N번째 프레임(FR0)에서의 블록(P1)의 타이밍과, N+1번째 프레임(FR1)에서의 블록(P1)의 타이밍은 상이할 수 있다.
본 발명은 도면에 도시된 실시 예를 참고로 설명되었으나 이는 예시적인 것에 불과하며, 본 기술 분야의 통상의 지식을 가진 자라면 이로부터 다양한 변형 및 균등한 타 실시 예가 가능하다는 점을 이해할 것이다. 따라서, 본 발명의 진정한 기술적 보호 범위는 첨부된 등록청구범위의 기술적 사상에 의해 정해져야 할 것이다.
1000: 디스플레이 장치
100: 디스플레이 패널
PX: 서브 픽셀
200: 디스플레이 구동 장치
300: 게이트 드라이버
400: 타이밍 컨트롤러

Claims (17)

  1. 디스플레이 패널을 구동하는 디스플레이 구동 장치에 있어서,
    제1영상 신호를 출력하도록 구성되는 제1구동 회로;
    제2영상 신호를 출력하도록 구성되는 제2구동 회로;
    상기 제1구동 회로와 연결되고, 제1수평 시간 동안 제1스위칭 신호에 기초하여 상기 제1영상 신호를 상기 디스플레이 패널에 배열되는 서브 픽셀들의 제1세트 중 일부로 전송하도록 구성되는 제1스위치 회로; 및
    상기 제2구동 회로와 연결되고, 상기 제1수평 시간 동안 제2스위칭 신호에 기초하여 상기 제2영상 신호를 상기 서브 픽셀들의 제1세트와 인접하여 상기 디스플레이 패널에 배열되는 서브 픽셀들의 제2세트의 일부로 전송하도록 구성되는 제2스위치 회로를 포함하고,
    상기 제1수평 시간에서, 상기 제1스위치 회로의 스위칭 타이밍과 상기 제2스위치 회로의 스위칭 타이밍이 서로 다르도록 상기 제1스위칭 신호의 폭과 상기 제2스위칭 신호의 폭을 서로 다르게 하는,
    디스플레이 구동 장치.
  2. 제1항에 있어서,
    상기 제1수평 시간에서 상기 제1스위칭 신호의 하강 시점은 상기 제2스위칭 신호의 하강 시점보다 앞선,
    디스플레이 구동 장치.
  3. 제2항에 있어서,
    상기 제1수평 시간에서 상기 제1스위칭 신호의 상승 시점은 상기 제2스위칭 신호의 상승 시점과 동일한,
    디스플레이 구동 장치.
  4. 제1항에 있어서,
    상기 제1스위치 회로는,
    상기 제1수평 시간 다음의 제2수평 시간 동안 제3스위칭 신호에 기초하여 상기 제1영상 신호를 상기 서브 픽셀들의 제1세트의 다른 일부로 전송하도록 더 구성되고,
    상기 제2스위치 회로는 상기 제2수평 시간 동안 제4스위칭 신호에 기초하여 상기 제2영상 신호를 상기 서브 픽셀들의 제2세트의 다른 일부로 전송하도록 더 구성되고,
    상기 제2수평 시간에서, 상기 제3스위칭 신호의 폭과 상기 제4스위칭 신호의 폭은 서로 다른,
    디스플레이 구동 장치.
  5. 제1항에 있어서,
    상기 제1구동 회로는,
    상기 제1수평 시간 동안, 제1선택 신호에 응답하여 제1화소 데이터와 제2화소 데이터들 중에서 하나의 화소 데이터를 출력하도록 구성되는 제1멀티플렉서를 포함하고,
    상기 제2구동 회로는,
    상기 제1수평 시간 동안, 제2선택 신호에 응답하여 제3화소 데이터와 제4화소 데이터들 중에서 하나의 화소 데이터를 출력하도록 구성되는 제2멀티플렉서를 포함하고,
    상기 제1수평 시간에서 상기 제1선택 신호의 위상과 상기 제2선택 신호의 위상은 서로 다르고,
    상기 제1선택 신호와 상기 제2선택 신호의 폭은 동일한,
    디스플레이 구동 장치.
  6. 제5항에 있어서,
    상기 제1수평 시간에서 상기 제1선택 신호의 하강 시점은 상기 제2선택 신호의 하강 시점보다 앞선,
    디스플레이 구동 장치.
  7. 제5항에 있어서,
    상기 제1구동 회로는,
    상기 제1화소 데이터와 상기 제2화소 데이터를 상기 제1멀티플렉서로 출력하도록 구성되는 제1래치; 및
    상기 제1멀티플렉서로부터 출력된 상기 하나의 화소 데이터에 해당하는 제1전압을 상기 제1영상 신호로서 상기 서브 픽셀들의 제1세트로 출력하도록 구성되는 제1소스 앰프를 더 포함하고,
    상기 제2구동 회로는,
    상기 제3화소 데이터와 상기 제4화소 데이터를 상기 제2멀티플렉서로 출력하도록 구성되는 제2래치; 및
    상기 제2멀티플렉서로부터 출력된 상기 하나의 화소 데이터에 해당하는 제2전압을 상기 제2영상 신호로서 상기 서브 픽셀들의 제2세트로 출력하도록 구성되는 제2소스 앰프를 더 포함하는,
    디스플레이 구동 장치.
  8. 제1항에 있어서, 상기 디스플레이 구동 장치는,
    상기 제1스위칭 신호의 폭과 상기 제2스위칭 신호의 폭을 조절하도록 구성되는 로직 회로를 더 포함하는,
    디스플레이 구동 장치.
  9. 제8항에 있어서, 상기 로직 회로는,
    4-사이클 카운터에 기초하여, 상기 제1스위칭 신호의 각 수평 주기에서의 폭을 순차적으로 기준 폭, 상기 기준 폭 보다 작은 값, 상기 기준 폭, 및 상기 기준 폭 보다 큰 값으로 설정하도록 더 구성되는,
    디스플레이 구동 장치.
  10. 디스플레이 패널과 상기 디스플레이 패널을 구동하는 디스플레이 구동 장치를 포함하는 디스플레이 장치에 있어서,
    상기 디스플레이 패널은 상기 디스플레이 패널에 배열되는 서브 픽셀들을 포함하고,
    상기 디스플레이 구동 장치는,
    제1영상 신호를 출력하도록 구성되는 제1구동 회로;
    제2영상 신호를 출력하도록 구성되는 제2구동 회로;
    상기 제1구동 회로와 연결되고, 제1수평 시간 동안 제1스위칭 신호에 기초하여 상기 제1영상 신호를 상기 서브 픽셀들의 제1세트 중 일부로 전송하도록 구성되는 제1스위치 회로; 및
    상기 제2구동 회로와 연결되고, 상기 제1수평 시간 동안 제2스위칭 신호에 기초하여 상기 제2영상 신호를 상기 서브 픽셀들의 제1세트와 인접하여 상기 디스플레이 패널에 배열되는 서브 픽셀들의 제2세트의 일부로 전송하도록 구성되는 제2스위치 회로를 포함하고,
    상기 제1수평 시간에서, 상기 제1스위치 회로의 스위칭 타이밍과 상기 제2스위치 회로의 스위칭 타이밍이 서로 다르도록 상기 제1스위칭 신호의 폭과 상기 제2스위칭 신호의 폭을 서로 다르게 하는,
    디스플레이 장치.
  11. 제10항에 있어서,
    상기 제1수평 시간에서 상기 제1스위칭 신호의 하강 시점은 상기 제2스위칭 신호의 하강 시점보다 앞선,
    디스플레이 장치.
  12. 제10항에 있어서,
    상기 제1구동 회로는,
    상기 제1수평 시간 동안, 제1선택 신호에 응답하여 제1화소 데이터와 제2화소 데이터들 중에서 하나의 화소 데이터를 출력하도록 구성되는 제1멀티플렉서를 포함하고,
    상기 제2구동 회로는,
    상기 제1수평 시간 동안, 제2선택 신호에 응답하여 제3화소 데이터와 제4화소 데이터들 중에서 하나의 화소 데이터를 출력하도록 구성되는 제2멀티플렉서를 포함하고,
    상기 제1수평 시간에서 상기 제1선택 신호의 위상과 상기 제2선택 신호의 위상은 서로 다르고,
    상기 제1선택 신호와 상기 제2선택 신호의 폭은 동일한,
    디스플레이 장치.
  13. 제10항에 있어서, 상기 디스플레이 구동 장치는,
    상기 제1스위칭 신호의 폭과 상기 제2스위칭 신호의 폭을 조절하도록 구성되는 로직 회로를 더 포함하고,
    상기 로직 회로는,
    4-사이클 카운터에 기초하여, 상기 제1스위칭 신호의 각 수평 주기에서의 폭을 순차적으로 기준 폭, 상기 기준 폭 보다 작은 값, 상기 기준 폭, 및 상기 기준 폭 보다 큰 값으로 설정하도록 더 구성되는,
    디스플레이 장치.
  14. 복수 개의 픽셀들이 나란히 배치되는 디스플레이 패널을 구동하는 디스플레이 구동 장치에 있어서,
    상기 복수 개의 픽셀들 중 홀수 번째 픽셀로 제1영상 신호를 출력하도록 구성되는 제1구동 회로부;
    상기 복수 개의 픽셀들 중 짝수 번째 픽셀로 제2영상 신호를 출력하도록 구성되는 제2구동 회로부;
    상기 홀수 번째 픽셀과 상기 제1구동 회로부 사이에 배치되고, 상기 홀수 번째 픽셀과 상기 제1구동 회로부를 연결하기 위한 스위칭 작동을 수행하도록 구성되는 제1스위치 회로부; 및
    상기 짝수 번째 픽셀과 상기 제2구동 회로부 사이에 배치되고, 상기 짝수 번째 픽셀과 상기 제2구동 회로부를 연결하기 위한 스위칭 작동을 수행하도록 구성되는 제2스위치 회로부를 포함하고,
    상기 제1스위치 회로부의 스위칭 타이밍과 상기 제2스위치 회로부의 스위칭 타이밍은 서로 다른,
    디스플레이 구동 장치.
  15. 제14항에 있어서,
    복수의 제1스위치 회로부들 각각의 스위치 타이밍은 동일하고, 복수의 제2스위치 회로부들 각각의 스위치 타이밍은 동일한,
    디스플레이 구동 장치.
  16. 제14항에 있어서,
    상기 제1스위치 회로부는 제1스위칭 신호에 응답하여 상기 홀수 번째 픽셀과 상기 제1구동 회로부를 연결하기 위한 스위칭 작동을 수행하도록 더 구성되고,
    상기 제2스위치 회로부는 제2스위칭 신호에 응답하여 상기 짝수 번째 픽셀과 상기 제2구동 회로부를 연결하기 위한 스위칭 작동을 수행하도록 더 구성되고,
    상기 제1스위칭 신호의 폭과 상기 제2스위칭 신호의 폭은 서로 다른,
    디스플레이 구동 장치.
  17. 제14항에 있어서,
    상기 제1구동 회로부는 입력된 화소 데이터 중에서 일부를 선택하기 위한 데이터 선택 작동을 수행하도록 더 구성되고,
    상기 제2구동 회로부는 입력된 화소 데이터 중에서 일부를 선택하기 위한 데이터 선택 작동을 수행하도록 더 구성되고,
    상기 제1구동 회로부의 데이터 선택 타이밍과 상기 제2구동 회로부의 데이터 선택 타이밍은 서로 다른,
    디스플레이 구동 장치.
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