KR102263014B1 - 디스플레이 장치 - Google Patents

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Abstract

본 발명은 다수의 소스 드라이버에 고유 정보를 부여해서 동작 순서 및 동작 시간을 용이하게 조정할 수 있는 디스플레이 장치를 개시한다. 상기 디스플레이 장치는, 화소 데이터 패킷 및 제어 데이터 패킷을 포함하는 데이터 신호에 클럭 신호가 임베드된 입력 신호를 생성하고, 상기 입력 신호를 소스 드라이버에 제공하는 타이밍 컨트롤러; 및 상기 입력 신호를 수신하며, 디스플레이 패널의 화소 정보를 센싱하고, 상기 제어 데이터 패킷에 포함된 고유 정보 또는 순서 정보에 대응하여 활성화되며, 상기 제어 데이터 패킷에 포함된 동작 시간 정보에 대응하여 상기 화소 정보를 상기 타이밍 컨트롤러에 전송하기 위한 동작 시간을 결정하는 소스 드라이버;를 포함한다.

Description

디스플레이 장치{DISPLAY DEVICE}
본 발명은 디스플레이 장치에 관한 것으로, 더 상세하게는 다수의 소스 드라이버에 고유 정보를 부여해서 동작 순서 및 동작 시간을 용이하게 조정할 수 있는 디스플레이 장치에 관한 것이다.
일반적으로, 디스플레이 장치는 디스플레이 패널, 게이트 드라이버, 소스 드라이버 및 타이밍 컨트롤러 등을 포함한다.
디스플레이 패널은 게이트 라인 및 데이터 라인을 구비하고, 게이트 드라이버는 게이트 구동 전압을 게이트 라인에 공급하며, 소스 드라이버는 데이터 전압을 데이터 라인에 공급한다. 타이밍 컨트롤러는 데이터 신호를 소스 드라이버에 제공한다.
소스 드라이버는 타이밍 컨트롤러로부터 제공되는 데이터 신호를 데이터 전압으로 변환하여 디스플레이 패널에 제공한다.
이러한 소스 드라이버는 타이밍 컨트롤러로부터 제공되는 데이터 신호를 데이터 전압으로 변환하는 디지털-아날로그 변환부 및 데이터 전압을 디스플레이 패널에 출력하는 출력 회로 등을 포함한다.
한편, 디스플레이 장치는 캐리(carry) 입출력 방식을 이용하여 다수의 소스 드라이버가 디스플레이 패널로부터 센싱한 화소 정보를 타이밍 컨트롤러에 제공한다. 소스 드라이버는 캐리 신호가 입력되면 화소 정보를 타이밍 컨트롤러에 전송하고, 전송이 완료되면 다음 소스 드라이버에 캐리 신호를 출력하여 다음 소스 드라이버가 화소 정보를 전송하도록 동작한다.
이러한 디스플레이 장치는 캐리 입출력 방식을 이용하기 때문에 다수의 소스 드라이버의 동작 순서 및 동작 시간 조정이 불가능하다. 따라서, 다수의 소스 드라이버의 동작 순서 및 동작 시간 조정이 가능한 장치가 요구되고 있다.
본 발명이 해결하고자 하는 기술적 과제는 다수의 소스 드라이버에 고유 정보를 부여해서 동작 순서 및 동작 시간을 용이하게 조정할 수 있는 디스플레이 장치를 제공하는데 있다.
본 발명이 해결하고자 하는 다른 기술적 과제는 캐리 입출력을 위한 신호 라인을 배제할 수 있는 디스플레이 장치를 제공하는데 있다.
본 발명의 디스플레이 장치는, 화소 데이터 패킷 및 제어 데이터 패킷을 포함하는 데이터 신호에 클럭 신호가 임베드된 입력 신호를 생성하고, 상기 입력 신호를 소스 드라이버에 제공하는 타이밍 컨트롤러; 및 상기 입력 신호를 수신하며, 디스플레이 패널의 화소 정보를 센싱하고, 상기 제어 데이터 패킷에 포함된 고유 정보 또는 순서 정보에 대응하여 활성화되며, 상기 제어 데이터 패킷에 포함된 동작 시간 정보에 대응하여 상기 화소 정보를 상기 타이밍 컨트롤러에 전송하기 위한 동작 시간을 결정하는 소스 드라이버;를 포함한다.
본 발명의 디스플레이 장치는, 소스 드라이버 별로 고유 정보를 부여하고, 순서 정보 또는 동작 시간 정보 중 하나 이상과 상기 고유 정보를 포함하는 제어 데이터 패킷을 소스 드라이버 별로 각각 제공하는 타이밍 컨트롤러; 및 상기 제어 데이터 패킷을 복원하고, 상기 제어 데이터 패킷의 상기 고유 정보 또는 상기 순서 정보에 대응하여 선택적으로 활성화되며, 상기 동작 시간 정보에 대응하여 디스플레이 패널로부터 센싱한 화소 정보를 상기 타이밍 컨트롤러에 제공하는 다수의 소스 드라이버;를 포함한다.
상술한 바와 같이, 본 발명은 소스 드라이버의 고유 정보 또는 순서 정보 또는 동작 시간 정보를 포함하는 제어 데이터 패킷에 대응하여 화소 정보를 타이밍 컨트롤러에 제공하므로 캐리 입출력을 위한 신호 라인을 배제할 수 있다.
본 발명은 다수의 소스 드라이버의 개별 제어가 가능하고, 동작 순서 및 동작 시간을 용이하게 조정할 수 있다.
도 1은 본 발명의 디스플레이 장치의 일 실시예를 설명하기 위한 블록도이다.
도 2는 도 1의 소스 드라이버의 실시예를 설명하기 위한 블록도이다.
도 3은 본 발명의 디스플레이 장치의 다른 실시예를 설명하기 위한 블록도이다.
이하, 첨부된 도면을 참조하여 본 발명의 바람직한 실시예를 상세하게 설명한다. 본 명세서 및 특허청구범위에 사용된 용어는 통상적이거나 사전적 의미로 한정되어 해석되지 아니하며, 본 발명의 기술적 사항에 부합하는 의미와 개념으로 해석되어야 한다.
본 명세서에 기재된 실시예와 도면에 도시된 구성은 본 발명의 바람직한 실시예이며, 본 발명의 기술적 사상을 모두 대변하는 것이 아니므로, 본 출원 시점에서 이들을 대체할 수 있는 다양한 균등물과 변형예들이 있을 수 있다.
도 1은 본 발명의 디스플레이 장치의 실시예를 설명하기 위한 블록도이다.
도 1을 참고하면, 본 발명의 디스플레이 장치는 타이밍 컨트롤러(10), 다수의 소스 드라이버(SD1~SDN) 및 디스플레이 패널(20)을 포함한다.
타이밍 컨트롤러(10)는 입력 신호(CED1~CEDN)를 다수의 소스 드라이버(SD1~SDN)에 제공한다. 여기서, 입력 신호(CED1~CEDN)는 데이터 신호 사이에 클럭 신호가 임베드된 CEDS(Clock Embedded Data Signaling) 방식의 프로토콜로 제공되는 신호이다. 데이터 신호에는 화소 데이터 패킷(RWGB Packet)과 제어 데이터 패킷(CP: Control data Packet)이 포함될 수 있고, 화소 데이터 패킷에는 화소 데이터(RWGB)가 포함되며, 제어 데이터 패킷(CP)은 소스 드라이버(SD1~SDN)를 구분하기 위한 고유 정보 또는 순서 정보와, 소스 드라이버(SD1~SDN)의 화소 정보(PI: Pixel Information) 전송을 위한 동작 시간 정보 중 적어도 하나 이상이 포함될 수 있다.
본 실시예는 제어 데이터 패킷(CP) 중 일부를 소스 드라이버(SD1~SDN)를 구분하기 위한 고유 정보 또는 순서 정보로 이용할 수 있다.
일례로, 본 실시예는 제어 데이터 패킷(CP) 중 하나 이상의 특정 비트를 소스 드라이버(SD1~SDN)를 구분하기 위한 고유 정보 또는 순서 정보로 이용할 수 있다. 특정 비트가 'LLLL' 이면 소스 드라이버(SD1)가 선택되고, 특정 비트가 'LLLH' 이면 소스 드라이버(SD2)가 선택되며, 특정 비트가 'LLHL' 이면 소스 드라이버(SD3)가 선택되고, 특정 비트가 'HHHH' 이면 소스 드라이버(SD16)가 선택될 수 있다.
상기와 같은 방식으로 본 실시예는 순차적으로 소스 드라이버(SD1~SDN)가 선택되도록 동작 순서를 설정할 수 있고, 소스 드라이버(SD1~SDN)가 인터벌(interval)을 두고 선택되도록 동작 순서를 설정할 수 있으며, 소스 드라이버(SD1~SDN)가 오버랩(overlap)되어 선택되도록 동작 순서를 설정할 수 있다. 즉, 본 실시예는 소스 드라이버(SD1~SDN)의 동작 순서를 용이하게 변경할 수 있다.
그리고, 본 실시예는 제어 데이터 패킷(CP) 중 일부를 소스 드라이버(SD1~SDN)의 화소 정보 전송을 위한 동작 시간 정보로 이용할 수 있다.
일례로, 제어 데이터 패킷(CP) 중 하나 이상의 특정 비트를 화소 정보 전송을 위한 동작 시간 정보로 이용할 경우, 특정 비트가 'LL' 이면 복원된 클럭 신호의 1/4 주기 동안 화소 정보를 전송하고, 특정 비트가 'LH' 이면 복원된 클럭 신호의 반 주기 동안 화소 정보를 전송하며, 특정 비트가 'HL' 이면 복원된 클럭 신호의 한 주기 동안 화소 정보를 전송하고, 특정 비트가 'HH'이면 화소 정보 전송을 중지하도록 설정할 수 있다.
상기와 같은 방식으로 본 실시예는 소스 드라이버(SD1~SDN)의 화소 정보 전송을 위한 동작 시간을 결정할 수 있고 용이하게 조정할 수 있다.
그리고, 입력 신호(CED1~CEDN)는 차동 신호(Differential Signaling) 방식 또는 단일 신호(Single-ended Signaling) 방식으로 전송될 수 있으며, 입력 신호(CED1~CEDN)에 포함된 클럭 신호 및 데이터 신호는 동일한 레벨의 진폭으로 구성될 수 있다.
이러한 입력 신호(CED1~CEDN)는 클럭 훈련(CT: Clock Training) 구간과 데이터 전송 구간에 다른 포맷을 갖고 전송된다. 입력 신호(CED1~CEDN)는 클럭 훈련 구간에 클럭 신호만을 포함하는 포맷을 가지며, 데이터 전송 구간에 클럭 신호가 데이터 신호 사이에 임베드된 포맷을 갖는다.
타이밍 컨트롤러(10)는 상기와 같은 CEDS방식의 프로토콜을 통해서 소스 드라이버(SD1~SDN)에 대한 고유 정보 또는 순서 정보 또는 동작 시간 정보 중 적어도 하나 이상이 포함된 제어 데이터 패킷(CP)을 입력 신호(CED1~CEDN)에 포함시켜 다수의 소스 드라이버(SD1~SDN)에 제공한다. 본 실시예는 제어 데이터 패킷(CP)을 입력 신호(CED1~CEDN)에 포함시켜 전송하는 것으로 구성하였으나, 별도의 제어 라인(도시되지 않음)을 통해서 제어 데이터 패킷을 소스 드라이버(SD1~SDN)에 제공하는 것으로 구성할 수 있다.
각각의 소스 드라이버(SD1~SDN)는 입력 신호(CED1~CEDN)로부터 데이터 신호와 클럭 신호를 복원하며, 데이터 신호에 포함된 화소 데이터(RWGB)를 데이터 전압으로 변환하여 디스플레이 패널(20)에 제공한다.
그리고, 소스 드라이버(SD1~SDN)는 디스플레이 패널(20)의 화소 정보(PI: Pixel Information)를 센싱하고, 데이터 신호에 포함된 제어 데이터 패킷(CP)에 대응하여 화소 정보(PI)를 공통 전송 라인(BUS-LINE)을 통해서 타이밍 컨트롤러(10)에 제공한다. 여기서, 공통 전송 라인(BUS-LINE)은 소스 드라이버(SD1~SDN)에 의해 공유된다.
결국, 소스 드라이버(SD1~SDN)는 제어 데이터 패킷(CP)에 포함된 고유 정보 또는 순서 정보 또는 동작 시간 정보 중 적어도 하나를 이용하여 공통 전송 라인(BUS-LINE)을 점유한다. 일례로, 소스 드라이버(SD1~SDN)는 고유 정보 또는 순서 정보에 대응하여 순차적으로 공통 전송 라인을 점유하거나, 인터벌을 두고 점유하거나 오버랩으로 점유할 수 있다.
소스 드라이버(SD1~SDN)의 내부 구성을 설명하면 다음과 같다. 본 발명은 설명의 간략화를 위해 소스 드라이버(SD1)의 구성 설명으로 다른 소스 드라이버(SD2~SDN)의 구성 설명을 대체한다.
도 2는 도 1의 소스 드라이버(SD1)의 실시예를 설명하기 위한 블록도이다.
도 2를 참고하면, 소스 드라이버(SD1)는 제어부(30), 데이터 변환부(32), 샘플링 회로(42) 및 ADC(Analog to Digital Converter, 40)를 포함한다.
제어부(30)는 입력 신호(CED1)로부터 화소 데이터 패킷과 제어 데이터 패킷(CP)이 포함된 데이터 신호를 복원하고, 입력 신호(CED1)로부터 클럭 신호를 복원한다.
제어부(30)는 화소 데이터 패킷과 클럭 신호를 데이터 신호 변환부(32)에 제공하고, 제어 데이터 패킷(CP)을 ADC(40)에 제공한다. 일례로, 제어부(30)는 클럭 신호를 복원하는 클럭 신호 복원부(도시되지 않음)와, 클럭 신호 복원부에서 생성된 샘플링 클럭 신호에 대응하여 데이터 신호를 복원하는 데이터 복원부(도시되지 않음)를 포함할 수 있다. 또한, 제어부(30)는 동작 시간을 카운팅하는 카운터(도시되지 않음)를 포함할 수 있다.
데이터 변환부(32)는 래치부(34), DAC(Digital to Analog Converter, 36) 및 출력 회로(38)를 포함한다. 데이터 변환부(32)의 래치부(34)는 제어부(30)로부터 복원된 화소 데이터 패킷을 래치하고 DAC(36)에 제공하며, DAC(36)는 화소 데이터 패킷을 데이터 전압으로 변환하고 출력 회로(38)에 제공하며, 출력 회로(38)는 데이터 전압을 버퍼링하고 디스플레이 패널(20)에 출력한다.
샘플링 회로(42)는 디스플레이 패널(20)의 화소 정보(PI)를 센싱하고, 화소 정보(PI)를 ADC(40)에 제공한다. 화소 정보(PI)에는 화소 전압이 포함될 수 있다. 이러한 화소 전압은 디스플레이 패널(20) 보상에 이용된다.
일례로, 디스플레이 패널(20)을 오엘이디 패널로 구성할 경우, 오엘이디 패널은 화소 별 구동 트랜지스터 및 유기발광소자를 포함하며, 데이터 전압의 인가와 구동 트랜지스터의 턴온에 의해 유기발광소자가 발광하도록 구성된다. 구동 트랜지스터는 문턱전압(Vth: threshold voltage)을 가지며, 화소 별 구동 트랜지스터들의 문턱전압은 차이가 있을 수 있다. 상기한 문턱전압 차에 의하여 동일한 데이터 전압이 인가되어도 화소 별로 구동 트랜지스터의 전류가 달라질 수 있다. 화소 별 문턱전압 차에 의해 화소마다 다른 휘도를 가질 수 있다. 이를 보상하기 위해 샘플링 회로(42)에 의해 센싱된 화소 전압은 구동 트랜지스터의 문턱전압 연산에 이용되고, 문턱전압은 디스플레이 패널(20) 보상에 이용된다.
ADC(40)는 샘플링 회로(42)로부터 센싱한 화소 정보(PI)를 디지털 신호로 변환하고, 제어 데이터 패킷(CP)에 대응하여 화소 정보(PI)를 타이밍 컨트롤러(10)에 제공한다. 이러한 ADC(40)는 제어 데이터 패킷(CP)에 포함된 소스 드라이버(SD1~SDN)를 구분하기 위한 고유 정보 또는 순서 정보에 대응하여 활성화되고, 제어 데이터 패킷(CP)에 포함된 소스 드라이버(SD1~SDN)의 동작 시간 정보에 대응하여 복원된 클럭 신호의 일정 주기 동안 화소 정보(PI)를 타이밍 컨트롤러(10)에 전송한다.
이와 같이 소스 드라이버(SD1)는 캐리 입출력 방식이 아닌, 제어 데이터 패킷(CP)에 포함된 고유 정보 또는 순서 정보에 따라 활성화되고, 제어 데이터 패킷(CP)에 포함된 동작 시간 정보에 따라 화소 정보(PI)를 타이밍 컨트롤러(10)에 제공하며, 다른 소스 드라이버(SD2~SDN)들도 제어 데이터 패킷(CP)에 포함된 고유 정보 또는 순서 정보에 따라 활성화되고, 제어 데이터 패킷(CP)에 포함된 동작 시간 정보에 따라 화소 정보(PI)를 타이밍 컨트롤러(10)에 제공한다.
따라서, 본 발명은 제어 데이터 패킷(CP)에 포함된 고유 정보 또는 순서 정보에 따라 다수의 소스 드라이버(SD1~SDN)를 선택적으로 활성화하여 동작하므로 다수의 소스 드라이버(SD1~SDN)의 개별 제어가 가능하고 동작 순서를 용이하게 변경할 수 있다.
또한, 본 발명은 제어 데이터 패킷(CP)에 포함된 동작 시간 정보에 따라 동작 시간을 결정할 수 있고 화소 정보(PI)를 타이밍 컨트롤러(10)에 제공할 수 있으므로 동작 시간을 용이하게 조정할 수 있다.
또한, 본 발명은 고유 정보 또는 순서 정보 또는 동작 시간 정보를 제어 데이터 패킷(CP)에 포함시켜 동작하므로 캐리 입출력을 위한 별도의 캐리 신호 라인을 배제할 수 있다.
한편, 본 실시예는 소스 드라이버(SD1~SDN)가 디스플레이 패널(20)로부터 센싱한 화소 정보(PI)를 제공하는 것을 예시하고 있으나, 소스 드라이버(SD1~SDN)의 상태 정보 등을 제공하는 것으로 구성할 수 있다.
또한, 본 실시예는 제어 데이터 패킷(CP)에 포함된 고유 정보 또는 순서 정보를 이용하여 소스 드라이버(SD1~SDN)가 순차적으로 동작하거나, 인터벌(interval)을 두고 동작하거나, 오버랩(overlap)으로 동작하는 등 동작 순서와 동작 시간을 변경하여 화소 정보(PI)를 타이밍 컨트롤러(10)에 제공하는 것으로 구성할 수 있다.
일례로, 본 실시예는 소스 드라이버(SD1~SDN)를 순차적으로 동작시킬 경우, 소스 드라이버(SD1~SDN)를 구분하기 위한 데이터 패킷(CP)의 특정 비트를 'LLLL', 'LLLH' ~ 'HHHH" 와 같은 방식으로 순차적으로 제공하여 소스 드라이버(SD1~SDN)가 순차적으로 선택되도록 구성할 수 있다.
또한, 본 실시예는 소스 드라이버(SD1~SDN)를 인터벌(interval)을 두고 동작시킬 경우, 소스 드라이버(SD1~SDN)를 구분하기 위한 데이터 패킷(CP)의 특정 비트를 'LLLL', 'LLHL', 'LHLL' 와 같은 방식으로 제공하거나 'LLLL', 'LLHH', 'LHLH' 와 같은 방식으로 제공하여 인터벌을 두고 소스 드라이버(SD1~SDN)가 선택되도록 구성할 수 있다.
도 3은 본 발명의 디스플레이 장치의 다른 실시예를 설명하기 위한 블록도이다. 구체적으로 도 3은 데이터 전송률을 증가 시키기 위한 목적으로 공통 전송라인(BUS-LINE)을 다수 개로 구성하고, 소스 드라이버(SD1~SDN)를 오버랩으로 동작시키는 실시예를 설명하기 위한 블록도이다.
도 3을 참고하면, 본 실시예는 소스 드라이버(SD1~SDN)를 구분하기 위한 데이터 패킷(CP)을 각각의 공통 전송라인(BUS-LINE#1, BUS-LINE#2)에 연결된 제1그룹의 소스 드라이버 및 제2그룹의 소스 드라이버에 동시에 제공하여 제1그룹 및 제2그룹의 소스 드라이버(SD1~SDN)가 시간적으로 오버랩되어 동시에 동작하도록 구성할 수 있다.
구체적으로 예를 들면, 본 실시예는 소스 드라이버(SD1~SDN)를 구분하기 위한 데이터 패킷(CP)의 특정 비트를 소스 드라이버 SD1과 SDN-2에는 'LLLL'을 제공하고 SD2과 SDN-1에는 'LLLH'를 제공함으로써 각각의 공통 버스라인(BUS-LINE#1, BUS-LINE#2)을 통해서 화소 정보(PI)를 동시에 수신할 수 있다. 도 3은 두 개의 공통 전송 라인을 예시로 설명하고 있으나, 이에 한정되는 것은 아니다.
이와 같이, 본 실시예는 소스 드라이버(SD1~SDN)를 구분하기 위한 고유 정보 또는 순서 정보를 이용하여 제어 데이터 패킷(CP) 포함시켜 동작하므로 소스 드라이버(SD1~SDN)의 동작 순서를 용이하게 변경할 수 있다. 또한, 본 실시예는 데이터 신호에 제어 데이터 패킷을 포함시켜 전송하는 것으로 구성하였으나, 별도의 제어 라인(도시되지 않음)을 통해서 제어 데이터 패킷을 소스 드라이버(SD1~SDN)에 제공하는 것으로 구성할 수 있다.
10: 타이밍 컨트롤러 20: 디스플레이 패널
SD1 ~ SDN: 소스 드라이버 30: 제어부
32: 데이터 변환부 34: 래치부
36: DAC 38: 출력 회로
40: ADC 42: 샘플링 회로

Claims (14)

  1. 화소 데이터 패킷 및 제어 데이터 패킷을 포함하는 데이터 신호에 클럭 신호가 임베드된 입력 신호를 생성하고, 상기 입력 신호를 복수개의 소스 드라이버들에 제공하는 타이밍 컨트롤러; 및
    상기 입력 신호를 수신하며, 디스플레이 패널의 화소 정보를 센싱하고, 상기 제어 데이터 패킷에 포함된 상기 복수개의 소스 드라이버들을 식별하기 위한 고유 정보 또는 상기 복수개의 소스 드라이버들의 동작 순서를 결정하기 위한 순서 정보에 대응하여 활성화되며, 상기 제어 데이터 패킷에 포함된 동작 시간 정보에 대응하여 상기 화소 정보를 상기 타이밍 컨트롤러에 전송하기 위한 동작 시간을 결정하는 상기 복수개의 소스 드라이버들;을 포함하고,
    상기 복수개의 소스 드라이버들 각각은,
    상기 디스플레이 패널의 상기 화소 정보를 센싱하는, 상기 화소 정보에는 화소들 각각에 대한 화소 전압이 포함되는, 샘플링 회로; 및
    상기 동작 시간 동안 상기 샘플링 회로에 의해 센싱된 상기 화소 정보를 상기 타이밍 컨트롤러에 전송하는 ADC를 포함하는 디스플레이 장치.
  2. 제 1 항에 있어서, 상기 제어 데이터 패킷은
    상기 고유 정보 또는 상기 순서 정보와, 상기 화소 정보를 상기 타이밍 컨트롤러에 전송하기 위한 상기 동작 시간 정보 중 적어도 하나 이상을 포함하도록 설정된 디스플레이 장치.
  3. 제 1 항에 있어서, 상기 복수개의 소스 드라이버들은
    상기 고유 정보 또는 상기 순서 정보에 대응하여 선택적으로 활성화되고, 상기 동작 시간 정보에 대응하여 상기 화소 정보를 상기 타이밍 컨트롤러에 제공하도록 설정된 디스플레이 장치.
  4. 제 3 항에 있어서, 상기 복수개의 소스 드라이버들은
    상기 입력 신호로부터 상기 데이터 신호와 상기 클럭 신호를 복원하는 제어부;
    복원된 상기 클럭 신호에 대응하여 복원된 상기 데이터 신호를 상기 디스플레이 패널에 제공하는 데이터 변환부;
    를 더 포함하는 디스플레이 장치.
  5. 제 1 항에 있어서,
    상기 복수개의 소스 드라이버들에 의해 공유되는 공통 전송 라인;을 더 포함하고,
    상기 복수개의 소스 드라이버들은 상기 고유 정보 또는 상기 순서 정보에 대응하여 상기 공통 전송 라인을 점유하고, 상기 공통 전송 라인을 통해서 상기 화소 정보를 상기 타이밍 컨트롤러에 제공하는 디스플레이 장치.
  6. 제 5 항에 있어서, 상기 복수개의 소스 드라이버들은
    상기 고유 정보 또는 상기 순서 정보에 대응하여 순차적으로 상기 공통 전송 라인을 점유하거나, 인터벌을 두고 상기 공통 전송 라인을 점유하거나, 오버랩으로 점유하도록 설정된 디스플레이 장치.
  7. 제 6 항에 있어서, 상기 복수개의 소스 드라이버들은
    상기 동작 시간 정보에 대응하여 상기 클럭 신호의 일정 주기 동안 상기 화소 정보를 전송하도록 설정된 디스플레이 장치.
  8. 제 1 항에 있어서,
    상기 복수개의 소스 드라이버들 중 제1그룹에 의해 공유되는 제1공통 전송 라인; 및
    상기 복수개의 소스 드라이버들 중 제2그룹에 의해 공유되는 제2공통 전송 라인;을 더 포함하고,
    상기 제1그룹 및 상기 제2그룹의 상기 복수개의 소스 드라이버들 각각은 상기 고유 정보 또는 상기 순서 정보에 대응하여 상기 제1공통 전송 라인 및 상기 제2공통 전송 라인을 점유하도록 설정된 디스플레이 장치.
  9. 제 8 항에 있어서,
    상기 제1그룹 및 상기 제2그룹의 상기 복수개의 소스 드라이버들은 시간적으로 오버랩되어 상기 화소 정보를 동시에 제공하도록 설정된 디스플레이 장치.
  10. 복수개의 소스 드라이버들을 식별하기 위한 고유 정보를 부여하고, 순서 정보 또는 동작 시간 정보 중 하나 이상과 상기 고유 정보를 포함하는 제어 데이터 패킷을 상기 복수개의 소스 드라이버들 각각에 제공하는 타이밍 컨트롤러; 및
    상기 제어 데이터 패킷을 복원하고, 상기 고유 정보 또는 상기 순서 정보에 대응하여 선택적으로 활성화되며, 상기 동작 시간 정보에 대응하여 디스플레이 패널로부터 센싱한 화소 정보를 상기 타이밍 컨트롤러에 제공하는 상기 복수개의 소스 드라이버들;
    을 포함하고,
    상기 복수개의 소스 드라이버들 각각은,
    상기 디스플레이 패널의 상기 화소 정보를 센싱하는, 상기 화소 정보에는 화소들 각각에 대한 화소 전압이 포함되는, 샘플링 회로; 및
    상기 동작 시간 동안 상기 샘플링 회로에 의해 센싱된 상기 화소 정보를 상기 타이밍 컨트롤러에 전송하는 ADC를 포함하는 디스플레이 장치.
  11. 제 10 항에 있어서, 상기 타이밍 컨트롤러는
    상기 제어 데이터 패킷을 별도의 제어 라인을 통해서 상기 복수개의 소스 드라이버들에 제공하도록 설정된 디스플레이 장치.
  12. 제 10 항에 있어서, 상기 복수개의 소스 드라이버들은
    공통 전송 라인을 통해서 상기 화소 정보를 상기 타이밍 컨트롤러에 제공하고, 상기 고유 정보 또는 상기 순서 정보에 대응하여 상기 공통 전송 라인을 점유하도록 설정된 디스플레이 장치.
  13. 제 12 항에 있어서,
    제1공통 전송 라인; 및 제2공통 전송 라인;을 더 포함하고,
    상기 제1공통 전송 라인은 상기 복수개의 소스 드라이버들 중 제1그룹에 의해 공유되며, 상기 제2공통 전송 라인은 상기 복수개의 소스 드라이버들 중 제2그룹에 의해 공유되는 디스플레이 장치.
  14. 제 13 항에 있어서,
    상기 제1그룹 및 상기 제2그룹의 상기 복수개의 소스 드라이버들 각각은 상기 고유 정보 또는 상기 순서 정보에 대응하여 상기 제1공통 전송 라인 및 상기 제2공통 전송 라인을 점유하고, 시간적으로 오버랩되어 상기 화소 정보를 동시에 제공하도록 설정된 디스플레이 장치.
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