KR101372959B1 - 액정표시장치의 게이트 구동용 쉬프트 레지스터 - Google Patents

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Abstract

본 발명은 액정표시장치의 게이트 구동용 쉬프트 레지스터에 관한 것으로, 액정표시장치의 게이트 구동용 쉬프트 레지스터는 하나의 스테이지를 이용하여 액정화소의 1 표시시간(1 Horizontal time) 내에 별도의 데이터 기입을 위해 2번의 스캔신호를 출력하되, 서로 독립된 클럭신호 및 캐리신호를 이용함으로써 두번째 스캔신호의 출력 타이밍을 자유롭게 조절할 수 있으며, 이에 블랙 데이터 삽입(BDI) 구동 등과 같은 응용 구동의 적용 범위가 확장되는 장점을 제공한다.

Description

액정표시장치의 게이트 구동용 쉬프트 레지스터{Shift register for liquid crystal display device}
본 발명은 액정표시장치의 구동회로에 관한 것으로서, 특히 액정표시장치의 시감특성 향상을 위해 블랙 데이터(Black data)를 삽입하는 구동에서 상기 블랙 데이터의 삽입이 용이하도록 스캔신호 출력타이밍을 제어할 수 있는 게이트구동용 쉬프트 레지스터에 관한 것이다.
디스플레이 장치 중 특히 액정표시장치는 소형 및 박형화와 저전력 소모의 장점을 가지며, 노트북 컴퓨터, 사무자동화 기기, 오디오/비디오 기기 등으로 이용되고 있다. 특히, 스위치 소자로서 박막 트랜지스터(Thin Film Transistor : 이하 "TFT"라 함)가 이용되는 액티브 매트릭스 타입의 액정표시장치는 동적인 이미지를 표시하기에 적합하다.
도 1은 일반적인 액정표시장치의 기본 구성을 도시한 블록구성도로서, 크게 액정패널(2)과 LCM구동회로부(26)로 구분된다.
각 구성을 보면, 인터페이스(10)는 퍼스널 컴퓨터등과 같은 구동시스템으로부터 LCM구동회로부(26)로 입력되는 데이터(RGB Data) 및 제어신호(입력 클럭, 수평동기신호, 수직동기신호, 데이터 인에이블 신호 등)들을 입력받아 타이밍 컨트롤러(12)로 공급한다. 주로 구동 시스템으로부터 데이터 및 제어 신호전송을 위해서 LVDS(Low Voltage Differential Signal) 인터페이스와 TTL 인터페이스 등이 사용되고 있다. 또한, 이러한 인터페이스 기능을 모아서 타이밍컨트롤러(12)와 함께 단일 칩(Chip)으로 집적시켜 사용하기도 한다.
액정패널(2)은 도 2와 같이, 글라스를 이용한 기판 상에 다수의 데이터라인(DL1~DLm)과 다수의 게이트라인(GL1~GLn)이 교차되어 다수의 화소영역을 형성하며, 각각의 화소영역에는 박막트랜지스터(TFT)와 액정(LC)이 구성되어 화면을 표시한다.
타이밍 컨트롤러(12)는 인터페이스(10)를 통해 입력되는 제어신호를 이용하여 복수개의 드라이브 집적회로들로 구성된 소스드라이버(18)와 복수개의 게이트 드라이버 집적회로들로 구성된 게이트 드라이버(20)를 구동하기 위한 제어신호를 생성한다. 또한 인터페이스(10)를 통해 입력되는 데이터들을 소스드라이버(18)로 전송한다.
기준전압생성부(16)는 소스드라이버(18)에서 사용되는 DAC(Digital To Analog Converter)의 기준전압들을 생성한다. 기준전압들은 패널의 투과율-전압특성을 기준으로 생산자에 의해서 설정된다.
소스드라이버(18)는 타이밍 컨트롤러(12)로부터 입력되는 제어신호들에 응답 하여 입력 데이터의 기준전압들을 선택하고, 선택된 기준전압을 액정패널(2)에 공급하여 액정 분자의 회전 각도를 제어한다.
게이트드라이버(20)는 타이밍 컨트롤러(12)로부터 입력되는 제어신호들에 응답하여 액정패널(2)상에 배열된 박막트랜지스터(TFT)들의 온/오프(on/off) 제어를 수행하는데, 스캔신호(Scan signal)를 출력하여 액정패널(2) 상의 게이트라인(GL1~GLn)을 1 수평동기 시간씩 순차적으로 인에이블(enable) 시킴으로써 액정패널(2) 상의 박막트랜지스터들(TFT)을 1 라인 분씩 순차적으로 구동시켜 소스드라이버(18)로부터 공급되는 아날로그 영상신호들이 각 박막트랜지스터(TFT)들에 접속된 픽셀들로 인가되도록 한다.
전원전압생성부(14)는 각 구성부들의 동작전원을 공급하고 액정패널(2)의 공통전극 전압을 생성하여 공급한다.
또한 도시되지는 않았지만 하나 이상의 램프(lamp)를 구비하여 상기 액정패널(2)로 광(light)을 공급하는 백라이트 유닛(Back-light unit)을 더욱 포함한다.
상기 구성 중 게이트드라이버(20)는 다수의 스캔 신호(Vg1~ Vgn)를 출력하는 다수의 스테이지를 포함하는 게이트 드라이버(20)의 일실시 구성을 도 3에 도시하였다.
도 3은 종래 기술에 의해 n 개의 스캔신호(Vg1~Vgn)를 출력하는 n 개의 스테이지(stage:즉, ST1~STn)로 구성되는 게이트드라이버(20)를 도시한 도면으로서, 각각의 스테이지(ST1~STn)는 쉬프트 레지스터(Shift register: 이하 S/R)이다.
상기 제1스테이지 내지 제 n 번째 스테이지(ST1~STn)는 각각 하이레벨 구동 전압(VDD) 및 로우레벨 구동전압(VSS)과 다수의 클럭신호(CLKs)가 입력되고, 상기 구동전압(VDD, VSS)과 다수의 클럭신호(CLKs) 중 선택된 일부 클럭신호에 응답하여 발생된 전단의 스테이지 출력을 후단 스테이지의 동작 개시를 위한 스타트 신호(Vst)로 공급함으로써 도 4와 같은 순차 타이밍의 게이트구동신호를 출력한다.
이때 상기 각 스테이지(ST1~STn)는 모두 동일한 회로 구성의 쉬프트 레지스터(S/R) 회로이며, 도 5에 예시한 것과 같이, 출력제어부(50)와, 풀-업(pull-up)/풀-다운(pull-down) 트랜지스터(Tup, Tdn)로 구성된 출력회로부(60)의 구성을 가진다.
상기 출력제어부(50)는 상기 구동전압(VDD, VSS)과 클럭신호(CLKs)를 이용하여 상기 출력회로부(60)의 동작을 제어하는데, 상기 풀-업 트랜지스터(Tup)를 통해 스캔신호{(Vg(n)}의 출력을 제어하기 위한 Q 노드와, 상기 풀-다운 트랜지스터(Tdn)를 제어하여 상기 출력회로부(60)의 리셋(reset)을 수행하기 위한 QB 노드를 구비한다.
그런데, 최근 들어 표시영상의 화질 및 시감 특성을 개선하기 위한 다양한 구동방법이 제안되고 있는데, 그 중에서는 블랙-데이터 삽입(Black-data insertion:BDI) 방식과 같이 액정화소의 1 표시시간(1 Horizontal time) 내에 별도의 데이터 기입을 위해 2번의 스캔신호를 인가해야 할 필요성이 대두되었다.
따라서 상기한 요구를 실현하기 위해서는 상기 일반적인 구성의 쉬프트레지스터(S/R)로는 1 표시시간(1 vertical time) 내에 새로운 스타트 신호(Vst)를 인가함으로서 2번째 스캔신호를 출력하는 방법밖에 없다.
즉, 상기 도 5에 도시한 바와 같이, 액정표시장치에서 채용하는 일반적인 쉬프트 레지스터는 상기 스타트 신호(Vst)의 신호위상을 기준으로 상기 클럭신호(CLKs)로 제공되는 다수 클럭신호들의 신호 위상이 각각 결정되고 있으며, 이와 더불어 상기 클럭신호(CLKs) 중 하나의 클럭신호를 상기 풀-업 트랜지스터(Tup)에서 입력받아 스캔신호로 출력하는 구조에서는 상기 풀-업 트랜지스터(Tup)로 입력되는 클럭신호와 다른 위상 구간에서는 스캔신호를 출력할 수 없는 구조이다.
본 발명은 상기와 같은 문제점을 해결하기 위해 안출된 것으로서, 단일 쉬프트레지스터를 통해 클럭신호 위상이 서로 다른 타이밍에 스캔신호를 출력하도록 함으로써 액정표시장치의 응용 구동의 범위를 확장시키는 것을 목적으로 한다.
상기와 같은 목적을 달성하기 위해 본 발명은, 스캔신호를 출력하는 다수개의 스테이지로 구성된 액정표시장치의 게이트 구동용 쉬프트 레지스터로서,
다수의 클럭신호로 구성된 제1클럭신호군 중 선택된 클럭신호와 제1출력제어신호에 따라 제1스캔신호를 출력하는 제1풀업회로부와, 다수의 클럭신호들로 구성된 제2클럭신호군 중 선택된 클럭신호와 제2출력제어신호에 따라 제2스캔신호를 출력하는 제2풀업회로부와, 리셋신호에 따라 상기 제1풀업회로부와 상기 제2풀업회로 부의 리셋을 수행하는 풀-다운회로부를 구비한 출력회로부와; 이전단 스테이지 및 다음단 스테이지의 제1스캔신호 및 제2스캔신호를 각각 입력받으며, 상기 제1출력제어신호, 상기 제2출력제어신호와 상기 리셋신호를 각각 출력하는 Q1 노드, Q2 노드, QB 노드를 구비한 출력제어부를 포함하여 일 스테이지를 구성하는 액정표시장치의 게이트 구동용 쉬프트 레지스터를 제안한다.
상기 제1클럭신호군과 제2클럭신호군은 각각 순차 지연출력되어 위상이 서로 다른 제1클럭신호 내지 제4클럭신호로 구성되고, 또한 상기 제1클럭신호군과 제2클럭신호군의 순번이 서로 대응되는 두 클럭신호의 위상은 서로 다른 것을 특징으로 한다.
상기 제1풀업회로부는, 상기 제1클럭신호군으로부터 클럭신호를 입력받으며 상기 Q1 노드로부터 입력되는 상기 제1출력제어신호에 의해 스위칭 제어되어 상기 제1스캔신호를 출력하는 제1-1풀업트랜지스터 및 제1-2풀업트랜지스터를 포함한다.
상기 제2풀업회로부는, 상기 제2클럭신호군으로부터 클럭신호를 입력받으며 상기 Q2 노드로부터 입력되는 상기 제2출력제어신호에 의해 스위칭 제어되어 상기 제2스캔신호를 출력하는 제2-1풀업트랜지스터 및 제2-2풀업트랜지스터를 포함한다.
상기 제1풀업회로부 또는 상기 제2풀업회로부의 각 풀업트랜지스터는 서로 동일 타입의 트랜지스터인 것을 특징으로 한다.
상기 풀-다운회로부는, 상기 QB 노드로부터 출력되는 상기 리셋신호에 의해 스위칭 제어되는 풀다운트랜지스터로 구성되는 것을 특징으로 한다.
상기 출력제어부는, 상기 이전단 스테이지의 제1스캔신호와 상기 다음단 스 테이지의 제1스캔신호를 입력받아 상기 Q1 노드를 통해 상기 제1출력제어신호를 출력하고, 상기 이전단 스테이지의 제2스캔신호와 상기 다음단 스테이지의 제2스캔신호를 입력받아 상기 Q2 노드를 통해 상기 제2출력제어신호를 출력하는 것을 특징으로 한다.
또한 상기 출력제어부는, 상기 QB 노드에 상기 리셋신호가 충전될 때 상기 Q1 노드 또는 상기 Q2 노드를 방전시키는 Q1/Q2방전회로가 구성되는 것을 특징으로 한다.
상기와 같은 특징의 본 발명에 따르면, 액정표시장치의 게이트 구동용 쉬프트 레지스터는 하나의 스테이지를 이용하여 액정화소의 1 표시시간(1 Horizontal time) 내에 별도의 데이터 기입을 위해 2번의 스캔신호를 출력하되, 클럭신호 또는 동작신호간 간섭이 없어 두번째 스캔신호의 출력 타이밍을 자유롭게 조절할 수 있으며, 이에 블랙 데이터 삽입(BDI) 구동 등과 같은 응용 구동의 적용 범위가 확장되는 장점이 있다.
이하 첨부된 도면을 참조하여 본 발명에 대해 상세하게 설명한다.
먼저, 본 발명은 액정화소의 1 표시시간(1 Horizontal time) 내에 별도의 데이터 기입을 위해 2번의 스캔신호를 출력하되, 두번째 스캔신호의 출력 타이밍을 자유롭게 조절할 수 있도록 하는 것이다.
이에 도 6은 본 발명에 따른 액정표시장치의 게이트 구동용 쉬프트 레지스터(100)의 n 번째 스테이지 구성을 간략 도시한 구성도로서, 출력제어부(110)와 출력회로부(120)로 구분하여 도시하였다.
상기 출력제어부(110)는 이전단 스테이지(n-1번째 스테이지)로부터 각각 출력된 캐리신호{(C1(n-1),C2(n-1)}와 다음단 스테이지(n+1번째 스테이지)로부터 출력된 캐리신호{(C1(n+1),C2(n+1)}를 S1, S2, R1, R2 입력단을 통해 입력받아 Q1노드(Q1), Q2노드(Q2) 및 QB노드(QB)로 각각 제1출력제어신호, 제2출력제어신호 및 리셋신호를 출력한다.
상기 출력회로부(120)는 다수의 클럭신호로 구성된 제1클럭신호군(CLKs1) 중 선택된 클럭신호와 상기 Q1 노드(Q1)로부터 출력되는 제1출력제어신호에 따라 제1스캔신호{Vg1(n)}를 출력하는 제1풀업회로부(122)와, 역시 다수의 클럭신호들로 구성된 제2클럭신호군(CLKs2) 중 선택된 클럭신호와 상기 Q2노드(Q2)로부터 출력되는 제2출력제어신호에 따라 제2스캔신호{Vg2(n)}를 출력하는 제2풀업회로부(124)와, 상기 QB노드(QB)로부터 출력되는 리셋신호에 따라 상기 제1풀업회로부(122)와 상기 제2풀업회로부(124)의 리셋을 수행하는 풀다운회로부(126)로 구성된다.
상기 제1풀업회로부(122)는 상기 제1클럭신호군(CLKs1)으로부터 선택된 클럭신호를 입력받으며 상기 Q1노드(Q1)로부터 입력되는 상기 제1출력제어신호에 의해 스위칭 제어되어 상기 제1스캔신호{Vg1(n)}를 출력하도록 동시 구동되는 제1-1풀업트랜지스터(T1-1) 및 제1-2풀업트랜지스터(T1-2)를 포함하여 구성되고, 상기 제2풀 업회로부(124)는 상기 제2클럭신호군(CLKs2)으로부터 클럭신호를 입력받으며 상기 Q2 노드(Q2)로부터 입력되는 상기 제2출력제어신호에 의해 스위칭 제어되어 상기 제2스캔신호{Vg2(n)}를 출력하도록 동시 구동되는 제2-1풀업트랜지스터(T2-1) 및 제2-2풀업트랜지스터(T2-2)를 포함한다.
또한 풀다운회로부(126)는 상기 QB 노드(QB)로부터 출력되는 상기 리셋신호에 의해 스위칭 제어되는 풀다운트랜지스터(Tdn)로 구성되며, 이때 상기 제1-1풀업트랜지스터(T1-1) 및 제1-2풀업트랜지스터(T1-2), 제2-1풀업트랜지스터(T2-1) 및 제2-2풀업트랜지스터(T2-2), 상기 풀다운트랜지스터(Tdn)는 모두 동일 타입의 트랜지스터이며, 바람직하게는 모두 n-타입의 박막트랜지스터이다.
상기 구성의 제1풀업회로부(122)와 제2풀업회로부(124)는 각각 제1스캔신호{Vg1(n)}와 제2스캔신호{Vg2(n)}를 출력함과 더불어 상기 제1스캔신호{Vg1(n)}와 제2스캔신호{Vg2(n)}를 각각 이전단 스테이지(n-1번째 스테이지) 및 다음단 스테이지(n+1번째 스테이지)에 캐리신호(carry)로 전달하여 상기 이전단 스테이지(n-1번째 스테이지) 및 다음단 스테이지(n+1번째 스테이지)의 S1, S2, R1, R2 입력단으로 제공한다.
상기 간략 구성도를 통해 설명한 바와 같이 본 발명에 따른 쉬프트 레지스터의 특징을 요약하면,
(1) 상기 제1클럭신호군(CLKs1)의 클럭신호와 상기 이전단 스테이지(n-1번째 스테이지)의 제1스캔신호{Vg1(n-1)}와 상기 다음단 스테이지(n+1번째 스테이지)의 제1스캔신호{Vg1(n+1)}를 각각 S1, R1 입력단으로 입력받아 상기 제1풀업회로 부(122)를 통해 상기 제1스캔신호{Vg1(n)}를 출력하도록 하고,
(2) 상기 제2클럭신호군(CLKs2)의 클럭신호와 상기 이전단 스테이지(n-1번째 스테이지)의 제2스캔신호{Vg2(n-1)}와 상기 다음단 스테이지(n+1번째 스테이지)의 제2스캔신호{Vg2(n+1)}를 각각 S2, R2 입력단으로 입력받아 상기 제2풀업회로부(124)를 통해 상기 제2스캔신호{Vg2(n)}를 출력한다.
(3) 이때 상기 제1클럭신호군(CLKs1)과 제2클럭신호군(CLKs2)은 각각 순차 지연출력되어 위상이 서로 다른 제1클럭신호 내지 제4클럭신호로 구성되고, 또한 상기 제1클럭신호군과 제2클럭신호군의 순번이 서로 대응되는 두 클럭신호의 위상은 서로 다르도록 구성한다.
즉, 일 스테이지(stage)에서 실질적으로 별개로 제공되는 상기 제1클럭신호군(CLKs1)과 제2클럭신호군(CLKs2)을 이용하기 때문에, 상기 제1클럭신호군(CLKs1)과 상기 제1풀업회로부(122)를 통해 상기 제1스캔신호{Vg1(n)}를 출력한 이후에 상기 제2클럭신호군(CLKs2)의 입력시점을 자유롭게 설정함으로써 상기 제2풀업회로부(124)를 통해 출력되는 제2스캔신호{Vg2(n)}의 출력 타이밍을 자유롭게 조절할 수 있게 된다.
도 7과 도 8은 각각 본 발명에 따른 액정표시장치의 게이트 구동용 쉬프트 레지스터의 일 스테이지에 대한 구체적인 예시 회로도 및 예시 구동타이밍도이다.
본 발명에 따른 쉬프트 레지스터는 최초 스테이지의 S1 입력단 및 S2 입력단에 각각 인가된 제1스타트신호(Vst1) 및 제2스타트신호(Vst2)에 의해 각각의 스테이지는 순차적으로 제1스캔신호{Vg1(1), Vg1(2),...Vg1(n),...} 및 제2스캔신 호{Vg2(1), Vg2(2),...Vg2(n),...}를 출력하게 되는데 그 중 임의의 n 번째 스테이지에서의 동작을 설명한다.
먼저, n-2번째 스테이지의 제1스캔신호{Vg1(n-2)}는 캐리신호(carry signal)로 이용되어 S1 입력단에 입력되어 도 8의 (구간 ①)과 같이 Q1노드(Q1)를 충전한다. 이때 상기 도 8에는 n-2번째 스테이지로부터 캐리신호가 입력되는 것으로 예시하였으나 이는 설계자에 따라 변경될 수 있는 부분이다.
이후 상기 충전된 Q1 노드(Q1)는 제1풀업회로부(도 6의 122)에 해당하는 도 8의 제1-1풀업트랜지스터(T1-1) 및 제1-2풀업트랜지스터(T1-2)를 온(on) 스위칭시키게 되고, 이에 상기 제1클럭신호군(CLKs1)의 제1클럭신호(CLK11)이 입력되는 타이밍에 제1스캔신호{Vg1(n)}와 제1캐리신호{C1(n)}를 출력한다. (구간 ②)
이때 도 8의 제25트랜지스터(t25)와 같이 Q1노드(Q1)의 동작시 Q2노드(Q2)를 기저전원(VSS)에 연결함으로써 상기 Q2노드(Q2)의 방전을 통해 상기 제2풀업회로부(도 6의 124)에 해당하는 제2-1풀업트랜지스터(T2-1) 및 제2-2풀업트랜지스터(T2-2)의 오프(off)상태 유지제어를 수행할 수도 있다.
이후 (구간 ③)과 같이 후속 순번의 스테이지로부터 R1 입력단에 입력되는 캐리신호를 이용하여 상기 Q1노드(Q1)의 방전을 수행한다. 이때 도 8에는 n+4번째 스테이지로부터 출력된 제1스캔신호{Vg1(n+4)}를 캐리신호로 이용하는 것으로 예시하였으나 이는 설계자에 따라 변경가능하다.
아울러 상기 제1구동전압(VDD1)에 의해 지속적인 충전상태(하이 레벨 상태)를 유지하며 상기 Q1 노드(Q1)의 충전상태에 의해 스위칭되어 방전(로우 레벨 상 태)되는 상기 QB1 노드(QB1)에 의해 스위칭되는 방전회로(즉, t15)를 구성하여 상기 S1 입력단에 캐리신호가 입력되기 전까지 상기 Q1 노드(Q1)를 로우 레벨로 유지하도록 하여 상기 회로의 동작 정확성을 증대시키는 것이 바람직하다.
이후 상기와 같은 방법으로 상기 제2스캔신호{Vg2(n)}출력방법을 설명하면, n-2번째 스테이지의 제2스캔신호{Vg2(n-2)}는 캐리신호(carry signal)로 S2 입력단에 입력되어 도 8의 (구간 ④)과 같이 Q2노드(Q2)를 충전한다.
이후 충전된 상기 Q2 노드(Q2)는 제2풀업회로부(도 6의 124)에 해당하는 도 8의 제2-1풀업트랜지스터(T2-1) 및 제2-2풀업트랜지스터(T2-2)를 온(on) 스위칭시키게 되고, 이에 상기 제2클럭신호군(CLKs2)의 제1클럭신호(CLK21)이 입력되는 타이밍에 제2스캔신호{Vg2(n)}와 제2캐리신호{C2(n)}를 출력한다. (구간 ⑤)
이때 도 8의 제5트랜지스터(t5)와 같이 Q2노드(Q2)의 동작시 Q1노드(Q1)를 기저전원(VSS)에 연결함으로써 상기 Q1노드(Q1)의 방전을 통해 상기 제1풀업회로부(도 6의 122)에 해당하는 제1-1풀업트랜지스터(T1-1) 및 제1-2풀업트랜지스터(T1-2)의 오프(off)상태 유지제어를 수행할 수도 있다.
이후 (구간 ⑥)과 같이 후속 순번의 스테이지로부터 R2 입력단에 입력되는 캐리신호를 이용하여 상기 Q2노드(Q2)의 방전을 수행한다. 이 역시 도 8에는 n+4번째 스테이지로부터 출력된 제2스캔신호{Vg2(n+4)}를 캐리신호로 이용하는 것으로 예시하였으나 설계자에 따라 변경가능하다.
아울러 상기 제2구동전압(VDD2)에 의해 지속적인 충전상태(하이 레벨 상태)를 유지하며 상기 Q2 노드(Q2)의 충전상태에 의해 스위칭되어 방전(로우 레벨 상 태)되는 상기 QB2 노드(QB2)에 의해 스위칭되는 방전회로(즉, t35)를 구성하여 상기 S2 입력단에 캐리신호가 입력되기 전까지 상기 Q2 노드(Q2)를 로우 레벨로 유지하도록 하여 상기 회로의 동작 정확성을 증대시키는 것이 바람직하다.
이상 상기 도 6과 도 7, 도 8의 예시 회로도 및 예시 구동타이밍도를 통해 설명한 바와 같이, 본 발명에 따른 액정표시장치의 게이트 구동용 쉬프트 레지스터는 하나의 스테이지를 이용하여 액정화소의 1 표시시간(1 Horizontal time) 내에 별도의 데이터 기입을 위해 2번의 스캔신호를 출력하되, 서로 독립된 클럭신호 및 캐리신호를 이용함으로써 두번째 스캔신호의 출력 타이밍을 자유롭게 조절할 수 있으며, 이에 블랙 데이터 삽입(BDI) 구동 등과 같은 응용 구동의 적용 범위가 확장되는 장점이 있다.
도 1은 일반적인 액정표시장치의 기본 구성을 도시한 블록구성도
도 2는 도 1의 구성 중 액정패널의 구성을 간략히 도시한 도면
도 3은 종래 기술에 의해 n 개의 게이트구동신호(Vg1~Vgn)를 출력하는 게이트드라이버의 구성을 도시한 도면
도 4는 도 3의 게이트드라이버에 의해 출력되는 순차 타이밍의 게이트구동신호를 도시한 신호타이밍도
도 5는 종래 기술에 따른 액정표시장치의 게이트 구동용 쉬프트 레지스터의 일 스테이지 구성을 간략 도시한 구성도
도 6은 본 발명에 따른 액정표시장치의 게이트 구동용 쉬프트 레지스터의 일 스테이지 구성을 간략 도시한 구성도
도 7은 본 발명에 따른 액정표시장치의 게이트 구동용 쉬프트 레지스터의 일 스테이지에 대한 예시 회로도
도 8은 본 발명에 따른 액정표시장치의 게이트 구동용 쉬프트 레지스터의 일 스테이지에 대한 예시 구동타이밍도
<도면의 주요부분에 대한 간단한 설명>
110 : 출력제어부 120 : 출력회로부
122 : 제1풀업회로부 124 : 제2풀업회로부
126 : 풀다운회로부

Claims (8)

  1. 스캔신호를 출력하는 다수개의 스테이지로 구성된 액정표시장치의 게이트 구동용 쉬프트 레지스터로서,
    다수의 클럭신호로 구성된 제1클럭신호군 중 선택된 클럭신호와 제1출력제어신호에 따라 제1스캔신호를 출력하는 제1풀업회로부와, 다수의 클럭신호들로 구성된 제2클럭신호군 중 선택된 클럭신호와 제2출력제어신호에 따라 제2스캔신호를 출력하는 제2풀업회로부와, 리셋신호에 따라 상기 제1풀업회로부와 상기 제2풀업회로부의 리셋을 수행하는 풀다운회로부를 구비한 출력회로부와;
    이전단 스테이지 및 다음단 스테이지의 제1스캔신호 및 제2스캔신호를 각각 입력받으며, 상기 제1출력제어신호, 상기 제2출력제어신호와 상기 리셋신호를 각각 출력하는 Q1 노드, Q2 노드, QB 노드를 구비한 출력제어부
    를 포함하여 일 스테이지를 구성하는 액정표시장치의 게이트 구동용 쉬프트 레지스터
  2. 청구항 제 1 항에 있어서,
    상기 제1클럭신호군과 제2클럭신호군은 각각 순차 지연출력되어 위상이 서로 다른 제1클럭신호 내지 제4클럭신호로 구성되고, 또한 상기 제1클럭신호군과 제2클럭신호군의 순번이 서로 대응되는 두 클럭신호의 위상은 서로 다른 것을 특징으로 하는 액정표시장치의 게이트 구동용 쉬프트 레지스터
  3. 청구항 제 1 항에 있어서,
    상기 제1풀업회로부는,
    상기 제1클럭신호군으로부터 클럭신호를 입력받으며 상기 Q1 노드로부터 입력되는 상기 제1출력제어신호에 의해 스위칭 제어되어 상기 제1스캔신호를 출력하는 제1-1풀업트랜지스터 및 제1-2풀업트랜지스터
    를 포함하는 액정표시장치의 게이트 구동용 쉬프트 레지스터
  4. 청구항 제 1 항에 있어서,
    상기 제2풀업회로부는,
    상기 제2클럭신호군으로부터 클럭신호를 입력받으며 상기 Q2 노드로부터 입력되는 상기 제2출력제어신호에 의해 스위칭 제어되어 상기 제2스캔신호를 출력하는 제2-1풀업트랜지스터 및 제2-2풀업트랜지스터
    를 포함하는 액정표시장치의 게이트 구동용 쉬프트 레지스터
  5. 청구항 제 3 항 또는 제 4 항에 있어서,
    상기 각 풀업트랜지스터는 서로 동일 타입의 트랜지스터인 것을 특징으로 하는 액정표시장치의 게이트 구동용 쉬프트 레지스터
  6. 청구항 제 1 항에 있어서,
    상기 풀다운회로부는,
    상기 QB 노드로부터 출력되는 상기 리셋신호에 의해 스위칭 제어되는 풀다운트랜지스터로 구성되는 액정표시장치의 게이트 구동용 쉬프트 레지스터
  7. 청구항 제 1 항에 있어서,
    상기 출력제어부는,
    상기 이전단 스테이지의 제1스캔신호와 상기 다음단 스테이지의 제1스캔신호를 입력받아 상기 Q1 노드를 통해 상기 제1출력제어신호를 출력하고, 상기 이전단 스테이지의 제2스캔신호와 상기 다음단 스테이지의 제2스캔신호를 입력받아 상기 Q2 노드를 통해 상기 제2출력제어신호를 출력하는 것을 특징으로 하는 액정표시장치의 게이트 구동용 쉬프트 레지스터
  8. 청구항 제 1 항에 있어서,
    상기 출력제어부는,
    상기 QB 노드에 상기 리셋신호가 충전될 때 상기 Q1 노드 또는 상기 Q2 노드를 방전시키는 Q1/Q2방전회로가 구성되는 것을 특징으로 하는 액정표시장치의 게이트 구동용 쉬프트 레지스터
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