KR100885485B1 - 반도체 메모리장치 - Google Patents
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Abstract
Description
Claims (19)
- 소정 동작의 기준신호를 지연시키는 기준신호 지연부;뱅크 어드레스를 지연시키는 어드레스 지연부; 및지연된 상기 기준신호를 지연된 상기 뱅크 어드레스에 의해 지정되는 뱅크에 대한 소정 동작의 시점을 결정하기 위한 신호로 출력하는 디코딩부를 포함하는 반도체 메모리장치.
- 제 1항에 있어서,상기 어드레스 지연부는,상기 뱅크 어드레스를 상기 기준신호에 동기하여 지연시키는 것을 특징으로 하는 반도체 메모리장치.
- 제 1항에 있어서,상기 기준신호 지연부는,상기 기준신호를 지연시키기 위한 복수의 딜레이단을 포함하는 것을 특징으로 하는 반도체 메모리장치.
- 제 3항에 있어서,상기 어드레스 지연부는,상기 복수의 딜레이단 각각의 입/출력 신호에 의해 열리고 닫히며 상기 뱅크 어드레스를 지연시키는 복수의 래치단을 포함해 구성되는 것을 특징으로 하는 반도체 메모리장치.
- 제 4항에 있어서,상기 복수의 래치단은,각각의 뱅크 어드레스 별로 구비되는 것을 특징으로 하는 반도체 메모리장치.
- 액티브 신호를 지연시키는 기준신호 지연부;뱅크 어드레스를 지연시키는 어드레스 지연부; 및지연된 상기 액티브 신호를 지연된 상기 뱅크 어드레스에 의해 지정되는 뱅크에 대한 프리차지 신호로 출력하는 디코딩부를 포함하는 반도체 메모리장치.
- 제 6항에 있어서,상기 반도체 메모리장치는 리프레쉬 동작시에,상기 뱅크 어드레스에 의해 지정된 뱅크가, 상기 액티브 신호에 의해 액티브되며, 상기 프리차지 신호에 의해 프리차지 되는 것을 특징으로 하는 반도체 메모리장치.
- 제 6항에 있어서,상기 어드레스 지연부는,상기 뱅크 어드레스를 상기 액티브 신호에 동기하여 지연시키는 것을 특징으로 하는 반도체 메모리장치.
- 제 6항에 있어서,상기 기준신호 지연부는,상기 액티브 신호를 지연시키기 위한 복수의 딜레이단을 포함하는 것을 특징으로 하는 반도체 메모리장치.
- 제 9항에 있어서,상기 어드레스 지연부는,상기 복수의 딜레이단 각각의 입/출력 신호에 의해 열리고 닫히며 상기 뱅크 어드레스를 지연시키는 복수의 래치단을 포함해 구성되는 것을 특징으로 하는 반도체 메모리장치.
- 삭제
- 제 9항에 있어서,상기 액티브 신호는 펄스 신호이며,상기 딜레이단은, 상기 액티브 신호를 지연시키면서 프리차지 동작에 맞게 그 펄스 폭을 변화시키는 것을 특징으로 하는 반도체 메모리장치.
- 각각 다수의 메모리셀을 포함하는 복수의 메모리 뱅크;각 뱅크별로 이루어지는 소정 동작의 기준신호를 생성하는 제어회로; 및상기 소정 동작의 기준신호와 뱅크 어드레스를 동기해 지연시키고, 지연된 상기 뱅크 어드레스가 지정하는 상기 뱅크에 지연된 상기 소정 동작의 기준신호를 공급하는 지연블록을 포함하는 반도체 메모리장치.
- 제 13항에 있어서,상기 지연블록은,상기 기준신호를 지연시키는 기준신호 지연부;상기 뱅크 어드레스를 지연시키는 어드레스 지연부; 및지연된 상기 기준신호를 지연된 상기 뱅크 어드레스에 의해 지정되는 뱅크에 대한 소정 동작의 시점을 결정하기 위한 신호로 출력하는 디코딩부를 포함하는 반도체 메모리장치.
- 제 14항에 있어서,상기 어드레스 지연부는,상기 뱅크 어드레스를 상기 기준신호에 동기하여 지연시키는 것을 특징으로 하는 반도체 메모리장치.
- 제 14항에 있어서,상기 기준신호 지연부는,상기 기준신호를 지연시키기 위한 복수의 딜레이단을 포함하는 것을 특징으로 하는 반도체 메모리장치.
- 제 16항에 있어서,상기 어드레스 지연부는,상기 복수의 딜레이단 각각의 입/출력 신호에 의해 열리고 닫히며 상기 뱅크 어드레스를 지연시키는 복수의 래치단을 포함해 구성되는 것을 특징으로 하는 반도체 메모리장치.
- 제 17항에 있어서,상기 복수의 래치단은,각각의 뱅크 어드레스 별로 구비되는 것을 특징으로 하는 반도체 메모리장치.
- 제 13항에 있어서,상기 제어회로에서 출력하는 상기 기준신호는 액티브 신호이며,상기 지연블록에서 출력되는 지연된 상기 기준신호는 프리차지 신호인 것을 특징으로 하는 반도체 메모리장치.
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