KR100757548B1 - Plasma Display Apparatus and Driving Method Thereof - Google Patents

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Abstract

본 발명은 플라즈마 디스플레이 장치 및 그의 구동방법에 관한 것이다.The present invention relates to a plasma display device and a driving method thereof.

이러한 본 발명에 따른 플라즈마 디스플레이 장치는 복수 개의 스캔 전극과 서스테인 전극이 형성된 플라즈마 디스플레이 패널, 복수 개의 스캔 전극과 복수 개의 서스테인 전극을 구동시키기 위한 구동부 및 서스테인 전극이 플로팅(floating)되도록 제어하는 구동 펄스 제어부를 포함한다.The plasma display apparatus according to the present invention includes a plasma display panel in which a plurality of scan electrodes and a sustain electrode are formed, a driving unit for driving the plurality of scan electrodes and the plurality of sustain electrodes, and a driving pulse control unit for controlling the sustain electrodes to float. It includes.

또한, 본 발명에 따른 플라즈마 디스플레이 장치의 구동방법은 리셋 기간, 어드레스 기간 및 서스테인 기간에 어드레스 전극(X1 ~ Xm)(m은 양의 정수), 스캔 전극 및 서스테인 전극에 리셋 펄스, 어드레스 펄스 및 서스테인 펄스를 인가하는 플라즈마 디스플레이 장치의 구동 방법에 있어서, 리셋 기간에 서스테인 전극은 플로팅(floating)되는 것을 특징으로 한다.Further, the method of driving a plasma display apparatus according to the present invention is a reset period, an address period, and the address electrodes (X 1 ~ Xm) during the sustain period (m is a positive integer), the reset pulse to the scan electrode and the sustain electrode, an address pulse, and In the driving method of the plasma display device applying the sustain pulse, the sustain electrode is floated in the reset period.

따라서, 본 발명은 리셋 기간에서 스캔 전극에는 종래와 같은 정극성 펄스를 인가하고 서스테인 전극은 플로팅(floating)시켜 스캔 전극과 어드레스 전극 사이의 대향방전을 이용하여 벽전하를 안정적으로 셋팅함으로써 스캔 전극과 서스테인 전극간의 간격을 넓게 형성하더라도 안정적인 방전이 일어날 수 있는 효과가 있다.Accordingly, in the reset period, the present invention applies the same positive pulse to the scan electrode and floats the sustain electrode to stably set the wall charge by using the opposite discharge between the scan electrode and the address electrode. Even if the interval between the sustain electrodes is formed wide, there is an effect that a stable discharge can occur.

Description

플라즈마 디스플레이 장치 및 그의 구동방법{Plasma Display Apparatus and Driving Method Thereof}Plasma Display Apparatus and Driving Method Thereof

도 1은 일반적인 플라즈마 디스플레이 패널의 구조를 나타낸 도.1 is a view showing the structure of a typical plasma display panel.

도 2는 종래 플라즈마 디스플레이 패널의 화상 계조를 표현하는 방법을 나타낸 도.2 is a diagram illustrating a method of expressing image gradation of a conventional plasma display panel.

도 3은 종래 플라즈마 디스플레이 패널의 구동방법에 따른 구동파형을 나타낸 도.3 is a view illustrating a driving waveform according to a driving method of a conventional plasma display panel.

도 4는 종래 플라즈마 디스플레이 패널의 리셋기간에서 벽전하 변화를 나타낸 도.4 is a view showing a change in wall charge in a reset period of a conventional plasma display panel.

도 5는 본 발명에 따른 플라즈마 디스플레이 장치의 구조를 설명하기 위한 도.5 is a diagram for explaining the structure of a plasma display device according to the present invention;

도 6은 본 발명에 따른 플라즈마 디스플레이 장치의 리셋 펄스를 포함하는 파형을 설명하기 위한 파형도.6 is a waveform diagram for explaining a waveform including a reset pulse of the plasma display device according to the present invention;

<도면의 주요 부분에 대한 부호의 설명><Explanation of symbols for main parts of the drawings>

500; 플라즈마 디스플레이 패널 510; 데이터 구동부500; Plasma display panel 510; Data driver

520; 스캔 구동부 530; 서스테인 구동부520; A scan driver 530; Sustain drive

540; 구동 펄스 제어부 550; 구동 전압 발생부540; A driving pulse controller 550; Drive voltage generator

본 발명은 플라즈마 디스플레이 패널 구동방법에 관한 것으로, 더욱 상세하게는 리셋(Reset) 기간에서 공급되는 구동파형을 개선하여 리셋 방전이 안정적으로 일어날 수 있는 플라즈마 디스플레이 장치 및 그의 구동방법에 관한 것이다.BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a plasma display panel driving method, and more particularly, to a plasma display device and a driving method thereof in which reset discharge can be stably generated by improving a driving waveform supplied in a reset period.

일반적으로 플라즈마 디스플레이 장치(Plasma Display Apparatus)는 전면패널과 후면패널 사이에 형성된 격벽이 하나의 단위 셀을 이루는 플라즈마 디스플레이 패널을 포함한다. 각 셀 내에는 네온(Ne), 헬륨(He) 또는 네온 및 헬륨의 혼합기체(Ne+He)와 같은 주 방전 기체와 소량의 크세논을 함유하는 불활성 가스가 충진되어 있다. 고주파 전압에 의해 방전이 될 때, 불활성 가스는 진공자외선(Vacuum Ultraviolet rays)을 발생하고 격벽 사이에 형성된 형광체를 발광시켜 화상이 구현된다. 이와 같은 플라즈마 디스플레이 장치는 얇고 가벼운 구성이 가능하므로 차세대 표시 장치로서 각광받고 있다. In general, a plasma display device includes a plasma display panel in which a partition wall formed between a front panel and a rear panel forms one unit cell. Each cell is filled with a main discharge gas such as neon (Ne), helium (He) or a mixture of neon and helium (Ne + He) and an inert gas containing a small amount of xenon. When discharged by a high frequency voltage, the inert gas generates vacuum ultraviolet rays and emits phosphors formed between the partition walls to realize an image. Such a plasma display device has a spotlight as a next generation display device because of its thin and light configuration.

도 1은 일반적인 플라즈마 디스플레이 패널의 구조를 나타낸 도이다.1 illustrates a structure of a general plasma display panel.

도 1에 도시된 바와 같이, 플라즈마 디스플레이 패널은 화상이 디스플레이 되는 표시면인 전면 글라스(101)에 스캔 전극(102)과 서스테인 전극(103)이 쌍을 이뤄 형성된 복수의 유지전극쌍이 배열된 전면패널(100) 및 배면을 이루는 후면 글 라스(111) 상에 상술한 복수의 유지전극쌍과 교차되도록 복수의 어드레스 전극(113)이 배열된 후면패널(110)이 일정거리를 사이에 두고 평행하게 결합된다.As shown in FIG. 1, a plasma display panel includes a front panel in which a plurality of sustain electrode pairs formed by pairing a scan electrode 102 and a sustain electrode 103 are arranged on a front glass 101, which is a display surface on which an image is displayed. The rear panel 110 on which the plurality of address electrodes 113 are arranged so as to intersect the plurality of sustain electrode pairs on the back glass 111 forming the back surface 100 and the rear surface is coupled in parallel with a predetermined distance therebetween. do.

전면패널(100)은 하나의 방전셀에서 상호 방전시키고 셀의 발광을 유지하기 위한 스캔 전극(102) 및 서스테인 전극(103), 즉 투명한 ITO(Indium Thin Oxide) 물질로 형성된 투명 전극(a)과 금속 재질로 제작된 버스 전극(b)으로 구비된 스캔 전극 및 서스테인 전극(103)의 방전 전류를 제한하며 전극 쌍 간을 절연시켜주는 하나 이상의 유전체층(104)에 의해 덮혀진다. 유전체층(104) 전면에는 방전 조건을 용이하게 하기 위하여 산화마그네슘(MgO)을 증착한 보호층(105)이 형성된다.The front panel 100 may include a scan electrode 102 and a sustain electrode 103, that is, a transparent electrode a made of a transparent indium thin oxide (ITO) material for mutual discharge in one discharge cell and maintaining light emission of the cell. It is covered by one or more dielectric layers 104 which limit the discharge current of the scan electrode and the sustain electrode 103 provided with the bus electrode b made of a metal material and insulate the electrode pairs. A protective layer 105 in which magnesium oxide (MgO) is deposited is formed on the entire surface of the dielectric layer 104 to facilitate discharge conditions.

후면패널(110)은 복수개의 방전 공간 즉, 방전셀을 형성시키기 위한 스트라이프 타입(또는 웰 타입)의 격벽(112)이 평행을 유지하여 배열된다. 또한, 어드레스 방전을 수행하는 다수의 어드레스 전극(113)이 격벽(112)에 대해 평행하게 배치된다. 후면패널(110)의 상측면에는 서스테인 방전시 화상 표시를 위한 가시광선을 방출하는 R, G, B 형광체(114)가 도포된다. 어드레스 전극(113)과 형광체(114) 사이에는 어드레스 전극(113)을 보호하기 위한 유전체층(115)이 형성된다.The rear panel 110 is arranged in such a manner that a plurality of discharge spaces, that is, partitions 112 of stripe type (or well type) for forming discharge cells are maintained in parallel. In addition, a plurality of address electrodes 113 for performing address discharge are arranged in parallel with the partition wall 112. On the upper side of the rear panel 110, R, G, and B phosphors 114 which emit visible light for displaying an image during sustain discharge are coated. A dielectric layer 115 is formed between the address electrode 113 and the phosphor 114 to protect the address electrode 113.

이와 같은 구조를 갖는 종래 플라즈마 디스플레이 패널의 화상 계조를 표현하는 방법을 살펴보면 다음 도 2와 같다.A method of expressing image gradation of a conventional plasma display panel having such a structure will be described with reference to FIG. 2.

도 2는 종래 플라즈마 디스플레이 패널의 화상 계조를 표현하는 방법을 나타낸 도이다. 2 is a diagram illustrating a method of expressing image gray scale of a conventional plasma display panel.

도 2에 도시된 바와 같이, 플라즈마 디스플레이 패널의 화상 계조는 한 프레임을 발광횟수가 다른 여러 서브필드로 나누어 구동하고 있다. 각 서브필드는 방전 을 균일하게 일으키기 위한 리셋 기간, 방전 셀을 선택하기 위한 어드레스 기간 및 방전횟수에 따라 계조를 구현하는 서스테인 기간으로 나뉘어 진다. 예를 들어, 256 계조로 화상을 표시하고자 하는 경우에 1/60 초에 해당하는 프레임 기간(16.67ms)은 8개의 서브필드들로 나누어지게 된다. 아울러, 8개의 서브 필드들 각각은 어드레스 기간과 서스테인 기간으로 다시 나누어지게 된다. 여기서, 각 서브필드의 리셋 기간 및 어드레스 기간은 각 서브필드마다 동일한 반면에 서스테인 기간은 각 서브필드에서 2n (n = 0,1,2,3,4,5,6,7)의 비율로 증가된다. 이와 같은 플라즈마 디스플레이 패널의 구동방법에 따른 구동파형을 살펴보면 다음 도 3과 같다.As shown in FIG. 2, the image gradation of the plasma display panel is driven by dividing one frame into several subfields having different emission counts. Each subfield is divided into a reset period for uniformly generating a discharge, an address period for selecting a discharge cell, and a sustain period for implementing gray levels according to the number of discharges. For example, when the image is to be displayed with 256 gray levels, the frame period (16.67 ms) corresponding to 1/60 second is divided into eight subfields. In addition, each of the eight subfields is divided into an address period and a sustain period. Here, the reset period and the address period of each subfield are the same for each subfield, while the sustain period increases at a rate of 2n (n = 0,1,2,3,4,5,6,7) in each subfield. do. Referring to the driving waveform according to the driving method of the plasma display panel as shown in FIG.

도 3은 종래 플라즈마 디스플레이 패널의 구동방법에 따른 구동파형을 나타낸 도이다. 3 is a diagram illustrating a driving waveform according to a driving method of a conventional plasma display panel.

도 3에 도시된 바와 같이 플라즈마 디스플레이 패널은 전 화면을 초기화시키기 위한 리셋 기간, 방전할 셀을 선택하기 위한 어드레스 기간, 선택된 셀의 방전을 유지시키기 위한 서스테인 기간 및 방전된 셀 내의 벽전하를 소거하기 위한 소거 기간으로 나뉘어 구동된다.As shown in FIG. 3, the plasma display panel includes a reset period for initializing the entire screen, an address period for selecting a cell to be discharged, a sustain period for maintaining the discharge of the selected cell, and erasing wall charges in the discharged cell. It is divided into the erase period for driving.

리셋 기간에 있어서, 셋업 기간에는 모든 스캔 전극들에 상승 램프파형이 동시에 인가된다. 이 상승 램프파형에 의해 전화면의 셀들 내에는 방전이 일어난다. 이 셋업 방전에 의해 어드레스 전극과 서스테인 전극상에는 정극성(+) 벽전하가 쌓이게 되며, 스캔 전극 상에는 부극성(-)의 벽전하가 쌓이게 된다. 셋 다운기간에는 상승 램프파형이 공급된 후, 상승 램프파형의 피크전압보다 낮은 정극성(+) 전압에서 떨어지기 시작하여 그라운드(GND)레벨 전압 이하의 특정 전압레벨(-Vw)까지 떨 어지는 하강 램프파형(Ramp-down)이 셀들 내에 미약한 소거방전을 일으킴으로써 과도하게 형성된 벽 전하를 충분히 소거시키게 된다. 이 셋다운방전에 의해 어드레스 방전이 안정되게 일어날 수 있을 정도의 벽전하가 셀들 내에 균일하게 잔류된다.In the reset period, the rising ramp waveform is simultaneously applied to all scan electrodes in the setup period. This rising ramp waveform causes discharge to occur in the cells of the full screen. By this setup discharge, positive wall charges are accumulated on the address electrode and the sustain electrode, and negative wall charges are accumulated on the scan electrode. In the set-down period, after the rising ramp waveform is supplied, the rising ramp waveform starts to fall from the positive voltage lower than the peak voltage of the rising ramp waveform and falls to a specific voltage level (-Vw) below the ground (GND) level voltage. Ramp-down causes a slight erase discharge in the cells, thereby sufficiently eradicating the excessively formed wall charge. By this set-down discharge, the wall charges such that the address discharge can be stably generated remain uniformly in the cells.

어드레스 기간에는 부극성(-) 전압(-Vy)의 스캔 펄스(Scan)가 스캔 전극들에 순차적으로 인가됨과 동시에 스캔 펄스에 동기되어 어드레스 전극에 정극성(+) 전압의 데이터펄스(data)가 인가된다. 이 스캔 펄스와 데이터 펄스의 전압 차와 초기화기간에 생성된 벽 전압이 더해지면서 데이터펄스가 인가되는 셀 내에는 어드레스 방전이 발생된다. 어드레스방전에 의해 선택된 셀들 내에는 서스테인 전압(Vs)이 인가될 때 방전이 일어날 수 있게 하는 정도의 벽전하가 형성된다. 서스테인 전극에는 셋다운 기간과 어드레스 기간 동안에 스캔 전극과의 전압차를 줄여 스캔 전극과의 오방전이 일어나지 않도록 정극성(+) 전압(Vz)이 공급된다.In the address period, a scan pulse of a negative voltage (-Vy) is sequentially applied to the scan electrodes and a data pulse of a positive voltage is applied to the address electrode in synchronization with the scan pulse. Is approved. As the voltage difference between the scan pulse and the data pulse and the wall voltage generated during the initialization period are added, an address discharge is generated in the cell to which the data pulse is applied. In the cells selected by the address discharge, wall charges such that discharge can occur when the sustain voltage Vs is applied are formed. The positive electrode voltage (Vz) is supplied to the sustain electrode so that the voltage difference with the scan electrode is reduced during the set down period and the address period so that no misdischarge with the scan electrode occurs.

서스테인 기간에는 스캔 전극과 서스테인 전극들에 교번적으로 서스테인 펄스(Sus)가 인가된다. 어드레스방전에 의해 선택된 셀은 셀 내의 벽 전압과 서스테인 펄스가 더해지면서 매 서스테인 펄스가 인가될 때 마다 스캔 전극과 서스테인 전극 사이에 서스테인 방전 즉, 표시방전이 일어나게 된다.In the sustain period, a sustain pulse Su is applied to the scan electrode and the sustain electrodes alternately. In the cell selected by the address discharge, the sustain voltage, that is, the display discharge, is generated between the scan electrode and the sustain electrode every time the sustain pulse is applied as the wall voltage and the sustain pulse in the cell are added.

서스테인 방전이 완료된 후, 소거 기간에서는 펄스폭과 전압레벨이 작은 소거 램프파형(Ramp-ers)의 전압이 서스테인 전극에 공급되어 전화면의 셀들 내에 잔류하는 벽 전하를 소거시키게 된다.After the sustain discharge is completed, in the erase period, a voltage of an erase ramp waveform Ramp-ers having a small pulse width and a low voltage level is supplied to the sustain electrode to erase the wall charge remaining in the cells of the full screen.

한편, 이와 같이 구동되는 종래 플라즈마 디스플레이 패널의 리셋 기간에서 벽전하 변화를 살펴보면 다음 도 4와 같다.On the other hand, the change in the wall charge in the reset period of the conventional plasma display panel is driven as shown in Figure 4 as follows.

도 4는 종래 플라즈마 디스플레이 패널의 리셋기간에서 벽전하 변화를 나타낸 도이다. 4 is a view showing a change in wall charge in the reset period of the conventional plasma display panel.

도 4를 살펴보면, (a)는 리셋기간의 셋업기간에서의 벽전하 상태를 나타낸 것이고, (b)는 리셋기간의 다운기간에서의 벽전하 상태를 나타낸 것으로, 먼저, 셋업기간에 스캔 전극에 상승램프파형이 공급됨에 따라 스캔 전극에는 부극성 벽전하가, 서스테인 전극과 어드레스 전극에는 정극성 벽전하가 쌓인다. 이 후, 셋다운 기간에 스캔 전극에 하강램프파형이 공급됨에 따라 전압 극성이 반전되어 과도하고 불균형적으로 생성된 벽전하가 일정량 줄어든다. 이 때, 면방전이 발생하게 되는데, 면방전이란 투명전극을 통해 셀 전체 면적에서 발생하는 스캔 전극과 서스테인 전극간의 방전을 말한다. 이러한 면방전을 통하여 어드레스 방전이 안정되게 일어날수 있도록 벽전하를 셋팅한다.Referring to FIG. 4, (a) shows the wall charge state in the setup period of the reset period, and (b) shows the wall charge state in the down period of the reset period. As the ramp waveform is supplied, negative wall charges are accumulated on the scan electrodes, and positive wall charges are accumulated on the sustain electrodes and the address electrodes. Subsequently, as the falling lamp waveform is supplied to the scan electrode in the set-down period, the voltage polarity is inverted to reduce the amount of excessive and disproportionately generated wall charges. In this case, surface discharge occurs, and surface discharge refers to a discharge between the scan electrode and the sustain electrode generated in the entire cell area through the transparent electrode. Through this surface discharge, the wall charge is set so that the address discharge can be stably generated.

그러나 최근들어 플라즈마 디스플레이 패널의 방전효율을 향상시키기 위하여 스캔 전극과 서스테인 전극간의 방전 갭(gap)을 증가시키는데, 방전 갭이 증가할수록 면방전 전압은 상승한다. 면방전 전압이 상승하게 되고, 방전 갭이 증가함에 따라 면방전이 불안정하게 되어 이에 따라 벽전하가 불안정하게 셋팅되어 오방전이 발생되는 문제점이 있다.However, in recent years, in order to improve the discharge efficiency of the plasma display panel, a discharge gap between the scan electrode and the sustain electrode is increased. As the discharge gap increases, the surface discharge voltage increases. As the surface discharge voltage is increased and the discharge gap is increased, the surface discharge becomes unstable, so that the wall charge is unstable and thus there is a problem in that false discharge occurs.

따라서 전술한 문제점을 해결하기 위하여 본 발명은 리셋 기간에서 구동파형을 개선하여 방전 갭이 증가하더라도 안정적인 리셋 방전이 일어날 수 있는 플라즈마 디스플레이 장치 및 그의 구동방법을 제공하는데 그 목적이 있다.Accordingly, an object of the present invention is to provide a plasma display device and a method of driving the same, which can generate stable reset discharge even when the discharge gap is increased by improving the driving waveform in the reset period.

이러한 목적을 달성하기 위한 본 발명에 따른 플라즈마 디스플레이 장치는 복수 개의 스캔 전극과 서스테인 전극이 형성된 플라즈마 디스플레이 패널, 복수 개의 스캔 전극과 복수 개의 서스테인 전극을 구동시키기 위한 구동부 및 서스테인 전극이 플로팅(floating)되도록 제어하는 구동 펄스 제어부를 포함한다.Plasma display device according to the present invention for achieving the above object is a plasma display panel having a plurality of scan electrodes and sustain electrodes, a driving unit for driving the plurality of scan electrodes and a plurality of sustain electrodes and the sustain electrode is floating (floating) It includes a drive pulse control unit for controlling.

스캔 전극과 서스테인 전극의 간격은 10㎛이상 200㎛이하인 것을 특징으로 한다.The interval between the scan electrode and the sustain electrode is characterized in that more than 10㎛ 200㎛.

플로팅(floating)은 서스테인 전극을 구동시키는 구동부의 전압 공급 스위칭 소자를 개방(open)하는 것을 특징으로 한다.Floating is characterized in that the voltage supply switching element of the driver for driving the sustain electrode is opened.

또한, 본 발명에 따른 플라즈마 디스플레이 장치의 구동방법은 리셋 기간, 어드레스 기간 및 서스테인 기간에 어드레스 전극(X1 ~ Xm)(m은 양의 정수), 스캔 전극 및 서스테인 전극에 리셋 펄스, 어드레스 펄스 및 서스테인 펄스를 인가하는 플라즈마 디스플레이 장치의 구동 방법에 있어서, 리셋 기간에는 서스테인 전극이 플로팅(floating)되는 것을 특징으로 한다.Further, the method of driving a plasma display apparatus according to the present invention is a reset period, an address period, and the address electrodes (X 1 ~ Xm) during the sustain period (m is a positive integer), the reset pulse to the scan electrode and the sustain electrode, an address pulse, and A method of driving a plasma display device that applies a sustain pulse, characterized in that the sustain electrode is floated in the reset period.

이하에서는 본 발명에 따른 구체적인 실시예를 첨부된 도면을 참조하여 설명한다.Hereinafter, with reference to the accompanying drawings, a specific embodiment according to the present invention will be described.

도 5는 본 발명에 따른 플라즈마 디스플레이 장치의 구조를 설명하기 위한 도이다.5 is a view for explaining the structure of the plasma display device according to the present invention.

도 5를 살펴보기 전에, 본 발명에 따른 플라즈마 디스플레이 패널은 화상이 디스플레이 되는 표시면인 전면 글라스에 스캔 전극과 서스테인 전극이 쌍을 이뤄 형성된 복수의 유지전극쌍이 배열된 전면패널 및 배면을 이루는 후면 글라스 상에 상술한 복수의 유지전극쌍과 교차되도록 복수의 어드레스 전극이 배열된 후면패널이 일정거리를 사이에 두고 평행하게 결합된다. 이 때, 양광주 영역을 이용하기 위해 스캔 전극과 서스테인 전극간의 간격이 10㎛이상 200㎛이하로 종래보다 넓게 형성된다. 이는 플라즈마 디스플레이 장치의 방전효율을 향상시키기 위함이다.Before looking at Figure 5, the plasma display panel according to the present invention is a front panel and a rear glass forming a rear panel and a plurality of sustain electrode pairs formed by pairing a scan electrode and a sustain electrode on the front glass which is a display surface on which an image is displayed A rear panel in which a plurality of address electrodes are arranged so as to intersect the plurality of sustain electrode pairs above is coupled in parallel with a predetermined distance therebetween. At this time, the gap between the scan electrode and the sustain electrode is formed to be wider than that of the conventional 10 μm or more and 200 μm or less in order to use the positive light column region. This is to improve the discharge efficiency of the plasma display device.

도 5에 도시된 바와 같이, 본 발명에 따른 플라즈마 디스플레이 장치는 플라즈마 디스플레이 패널(500), 데이터 구동부(510), 스캔 구동부(520), 서스테인 구동부(530), 구동 펄스 제어부(540) 및 구동 전압 발생부(550)를 구비한다.As shown in FIG. 5, the plasma display apparatus according to the present invention includes a plasma display panel 500, a data driver 510, a scan driver 520, a sustain driver 530, a driving pulse controller 540, and a driving voltage. The generator 550 is provided.

플라즈마 디스플레이 패널(500)은 스캔 전극(Y1 ~ Yn) 및 서스테인 전극(Z)과, 스캔 전극(Y1 ~ Yn) 및 서스테인 전극(Z)과 교차하는 복수의 어드레스 전극(X1 ~ Xm)이 형성된다.The plasma display panel 500 includes scan electrodes Y 1 to Yn and a sustain electrode Z, and a plurality of address electrodes X 1 to Xm intersecting the scan electrodes Y 1 to Yn and the sustain electrode Z. Is formed.

데이터 구동부(510)는 플라즈마 디스플레이 패널(500)에 형성된 어드레스 전극들(X1 ~ Xm)에 데이터를 인가한다. 여기서, 데이터는 외부에서 입력되는 영상신호를 처리하는 영상신호 처리부(미도시)에서 처리된 영상신호 데이터이다. 즉, 데이터 구동부(510)는 구동 펄스 제어부(540)로부터의 데이터 타이밍 제어 신호(CTRX)에 응답하여 영상신호 데이터를 샘플링하고 래치한 다음, 어드레스 전압(Va)을 갖는 어드레스 펄스를 각각의 어드레스 전극들(X1 ~ Xm)에 공급한다.The data driver 510 applies data to the address electrodes X 1 to Xm formed in the plasma display panel 500. Here, the data is video signal data processed by a video signal processor (not shown) for processing a video signal input from the outside. That is, the data driver 510 samples and latches the image signal data in response to the data timing control signal CTRX from the driving pulse controller 540, and then applies an address pulse having an address voltage Va to each address electrode. To X (X 1 ~ Xm).

스캔 구동부(520)는 플라즈마 디스플레이 패널(500)에 형성된 스캔 전극들 (Y1 ~ Yn)을 구동한다. 본 발명에 따른 스캔 구동부(520)는 구동 펄스 제어부(540)의 제어 하에 구동 전압 발생부(550)로부터 인가되는 펄스를 스캔 전극들(Y1 ~ Yn)에 공급한다.The scan driver 520 drives the scan electrodes Y 1 to Yn formed in the plasma display panel 500. The scan driver 520 according to the present invention supplies pulses applied from the driving voltage generator 550 to the scan electrodes Y 1 to Yn under the control of the driving pulse controller 540.

서스테인 구동부(530)는 플라즈마 디스플레이 패널(500)에 공통전극을 이루며 형성된 서스테인 전극들(Z)을 구동한다. 서스테인 구동부(530)에서는 리셋 기간 동안, 서스테인 구동부의 전압 공급 스위칭 소자가 개방된다. 이에 따라 리셋 기간 동안 서스테인 전극이 플로팅(floating)된다.The sustain driver 530 drives the sustain electrodes Z formed as a common electrode on the plasma display panel 500. In the sustain driver 530, the voltage supply switching element of the sustain driver is opened during the reset period. This causes the sustain electrode to float during the reset period.

또한, 어드레스 기간 동안, 바이어스 전압을 서스테인 전극(Z)들에 공급하고, 서스테인 기간 동안, 그라운드(GND) 레벨에서 서스테인 전압으로 인가되는 서스테인 방전을 하기 위한 적어도 하나 이상의 서스테인 펄스를 서스테인 전극(Z)들에 공급하게 된다.In addition, during the address period, at least one sustain pulse for supplying a bias voltage to the sustain electrodes Z, and for sustain discharge applied to the sustain voltage at the ground GND level during the sustain period, is sustain electrode Z. Feed the fields.

구동 펄스 제어부(540)는 플라즈마 디스플레이 패널(500) 구동시 데이터 구동부(510), 스캔 구동부(520) 및 서스테인 구동부(530)를 제어한다. 즉, 구동 펄스 제어부(540)는 상술한 바와 같은 리셋 기간, 어드레스 기간 및 서스테인 기간에 데이터 구동부(510), 스캔 구동부(520) 및 서스테인 구동부(530)의 동작 타이밍과 동기화를 제어하기 위한 타이밍 제어신호(CTRX, CTRY, CTRZ)를 생성하고, 각각의 구동부(510, 520, 530)로 각각의 타이밍 제어신호(CTRX, CTRY, CTRZ)를 전송한다. The driving pulse controller 540 controls the data driver 510, the scan driver 520, and the sustain driver 530 when the plasma display panel 500 is driven. That is, the driving pulse controller 540 controls timing of operation and synchronization of the data driver 510, the scan driver 520, and the sustain driver 530 in the reset period, the address period, and the sustain period as described above. The signals CTRX, CTRY, and CTRZ are generated, and the timing control signals CTRX, CTRY, and CTRZ are transmitted to the driving units 510, 520, and 530, respectively.

이 때, 데이터 제어신호(CTRX)에는 데이터를 샘플링하기 위한 샘플링 클럭, 래치 제어신호, 데이터 구동부(510) 내의 에너지 회수회로 및 구동 스위치소자의 온/오프 타임을 제어하기 위한 스위치 제어신호가 포함된다. 스캔 제어신호(CTRY)에는 스캔 구동부(520) 내의 에너지 회수회로와 구동 스위치소자의 온/오프 타임을 제어하기 위한 스위치 제어신호가 포함되고, 서스테인 제어신호(CTRZ)에는 서스테인 구동부(530) 내의 에너지 회수회로와 구동 스위치소자의 온/오프 타임을 제어하기 위한 스위치 제어신호가 포함된다.In this case, the data control signal CTRX includes a sampling clock for sampling data, a latch control signal, an energy recovery circuit in the data driver 510, and a switch control signal for controlling on / off time of the driving switch element. . The scan control signal CTRY includes an energy recovery circuit in the scan driver 520 and a switch control signal for controlling the on / off time of the driving switch element. The sustain control signal CTRZ includes the energy in the sustain driver 530. A switch control signal for controlling the on / off time of the recovery circuit and the drive switch element is included.

구동 전압 발생부(550)는 구동 펄스 제어부(540)와 각각의 구동부(510, 520, 530)에 필요한 구동 전압을 발생시키고, 공급한다. 즉, 구동 전압 발생부(550)는 셋업 전압(Vsetup), 스캔 기준 전압(Vsc), 서스테인 전압(Vs), 어드레스 전압(Va) 및 바이어스 전압(Vzb)을 발생한다. 이러한 구동 전압들은 방전가스의 조성이나 방전셀 구조에 따라 조절할 수 있다. 이와 같은 본 발명에 따른 플라즈마 디스플레이 장치에 따라 구현되는 구동 펄스를 살펴보면 다음 도 6과 같다.The driving voltage generator 550 generates and supplies driving voltages necessary for the driving pulse controller 540 and each of the driving units 510, 520, and 530. That is, the driving voltage generator 550 generates the setup voltage Vsetup, the scan reference voltage Vsc, the sustain voltage Vs, the address voltage Va, and the bias voltage Vzb. These driving voltages can be adjusted according to the composition of the discharge gas or the structure of the discharge cell. Looking at the driving pulse implemented in the plasma display device according to the present invention as shown in FIG.

도 6은 본 발명에 따른 플라즈마 디스플레이 장치의 리셋 펄스를 포함하는 파형을 설명하기 위한 파형도이다.6 is a waveform diagram illustrating a waveform including a reset pulse of the plasma display device according to the present invention.

도 6에 도시된 바와 같이, 본 발명에 따른 플라즈마 디스플레이 장치는 각 서브필드 마다 모든 셀들의 벽전하 분포를 동일하게 하기 위한 리셋 기간, 방전할 셀을 선택하기 위한 어드레스 기간, 선택된 셀의 방전을 유지시키기 위한 서스테인 기간 및 방전된 셀 내의 벽전하를 소거하기 위한 소거 기간으로 나뉘어 구동된다.As shown in FIG. 6, the plasma display apparatus according to the present invention maintains a reset period for equalizing wall distribution of all cells in each subfield, an address period for selecting a cell to be discharged, and discharge of the selected cell. The driving period is divided into a sustain period for discharging and an erase period for erasing wall charges in the discharged cell.

리셋 기간의 셋업 기간에서는, 스캔 전극에 정극성 램프 파형의 펄스가 인가되며, 서스테인 전극은 플로팅(floating)되며, 어드레스 전극에는 0 V가 인가된다. 이러한 스캔 전극의 상승 램프 파형에 의해 전체 방전셀들 내에는 약한 대향 방전이 일어나고, 어드레스 전극과 서스테인 전극 상에는 정극성 벽전하가 쌓이게 되며, 스캔 전극 상에는 부극성의 벽전하가 쌓이게 된다.In the setup period of the reset period, a pulse of a positive ramp waveform is applied to the scan electrode, the sustain electrode is floating, and 0 V is applied to the address electrode. Due to the rising ramp waveform of the scan electrode, weak counter discharge occurs in all the discharge cells, positive wall charges are accumulated on the address electrode and the sustain electrode, and negative wall charges are accumulated on the scan electrode.

셋다운 기간에는, 스캔 전극에 그라운드(GND)레벨의 전압에서 특정 전압 레벨까지 떨어지는 하강 램프 파형이 인가됨으로써, 셋업 기간 동안 과도하게 형성된 벽전하가 소거된다. 즉, 셀들 내에 스캔 전극과 어드레스 전극 간에 소거 방전이 일어남에 따라 이후, 어드레스 방전이 안정되게 일어날 수 있을 정도의 벽전하가 셀들 내에 균일하게 잔류된다.In the set-down period, the falling ramp waveform falling from the voltage of the ground (GND) level to the specific voltage level is applied to the scan electrode, thereby over-producing wall charges formed during the setup period. That is, as the erase discharge occurs between the scan electrode and the address electrode in the cells, wall charges such that the address discharge can stably occur remain uniformly in the cells.

어드레스 기간에는, 부극성 스캔 펄스가 스캔 전극들에 순차적으로 인가됨과 동시에 스캔 펄스에 동기되어 어드레스 전극에 정극성의 어드레스 펄스가 인가된다. 이 스캔 펄스와 어드레스 펄스의 전압 차와 리셋 기간에 생성된 벽 전압이 더해지면서 어드레스 펄스가 인가되는 방전셀 내에는 어드레스 방전이 발생된다. 어드레스 방전에 의해 선택된 셀들 내에는 서스테인 전압이 인가될 때 방전이 일어날 수 있게 하는 정도의 벽전하가 형성된다. 서스테인 전극에는 어드레스 기간 동안에 스캔 전극과의 전압차를 줄여 스캔 전극과의 오방전이 일어나지 않도록 정극성 바이어스 전압이 공급된다.In the address period, the negative scan pulses are sequentially applied to the scan electrodes and the positive address pulses are applied to the address electrodes in synchronization with the scan pulses. As the voltage difference between the scan pulse and the address pulse and the wall voltage generated in the reset period are added, address discharge is generated in the discharge cell to which the address pulse is applied. In the cells selected by the address discharge, wall charges are formed such that a discharge can occur when a sustain voltage is applied. The sustain electrode is supplied with a positive bias voltage so that the voltage difference with the scan electrode is reduced during the address period so that erroneous discharge with the scan electrode does not occur.

서스테인 기간에는, 스캔 전극과 서스테인 전극들에 교번적으로 서스테인 펄스(Sus)가 인가된다. 어드레스 방전에 의해 선택된 셀은 셀 내의 벽 전압과 서스테인 펄스가 더해지면서 매 서스테인 펄스가 인가될 때 마다 스캔 전극과 서스테인 전극 사이에 서스테인 방전 즉, 표시방전이 일어나게 된다.In the sustain period, a sustain pulse Su is applied to the scan electrode and the sustain electrodes alternately. In the cell selected by the address discharge, as the wall voltage and the sustain pulse in the cell are added, a sustain discharge, that is, a display discharge, occurs between the scan electrode and the sustain electrode every time the sustain pulse is applied.

소거 기간에서는, 펄스폭과 전압 레벨이 작은 소거 램프 파형의 전압이 서스테인 전극에 공급되어 전화면의 셀들 내에 잔류하는 벽전하를 소거시키게 된다.In the erase period, the voltage of the erase ramp waveform having a small pulse width and voltage level is supplied to the sustain electrode to erase the wall charge remaining in the cells of the full screen.

이와 같이 리셋 기간에서 스캔 전극에는 종래와 같은 정극성 펄스를 인가하고 서스테인 전극은 플로팅(floating)시켜 스캔 전극과 어드레스 전극 사이의 대향방전을 이용하여 벽전하를 안정적으로 셋팅함으로써 스캔 전극과 서스테인 전극간의 간격을 넓게 형성하더라도 안정적인 방전이 일어날 수 있다.As described above, the positive electrode pulse is applied to the scan electrode in the reset period, and the sustain electrode is floated to stably set the wall charge by using the opposite discharge between the scan electrode and the address electrode. Even if the gap is widened, stable discharge may occur.

이와 같이, 상술한 본 발명의 기술적 구성은 본 발명이 속하는 기술분야의 당업자가 본 발명의 그 기술적 사상이나 필수적 특징을 변경하지 않고서 다른 구체적인 형태로 실시될 수 있다는 것을 이해할 수 있을 것이다. As such, the technical configuration of the present invention described above can be understood by those skilled in the art that the present invention can be implemented in other specific forms without changing the technical spirit or essential features of the present invention.

그러므로 이상에서 기술한 실시예들은 모든 면에서 예시적인 것이며 한정적인 것이 아닌 것으로서 이해되어야 하고, 본 발명의 범위는 상기 상세한 설명보다 는 후술하는 특허청구범위에 의하여 나타나며, 특허청구범위의 의미 및 범위 그리고 그 등가개념으로부터 도출되는 모든 변경 또는 변형된 형태가 본 발명의 범위에 포함되는 것으로 해석되어야 한다.Therefore, the exemplary embodiments described above are to be understood as illustrative and not restrictive in all aspects, and the scope of the present invention is indicated by the following claims rather than the detailed description, and the meaning and scope of the claims and All changes or modifications derived from the equivalent concept should be interpreted as being included in the scope of the present invention.

이상에서 보는 바와 같이, 본 발명은 리셋 기간에서 스캔 전극에는 종래와 같은 정극성 펄스를 인가하고 서스테인 전극은 플로팅(floating)시켜 스캔 전극과 어드레스 전극 사이의 대향방전을 이용하여 벽전하를 안정적으로 셋팅함으로써 스캔 전극과 서스테인 전극간의 간격을 넓게 형성하더라도 안정적인 방전이 일어날 수 있는 효과가 있다.As described above, the present invention applies the same positive pulse to the scan electrode in the reset period and floats the sustain electrode, thereby stably setting the wall charge by using the opposite discharge between the scan electrode and the address electrode. As a result, even if the gap between the scan electrode and the sustain electrode is widened, stable discharge can occur.

Claims (4)

복수 개의 스캔 전극과 서스테인 전극이 형성된 플라즈마 디스플레이 패널;A plasma display panel on which a plurality of scan electrodes and a sustain electrode are formed; 상기 복수 개의 스캔 전극과 상기 복수 개의 서스테인 전극을 구동시키기 위한 구동부; 및A driving unit for driving the plurality of scan electrodes and the plurality of sustain electrodes; And 리셋 기간의 셋 다운 전체기간 동안에 상기 서스테인 전극이 플로팅(floating)되도록 제어하는 구동 펄스 제어부;A driving pulse controller which controls the sustain electrode to float during the entire set down period of a reset period; 를 포함하는 플라즈마 디스플레이 장치.Plasma display device comprising a. 제 1 항에 있어서,The method of claim 1, 상기 스캔 전극과 상기 서스테인 전극의 간격은 10㎛이상 200㎛이하인 것을 특징으로 하는 플라즈마 디스플레이 장치.And a distance between the scan electrode and the sustain electrode is 10 µm or more and 200 µm or less. 제 1 항에 있어서,The method of claim 1, 상기 플로팅(floating)은 상기 서스테인 전극을 구동시키는 구동부의 전압 공급 스위칭 소자를 개방(open)하는 것을 특징으로 하는 플라즈마 디스플레이 장치.And said floating opens the voltage supply switching element of a driver for driving said sustain electrode. 리셋 기간, 어드레스 기간 및 서스테인 기간에 어드레스 전극(X1 ~ Xm)(m은 양의 정수), 스캔 전극 및 서스테인 전극에 리셋 펄스, 어드레스 펄스 및 서스테인 펄스를 인가하는 플라즈마 디스플레이 장치의 구동 방법에 있어서,In the driving method of the plasma display apparatus which applies a reset pulse, an address pulse and a sustain pulse to the address electrodes X 1 to Xm (m is a positive integer), the scan electrode and the sustain electrode in the reset period, the address period and the sustain period. , 상기 리셋 기간의 셋 다운 전체기간 동안에 상기 서스테인 전극은 플로팅(floating)되는 것을 특징으로 하는 플라즈마 디스플레이 장치의 구동방법.And the sustain electrode is floating during the entire set down period of the reset period.
KR1020050060941A 2005-07-06 2005-07-06 Plasma Display Apparatus and Driving Method Thereof KR100757548B1 (en)

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