KR100738581B1 - Plasma display device and driving method thereof - Google Patents

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공병구
김태형
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엘지전자 주식회사
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Abstract

A plasma display device and a driving method thereof are provided to reduce manufacturing cost by inducing a sustain discharge using a ground voltage in an address electrode without using a sustain driving circuit. A plasma display device includes a first electrode(Y), a plasma display panel, and first and second drivers. The plasma display panel includes a second electrode(X) formed to cross the first electrode. The first driver alternately supplies a positive sustain pulse(+Vsus) and a negative sustain pulse(-Vsus) to the first electrode during a sustain period. The second driver supplies a reference voltage to the second electrode during the sustain period. The reference voltage is maintained at a ground level(GND). The magnitude of the positive sustain pulse is equal to that of the negative sustain pulse.

Description

플라즈마 디스플레이 장치 및 그 구동방법{PLASMA DISPLAY DEVICE AND DRIVING METHOD THEREOF}Plasma display device and driving method thereof {PLASMA DISPLAY DEVICE AND DRIVING METHOD THEREOF}

도 1는 본 발명의 실시 예에 따른 플라즈마 디스플레이 장치를 설명하기 위한 도.1 is a view for explaining a plasma display device according to an embodiment of the present invention.

도 2는 본 발명의 플라즈마 디스플레이 패널의 일례를 설명하기 위한 도.2 is a view for explaining an example of the plasma display panel of the present invention.

도 3은 본 발명의 플라즈마 디스플레이 패널의 전극배치를 나타낸 도.3 illustrates an electrode arrangement of a plasma display panel of the present invention.

도 4는 본 발명의 실시 예에 따른 플라즈마 디스플레이 장치의 구동 파형을 나타내는 파형도.4 is a waveform diagram illustrating driving waveforms of a plasma display device according to an exemplary embodiment of the present invention.

도 5a 내지 도 5d는 도 4에 따른 벽 전하 분포를 순차적으로 나타낸 도.5a to 5d sequentially show the wall charge distribution according to FIG. 4;

***** 도면의 주요 부분에 대한 부호의 설명 ********** Explanation of symbols for the main parts of the drawing *****

101 : 타이밍 콘트롤러 102 : 제 2 구동부101: timing controller 102: second drive unit

103 : 제 1 구동부 104 : 구동전압 발생부103: first driving unit 104: driving voltage generating unit

202 : 제 1 전극 213 : 제 2 전극202: first electrode 213: second electrode

본 발명은 디스플레이 장치에 관한 것으로, 더욱 자세하게는 플라즈마 디스 플레이 장치 및 그 구동방법에 관한 것이다.The present invention relates to a display device, and more particularly, to a plasma display device and a driving method thereof.

일반적으로 디스플레이 장치 중 플라즈마 디스플레이 패널(Plasma Display Panel)은 전면 기판과 후면 기판 사이에 형성된 격벽(Barrier Rip)이 하나의 단위 셀을 이루는 것으로, 각 셀 내에는 네온(Ne), 헬륨(He) 또는 네온 및 헬륨의 혼합기체(Ne+He)와 같은 주 방전 기체와 소량의 크세논을 함유하는 불활성 가스가 충진되어 있다. 고주파 전압에 의해 방전이 될 때, 불활성 가스는 진공자외선(Vacuum Ultraviolet rays)을 발생하고 격벽 사이에 형성된 형광체를 발광시켜 화상이 구현된다. 이와 같은 플라즈마 디스플레이 패널은 박막화와 대형화가 용이할 뿐만 아니라 최근의 기술 개발에 힘입어 크게 향상된 화질을 제공하여 차세대 표시장치로서 각광받고 있다.In general, a plasma display panel (Plasma Display Panel) of the display device is a barrier rib formed between the front substrate and the rear substrate to form a unit cell, each cell Neon (He) or Helium (He) or A main discharge gas such as a mixture of neon and helium (Ne + He) and an inert gas containing a small amount of xenon are filled. When discharged by a high frequency voltage, the inert gas generates vacuum ultraviolet rays and emits phosphors formed between the partition walls to realize an image. Such plasma display panels are not only easy to thin and large in size, but also greatly improved as a result of recent technology developments, and thus are attracting attention as next generation display devices.

이러한, 플라즈마 디스플레이 패널은 기본적으로 3개의 전극 구조 즉, 데이터를 공급하기 위한 어드레스 전극(X)과, 방전을 위한 서스테인 펄스가 교번적으로 공급되는 스캔 전극(Y) 및 서스테인 전극(Z)을 포함한다.The plasma display panel basically includes three electrode structures, namely, an address electrode X for supplying data, and a scan electrode Y and a sustain electrode Z to which a sustain pulse for discharge is alternately supplied. do.

또한, 3개의 전극 구조의 플라즈마 디스플레이 패널은 3개의 전극 각각에 파형을 공급함에 따라 높은 소비전력을 갖게 되고, 3개의 전극을 구동하기 위한 구동부와 그 구동부를 구동시키기 위한 구동회로를 각각 포함해야 함에 따라, 구동부 제작을 위한 생산비가 증가되는 문제점이 발생한다.In addition, the plasma display panel having a three-electrode structure has high power consumption by supplying waveforms to each of the three electrodes, and must include a driver for driving the three electrodes and a driver circuit for driving the driver. Accordingly, a problem arises in that the production cost for manufacturing the driving unit is increased.

이러한 문제점을 해결하기 위해 본 발명은 2개의 전극 구조를 가지는 플라즈마 디스플레이 패널과, 2개의 전극을 통하여 패널이 구동할 수 있는 구동방법을 개 선하여 소비되는 비용을 절감하는데 그 목적이 있다.In order to solve this problem, an object of the present invention is to reduce the cost consumed by improving a plasma display panel having a two electrode structure and a driving method capable of driving the panel through the two electrodes.

상기의 목적을 달성하기 위한 본 발명은 제 1 전극과, 제 1 전극과 교차하여 형성된 제 2 전극만으로 구성된 플라즈마 디스플레이 패널과, 제 1 전극에 서스테인 기간 동안 정극성 서스테인 펄스(+Vsus)와 부극성 서스테인 펄스(-Vsus)를 교번적으로 공급하는 제 1 구동부 및 제 2 전극에 서스테인 기간 동안 기준 전압을 공급하는 제 2 구동부를 포함한다.In order to achieve the above object, the present invention provides a plasma display panel including only a first electrode, a second electrode formed to intersect the first electrode, and a positive sustain pulse (+ Vsus) and a negative polarity during the sustain period of the first electrode. And a first driver supplying a sustain pulse (-Vsus) alternately and a second driver supplying a reference voltage to the second electrode during the sustain period.

또한, 기준전압은 그라운드(GND) 레벨의 전압을 유지하는 것을 특징으로 한다.In addition, the reference voltage is characterized by maintaining the voltage of the ground (GND) level.

또한, 정극성 서스테인 펄스의 크기와 부극성 서스테인 펄스의 크기는 동일한 것을 특징으로 한다.In addition, the magnitude of the positive sustain pulse and the magnitude of the negative sustain pulse are the same.

또한, 제 1 구동부는 서스테인 펄스를 공급하는 에너지 회수 회로를 포함하는 것을 특징으로 한다.The first driving unit may include an energy recovery circuit for supplying a sustain pulse.

또한, 제 1 전극에 서스테인 기간 동안 정극성 서스테인 펄스(+Vsus)와 부극성 서스테인 펄스(-Vsus)를 공급하고, 제 1 전극에 서스테인 펄스가 공급되는 동안 제 2 전극에 그라운드 레벨의 전압을 유지하여 공급한다.In addition, the positive sustain pulse (+ Vsus) and the negative sustain pulse (-Vsus) are supplied to the first electrode during the sustain period, and the ground level voltage is maintained at the second electrode while the sustain pulse is supplied to the first electrode. Supply by

상기 목적 외에 다른 목적 및 이점들은 첨부한 도면들을 참조한 본 발명의 바람직한 실시 예에 대한 설명을 통하여 명백하게 드러나게 될 것이다.Other objects and advantages other than the above object will become apparent from the description of the preferred embodiment of the present invention with reference to the accompanying drawings.

이하 첨부된 도면을 참조하여 본 발명의 플라즈마 디스플레이 장치를 상세히 설명한다.Hereinafter, a plasma display device of the present invention will be described in detail with reference to the accompanying drawings.

도 1 내지 도4c 을 참조하여 본 발명의 바람직한 실시 예들에 대하여 설명하기로 한다.1 to 4C, exemplary embodiments of the present invention will be described.

도 1은 본 발명의 실시 예에 따른 플라즈마 디스플레이 장치를 설명하기 위한 도면이다.1 is a diagram illustrating a plasma display device according to an exemplary embodiment of the present invention.

도 1를 살펴보면, 본 발명의 플라즈마 디스플레이 장치는 플라즈마 디스플레이 패널(100)과 제 1 구동부(103)를 포함한다. 아울러, 본 발명의 플라즈마 디스플레이 장치는 제 1 구동부(103)를 제외한 플라즈마 디스플레이 패널(100)에 형성되는 전극에 따라 제 2 구동부(102)를 더 포함하는 것이 바람직하다.Referring to FIG. 1, the plasma display apparatus of the present invention includes a plasma display panel 100 and a first driver 103. In addition, the plasma display apparatus of the present invention preferably further includes a second driver 102 according to the electrodes formed on the plasma display panel 100 except for the first driver 103.

여기서, 플라즈마 디스플레이 패널(100)의 전극은 제 1 전극(Y1 내지 Yn)과 제 2 전극(X1 내지 Xm)인 2개의 전극을 포함한다.Here, the electrode of the plasma display panel 100 includes two electrodes, that is, the first electrodes Y1 to Yn and the second electrodes X1 to Xm.

플라즈마 디스플레이 패널의 복수의 제 2 전극(X1 내지 Xm)에 데이터를 공급함과 아울러 선택된 방전 셀의 방전을 유지하기 위한 서스테인 펄스를 공급하는 제 2 구동부(102)와, 복수의 제 1 전극(Y1 내지 Yn)을 구동하기 위한 제 1 구동부(103)와, 제 1 구동부(103)와 제 2 구동부(102)를 제어하기 위한 타이밍 콘트롤러(101)와, 제 1 구동부(103)와 제 2 구동부(102)에 구동전압을 공급하기 위한 구동전압 발생부(104)를 포함한다.A second driver 102 for supplying data to the plurality of second electrodes X1 to Xm of the plasma display panel and supplying a sustain pulse for maintaining the discharge of the selected discharge cell, and the plurality of first electrodes Y1 to Xm. The first driver 103 for driving Yn, the timing controller 101 for controlling the first driver 103 and the second driver 102, the first driver 103 and the second driver 102. ) Includes a driving voltage generator 104 for supplying a driving voltage.

제 2 구동부(102)는 도시하지 않은 역감마 보정회로, 오차확산회로 등에 의해 역감마 보정 및 오차확산된 후, 서브필드 맵핑 회로에 의해 미리 설정된 서브필드 패턴에 맵핑된 데이터가 공급된다. 이 제 2 구동부(102)는 타이밍 콘트롤러(101)의 제어 하에 데이터를 샘플링하고 래치한 다음, 그 데이터를 복수의 제 2 전 극(X1 내지 Xm)에 공급하게 된다. 그리고 제 2 구동부(102)는 전 화면의 방전 셀을 초기화하기 위한 리셋 기간 동안 그라운드(GND) 전압을 공급하며, 어드레스 기간 동안 선택된 셀의 방전을 유지하는 서스테인 펄스를 서스테인 기간 동안 공급한다.The second driver 102 is subjected to inverse gamma correction and error diffusion by an inverse gamma correction circuit, an error diffusion circuit, and the like not shown, and then data mapped to a subfield pattern preset by the subfield mapping circuit is supplied. The second driver 102 samples and latches data under the control of the timing controller 101, and then supplies the data to the plurality of second electrodes X1 to Xm. The second driver 102 supplies a ground (GND) voltage during the reset period for initializing the discharge cells of the entire screen, and supplies a sustain pulse for sustaining the discharge of the selected cell during the address period.

제 1 구동부(103)는 타이밍 콘트롤러(101)의 제어 하에 전 화면의 방전 셀을 초기화하기 위하여 리셋 기간 중 셋 업 기간 동안 그라운드(GND) 전압에서 일정 기울기를 가지며 상승하는 상승램프 파형(Ramp-up)을 공급하고, 셋다운 기간(Set_down) 동안 그라운드(GND) 전압에서 스캔 전압(Vscan)까지 하강하는 하강 램프파형(Ramp-dn)을 복수의 제 1 전극(Y1 내지 Yn)에 연속으로 공급한 후, 스캔 라인을 선택하기 위하여 어드레스 기간 동안 부극성의 스캔 펄스(Vscan)를 복수의 제 1 전극(Y1 내지 Yn)에 순차적으로 공급한다. 그리고, 서스테인 기간 동안 제 1 전극(Y)에 정극성 서스테인 펄스(+Vs)와 부극성 서스테인 펄스(-Vs)를 포함하는 서스테인 펄스(sus)를 교번적으로 공급하고, 제 2 전극(X)에 기준 전압을 공급한다. 여기서, 기준 전압은 그라운드(GND) 레벨의 전압을 유지하여 제 2 전극(X)으로 공급한다.The first driver 103 ramps up a ramp-up ramp with a predetermined slope in the ground (GND) voltage during the set-up period of the reset period in order to initialize the discharge cells of the entire screen under the control of the timing controller 101. ) And a falling ramp waveform Ramp-dn that falls from the ground GND voltage to the scan voltage Vscan during the set down period, is continuously supplied to the plurality of first electrodes Y1 to Yn. In order to select the scan line, the negative scan pulse Vscan is sequentially supplied to the plurality of first electrodes Y1 to Yn during the address period. During the sustain period, the sustain pulse su including the positive sustain pulse (+ Vs) and the negative sustain pulse (-Vs) is alternately supplied to the first electrode Y, and the second electrode X is supplied. Supply the reference voltage to. Here, the reference voltage is supplied to the second electrode X while maintaining the voltage of the ground GND level.

타이밍 콘트롤러(101)는 수직/수평 동기신호를 입력받고 제 1 구동부(103)와 제 2 구동부(102)에 필요한 타이밍 제어신호(CTRX, CTRY)를 발생하고 그 타이밍 제어신호(CTRX, CTRY)를 해당 제 1 구동부(103)와 제 2 구동부(102)에 공급함으로써 제 1 구동부(103)와 제 2 구동부(102)를 제어하게 된다. 제 2 구동부(102)에 공급되는 타이밍 제어신호(CTRX)에는 데이터를 샘플링하기 위한 샘플링 클럭, 래치 제어신호, 에너지 회수 회로와 구동 스위치소자의 온/오프 타임을 제어하기 위한 스 위치 제어신호가 포함된다. 타이밍 콘트롤러(101)로부터 제 1 구동부(103)에 공급되는 타이밍 제어신호(CTRY)에는 제 1 구동부(103) 내의 에너지 회수 회로와 구동 스위치소자의 온/오프 타임을 제어하기 위한 스위치제어신호가 포함된다. 여기서, 제 1 구동부(103)는 서스테인 기간동안 에너지를 회수하는 에너지 회수 회로와 스캔 펄스 공급을 위한 구동스위치를 더 포함한다.The timing controller 101 receives a vertical / horizontal synchronization signal and generates timing control signals CTRX and CTRY necessary for the first driver 103 and the second driver 102, and generates the timing control signals CTRX and CTRY. The first driving unit 103 and the second driving unit 102 are controlled by supplying the first driving unit 103 and the second driving unit 102. The timing control signal CTRX supplied to the second driver 102 includes a sampling clock for sampling data, a latch control signal, a switch control signal for controlling on / off time of the energy recovery circuit and the driving switch element. do. The timing control signal CTRY supplied from the timing controller 101 to the first driver 103 includes a switch control signal for controlling on / off time of the energy recovery circuit and the driving switch element in the first driver 103. do. Here, the first driver 103 further includes an energy recovery circuit for recovering energy during the sustain period and a drive switch for supplying scan pulses.

여기서, 제 1 구동부(103)는 서스테인 기간동안 에너지 회수 회로를 사용하는 이유는 에너지 회수 회로를 사용함으로써, 플라즈마 디스플레이 패널에서 공급되고 소비되는 전력을 LC공진에 의한 무효 전력을 이용하여 보다 효율적으로 전력을 절감할 수 있기 때문이다.Here, the reason why the first driver 103 uses the energy recovery circuit during the sustain period is that the energy recovery circuit is used, whereby the power supplied and consumed by the plasma display panel is more efficiently used by using reactive power by LC resonance. Because it can save.

여기 도 1에서는 본 발명의 플라즈마 디스플레이 장치의 일례만을 도시하고 설명한 것으로써, 본 발명이 여기 도 1의 구조는 플라즈마 디스플레이 장치에 한정되는 것은 아님을 밝혀둔다. 예를 들면, 여기 도 1에서는 전술한 제 1 구동부(103)는 플라즈마 디스플레이 패널의 제 1 전극(Y1 내지 Yn)으로 펄스를 공급하고, 제 2 구동부(102)는 패널의 제 2 전극(X1 내지 Xm)으로 펄스를 공급하는 것으로만 도시하고 있지만, 이와는 다르게 제 1 구동부(103)는 플라즈마 디스플레이 패널의 제 2 전극(X1 내지 Xm)으로 펄스를 공급하고, 제 2 구동부(102)는 패널의 제 1 전극(Y1 내지 Yn)으로 펄스를 공급할 수도 있다.In FIG. 1, only one example of the plasma display device of the present invention is shown and described, and the present invention is not limited to the plasma display device. For example, in FIG. 1, the above-described first driver 103 supplies pulses to the first electrodes Y1 to Yn of the plasma display panel, and the second driver 102 supplies the second electrodes X1 to Y of the panel. Although only the pulses are supplied to Xm, the first driver 103 supplies pulses to the second electrodes X1 to Xm of the plasma display panel, and the second driver 102 is formed of the panel. Pulses may be supplied to the first electrodes Y1 to Yn.

이러한, 제 2 구동부(102)는 본 발명의 구동방법에 따라 서스테인 기간 동안 제 2 전극(X)은 그라운드(GND) 레벨의 전압을 유지하기 때문에 그라운드(GND)로 전극을 연결만 하면 된다. 따라서, 별도의 구동 회로 없이 서스테인 방전을 유도하게 되고, 제 2 구동부(102)의 구동회로 제작을 위해 소비되는 생산비를 효율적으로 절감할 수 있게 된다.According to the driving method of the present invention, the second driver 102 only needs to connect the electrode to the ground GND because the second electrode X maintains the voltage of the ground GND level during the sustain period. Therefore, the sustain discharge is induced without a separate driving circuit, and the production cost consumed for manufacturing the driving circuit of the second driving unit 102 can be efficiently reduced.

구동전압 발생부(104)는 상승램프 파형(Ramp-up)의 상한 전압으로 공급되는 셋업 전압(Vsetup), 그라운드(GND) 전압에서 스캔 전압(Vscan)까지 하강하는 하강램프파형(Ramp-dn)을 가지는 셋다운 전압(Vsetdown), 스캔 펄스의 전압으로 설정되는 스캔 전압(Vscan), 제 2 전극(X) 및 제 1 전극(Y)에 공급되는 서스테인(sus) 전압을 각각 생성한다.The driving voltage generator 104 has a ramp down ramp waveform Ramp-dn that falls from the setup voltage Vsetup and ground GND voltage supplied to the upper limit voltage of the ramp ramp waveform Ramp-up to the scan voltage Vscan. A setdown voltage Vsetdown having a voltage, a scan voltage Vscan set as a scan pulse voltage, and a sustain voltage supplied to the second electrode X and the first electrode Y are generated.

도 2는 본 발명의 플라즈마 디스플레이 패널의 일례를 설명하기 위한 도면이다.2 is a view for explaining an example of the plasma display panel of the present invention.

도 2를 살펴보면, 본 발명의 플라즈마 디스플레이 패널은 화상이 디스플레이 되는 표시 면이 전면 기판(201)에 제 1 전극(202, Y)이 형성된 전면 패널(200) 및 배면을 이루는 후면 기판(211) 상에 전술한 제 1 전극(202, Y)과 교차 되도록 복수의 제 2 전극(213, X)이 배열된 후면 패널(210)이 일정거리를 사이에 두고 나란하게 결합된다.Referring to FIG. 2, in the plasma display panel of the present invention, a display surface on which an image is displayed is formed on the front panel 200 having the first electrodes 202 and Y formed on the front substrate 201 and on the rear substrate 211 forming the rear surface. The rear panel 210 in which the plurality of second electrodes 213 and X are arranged to intersect the first electrodes 202 and Y described above is coupled side by side with a predetermined distance therebetween.

전면 패널(200)은 방전 공간, 즉 방전 셀(Cell)에서 상호 방전시키고 방전 셀의 발광을 유지하기 위한 제 1 전극(202, Y), 바람직하게는 투명한 ITO 물질로 형성된 투명 전극(a)과 불투명 금속재질로 제작된 버스 전극(b)을 포함한다.The front panel 200 may include a first electrode 202 (Y) for discharging each other in a discharge space, that is, a discharge cell, and maintaining light emission of the discharge cell, preferably a transparent electrode a formed of a transparent ITO material. Bus electrode (b) is made of an opaque metal material.

제 1 전극(202, Y)은 방전 전류를 제한하며 전극을 절연시켜주는 하나 이상의 상부 유전체 층(204)에 의해 덮혀지고, 상부 유전체 층(204) 상면에는 방전 조건을 용이하게 하기 위하여 산화마그네슘(MgO)을 증착한 보호 층(205)이 형성된다.The first electrode 202, Y is covered by one or more top dielectric layers 204 that limit the discharge current and insulate the electrodes, and the top surface of the top dielectric layer 204 has a magnesium oxide (< / RTI > A protective layer 205 on which MgO) is deposited is formed.

후면 패널(210)은 복수 개의 방전 공간 즉, 방전 셀을 구획하기 위한 웰 타입(Well Type)(또는 스트라이프 타입의 오픈형)의 폐쇄형 격벽(212)을 포함한다. 또한, 데이터 펄스를 공급하기 위한 복수의 제 2 전극(213, X)이 배치된다.The rear panel 210 includes a plurality of discharge spaces, that is, a closed type barrier rib 212 of a well type (or stripe type open type) for partitioning discharge cells. Further, a plurality of second electrodes 213 and X for supplying the data pulses are disposed.

이러한, 격벽(212)에 의해 구획된 복수의 방전 셀 내에는 어드레스 방전 시 화상표시를 위한 가시 광을 방출하는 형광체 층(214), 바람직하게는 적색(Red : R), 녹색(Green : G), 청색(Blue : B) 형광체 층이 형성된다.In the plurality of discharge cells partitioned by the partition wall 212, the phosphor layer 214 that emits visible light for image display upon address discharge, preferably red (R), green (G). A blue (B) phosphor layer is formed.

그리고, 제 2 전극(213, X)과 형광체 층(214) 사이에는 하부 유전체 층(215)이 형성된다.The lower dielectric layer 215 is formed between the second electrodes 213 and X and the phosphor layer 214.

여기서, 상부 유전체 층(204)과 하부 유전체 층(215)이 전면 기판(201)과 후면 기판(211)상에 형성되는 것은 반드시 한정되지 않는다. 즉, 전면 기판(201)과 후면 기판(210) 상에 하부 유전체 층(215)과 상부 유전체 층(204)이 형성되는 것도 가능하다.Here, it is not necessarily limited that the upper dielectric layer 204 and the lower dielectric layer 215 are formed on the front substrate 201 and the rear substrate 211. That is, the lower dielectric layer 215 and the upper dielectric layer 204 may be formed on the front substrate 201 and the rear substrate 210.

여기 도 2에서는 본 발명의 플라즈마 디스플레이 패널의 일례만을 도시하고 설명한 것으로써, 본 발명이 여기 도 2의 구조의 플라즈마 디스플레이 패널에 한정되는 것은 아님을 밝혀둔다. 예를 들면, 여기 도 2에서는 전술한 제 1 전극(202, Y)은 투명 전극(202a)과 버스 전극(202b)으로 이루어지는 것만을 도시하고 있지만, 이와는 다르게 제 1 전극(202, Y)은 투명 전극(202a)과 버스 전극(202b) 중 어느 하나로 이루어지는 것도 가능하다.In FIG. 2, only one example of the plasma display panel of the present invention is shown and described, and the present invention is not limited to the plasma display panel having the structure of FIG. For example, in FIG. 2, only the first electrodes 202 and Y described above are made up of the transparent electrode 202a and the bus electrode 202b. Alternatively, the first electrodes 202 and Y are transparent. It is also possible to consist of either the electrode 202a or the bus electrode 202b.

또한, 플라즈마 디스플레이 패널의 전면 기판(201) 상에 제 1 전극(202, Y)이 형성되고, 패널의 후면 기판(211) 상에 제 2 전극(213, X)이 형성된 것으로 도 시되어 있지만, 이와는 다르게 플라즈마 디스플레이 패널의 전면 기판(201) 상에 제 2 전극(213)이 형성되고, 패널의 후면 기판(211) 상에 제 1 전극(202, Y)이 형성될 수도 있다.In addition, although the first electrodes 202 and Y are formed on the front substrate 201 of the plasma display panel and the second electrodes 213 and X are formed on the rear substrate 211 of the panel, Alternatively, the second electrode 213 may be formed on the front substrate 201 of the plasma display panel, and the first electrodes 202 and Y may be formed on the rear substrate 211 of the panel.

또한, 여기 도 2에서는 방전 셀을 구획하기 위한 격벽(212)이 후면 기판(211) 상에 형성된 경우만을 도시하고 있지만, 이와는 다르게 격벽(212)이 전면 기판(201) 상에 형성되는 것도 가능하고 또는, 전면 기판(201)과 후면 기판(212)에 각각 형성되는 것도 가능한 것이다.In addition, in FIG. 2, only the case where the partition 212 for partitioning the discharge cells is formed on the rear substrate 211 is illustrated, but the partition 212 may be formed on the front substrate 201. Alternatively, the front substrate 201 and the rear substrate 212 may be formed respectively.

여기서, 플라즈마 디스플레이 패널의 제 1 전극(Y)과 제 2 전극(X)만을 간략히 각각 어떻게 배치되는지를 다음 도 3과 같이 나타낸다.Here, how only the first electrode Y and the second electrode X of the plasma display panel are arranged, respectively, is briefly shown in FIG. 3.

도 3은 본 발명의 플라즈마 디스플레이 패널의 전극배치를 나타낸 도이다.3 is a view showing an electrode arrangement of the plasma display panel of the present invention.

도 3을 살펴보면, 본 발명의 플라즈마 디스플레이 패널은 제 1 전극(202, Y)과 제 2 전극(213, X)의 2개의 전극을 구비한다.Referring to FIG. 3, the plasma display panel of the present invention includes two electrodes, a first electrode 202 and a second electrode 213 and a second electrode 213 and X. FIG.

플라즈다 디스플레이 패널의 제 1 전극(202, Y)에 교차하여 제 2 전극(213, X)이 형성된다. 제 1 전극(202, Y) 끝단의 A영역으로 정극성 서스테인 펄스(+Vsus)와 부극성 서스테인 펄스(-Vsus)가 교번하여 공급되고, 제 2 전극(213, X)으로 서스테인 기간 동안 기준 전압이 공급된다. 여기서 기준 전압은 그라운드 레벨의 전압을 유지하는 것이 바람직하다.Second electrodes 213 and X are formed to cross the first electrodes 202 and Y of the plasma display panel. The positive sustain pulse (+ Vsus) and the negative sustain pulse (-Vsus) are alternately supplied to the A region at the ends of the first electrodes 202 and Y, and the reference voltage is supplied to the second electrodes 213 and X during the sustain period. Is supplied. Here, the reference voltage preferably maintains the ground level voltage.

이러한 플라즈마 디스플레이 패널의 제 1 전극(202, Y)으로 구동 파형이 공급되는데 이것은 다음 도 4와 같이 나타난다.The driving waveform is supplied to the first electrodes 202 and Y of the plasma display panel, which is shown in FIG.

도 4는 본 발명의 실시 예에 따른 플라즈마 디스플레이 장치의 구동파형을 나타내기 위한 도면이다.4 is a diagram illustrating a driving waveform of a plasma display device according to an exemplary embodiment of the present invention.

도 5a 내지 도 5d는 본 발명의 실시 예에 따른 플라즈마 디스플레이 패널의 벽 전하 분포를 나타낸 도면이다.5A through 5D are diagrams illustrating wall charge distribution of a plasma display panel according to an exemplary embodiment of the present invention.

도 4 내지 도 5d를 살펴보면, 본 발명의 실시 예에 따른 플라즈마 디스플레이 패널의 복수의 방전 셀을 초기화하기 위한 리셋 기간, 셀을 선택하기 위한 어드레스 기간 및 선택된 셀의 방전을 유지시키는 서스테인 기간으로 나누어 구동된다.4 to 5D, driving is divided into a reset period for initializing a plurality of discharge cells of a plasma display panel, an address period for selecting a cell, and a sustain period for maintaining the discharge of the selected cell, according to an exemplary embodiment of the present invention. do.

여기서, 리셋 기간의 초기 즉 셋업 기간(Set_up)에는 도 4a에 도시된 바와 같이 플라즈마 디스플레이 패널에 형성된 모든 복수의 제 1 전극(202, Y)에 셋업 전압(Vsetup)까지 상승하는 상승 램프 파형(Ramp-up)이 인가된다. 이와 동시에, 패널에 형성된 복수의 제 2 전극(213, X)에는 0[V]가 인가된다. 이 상승 램프 파형에 의해 패널의 전 화면의 복수의 방전 셀 내에는 약한 암방전(Dark Discharge)이 일어난다. 이 셋업 기간의 방전에 의해 서스테인 전극 상에는 정극성 벽 전하가 쌓이게 되며, 복수의 제 1 전극(202, Y) 상에는 부극성의 벽 전하가 쌓이게 된다.Here, in the initial stage of the reset period, that is, the setup period Set_up, the rising ramp waveform Ramp rising up to the setup voltage Vsetup on all the plurality of first electrodes 202 and Y formed in the plasma display panel as shown in FIG. 4A. -up) is applied. At the same time, 0 [V] is applied to the plurality of second electrodes 213 and X formed in the panel. This rising ramp waveform causes weak dark discharge within a plurality of discharge cells of the entire screen of the panel. The discharge during this setup period causes positive wall charges to accumulate on the sustain electrode, and negative wall charges to accumulate on the plurality of first electrodes 202 and Y.

이러한, 상승 램프 파형은 1차적으로 패널에 형성된 제 1 전극(202, Y)과 제 2 전극(213, X) 사이의 벽 전하를 증가시킨다.This rising ramp waveform primarily increases the wall charge between the first electrodes 202, Y and the second electrodes 213, X formed in the panel.

리셋 기간의 후기 즉, 셋 다운(Set_down)에는 도 4b에 도시된 바와 같이 상승 램프 파형의 피크 전압보다 낮은 정극성 전압에서 떨어지기 시작하여 그라운드(GND)레벨 전압 이하의 특정 전압레벨까지 떨어지는 하강 램프 파형이 복수의 방전 셀 내에 미약한 소거 방전을 일으킴으로써 복수의 제 1 전극(202, Y)에 과도하게 형성된 벽 전하를 충분히 소거시키게 된다. 이 셋 다운 방전에 의해 어드레스 방전 이 안정되게 일어날 수 있을 정도의 벽 전하가 복수의 방전 셀 내에 균일하게 잔류 된다.At the end of the reset period, that is, Set_down, the falling ramp begins to fall from the positive voltage lower than the peak voltage of the rising ramp waveform and falls to a specific voltage level below the ground (GND) level voltage as shown in FIG. 4B. The waveform causes weak erase discharge in the plurality of discharge cells, thereby sufficiently erasing wall charges excessively formed in the plurality of first electrodes 202 and Y. By this set down discharge, wall charges such that the address discharge can stably occur are uniformly retained in the plurality of discharge cells.

이러한, 하강램프 파형(Ramp-dn)은 제 1 전극(202, Y)에 인가됨에 따라 제 1 전극(202, Y)과 제 2 전극(213, X) 사이의 균일한 벽 전하를 유지시킨다.The falling ramp waveform Ramp-dn maintains uniform wall charge between the first electrode 202 and Y and the second electrode 213 and X as it is applied to the first electrode 202 and Y.

다음 단계의 어드레스기간에는 복수의 제 1 전극(202, Y)에 스캔 펄스(Vscan)가 인가되며, 복수의 제 2 전극(213, X)에는 데이터 전압(Vd)가 인가된다. 이에 따라, 제 1 전극(202, Y)과 제 2 전극(213, X) 간에는 어드레스방전이 발생하게 되고, 결과적으로, 제 1 전극(202, Y)과 제 2 전극(213, X) 사이의 벽 전하는 도 4c에 도시된 바와 같이 서스테인 기간 동안 방전이 유지될 수 있을 만큼의 벽 전하를 축적시킨다.In the next address period, a scan pulse Vscan is applied to the plurality of first electrodes 202 and Y, and a data voltage Vd is applied to the plurality of second electrodes 213 and X. As a result, an address discharge occurs between the first electrodes 202 and Y and the second electrodes 213 and X. As a result, an address discharge occurs between the first electrodes 202 and Y and the second electrodes 213 and X. The wall charges accumulate wall charges such that the discharge can be maintained during the sustain period as shown in Fig. 4C.

마지막 단계의 서스테인 기간에는 패널에 형성된 복수의 제 1 전극(202, Y)에 그라운드(GND) 레벨의 전압에 정극성 서스테인 펄스(+Vsus)와 부극성 서스테인 펄스(-Vsus)를 교번하여 공급하며, 복수의 제 2 전극(213, X)에 그라운드(GND) 레벨의 전압을 유지시켜 공급한다. 어드레스 방전에 의해 선택된 복수의 방전 셀은 방전 셀 내의 벽 전압과 서스테인 펄스에 의한 전압이 더해지면서 매 서스테인 펄스가 인가될 때마다 도 4d에 도시된 바와 같이, 패널에 형성된 복수의 제 1 전극(202, Y)과 복수의 제 2 전극(213, X) 간에 서스테인 방전이 발생하게 되어 화상을 표시하게 된다.In the last sustain period, the positive sustain pulse (+ Vsus) and the negative sustain pulse (-Vsus) are alternately supplied to the plurality of first electrodes 202 and Y formed in the panel at a voltage of ground (GND) level. The plurality of second electrodes 213 and X are supplied with the voltage at the ground (GND) level. The plurality of discharge cells selected by the address discharge have a plurality of first electrodes 202 formed in the panel as shown in FIG. 4D each time a sustain pulse is applied as the wall voltage in the discharge cell and the voltage by the sustain pulse are added. , Y) and a plurality of second electrodes 213 and X generate sustain discharge, thereby displaying an image.

여기서, 제 1 전극(202, Y)에 공급되는 정극성 서스테인 펄스(+Vsus)의 크기와 부극성 서스테인 펄스(-Vsus)의 크기는 동일한 것이 바람직하다. 그러나, 정극 성 서스테인 펄스(+Vsus)의 크기와 부극성 서스테인 펄스(-Vsus)의 크기는 동일한 것에 한정된 것이 아니라 정극성 서스테인 펄스(+Vsus)의 크기와 부극성 서스테인 펄스(-Vsus)의 크기가 서로 다를 수도 있다.Here, it is preferable that the magnitude of the positive sustain pulse (+ Vsus) and the magnitude of the negative sustain pulse (-Vsus) supplied to the first electrodes 202 and Y be the same. However, the magnitude of the positive sustain pulse (+ Vsus) and the magnitude of the negative sustain pulse (-Vsus) are not limited to the same, but the magnitude of the positive sustain pulse (+ Vsus) and the magnitude of the negative sustain pulse (-Vsus). May be different.

예를 들면, 제 1 구동부(103)는 제 1 전극(202, Y)을 통하여 서스테인 기간에서 정극성 펄스(+Vsus)와 정극성 펄스(+Vsus)의 크기보다 더 큰 부극성 펄스(-Vsus)를 포함하는 서스테인 펄스를 교번적으로 공급한다. 이와 같이 제 1 전극(202, Y)에 크기가 다른 정극성 펄스(+Vsus)와 부극성 펄스(-Vsus)의 서스테인 펄스가 공급되는 동안에 제 2 전극(213, X)을 통하여 기준 전압인, 그라운드 레벨의 전압(GND)을 공급한다.For example, the first driver 103 may have a negative pulse (-Vsus) greater than the magnitude of the positive pulse (+ Vsus) and the positive pulse (+ Vsus) in the sustain period through the first electrodes 202 and Y. Alternately supplies a sustain pulse comprising a). In this way, while the sustain pulses of the positive polarity pulse (+ Vsus) and the negative polarity pulse (-Vsus) having different magnitudes are supplied to the first electrodes 202 and Y, they are the reference voltages through the second electrodes 213 and X. Supply the ground level voltage (GND).

이와 같이 하는 것은 하나의 전극을 통하여 정극성 펄스(+Vsus)와 부극성 펄스(-Vsus)의 서스테인 펄스가 공급될 때 발생할 수 있는 방전 불균형을 해소하기 위해서이다. 더욱 상세히 설명하면, 부극성 펄스(-Vsus)의 크기를 더 크게 하여 상대적으로 약한 부극성 펄스(-Vsus)의 방전을 정극성 펄스(+Vsus)의 방전만큼 강하게 만들어 부극성 펄스(-Vsus)와 정극성 펄스(+Vsus)의 방전의 불균형을 해소할 수 있는 것이다. 따라서, 플라즈마 디스플레이 패널에 형성된 제 1 전극(202, Y)과 제 2 전극(213, X) 사이에서 일어나는 대향 방전에 의한 형광체의 손상을 줄이는 효과가 있다.This is done to solve the discharge imbalance that may occur when the sustain pulses of the positive pulse (+ Vsus) and the negative pulse (-Vsus) are supplied through one electrode. In more detail, the magnitude of the negative pulse (-Vsus) is increased to make the discharge of the relatively weak negative pulse (-Vsus) as strong as the discharge of the positive pulse (+ Vsus), thereby making the negative pulse (-Vsus) And the unbalance of the discharge of the positive pulse (+ Vsus) can be eliminated. Therefore, there is an effect of reducing the damage of the phosphor due to the counter discharge occurring between the first electrode 202, Y and the second electrode 213, X formed in the plasma display panel.

또한, 이와 같은 방식으로 구동되는 본 발명의 실시 예에 따른 플라즈마 디스플레이 패널의 전극이 제 1 전극(202, Y)과 제 2 전극(213, X)만을 포함함에 따라, 종래의 플라즈마 디스플레이 패널에 형성된 전극의 수를 대폭 줄일 수 있다. 따라서, 패널의 전극의 생산 비용을 절감할 수 있다.In addition, as the electrode of the plasma display panel according to the embodiment of the present invention driven in this manner includes only the first electrode 202 and the second electrode 213 and X, the plasma display panel may be The number of electrodes can be greatly reduced. Therefore, the production cost of the electrode of the panel can be reduced.

또한, 종래의 서스테인 구동부를 별도로 포함하지 않으므로 서스테인 구동부 제작을 위해 소비되는 생산비를 절감할 수 있고, 본 발명의 플라즈마 디스플레이 패널에 형성된 제 2 전극(213, X)은 그라운드(GND) 레벨의 전압으로 유지하여 서스테인 방전을 유도한다. 따라서, 제 2 구동부(102)는 별도의 구동회로 없이 그라운드로 전극을 연결만 하면 되기 때문에 구동회로 제작을 위해 소비되는 생산 비용을 보다 효율적으로 절감할 수 있게 된다.In addition, since the conventional sustain driver is not included separately, the production cost consumed for manufacturing the sustain driver may be reduced, and the second electrodes 213 and X formed in the plasma display panel of the present invention may have a ground (GND) level voltage. Holding to induce a sustain discharge. Therefore, since the second driving unit 102 only needs to connect the electrodes to the ground without a separate driving circuit, it is possible to more efficiently reduce the production cost consumed for manufacturing the driving circuit.

또한, 본 발명은 플라즈마 디스플레이 패널에 형성된 제 1 전극(202, Y)과 제 2 전극(213, X)의 2개의 전극 구조의 방전을 이용하게 됨으로, 종래의 스캔 전극(Y)과 서스테인(Z) 및 어드레스 전극(X)의 3개의 전극 구조에 비하여 소비전력을 효율적으로 절감할 수 있게 된다.In addition, the present invention uses the discharge of the two-electrode structure of the first electrode (202, Y) and the second electrode (213, X) formed in the plasma display panel, the conventional scan electrode (Y) and sustain (Z) ) And power consumption can be reduced more efficiently than the three electrode structures of the < RTI ID = 0.0 > and < / RTI >

상술한 바와 같이, 본 발명의 기술적 구성은 본 발명이 속하는 기술분야의 당업자가 본 발명의 그 기술적 사상이나 필수적 특징을 변경하지 않고서 다른 구체적인 형태로 실시될 수 있다는 것을 이해할 수 있을 것이다.As described above, it will be understood by those skilled in the art that the technical configuration of the present invention may be implemented in other specific forms without changing the technical spirit or essential features of the present invention.

그러므로 이상에서 기술한 실시 예들은 모든 면에서 예시적인 것이며 한정적인 것이 아닌 것으로서 이해되어야 하고, 본 발명의 범위는 상기 상세한 설명보다는 후술하는 특허청구범위에 의하여 나타내어지며, 특허청구범위의 의미 및 범위 그리고 그 등가개념으로 부터 도출되는 모든 변경 또는 변형된 형태가 본 발명의 범위에 포함되는 것으로 해석되어야 한다.Therefore, the exemplary embodiments described above are to be understood as illustrative and not restrictive in all respects, and the scope of the present invention is indicated by the following claims rather than the detailed description, and the meaning and scope of the claims and All changes or modifications derived from the equivalent concept should be interpreted as being included in the scope of the present invention.

상술한 바와 같이, 본 발명은 2개의 전극 구조를 이용하여 플라즈마 디스플레이 패널을 구성함에 따라 서스테인 전극과 서스테인 구동부 및 이를 구동하는 회로가 사용되지 않기 때문에 소비되는 비용을 절감하는 효과가 있다.As described above, the present invention has the effect of reducing the cost consumed because the sustain electrode and the sustain driver and the circuit driving the same are not used as the plasma display panel is configured using two electrode structures.

또한, 2개의 전극 중 제 2 전극(X)은 접지(GND) 전압으로 하여 서스테인 방전을 유도하기 때문에 별도의 회로 없이 접지(Ground)로 전극을 연결만 하면 되기 때문에 구동회로 제작을 위해 소비되는 생산 비용을 효율적으로 절감할 수 있다.In addition, since the second electrode (X) of the two electrodes induces sustain discharge by using the ground (GND) voltage, only the electrodes are connected to the ground (Ground) without a separate circuit. Cost can be reduced efficiently.

Claims (5)

제 1 전극;A first electrode; 상기 제 1 전극과 교차하여 형성된 제 2 전극만으로 구성된 플라즈마 디스플레이 패널;A plasma display panel including only a second electrode formed to intersect the first electrode; 상기 제 1 전극에 서스테인 기간 동안 정극성 서스테인 펄스(+Vsus)와 부극성 서스테인 펄스(-Vsus)를 교번적으로 공급하는 제 1 구동부; 및A first driver alternately supplying a positive sustain pulse (+ Vsus) and a negative sustain pulse (−Vsus) to the first electrode during a sustain period; And 상기 제 2 전극에 서스테인 기간 동안 기준 전압을 공급하는 제 2 구동부A second driver supplying a reference voltage to the second electrode for a sustain period 를 포함하는 플라즈마 디스플레이 장치.Plasma display device comprising a. 제 1 항에 있어서,The method of claim 1, 상기 기준전압은 그라운드(GND) 레벨의 전압을 유지하는 것을 특징으로 하는 플라즈마 디스플레이 장치.And the reference voltage maintains a voltage at ground level. 제 1 항에 있어서,The method of claim 1, 상기 정극성 서스테인 펄스의 크기와 상기 부극성 서스테인 펄스의 크기는 동일한 것을 특징으로 하는 플라즈마 디스플레이 장치.The magnitude of the positive sustain pulse and the magnitude of the negative sustain pulse is the same. 제 1항에 있어서,The method of claim 1, 상기 제 1 구동부는 The first driving unit 상기 서스테인 펄스를 공급하는 에너지 회수 회로를 포함하는 것을 특징으로 하는 플라즈마 디스플레이 장치.And an energy recovery circuit for supplying the sustain pulse. 제 1 전극과 제 2 전극으로 구성된 플라즈마 디스플레이 장치의 구동 방법에 있어서,In the driving method of a plasma display device composed of a first electrode and a second electrode, 상기 제 1 전극에 서스테인 기간 동안 정극성 서스테인 펄스(+Vsus)와 부극성 서스테인 펄스(-Vsus)를 공급하는 단계;Supplying a positive sustain pulse (+ Vsus) and a negative sustain pulse (-Vsus) to the first electrode during a sustain period; 상기 제 1 전극에 서스테인 펄스가 공급되는 동안 상기 제 2 전극에 그라운드 레벨의 전압을 유지하여 공급하는 단계Maintaining and supplying a ground level voltage to the second electrode while a sustain pulse is supplied to the first electrode 를 포함하는 플라즈마 디스플레이 장치의 구동방법.Method of driving a plasma display device comprising a.
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