KR100627362B1 - 플라즈마 표시 장치 및 그 구동 방법 - Google Patents

플라즈마 표시 장치 및 그 구동 방법 Download PDF

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Abstract

본 발명은 플라즈마 표시 장치 및 그 구동 방법에 관한 것이다.
본 발명의 플라즈마 표시 장치에 따르면, 나란히 배열되는 복수의 X 전극 및 복수의 Y 전극, 상기 X 전극 및 상기 Y 전극 사이에 형성되는 M 전극 및 상기 X 전극, Y 전극 및 M 전극과 교차하여 형성되는 어드레스 전극을 포함한다. 이때, X 전극을 접지로 바이어스한 상태에서 M 전극에 리셋 파형 및 스캔 펄스 파형을 인가하며, X 전극을 접지로 바이어스한 상태에서 Y 전극에 Vs 전압과 -Vs 전압을 교대로 인가한다. 또한, 방전을 더욱 잘 일으키기 위해 유지방전 기간에서 어드레스 전극에 숏펄스를 인가한다.
PDP, 중간 전극, 통합보드, 유지방전 기간

Description

플라즈마 표시 장치 및 그 구동 방법{PLASMA DISPLAY DEVICE AND DRVING METHOD THEREOF}
도 1은 종래 플라즈마 디스플레이 패널의 사시도이다.
도 2는 도1에 도시한 플라즈마 디스플레이 패널의 단면도이다.
도 3은 종래 플라즈마 표시장치의 전극 배열도이다.
도 4는 종래 플라즈마 표시장치의 구동 파형도이다.
도 5는 본 발명의 실시예에 따른 플라즈마 디스플레이 패널의 전극 배열도이다.
도 6 및 도 7은 각각 본 발명의 실시예에 따른 플라즈마 디스플레이 패널의 사시도 및 단면도이다.
도 8은 본 발명의 제1 실시예에 따른 플라즈마 디스플레이 패널의 구동파형도이다.
도 9a 내지 도 9e는 본 발명의 제1 실시예에 따른 구동 파형에 기초한 벽전하 분포도이다.
도 10은 본 발명의 제2 실시예에 따른 플라즈마 표시 장치의 구동 파형도이다.
도 11은 본 발명의 제3 실시예에 따른 플라즈마 표시 장치의 구동 파형도이 다.
도 12는 본 발명의 제4 실시예에 따른 플라즈마 표시 장치의 구동 파형도이다.
도 13은 본 발명의 제5 실시예에 따른 플라즈마 표시 장치의 구동 파형도이다.
본 발명은 플라즈마 표시 장치 및 그 구동 방법에 관한 것이다.
최근 액정표시장치(liquid crystal display; LCD), 전계 방출 표시장치(field emission display; FED), 플라즈마 표시장치 등의 평면 표시 장치가 활발히 개발되고 있다. 이들 평면 표시 장치 중에서 플라즈마 표시장치는 다른 평면 표시 장치에 비해 휘도 및 발광효율이 높으며 시야각이 넓다는 장점이 있다. 따라서, 플라즈마 표시장치가 40인치 이상의 대형 표시 장치에서 종래의 CRT(cathode ray tube)를 대체할 표시 장치로서 각광받고 있다.
플라즈마 표시장치는 기체 방전에 의해 생성된 플라즈마를 이용하여 문자 또는 영상을 표시하는 평면 표시 장치로서, 그 크기에 따라 수십에서 수백 만개 이상의 픽셀(pixel)이 매트릭스(matrix)형태로 배열되어 있다. 이러한 플라즈마 표시장치는 인가되는 구동 전압 파형의 형태와 방전 셀의 구조에 따라 직류형(DC형)과 교류형(AC형)으로 구분된다.
직류형 플라즈마 표시장치는 전극이 방전 공간에 그대로 노출되어 있어서 전압이 인가되는 동안 전류가 방전공간에 그대로 흐르게 되며, 이를 위해 전류제한을 위한 저항을 만들어 주어야 하는 단점이 있다. 반면 교류형 플라즈마 표시장치에서는 전극을 유전체층이 덮고 있어 자연스러운 캐패시턴스 성분의 형성으로 전류가 제한되며 방전시 이온의 충격으로부터 전극이 보호되므로 직류형에 비해 수명이 길다는 장점이 있다.
도1은 종래 교류형 플라즈마 디스플레이 패널의 일부 사시도이며, 도2는 도 1에 도시된 플라즈마 디스플레이 패널의 단면도이다.
도 1 및 도 2를 참조하면, 제1 유리기판(11) 위에 유전체층(14) 및 보호막(15)으로 덮인 X 전극(3) 및 Y 전극(4)이 쌍을 이루어 평행하게 설치된다. 이때, X 전극 및 Y 전극은 투명 도전성 물질로 이루어진다. X 전극 및 Y 전극(3,4)의 표면에는 금속 물질로 이루어지는 버스 전극(6)이 각각 형성된다.
제2 유리기판(12) 위에는 복수의 어드레스 전극(5)이 설치되며, 어드레스 전극(5)은 유전체층(14')에 의해 덮혀 있다. 어드레스전극(5)들 사이에 있는 유전체층(14') 위에는 어드레스 전극(5)과 평행하게 격벽(17)이 형성되어 있다. 또한, 유전체층(14')의 표면 및 격벽(17)의 양측면에 형광체(18)가 형성되어 있다. 제1 유리기판(11)과 제2 유리기판(12)은 Y 전극(4)과 어드레스전극(5), 및 X 전극(3)과 어드레스전극(5)이 직교하도록 방전공간(19)을 사이에 두고 대향하여 배치되어 있다. 어드레스전극(5)과, 쌍을 이루는 Y 전극(4)과 X 전극(3)과의 교차부분에 있는 방전공간이 방전셀(19)을 형성한다.
도 3은 종래 플라즈마 표시장치의 전극 배열도를 나타낸다.
도3에 도시한 바와 같이, 종래 플라즈마 표시장치 전극은 ｍ＞ｎ의 매트릭스 구성을 가지고 있다. 열 방향으로 어드레스 전극(A1~Am)이 배열되어 있고 행방향으로 n행의 Y 전극(Y1~Yn) 및 X 전극(X1~Xn)이 지그재그로 배열되어 있다. 도 3에 도시된 방전셀(20)은 도 1에 도시된 방전셀(19)에 대응한다.
도 4는 종래의 플라즈마 표시장치의 구동 파형도이다.
도4에 도시한 플라즈마 표시장치의 구동방법에 따르면 각 서브필드는 리셋구간, 어드레스 구간, 유지구간으로 구성된다.
리셋구간은 이전의 유지 방전의 벽전하 상태를 소거하고, 다음의 어드레스 방전을 안정적으로 수행하기 위해 벽전하를 셋업(setup) 하는 역할을 한다.
어드레스 구간은 패널에서 켜지는 셀과 켜지지 않는 셀을 선택하여 켜지는 셀(어드레싱된 셀)에 벽전하를 쌓아두는 동작을 수행하는 기간이다.
유지 구간은 X 전극 및 Y 전극에 유지방전 전압을 교대로 인가하여, 어드레싱된 셀에 실제로 화상을 표시하기 위한 방전을 수행하는 기간이다.
이하에서는 종래의 플라즈마 표시장치 구동방법의 리셋구간의 동작을 보다 상세히 설명한다. 도4에 도시한 바와 같이, 리셋 구간은 소거 구간, Y 램프 상승구간 및 Y 램프 하강구간으로 이루어진다.
(1) 소거 구간 (I)
이 구간동안에는, X 전극을 일정한 전위(Vbias)로 바이어스시킨 상태에서 Y 전극에 유지방전 전압(Vs)에서 접지 전위까지 천천히 하강하는 하강 램프를 인가하 여, 이전의 유지 구간에서 형성된 벽전하를 제거한다.
(2) Y 램프 상승구간 (Ⅱ)
이 구간 동안에는 어드레스 전극 및 X 전극을 0V로 유지하고, Y 전극에 전압 Vs로부터 전압 Vset을 향하여 완만하게 상승하는 램프전압을 인가한다. 이 램프전압이 상승하는 동안 모든 방전 셀에서는 Y 전극으로부터 어드레스 전극 및 X 전극으로 각각 미약한 리셋 방전이 일어난다. 그 결과, Y 전극에 (-) 벽전하가 축적되고, 동시에 어드레스 전극 및 X 전극에 (+) 벽전하가 축적된다.
(3) Y 램프 하강 구간 (Ⅲ)
이어서, 리셋기간의 후반에는 X 전극을 정전압 Vbias로 유지한 상태에서, Y 전극에 전압 Vs로부터 접지 전압을 향해 완만하게 하강하는 램프전압을 인가한다. 이 램프전압이 하강하는 동안 다시 모든 방전 셀에서는 미약한 리셋 방전이 일어난다.
그러나, 종래의 플라즈마 표시장치에 의하면 어드레스 기간 후 첫 번째 유지 방전 펄스 인가시 방전 셀내에 충분한 프라이밍 전하(priming particle)가 생성되어 있지 않기 때문에, 방전 불량이 발생하는 문제점이 있었다.
한편, 유지 방전 구간에서는 X 전극 및 Y 전극에 동일한 유지방전 전압을 교대로 인가하여, 어드레싱된 셀에 실제로 화상을 표시하기 위한 유지 방전을 수행한다. 이때, 유지 방전 구간에 X 전극 및 Y 전극에 인가되는 파형은 대칭적인 파형이 인가되는 것이 바람직하다. 그러나, 종래의 플라즈마 표시장치에 의하면 리셋 구간에 Y 전극(Y 전극에는 리셋 및 스캔을 위한 파형이 추가적으로 인가됨)에 인가되는 파형과 X 전극에 인가되는 파형이 다르기 때문에, Y 전극을 구동하기 위한 회로와 X 전극을 구동하기 위한 회로가 다르다. 이에 따라, X 전극 및 Y 전극의 구동회로가 임피던스 매칭이 되지 않아, 유지 방전 구간에서 X 전극 및 Y 전극에 교대로 인가되는 파형이 왜곡되어, 방전 불량이 발생하는 문제점이 발생한다.
본 발명이 이루고자 하는 기술적 과제는 상기한 종래 기술의 문제점을 해결하기 위한 것으로 방전 불량을 방지하기 위한 플라즈마 표시 장치 및 이의 구동방법을 제공하기 위한 것이다. 또한, 주사전극과 유지전극을 구동할 수 있는 통합보드를 가지는 플라즈마 표시 장치를 제공함과 아울러 통합보드에 적합한 구동 파형을 제공하기 위한 것이다.
상기한 목적을 달성하기 위한 본 발명의 특징에 따른 플라즈마 표시 장치의 구동 방법은,
복수의 제1 전극(X)과 복수의 제2 전극(Y), 상기 제1 전극과 제2 전극 사이에 형성되는 복수의 제3 전극(M) 및 상기 제1 전극과 제2 전극에 교차하는 방향으로 형성되는 복수의 제4 전극(A)을 포함하는 플라즈마 표시 장치에서 한 프레임을 복수의 서브필드로 나누어 구동하는 방법에 있어서,
적어도 하나의 서브필드에서, (a) 리셋 기간에서 상기 제1 전극을 제1 전압으로 바이어스한 상태에서 상기 제3 전극의 전압을 제2 전압에서 제3 전압까지 점진적으로 증가시킨 후, 제4 전압에서 제5 전압까지 점진적으로 감소시키는 단계; (b) 어드레스 기간에서 켜질 방전 셀을 선택하는 단계; 및 (c) 상기 제1 전극을 상기 제1 전압으로 바이어스한 상태에서 상기 제2 전극에 상기 제1 전압보다 높은 제6 전압과 상기 제1 전압보다 낮은 제7 전압을 교대로 가지는 펄스를 인가하여 상기 단계(b)에서 선택된 방전 셀을 유지방전시키는 단계를 포함한다. 여기서, 상기 제1 전압은 접지 전압이다.
한편, 상기 제2 전극에 상기 제6 전압이 인가되는 동안에 상기 제3 전극에 상기 제1 전압보다 높은 제8 전압을 인가하고, 상기 제2 전극에 상기 제7 전압이 인가되는 동안에 상기 제3 전극에 상기 제7 전압보다 높은 제9 전압을 인가한다.
또한, 상기 제2 전극에 상기 제6 전압이 인가되는 동안에 상기 제4 전극에 상기 펄스의 폭보다 좁으며 상기 제6 전압과 같은 극성의 전압을 인가하며, 상기 제2 전극에 상기 제7 전압이 인가되는 동안에 상기 제4 전극에 상기 펄스의 폭보다 좁으며 상기 제6 전압과 같은 극성의 전압을 인가한다.
본 발명의 다른 특징에 따른 플라즈마 표시 장치는
제1 기판 및 제2 기판; 상기 제1 기판에 각각 형성되는 제1 전극과 제2 전극; 상기 제1 전극과 제2 전극 사이에 형성되는 제3 전극; 상기 제2 기판에 형성되며, 상기 제1 전극, 상기 제2 전극 및 상기 제3 전극과 교차하는 방향으로 형성된 어드레스 전극; 및 인접한 상기 제1 전극, 상기 제2 전극, 상기 제3 전극 및 상기 어드레스 전극에 의해 형성되는 방전셀을 방전시키기 위해 상기 제1 전극, 제2 전극, 제3 전극 및 어드레스 전극에 구동 전압을 공급하는 구동 회로를 포함하며,
상기 구동 회로는, 리셋 기간에서 상기 제1 전극을 제1 전압으로 바이어스한 상태에서 상기 제3 전극에 점진적으로 상승하고 하강하는 전압을 인가하며, 유지방전 기간에서 상기 제1 전극을 상기 제1 전압으로 바이어스한 상태에서 상기 제2 전극에 상기 제1 전압보다 높은 제2 전압과 상기 제1 전압보다 낮은 제3 전압을 교대로 가지는 펄스를 인가한다.
아래에서는 첨부한 도면을 참고로 하여 본 발명의 실시예에 대하여 본 발명이 속하는 기술 분야에서 통상의 지식을 가진 자가 용이하게 실시할 수 있도록 상세히 설명한다. 그러나 본 발명은 여러 가지 상이한 형태로 구현될 수 있으며 여기에서 설명하는 실시예에 한정되지 않는다.
도면에서 본 발명을 명확하게 설명하기 위해서 설명과 관계없는 부분은 생략하였다. 명세서 전체를 통하여 유사한 부분에 대해서는 동일한 도면 부호를 붙였다.
그리고 본 발명에서 언급되는 벽 전하란 셀의 벽(예를 들어, 유전체층) 상에서 각 전극에 가깝게 형성되는 전하를 말한다. 그리고 벽 전하는 실제로 전극 자체에 접촉되지는 않지만, 여기서는 전극에 "형성됨", "축적됨" 또는 "쌓임"과 같이 설명한다. 또한 벽 전압은 벽 전하에 의해서 셀의 벽에 형성되는 전위차를 말한다.
이제 본 발명의 실시예에 따른 플라즈마 표시 장치 및 그 구동 방법에 대하여 도면을 참고로 하여 상세하게 설명한다.
도 5는 본 발명의 실시예에 따른 플라즈마 표시 장치의 전극 배열도를 나타낸다.
도 5에 도시한 바와 같이, 본 발명의 실시예에 따른 플라즈마 디스플레이 패 널은 열 방향으로 어드레스 전극(A1~Am)이 평행하게 배열되어 있고, n행의 Y 전극(Y1~Yn), X 전극(X1~Xn) 및 2n-1행의 중간 전극(이하 'M 전극')이 배열되어 있다. 즉, 본 발명의 실시예에 따르면 Y 전극 및 X 전극의 중간에 M 전극이 배열되어 있으며, Y 전극, X 전극, M 전극 및 어드레스 전극이 하나의 방전 셀을 이루는 4 전극 구조를 가진다.
이때, 본 발명의 실시예에 따르면 X 전극 및 Y 전극은 주로 유지 방전 전압파형을 인가하기 위한 전극의 역할을 하며, M 전극은 주로 리셋 파형 및 스캔 펄스 전압을 인가하기 위한 역할을 한다.
도 6은 본 발명의 실시예에 따른 플라즈마 디스플레이 패널의 사시도이며, 도 7은 도 6에 도시한 플라즈마 디스플레이 패널의 단면도이다.
도 6 및 도 7을 참조하면, 본 발명의 실시예에 따른 플라즈마 디스플레이 패널은 제1 기판(41) 및 제2 기판(42)을 구비한다. 상기 제1 기판(41)에는 X 전극(53)과 Y 전극(54)이 형성된다. 또한 상기 X 전극(53)과 Y 전극(53)의 상부에는 버스 전극(46)이 형성된다. 상기 X 및 Y 전극(53,54)의 상부에는 유전체층(44)과 보호막(45)이 차례로 형성된다.
한편, 제2 기판(42)의 표면에는 어드레스 전극(55)이 형성되며, 상기 어드레스 전극(55)의 상부에는 유전체층(44')이 형성된다. 상기 유전체층(44')의 상부에는 격벽(47)이 형성됨으로써 격벽(47) 사이에 방전 공간인 셀(49)이 형성된다. 격벽(47) 사이의 셀 공간에서 격벽(47)의 표면에는 형광체(48)가 도포된다. 상기 X 및 Y 전극(53, 54)은 상기 어드레스 전극(55)에 대하여 상호 직각으로 형성된다.
이때, 본 발명의 실시예에 따르면 제1 기판(41)의 표면에 형성된 한쌍의 X 전극(53)과 Y 전극(54) 사이에 중간 전극(56)이 형성된다. 전술한 바와 같이, 이 중간 전극에는 주로 리셋 파형 및 스캔 파형이 인가된다. 중간 전극(56)의 상부에 버스 전극(46)이 형성된다.
이하에서 설명하는 플라즈마 표시 장치의 구동 방법은 리셋 기간, 어드레스 기간 및 유지 기간을 포함한다. 그리고, 플라즈마 디스플레이 패널에는 각 기간에서 X 전극에 구동 전압을 인가하는 X 전극 구동회로(도시하지 않음), Y 전극에 구동 전압을 인가하는 Y 전극 구동회로(도시하지 않음), 어드레스 전극(A)에 구동 전압을 인가하는 어드레스 구동회로(도시하지 않음) 및 M 전극에 구동 전압을 인가하는 구동 회로(도시하지 않음)가 연결된다. 이러한 구동 회로와 플라즈마 디스플레이 패널이 연결되어 하나의 플라즈마 표시 장치를 이룬다.
도 8은 본 발명의 제1 실시예에 따른 플라즈마 표시장치의 구동파형도이며, 도 9a 내지 도 9e는 도 8에 도시한 구동 파형에 따른 벽전하 분포를 나타내는 도면이다.
이하에서는 도 8, 도 9a 내지 도 9e를 참조하여, 본 발명의 제1 실시예에 따른 구동방법을 설명한다.
도 8에 도시한 본 발명의 제1 실시예에 따른 구동방법에 의하면, 각 서브필드는 리셋기간, 어드레스 기간, 유지기간으로 구성된다.
본 발명의 실시예에 따르면 리셋 기간은 소거 기간, M 전극 상승파형 기간 및 M 전극 하강파형 기간으로 이루어진다.
(1-1) 소거 기간 (I)
이 기간은 이전의 유지방전 기간에 형성된 벽전하를 소거하는 역할을 한다. 본 발명의 실시예에 따르면, 유지방전 기간의 마지막 시점에 X 전극에 유지방전 전압 펄스가 인가되고, Y 전극에는 X 전극에 인가된 전압보다 낮은 전압(예컨대, 접지 전압)이 인가되었다고 가정한다. 그러면, 도 9a와 같이, Y 전극 및 어드레스 전극에는 (+) 벽전하가 형성되고, X 전극 및 M 전극에는 (-) 벽전하가 형성된다.
소거 기간에서는 Y 전극을 전압 Vyc로 바이어스시킨 상태에서, M 전극에 Vmc 전압에서 접지전압까지 완만하게 하강하는 파형(램프 파형 또는 로그 파형)을 인가한다. 그러면, 도 9a에 도시한 바와 같이 유지 방전 기간시 형성된 벽전하는 소거된다.
(1-2) M 전극 상승 파형기간 (Ⅱ)
이 기간 동안에는 X 전극 및 Y 전극을 접지전압으로 바이어스시킨 상태에서, M 전극에 전압 Vmd에서 Vset으로 완만하게 상승하는 파형(램프파형 또는 로그파형)을 인가한다. 이 상승 파형이 인가되는 동안, 모든 방전 셀에서는 M 전극으로부터 어드레스 전극, X 전극 및 Y 전극으로 각각 미약한 리셋 방전이 일어난다. 그 결과, 도 9b에 도시한 바와 같이, M 전극에 (-) 벽전하가 축적되고, 동시에 어드레스 전극, X 전극 및 Y 전극에는 (+) 벽전하가 축적된다.
(1-3) M 전극 하강 파형기간 (Ⅲ)
이어서, 리셋기간의 후반에는 X 전극 및 Y 전극을 각각 Vxe와 Vye로 바이어스시킨 상태에서, M 전극에 전압 Vme부터 접지 전압을 향해 완만하게 하강하는 파 형(램프파형 또는 로그파형)을 인가한다. 이때, Vxe = Vye, Vmd = Vme로 설정하는 것이 회로 구성을 간단히 할 수 있다는 점에서 바람직하나, 반드시 이에 한정되는 것은 아니다.
이 램프전압이 하강하는 동안 다시 모든 방전 셀에서는 미약한 리셋 방전이 일어난다. 이때, M 전극 하강 파형기간은 M 전극 상승 파형 기간에 의해 쌓인 벽전하를 천천히 감소시키기 위한 것이므로, 하강 파형의 시간을 길게 가지고 갈수록(즉, 기울기를 완만하게 할수록) 감소되는 벽전하량을 정밀하게 제어할 수 있기 때문에 어드레스 방전에 유리하다.
M 전극에 하강 파형을 인가한 결과, 모든 셀의 각 전극에 쌓였던 벽전하가 균등하게 소거되어, 도 9c에 도시된 바와 같이 어드레스 전극에는 (+) 벽전하가 축적되고, 동시에 X 전극, Y 전극 및 M 전극에는 (-) 벽전하가 축적된다.
(2) 어드레스 기간 (스캔 기간)
어드레스 기간에서는 다수의 M 전극을 Vsc 전압으로 바이어스시킨 상태에서 M 전극에 순차적으로 스캔 전압(예컨대, 접지 전압)을 인가하여 스캔 펄스를 인가하고, 동시에 어드레스 전극에는 방전을 원하는 셀(즉, 켜지는 셀)에 어드레스 전압을 인가한다. 이때, X 전극에는 접지 전압으로 유지하고, Y 전극에는 전압 Vye를 인가한다. (즉, Y 전극에 X 전극의 전압보다 높은 전압을 인가한다.)
그러면, M전극과 어드레스 전극 사이의 방전이 일어나면서, 방전이 X 전극 및 Y 전극으로 확장되고, 그 결과 도 9d에 도시한 바와 같이, X 전극 및 M 전극에는 (+) 전하가 축적되고, Y 전극 및 어드레스 전극에는 (-) 벽전하가 축적된다.
(3) 유지방전 기간
본 발명의 실시예에 따른 유지 방전 기간에 의하면, M 전극을 유지 방전 전압 Vm으로 바이어스시킨 상태에서, X 전극 및 Y 전극에 유지방전 전압 펄스를 교대로 인가한다. 이와 같은 전압의 인가를 통해 어드레스 기간에서 선택된 방전 셀에는 유지방전이 일어나게 된다. 여기서, M 전극에 인가하는 Vm 전압과 X 전극 또는 Y 전극에 인가하는 Vs 전압을 동일한 전압으로 하여 전원 수를 감소시킬 수 있다.
이때, 본 발명의 실시예에 따르면 유지 방전 초기와 정상 시점에서는 서로 다른 방전 메카니즘에 의해 방전이 생기게 된다. 이하에서는 설명의 편의상 유지 방전 초기에 발생하는 방전을 숏갭 방전(short-gap discharge) 기간이라 칭하고, 정상 시점의 방전을 롱갭 방전(long-gap discharge) 기간이라 칭한다.
(3-1) 숏갭 방전 기간
유지방전의 시작 기간에서는 도 9e의 (a), (b)에 도시한 바와 같이, X 전극에 (+) 전압 펄스가 인가되고 Y전극에 (-) 전압 펄스가 인가되지만(여기서, + 및 -의 부호는 X 전극에 인가된 전압과 Y 전극에 인가된 전압의 크기를 비교한 상대적인 개념으로서, X 전극에 + 펄스 전압이 인가되었다는 의미는 X 전극에 Y 전극보다 큰 전압이 인가되었다는 것을 의미한다.), 동시에 M 전극에 (+) 전압펄스가 인가된다. 따라서, X 전극 및 Y 전극 사이에서만 방전이 일어나는 종래와 달리, X전극/M전극과 Y 전극과의 방전이 일어나게 된다. 특히, 본 발명의 실시예에 따르면 X 전극 및 Y 전극 사이의 거리보다 M 전극과 Y 전극 사이의 거리가 더 가깝기 때문에, M 전극과 Y 전극 사이에 인가되는 전계(electric field)가 더 크게 된다. 따라서, M 전극과 Y 전극 사이의 방전이 X 전극과 Y 전극 사이의 방전보다 주도적인 역할을 한다. 이처럼, 본 발명의 실시예에서는 유지 방전 초기에 상대적으로 거리가 짧은 M 전극과 Y 전극 사이의 방전이 주도적인 역할을 한다고 해서, 숏갭 방전이라 칭하는 것이다.
이처럼, 본 발명의 실시예에 따르면 유지 방전 초기에 상대적으로 높은 전계가 인가되어 수행되는 숏갭 방전이 발생하기 때문에, 어드레스 기간 후 첫 번째 유지 방전 펄스 인가시 방전 셀내에 충분한 프라이밍 전하(priming particle)가 생성되어 있지 않더라도, 충분한 방전을 수행할 수 있다.
(3-2) 롱갭 방전 기간
유지 방전의 첫 번째 유지방전 펄스 인가 후에는, M 전극의 전압이 일정 전압(Vs)으로 바이어스되기 때문에, M 전극과 X 전극 사이의 방전 또는 M 전극과 Y 전극 사이의 방전(즉, 숏갭 방전)은 방전에 기여하는 정도가 작아 주 방전은 X 전극 및 Y 전극 사이의 방전이 되고, 결국 X 전극 및 Y 전극에 교대로 인가되는 방전 펄스 수에 의해 입력된 영상을 표시할 수 있게 된다.
즉, 도 9e의 (d)에 도시하였듯이, 정상상태의 유지방전기간에서는 M 전극에는 (-) 벽전하가 계속적으로 축적되고, X 전극 및 Y 전극에는 교대로 (-) 벽전하와 (+) 벽전하가 축적된다.
이처럼 본 발명의 실시예에 따르면, 유지 방전 초기에는 X 전극과 M 전극(또는 Y 전극과 M 전극 사이)의 숏갭 방전에 의해 방전을 수행하기 때문에 프라이밍 파티클이 적은 상태에서도 충분한 방전을 수행하고, 정상적인 상태에서는 X 전극 및 Y 전극 사이의 롱갭 방전에 의해 방전을 수행하기 때문에 안정적인 방전을 수행할 수 있다.
또한, 본 발명의 실시예에 따르면, X 전극과 Y 전극에 거의 대칭적인 전압 파형이 인가되기 때문에, X 전극 및 Y 전극을 구동하기 위한 회로를 거의 동일하게 설계할 수 있다. 따라서, X 전극 및 Y 전극 사이의 회로 임피던스의 차를 거의 없앨 수 있기 때문에, 유지방전 기간에서 X 전극 및 Y 전극에 인가되는 펄스 파형의 왜곡을 감소시켜 안정적인 방전을 도모할 수 있다.
도 8에 도시한 본 발명의 제1 실시예에 따르면 X 전극과 Y 전극의 파형은 서로 뒤바뀌어도 구동이 가능하며, 또한 어드레스 기간에서 X 전극과 Y 전극과의 파형이 서로 바뀌어도 구동이 가능하다.
위에서 설명한 본 발명의 제1 실시예에 따른 구동 방법에 따르면, M 전극에는 주로 리셋 파형 및 스캔 펄스 파형이 인가되고, X 전극 및 Y 전극에는 주로 유지 전압 파형이 인가된다. 이때, M 전극에 인가되는 리셋 파형은 도 8에 도시한 리셋 파형뿐만 아니라 다양한 형태의 리셋 파형이 인가될 수 있다.
그러나, 이러한 본 발명의 제1 실시예에 따른 구동 파형을 인가하기 위해서는 유지방전 기간에서는 Y 전극과 X 전극에 교대로 유지 방전 펄스가 인가되고, 리셋 기간과 어드레스 기간에서는 M 전극에 리셋 파형과 주사 파형이 인가된다. 따라서, M 전극을 구동하기 위한 M 구동 보드와 X전극을 구동하기 위한 구동 보드 및 Y 전극을 구동하기 위한 구동보드가 별도로 존재해야 한다. 이와 같이 구동 보드 가 따로 존재하면 샤시 베이스(도시하지 않았음)에 구동 보드를 실장하는 문제점이 있으며, 3개의 구동 보드로 인해서 단가가 증가한다. 이하에서는 이와 같은 제1 실시예의 문제를 개선하는 구동 방법에 대해서 알아본다.
도 10은 본 발명의 제2 실시예에 따른 플라즈마 표시 장치의 구동 파형도이다. 아래에서는 Y 전극에 인가되는 전압은 Y 구동 보드(도시하지 않았음)에서 공급되고 M 전극에 인가되는 전압은 M 구동 보드(도시하지 않았음)와 M 버퍼 보드(도시하지 않았음)에서 공급되고 A 전극에 인가되는 전압은 어드레스 버퍼 보드(도시하지 않았음)에서 공급된다. 또한, X 전극은 기준 전압(도 10에서는 접지 전압)으로 바이어스되어 있으므로, X 전극에 인가되는 전압에 대해서는 설명을 생략한다.
도 10을 보면, 하나의 서브필드는 리셋 기간, 어드레스 기간 및 유지방전 기간으로 이루어지며, 리셋 기간은 상승 기간 및 하강 기간으로 이루어진다. 한편, 도 10에서는 도 8에서와 같은 소거 기간은 동일한바 편의상 생략하였다.
리셋 기간의 상승 기간에서는 A 전극과 Y 전극을 기준 전압(도 10에서는 0V)으로 유지한 상태에서 M 전극의 전압을 Vmd 전압에서 Vset 전압까지 점진적으로 증가시킨다. 도 10에서는 M 전극의 전압이 램프 형태로 증가하는 것으로 도시하였다. M 전극의 전압이 증가하는 중에 M 전극으로부터 A 전극, X 전극 및 Y 전극으로 각각 미약한 미약한 방전(이하, '약 방전'이라 함)이 일어나면서, M 전극에 (-) 벽 전하가 형성되고 A 전극, X 전극 및 Y 전극에는 (+) 벽전하가 형성된다. 그리고 전극의 전압이 도 10과 같이 점진적으로 변하는 경우에는 셀에 미약한 방전이 일어나면서 외부에서 인가된 전압과 셀의 벽 전압이 방전 개시 전압 상태를 유지하 도록 벽전하 형성된다. 이러한 원리에 대해서는 웨버(Weber)의 미국등록특허 제5,745,086에 개시되어 있다. 리셋 기간에서는 모든 셀의 상태를 초기화하여야 하므로 Vset 전압은 모든 조건의 셀에서 방전이 일어날 수 있을 정도의 높은 전압이다. 또한, Vmd 전압은 일반적으로 유지방전 기간에서 Y 전극에 인가되는 전압이며, Y 전극과 X 전극 사이의 방전 개시 전압보다 낮은 전압이다.
이어서, 리셋 기간의 하강 기간에서는 A 전극과 Y 전극의 전압을 기준 전압으로 유지한 상태에서 M 전극의 전압을 Vme 전압에서 Vnf 전압까지 점진적으로 감소시킨다. 그러면 M 전극의 전압이 감소하는 중에 M 전극과 X 전극 사이, M 전극과 Y 전극 사이 및 M 전극과 A 전극 사이에서 미약한 방전이 일어나면서 M 전극에 형성된 (-) 벽 전하와 X전극, Y 전극 및 A 전극에 형성된 (+) 벽 전하가 소거된다. 일반적으로 Vnf 전압의 크기는 M 전극과 X 전극(또는 Y 전극) 사이의 방전 개시 전압 근처로 설정된다. 그러면 M 전극과 X 전극(도는 Y 전극) 사이의 벽 전압이 거의 0V가 되어, 어드레스 기간에서 어드레스 방전이 일어나지 않은 셀이 유지 기간에서 오방전하는 것을 방지할 수 있다. 그리고 A 전극은 기준 전압으로 유지되어 있으므로 Vnf 전압의 레벨에 의해 M 전극과 A 전극 사이의 벽 전압이 결정된다.
다음, 어드레스 기간에서 켜질 셀을 선택하기 위해 M 전극과 A 전극에 각각 VscL 전압을 가지는 주사 펄스 및 Va 전압을 가지는 어드레스 펄스를 인가한다. 그리고 선택되지 않는 M 전극은 VscL 전압보다 높은 VscH 전압으로 바이어스하고, 켜지지 않을 셀의 A 전극에는 기준 전압을 인가한다. 이러한 동작을 수행하기 위해 M 버퍼 보드(도시하지 않음)는 M 전극(M1∼Mn) 중 VscL의 주사 펄스가 인가될 M 전극을 선택하며, 예를 들어 구동에서 세로 방향으로 배열된 순서대로 Y 전극을 선택할 수 있다. 그리고 어드레스 버퍼 보드(도시하지 않음)는 하나의 M 전극이 선택될 때 해당 M 전극의 의해 형성되는 방전 셀을 통과하는 A 전극(A1∼Am) 중 Va 전압의 어드레스 펄스가 인가될 셀을 선택한다.
구체적으로, 먼저 첫 번째 행의 M 전극(도 5에서 M11)에 VscL 전압의 주사 펄스를 인가하는 동시에 첫 번째 행 중 켜질 셀에 위치하는 A 전극에 Va 전압의 어드레스 펄스를 인가한다. 그러면 첫 번째 행의 M 전극과 Va 전압이 인가된 A 전극 사이에서 방전이 일어나서, M 전극에 (+)벽 전하, A, X 및 Y 전극에 각각(-) 벽 전하가 형성된다. 그 결과 M 전극과 X 전극 사이, M 전극과 Y 전극 사이에 각각 M 전극의 전위가 X 전극 및 Y 전극의 전위에 대해 높도록 벽 전압(Vwxm,Vwym)이 형성된다. 이어서, 두 번째 행의 M 전극(도 5에서 M21)에 VscL 전압의 주사 펄스를 인가하면서 두 번째 행 중 표시하고자 하는 셀에 위치하는 A 전극에 Va 전압의 어드레스 펄스를 인가한다. 그러면 앞에서 설명한 것처럼 Va 전압이 인가된 A 전극과 두 번째 행의 M 전극에 의해 형성되는 셀에서 어드레스 방전이 일어나서 셀에 앞서 설명한 것처럼 벽 전하가 형성된다. 마찬가지로 나머지 행의 M 전극에 대해서도 순차적으로 VscL 전압의 주사 펄스를 인가하면서 켜질 셀에 위치하는 A 전극에 Va 전압의 어드레스 펄스를 인가하여 벽 전하를 형성한다.
이러한 어드레스 기간에서 VscL 전압은 일반적으로 Vnf 전압과 같거나 낮은 레벨로 설정되고 Va 전압은 기준 전압보다 높은 레벨로 설정된다. 예를 들어, VscL 전압과 Vnf 전압이 같은 경우에 Va 전압이 인가될 때 셀에서 어드레스 방전이 일어나는 이유에 대해서 설명한다. 리셋 기간에서 Vnf 저압이 인가되었을 때, A 전극과 M 전극 사이의 벽 전압과 A 전극과 M 전극 사이의 외부 전압(Vnf)의 합은 A 전극과 M 전극 사이의 방전 개시 전압(Vfam)으로 결정된다, 그런데 어드레스 A 전극에 0V가 인가되고 M 전극에 VscL(=Vnf)전압이 인가되는 A 전극과 M 전극 사이에는 Vfay 전압이 형성되므로 방전이 일어날 수 있지만, 일반적으로 이 경우의 방전 지연 시간이 주사 펄스와 어드레스 펄스 폭보다 길어서 방전이 일어나지 않는다. 그런데 A 전극에 Va 전압이 인가되고 M 전극에 VscL(=Vnf)전압이 인가되는 경우에 A 전극과 M 전극 사이에는 Vfam 전압보다 높은 전압이 형성되어 방전 지연 시간이 주사 펄스의 폭보다 줄어들어서 방전이 일어날 수 있다. 이때, 어드레스 방전이 더 잘 일어나도록 하기 위해서 VscL 전압을 Vnf 전압보다 낮은 전압으로 설정할 수 있다.
다음, 어드레스 기간에서 어드레스 방전이 일어난 셀에서는 X 전극(또는 Y 전극)에 대한 M 전극의 벽 전압(Vwxm 또는 Vwym)이 높은 전압으로 형성되었으므로, 유지방전 기간에서는 M 전극과 X 전극을 각각 전압 Vm 및 기준전압(0V)으로 바이어스시킨 상태에서 Y전극에 먼저 Vs 전압을 가지는 펄스를 인가한다. 그러면, 본 발명의 제1 실시예와 동일하게 M전극과 X 전극 사이에 숏갭 방전이 발생하며, M전극과 Y 전극 사이에서는 방전 개시 전압이 넘지 않아 방전이 발생하지 않는다. 이때, Vm 전압은 M 전극과 X 전극 사이의 방전 개시 전압(Vfxm)보다는 낮고 (Vm+Vwxm) 전압이 Vfxm 전압보다 높도록 설정된다. 숏갭 방전 결과 M 전극 및 Y 전극에는 (-) 벽 전하가 형성되고 X 전극과 A 전극에는 (+) 벽 전하가 형성되어, Y 전극에 대한 X 전극의 벽 전압(Vwyx)이 높은 전압으로 형성된다.
이어서, Y 전극에 대한 X 전극의 벽 전압(Vwyx)이 높은 전압으로 형성되었으므로, Y 전극에 -Vs 전압을 가지는 펄스를 인가하여 Y 전극과 X 전극 사이에 롱갭 방전을 일으킨다. 그 결과 Y 전극에 (+) 벽전하가 형성되고 X 전극, M 전극 및 A 전극에 (-) 벽전하가 형성되어 Y 전극에 Vs 전압이 인가될 때 유지방전이 일어날 수 있는 상태가 된다. 이때, M 전극의 전압이 일정한 전압(Vm)으로 바이어스되기 때문에, M 전극과 X 전극 사이의 방전과 M 전극과 Y 전극 사이의 방전(즉, 숏갭 방전)은 방전에 기여하는 정도가 작아 주 방전은 X 전극과 Y 전극 사이의 방전이 된다. 이후, Y 전극에 Vs 전압의 유지 방전 펄스를 인가하는 과정과 X 전극에 Vs 전압의 유지방전 펄스를 인가하는 과정은 해당 서브필드가 표시하는 가중치에 대응하는 횟수만큼 반복한다.
이와 같이 본 발명의 제2 실시예에서는 X 전극을 기준 전압으로 바이어스한 상태에서 M 전극에 인가되는 구동 파형만으로 리셋 동작, 어드레스 동작을 수행하고, X 전극을 기준 전압으로 바이어스한 상태에서 Y 전극에 인가되는 구동 파형만으로 유지방전 동작을 수행할 수 있다. 따라서, X 전극을 구동하는 구동 보드를 제거할 수 있으며, 단지 X 전극을 기준전압으로 바이어스만 하면 된다.
상기 본 발명의 제2 실시예에 따른 구동 파형의 유지방전 기간에서 M 전극과 X 전극 사이의 숏갭 방전 이후에 M 전극과 Y 전극 사이에 외부 인가 전압차가 Vs+Vm으로 되는 지점이 있는바 이 때에 M 전극과 Y 전극 사이에 숏갭 방전이 발생할 수 있다. 초기의 숏갭 방전 이후에는 상기에서 설명한 바와 같이 X 전극과 Y 전극 사이의 롱갭 방전이 주 방전이 되는 것이 바람직하므로 이하에서는 초기 숏갭 방전 이후에 발생될 수 있는 M 전극과 Y 전극 사이의 숏갭 방전을 방지하는 방법에 대해서 알아본다.
도 11 및 도 12는 각각 본 발명의 제3 실시예 및 제4 실시예에 따른 구동파형을 나타내는 도면이다. 특히, 도 11 및 도 12는 편의상 유지방전 기간의 파형만을 나타내었다.
도 11을 참조하면, M 전극에 Vm 전압과 기준 전압(0V)을 교대로 인가한다. 즉, Y 전극에 Vs 전압이 인가되는 동안에는 Vm 전압을 인가하고, Y 전극에 -Vs 전압이 인가되는 동안에는 기준 전압(0V)을 인가한다. 그러면, 유지 방전 기간에서 M 전극과 Y 전극에 각각 Vm 전압과 Vs 전압이 인가되는 동안에 같은 벽 전하가 형성된 후, M 전극과 Y 전극에 각각 0V 와 -Vs 전압을 인가하므로 방전이 발생하지 않아 M전극과 Y 전극 사이의 원치 않는 숏갭 방전을 방지할 수 있다. 한편, X 전극과 Y 전극 사이의 전압은 본 발명의 제2 실시예와 동일하다.
도 12를 참조하면, Y 전극 및 X 전극의 파형은 도 12에 도시한 파형과 동일하며 단지 유지방전 기간에서 M 전극에 Vm 전압을 인가하여 M 전극과 X 전극 사이에 숏갭 방전을 일으킨 후 M 전극을 플로팅시키는 것만이 다를 뿐이다.
M 전극을 플로팅시키면 M 전극은 X 전극 및 Y 전극의 평균 전압값이 유지되기 때문에, 도 12에서 도시한 바와 같은 파형을 갖는다. 따라서, 도 12에 도시한 파형에서 첫 번째 숏갭 방전 이후에 M 전극과 Y 전극 사이의 전압이 도 11의 파형보다 더욱 줄어들어 원치 않는 숏갭 방전을 더욱 방지할 수 있다. 한편, X 전극과 Y 전극 사이의 전압은 본 발명의 제2 실시예와 동일하다.
도 13은 본 발명의 제5 실시예에 따른 구동파형을 나타내는 도면이다. 특히, 도 13에 나타낸 구동 파형은 편의상 유지방전 기간에서 Y 전극과 A 전극에 인가하는 파형만 나타내었으며, X 전극과 M 전극에 인가하는 파형은 본 발명의 도 10내지 도 12의 파형이 될 수 있다.
도 13을 참조하면, Y 전극에 Vs 전압과 -Vs 전압이 교대로 인가될 시에 A 전극에 (+)의 숏 펄스(short pulse)를 인가한다. 그러면, X 전극과 M 전극 간(첫 숏갭 방전시), X 전극과 Y 전극간(롱갭 방전시)의 전기장 외에도 M 전극과 A 전극 사이 및 Y 전극과 A 전극 사이에도 전기장이 발생하여, 방전 공간의 프라이밍 입자들이 활발하게 움직임으로써 방전이 빠르게 일어난다. 이에 따라 유지 방전 전압인 Vs 전압을 낮출 수 있다. 유지방전 기간에서 A 전극에 (+)의 숏 펄스를 인가함으로써, 방전 셀에서는 강한 전계가 형성되어 전자들이 가속되어 더욱 빠른 속도로 이동하게 된다. 전자들의 속도가 증가되면, 방전 셀에 주입된 방전 가스(Xe)와 강한 충돌을 일으키고 충돌된 Xe 입자는 전자가 튀어나가게 되어 이온화(ionized)된다. 그러면, 튀어나온 전자는 전계에 의해 다시 가속되고 가속된 전자는 다른 Xe과 연쇄반응을 일으키고 계속해서 전자를 튀어나가게 한다. 따라서, 충분한 시간이 흐르면 거의 모든 Xe 입자들이 이온화되어서 방전 셀 내부의 프라이밍 입자(prining particle)의 밀도가 급속히 증가하게 되어, 저전압 M-X, X-Y 방전이 가능하고, 방전 딜레이의 개선 및 방전 효율 개선의 효과가 있다.
여기서, 도 13에서는 Y 전극에 Vs 전압과 -Vs 전압이 교대로 인가할 때마다 A 전극에 숏 펄스를 인가하는 것으로 나타내었으나, Y 전극에 Vs 전압만이 인가되는 경우 또는 -Vs 전압만이 인가되는 경우에 A 전극에 숏 펄스를 인가하여 동일한 효과를 볼 수 있다.
이상에서 본 발명의 바람직한 실시예에 대하여 상세하게 설명하였지만 본 발명의 권리범위는 이에 한정되는 것은 아니고 다음의 청구범위에서 정의하고 있는 본 발명의 기본 개념을 이용한 당업자의 여러 변형 및 개량 형태 또한 본 발명의 권리범위에 속하는 것이다.
이상에서 살펴본 바와 같이, 본 발명에 따르면 X전극과 Y 전극 사이에 중간 전극을 형성하고 중간 전극에 리셋 파형 및 스캔 파형을 인가하고, X 전극 및 Y 전극에 유지 방전 전압 파형을 인가함으로써, 방전 불량을 방지할 수 있다.
또한, X 전극을 일정한 전압으로 바이어스한 상태에서 M 전극과 Y 전극에만 구동 파형이 인가되므로 X 전극을 구동하는 보드를 제거할 수 있다. 즉, 실질적으로 하나의 보드만으로 구동하는 통합 보드를 구현할 수 있으며, 이에 따라 단가가 저감된다.
한편, 유지방전 기간에서 A 전극에 숏 펄스를 인가함으로써 유지방전의 딜레이를 줄일 수 있다.

Claims (17)

  1. 복수의 제1 전극과 복수의 제2 전극, 상기 제1 전극과 제2 전극 사이에 형성되는 복수의 제3 전극 및 상기 제1 전극과 제2 전극에 교차하는 방향으로 형성되는 복수의 제4 전극을 포함하는 플라즈마 표시 장치에서 한 프레임을 복수의 서브필드로 나누어 구동하는 방법에 있어서,
    적어도 하나의 서브필드에서,
    (a) 리셋 기간에서 상기 제1 전극을 제1 전압으로 바이어스한 상태에서 상기 제3 전극의 전압을 제2 전압에서 제3 전압까지 점진적으로 증가시킨 후, 제4 전압에서 제5 전압까지 점진적으로 감소시키는 단계;
    (b) 어드레스 기간에서 상기 제3 전극에 스캔 펄스를 인가하여, 켜질 방전 셀을 선택하는 단계; 및
    (c) 유지 기간에서, 상기 제1 전극을 상기 제1 전압으로 바이어스한 상태에서 상기 제2 전극에 상기 제1 전압보다 높은 제6 전압과 상기 제1 전압보다 낮은 제7 전압을 교대로 가지는 펄스를 인가하여 상기 단계(b)에서 선택된 방전 셀을 유지방전시키는 단계를 포함하는 플라즈마 표시 장치의 구동 방법.
  2. 제1항에 있어서,
    상기 제1 전압은 접지 전압인 플라즈마 표시 장치의 구동 방법.
  3. 제1항 또는 제2항에 있어서,
    상기 어드레스 기간에서 상기 제1 전극은 상기 제1 전압으로 바이어스되어 있는 플라즈마 표시 장치의 구동 방법.
  4. 제1항 또는 제2항에 있어서,
    상기 유지 기간에서 상기 제3 전극에 상기 제1 전압보다 높은 제8 전압을 인가하며, 상기 유지 기간은 상기 유지 방전 중 첫 번째 유지 방전이 발생하는 기간을 포함하는 플라즈마 표시 장치의 구동 방법.
  5. 제4항에 있어서,
    상기 제8 전압은 상기 제6 전압과 동일한 플라즈마 표시 장치의 구동 방법.
  6. 제1항 또는 2항에 있어서,
    상기 제2 전극에 상기 제6 전압이 인가되는 동안에 상기 제3 전극에 상기 제1 전압보다 높은 제8 전압을 인가하고, 상기 제2 전극에 상기 제7 전압이 인가되는 동안에 상기 제3 전극에 상기 제7 전압보다 높은 제9 전압을 인가하는 플라즈마 표시 장치의 구동 방법.
  7. 제6항에 있어서,
    상기 제3 전극을 플로팅시킴으로써 상기 제3 전극에 상기 제8 전압 및 상기 제9 전압을 인가하는 플라즈마 표시 장치의 구동 방법.
  8. 제1항 또는 제2항에 있어서,
    상기 제6 전압 및 제7 전압은 크기가 거의 동일하며, 극성이 반대인 플라즈마 표시 장치의 구동 방법.
  9. 제1항 또는 제2항에 있어서,
    상기 제2 전극에 상기 제6 전압이 인가되는 동안에 상기 제4 전극에 상기 펄스의 폭보다 좁으며 상기 제6 전압과 같은 극성의 전압을 인가하는 플라즈마 표시 장치의 구동 방법.
  10. 제9항에 있어서,
    상기 제2 전극에 상기 제7 전압이 인가되는 동안에 상기 제4 전극에 상기 펄스의 폭보다 좁으며 상기 제6 전압과 같은 극성의 전압을 인가하는 플라즈마 표시 장치의 구동 방법.
  11. 제1항 또는 제2항에 있어서,
    상기 단계(a) 및 상기 단계(b)에서 상기 제2 전극에 상기 제1 전압이 바이어스되어 있는 플라즈마 표시 장치의 구동 방법.
  12. 제1 전극과 제2 전극;
    상기 제1 전극과 제2 전극 사이에 형성되는 제3 전극;
    상기 제1 전극, 상기 제2 전극 및 상기 제3 전극과 교차하는 방향으로 형성된 어드레스 전극; 및
    인접한 상기 제1 전극, 상기 제2 전극, 상기 제3 전극 및 상기 어드레스 전극에 의해 형성되는 방전셀을 방전시키기 위해 상기 제1 전극, 제2 전극, 제3 전극 및 어드레스 전극에 구동 전압을 공급하는 구동 회로를 포함하며,
    상기 구동 회로는, 리셋 기간에서 상기 제1 전극을 제1 전압으로 바이어스한 상태에서 상기 제3 전극에 점진적으로 상승하고 하강하는 전압을 인가하며, 어드레스 기간에서 상기 제3 전극에 스캔 펄스를 인가하며, 유지방전 기간에서 상기 제1 전극을 상기 제1 전압으로 바이어스한 상태에서 상기 제2 전극에 상기 제1 전압보다 높은 제2 전압과 상기 제1 전압보다 낮은 제3 전압을 교대로 가지는 펄스를 인가하는 플라즈마 표시 장치.
  13. 제12항에 있어서,
    상기 제1 전압은 접지전압이며,
    상기 구동 회로는 상기 어드레스 기간에서 상기 제1 전극을 상기 제1 전압으로 바이어스하는 플라 즈마 표시 장치.
  14. 제12항 또는 제13항에 있어서,
    상기 구동 회로는, 상기 유지방전 기간에서 상기 제3 전극에 상기 제1 전압보다 높은 제4 전압을 인가하며, 상기 유지방전 기간은 첫 번째 유지 방전이 발생하는 기간을 포함하는 플라즈마 표시 장치.
  15. 제12항 또는 제13항에 있어서,
    상기 구동 회로는 상기 제2 전극에 상기 제2 전압이 인가되는 동안에 상기 제3 전극에 상기 제1 전압보다 높은 제4 전압을 인가하고, 상기 제2 전극에 상기 제3 전압이 인가되는 동안에 상기 제3 전극에 상기 제3 전압보다 높은 제5 전압을 인가하는 플라즈마 표시 장치.
  16. 제12항 또는 제13항에 있어서,
    상기 제2 전극에 상기 제2 전압이 인가되는 동안에 상기 어드레스 전극에 상기 펄스의 폭보다 좁으며 상기 제2 전압과 같은 극성의 전압을 인가하는 플라즈마 표시 장치.
  17. 제16항에 있어서,
    상기 제2 전극에 상기 제3 전압이 인가되는 동안에 상기 어드레스 전극에 상기 펄스의 폭보다 좁으며 상기 제2 전압과 같은 극성의 전압을 인가하는 플라즈마 표시 장치.
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