KR100607241B1 - 플라즈마 표시장치 및 그 구동방법 - Google Patents

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Abstract

본 발명은 플라즈마 표시장치 및 그 구동방법에 관한 것이다. 본 발명의 플라즈마 표시장치는 입력된 영상 데이터에 대하여 복수의 스캔타입별로 임의의 셀과 상기 셀 근방의 셀의 영상 데이터를 비교하는 데이터 비교부와; 데이터 비교부의 결과에 기초하여 복수의 스캔타입 중 하나의 스캔타입에 따라 스캔순서를 결정하는 스캔순서 결정부를 포함한다. 이와 같은 본 발명은 영상 데이터에 따라 변위 전류를 계산하고 변위 전류가 가장 작은 영상 데이터의 패턴을 결정한 후 스캔 순서를 결정함으로써 데이터 드라이버 IC의 파손이나 오동작을 막을 수 있다.
플라즈마, 디스플레이, 패널, 서브필드, 스캔

Description

플라즈마 표시장치 및 그 구동방법{Plasma Display Apparatus and Driving Method Thereof}
도 1은 일반적인 플라즈마 표시 패널의 구조를 나타낸 사시도이다.
도 2는 일반적인 플라즈마 표시 패널의 구동장치의 간략한 회로도이다.
도 3a 내지는 도 3e는 영상 데이터에 따른 변위 전류와 이에 따른 전력의 크기를 나타낸 것이다.
도 4a 내지는 도 4d는 영상 데이터에 따라 플라즈마 표시 패널에 디스플레이되는 화상을 나타낸 것이다.
도 5a 및 도 5b는 일반적인 플라즈마 표시 패널의 화질 향상을 위한 하프토닝에 사용되는 디더링을 설명하기 위한 것이다.
도 6은 본 발명의 실시예에 따른 플라즈마 표시장치의 구동방법의 개념을 설명하기 위한 도면이다.
도 7은 본 발명의 실시예에 따른 플라즈마 표시장치의 구동방법을 설명하기 위한 것이다.
도 8은 본 발명의 실시예에 따른 플라즈마 표시장치의 블록 구성도이다.
도 9는 도 8에 도시된 데이터 비교부에 포함되는 기본 회로 블록의 구성도이다.
도 10은 도 8에 도시된 데이터 비교부의 기본 회로 블록에 포함된 제1 내지는 제3 판단부의 비교 동작을 나타낸 것이다.
도 11은 본 발명의 데이터 비교부의 기본 회로 블록에 포함된 제1 내지는 제3 판단부의 출력 신호에 따른 영상 데이터의 패턴 내용을 나타낸 것이다.
도 12는 본 발명의 제1 실시예에 따른 데이터 비교부와 스캔 순서 결정부의 블록 구성도이다.
도 13은 본 발명의 제1 실시예에 따른 데이터 비교부에 포함된 제1 내지는 제3 판단부(XOR1,XOR2,XOR3)의 출력 신호에 따른 영상 데이터의 패턴 내용을 나타낸 것이다.
도 14는 본 발명의 제2 실시예에 따른 데이터 비교부에 포함된 기본 회로 블록의 구성도이다.
도 15는 본 발명의 제2 실시예에 따른 기본 회로 블록에 포함된 제1 내지는 제9 판단부(XOR1 ~XOR9)의 출력 신호에 따른 영상 데이터의 패턴 내용을 나타낸 것이다.
도 16은 본 발명의 제2 실시예에 따른 데이터 비교부와 스캔 순서 결정부의 블록 구성도이다.
도 17은 본 발명에 따른 데이터 비교부와 스캔 순서 결정부가 각 서브필드 별로 적용되는 실시예의 블록 구성도이다.
본 발명은 플라즈마 표시 장치에 관한 것으로서, 더욱 자세하게는 영상 데이터에 따른 변위 전류의 크기가 최소화되도록 변위 전류가 가장 작은 영상 데이터의 패턴을 결정한 후 스캔 순서를 결정할 수 있는 플라즈마 표시장치 및 그 구동방법에 관한 것이다.
일반적으로 플라즈마 표시 패널(Plasma Display Panel)은 He+Xe 또는 Ne+Xe 불활성 혼합가스의 방전시 발생하는 147nm의 자외선에 의해 형광체를 발광시킴으로써 문자 또는 그래픽을 포함한 화상을 표시하게 된다.
도 1은 일반적인 플라즈마 표시 패널의 구조를 나타낸 사시도이다. 도 1에 도시된 바와 같이, 플라즈마 표시 패널은 상부기판(10) 상에 형성되어진 Y전극(12A) 및 Z전극(12B)과, 하부기판(18) 상에 형성되어진 X전극(20)을 구비한다.
Y전극(12A)과 Z전극(12B) 각각은 투명전극 및 버스전극을 포함한다. 투명전극은 인듐틴옥사이드(Indium-Tin-Oxide : ITO)로 형성된다. 버스전극은 저항을 줄이기 위한 금속으로 형성된다.
Y전극(12A)과 Z전극(12B)이 형성된 상부기판(10)에는 상부 유전체 층(14)과 보호막(16)이 적층된다.
상부 유전체 층(14)에는 플라즈마 방전시 발생된 벽전하가 축적된다. 보호막(16)은 플라즈마 방전시 발생된 스퍼터링에 의한 상부 유전체 층(14)의 손상을 방지함과 아울러 2차 전자의 방출 효율을 높이게 된다. 보호막(16)은 통상 산화마그네슘(MgO)으로 형성된다.
한편, X전극(20)이 형성된 하부기판(18) 상에는 하부 유전체 층(22), 격벽(24)이 형성된다. 하부 유전체 층(22)과 격벽(24)의 표면에는 형광체 층(26)이 도포된다.
X전극(20)은 Y전극(12A) 및 Z전극(12B)과 교차되는 방향으로 형성된다. 격벽(24)은 X전극(20)과 나란하게 형성되어 방전에 의해 생성된 자외선 및 가시광이 인접한 방전셀에 누설되는 것을 방지한다.
형광체층(26)은 플라즈마 방전시 발생된 자외선에 의해 여기되어 적색, 녹색 또는 청색 중 어느 하나의 가시광선을 발생하게 된다. 상/하부기판(10,18)과 격벽(24) 사이에 마련된 방전셀의 방전공간에는 방전을 위한 He+Xe 또는 Ne+Xe 등의 불활성 혼합가스가 주입된다.
도 2는 일반적인 플라즈마 표시 패널의 구동장치의 간략한 회로도이다. 도 2에 도시된 바와 같이, 스캔 과정에서 첫 번째 Y전극(Y1)에 해당하는 채널이 선택되면, 나머지 Y전극(Y2, Y3,……,Yn)에 해당하는 채널은 선택되지 않는다.
이와 같이 채널이 선택되면, 선택된 채널에 해당하는 첫 번째 스캔 드라이버(210-1)의 제2 스위칭 소자(213-1)가 턴온되고 스캔용 스위칭 소자(220)가 턴온된다.
이와 동시에, 선택되지 않은 채널에 해당하는 스캔 드라이버(210-2 내지는 210-n)의 제1 스위칭 소자(211-2 내지는 211-n)와 그라운드용 스위칭 소자(230)가 턴온된다.
이와 같이 스위칭 소자들이 동작하고 데이터 드라이버 IC(300-1 내지는 300-m)의 제1 데이터 스위칭 소자(310-1 내지는 310-m) 또는 제2 데이터 스위칭 소자(320-1 내지는 320-m)의 동작에 의해 X전극(X1 내지는 Xm)에 데이터 전압(+Vd 또는 0V)이 인가되면 첫 번째 라인에 위치하는 셀에 쓰기 동작이 이루어진다.
이와 같은 과정이 모든 Y전극에서 이루어지면 스캔 과정이 끝난다. 스캔 과정 이후에 제1 서스테인용 스위칭 소자(240), 스캔 드라이버(210-1 내지는 210-n)의 제2 스위칭 소자(213-2 내지는 213-n) 및 그라운드용 스위칭 소자(260)가 턴온한다.
이에 따라 제1 서스테인 전압(+Vsy), 제1 서스테인용 스위칭 소자(240), 스캔 드라이버(210-1 내지는 210-n)의 제2 스위칭 소자(213-2 내지는 213-n), 각 Y전극(Y1 내지는 Yn), Z전극(Z1 내지는 Zn) 및 그라운드용 스위칭 소자(260)가 루프(loop)를 형성하여 Y전극(Y1 내지는 Yn)에 서스테인 전압(+Vsy)이 인가된다.
다음으로, 제2 서스테인용 스위칭 소자(250), 스캔 드라이버(210-1 내지는 210-n)의 제1 스위칭 소자(211-2 내지는 211-n) 및 그라운드용 스위칭 소자(230)가 턴온한다.
이에 따라 제2 서스테인 전압(+Vsz), Z전극(Z1 내지는 Zn), Y전극(Y1 내지는 Yn), 스캔 드라이버(210-1 내지는 210-n)의 제1 스위칭 소자(211-2 내지는 211-n) 및 그라운드용 스위칭 소자(230)가 루프를 형성하여 Z전극(Z1 내지는 Zn)에 서스테인 전압(+Vsz)이 인가된다.
이와 같은 플라즈마 표시 패널의 구동 장치는 스캔 기간에 스캔 드라이버(210-1 내지는 210-n)와 데이터 드라이버 IC(300-1 내지는 300-m)에 포함된 스위칭 소자의 스위칭 동작을 통하여 해당 전극에 스캔 전압(-Vyscan)과 데이터 전압(+Vd 또는 0V)을 인가하는데 이 과정에서 X전극을 통하여 데이터 드라이버 IC(300-1 내지는 300-m)에 변위 전류(Id)가 흐른다.
일반적인 플라즈마 표시 패널은 3전극 구조를 가지고 있기 때문에 도 2에서와 같이 X전극과 X전극 사이에 제1 등가 캐패시터(Cm1)와 X전극과 Y전극 또는 Z전극 사이에 제2 등가 캐패시터(Cm2)가 존재한다.
따라서, 스캔 과정에서 스캔 드라이버(210-1 내지는 210-n)와 데이터 드라이버 IC(300-1 내지는 300-m)에 포함된 스위칭 소자의 동작에 따라 전극에 인가되는 전압의 상태가 변하게 되므로 제1 등가 캐패시터(Cm1)와 제2 등가 캐패시터(Cm2)에 의하여 발생한 변위 전류(Id)가 X전극을 통하여 데이터 드라이버 IC(300-1 내지는 300-m)에 흐르게 된다.
그런데 이와 같은 데이터 드라이버 IC(300-1 내지는 300-m)에 흐르는 변위 전류와 이에 따른 전력의 크기는 X전극(X1 내지는 Xm)에 인가되는 영상 데이터에 따라 다르다.
도 3a 내지는 도 3d는 영상 데이터에 따른 변위 전류와 이에 따른 전력의 크기를 나타낸 것이다. 도 2와 도 3a에 도시된 바와 같이 두 번째 Y전극(Y2)이 스캔될 때, X전극(X1 내지는 Xm)에는 논리값 1과 0이 교대로 변하는 영상 데이터가 인가된다. 또한, 세 번째 Y전극(Y3)이 스캔될 때, X전극(X1 내지는 Xm)에는 논리값 0이 유지된다. 논리값 1은 해당 X전극에 데이터 전압(+Vd)가 인가된 상태이고, 논리값 0은 해당 X전극에 0V가 인가된 상태이다.
즉, 하나의 Y전극 상의 셀에 논리값 1과 0이 교대로 변하는 영상 데이터가 인가되고, 다음의 Y전극 상의 셀에 논리값 0이 유지되는 영상 데이터가 인가되는 경우이다.
이 때, 각 X전극에 흐르는 변위 전류(Id)와 이에 따른 전력은 다음의 수학식1과 같다.
Id = 1/2(Cm1+Cm2)Va,
Pd = 1/2(Cm1+Cm2)Va2
Id: 각 X전극에 흐르는 변위전류, Cm1: 제1 등가 캐패시터,
Cm2: 제2 등가 캐패시터, Va: 각 X전극에 인가되는 전압(+Vd 또는 0V),
Pd: 변위 전류(Id)로 인한 소비 전력
다음으로 도 2와 도 3b에 도시된 바와 같이 두 번째 Y전극(Y2)이 스캔될 때, X전극(X1 내지는 Xm)에는 논리값 1이 유지되는 영상 데이터가 인가된다. 또한, 세 번째 Y전극(Y3)이 스캔될 때, X전극(X1 내지는 Xm)에도 논리값 0이 유지되는 영상 데이터가 인가된다. 논리값 0은 해당 X전극에 0V가 인가된 상태이다.
즉, 하나의 Y전극 상의 셀에 1이 유지되는 영상 데이터가 인가되고, 다음의 Y전극 상의 셀에는 논리값 0이 유지되는 영상 데이터가 인가되는 경우이다.
이 때, 각 X전극에 흐르는 변위 전류(Id)와 이에 따른 전력은 다음의 수학식2와 같다.
Id = 1/2(Cm2)Va,
Pd = 1/2(Cm2)Va2
Id: 각 X전극에 흐르는 변위전류, Cm2: 제2 등가 캐패시터,
Va: 각 X전극에 인가되는 전압(0V),
Pd: 변위 전류(Id)로 인한 소비 전력
다음으로 도 2와 도 3c에 도시된 바와 같이 두 번째 Y전극(Y2)이 스캔될 때, X전극(X1 내지는 Xm)에는 논리값 1과 0이 교대로 변하는 영상 데이터가 인가된다. 또한, 세 번째 Y전극(Y3)이 스캔될 때, 두 번재 Y전극(Y2) 상의 셀에 인가된 영상 데이터의 위상과 데이터의 위상이 180°차이가 나도록 논리값 1과 0이 교대로 변하는 영상 데이터가 인가된다. 논리값 1은 해당 X전극에 데이터 전압(+Vd)가 인가된 상태이고, 논리값 0은 해당 X전극에 0V가 인가된 상태이다.
즉, 하나의 Y전극 상의 셀에 논리값 1과 0이 교대로 변하는 영상 데이터가 인가되고, 다음의 Y전극 상의 셀에 상기 하나의 Y전극 상의 셀에 인가된 영상 데이터의 위상과 데이터의 위상이 180°차이가 나도록 논리값 1과 0이 교대로 변하는 영상 데이터가 인가된다.
이 때, 각 X전극에 흐르는 변위 전류(Id)와 이에 따른 전력은 다음의 수학식3과 같다.
Id=1/2(4Cm1+Cm2)Va,
Pd=1/2(4Cm1+Cm2)Va2
Id: 각 X전극에 흐르는 변위전류, Cm2: 제2 등가 캐패시터,
Va: 각 X전극에 인가되는 전압(0V),
Pd: 변위 전류(Id)로 인한 소비 전력
다음으로 도 2와 도 3d에 도시된 바와 같이 두 번째 Y전극(Y2)이 스캔될 때, X전극(X1 내지는 Xm)에는 논리값 1과 0이 교대로 변하는 영상 데이터가 인가된다. 또한, 세 번째 Y전극(Y3)이 스캔될 때, 두 번재 Y전극(Y2) 상의 셀에 인가된 영상 데이터의 위상과 동일하도록 논리값 1과 0이 교대로 변하는 영상 데이터가 인가된다. 논리값 1은 해당 X전극에 데이터 전압(+Vd)가 인가된 상태이고, 논리값 0은 해당 X전극에 0V가 인가된 상태이다.
즉, 하나의 Y전극 상의 셀에 논리값 1과 0이 교대로 변하는 영상 데이터가 인가되고, 다음의 Y전극 상의 셀에는 상기 하나의 Y전극 상의 셀에 인가된 영상 데이터의 위상과 동일하도록 논리값 1과 0이 교대로 변하는 영상 데이터가 인가된다.
이 때, 각 X전극에 흐르는 변위 전류(Id)와 이에 따른 전력은 다음의 수학식4와 같다.
Id=0,
Pd=0
Id: 각 X전극에 흐르는 변위전류, Cm2: 제2 등가 캐패시터,
Va: 각 X전극에 인가되는 전압(0V),
Pd: 변위 전류(Id)로 인한 소비 전력
다음으로 도 2와 도 3e에 도시된 바와 같이 두 번째 Y전극(Y2)이 스캔될 때, X전극(X1 내지는 Xm)에는 논리값 0이 유지되는 영상 데이터가 인가된다. 또한, 세 번째 Y전극(Y3)이 스캔될 때, 세 번째 Y전극(Y3)에는 논리값 0이 유지되는 영상 데이터가 인가된다. 논리값 0은 해당 X전극에 0V가 인가된 상태이다.
즉, 하나의 Y전극 상의 셀에는 논리값 0이 유지되는 영상 데이터가 인가되고, 다음의 Y전극 상의 셀에도 논리값 0이 유지되는 영상 데이터가 인가된다.
이 때, 각 X전극에 흐르는 변위 전류(Id)와 이에 따른 전력은 다음의 수학식5와 같다.
Id=0,
Pd=0
Id: 각 X전극에 흐르는 변위전류, Cm2: 제2 등가 캐패시터,
Va: 각 X전극에 인가되는 전압(0V),
Pd: 변위 전류(Id)로 인한 소비 전력
수학식 1 내지는 수학식 5에서 알 수 있는 바와 같이, 하나의 Y전극 상의 셀에 논리값 1과 0이 교대로 변하는 영상 데이터가 인가되고, 다음의 Y전극 상의 셀에 상기 하나의 Y전극 상의 셀에 인가된 영상 데이터의 위상과 데이터의 위상이 180°차이가 나도록 논리값 1과 0이 교대로 변하는 영상 데이터가 인가되는 경우가 X전극에 가장 큰 변위 전류가 흐른다.
또한, 하나의 Y전극 상의 셀에 논리값 1과 0이 교대로 변하는 영상 데이터가 인가되고, 다음의 Y전극 상의 셀에는 상기 하나의 Y전극 상의 셀에 인가된 영상 데 이터의 위상과 동일하도록 논리값 1과 0이 교대로 변하는 영상 데이터가 인가되는 경우 혹은 하나의 Y전극 상의 셀과 다음 Y전극 상의 셀 모두에 논리값0이 지속되는 영상 데이터가 인가되는 경우가 X전극에 가장 작은 변위 전류가 흐른다.
이와 같이 도 3a 내지는 도 3e에 도시된 영상 데이터에 따라 플라즈마 표시 패널에 디스플레이되는 화상은 다음의 도 4a 내지는 도 4d와 같을 때, 도 4c와 같이 플라즈마 표시 패널이 격자 구조의 화상을 디스플레이할 때 가장 큰 변위 전류가 흐르고 동일한 영상 데이터가 X전극에 인가될 때 가장 작은 변위 전류가 흐른다.
즉, 하나의 X전극을 담당하는 데이터 드라이버 IC의 관점에서 보면 도 3c 또는 도 4c와 같은 영상 데이터는 데이터 드라이버 IC의 스위칭 횟수가 가장 많은 경우에 해당하므로 데이터 드라이버 IC의 스위칭 동작 횟수가 많을수록 데이터 드라이버 IC에 흐르는 변위 전류가 커짐을 알 수 있다.
또한, 하나의 X전극을 담당하는 데이터 드라이버 IC의 관점에서 보면 도 3d또는 도 4d와 같은 영상 데이터는 데이터 드라이버 IC의 스위칭 횟수가 가장 적은 경우에 해당하므로 데이터 드라이버 IC의 스위칭 동작 횟수가 적을수록 데이터 드라이버 IC에 흐르는 변위 전류가 작아짐을 알 수 있다.
이와 같이 플라즈마 표시 패널이 격자 구조의 화상을 디스플레이할 때 X전극에 최대의 변위 전류가 흐르고, 최대 변위 전류가 도 2의 데이터 드라이버 IC(300-1 내지는 300-m)에 손상을 입히거나 데이터 드라이버 IC(300-1 내지는 300-m)를 파괴하는 문제점이 발생한다.
특히, 격자 구조의 화상은 플라즈마 표시 패널의 화질을 개선하기 위한 하프토닝(half-toning) 과정에 사용되므로 문제의 심각성이 있다.
도 5a 및 도 5b는 일반적인 플라즈마 표시 패널의 화질 향상을 위한 하프토닝에 사용되는 디더링을 설명하기 위한 것이다. 도 5a에 도시된 바와 같이, 플라즈마 표시 패널의 화질 향상을 위한 디더링(dithering) 과정에서 사용되는 1/8 그레이 레벨(gray level) 내지는 7/8 그레이 레벨을 위한 4×4 디더 마스크(dither mask) 중, 4/8 레벨에 해당하는 디더 마스크는 격자 형태로서 도 3c 및 도 4c에 해당한다. 따라서, 화질 향상을 위한 디더링 과정에서 사용되는 디더 마스크 자체가 최대의 변위 전류를 유발한다.
이와 같은 디더 마스크를 이용하여 그레이 레벨 27.5를 표현할 경우, 도 5(b)에 도시된 바와 같이, 가중치가 할당된 각 서브필드(subfield)(SF1 내지는 SF13) 중 그레이 레벨 27을 표현하기 위한 서브 필드들(SF1, SF2, SF6, SF7, SF8, SF9, SF10)과 그레이 레벨 28을 표현하기 위한 서브필드들(SF1, SF3, SF9, SF11)이 사용되어야 한다.
이 때, SF2, SF6, SF7, SF8 및 SF10는 그레이 레벨 27을 표현할 때 선택되었다가 그레이 레벨28을 표현할 때 선택되지 않는 서브필드들이고, SF3 및 SF11는 그레이 레벨 27을 표현할 때 선택되지 않았다가 그레이 레벨28을 표현할 때 선택되는 서브필드들이다.
즉, 서브필드의 변화가 7회 일어난다. 이와 같은 서브 필드의 변화는 4/8 그레이 레벨에 해당하는 격자형의 디더 마스크와 함께 데이터 드라이브 IC의 스위칭 횟수를 급격하게 늘림으로써 아주 큰 변위 전류가 데이터 드라이브 IC로 흐른다. 이러한 큰 변위 전류는 데이터 드라이버 IC를 파손시키거나 정상적인 동작을 못하도록 한다.
본 발명은 상기와 같은 문제점들을 해결하기 위한 것으로, 특정 영상 데이터의 패턴, 특히 디더링 과정에서 발생하는 영상 데이터에 따른 변위 전류에 크기를 최소화할 수 있는 플라즈마 표시장치 및 그 구동방법를 제공하기 위한 것이다.
상기 목적을 달성하기 위한 플라즈마 표시장치는 복수의 스캔 전극과, 상기 스캔 전극과 교차배치되는 복수의 어드레스 전극과, 상기 스캔 전극과 상기 어드레스 전극의 교차 위치에 방전 셀이 형성되는 플라즈마 표시 장치에 있어서, 입력된 영상 데이터에 대하여 복수의 스캔타입 별로 임의의 셀과 상기 셀 근방의 셀의 영상 데이터를 비교하는 데이터 비교부와; 상기 데이터 비교부의 결과에 기초하여 상기 복수의 스캔타입 중 하나의 스캔타입에 따라 스캔순서를 결정하는 스캔순서 결정부를 포함한다.
이와 같은 특징에 의하면, 상기 데이터 비교부는, 상기 임의의 셀의 영상 데이터와 상기 임의의 셀의 수평 방향에 위치한 셀의 영상 데이터를 비교하고, 상기 임의의 셀의 영상 데이터와 상기 셀과 수직 방향 상에 위치하는 셀의 영상 데이터와 비교하고,상기 수직 방향 상에 위치하는 셀은 상기 임의의 셀이 포함된 스캔라인과 상기 복수 개의 스캔 타입 각각에 따라 소정 개수의 스캔 라인만큼 떨어진 스캔 라인 상에 위치한다.
이와 같은 특징에 의하면, 상기 스캔 순서 결정부는, 상기 복수 개의 스캔 타입 각각에 해당하는 라인들 사이의 영상 데이터를 비교하고 영상 데이터의 변화량이 가장 작은 스캔 타입에 해당하는 라인들을 순차적으로 스캔한다.
이와 같은 특징에 의하면, 상기 데이터 비교부는, ℓ 번째 스캔 라인 상의 q 번째 셀(ℓ, q)의 영상 데이터와 ℓ 번째 스캔 라인 상의 q-1 번째 셀(ℓ, q-1)의 영상 데이터를 비교하고, 상기 ℓ 번째 스캔 라인 상의 q-1 번째 셀(ℓ, q-1)의 영상 데이터와 상기 스캔 타입에 따라 ℓ-x(x는 ℓ보다 작은 자연수) 번째 스캔 라인 상의 q-1 번째 셀(ℓ-x, q-1)의 영상 데이터를 비교하고, 상기 ℓ-x 번째 스캔 라인 상의 q-1 번째 셀(ℓ-x, q-1)의 영상 데이터와 ℓ-x 번째 스캔 라인 상의 q 번째 셀(ℓ-x, q)의 영상 데이터를 비교하며, 상기 셀(ℓ, q)의 영상 데이터와 상기 셀(ℓ, q-1)의 영상 데이터의 비교 결과를 Value1이라 하고, 상기 셀(ℓ, q-1)의 영상 데이터와 상기 셀(ℓ-x, q-1)의 영상 데이터의 비교 결과를 Value2라 하고, 상기 셀(ℓ-x, q-1)의 영상 데이터와 상기 셀(ℓ-x, q)의 영상 데이터의 비교 결과를 Value3 이라 할 때, 상기 Value1, 상기 Value2, 상기 Value3의 조합에 따라 변위 전류의 크기가 다음 표에 기재된 캐패시턴스에 비례한다.
Value1 Value2 Value3
0 0 0 0
0 1 0 Cm2
0 0 1 Cm1+Cm2
0 1 1 Cm1+Cm2
1 0 0 Cm1+Cm2
1 1 0 Cm1+Cm2
1 0 1 0
1 1 1 4Cm1+Cm2

(0: 영상 데이터의 비교 결과가 동일할 경우, 1: 영상 데이터의 비교 결과가 동일하지 않는 경우, Cm1: X전극 사이에 존재하는 등가 캐패시턴스, Cm2: X전극과 Y전극 또는 X전극과 Z전극에 존재하는 등가 캐패시턴스)
이와 같은 특징에 의하면, 상기 셀은 2개이상의 셀을 포함한다.
이와 같은 특징에 의하면, 상기 데이터 비교부와 상기 스캔 순서 결정부의 동작이 서브필드 마다 이루어진다.
이와 같은 특징에 의하면, 상기 데이터 비교부는 상기 셀의 행방향 또는 열방향 중 적어도 하나의 방향으로 인접한 셀간의 영상 데이터를 비교한다.
이와 같은 특징에 의하면, 상기 데이터 비교부는 상기 셀의 열 방향으로 위치한 셀간의 영상 데이터를 비교하여 데이터 변화량을 측정한다.
이와 같은 특징에 의하면, 상기 데이터 비교부는 상기 셀의 열 방향으로 위치한 셀간의 영상 데이터를 비교하여 데이터 변화량을 측정한다.
이와 같은 특징에 의하면, 상기 복수의 스캔타입은 미리 설정된다.
본 발명의 다른 특징에 의하면, 플라즈마 표시장치의 구동방법은 복수의 스캔 전극과, 상기 스캔 전극과 교차배치되는 복수의 어드레스 전극과, 상기 스캔 전극과 상기 어드레스 전극의 교차 위치에 방전 셀이 형성되는 플라즈마 표시 장치의 구동방법에 있어서, 입력된 영상데이터에 대하여 복수의 스캔타입 별로 임의의 셀과 상기 셀 근방의 셀의 영상 데이터를 비교하는 단계; 상기 데이터 비교부의 결과에 기초하여 상기 복수의 스캔타입 중 하나의 스캔타입에 따라 스캔순서를 결정하는 단계를 포함한다.
본 발명의 또 다른 특징에 의하면, 플라즈마 표시장치의 구동방법은 복수의 스캔 전극과, 상기 스캔 전극과 교차배치되는 복수의 어드레스 전극과, 상기 스캔 전극과 상기 어드레스 전극의 교차 위치에 방전 셀이 형성되는 플라즈마 표시장치를 복수의 서브필드로 분할하여 구동하는 플라즈마 표시장치의 구동방법에 있어서, 제 1서브필드에서는 제 1스캔타입으로 상기 스캔전극에 스캔펄스를 인가하는 단계; 제 2서브필드에서는 제 2스캔타입으로 상기 스캔전극에 스캔펄스를 인가하는 단계;를 포함하며 상기 제 1서브필드에서 제 1스캔타입으로 상기 스캔전극에 인가되는 스캔펄스에 대응하여 특정 데이터전극으로 데이터전압을 인가하는 스위치의 제 1스위칭 횟수보다 상기 제 1서브필드에서 제 2스캔타입으로 상기 스캔전극에 인가되는 스캔펄스에 대응하여 상기 특정 데이터전극으로 데이터전압을 인가하는 스위치의 제 2스위칭가 많으며, 상기 제 2서브필드에서 제 1스캔타입으로 상기 스캔전극에 인가되는 스캔펄스에 대응하여 상기 특정 데이터전극으로 데이터전압을 인가하는 스위치의 제 3스위칭 횟수보다 상기 제 2서브필드에서 제 2스캔타입으로 상기 스캔전극에 인가되는 스캔펄스에 대응하여 상기 특정 데이터전극으로 데이터전압을 인가하는 스위치의 제 4스위칭 횟수가 작다.
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이하, 본 발명의 실시예를 첨부된 도면을 참조하여 상세히 설명하고자 한다.
도 6은 본 발명의 실시예에 따른 플라즈마 표시장치의 구동방법의 개념을 설명하기 위한 도면이다. 앞서 설명한 바와 같이 4×4 디더 마스크(dither mask) 중, 4/8 레벨에 해당하는 디더 마스크는 최대의 변위 전위를 발생시킨다. 즉, 첫 번째 Y전극(Y1)이 스캔될 때부터 순차적으로 격자 무늬에 해당하는 데이터 펄스가 Y전극으로 인가될 때 총 n회의 변위 전류가 발생한다.
이와 같은 격자 무늬 패턴을 살펴보면 Y1, Y3, Y5, ……, Yn-1 번째 라인에 해당하는 영상 데이터의 위상이 동일하고, Y2, Y4, Y6, ……, Yn 번째 라인에 해당하는 영상 데이터의 위상이 동일하다는 것을 알 수 있다.
따라서 도 6의 우측에 도시된 바와 같이 Y1, Y3, Y5, ……, Yn-1 번째 라인이 순차적으로 스캔될 때 동일 위상의 영상 데이터를 인가하고, Y2, Y4, Y6, ……, Yn 번째 라인이 순차적으로 스캔되 때 동일 위상의 영상 데이터를 인가하면, 변위 전류는 총 2회 발생하므로 변위 전류의 크기가 획기적으로 줄어든다.
즉, 데이터 드라이버 IC의 스위칭 동작은 Y1, Y3, Y5, ……, Yn-1 번째 라인 에 해당하는 제1 그룹의 영상 데이터가 인가된 후 Y2, Y4, Y6, ……, Yn 번째 라인에 해당하는 제2 그룹의 영상 데이터가 인가되는 순간에만 발생하기 때문에 변위 전류가 최소화된다.
도 7은 본 발명의 실시예에 따른 플라즈마 표시장치의 구동방법을 설명하기 위한 것이다. 본 발명에 따른 플라즈마 표시 패널의 구동 방법은 도 7에 도시된 바와 같이, 4가지 스캔 타입(type)의 스캔 순서에 따라 스캔을 수행한다.
제1 스캔 타입(Type 1)의 스캔 순서는 Y1-Y2-Y3-……과 같이 순서대로 스캔된다.
제2 스캔 타입(Type 2)의 스캔 순서는 제1 그룹에 속하는 Y전극들을 순차적으로 스캔하고 제2 그룹에 속하는 Y전극들을 순차적으로 스캔한다. 즉, Y1-Y3-Y5-……Yn-1을 스캔하고 Y2-Y4-Y6-……Yn을 스캔한다.
제3 스캔 타입(Type 3)의 스캔 순서는 제1 그룹에 속하는 Y전극들을 순차적으로 스캔하고 제2 그룹에 속하는 Y전극들을 순차적으로 스캔한 후 제3 그룹에 속하는 Y전극들을 순차적으로 스캔한다. 즉, Y1-Y4-Y7-……Yn-2을 스캔하고 Y2-Y5-Y8-……Yn-1을 스캔한 후 Y3-Y6-Y9-……Yn을 스캔한다.
제4 스캔 타입(Type 4)의 스캔 순서는 제1 그룹에 속하는 Y전극들을 순차적으로 스캔하고 제2 그룹에 속하는 Y전극들을 순차적으로 스캔하고 제3 그룹에 속하는 Y전극들을 순차적으로 스캔한 후 제4 그룹에 속하는 Y전극들을 순차적으로 스캔한 다. 즉, Y1-Y5-Y9-……Yn-3을 스캔하고 Y2-Y6-Y10-……Yn-2을 스캔하고, Y3-Y7-Y11-……Yn-1을 스캔한 후 Y4-Y8-Y12-……Yn을 스캔한다.
도 8은 본 발명의 실시예에 따른 플라즈마 표시장치의 블록 구성도이다. 도 8에 도시된 바와 같이, 본 발명에 따른 플라즈마 표시 패널의 구동 장치는 데이터 변환부(710), 서브필드 매핑(subfield mapping)부(720), 데이터 비교부(730), 스캔 순서 결정부(740) 및 데이터 정렬부(750)를 포함한다.
〈데이터 변환부〉
데이터 변환부(710)는 외부에서 입력된 RGB 영상 데이터를 역감마 보정, 오차 확산 및 디더링에 의하여 플라즈마 표시 패널에 적합한 영상 데이터로 변환한다.
〈서브필드 매핑부〉
서브필드 매핑부(720)는 데이터 변환부(710)에 의하여 플라즈마 표시 패널에 적합하게 변환된 영상 데이터에 해당하는 서브필드를 매핑한다.
〈데이터 비교부〉
데이터 비교부(730)는 특정 스캔 라인상에 위치하는 한 개 이상의 셀로 이루어진 셀 묶음의 영상 데이터와 복수 개의 스캔 타입 각각에 따라 상기 셀 묶음의 수직 및 수평 방향으로 위치한 셀 묶음의 영상 데이터와 비교하여 변위 전류의 크기를 계산한다.
이 때, 셀 묶음이라는 것은 한 개 이상의 셀이 묶여 하나의 단위화한 것을 의미한다. 예를 들어, R,G,B에 해당하는 셀이 모여 하나의 픽셀을 이루므로 픽셀은 셀 묶음에 해당한다.
〈스캔 순서 결정부〉
스캔 순서 결정부(740)는 데이터 비교부(730)로부터 입력받은 변위 전류의 크기가 가장 작은 스캔 타입에 따라 스캔 순서를 결정한다.
〈데이터 정렬부〉
데이터 정렬부(750)는 서브필드가 매핑된 영상 데이터를 서브필드 별로 재정렬하고 스캔 순서 결정부(740)의 출력신호에 해당하는 스캔 순서에 따라 재정렬된 영상 데이터를 X전극에 인가한다.
도 9는 도 8에 도시된 데이터 비교부에 포함되는 기본 회로 블록의 구성도이다. 도 9에 도시된 바와 같이, 본 발명의 데이터 비교부(730)에 포함되는 기본 회로 블록은 메모리부(731), 제1 버퍼(buffer)(buf1), 제2 버퍼(buf2), 제1 판단부 내지는 제3 판단부(734-1, 734-2, 734-3), 디코더부(735), 제1 내지는 제3 합산부(736-1, 736-2, 736-3), 제1 내지는 제3 전류 계산부(737-1, 737-2, 737-3) 및 전류 합산부(738)를 포함한다.
ℓ-1 번째 Y전극, 즉 ℓ-1 번째 라인에 해당하는 영상 데이터가 메모리부(731)에 저장되고, ℓ번째 Y전극, 즉 ℓ번째 라인에 해당하는 영상 데이터가 입력된다.
제1 버퍼(buf1)는 ℓ번째 라인에 해당하는 셀 중 q-1 번째 셀의 영상 데이터를 임시 저장한다.
제2 버퍼(buf2)는 메모리부(731)에 저장된 ℓ-1 번째 라인에 해당하는 셀 중 q-1 번째 셀의 영상 데이터를 임시 저장한다.
제1 판단부(734-1)는 배타적 논리합 게이트 소자(exclusive OR gate)를 포함 하여 ℓ 번째 라인의 q 번째 셀의 영상 데이터와 제1 버퍼(buf1)에 저장된 ℓ 번째 라인의 q-1 번째 셀의 영상 데이터를 비교하여 서로 다르면 1을 출력하고 서로 같으면 0을 출력한다.
제2 판단부(734-2)는 배타적 논리합 게이트 소자를 포함하여 ℓ-1 번째 라인의 q 번째 셀의 영상 데이터와 제2 버퍼(buf2)에 저장된 ℓ-1 번째 라인의 q-1 번째 셀의 영상 데이터를 비교하여 서로 다르면 1을 출력하고 서로 같으면 0을 출력한다.
제3 판단부(734-3)는 배타적 논리합 게이트 소자를 포함하여 제1 버퍼(buf1)에 저장된 ℓ 번째 라인의 q-1 번째 셀의 영상 데이터와 제2 버퍼(buf2)에 저장된 ℓ-1 번째 라인의 q-1 번째 셀의 영상 데이터를 비교하여 서로 다르면 1을 출력하고 서로 같으면 0을 출력한다.
도 10은 도 8에 도시된 데이터 비교부의 기본 회로 블록에 포함된 제1 내지는 제3 판단부의 비교 동작을 나타낸 것이다. ①, ② 및 ③ 각각은 제1 판단부(734-1), 제2 판단부(734-2) 및 제3 판단부(734-3)의 동작에 해당하는 것이다.
즉, 본 발명의 데이터 비교부(730)는 제1 판단부(734-1) 내지는 제3 판단부(734-3)를 통하여 하나의 셀의 수평 방향과 수직 방향에 있는 인접 셀의 영상 데이터를 비교하여 그 변화를 판단한다.
디코더(735)는 제1 판단부 내지는 제3 판단부(734-1, 734-2, 734-3) 각각의 출력신호에 해당하는 3비트 신호를 출력한다.
도 11은 본 발명의 데이터 비교부의 기본 회로 블록에 포함된 제1 내지는 제 3 판단부(734-1, 734-2, 734-3)의 출력 신호에 따른 영상 데이터의 패턴 내용을 나타낸 것이다.
즉, 제1 내지는 제3 판단부(734-1, 734-2, 734-3) 각각의 출력 신호가 (0,0,0)이면, 도 3d에 도시된 영상 데이터의 상태와 같다. 따라서, 출력 신호가 (0,0,0)이면, 변위 전류(Id)는 0이다.
제1 내지는 제3 판단부(734-1, 734-2, 734-3) 각각의 출력 신호가 (0,0,1)이면, 도 3b에 도시된 영상 데이터의 상태와 같다. 따라서, 출력 신호가 (0,0,1)이면, 변위 전류(Id)는 Cm2에 비례한다.
제1 내지는 제3 판단부(734-1, 734-2, 734-3) 각각의 출력 신호가 (0,1,0), (0,1,1), (1,0,0) 및 (1,0,1) 중 어느 하나이면, 도 3a에 도시된 영상 데이터의 상태와 같다. 따라서, 출력 신호가 (0,1,0), (0,1,1), (1,0,0) 및 (1,0,1) 중 어느 하나이면, 변위 전류(Id)는 (Cm1+Cm2)에 비례한다.
제1 내지는 제3 판단부(734-1, 734-2, 734-3) 각각의 출력 신호가 (1,1,0)이면, 도 3d에 도시된 영상 데이터의 상태와 같다. 따라서, 출력 신호가 (1,1,0)이면, 변위 전류(Id)는 0이다.
제1 내지는 제3 판단부(734-1, 734-2, 734-3) 각각의 출력 신호가 (1,1,1)이면, 도 3c에 도시된 영상 데이터의 상태와 같다. 따라서, 출력 신호가 (1,1,1)이면, 변위 전류(Id)는 (4Cm1+Cm2)에 비례한다.
제1 합산부 내지는 제3 합산부(736-1, 736-2, 736-3)는 디코더(735)로부터 출력된 특정 3비트 신호의 출력 횟수를 합산하여 출력한다.
즉, 제1 합산부(736-1)는 디코더(735)가 (0,1,0), (0,1,1), (1,0,0) 및 (1,0,1) 중 어느 하나를 출력하는 횟수를 합산(C1)한다. 제2 합산부(736-2)는 디코더(735)가 (0,0,1)를 출력하는 횟수를 합산(C2)한다. 제3 합산부(736-3)는 디코더(735)가 (1,1,1)를 출력하는 횟수를 합산(C3)한다.
제1 내지는 제3 전류 계산부(737-1, 737-2, 737-3) 각각은 제1 합산부(736-1), 제2 합산부(736-2) 및 제3 합산부(736-3)로부터 C1,C2 및 C3를 입력받아 변위 전류의 크기를 계산한다.
전류 합산부(738)는 제1 내지는 제3 전류 계산부(737-1, 737-2, 737-3) 각각으로부터 계산된 변위 전류의 크기를 합산한다.
도 12는 본 발명의 제1 실시예에 따른 데이터 비교부(730)와 스캔 순서 결정부(740)의 블록 구성도이다. 도 12에 도시된 바와 같이, 본 발명의 제1 실시예에 따른 데이터 비교부(730)는 도 10에 도시된 기본 회로 블록 4개가 연결되어 있는 구조이고, 스캔 순서 결정부(740)는 4개의 기본 회로 블록의 출력을 비교하여 가장 작은 변위 전류를 발생하는 스캔 순서를 결정한다.
데이터 비교부(730)는 제1 내지는 제4 메모리부(901,903,905,907) 및 제1 전류 판별부 내지는 제4 전류 판별부(910,930,950,970)를 포함한다. 즉, 하나의 메모리부와 하나의 전류 판별부가 도 9에 도시된 기본 회로 블록을 형성한다.
제1 내지는 제4 메모리부(901,903,905,907)는 서로 직렬 연결되어 있어서 4개의 라인에 해당하는 영상 데이터가 저장된다. 즉, 제1 메모리부(901)는 ℓ-4 번째 라인에 해당하는 영상 데이터를, 제2 메모리부(903)는 ℓ-3 번째 라인에 해당하 는 영상 데이터를, 제3 메모리부(905)는 ℓ-2 번째 라인에 해당하는 영상 데이터를, 제4 메모리부(907)는 ℓ-1 번째 라인에 해당하는 영상 데이터를 저장한다.
제1 전류 판별부(910)는 ℓ 번째 라인의 영상 데이터와 제1 메모리부(901)에 저장된 ℓ-4 번째 라인의 영상 데이터를 입력받는다. 이와 같은 영상 데이터를 입력받은 제1 전류 판별부(910)의 전류 크기 계산이 제2 내지는 제4 전류 판별부(930,950,970)의 전류 크기보다 작다면 스캔 순서는 도 7의 제4 스캔 타입(Type 4)과 같다. 즉, Y1-Y5-Y9-……, Y2-Y6-Y10-……, Y3-Y7-Y11-……, Y4-Y8-Y12-…… 순서대로 스캔되어야 한다.
제1 전류 판별부(910)의 동작은 앞서 설명한 기본 회로 블록의 동작과 같다. ℓ-4 번째 라인에 해당하는 영상 데이터가 제1 메모리부(901)에 저장되고, ℓ 번째 라인에 해당하는 영상 데이터가 입력된다.
제1 버퍼(buf1)는 ℓ 번째 라인에 해당하는 셀 중 q-1 번째 셀의 영상 데이터를 임시 저장한다.
제2 버퍼(buf2)는 제1 메모리부(901)에 저장된 ℓ-4 번째 라인에 해당하는 셀 중 q-1 번째 셀의 영상 데이터를 임시 저장한다.
제1 판단부(XOR1)는 배타적 논리합 게이트 소자(exclusive OR gate)를 포함하여 ℓ 번째 라인의 q 번째 셀의 영상 데이터(ℓ, q)와 제1 버퍼(buf1)에 저장된 ℓ 번째 라인의 q-1 번째 셀의 영상 데이터(ℓ, q-1)를 비교하여 서로 다르면 1을 출력하고 서로 같으면 0을 출력한다.
제2 판단부(XOR2)는 배타적 논리합 게이트 소자를 포함하여 ℓ 번째 라인의 q-1 번째 셀의 영상 데이터(ℓ, q-1)와 제2 버퍼(buf2)에 저장된 ℓ-4 번째 라인의 q-1 번째 셀의 영상 데이터(ℓ-4, q-1)를 비교하여 서로 다르면 1을 출력하고 서로 같으면 0을 출력한다.
제3 판단부(XOR3)는 배타적 논리합 게이트 소자를 포함하여 제2 버퍼(buf2)에 저장된 ℓ-4 번째 라인의 q-1 번째 셀의 영상 데이터(ℓ-4,q-1)와 제1 메모리부(901)로부터 출력되는 ℓ-4 번째 라인의 q 번째 셀의 영상 데이터(ℓ-4,q)를 비교하여 서로 다르면 1을 출력하고 서로 같으면 0을 출력한다.
제1 디코더(Dec1)는 제1 판단부 내지는 제3 판단부(XOR1, XOR2, XOR3) 각각의 출력신호를 병렬로 입력받아 3비트 신호를 출력한다.
도 13은 본 발명의 데이터 비교부에 포함된 제1 내지는 제3 판단부(XOR1, XOR2, XOR3)의 출력 신호에 따른 영상 데이터의 패턴 내용을 나타낸 것이다.
즉, 제1 내지는 제3 판단부(XOR1, XOR2, XOR3)의 출력 신호(Value1, Value2, Value3)에 따라 변위 전류의 크기를 결정하는 캐패시턴스의 크기가 달라진다.
제1 합산부 내지는 제3 합산부(Int1, Int2, Int3)는 제1 디코더(Dec1)로부터 출력된 특정 3비트 신호의 출력 횟수를 합산하여 출력한다.
즉, 제1 합산부(Int1)는 제1 디코더(Dec1)가 (0,0,1), (0,1,1), (1,0,0) 및 (1,1,0) 중 어느 하나를 출력하는 횟수를 합산(C1)한다. 제2 합산부(Int2)는 제1 디코더(Dec1)가 (0,1,0)를 출력하는 횟수를 합산(C2)한다. 제3 합산부(Int3)는 제1 디코더((Dec1)가 (1,1,1)를 출력하는 횟수를 합산(C3)한다.
제1 내지는 제3 전류 계산부(Cal1, Cal2, Cal3) 각각은 제1 합산부(Int1), 제2 합산부(Int2) 및 제3 합산부(Int3)로부터 C1,C2 및 C3을 입력받아 변위 전류의 크기를 계산한다.
즉, 제1 전류 계산부(Cal1)는 제1 합산부(Int1)의 출력(C1)과 (Cm1+Cm2)를 곱하여 전류의 크기를 계산한다. 제2 전류 계산부(Cal2)는 제2 합산부(Int2)의 출력(C2)과 Cm2를 곱하여 전류의 크기를 계산한다. 제3 전류 계산부(Cal3)는 제3 합산부(Int3)의 출력(C3)과 (4Cm1+Cm2)를 곱하여 전류의 크기를 계산한다.
제1 전류 합산부(Add1)는 제1 내지는 제3 전류 계산부(Cal1, Cal2, Cal3) 각각으로부터 계산된 변위 전류의 크기를 합산한다.
이와 같은 제1 전류 판별부의 동작과 마찬가지로 제2 내지는 제4 전류 판별부(930,950,970) 또한 동작함으로써 합산된 변위 전류의 크기를 계산한다.
이 때, 제2 전류 판별부(930)의 제1 판단부(XOR1)는 배타적 논리합 게이트 소자(exclusive OR gate)를 포함하여 ℓ 번째 라인의 q 번째 셀의 영상 데이터(ℓ, q)와 제1 버퍼(buf1)에 저장된 ℓ 번째 라인의 q-1 번째 셀의 영상 데이터(ℓ, q-1)를 비교하여 서로 다르면 1을 출력하고 서로 같으면 0을 출력한다.
제2 전류 판별부(930)의 제2 판단부(XOR2)는 배타적 논리합 게이트 소자를 포함하여 ℓ 번째 라인의 q-1 번째 셀의 영상 데이터(ℓ, q-1)와 제2 버퍼(buf2)에 저장된 ℓ-3 번째 라인의 q-1 번째 셀의 영상 데이터(ℓ-3, q-1)를 비교하여 서로 다르면 1을 출력하고 서로 같으면 0을 출력한다.
제2 전류 판별부(930)의 제3 판단부(XOR3)는 배타적 논리합 게이트 소자를 포함하여 제2 버퍼(buf2)에 저장된 ℓ-3 번째 라인의 q-1 번째 셀의 영상 데이터( ℓ-3, q-1)와 제2 메모리부(903)로부터 출력되는 ℓ-3 번째 라인의 q 번째 셀의 영상 데이터(ℓ-3, q)를 비교하여 서로 다르면 1을 출력하고 서로 같으면 0을 출력한다.
또한, 제3 전류 판별부(950)의 제1 판단부(XOR1)는 배타적 논리합 게이트 소자(exclusive OR gate)를 포함하여 ℓ 번째 라인의 q 번째 셀의 영상 데이터(ℓ, q)와 제1 버퍼(buf1)에 저장된 ℓ 번째 라인의 q-1 번째 셀의 영상 데이터(ℓ, q-1)를 비교하여 서로 다르면 1을 출력하고 서로 같으면 0을 출력한다.
제3 전류 판별부(950)의 제2 판단부(XOR2)는 배타적 논리합 게이트 소자를 포함하여 ℓ 번째 라인의 q-1 번째 셀의 영상 데이터(ℓ, q-1)와 제2 버퍼(buf2)에 저장된 ℓ-2 번째 라인의 q-1 번째 셀의 영상 데이터(ℓ-2, q-1)를 비교하여 서로 다르면 1을 출력하고 서로 같으면 0을 출력한다.
제3 전류 판별부(950)의 제3 판단부(XOR3)는 배타적 논리합 게이트 소자를 포함하여 제2 버퍼(buf2)에 저장된 ℓ-2 번째 라인의 q-1 번째 셀의 영상 데이터(ℓ-2, q-1)와 제3 메모리부(905)로부터 출력되는 ℓ-2 번째 라인의 q 번째 셀의 영상 데이터(ℓ-2, q)를 비교하여 서로 다르면 1을 출력하고 서로 같으면 0을 출력한다.
마지막으로 제4 전류 판별부(970)의 제1 판단부(XOR1)는 배타적 논리합 게이트 소자(exclusive OR gate)를 포함하여 ℓ 번째 라인의 q 번째 셀의 영상 데이터(ℓ, q)와 제1 버퍼(buf1)에 저장된 ℓ 번째 라인의 q-1 번째 셀의 영상 데이터(ℓ, q-1)를 비교하여 서로 다르면 1을 출력하고 서로 같으면 0을 출력한다.
제4 전류 판별부(970)의 제2 판단부(XOR2)는 배타적 논리합 게이트 소자를 포함하여 ℓ 번째 라인의 q-1 번째 셀의 영상 데이터(ℓ, q-1)와 제2 버퍼(buf2)에 저장된 ℓ-1 번째 라인의 q-1 번째 셀의 영상 데이터(ℓ-1, q-1)를 비교하여 서로 다르면 1을 출력하고 서로 같으면 0을 출력한다.
제4 전류 판별부(970)의 제3 판단부(XOR3)는 배타적 논리합 게이트 소자를 포함하여 제2 버퍼(buf2)에 저장된 ℓ-1 번째 라인의 q-1 번째 셀의 영상 데이터(ℓ-1, q-1)와 제4 메모리부(907)로부터 출력되는 ℓ-1 번째 라인의 q 번째 셀의 영상 데이터(ℓ-1, q)를 비교하여 서로 다르면 1을 출력하고 서로 같으면 0을 출력한다.
스캔 순서 결정부(740)는 제1 내지는 제4 전류 판별부(910,930,950,970) 각각이 계산한 변위 전류의 크기를 입력받아 그 중 가장 작은 변위 전류를 출력한 전류 판별부에 따라 스캔 순서를 결정한다.
예를 들어, 스캔 순서 결정부(740)가 제2 전류 판별부(930)로부터 입력받은 변위 전류의 크기가 가장 작다고 판단하면, 스캔 순서 결정부(740)는 스캔 순서를 도 7의 제3 스캔 타입(Type 3)과 같이 Y1-Y4-Y7-……, Y2-Y5-Y8-……, Y3-Y6-Y9-…… 순으로 스캔하도록 한다.
또한, 스캔 순서 결정부(740)가 제3 전류 판별부(950)로부터 입력받은 변위 전류의 크기가 가장 작다고 판단하면, 스캔 순서 결정부(740)는 스캔 순서를 도 7의 제2 스캔 타입(Type 2)과 같이 Y1-Y3-Y5-……, Y2-Y4-Y6-…… 순으로 스캔하도록 한다.
마지막으로 스캔 순서 결정부(740)가 제4 전류 판별부(970)로부터 입력받은 변위 전류의 크기가 가장 작다고 판단하면, 스캔 순서 결정부(740)는 스캔 순서를 도 7의 제1 스캔 타입(Type 1)과 같이 Y1-Y2-Y3-Y4-Y5-Y6-…… 순으로 스캔하도록 한다.
이 때, 그룹화된 스캔 라인들은 순차적으로 스캔된다.
도 14는 본 발명의 제2 실시예에 따른 데이터 비교부에 포함된 기본 회로 블록의 구성도이다. 도 14의 기본 회로 블록은 ℓ 번째 스캔 라인상에 q 번째 픽셀과 q-1 번째 픽셀의 R,G,B 서브픽셀(sub pixel)에 해당하는 영상 데이터의 변화, ℓ-1 번째 스캔 라인상에 q 번째 픽셀과 q-1 번째 픽셀의 R,G,B 서브픽셀에 해당하는 영상 데이터의 변화 및 ℓ 번째 스캔 라인상의 q 번째 픽셀과 ℓ-1 번째 스캔 라인상의 q-1 번째 픽셀의 R,G,B 서브픽셀에 해당하는 영상 데이터의 변화를 통하여 변위 전류의 크기를 계산한다.
제1 메모리부 내지는 제3 메모리부(Memory1, Memory2, Memory3)는 각각 ℓ-1 번째 라인의 R 서브픽셀에 해당하는 영상 데이터, G 서브픽셀에 해당하는 영상 데이터 및 B 서브픽셀에 해당하는 영상 데이터를 임시로 저장한다.
제1 판단부 내지는 제3 판단부(XOR1, XOR2, XOR3)는 ℓ 번째 스캔 라인상의 q 번째 픽셀의 R,G,B 서브픽셀에 해당하는 영상 데이터 간의 변화를 판단한다.
즉, 제1 판단부(XOR1)는 ℓ 번째 스캔 라인상의 q 번째 픽셀의 R 서브픽셀에 해당하는 영상 데이터(ℓ, qR)와 ℓ 번째 스캔 라인상의 q 번째 픽셀의 G 서브픽셀에 해당하는 영상 데이터(ℓ, qG)를 비교하여 같으면 논리값 1을 출력하고 다르면 논리값 0을 출력한다.
제2 판단부(XOR2)는 ℓ 번째 스캔 라인상의 q 번째 픽셀의 G 서브픽셀에 해당하는 영상 데이터(ℓ, qG)와 ℓ 번째 스캔 라인상의 q 번째 픽셀의 B 서브픽셀에 해당하는 영상 데이터(ℓ, qB)를 비교하여 같으면 논리값 1을 출력하고 다르면 논리값 0을 출력한다.
제3 판단부(XOR3)는 ℓ 번째 스캔 라인상의 q 번째 픽셀의 B 서브픽셀에 해당하는 영상 데이터(ℓ, qB)와 ℓ 번째 스캔 라인상의 q-1 번째 픽셀의 R 서브픽셀에 해당하는 영상 데이터(ℓ, q-1R)를 비교하여 같으면 논리값 1을 출력하고 다르면 논리값 0을 출력한다.
제4 판단부 내지는 제6 판단부(XOR4, XOR5, XOR6)는 ℓ-1 번째 스캔 라인상의 q 번째 픽셀의 R,G,B 서브픽셀에 해당하는 영상 데이터 간의 변화를 판단한다.
즉, 제4 판단부(XOR4)는 ℓ-1 번째 스캔 라인상의 q 번째 픽셀의 R 서브픽셀에 해당하는 영상 데이터(ℓ-1, qR)와 ℓ-1 번째 스캔 라인상의 q 번째 픽셀의 G 서브픽셀에 해당하는 영상 데이터(ℓ-1, qG)를 비교하여 같으면 논리값 1을 출력하고 다르면 논리값 0을 출력한다.
제5 판단부(XOR5)는 ℓ-1 번째 스캔 라인상의 q 번째 픽셀의 G 서브픽셀에 해당하는 영상 데이터(ℓ-1, qG)와 ℓ-1 번째 스캔 라인상의 q 번째 픽셀의 B 서브픽셀에 해당하는 영상 데이터(ℓ-1, qB)를 비교하여 같으면 논리값 1을 출력하고 다르면 논리값 0을 출력한다.
제6 판단부(XOR6)는 ℓ-1 번째 스캔 라인상의 q 번째 픽셀의 B 서브픽셀에 해당하는 영상 데이터(ℓ-1, qB)와 ℓ-1 번째 스캔 라인상의 q-1 번째 픽셀의 R 서브픽셀에 해당하는 영상 데이터(ℓ-1, q-1R)를 비교하여 같으면 논리값 1을 출력하고 다르면 논리값 0을 출력한다.
제7 판단부 내지는 제9 판단부(XOR7, XOR8, XOR9)는 ℓ 번째 스캔 라인상의 q 번째 픽셀의 R,G,B 서브픽셀에 해당하는 영상 데이터 각각과 ℓ-1 번째 스캔 라인상의 q 번째 픽셀의 R,G,B 서브픽셀에 해당하는 영상 데이터 각각을 비교하여 영상 데이터 간의 변화를 판단한다.
즉, 제7 판단부(XOR7)는 ℓ 번째 스캔 라인상의 q 번째 픽셀의 R 서브픽셀에 해당하는 영상 데이터(ℓ, qR)와 ℓ-1 번째 스캔 라인상의 q 번째 픽셀의 R 서브픽셀에 해당하는 영상 데이터(ℓ-1, qR)를 비교하여 같으면 논리값 1을 출력하고 다르면 논리값 0을 출력한다.
제8 판단부(XOR8)는 ℓ 번째 스캔 라인상의 q 번째 픽셀의 G 서브픽셀에 해당하는 영상 데이터(ℓ, qG)와 ℓ-1 번째 스캔 라인상의 q 번째 픽셀의 G 서브픽셀에 해당하는 영상 데이터(ℓ-1, qG)를 비교하여 같으면 논리값 1을 출력하고 다르면 논리값 0을 출력한다.
제9 판단부(XOR9)는 ℓ 번째 스캔 라인상의 q 번째 픽셀의 B 서브픽셀에 해당하는 영상 데이터(ℓ, qB)와 ℓ-1 번째 스캔 라인상의 q 번째 픽셀의 B 서브픽셀에 해당하는 영상 데이터(ℓ-1, qB)를 비교하여 같으면 논리값 1을 출력하고 다르면 논리값 0을 출력한다.
디코더(Dec)는 제1 내지는 제3 판단부(XOR1, XOR2, XOR3) 각각의 출력신호 (Value1, Value2, Value3), 제4 내지는 제6 판단부(XOR4, XOR5, XOR6) 각각의 출력신호(Value4, Value5, Value6) 및 제7 내지는 제9 판단부(XOR7, XOR8, XOR9) 각각의 출력신호(Value7, Value8, Value9)에 해당하는 3비트의 신호를 출력한다.
도 15는 본 발명의 제2 실시예에 따른 기본 회로 블록에 포함된 제1 내지는 제9 판단부(XOR1 ~XOR9)의 출력 신호에 따른 영상 데이터의 패턴 내용을 나타낸 것이다.
제1 합산부 내지는 제3 합산부(Int1, Int2, Int3) 각각은 디코더(Dec)로부터 제1 내지는 제3 판단부(XOR1, XOR2, XOR3)의 출력신호(Value1, Value2, Value3)에 해당하는 3비트 신호의 출력 횟수를 합산(C1, C2, C3)하여 출력한다.
제4 합산부 내지는 제6 합산부(Int4, Int5, Int6) 각각은 디코더(Dec)로부터 제4 내지는 제6 판단부(XOR4, XOR5, XOR6)의 출력신호(Value4, Value5, Value6)에 해당하는 3비트 신호의 출력 횟수를 합산(C4, C5, C6)하여 출력한다.
제7 합산부 내지는 제9 합산부(Int7, Int8, Int9) 각각은 디코더(Dec)로부터 제7 내지는 제9 판단부(XOR7, XOR8, XOR9)의 출력신호(Value7, Value8, Value9)에 해당하는 3비트 신호의 출력 횟수를 합산(C7, C8, C9)하여 출력한다.
제1 전류 계산부 내지는 제3 전류 계산부(Cal1, Cal2, Cal3) 각각은 제1 합산부(Int1), 제2 합산부(Int2) 및 제3 합산부(Int3)로부터 C1,C2 및 C3을 입력받아 변위 전류의 크기를 계산한다.
제4 전류 계산부 내지는 제6 전류 계산부(Cal4, Cal5, Cal6) 각각은 제4 합산부(Int4), 제5 합산부(Int5) 및 제6 합산부(Int6)로부터 C4,C5 및 C6을 입력받아 변위 전류의 크기를 계산한다.
제7 전류 계산부 내지는 제9 전류 계산부(Cal7, Cal8, Cal9) 각각은 제7 합산부(Int7), 제8 합산부(Int8) 및 제9 합산부(Int9)로부터 C7,C8 및 C9를 입력받아 변위 전류의 크기를 계산한다.
제1 전류 합산부(Add1)는 제1 내지는 제3 전류 계산부(Cal1, Cal2, Cal3) 각각으로부터 계산된 변위 전류의 크기를 합산한다.
제2 전류 합산부(Add2)는 제4 내지는 제6 전류 계산부(Cal4, Cal5, Cal6) 각각으로부터 계산된 변위 전류의 크기를 합산한다.
제3 전류 합산부(Add3)는 제7 내지는 제9 전류 계산부(Cal7, Cal8, Cal9) 각각으로부터 계산된 변위 전류의 크기를 합산한다.
이와 같이 하여 서브픽셀에 해당하는 영상 데이터의 변화에 대한 변위 전류의 크기를 계산할 수 있다.
도 16은 본 발명의 제2 실시예에 따른 데이터 비교부와 스캔 순서 결정부의 블록 구성도이다. 도 16에 도시된 바와 같이 본 발명의 제2 실시예에 따른 데이터 비교부(730)는 도 14에 도시된 기본 회로 블록 4개, 즉 제1 전류 판별부 내지는 제4 전류 판별부(910', 920', 930', 940')가 연결되어 있는 구조이고, 스캔 순서 결정부(740)는 4개의 기본 회로 블록의 출력을 비교하여 가장 작은 변위 전류를 발생하는 스캔 순서를 결정한다.
이 때, 제1 전류 판별부(910')는 영상 데이터(ℓ, qR)와 영상 데이터(ℓ, qG), 영상 데이터(ℓ, qG)와 영상 데이터(ℓ, qB), 영상 데이터(ℓ, qB)와 영상 데 이터(ℓ, q-4R), 영상 데이터(ℓ-4, qR)와 영상 데이터(ℓ-4, qG), 영상 데이터(ℓ-4, qG)와 영상 데이터(ℓ-4, qB), 영상 데이터(ℓ-4, qB)와 (ℓ-4, q-1R), 영상 데이터(ℓ, qR)와 영상 데이터(ℓ-4, qR), 영상 데이터(ℓ, qG)와 (ℓ-4, qG) 및 영상 데이터(ℓ, qB)와 영상 데이터(ℓ-4, qB) 각각을 비교한다.
이 때, ℓ과 ℓ-4은 ℓ 번째 스캔 라인과 ℓ-4 번째 스캔 라인을 의미한다. qR, qG 및 qB는 q 번째 픽셀의 R,G,B 서브픽셀 각각을 의미한다. q-1R, q-1G 및 q-1B는 q-1 번째 픽셀의 R,G,B 서브픽셀 각각을 의미한다.
따라서, 제1 전류 판별부(910')는 상기와 같은 영상 데이터를 비교하여 변위 전류의 크기를 계산한다.
제2 전류 판별부(920')는 영상 데이터(ℓ, qR)와 영상 데이터(ℓ, qG), 영상 데이터(ℓ, qG)와 영상 데이터(ℓ, qB), 영상 데이터(ℓ, qB)와 영상 데이터(ℓ, q-1R), 영상 데이터(ℓ-3, qR)와 영상 데이터(ℓ-3, qG), 영상 데이터(ℓ-3, qG)와 영상 데이터(ℓ-3, qB), 영상 데이터(ℓ-3, qB)와 (ℓ-3, q-1R), 영상 데이터(ℓ, qR)와 영상 데이터(ℓ-3, qR), 영상 데이터(ℓ, qG)와 (ℓ-3, qG) 및 영상 데이터(ℓ, qB)와 영상 데이터(ℓ-3, qB) 각각을 비교한다. 이 때, ℓ과 ℓ-3은 ℓ 번째 스캔 라인과 ℓ-3 번째 스캔 라인을 의미한다.
따라서, 제2 전류 판별부(920')는 상기와 같은 영상 데이터를 비교하여 변위 전류의 크기를 계산한다.
제3 전류 판별부(930')는 영상 데이터(ℓ, qR)와 영상 데이터(ℓ, qG), 영상 데이터(ℓ, qG)와 영상 데이터(ℓ, qB), 영상 데이터(ℓ, qB)와 영상 데이터(ℓ, q-1R), 영상 데이터(ℓ-2, qR)와 영상 데이터(ℓ-2, qG), 영상 데이터(ℓ-2, qG)와 영상 데이터(ℓ-2, qB), 영상 데이터(ℓ-2, qB)와 (ℓ-2, q-1R), 영상 데이터(ℓ, qR)와 영상 데이터(ℓ-2, qR), 영상 데이터(ℓ, qG)와 (ℓ-2, qG) 및 영상 데이터(ℓ, qB)와 영상 데이터(ℓ-2, qB) 각각을 비교한다. 이 때, ℓ과 ℓ-2은 ℓ 번째 스캔 라인과 ℓ-2 번째 스캔 라인을 의미한다.
따라서, 제3 전류 판별부(930')는 상기와 같은 영상 데이터를 비교하여 변위 전류의 크기를 계산한다.
제4 전류 판별부(940')는 영상 데이터(ℓ, qR)와 영상 데이터(ℓ, qG), 영상 데이터(ℓ, qG)와 영상 데이터(ℓ, qB), 영상 데이터(ℓ, qB)와 영상 데이터(ℓ, q-1R), 영상 데이터(ℓ-1, qR)와 영상 데이터(ℓ-1, qG), 영상 데이터(ℓ-1, qG)와 영상 데이터(ℓ-1, qB), 영상 데이터(ℓ-1, qB)와 (ℓ-1, q-1R), 영상 데이터(ℓ, qR)와 영상 데이터(ℓ-1, qR), 영상 데이터(ℓ, qG)와 (ℓ-1, qG) 및 영상 데이터(ℓ, qB)와 영상 데이터(ℓ-1, qB) 각각을 비교한다. 이 때, ℓ과 ℓ-1은 ℓ 번째 스캔 라인과 ℓ-1 번째 스캔 라인을 의미한다.
따라서, 제4 전류 판별부(940')는 상기와 같은 영상 데이터를 비교하여 변위 전류의 크기를 계산한다.
스캔 순서 결정부(740)는 제1 내지는 제4 전류 판별부(910',930',950',970') 각각이 계산한 변위 전류의 크기를 입력받아 그 중 가장 작은 변위 전류를 출력한 전류 판별부에 따라 스캔 순서를 결정한다.
예를 들어, 스캔 순서 결정부(740)가 제2 전류 판별부(930')로부터 입력받은 변위 전류의 크기가 가장 작다고 판단하면, 스캔 순서 결정부(740)는 스캔 순서를 도 7의 제3 스캔 타입(Type 3)과 같이 Y1-Y4-Y7-……, Y2-Y5-Y8-……, Y3-Y6-Y9-…… 순으로 스캔하도록 한다.
또한, 스캔 순서 결정부(740)가 제3 전류 판별부(950')로부터 입력받은 변위 전류의 크기가 가장 작다고 판단하면, 스캔 순서 결정부(740)는 스캔 순서를 도 6의 제2 스캔 타입(Type 2)과 같이 Y1-Y3-Y5-……, Y2-Y4-Y6-…… 순으로 스캔하도록 한다.
도 17은 본 발명에 따른 데이터 비교부와 스캔 순서 결정부가 각 서브필드 별로 적용되는 실시예의 블록 구성도이다.
즉, SF1용 데이터 비교부 내지는 SF16용 데이터 비교부(730-SF1 내지는 730-SF16) 각각은 해당 서브필드에서의 영상 패턴에 따른 변위 전류의 크기를 계산하여 임시 저장부(800)에 저장한다.
각 서브필드용 데이터 비교부(730-SF1 내지는 730-SF16)는 도 12에 도시된 데이터 비교부의 블록 구성과 동일하며 각 서브필드에서의 영상 데이터의 패턴에 따른 변위 전류의 크기를 임시 저장부(800)에 저장한다.
스캔 순서 결정부(740)는 임시 저장부(800)로부터 입력된 각 서브필드별 영상 데이터의 패턴에 따른 변위 전류의 크기를 비교하여 변위 전류가 가장 작은 영상 데이터의 패턴을 파악하여 스캔 순서를 각 서브 필드마다 결정한다.
이와 같이 본 발명에 따른 플라즈마 표시 패널의 구동 장치 및 구동 방법은 복수 개의 스캔 타입 각각에 해당하는 라인들 사이의 변위 전류를 계산하고 변위 전류의 크기가 가장 작은 스캔 타입에 해당하는 라인들을 순차적으로 스캔하는 것을 특징으로 한다.
즉, 도 7에는 각각의 스캔 타입이 일정 개수만큼 규칙적으로 떨어진 라인들 사이의 변위 전류를 계산하여 가장 변위 전류가 작은 스캔 타입을 선택하는 것이지만 불규칙적으로 혹은 임의의 규칙에 따라 떨어진 라인들 사이의 변위 전류를 계산하여 가장 변위 전류가 작은 스캔 타입을 선택할 수 있는 것은 물론이다.
이와 같이, 본 발명이 속하는 기술분야의 당업자는 본 발명이 그 기술적 사상이나 필수적 특징을 변경하지 않고서 다른 구체적인 형태로 실시될 수 있다는 것을 이해할 수 있을 것이다. 그러므로 이상에서 기술한 실시예들은 모든 면에서 예시적인 것이며 한정적인 것이 아닌 것으로서 이해해야만 한다.
본 발명의 범위는 상기 상세한 설명보다는 후술하는 특허청구범위에 의하여 나타내어지며, 특허청구범위의 의미 및 범위 그리고 그 등가개념으로부터 도출되는 모든 변경 또는 변형된 형태가 본 발명의 범위에 포함되는 것으로 해석되어야 한다.
이상에서와 같이 본 발명은 영상 데이터에 따라 변위 전류를 계산하고 변위 전류가 가장 작은 영상 데이터의 패턴을 결정한 후 스캔 순서를 결정함으로써 데이터 드라이버 IC의 파손이나 오동작을 막을 수 있다.

Claims (16)

  1. 복수의 스캔 전극과, 상기 스캔 전극과 교차배치되는 복수의 어드레스 전극과, 상기 스캔 전극과 상기 어드레스 전극의 교차 위치에 방전 셀이 형성되는 플라즈마 표시 장치에 있어서,
    입력된 영상 데이터에 대하여, 복수의 스캔타입별로 임의의 셀과 상기 셀 근방의 셀의 영상데이터를 비교하는 데이터 비교부와;
    상기 데이터 비교부의 결과에 기초하여 상기 복수의 스캔타입 중 하나의 스캔타입에 따라 스캔순서를 결정하는 스캔순서 결정부를 포함하는 플라즈마 표시장치.
  2. 제1항에 있어서,
    상기 데이터 비교부는,
    상기 임의의 셀의 영상 데이터와 상기 임의의 셀의 수평 방향에 위치한 셀의 영상 데이터를 비교하고,
    상기 임의의 셀의 영상 데이터와 상기 셀과 수직 방향 상에 위치하는 셀의 영상 데이터와 비교하고,
    상기 수직 방향 상에 위치하는 셀은 상기 임의의 셀이 포함된 스캔라인과 상기 복수 개의 스캔 타입 각각에 따라 소정 개수의 스캔 라인만큼 떨어진 스캔 라인 상에 위치하는 것을 특징으로 하는 플라즈마 표시장치.
  3. 제1항에 있어서,
    상기 스캔 순서 결정부는,
    상기 복수 개의 스캔 타입 각각에 해당하는 라인들 사이의 영상 데이터를 비교하고 영상 데이터의 변화량이 가장 작은 스캔 타입에 해당하는 라인들을 순차적으로 스캔하는 것을 특징으로 하는 플라즈마 표시장치.
  4. 제2항에 있어서,
    상기 데이터 비교부는,
    ℓ 번째 스캔 라인 상의 q 번째 셀(ℓ, q)의 영상 데이터와 ℓ 번째 스캔 라인 상의 q-1 번째 셀(ℓ, q-1)의 영상 데이터를 비교하고,
    상기 ℓ 번째 스캔 라인 상의 q-1 번째 셀(ℓ, q-1)의 영상 데이터와 상기 스캔 타입에 따라 ℓ-x(x는 ℓ보다 작은 자연수) 번째 스캔 라인 상의 q-1 번째 셀(ℓ-x, q-1)의 영상 데이터를 비교하고,
    상기 ℓ-x 번째 스캔 라인 상의 q-1 번째 셀(ℓ-x, q-1)의 영상 데이터와 ℓ-x 번째 스캔 라인 상의 q 번째 셀(ℓ-x, q)의 영상 데이터를 비교하며,
    상기 셀(ℓ, q)의 영상 데이터와 상기 셀(ℓ, q-1)의 영상 데이터의 비교 결과를 Value1이라 하고, 상기 셀(ℓ, q-1)의 영상 데이터와 상기 셀(ℓ-x, q-1)의 영상 데이터의 비교 결과를 Value2라 하고, 상기 셀(ℓ-x, q-1)의 영상 데이터와 상기 셀(ℓ-x, q)의 영상 데이터의 비교 결과를 Value3 이라 할 때,
    상기 Value1, 상기 Value2, 상기 Value3의 조합에 따라 변위 전류의 크기가 다음 표에 기재된 캐패시턴스에 비례하는 것을 특징으로 하는 플라즈마 표시장치.
    Value1 Value2 Value3 0 0 0 0 0 1 0 Cm2 0 0 1 Cm1+Cm2 0 1 1 Cm1+Cm2 1 0 0 Cm1+Cm2 1 1 0 Cm1+Cm2 1 0 1 0 1 1 1 4Cm1+Cm2
    (0: 영상 데이터의 비교 결과가 동일할 경우, 1: 영상 데이터의 비교 결과가 동일하지 않는 경우, Cm1: X전극 사이에 존재하는 등가 캐패시턴스, Cm2: X전극과 Y전극 또는 X전극과 Z전극에 존재하는 등가 캐패시턴스)
  5. 제1항에 있어서,
    상기 셀은 2개이상의 셀을 포함하는 것을 특징으로 하는 플라즈마 표시장치.
  6. 제1항에 있어서,
    상기 데이터 비교부와 상기 스캔 순서 결정부의 동작이 서브필드 마다 이루어지는 것을 특징으로 하는 플라즈마 표시장치.
  7. 복수의 스캔 전극과, 상기 스캔 전극과 교차배치되는 복수의 어드레스 전극과, 상기 스캔 전극과 상기 어드레스 전극의 교차 위치에 방전 셀이 형성되는 플라즈마 표시 장치의 구동방법에 있어서,
    입력된 영상 데이터에 대하여 복수의 스캔타입별로 임의의 셀과 상기 셀 근방의 영상 데이터를 비교하는 단계;
    상기 데이터 비교부의 결과에 기초하여 상기 복수의 스캔타입 중 하나의 스캔타입에 따라 스캔순서를 결정하는 단계를 포함하는 플라즈마 표시장치의 구동방법.
  8. 제7항에 있어서,
    상기 영상 데이터를 비교하는 단계는,
    상기 임의의 셀의 영상 데이터와 상기 임의의 셀의 수평 방향에 위치한 셀의 영상 데이터를 비교하는 단계,
    상기 임의의 셀의 영상 데이터와 상기 셀과 수직 방향 상에 위치하는 셀의 영상 데이터와 비교하는 단계를 포함하고,
    상기 수직 방향 상에 위치하는 셀은 상기 임의의 셀이 포함된 스캔라인과 상기 복수 개의 스캔 타입 각각에 따라 소정 개수의 스캔 라인만큼 떨어진 스캔 라인 상에 위치하는 것을 특징으로 하는 플라즈마 표시장치의 구동방법.
  9. 제7항에 있어서,
    상기 스캔 순서를 결정하는 단계는,
    상기 복수 개의 스캔 타입 각각에 해당하는 라인들 사이의 영상 데이터를 비교하고 영상 데이터의 변화량이 가장 작은 스캔 타입에 해당하는 라인들을 순차적으로 스캔하는 것을 특징으로 하는 플라즈마 표시장치의 구동방법.
  10. 제7항에 있어서,
    상기 셀은 2개이상의 셀을 포함하는 것을 특징으로 하는 플라즈마 표시장치의 구동방법.
  11. 제7항에 있어서,
    상기 영상 데이터를 비교하는 단계와 스캔순서를 결정하는 단계는 매 서브필드 마다 이루어지는 것을 특징으로 하는 플라즈마 표시장치의 구동방법.
  12. 제1항에 있어서,
    상기 데이터 비교부는 상기 셀의 행방향 또는 열방향 중 적어도 하나의 방향으로 위치한 셀간의 영상 데이터를 비교하는 것을 특징으로 하는 플라즈마 표시장치.
  13. 제1항에 있어서,
    상기 데이터 비교부는 상기 셀의 열 방향으로 위치한 셀간의 영상 데이터를 비교하여 데이터 변화량을 측정하는 것을 특징으로 하는 플라즈마 표시장치.
  14. 제13항에 있어서,
    상기 데이터 변화량은 임의의 데이터 라인으로 데이터 전압을 인가하는 스위치의 스위칭 횟수인 것을 특징으로 하는 플라즈마 표시장치.
  15. 제1항에 있어서,
    상기 상기 복수의 스캔타입은 미리 설정된 것을 특징으로 하는 플라즈마 표시장치.
  16. 복수의 스캔 전극과, 상기 스캔 전극과 교차배치되는 복수의 어드레스 전극과, 상기 스캔 전극과 상기 어드레스 전극의 교차 위치에 방전 셀이 형성되는 플라즈마 표시장치를 복수의 서브필드로 분할하여 구동하는 플라즈마 표시장치의 구동방법에 있어서,
    제 1서브필드에서는 제 1스캔타입으로 상기 스캔전극에 스캔펄스를 인가하는 단계;
    제 2서브필드에서는 제 2스캔타입으로 상기 스캔전극에 스캔펄스를 인가하는 단계;를 포함하며
    상기 제 1서브필드에서 제 1스캔타입으로 상기 스캔전극에 인가되는 스캔펄스에 대응하여 특정 데이터전극으로 데이터전압을 인가하는 스위치의 제 1스위칭 횟수보다 상기 제 1서브필드에서 제 2스캔타입으로 상기 스캔전극에 인가되는 스캔펄스에 대응하여 상기 특정 데이터전극으로 데이터전압을 인가하는 스위치의 제 2스위칭가 많으며,
    상기 제 2서브필드에서 제 1스캔타입으로 상기 스캔전극에 인가되는 스캔펄스에 대응하여 상기 특정 데이터전극으로 데이터전압을 인가하는 스위치의 제 3스위칭 횟수보다 상기 제 2서브필드에서 제 2스캔타입으로 상기 스캔전극에 인가되는 스캔펄스에 대응하여 상기 특정 데이터전극으로 데이터전압을 인가하는 스위치의 제 4스위칭 횟수가 작은 것을 특징으로 하는 플라즈마 표시장치의 구동방법.
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