KR100408761B1 - 사각 단면을 가지는 (100) 방향 비소화갈륨 빔 제조 방법 - Google Patents

사각 단면을 가지는 (100) 방향 비소화갈륨 빔 제조 방법 Download PDF

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Abstract

본 발명은, 사각 단면을 가지는 <100> 방향 GaAs 빔 제조 방법에 관한 것으로서, (001) GaAs 기판을 이용하여, <100> 방향 경계선을 가지는 식각 마스크를 패터닝하는 단계(a); 습식 식각 또는 건식 식각을 수행하여 구조물의 벽면에 수직하게 단차진 구조를 생성하는 단계(b); 상기 단계(b)에서 제작된 구조물의 벽면 보호막을 생성하는 단계(c); 및 상기 단계(c)에서 벽면 보호막이 생성된 구조물을 습식 식각을 통하여 <100> 방향 빔을 부유시키는 단계(d)를 포함하는 것을 특징으로 한다. 본 발명에 의한 방법에 의하면, 초기 식각마스크 패턴의 폭, 식각 공정에서의 식각 깊이 등을 조정하여, 제조되는 사각 단면을 가지는 <100> 방향 GaAs 빔의 수치를 조절할 수 있으므로, 몸체미세가공 기술을 이용하여 제작할 수 있는 GaAs의 구조물의 적용 범위를 넓힐 수 있는 효과가 있다. 특별히, 본 발명에 의한 방법에 의하면, GaAs 미세 구조물의 기본이 되는 외팔보 및 양단지지보를 구성할 수 있는 장점이 있다.

Description

사각 단면을 가지는 (100) 방향 비소화갈륨 빔 제조 방법{Fabrication Method for (100) directional GaAs beam with rectangular cross-section}
본 발명은, 반도체 공정에 관한 것으로서, 구체적으로는 GaAs 기판의 습식 식각 특성을 이용하여, 사각 단면을 가지는 <100> 방향 GaAs 빔 제조 방법에 관한 것이다.
GaAs는 빠른 전자 이동 속도, 준부도체 상태의 높은 저항도, 넓은 직접 천이, 우수한 열적 안정성 등 실리콘에 비하여 독특한 장점을 가진다. GaAs 반도체는 빠른 전자 이동 속도의 특성으로 인하여 수십 GHz 영역의 고주파 대역에서 동작하는 고속 집적회로의 제작에 이용되고 있다. 또한, GaAs는 넓은 직접 천이 특성이있어서 가시 광선 영역에서의 발광원 및 수광원으로 쓰이는 레이저다이오드, 포토다이오드 및 LED 등의 광소자로 쓰이고 있다.
최근 MMIC(Monolithic Microwave Integrated Circuit, 단일칩 고주파 집적회로)의 성능을 향상시키기 위하여 MEMS(Micro Electro Mechanical System) 기술을 적용하려는 시도가 진행되고 있으며, RF MEMS 라는 분야로 발전되고 있다. 그러나, 아직은 그 범위가 실리콘에 한정되어 있어서, MMIC의 기판이 되는 GaAs와 집적화 시킬 수 없는 단점이 있다. 일반적인 GaAs IC 공정과 호환이 가능한 몸체미세가공기술로 GaAs 구조물 제작이 가능하면 MMIC의 성능을 크게 향상시킬 수 있을 것으로 기대된다.
본 발명은, 몸체미세가공 기술을 이용하여 GaAs 구조물을 제작하는 것에 관한 것으로서, 특히, GaAs의 식각액으로서 널리 알려져있는, 수산화암모늄계열의 식각액을 사용하여 GaAs 기판을 습식 식각하는 경우 식각 특성을 이용하여, 사각 단면을 가지는 <100> 방향 GaAs 빔 제조 방법을 제공하고자 한다.
도1은 GaAs의 습식 식각시, 방향에 따른 GaAs의 언더컷 특성을 보여주는 SEM 사진들이다. 구체적으로는 (001) GaAs 기판상에서 수산화암모늄 계열의 식각액을 이용하여 습식 식각하는 경우이다.
도1a는방향의 빔 단면의 사진으로서, [110] 방향 언더컷면이 기판면과 137°를 이루는 것을 보여준다. 도1b는 [100] 방향의 빔 단면의 사진으로서, [010] 방향 언더컷면이 기판면과 90°를 이루는 것을 보여준다. 도1c는 [110] 방향의 빔 단면의 사진으로서,방향 언더컷면이 기판면과 74°를 이루는 것을 보여준다. 즉, 빔의 방향이에서 [100]으로 갈수록 식각 경사면과 기판면이 이루는 각이 137°에서 점차 감소하여 90°가 되며, 다시 [110] 방향으로 갈수록 74°가 되는 경향을 보인다.
종래 기술로서,방향 언더컷 특성을 이용하여 습식 식각한 후 부유된 GaAs 빔이 알려져 있는데, 이는 단면이 역삼각형 모양을 가지며 두께와 폭의 비가 고정된다. 이와 같이 이등변각이 74°이상인 역삼각형 단면의 빔은 기판면에 수직한 기계적 거동에 적합하지 않으므로 그 응용이 제한된다.
본 발명의 목적은, 구조물 재료로서 (001) GaAs 기판을 이용하며, 기판 습식 식각 수행시 식각 마스크 패턴의 <100> 방향 경계선상에서 언더컷 면으로서 {100} 면이 생성되는 특성을 이용하여, 사각 단면을 가지는 <100> 방향 GaAs 빔 제조 방법을 제공하는 것이다.
도1은 GaAs의 습식 식각시, 방향에 따른 GaAs의 언더컷 특성을 보여주는 SEM 사진들,
도2는 본 발명에 의한 방법의 제조 공정도,
도3는 본 발명에 의한 방법에 의하여 제조된 사각 단면을 가지는 <100> 방향 GaAs 빔의 SEM 사진들.
상기한 본 발명에 의한 목적을 달성하기 위하여, 본 발명에 의한 제조 방법에서는, (001) GaAs 기판을 이용하여, <100> 방향 경계선을 가지는 식각 마스크를 패터닝하는 단계(a); 습식 식각 또는 건식 식각을 수행하여 구조물의 벽면에 수직하게 단차진 구조를 생성하는 단계(b); 상기 단계(b)에서 제작된 구조물의 벽면 보호막을 생성하는 단계(c); 및 상기 단계(c)에서 벽면 보호막이 생성된 구조물을 습식 식각을 통하여 <100> 방향 빔을 부유시키는 단계(d)를 포함하는 것을 특징으로 한다.
이하에서 첨부된 도면을 참조하면서 본 발명에 의한 사각 단면을 가지는 <100> 방향 GaAs 빔 제조 방법을 상세하게 설명한다.
도2는 본 발명에 의한 방법의 제조 공정도이다.
본 발명에서는 구조물 재료로서 (001) GaAs 기판을 사용한다. 기판 위에 식각마스크1을 증착한 후, 사진묘화작업을 수행한다. 사진묘화작업을 통하여 패터닝된 감광막을 식각마스크 삼아 식각마스크1을 패터닝한 후 감광막을 제거하면 도2a와 같은 단면 상태에 도달한다. 사각 단면의 빔을 제작하기 위하여는 빔의 방향이 도2a에서 보이는 바와 같이, <100> 방향이어야 한다. 이는 추후 수행될 GaAs의 습식 식각 특성을 감안한 것이다.
다음으로 도2b에서 보이는 바와 같이, GaAs 기판을 깊이 방향으로 h1깊이만큼 건식 식각 또는 습식 식각을 수행하여 단차진 구조를 제작한다. 이때, 습식 식각을 수행하는 경우, 깊이 방향의 식각량 h1과 비슷한 언더컷량 u1이 발생하며, 건식 식각을 수행하는 경우, 깊이 방향의 식각량 h1에 비해 작은 언더컷량 u1이 발생한다.
그런 다음, 추후 희생층 식각 공정에서 GaAs 빔의 벽면을 보호하기 위하여 식각 마스크 막을 GaAs 기판 전체에 증착시키고, 증착된 막을 비등방성 건식 식각하여 도2c와 같은 벽면 보호막을 형성한다.
마지막으로, GaAs 습식 식각하여 도2d와 같이 깊이 h2만큼 식각하면 사각 단면을 지닌 <100> 방향 GaAs 빔을 얻을 수 있다. 이 때, 첫 번째 식각 깊이 h1이 건식 식각에 의하여 수행되어 언더컷량 u1이 깊이 방향 식각량 h1에 비하여 작다면, w/2+u1은 거의 w/2와 동일하므로, 희생층 식각시 식각 깊이 h2가 w/2만큼 도달하였을 때에 빔이 부유되기 시작한다. 또한, 첫 번째 식각 깊이 h1이 습식 식각에 의하여 수행되어 언터컷량 u1이 깊이 방향 식각량 h1과 비슷하다면, 희생층 식각시 식각 깊이 h2가 w/2+h1만큼 도달하였을 때에 빔이 부유하기 시작한다.
도2d에서 부유된 빔의 폭 w는 초기 식각마스크1의 폭 D에서 첫 번째 깊이 방향 식각시 발생하는 언더컷량 u1만큼 양쪽으로 감소하여, D-2u1이 된다. 부유된 빔의 두께 t는, 첫 번째 깊이 방향 식각량 h1에서 희생층 식각시 빔의 밑면에서 식각되는 양 u2을 빼면 된다(h1-u2). 따라서 희생층 식각시 깊이 방향 식각량 h2은 u1+u2이상의 값을 가져야 한다.
아래에서는 본 발명에 의한 방법을 적용한 구체적인 실시예를 상세하게 설명한다.
지름 3인치 크기의 (001) GaAs 기판을, 끓는 점 이하의 온도에서 데운 아세톤, 메탄올 및 TCE(Trichloroethylene) 용액에 10분씩 차례로 담금으로써 세척한다. PECVD(Plasma Enhanced Chemical Vapor Deposition) 방법을 이용한 저응력 질화막(Si3N4) 5000Å을 기판 앞면과 뒷면에 증착한다. 증착된 저응력 질화막 위에 1.2㎛ 두께의 감광막을 사진묘화작업을 통하여 패터닝하고, 감광막을 식각마스크로 하여 저응력 질화막을 건식 식각한 후 아세톤을 이용하여 감광막을 제거하면 도2a와 같은 단면 상태에 도달한다. 이때 빔의 방향은 <100> 방향이어야 한다.
다음으로, 온도 18℃의 NH4OH: H2O2: H20=25㎖:25㎖:450㎖ 조성의 식각액을 이용하여 식각 깊이 h1=60㎛만큼 GaAs 기판을 습식 식각하여 도2b와 같은 단차진 구조를 제작한다. 이때 (001) GaAs 기판의 습식 식각 특성상 식각 마스크 패턴의 <100> 방향 경계선상에서 언더컷면으로서 {100} 면이 생성된다. 습식 식각으로 인한 언더컷양 u1은 깊이 방향보다 적은 50㎛ 정도 발생한다. 따라서 최종 부유되는 빔에서 폭 w은, 포기 마스크 폭 D=120㎛에서 언더컷양을 고려하여 20㎛(=D-2u1)가 된다. 이와 같이 벽면이 수직한 단차진 구조를 제작하기 위하여, 습식 식각 방법 이외에 건식 식각 방법도 사용할 수 있다. 습식 식각시 언더컷양이 깊이 방향 식각량 정도임과 비교할 때에, 건식 식각을 이용하는 경우 언더컷이 거의 발생하지 않는다.
본 발명에 의한 단계(c)는, 본 발명에 의한 단계(d)에서의 희생층 습식 식각시 GaAs 빔의 벽면 보호막을 생성하는 단계이다. 이를 위하여, PECVD 저응력 질화막을 3000Å의 두께로 GaAs 웨이퍼 전체에 증착시키고, 증착된 저응력 질화막 3000Å을 비등방성 건식 식각하게 되면 도2c와 같은 벽면 보호막이 생성된다. 이때에 건식 식각 장비의 식각 균일도와 습식 식각될 바닥면의 저응력 질화막을 완전히 제거하기 위하여, 식각 목표 두께보다 10% 정도 추가하여 건식 식각을 수행하는 것이 바람직하다. 이 경우 식각마스크1의 저응력 질화막의 두께는, 이러한 추가 건식 식각 과정 후 희생층 습식 식각을 견뎌낼 수 있는 충분한 두께를 가지도록 고려하여야 한다.
마지막으로, 온도 18℃의 NH4OH: H2O2: H20=25㎖:25㎖:450㎖ 조성의 식각액을 이용하여 식각 깊이 h2=115㎛만큼 GaAs 기판을 습식 식각하여 도2d와 같은 사각 단면을 가지는 <100> 방향 GaAs 빔을 완성한다. 도2d와 같은 상태에서 HF를 이용하여 식각마스크를 제거하면, 도3a의 사진에서 보이는 바와 같은 부유된 <100> 방향의 GaAs 빔을 얻을 수 있다. 이때 빔의 주요 치수는, 폭이 20㎛, 두께는 약 5㎛이다. 도3b는 도3a의 부유된 빔의 뒷면 사진인데, 밑면이 평탄한 것을 볼 수 있다.
이상에서 설명한 바와 같이, 본 발명에서는, 구조물 재료로서 (001) GaAs 기판을 이용하며, 사각 단면을 가지는 <100> 방향 GaAs 빔 제조 방법을 제공한다. 본 발명에 의한 방법에 의하면, 초기 식각마스크 패턴의 폭, 식각 공정에서의 식각 깊이 등을 조정하여, 제조되는 사각 단면을 가지는 <100> 방향 GaAs 빔의 수치를 조절할 수 있으므로, 몸체미세가공 기술을 이용하여 제작할 수 있는 GaAs의 구조물의 적용 범위를 넓힐 수 있는 효과가 있다. 특별히, 본 발명에 의한 방법에 의하면,GaAs 미세 구조물의 기본이 되는 외팔보 및 양단지지보를 구성할 수 있는 장점이 있다.

Claims (7)

  1. (001) GaAs 기판을 이용하여, <100> 방향 경계선을 가지는 식각 마스크를 패터닝하는 단계(a);
    습식 식각 또는 건식 식각을 수행하여 구조물의 벽면에 수직하게 단차진 구조를 생성하는 단계(b);
    상기 단계(b)에서 제작된 구조물의 벽면 보호막을 생성하는 단계(c); 및
    상기 단계(c)에서 벽면 보호막이 생성된 구조물을 습식 식각을 통하여 <100> 방향 빔을 부유시키는 단계(d)를 포함하는 것을 특징으로 하는 사각 단면을 가지는 [100] 방향 GaAs 빔 제조 방법.
  2. 제1항에 있어서,
    상기 단계(b)에서, 습식 식각을 수행하는 경우, 언더컷량이 단계(b)에서의 깊이 방향 식각량 정도인 언더컷이 발생하는 것임을 특징으로 하는 사각 단면을 가지는 <100> 방향 GaAs 빔 제조 방법.
  3. 제1항에 있어서,
    상기 단계(b)에서, 건식 식각을 수행하는 경우, 언더컷량이 단계(b)에서의 깊이 방향 식각량보다 작은 언더컷이 발생하는 것임을 특징으로 하는 사각 단면을 가지는 <100> 방향 GaAs 빔 제조 방법.
  4. 제1항에 있어서,
    상기 단계(a)에서의 식각 마스크 패턴의 폭을 'D'라고 하고, 상기 단계(b)에서의 언더컷량은 'u1'이라고 할 때에, 상기 단계(d)에서, 부유된 [100] 방향 GaAs 빔의 폭은 'D-2u1'임을 특징으로 하는 사각 단면을 가지는 <100> 방향 GaAs 빔 제조 방법.
  5. 제1항에 있어서,
    상기 단계(b)에서의 깊이 방향 식각량을 'h1'이라고 하고, 상기 단계(d)에서의 희생층 식각시 빔의 밑면에서 식각되는 양을 'u2'라고 하면, 부유된 빔의 두께 t는, 'h1-u2'임을 특징으로 하는 사각 단면을 가지는 <100> 방향 GaAs 빔 제조 방법.
  6. 제4항 또는 제5항에 있어서,
    상기 단계(a)에서의 식각 마스크 패턴의 폭 'D', 상기 단계(b)에서의 깊이 방향 식각량 'h1' 및 이에 따른 언더컷량 'u1' 및 상기 단계(d)에서의 희생층 식각시 빔의 밑면에서 식각되는 양 'u2'를 조절하여, 사각 단면을 가지는 <100> 방향 GaAs 빔의 수치를 결정하는 것임을 특징으로 하는 사각 단면을 가지는 <100> 방향 GaAs 빔 제조 방법.
  7. 제4항 또는 제6항에 있어서,
    상기 단계(d)에서의 희생층 식각시 깊이 방향의 식각량 h2는 'u1+u2' 이상의 값을 가지는 것임을 특징으로 하는 사각 단면을 가지는 <100> 방향 GaAs 빔 제조 방법.
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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR20030067847A (ko) * 2002-02-08 2003-08-19 조동일 갈륨아세나이드 반도체 미세구조물의 제조 방법

Citations (6)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR970067950A (ko) * 1996-03-30 1997-10-13 오상수 반도체 센서용 마이크로 빔의 제조방법
KR19990027307A (ko) * 1997-09-29 1999-04-15 윤종용 초미세 소자 제작을 위한 마이크로 기계가공 방법
US6159385A (en) * 1998-05-08 2000-12-12 Rockwell Technologies, Llc Process for manufacture of micro electromechanical devices having high electrical isolation
US6238946B1 (en) * 1999-08-17 2001-05-29 International Business Machines Corporation Process for fabricating single crystal resonant devices that are compatible with integrated circuit processing
KR100300002B1 (ko) * 1998-04-01 2001-11-22 조동일 (111)단결정실리콘을이용한마이크로머시닝제조방법
KR100381011B1 (ko) * 2000-11-13 2003-04-26 한국전자통신연구원 멤즈소자 제조용 미세구조체를 고착없이 띄우는 방법

Patent Citations (6)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR970067950A (ko) * 1996-03-30 1997-10-13 오상수 반도체 센서용 마이크로 빔의 제조방법
KR19990027307A (ko) * 1997-09-29 1999-04-15 윤종용 초미세 소자 제작을 위한 마이크로 기계가공 방법
KR100300002B1 (ko) * 1998-04-01 2001-11-22 조동일 (111)단결정실리콘을이용한마이크로머시닝제조방법
US6159385A (en) * 1998-05-08 2000-12-12 Rockwell Technologies, Llc Process for manufacture of micro electromechanical devices having high electrical isolation
US6238946B1 (en) * 1999-08-17 2001-05-29 International Business Machines Corporation Process for fabricating single crystal resonant devices that are compatible with integrated circuit processing
KR100381011B1 (ko) * 2000-11-13 2003-04-26 한국전자통신연구원 멤즈소자 제조용 미세구조체를 고착없이 띄우는 방법

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