KR0163146B1 - 디지탈 전전자 교환기의 No.7 신호처리장치 - Google Patents

디지탈 전전자 교환기의 No.7 신호처리장치 Download PDF

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Abstract

본 발명은 디지탈 전전자 교환기의 No.7 신호처리장치에 관한 것으로, 서브하이웨이 차동신호를 서브하이웨이 TTL 레벨로 변환하여 버퍼링된 서브하이웨이를 출력하고, ST-버스를 통해 제어데이타를 입출력하는 신호단말관리부(30); 및 상기 ST-버스를 통해 입출력되는 제어데이타에 따라 상기 신호단말관리부로부터 버퍼링된 서브하이웨이에서 특정 타임슬롯의 채널 데이타를 추출하여 신호처리하는 복수개의 신호단말(40-1~40-16)로 구성되어 있다. 따라서 신호단말기가 각각 레이트어답션(RA)기능을 구비함으로써 서브하이웨이에서 해당 채널을 직접 추출하고, 해당 채널을 서브하이웨이로 속도변환해 주므로 신호링크의 신뢰성이 향상되는 효과가 있다.

Description

디지탈 전전자 교환기의 No.7 신호처리장치
제1도의 (a) 내지 (c)는 No.7 패킷의 데이타 포맷도.
제2도는 종래의 No.7 신호처리장치를 도시한 블럭도.
제3도는 본 발명에 따른 No.7 신호처리장치를 도시한 블럭도.
제4도는 제3도에 도시된 신호단말(ST)의 세부 블럭도.
제5도는 제4도에 도시된 속도변환부의 기능 블럭도이다.
* 도면의 주요부분에 대한 부호의 설명
10,30 : 신호단말관리부 11-1~11-4 : 속도변환(RA)칩
20-1~20-16, 40-1~40-16 : 신호단말(ST)
31 : 프로세서부 32 : 레벨변환부
33 : 버퍼 41 : 클럭생성부
42 : 리셋부 43 : 멀티프로토콜 프로세서
44,45,47 : 메모리 46 : 속도변환부
48 : 모뎀인터페이스부 49 : SHW인터페이스부
50 : ST-버스 인터페이스부 51 : 루프백부
52 : 채널선택부 53 : 제1속도변환부
54 : T1/E1 선택부 55 : 제2속도변환부
본 발명은 디지탈 전전자 교환기에서 No.7 공통선 신호(CCS) 방식을 사용할 경우에, No.7 CCS 신호를 처리하기 위한 신호처리장치에 관한 것이다.
통신망을 경유해서 단말 사이를 접속하기 위해서는 사용자, 단말과 교환기의 사이에 신호의 송수신(가입자선 신호)이 필요하게 되고, 사용자 단말이 각각 다른 교환기에 수용되어 있다면 교환기 사이에서도 신호의 교환(국간신호)을 행할 필요가 있다.
이때 신호방식은 개개의 통화회선을 통해 신호가 전송되는 개별선 신호방식(CAS)과, 통화회선과 분리된 전용회선으로 복수의 통화회선의 신호를 전송하는 공통선 신호방식(CCS)으로 구분되는데, 공통선 신호방식은 축적 프로그램을 채용한 전자교환방식의 도입에 의해 가능해진 후 ISDN방식에서 널리 사용되고 있다.
No.7 공통선 신호방식은 ITU-T에 의해 7번째 신호방식으로 표준화가 진행된 것으로 패킷 통신기술을 응용하는 데이타 통신방식으로서, OSI모델의 레이어 1부터 레이어 3까지 해당하는 부분을 메세지전송부(MTP)라 총칭하고 있고, 이를 다시 레벨 1: 신호데이타 링크부, 레벨 2: 신호링크 기능부, 레벨 3: 신호망 기능부로 나누고 있다.
이러한 No.7 공통선 신호방식의 패킷 포맷은 제1도의 (a) 내지 (c)에 도시된 바와 같이, 필인 신호 유니트(FISU), 링크 상태 유니트(LSSU), 메세지 신호 유니트(MSU)가 있다.
제1도에 있어서, 신호 유니트가 어떤 종류인가는 길이표시(LI) 옥텟중 에러점검용 필드에 있는 2비트에 의해 정해지는데, 예컨대 '00' 이면 필인 신호 유니트(FISU), '01'이면 링크 상태 신호 유니트(LSSU), '11'이면 메세지신호(MSU) 유니트이다. 또한, (a) 내지 (c)의 포맷에서 'F'는 플래그를 나타내고 'BSN'은 역방향 시퀀스 번호를 나타내며, 'BIB'는 역방향 상태 표시비트, 'FSN'은 순방향 시퀀스 번호, 'FIB'는 순방향 상태 표시비트, 'LI'는 신호길이표시, 'CK'는 오류검사부호를 나타낸다.
그리고 FISU는 신호링크 상에 전송해야할 다른 신호 유니트가 없을 경우에 전송되는 신호 유니트이고, LSSU는 이 신호 유니트를 보내는 측의 신호링크상태를 나타내고, MSU는 레벨3이상의 신호메세지를 넣어서 보낼때 사용되는 것으로 LAPD의 정보(I) 프레임에 대응한다.
이러한 No.7 공통선 신호방식을 구현하기 위한 종래의 신호처리장치는 제2도에 도시한 바와 같이, 타임스위치블럭(TSL)에 연결되어 2.048Mbps 차동 서브하이웨이(SHW)를 입력받아 64Kbps로 변환하고, 64Kbps의 채널 데이타를 입력받아 2.048Mbps 의 서브하이웨이(SHW)로 변환하는 신호단말 관리부(10); 상기 신호단말관리부(10)에 연결되는 복수개의 신호단말(20-1~20-16)로 이루어져 있다.
제2도에 있어서, 신호단말관리부(10)는 32채널이 다중화된 2.048Mbps 의 서브하이웨이(SHW)를 입력받아 64Kbps의 채널 속도를 갖는 소정의 4채널을 추출하는 4개의 속도변환칩(RA:11-1~11-4)으로 구성되어 서브하이웨이 32채널 중 16채널을 추출해서 16개의 신호단말(20-1~20-16)과 연결한다.
이와 같이 종래의 신호 단말은 신호단말관리부(10)에서 속도변환된 후 채널 단위로 인터페이스되었기 때문에 신호단말관리부와 신호단말간에 배선이 복잡하고, 어느 하나의 속도변환칩(RA)에 고장이 발생될 경우 4채널을 모두 사용할 수 없는 문제점이 있었다.
이에 본 발명은 상기와 같은 문제점을 해소하기 위하여 안출된 것으로, 각각의 신호단말이 서브하이웨이를 입력받아 속도변환하여 해당 채널을 추출할 수 있는 디지탈 전전자 교환기의 No.7 신호처리장치를 제공하는데 그 목적이 있다.
상기와 같은 목적을 달성하기 위하여 본 발명의 장치는,
2.048Mbps의 서브하이웨이 데이타를 입력받아 특정한 타임슬롯의 채널 데이타를 추출하여 No.7 신호 메세지를 처리하도록 된 디지탈 전전자 교환기의 신호처리장치에 있어서, 서브하이웨이 차동신호를 서브하이웨이 TTL 레벨로 변환하여 버퍼링된 서브하이웨이를 출력하고, ST-버스를 통해 제어데이타를 입출력하는 신호단말관리부; 및 상기 ST-버스를 통해 입출력되는 제어데이타에 따라 상기 신호단말관리부로부터 버퍼링된 서브하이웨이에서 특정 타임슬롯의 채널 데이타를 추출하여 신호처리하는 복수개의 신호단말로 구성된 것을 특징으로 한다.
이하, 첨부된 도면을 참조하여 본 발명을 자세히 설명하기로 한다.
먼저 본 발명을 이해하기 쉽도록 TDX-10계열에서의 신호링크 계통을 설명한다. 디지탈 전전자 교환기(TDX-10계통)에서의 신호처리(SS7U)블럭은 공통선신호방식인 No.7 CCS 기능을 수행하는 블럭으로서, MTP레벨 2신호 링크기능 및 레벨 3 메세지 처리기능을 수행하며, 제3도에 도시된 바와 같이 신호단말관리부(STM:30)와 신호단말(ST:40-1~40-16)로 구성된다.
여기서 신호단말관리부(30)는 레벨변환부(32)와 버퍼(33), 및 프로세서부(31)로 구성되어 타임스위치(TSL)로부터 서브하이웨이(SHW)를 입력받아 차등레벨을 TTL레벨로 변환시켜 16개의 신호단말(ST)로 공통출력하고, 반대로 TTL레벨의 SHW를 차등레벨로 변환하여 타임스위치(TSL)로 출력한다. 이때, 각 신호단말(ST:40-1~40-16)은, 서브하이웨이 데이타를 디지탈 신호 데이타 링크(SDL)에 의해 신호단말관리부(30)와 교환하고, 제어데이타를 ST-버스에 의해 상위 프로세서와 교환하여 지정된 해당 채널에 대해서만 신호링크 데이타를 송수신한다.
그리고 상기 신호단말(ST)은 제4도에 도시된 바와 같이, 소정의 클럭을 발생하는 클럭생성부(41); 장치를 리셋시키기 위한 리셋신호를 발생하는 리셋부(42); 상기 클럭생성부(41)의 클럭을 받아 No.7 레벨2 기능을 수행하기 위한 펌웨어에 의해 No.7 프로토콜을 수행하는 멀티프로토콜 프로세서(IMP:43); 펌웨어를 저장하는 메모리(44,45); 상기 클럭생성부(41)의 클럭을 받아 채널속도를 서브하이웨이속도로, 서브하이웨이 속도를 채널 속도로 변환하는 속도변환부(46); 속도변환관련 데이타를 저장하고 있는 메모리(47); 상기 멀티프로토콜 프로세서를 모뎀과 인터페이스하기 위한 모뎀인터페이스부(48); 상기 속도변환부를 서브하이웨이측과 인터페이스하기 위한 SHW인터페이스부(49); 상기 속도변환부를 ST-버스와 인터페이스하기 위한 ST-버스 인터페이스부(50)로 구성되어 있다.
여기서 상기 멀티프로토콜 프로세서(IMP:43)는 No.7 레벨2 기능을 수행하는 펌웨어가 장착되며, ST-버스 정합, SHW 데이터링크 정합, 모뎀정합, 각종 상태정보등의 데이타를 처리하고, 클럭생성부(41)는 멀티프로토콜 프로세서(IMP:43)와 속도변환부(46)에 20MHz의 클럭을 제공한다. 리셋부(42)는 IMP(43)와 속도변환부(46)에 PBA의 안정화가 고려된 시간간격으로 리셋신호를 제공한다.
그리고, 속도변환부(46)는 FPGA(Field Programmable Gate Array)로 구현되어 ST-버스 인터페이스, 각종 클럭 폴트감지 로직, PBA상태점검로직, RA기능등을 수행하고, ST-버스 인터페이스부(50)는 이중화되어 있는 상위 블럭과 연동되는 데이타, 클럭, 이중화 선택신호들로 구성되며 모뎀 인터페이스부(48)는 모뎀 정합시에 사용되는 데이타, 클럭 등의 신호를 제공한다.
또한, 상기 속도변환부(46)는 제5도에 도시된 바와 같이, 서브하이웨이를 루프백하기 위한 루프백부(51); 서브하이웨이 동기신호(SHW FS, SHW CLK)를 입력받고, 채널선택번호를 입력받아 서브하이웨이에서 해당 채널을 선택하는 채널선택부(52); 64Kbps의 채널속도를 2.048Mbps의 서브하이웨이속도로 변환하는 제1속도변환부(53); T1이면 채널속도를 56Kbps로 하기 위해 T1 혹은 E1모드를 선택하는 T1/E1선택부(54); 및 선택된 수신채널 데이타의 속도를 2.048Mbps에서 64Kbps로 변환하는 제2속도변환부(55)로 구성되어 있다.
여기서, 상기 채널 선택부(52)는 SHW의 프레임동기(FS)와 클럭(CLK)으로부터 해당되는 채널번호(0~31;5비트)의 타임슬롯에 데이터를 추출 및 삽입하고, 2.048Mbps를 64Kbps로 속도 변환하는 제2속도변환부(55)는 2M RX DATA로부터 추출된 8비트단위 2M 데이타를 64Kbps 데이타로 변환시키며, 64Kbps를 2.048Mbps로 속도변환하는 제1속도변환부(53)는 64Kbps의 직렬 데이타를 8비트 단위로 2.048Mbps로 변환시킨다.
그리고, T1/E1선택부(54)는 T1인 경우 56K 로 데이타 변환하고, 루프백부(51)는 루프백 테스트시에 서브하이웨이 수신(RX) 데이타를 송신(TX) 데이타로 직접 연결한다.
이상에서 살펴본 바와 같이 본 발명에 따라 신호단말기가 각각 레이트어답션(RA)기능을 구비함으로써 서브하이웨이에서 해당 채널을 직접 추출하고, 해당 채널을 서브하이웨이로 속도변환해 주므로 신호링크의 신뢰성이 향상되는 효과가 있다.

Claims (3)

  1. 소정의 서브하이웨이 데이타를 입력받아 특정한 타임슬롯의 채널 데이타를 추출하여 No.7 신호 메세지를 처리하도록 된 디지탈 전전자 교환기의 신호처리장치에 있어서, 서브하이웨이 차동신호를 서브하이웨이 TTL 레벨로 변환하여 버퍼링된 서브하이웨이를 출력하고, ST-버스를 통해 제어데이타를 입출력하는 신호단말관리부; 및 상기 ST-버스를 통해 입출력되는 제어데이타에 따라 상기 신호단말관리부로부터 버퍼링된 서브하이웨이에서 특정 타임슬롯의 채널 데이타를 추출하여 신호처리하는 복수개의 신호단말로 구성된 것을 특징으로 하는 디지탈 전전자 교환기의 No.7 신호처리장치.
  2. 제1항에 있어서, 상기 신호단말(ST)은 소정의 클럭을 발생하는 클럭생성부(41); 장치를 리셋시키기 위한 리셋신호를 발생하는 리셋부(42); 상기 클럭생성부(41)의 클럭을 받아 No.7 레벨2 기능을 수행하기 위한 펌웨어에 의해 No.7 프로토콜을 수행하는 멀티프로토콜 프로세서(IMP:43); 펌웨어를 저장하는 메모리(44,45); 상기 클럭생성부(41)의 클럭을 받아 채널속도를 서브하이웨이속도로, 서브하이웨이 속도를 채널 속도로 변환하는 속도변환부(46); 속도변환관련 데이타를 저장하고 있는 메모리(47); 상기 멀티프로토콜 프로세서를 모뎀과 인터페이스하기 위한 모뎀인터페이스부(48); 상기 속도변환부를 서브하이웨이측과 인터페이스하기 위한 SHW인터페이스부(49); 상기 속도변환부를 ST-버스와 인터페이스하기 위한 ST-버스 인터페이스부(50)로 구성되는 것을 특징으로 하는 디지탈 전전자 교환기의 No.7 신호처리장치.
  3. 제2항에 있어서, 상기 속도변환부(46)는 루프백을 위한 루프백부(51); 서브하이웨이 동기신호(SHW FS, SHW CLK)를 입력받고, 채널선택번호를 입력받아 서브하이웨이에서 해당 채널를 선택하는 채널선택부(52); 64Kbps의 채널속도를 2.048Mbps의 서브하이웨이속도로 변환하는 제1속도변환부(53); T1 이면 채널속도를 56Kbps로 하기 위해 T1 혹은 E1모드를 선택하는 T1/E1선택부(54); 및 선택된 수신채널 데이타의 속도를 2.048Mbps에서 64Kbps로 변환하는 제2속도변환부(55)로 구성되는 것을 특징으로 하는 디지탈 전전자 교환기의 No.7 신호처리장치.
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