JPS6378294A - 電源制御装置 - Google Patents
電源制御装置Info
- Publication number
- JPS6378294A JPS6378294A JP22093486A JP22093486A JPS6378294A JP S6378294 A JPS6378294 A JP S6378294A JP 22093486 A JP22093486 A JP 22093486A JP 22093486 A JP22093486 A JP 22093486A JP S6378294 A JPS6378294 A JP S6378294A
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- JP
- Japan
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- alarm signal
- low voltage
- overcurrent
- power supply
- signal
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- Pending
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- 238000001514 detection method Methods 0.000 claims description 19
- 230000002159 abnormal effect Effects 0.000 claims description 9
- 238000010586 diagram Methods 0.000 description 13
- 238000012423 maintenance Methods 0.000 description 4
- 230000005856 abnormality Effects 0.000 description 2
- 230000002457 bidirectional effect Effects 0.000 description 2
- 230000000694 effects Effects 0.000 description 2
- 238000005516 engineering process Methods 0.000 description 1
- 238000004519 manufacturing process Methods 0.000 description 1
- 238000011084 recovery Methods 0.000 description 1
- 238000004904 shortening Methods 0.000 description 1
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- Emergency Alarm Devices (AREA)
- Measurement Of Current Or Voltage (AREA)
- Burglar Alarm Systems (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔概 要〕
電源制御装置であって、電源の出力端における異常低電
圧の検出時間より短い検出時間で異常過電流を検出する
ように構成し、異常低電圧と異常過電流にそれぞれ対応
した処理を行なう処理装置が過電流アラームが発生した
にもかかわらず低電圧アラームと誤認することを防止す
るもの。
圧の検出時間より短い検出時間で異常過電流を検出する
ように構成し、異常低電圧と異常過電流にそれぞれ対応
した処理を行なう処理装置が過電流アラームが発生した
にもかかわらず低電圧アラームと誤認することを防止す
るもの。
本発明は電源制御装置に係り、特に電源の出力端子にお
ける過電流を有効に検出する電源制御装置に関する。
ける過電流を有効に検出する電源制御装置に関する。
コンピュータ等の電源としてDC/DCコンバータ等が
用いられている。この電源の出力端における異常は、出
力電圧の異常低下を示す低電圧アラーム信号又は負荷の
短絡等による出力電流の異常過電流を示す過電流アラー
ム信号として出力される。処理装置は、これらのアラー
ム信号を保守情報として、例えば、メモリに記憶させた
り表示装置に表示させる。
用いられている。この電源の出力端における異常は、出
力電圧の異常低下を示す低電圧アラーム信号又は負荷の
短絡等による出力電流の異常過電流を示す過電流アラー
ム信号として出力される。処理装置は、これらのアラー
ム信号を保守情報として、例えば、メモリに記憶させた
り表示装置に表示させる。
第5図は従来の電源制御装置の一例を示すブロツク回路
図、第6図は第4図の装置の動作を説明する波形図であ
る。
図、第6図は第4図の装置の動作を説明する波形図であ
る。
第5図に示されるように、従来は電源1から出力される
低電圧アラームは電源制御装置50において、ANDゲ
ート51の一方の入力に入力され、電源1から出力され
る過電流アラーム信号は電源制御装置50内のインバー
タゲート52に入力される。インバータゲート52の出
力はANDゲート51の他方の入力に接続されている。
低電圧アラームは電源制御装置50において、ANDゲ
ート51の一方の入力に入力され、電源1から出力され
る過電流アラーム信号は電源制御装置50内のインバー
タゲート52に入力される。インバータゲート52の出
力はANDゲート51の他方の入力に接続されている。
そして、 ・電源制御装置50内の処理装置40は、A
NDゲート51の出力を有効低電圧アラーム信号として
受は取り、インバータゲート52の出力を有効過電流ア
ラーム信号として受は取って、それぞれのアラーム信号
に対応した処理を行なう。
NDゲート51の出力を有効低電圧アラーム信号として
受は取り、インバータゲート52の出力を有効過電流ア
ラーム信号として受は取って、それぞれのアラーム信号
に対応した処理を行なう。
電源1はD C/D Cコンバータ等で実現されるもの
であり、内部にカレントトランスや整流回路を有してい
るので、電源の出力端子の短絡時等の過電流時に、第6
図に示すように、低電圧アラーム信号は出力端子の短絡
と同時に立上るが、過電流アラーム信号は遅れて立上る
。このため、有効低電圧アラーム信号の方が有効過電流
アラーム信号よりも先に処理装置40に送られる。した
がって、実際には過電流の事故が発生しているにもかか
わらず、処理装置40は最初に受けた有効アラーム信号
である有効低電圧アラーム信号に基づいて、異常低電圧
に対処するための動作、例えば電源の切断、メモリへの
記録、表示装置への表示等を行なう。そして、保守者は
これらメモリに記録された情報または表示装置に表示さ
れた情報に基づき、低電圧異常と誤認して障害除去の作
業をすることになるが、実際には過電流の障害であるの
で、障害除去の作業に支障をきたすという問題点がある
。
であり、内部にカレントトランスや整流回路を有してい
るので、電源の出力端子の短絡時等の過電流時に、第6
図に示すように、低電圧アラーム信号は出力端子の短絡
と同時に立上るが、過電流アラーム信号は遅れて立上る
。このため、有効低電圧アラーム信号の方が有効過電流
アラーム信号よりも先に処理装置40に送られる。した
がって、実際には過電流の事故が発生しているにもかか
わらず、処理装置40は最初に受けた有効アラーム信号
である有効低電圧アラーム信号に基づいて、異常低電圧
に対処するための動作、例えば電源の切断、メモリへの
記録、表示装置への表示等を行なう。そして、保守者は
これらメモリに記録された情報または表示装置に表示さ
れた情報に基づき、低電圧異常と誤認して障害除去の作
業をすることになるが、実際には過電流の障害であるの
で、障害除去の作業に支障をきたすという問題点がある
。
第1図は本発明の電源制御装置の原理ブロック図を示す
。
。
第1図において、電源制御装置は、低電圧アラーム信号
検出手段2と、過電流アラーム信号検出手段3と、処理
装置4とを備えている。
検出手段2と、過電流アラーム信号検出手段3と、処理
装置4とを備えている。
低電圧アラーム信号検出手段2は、電源1の出力端にお
ける異常低電圧を第1の所定時間t1の量検出した後に
有効低電圧アラーム信号を出力する。
ける異常低電圧を第1の所定時間t1の量検出した後に
有効低電圧アラーム信号を出力する。
過電流アラーム信号検出手段3は、電源1の出力端にお
ける異常過電流を第1の所定時間t、より短い第2の所
定時間t2の量検出した後に有効過電流アラーム信号を
出力する。
ける異常過電流を第1の所定時間t、より短い第2の所
定時間t2の量検出した後に有効過電流アラーム信号を
出力する。
処理装置4は、有効低電圧アラーム信号と有効過電流ア
ラーム信号とにそれぞれ対応した処理を行なう。
ラーム信号とにそれぞれ対応した処理を行なう。
異常過電流の検出時間が異常低電圧の検出時間より短い
ので、過電流アラーム信号が低電圧アラーム信号より遅
れて電源から出力されても、有効過電流アラーム信号が
有効低電圧アラーム信号より先に処理装置に送出される
。したがって、処理装置4は確実に過電流による障害が
発生したことを認識することができる。
ので、過電流アラーム信号が低電圧アラーム信号より遅
れて電源から出力されても、有効過電流アラーム信号が
有効低電圧アラーム信号より先に処理装置に送出される
。したがって、処理装置4は確実に過電流による障害が
発生したことを認識することができる。
第2図は本発明の一実施例を説明する回路図である。
第2図において、低電圧アラーム信号検出手段2は、電
源1からの低電圧アラーム信号をクロック発生器6から
のクロック信号に応じて通過させるANDゲート21と
、ANDゲート21の出力を、低電圧アラーム信号がハ
イレベル“H”のときに第1の所定時間1+(例えば1
00個のクロックパルス分)だけカウントしている間は
出力をハイレベル“H”にし、低電圧アラーム信号のロ
ーレベル′″L”をクリア信号CLRとしてカウント値
をクリアし、出力をローレベル″L”に落とすカウンタ
22と、電#1からの低電圧アラーム信号をカウンタ2
2の出力に応じて通過させるANDゲート23とを備え
ている。
源1からの低電圧アラーム信号をクロック発生器6から
のクロック信号に応じて通過させるANDゲート21と
、ANDゲート21の出力を、低電圧アラーム信号がハ
イレベル“H”のときに第1の所定時間1+(例えば1
00個のクロックパルス分)だけカウントしている間は
出力をハイレベル“H”にし、低電圧アラーム信号のロ
ーレベル′″L”をクリア信号CLRとしてカウント値
をクリアし、出力をローレベル″L”に落とすカウンタ
22と、電#1からの低電圧アラーム信号をカウンタ2
2の出力に応じて通過させるANDゲート23とを備え
ている。
過電流アラーム信号検出手段3は、電源1からの過電流
アラーム信号をクロック発生器6からのクロック信号に
応じて通過させるANDゲート31と、ANDゲート3
1の出力を、過電流アラーム信号がハイレベル″H″の
ときに第1の所定時間1.より短かい第2の所定時間t
z(例えば5個のクロックパルス分)だけカウントして
いる間は出力をハイレベル5H″にし、上記カウント後
に過電流アラーム信号をクリア信号CLRとしてカウン
ト値をクリアし、出力をローレベル“L”に落とすカウ
ンタ32と、電源1からの過電流アラーム信号をカウン
タ32の出力に応じて通過させるANDゲート33とを
備えている。
アラーム信号をクロック発生器6からのクロック信号に
応じて通過させるANDゲート31と、ANDゲート3
1の出力を、過電流アラーム信号がハイレベル″H″の
ときに第1の所定時間1.より短かい第2の所定時間t
z(例えば5個のクロックパルス分)だけカウントして
いる間は出力をハイレベル5H″にし、上記カウント後
に過電流アラーム信号をクリア信号CLRとしてカウン
ト値をクリアし、出力をローレベル“L”に落とすカウ
ンタ32と、電源1からの過電流アラーム信号をカウン
タ32の出力に応じて通過させるANDゲート33とを
備えている。
第2図の回路の動作は第3図の波形説明図から明らかな
ように、過電流アラーム検出時間t2を低電圧アラーム
検出時間1.より大幅に短か(したので、過電流アラー
ム信号が低電圧アラーム信号より時間dだけ遅れて電流
1から送出されても、有効過電流アラーム信号の方が有
効低電圧アラーム信号より先に処理装置4に受信される
。したがって、処理装置4は、電源Iの障害が、過電流
であるにもかかわらず低電圧であると誤認することはな
い。
ように、過電流アラーム検出時間t2を低電圧アラーム
検出時間1.より大幅に短か(したので、過電流アラー
ム信号が低電圧アラーム信号より時間dだけ遅れて電流
1から送出されても、有効過電流アラーム信号の方が有
効低電圧アラーム信号より先に処理装置4に受信される
。したがって、処理装置4は、電源Iの障害が、過電流
であるにもかかわらず低電圧であると誤認することはな
い。
カウンタ22及び32はそれぞれ、アラーム信号検出中
アラーム情報がローレベル“L”になると、それがクリ
ア信号CLRとなって内容がリセットされる。したがっ
て、ノイズ等の影響で瞬間的にアラーム信号が発生して
も、それが処理装置に伝達されないという利点もある。
アラーム情報がローレベル“L”になると、それがクリ
ア信号CLRとなって内容がリセットされる。したがっ
て、ノイズ等の影響で瞬間的にアラーム信号が発生して
も、それが処理装置に伝達されないという利点もある。
、 第2図においては、カウンタやA N Dゲートを
用いた電源制御装置を一実施例として示したが、本発明
による電源制御装置はマイクロプロセッサを用いて構成
してもよく、この場合カウンタの計数時間はリード・オ
ンリ・メモリ (ROM)に設定しておけばよい。
用いた電源制御装置を一実施例として示したが、本発明
による電源制御装置はマイクロプロセッサを用いて構成
してもよく、この場合カウンタの計数時間はリード・オ
ンリ・メモリ (ROM)に設定しておけばよい。
第3図は本発明の他の実施例により、マイクロプロセッ
サを用いた電源制御装置の一例を示すブロック図である
。
サを用いた電源制御装置の一例を示すブロック図である
。
第3図において、電源ユニフト1−1.1−2゜1−3
は電源投入信号レジスタ(FF)10がらのパワーオン
信号(PONI 、 2 、3)によってオンとなり、
負荷11に電力を供給する。電源ユニット1−1.1−
2.1−3のいずれかから低電圧アラーム信号(アンダ
ー・ボルテージ・アラームIJVAI、2.3)が発生
すると、このアラーム信号はレシーバ(RV)12−デ
ータバスD0〜D、−双方向バソファ (TRV)13
を介してマイクロプロセッサ(MPU) 14に入力さ
れる。同様に、電源ユニット1−1.1−2.1−3の
いずれかから過電流アラーム信号(オーバ・カレント・
アラームDCA I 。
は電源投入信号レジスタ(FF)10がらのパワーオン
信号(PONI 、 2 、3)によってオンとなり、
負荷11に電力を供給する。電源ユニット1−1.1−
2.1−3のいずれかから低電圧アラーム信号(アンダ
ー・ボルテージ・アラームIJVAI、2.3)が発生
すると、このアラーム信号はレシーバ(RV)12−デ
ータバスD0〜D、−双方向バソファ (TRV)13
を介してマイクロプロセッサ(MPU) 14に入力さ
れる。同様に、電源ユニット1−1.1−2.1−3の
いずれかから過電流アラーム信号(オーバ・カレント・
アラームDCA I 。
2.3)が発生すると、このアラーム信号はレシーバ(
RV)15−データバスDo xDt −双方向ハッフ
ァ(TRV) 13を介してマイクロプロセッサ(MP
U)14に入力される。マイクロプロセッサ14は、受
は取ったアラーム信号が低電圧アラーム信号UVAか過
電流アラーム信号OCAかに応じて、アドレスバスA0
〜A 15を介してl?o1116の対応アドレスをア
クセスし、検出時間1.又はt2を読み出す。そしてプ
ログラム上で上記検出時間を計数後、制御信号をタイミ
ング回路17に送るとともに障害が発生した電源ユニッ
トのアドレス及び障害内容をRAM 18の所定エリア
に記憶させる。タイミング回路17はアドレスバスA0
〜AISからのアドレス信号及び上記制御信号に応じて
RAM 17に対する書込み(WT)のタイミング及び
RAM 17からの読出しくRD)のを制御すると共に
、電源投入信号レジスタ10をセットして障害が発生し
ている電源ユニットのパワーオン信号PONをオフにす
る。また、タイミング回路19からの書込みタイミング
信号(WT)はフリップフロップ19にもセットされ、
アラーム信号として図示しないサービスプロセッサ(S
V P)に伝達される。フリップフロップ10及び1
9は電源ユニットからのアラーム信号が消失すると、マ
イクロプロセッサ14からデータバスD0〜D、を介し
て送られるリセット信号によりリセットされる。
RV)15−データバスDo xDt −双方向ハッフ
ァ(TRV) 13を介してマイクロプロセッサ(MP
U)14に入力される。マイクロプロセッサ14は、受
は取ったアラーム信号が低電圧アラーム信号UVAか過
電流アラーム信号OCAかに応じて、アドレスバスA0
〜A 15を介してl?o1116の対応アドレスをア
クセスし、検出時間1.又はt2を読み出す。そしてプ
ログラム上で上記検出時間を計数後、制御信号をタイミ
ング回路17に送るとともに障害が発生した電源ユニッ
トのアドレス及び障害内容をRAM 18の所定エリア
に記憶させる。タイミング回路17はアドレスバスA0
〜AISからのアドレス信号及び上記制御信号に応じて
RAM 17に対する書込み(WT)のタイミング及び
RAM 17からの読出しくRD)のを制御すると共に
、電源投入信号レジスタ10をセットして障害が発生し
ている電源ユニットのパワーオン信号PONをオフにす
る。また、タイミング回路19からの書込みタイミング
信号(WT)はフリップフロップ19にもセットされ、
アラーム信号として図示しないサービスプロセッサ(S
V P)に伝達される。フリップフロップ10及び1
9は電源ユニットからのアラーム信号が消失すると、マ
イクロプロセッサ14からデータバスD0〜D、を介し
て送られるリセット信号によりリセットされる。
RA?+ 18に記憶−されたアラーム情報は表示装置
(図示せず)に表示されたり、プリンタ(図示せず)か
ら出力されたりして保守者のだめの障害情報として利用
される。
(図示せず)に表示されたり、プリンタ(図示せず)か
ら出力されたりして保守者のだめの障害情報として利用
される。
第4図の実施例においても、ROM 16に格納する検
出時間t2をt、より大幅に短くすることにより、第2
図に示した実施例と同様の効果が得られる。
出時間t2をt、より大幅に短くすることにより、第2
図に示した実施例と同様の効果が得られる。
以上説明したように、本発明によれば、電源の過電流ア
ラーム信号の検出時間を低電圧アラーム信号の検出時間
より大幅に短くしたことにりより、電源制御装置におい
て、過電流の障害が発生しているにもかかわらず低電圧
の障害と誤認することを防ぐことができ、保守者の障害
復旧作業を効率よく行うことができる。
ラーム信号の検出時間を低電圧アラーム信号の検出時間
より大幅に短くしたことにりより、電源制御装置におい
て、過電流の障害が発生しているにもかかわらず低電圧
の障害と誤認することを防ぐことができ、保守者の障害
復旧作業を効率よく行うことができる。
また、アラーム信号を所定時間の量検出した後に有効ア
ラーム信号としたので、ノイズ等によるアラーム信号の
誤認を防ぐことができる。
ラーム信号としたので、ノイズ等によるアラーム信号の
誤認を防ぐことができる。
第1図は本発明の原理ブロック図、
第2図は本発明の一実施例を説明する回路図、第3図は
第2図の回路の波形説明図、 第4図は本発明の他の実施例を説明するブロック図、 第5図は従来の電源制御装置を説明する回路図、第6図
は従来の問題点を説明する波形図である。 1・・・電源、
第2図の回路の波形説明図、 第4図は本発明の他の実施例を説明するブロック図、 第5図は従来の電源制御装置を説明する回路図、第6図
は従来の問題点を説明する波形図である。 1・・・電源、
Claims (1)
- 【特許請求の範囲】 電源(1)の出力端における異常低電圧を第1の所定時
間(t_1)の間検出した後に有効低電圧アラーム信号
を出力する低電圧アラーム信号検出手段(2)と、 該電圧(2)の出力端における異常過電流を該第1の所
定時間(t_1)より短い第2の所定時間(t_2)の
間検出した後に有効過電流アラーム信号を出力する過電
流アラーム信号検出手段(3)と、該有効低電圧アラー
ム信号と該有効過電圧アラーム信号とにそれぞれ対応し
た処理を行なう処理装置(4)とを具備することを特徴
とする電源制御装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP22093486A JPS6378294A (ja) | 1986-09-20 | 1986-09-20 | 電源制御装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP22093486A JPS6378294A (ja) | 1986-09-20 | 1986-09-20 | 電源制御装置 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS6378294A true JPS6378294A (ja) | 1988-04-08 |
Family
ID=16758845
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP22093486A Pending JPS6378294A (ja) | 1986-09-20 | 1986-09-20 | 電源制御装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS6378294A (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5703837A (en) * | 1994-03-31 | 1997-12-30 | Citizen Watch Co., Ltd. | Watch with light transmitting type display plate |
-
1986
- 1986-09-20 JP JP22093486A patent/JPS6378294A/ja active Pending
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5703837A (en) * | 1994-03-31 | 1997-12-30 | Citizen Watch Co., Ltd. | Watch with light transmitting type display plate |
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