JPS6370676A - Video recording and reproducing device - Google Patents

Video recording and reproducing device

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Publication number
JPS6370676A
JPS6370676A JP61216337A JP21633786A JPS6370676A JP S6370676 A JPS6370676 A JP S6370676A JP 61216337 A JP61216337 A JP 61216337A JP 21633786 A JP21633786 A JP 21633786A JP S6370676 A JPS6370676 A JP S6370676A
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JP
Japan
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speed
frequency
output
playback
circuit
Prior art date
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Pending
Application number
JP61216337A
Other languages
Japanese (ja)
Inventor
Toshifumi Fujii
敏史 藤井
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Mitsubishi Electric Corp
Original Assignee
Mitsubishi Electric Corp
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Filing date
Publication date
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Publication of JPS6370676A publication Critical patent/JPS6370676A/en
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  • Television Signal Processing For Recording (AREA)

Abstract

PURPOSE:To perform excellent variable-speed reproduction by using a couple of heads and a field memory by providing a run control circuit which controls tape running speed at the time of the variable-speed reproduction to specific times as fast as in recording. CONSTITUTION:When the variable-speed reproduction is performed at an (N+0.5)-fold speed, the frequency ratio of input signals of frequency converting circuits 21 and 22 is set as shown by a table in a figure and a magnetic tape 1 travels (n+0.5) times as fast as in recording. When N = 3, namely, when the speed is 3.5 times, the relation between recording tracks and scanning tracks of heads is as shown in a figure (a). Hatched parts of the tracks are reproduced by the heads 2a and 2b through azimuth effect. The output of an envelope detecting circuit 7 is repeated i a pattern in a figure (b) which has four field periods as one cycle. A comparator 8 compares the output of a circuit 7 with a level Vt1 and outputs a signal indicating the large/small relation. A memory control circuit 9 writes the output of a video signal processing circuit 5 in the field memory 6 when the output of the circuit 7 is larger than Vt1. Therefore, a video signal is stored in the memory 6 in a pattern in a figure (c).

Description

【発明の詳細な説明】 〔産業上の利用分野〕 この発明は、フィールドメモリを用いて変速再生を行な
うようにした映像記録再生装置(以下VTRという)に
関するものである。
DETAILED DESCRIPTION OF THE INVENTION [Field of Industrial Application] The present invention relates to a video recording and reproducing apparatus (hereinafter referred to as a VTR) that uses a field memory to perform variable speed reproduction.

〔従来の技術〕[Conventional technology]

従来、VTRの特殊再生(静止画再生および変速再生)
の高画質化はテープ走行制御の高精度化と特殊再生用ヘ
ッドの採用等によって実現でれてきた。一方、最近のメ
モリ等半導体製品の低価格化に伴ない、フィールドメモ
リをVTR内に備えて特殊再生を良゛好に行なうように
したものがある。
Traditionally, VTR special playback (still image playback and variable speed playback)
Higher image quality has been achieved by increasing the precision of tape running control and using special playback heads. On the other hand, as semiconductor products such as memories have become cheaper in recent years, some VTRs have been equipped with field memories to enable better special playback.

この際、テープ走行制御の簡素化が可能となる。At this time, tape running control can be simplified.

以下、フィールドメモリを用いて行なう静止画再生と高
速再生について説明する。なお、VTRとしてはVH8
方式のものを使用する。すなわち、記録モードとして標
準モード(トラックピッチ58μm)と3倍モード(記
録時のテープ走行速度が標準モードの届、トラックピッ
チ19μm)、また映像信号記録再生用回転ヘッド(以
下回転ヘッドという)は2個であシ、ヘッド幅は共に2
9μmである。
Still image playback and high-speed playback performed using field memory will be described below. In addition, as a VTR, VH8
Use the method. In other words, there are two recording modes: standard mode (track pitch 58 μm) and triple mode (tape running speed during recording reaches standard mode, track pitch 19 μm), and two rotary heads for video signal recording and playback (hereinafter referred to as rotary heads). Both head widths are 2.
It is 9 μm.

静止画再生は、通常再生時にフィールドメモリの内容全
書替え続けておき、静止画再生指令が出たときに直前の
フィールドの映像信号をフィールドメモリから読出し続
けると七によシ行なえる。
Still picture playback can be accomplished seven times by continuing to rewrite the entire contents of the field memory during normal playback, and by continuing to read the video signal of the immediately previous field from the field memory when a still picture playback command is issued.

この方式は積率/3倍モードによらず従来必要であった
テープの最適停止位置制御が不要となる。
This method eliminates the need for optimal tape stop position control, which was necessary in the past, regardless of the multiplication factor/3x mode.

次に高速再生モードについて説明する。第4図はフィー
ルドメモリを使った従来のVTRの高速再生系を示し、
1は記録済与磁気テープ、2a。
Next, the high-speed playback mode will be explained. Figure 4 shows a conventional VTR high-speed playback system using field memory.
1 is a recorded magnetic tape; 2a;

2bは互いにアジマスが異なる回転ヘッド、3a。2b is a rotary head having different azimuths; 3a;

3bは両回転ヘッド2a+2bの出力全増幅するヘッド
アンプ、4はこのアンプ3a、3bの何れか一方の出力
を選択する切替回路、5はFM復調を行なってビデオ信
号を得ると共に同期信号の検出も行なうビデオ信号処理
回路、6はフィールドメモリ、7は再生FM信号のエン
ベロープを取出すエンベロープ検波回路、8はこの検波
囲路7の出力′t−所定のレベルと比較するコンパレー
タ、9はビデオ信号処理回路5から出力される同期信号
とコンノぐレータ8の出力に基づいてフィールドメモリ
6の書込み制御全行ない、読出し制御は同期信号とは非
同期で行なうメモリコントロール回路である。なお、フ
ィールドメモリ6は例えばデュアルポートメモリであシ
、出力ボートとしてランダム出力とシリアル出力をもち
、シリアルボートを使用すればメモリへの書込みと読出
しが非同期で行なえるものである。ここでの動作はフィ
ールドメモリ6へビデオ信号処理回路5からの再生信号
に!込みながらシリアルボートを使用してフィールドメ
モリ6の内gk読出す非同期動作全行なう。一方、10
はコントロールヘッド、11はキヤハスタ/軸1[動用
モータ(以下CPモータという)、12はCPモータ1
1′f:、駆動するモータドライバ、30はモータドラ
イバ々12を制御する走行制御回路、31はCPモータ
11の速度周波数発電機出力(以下FG倍信号いう)を
入力し、第4図の表に示した周波数関係にある信号を出
力する第1の周波数変換回路、32はコントロールヘッ
ド10によシ再生されたコントロール信号を入力し、同
図の表に示した周波数関係にある信号を出力する第2の
周波数変換回路、33は位相制御回路、34は速度制御
回路である。なお、FG信号31とはCPモータ11の
速度周波数発電機の出力で、その周波数は回転数に比例
する。
3b is a head amplifier that amplifies the entire output of both rotary heads 2a+2b; 4 is a switching circuit that selects the output of either one of the amplifiers 3a or 3b; and 5 is a switching circuit that performs FM demodulation to obtain a video signal and also detects a synchronization signal. 6 is a field memory; 7 is an envelope detection circuit for extracting the envelope of the reproduced FM signal; 8 is a comparator for comparing the output 't of this detection circuit 7 with a predetermined level; 9 is a video signal processing circuit This is a memory control circuit that performs all write control of the field memory 6 based on the synchronization signal outputted from the synchronization signal 5 and the output of the connogulator 8, and performs read control asynchronously with the synchronization signal. Note that the field memory 6 is, for example, a dual port memory, and has random output and serial output as an output port, and if the serial port is used, writing and reading to and from the memory can be performed asynchronously. The operation here is to send the playback signal from the video signal processing circuit 5 to the field memory 6! All asynchronous operations such as gk reading from the field memory 6 are performed using the serial port while the data is being read. On the other hand, 10
is the control head, 11 is the gear haster/shaft 1 [driving motor (hereinafter referred to as CP motor), 12 is CP motor 1
1'f: a driving motor driver; 30 is a travel control circuit that controls the motor drivers 12; 31 is a speed frequency generator output (hereinafter referred to as FG multiplication signal) of the CP motor 11; A first frequency conversion circuit 32 outputs a signal having the frequency relationship shown in the table shown in FIG. In the second frequency conversion circuit, 33 is a phase control circuit, and 34 is a speed control circuit. Note that the FG signal 31 is the output of the speed frequency generator of the CP motor 11, and its frequency is proportional to the rotation speed.

次に動作について説明する。M倍速(M=±2゜±4.
±6.・・・;士は走行方向を示し、+は通常再生と同
じ方向であり、−は逆方向である)の高速再生を行なう
場合、第1の周波数変換回路31および第2の周波数変
換回路32の入出力信号間の周波数比は第4図モード/
周波数比の表のように設定され、この結果、磁気テープ
1は記録時のテープ速度のM倍で走行する。記録が標準
モードで行なわれたものとし、M=4とすると記録トラ
ックとヘッドの走査軌跡の関係は第5図(a)となる。
Next, the operation will be explained. M times speed (M=±2°±4.
±6. ... ; indicates the running direction, + indicates the same direction as normal reproduction, and - indicates the opposite direction), the first frequency conversion circuit 31 and the second frequency conversion circuit 32 The frequency ratio between the input and output signals is shown in Figure 4 mode/
The frequency ratios are set as shown in the table, and as a result, the magnetic tape 1 runs at M times the tape speed during recording. Assuming that recording is performed in the standard mode and M=4, the relationship between the recording track and the scanning locus of the head is as shown in FIG. 5(a).

図中、トラックのR,Lはそれぞれヘッド2a。In the figure, tracks R and L are heads 2a, respectively.

2bあるいはこれらと同一のアジマスを有するヘッドに
よって記録されたものであることを示す。
2b or a head having the same azimuth as these.

なお、アジマス効果によシヘッド2a、2bによって再
生されるのはトラックに斜線を施こした部分の信号であ
る。第5図(b)は第4図のエンベロープ検波回路7の
出力を示したものである。トラツクノやターンとヘッド
軌跡の関係は2フイ一ルド期間を周期として〈シ返すの
で(b)のパターンがくシ返し現われることになる。コ
ンノぐレータ回路8ではエンベロープ検波回路7の出力
全所定レベルVto(第5図(ト)〕に破線で示す)と
比較し、その大小関係を表わす信号全メモリコントロー
ル回路9に出力する。メモリコントロール回路9はエン
ベロープ検波回路7の出力が上記所定レベルVto以上
のときにビデオ信号処理回路5の出力をフィールドメモ
リ6に書込むように動作する。したがつてフィールドメ
モリ6においては1フイ一ルド分の映像信号が第5図(
c)のノぐターンで記憶されていることになる。なお、
(C)図において斜線の部分はテープ走行が定常状態に
なってからは曹替えられることがなり部分である。
Note that, due to the azimuth effect, the signals reproduced by the heads 2a and 2b are those from the shaded portions of the track. FIG. 5(b) shows the output of the envelope detection circuit 7 of FIG. The relationship between the track and turn and the head trajectory repeats every two field periods, so the pattern (b) appears repeatedly. The converter circuit 8 compares the output of the envelope detection circuit 7 with a predetermined total level Vto (shown by a broken line in FIG. 5(G)), and outputs a signal representing the magnitude relationship to the total memory control circuit 9. The memory control circuit 9 operates to write the output of the video signal processing circuit 5 into the field memory 6 when the output of the envelope detection circuit 7 is above the predetermined level Vto. Therefore, in the field memory 6, the video signal for one field is shown in FIG.
It will be memorized at the Nogu turn in c). In addition,
In the diagram (C), the shaded area is the area where the tape is replaced after the tape running reaches a steady state.

フィールドメモリ6からの読出しは書込み動作とは非同
期で行なわれる。第5図(c)においてエンベロープレ
ベルが大きいところではS/N のよい再生画像が得ら
れるが、エンベロープレベルが/JXさいところではS
/N が低下し見苦しい画面となる。1だ、(e)図の
斜線の部分は画面上では固定絵柄の帯となって現われ視
覚上好壕しくない。一方、3倍モードで記録されたテー
プを高速再生する場合にllJ:第6図にM=4の場合
のフィールドメモリ6の状態を示すように、ガードノぐ
ンドがないのでS/N が低下することもなく、また固
定絵柄の帯が表われることもなく良好な再生画面が得ら
れる。
Reading from field memory 6 is performed asynchronously with the writing operation. In Fig. 5(c), a reproduced image with good S/N can be obtained where the envelope level is large, but when the envelope level is /JX small, the S
/N decreases, resulting in an unsightly screen. 1. (e) The shaded area in the diagram appears as a band of fixed patterns on the screen, which is visually unattractive. On the other hand, when playing back a tape recorded in 3x mode at high speed, the S/N decreases because there is no guard node, as shown in Figure 6, which shows the state of the field memory 6 when M = 4. A good reproduction screen can be obtained without any problems or the appearance of fixed picture bands.

〔発明が解決しようとする問題点〕[Problem that the invention seeks to solve]

従来のVTRは以上のように構成されているので、記録
モードが複数個あるVTRにおいて、フィールドメモリ
を用いて各モード共良好な高速再生画面を得るためには
、複数対のヘッドが必要であった。なお、上記VH8方
式のVTRにおいては標準モード専用ヘッドと3倍モー
ド専用ヘッドとが必要になる。このように従来の構成で
は各モードで良好な高速再生全実現しようとすると、フ
ィールドメモリを採用したにも拘わらずヘッド数の削減
ができないことになシ、価値の点で問題があった。
Conventional VTRs are configured as described above, so in a VTR with multiple recording modes, multiple pairs of heads are required in order to use field memory to obtain a good high-speed playback screen in each mode. Ta. Note that the VH8 system VTR requires a head dedicated to the standard mode and a head dedicated to the 3x mode. As described above, when trying to achieve good high-speed playback in all modes with the conventional configuration, the number of heads could not be reduced even though field memory was used, which caused a problem in terms of value.

この発明は上記のような問題唐を解消するためになされ
たもので、複数の記録モードを有するVTRにおいて、
1対のヘッドおよびフィールドメモリを用いて良好な変
速再生を実現することのできる映像記録再生装置を得る
ことを目的とする。
This invention was made to solve the above-mentioned problems, and in a VTR having multiple recording modes,
It is an object of the present invention to provide a video recording and reproducing device that can realize good variable speed reproduction using a pair of heads and a field memory.

〔問題点を解決するための手段〕[Means for solving problems]

この発明に係る映像記録再生装置は、変速再生時のテー
プ走行速度を記録時の(N+0.5)倍に制御する走行
制御回路を備えたものである。
The video recording and reproducing apparatus according to the present invention includes a running control circuit that controls the tape running speed during variable speed playback to (N+0.5) times the tape running speed during recording.

〔作 用〕[For production]

この発明における映像記録再生装置は、上記のように構
成したので、変速再生時のトラックノぐターンとヘッド
軌跡の関係は4フイールドを1周期とするものになシ、
これによってガードノ々ンドが有する場合でもS/Hの
低下や固定絵柄の帯がない良好な変速再生画面となる作
用が得られる。
Since the video recording and reproducing apparatus according to the present invention is configured as described above, the relationship between the track turn and the head trajectory during variable speed reproduction is such that one period is 4 fields.
As a result, even in the case of a guard node, it is possible to obtain a good variable speed playback screen without a decrease in S/H or a fixed pattern band.

〔実施例〕〔Example〕

以下、この発明の一実施例を図について説明する。第1
図において、符号1〜12は第4図に示した従来の装置
と同一である。20はCPモータ11全駆動するモータ
ドライノ々12を制御する走行制御回路であって、21
はCPモータ11のFG倍信号入力し、第1図の表に示
した周波数関係にある信号を出力する第1の周波数変換
回路、22はコントロールヘッドIOKよシ再生された
コントロール信号全入力し、表に示した周波数関係にあ
る信号を出力する第2の周波数変換回路、23は第2の
周波数変換回路22の出力を用いてCPモータ11を位
相制御する位相制御回路、24は第1の周波数変換回路
の出力を用いてCPモータ11を速度制御する速度制御
回路である。
An embodiment of the present invention will be described below with reference to the drawings. 1st
In the figure, numerals 1 to 12 are the same as those of the conventional device shown in FIG. Reference numeral 20 denotes a travel control circuit for controlling the motor dryer noses 12 that fully drives the CP motor 11;
22 is a first frequency conversion circuit which inputs the FG multiplied signal of the CP motor 11 and outputs a signal having the frequency relationship shown in the table of FIG. a second frequency conversion circuit that outputs signals having the frequency relationship shown in the table; 23, a phase control circuit that controls the phase of the CP motor 11 using the output of the second frequency conversion circuit 22; 24, a first frequency This is a speed control circuit that controls the speed of the CP motor 11 using the output of the conversion circuit.

次に動作について説明する。(N+0.5)倍速(N=
O,±1.±2.・・・)の変速再生を行なう場合、第
1および第2の周波数変換回路21.22の入出力信号
間の周波数比は第1図モード/周波数比の表のように設
定され、この結果、磁気テープ1は記録時のテープ速度
の(N+0.5)倍で走行する。
Next, the operation will be explained. (N+0.5) double speed (N=
O, ±1. ±2. ...), the frequency ratio between the input and output signals of the first and second frequency conversion circuits 21 and 22 is set as shown in the mode/frequency ratio table in Figure 1, and as a result, The magnetic tape 1 runs at (N+0.5) times the tape speed during recording.

かくして従来例と同様にVH8方式のVTR’e例にと
シヘッド幅は29μmとする。記録が標準モードで行な
われたものとし、N=3すなわち、3.5倍速の場合を
考えると、記録トラックとヘッドの走査軌跡の関係は第
2図(a)のようになる。アジマス効果によシ各ヘッド
2a、2bによって再生されるのはトラックに斜fsを
施こした部分の信号である。第2図(b)はエンベロー
プ検波回路7の出力を示したものである。トラックノ々
ターンとヘッド軌跡の関係は4フイ一ルド期間全周期と
してくシ返すので(b)図のパターンがくり返し現われ
ることになる。コン7ぐレータ回路8ではエンベロープ
検波回路7の出方を破線で示す所定レベルVtxと比較
し、その大小関係を表わす信号をメモリコントロール回
路9に出力する。このメモリコントロール回路9はエン
ベロープ検波回路7の出力が上記所定レベルVt1以上
のときにビデオ信号処理回路5の出力をフィールドメモ
リ6に曹込むように動作する。したがってフィールドメ
モリ6においては1フイ一ルド分の映像信号が(C)図
のノぐターンで記憶されていることになる。
Thus, as in the conventional example, the head width of the VH8 system VTR'e example is set to 29 μm. Assuming that recording is performed in the standard mode and considering N=3, that is, 3.5 times the speed, the relationship between the recording track and the scanning locus of the head is as shown in FIG. 2(a). Due to the azimuth effect, each head 2a, 2b reproduces the signal of the portion where the track is obliquely fs. FIG. 2(b) shows the output of the envelope detection circuit 7. Since the relationship between the track no-turns and the head locus repeats over the entire four-field period, the pattern shown in FIG. 3(b) appears repeatedly. The converter circuit 8 compares the output of the envelope detection circuit 7 with a predetermined level Vtx shown by a broken line, and outputs a signal representing the magnitude relationship to the memory control circuit 9. This memory control circuit 9 operates to store the output of the video signal processing circuit 5 into the field memory 6 when the output of the envelope detection circuit 7 is above the predetermined level Vt1. Therefore, in the field memory 6, the video signal for one field is stored in the turn shown in FIG.

ここでこの発明による第2図(b)、(ei従来の第5
図(b)、(c)と比較すると、この発明の場合は設定
値N’tlをVjo、!ニジも太きぐ選ぶことが可能で
あり、丑だフィールドメモリに記憶されている映像信号
は全て4フイ一ルド周期で書替えられる。
Here, FIG. 2(b) according to the present invention, (ei the conventional fifth
Comparing with Figures (b) and (c), in the case of this invention, the set value N'tl is set to Vjo,! It is also possible to select a wide or thick width, and all video signals stored in the field memory are rewritten every 4 fields.

フィールドメモリ6からの読出しは書込み動作とは非同
期で行なわれる。第2図(C)に示したようにフィール
ドメモリ6に記憶されているのは再生信号のエンベロー
プレベルが比較的大きな部分であるから、読出される映
像信号のS/N が低下して画面が見苦しくなるような
ことはなく、また、4フイールド毎に全てのデータが書
替えられているので固定絵柄の帯が発止することもない
Reading from field memory 6 is performed asynchronously with the writing operation. As shown in FIG. 2(C), what is stored in the field memory 6 is a portion with a relatively large envelope level of the reproduced signal, so the S/N of the read video signal decreases and the screen is distorted. It does not look unsightly, and since all the data is rewritten every 4 fields, there are no fixed patterns.

第3図は3倍モードで記録されたテープを3.5倍速(
N=3)再生した場合のフィールドメモリ6の状態を示
したものである。この場合はガーにノ々ンドがない状態
で記録されているのでエンベロープの低下は殆んどなく
極めて良好な変速再生全実現できる。
Figure 3 shows a tape recorded in 3x mode at 3.5x speed (
N=3) This shows the state of the field memory 6 when played back. In this case, since the data is recorded without any knots in the gar, there is almost no drop in the envelope and extremely good variable speed playback can be achieved.

なお、実施例ではN=3の場合について説明したが、N
が他の整数、N=0.±1.±1、±2…の場合にも同
様の動作が得られる。また、実施例ではアジマス記録を
行な5s合′ft:扱ったが、同一アジマスの2ヘツド
でガードノ々ンドを設は記録する場合に適用しても同様
の動作が得られる。このことは第2図(aJから容易に
予測できる。この際、2フイ一ルド期間を1周期として
フィールドメモリのデータが書替えられる。
In addition, although the case where N=3 was explained in the embodiment, N
is another integer, N=0. ±1. A similar operation can be obtained in the case of ±1, ±2, . . . . Further, in the embodiment, azimuth recording is performed and treated as 5s/'ft:, but the same operation can be obtained even if applied to the case where guard nodes are set and recorded with two heads of the same azimuth. This can be easily predicted from FIG. 2 (aJ). At this time, the data in the field memory is rewritten with two field periods as one cycle.

〔発明の効果〕〔Effect of the invention〕

以上説明したようにこの発明によれば、変速再生時にテ
ープ走行速度を記録時の(N+0.51倍に制御し、フ
ィールドメモリを用いて変速再生画像を得るようにした
ので、1mの回転ヘッドを複数の記録モードで兼用する
VTRにおいても良好な変速再生を行なうことができる
As explained above, according to the present invention, the tape running speed during variable speed playback is controlled to (N+0.51 times) that of recording, and the field memory is used to obtain variable speed playback images, so that a 1 m rotary head can be used. Good variable speed playback can be performed even in a VTR that is used in multiple recording modes.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図はこの発明の一実施例による映像記録再生装置の
ブロック回路とモード/周波数比を示す図、第2図(a
)〜(c)および第3図はこの発明装置の動作説明1シ
1、第4図は従来の映像記録再生装置のブロック回路と
モード/周波数比を示す図、第5図(al〜(C)およ
び第6図は従来装置の動作説明図である。 1・・・磁気テープ、2a、2b・・・回転ヘッド、5
・・・ビデオ信号処理回路、6・・・フィールドメモリ
、7°・・工y ヘo−フ検波回路、8・・・コンパレ
ータ回路、9・・・メモリコントロール回路、11・・
・CP%−タ、20・・・走行制御回路、21・・・第
1の周波数変換回路、21、±2…第2の周波数変換回
路、23・・・位相制御回路、24・・・速度制御回路
。 なお、図中同一符号は同−又は相当部分を示す。
FIG. 1 is a diagram showing a block circuit and mode/frequency ratio of a video recording/reproducing apparatus according to an embodiment of the present invention, and FIG.
) to (c) and FIG. 3 are diagrams illustrating the operation of the device according to the present invention, FIG. ) and FIG. 6 are explanatory diagrams of the operation of the conventional apparatus. 1... Magnetic tape, 2a, 2b... Rotating head, 5
. . . Video signal processing circuit, 6 . . Field memory, 7° . . .
・CP%-ta, 20... Travel control circuit, 21... First frequency conversion circuit, 21, ±2... Second frequency conversion circuit, 23... Phase control circuit, 24... Speed control circuit. Note that the same reference numerals in the figures indicate the same or equivalent parts.

Claims (2)

【特許請求の範囲】[Claims] (1)変速再生時に記録済み磁気テープからの再生信号
レベルが所定レベル以上のとき、上記再生信号をフィー
ルドメモリに記憶し、この記憶された内容を再生信号の
同期信号と非同期で読出す映像記録再生装置において、
上記変速再生時の磁気テープの走行速度を記録時の(N
+0.5)倍、(N=0、±1、±2…)に制御する走
行制御回路を備えたことを特徴とする映像記録再生装置
(1) When the playback signal level from the recorded magnetic tape is higher than a predetermined level during variable speed playback, the playback signal is stored in the field memory, and the stored contents are read out asynchronously with the synchronization signal of the playback signal.Video recording In the playback device,
The running speed of the magnetic tape during variable-speed playback mentioned above is (N
+0.5) times (N=0, ±1, ±2, . . . ).
(2)走行制御回路はキャパスタン軸駆動用モータの速
度周波数発電機出力を入力し周波数が該発電機出力周波
数の1/(1N+0.51)である信号を出力する第1
の周波数変換回路と、記録済みテープから再生されるコ
ントロール信号を入力し、N=0.1のときは周波数が
再生コントロール信号周波数と同一である信号を出力し
、N≠0.1のときは周波数が再生コントロール信号周
波数の1/(21N+0.51)である信号を出力する
第2の周波数変換回路と、上記第1の周波数変換回路の
出力を用いて上記キャパスタン軸駆動用モータを速度制
御する速度制御回路と、第2の周波数変換回路の出力を
用いてキャパスタン軸駆動用モータを位相制御する位相
制御回路とを備えたことを特徴とする特許請求の範囲第
1項記載の映像記録再生装置。
(2) The travel control circuit inputs the speed frequency generator output of the capacitor stun shaft drive motor and outputs a signal whose frequency is 1/(1N+0.51) of the generator output frequency.
input the frequency conversion circuit and the control signal played back from the recorded tape, and when N=0.1 outputs a signal whose frequency is the same as the playback control signal frequency, and when N≠0.1 A second frequency conversion circuit outputs a signal whose frequency is 1/(21N+0.51) of the reproduction control signal frequency, and the output of the first frequency conversion circuit is used to control the speed of the capacitor shaft drive motor. and a phase control circuit that controls the phase of the capacitor shaft drive motor using the output of the second frequency conversion circuit. playback device.
JP61216337A 1986-09-12 1986-09-12 Video recording and reproducing device Pending JPS6370676A (en)

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