JPS6355070B2 - - Google Patents
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- Publication number
- JPS6355070B2 JPS6355070B2 JP57164421A JP16442182A JPS6355070B2 JP S6355070 B2 JPS6355070 B2 JP S6355070B2 JP 57164421 A JP57164421 A JP 57164421A JP 16442182 A JP16442182 A JP 16442182A JP S6355070 B2 JPS6355070 B2 JP S6355070B2
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- Japan
- Prior art keywords
- character
- signal
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- Prior art date
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- 239000011159 matrix material Substances 0.000 claims description 2
- 238000010586 diagram Methods 0.000 description 3
- 230000004044 response Effects 0.000 description 3
- 101100262374 Saccharomyces cerevisiae (strain ATCC 204508 / S288c) CDC21 gene Proteins 0.000 description 1
- 239000002131 composite material Substances 0.000 description 1
- 238000003384 imaging method Methods 0.000 description 1
- 230000001788 irregular Effects 0.000 description 1
Landscapes
- Controls And Circuits For Display Device (AREA)
Description
【発明の詳細な説明】
本発明はラスター走査される陰極線管(以下
CRTと記す)に文字、数字或いは記号等(本明
細書では単に文字と略称する)を表示する表示装
置に関し、特に走査電子顕微鏡の如く走査速度、
走査線数が大幅に変化する観察用CRTを持つ装
置に用いて好適な文字表示装置に関する。
CRTと記す)に文字、数字或いは記号等(本明
細書では単に文字と略称する)を表示する表示装
置に関し、特に走査電子顕微鏡の如く走査速度、
走査線数が大幅に変化する観察用CRTを持つ装
置に用いて好適な文字表示装置に関する。
例えば、走査電子顕微鏡等においては、CRT
に試料像に重畳して該像の撮像条件(倍率、加速
電圧等)を示す文字を表示することが行われてい
る。この文字表示は1行に限らず複数行となる場
合もある。文字表示は、垂直走査信号に対応して
得られる垂直番地によつてキヤラクタジエネレー
タをアドレス指定し、ドツトパターン(通常8×
8ドツトで構成されている)の1行8ビツトを並
列的に読み出し、これを並列・直列変換器を介し
て水平走査信号に対応して得られる水平番地に同
期して1ドツトずつ出力し、ビデオ信号に加算し
てCRT上に表示することによつてなされる。
に試料像に重畳して該像の撮像条件(倍率、加速
電圧等)を示す文字を表示することが行われてい
る。この文字表示は1行に限らず複数行となる場
合もある。文字表示は、垂直走査信号に対応して
得られる垂直番地によつてキヤラクタジエネレー
タをアドレス指定し、ドツトパターン(通常8×
8ドツトで構成されている)の1行8ビツトを並
列的に読み出し、これを並列・直列変換器を介し
て水平走査信号に対応して得られる水平番地に同
期して1ドツトずつ出力し、ビデオ信号に加算し
てCRT上に表示することによつてなされる。
ところで、キヤラクタジエネレータの出力デー
タはアクセスタイムの間不定となつているが、水
平方向の走査期間中に垂直番地が変化すると、こ
の不定の出力が並列・直列変換器に取り込まれる
場合があり、その時ここで変換し出力されたデー
タがCRT上に表示され画面上にノイズとして現
われるという問題があつた。
タはアクセスタイムの間不定となつているが、水
平方向の走査期間中に垂直番地が変化すると、こ
の不定の出力が並列・直列変換器に取り込まれる
場合があり、その時ここで変換し出力されたデー
タがCRT上に表示され画面上にノイズとして現
われるという問題があつた。
本発明は、このような点に鑑みてなされたもの
で、その目的とするところは、水平方向の走査期
間中は垂直番地が変わらないようにして、キヤラ
クタジエネレータの不定の出力が並列・直列変換
器に取り込まれないように抑制し、CRT上のノ
イズ出現を防止するようにした文字表示装置を提
供することにある。
で、その目的とするところは、水平方向の走査期
間中は垂直番地が変わらないようにして、キヤラ
クタジエネレータの不定の出力が並列・直列変換
器に取り込まれないように抑制し、CRT上のノ
イズ出現を防止するようにした文字表示装置を提
供することにある。
本発明の特徴とするところは、キヤラクタジエ
ネレータをアドレス指定する垂直番地信号を水平
ブランキング信号でラツチすることにより、キヤ
ラクタジエネレータの行指定の番地信号は必ず水
平ブランキング期間に変化し、CRT上には不正
確な表示が出ないようにした点である。
ネレータをアドレス指定する垂直番地信号を水平
ブランキング信号でラツチすることにより、キヤ
ラクタジエネレータの行指定の番地信号は必ず水
平ブランキング期間に変化し、CRT上には不正
確な表示が出ないようにした点である。
以下、図面を参照し本発明を詳細に説明する。
第1図は本発明の文字表示装置の一実施例を示
す構成図である。図において、1,2はアナロ
グ・デイジタル変換器(以下A/D変換器と略
す)、3は表示する文字データを予め記憶したメ
モリ、4は垂直番地指定回路、5はキヤラクタジ
エネレータ(以下CGと略す)、6は並列・直列変
換器(以下P/S変換器と略す)、7は加算器、
8は増幅器、9はCRTである。A/D変換器1
は、鋸歯状波形を持つ水平走査信号Hをその周期
に比べて十分に短い周期でデイジタル信号に変換
して出力するもので、本実施例ではCRT9上に
水平方向には8×8ドツト1文字を32個表示する
場合を例にとつているので、8ビツト構成の出力
が得られるようになつている。即ち、8ビツトの
中、上位5ビツトが各文字の位置に、下位3ビツ
トが1文字中のドツトの位置にそれぞれ対応す
る。又、A/D変換器2は、同様に、鋸歯状波形
を持つ垂直走査信号Vをその周期よりも十分に短
い周期でデイジタル信号に変換して出力するもの
で、CRT9上に垂直方向には16個表示するよう
にしたため、7ビツト構成の出力を得るように構
成してある。そして7ビツトの中、上位4ビツト
が各文字の位置に、下位3ビツトが1文字中のド
ツト列の各行にそれぞれ対応している。この上位
4ビツト下位3ビツトのデータは垂直番地指定回
路4に導かれ、水平走査の帰線時に出る水平ブラ
ンキング信号によりラツチされるようになつてい
る。メモリ3は1画面中に表示すべき文字データ
がCRT画面に対応した番地に格納されている。
その文字データは図示しないコンピユータ等によ
り予め格納されるようになつている。各文字デー
タの番地指定はA/D変換器1,2の出力によつ
て行われる。即ち、A/D変換器1の上位5ビツ
トで水平方向の番地が、又垂直番地指定回路4の
上位4ビツトで垂直方向の番地がそれぞれ指定さ
れるようになつている。CG5は、多数の文字を
それぞれ8×8ドツトのドツトマトリクスで構成
されたパターンで記憶している文字発生器で、メ
モリ3より出力される文字データ(A0〜A7)に
よつて文字の指定が可能である。更に、指定され
た当該文字のパターンの中、どのドツト列を出力
するかは垂直番地指定回路4の下位3ビツトによ
つて指定されるようになつている。CG5より発
生した並列ドツト列信号はP/S変換器6に送ら
れる。P/S変換器6にはA/D変換器1の下位
3ビツトの出力が与えられており、その3ビツト
の水平番地に基づいて並列ドツト列信号を時間的
に直列な文字信号に変換し加算器7に送る。加算
器7ではこの文字信号と像信号(ビデオ信号)を
加算し、得られた合成信号は増幅器8を介して
CRT9のグリツドに輝度信号として送られるよ
うになつている。
す構成図である。図において、1,2はアナロ
グ・デイジタル変換器(以下A/D変換器と略
す)、3は表示する文字データを予め記憶したメ
モリ、4は垂直番地指定回路、5はキヤラクタジ
エネレータ(以下CGと略す)、6は並列・直列変
換器(以下P/S変換器と略す)、7は加算器、
8は増幅器、9はCRTである。A/D変換器1
は、鋸歯状波形を持つ水平走査信号Hをその周期
に比べて十分に短い周期でデイジタル信号に変換
して出力するもので、本実施例ではCRT9上に
水平方向には8×8ドツト1文字を32個表示する
場合を例にとつているので、8ビツト構成の出力
が得られるようになつている。即ち、8ビツトの
中、上位5ビツトが各文字の位置に、下位3ビツ
トが1文字中のドツトの位置にそれぞれ対応す
る。又、A/D変換器2は、同様に、鋸歯状波形
を持つ垂直走査信号Vをその周期よりも十分に短
い周期でデイジタル信号に変換して出力するもの
で、CRT9上に垂直方向には16個表示するよう
にしたため、7ビツト構成の出力を得るように構
成してある。そして7ビツトの中、上位4ビツト
が各文字の位置に、下位3ビツトが1文字中のド
ツト列の各行にそれぞれ対応している。この上位
4ビツト下位3ビツトのデータは垂直番地指定回
路4に導かれ、水平走査の帰線時に出る水平ブラ
ンキング信号によりラツチされるようになつてい
る。メモリ3は1画面中に表示すべき文字データ
がCRT画面に対応した番地に格納されている。
その文字データは図示しないコンピユータ等によ
り予め格納されるようになつている。各文字デー
タの番地指定はA/D変換器1,2の出力によつ
て行われる。即ち、A/D変換器1の上位5ビツ
トで水平方向の番地が、又垂直番地指定回路4の
上位4ビツトで垂直方向の番地がそれぞれ指定さ
れるようになつている。CG5は、多数の文字を
それぞれ8×8ドツトのドツトマトリクスで構成
されたパターンで記憶している文字発生器で、メ
モリ3より出力される文字データ(A0〜A7)に
よつて文字の指定が可能である。更に、指定され
た当該文字のパターンの中、どのドツト列を出力
するかは垂直番地指定回路4の下位3ビツトによ
つて指定されるようになつている。CG5より発
生した並列ドツト列信号はP/S変換器6に送ら
れる。P/S変換器6にはA/D変換器1の下位
3ビツトの出力が与えられており、その3ビツト
の水平番地に基づいて並列ドツト列信号を時間的
に直列な文字信号に変換し加算器7に送る。加算
器7ではこの文字信号と像信号(ビデオ信号)を
加算し、得られた合成信号は増幅器8を介して
CRT9のグリツドに輝度信号として送られるよ
うになつている。
このような構成における本発明装置の動作を次
に説明する。水平走査信号をA/D変換器1で
A/D変換し、水平方向アドレス(Hアドレス)
を得る。同時にA/D変換器2で垂直走査信号を
A/D変換し垂直方向のアドレス(Vアドレス)
を得る。8ビツト構成のHアドレスの中の上位5
ビツトと、7ビツト構成のVアドレスの中の上位
4ビツトでメモリ3へのアドレスを構成する。メ
モリ3は指定されたアドレスに記憶された文字デ
ータ(8ビツト)を送出する。CG5はこれを受
けて、第2図イに示すような8×8ドツトパター
ンの文字パターン(数字8を示す)を選択する。
この文字パターンは第2図ロに示すように0、1
信号として記憶されたものである。一方、垂直番
地指定回路4では1文字分の垂直方向のアドレス
をA/D変換器2より得、これをCG5に与えて
いる。CGは前記指定された文字パターンの中、
このアドレスに該当する行のドツト列データD0
〜D7を並列出力する。P/S変換器6はA/D
変換器1の出力するHアドレスの下位3ビツトに
基づきD7からD0へと順次出力する。例えばCRT
上で文字パターンの第2行目を表示する際には、
CG5には垂直番地として001が与えられ、これに
より00011110のパターン信号がP/S変換器6に
与えられる。P/S変換器6はHアドレス下位3
ビツトが0、1、2、3、…、6、7と変化する
のと同期して0、0、0、1、…、1、0と順次
出力する。この文字信号の0は黒レベル、1は白
レベルの輝度信号に対応するもので、加算器7で
ビデオ信号(ビデオ信号のない場合もある)に重
畳され、増幅器8を経てCRT9に与えられる。
このようにして文字パターンの1行分(D0〜D7)
がドツト表示される。
に説明する。水平走査信号をA/D変換器1で
A/D変換し、水平方向アドレス(Hアドレス)
を得る。同時にA/D変換器2で垂直走査信号を
A/D変換し垂直方向のアドレス(Vアドレス)
を得る。8ビツト構成のHアドレスの中の上位5
ビツトと、7ビツト構成のVアドレスの中の上位
4ビツトでメモリ3へのアドレスを構成する。メ
モリ3は指定されたアドレスに記憶された文字デ
ータ(8ビツト)を送出する。CG5はこれを受
けて、第2図イに示すような8×8ドツトパター
ンの文字パターン(数字8を示す)を選択する。
この文字パターンは第2図ロに示すように0、1
信号として記憶されたものである。一方、垂直番
地指定回路4では1文字分の垂直方向のアドレス
をA/D変換器2より得、これをCG5に与えて
いる。CGは前記指定された文字パターンの中、
このアドレスに該当する行のドツト列データD0
〜D7を並列出力する。P/S変換器6はA/D
変換器1の出力するHアドレスの下位3ビツトに
基づきD7からD0へと順次出力する。例えばCRT
上で文字パターンの第2行目を表示する際には、
CG5には垂直番地として001が与えられ、これに
より00011110のパターン信号がP/S変換器6に
与えられる。P/S変換器6はHアドレス下位3
ビツトが0、1、2、3、…、6、7と変化する
のと同期して0、0、0、1、…、1、0と順次
出力する。この文字信号の0は黒レベル、1は白
レベルの輝度信号に対応するもので、加算器7で
ビデオ信号(ビデオ信号のない場合もある)に重
畳され、増幅器8を経てCRT9に与えられる。
このようにして文字パターンの1行分(D0〜D7)
がドツト表示される。
水平方向の次の文字表示は前述と同様な動作に
より表示される。このようにして1水平方向にお
ける文字表示が終わると次の行のドツト列につい
て上述と同様の動作を繰り返して表示が行われ
る。この場合、垂直番地指定回路4は常に水平ブ
ランキング信号でVアドレスをラツチして出力す
るので、もしA/D変換器2のVアドレスが途中
で変化したとしても1水平走査期間中には出力は
変化しないようになつている。従つて、水平走査
中におけるCG5の不定な出力を表示するような
ことはなく、ノイズのない良質の文字表示が保証
されることとなる。
より表示される。このようにして1水平方向にお
ける文字表示が終わると次の行のドツト列につい
て上述と同様の動作を繰り返して表示が行われ
る。この場合、垂直番地指定回路4は常に水平ブ
ランキング信号でVアドレスをラツチして出力す
るので、もしA/D変換器2のVアドレスが途中
で変化したとしても1水平走査期間中には出力は
変化しないようになつている。従つて、水平走査
中におけるCG5の不定な出力を表示するような
ことはなく、ノイズのない良質の文字表示が保証
されることとなる。
以上説明したように、本発明によれば、キヤラ
クタジエネレータをアドレス指定する垂直番地は
水平ブランキング信号に同期して変化し得るよう
にしたもので、水平走査期間中に垂直番地が変化
して不定な文字パターンを表示し表示文字中にノ
イズが混入するというような弊害を防ぐことがで
きる。
クタジエネレータをアドレス指定する垂直番地は
水平ブランキング信号に同期して変化し得るよう
にしたもので、水平走査期間中に垂直番地が変化
して不定な文字パターンを表示し表示文字中にノ
イズが混入するというような弊害を防ぐことがで
きる。
第1図は本発明に係る文字表示装置の一実施例
を示す構成図、第2図は文字パターンの一例を示
す図である。 1,2……A/D変換器、3……メモリ、4…
…垂直番地指定回路、5……キヤラクタジエネレ
ータ、6……P/S変換器、9……CRT。
を示す構成図、第2図は文字パターンの一例を示
す図である。 1,2……A/D変換器、3……メモリ、4…
…垂直番地指定回路、5……キヤラクタジエネレ
ータ、6……P/S変換器、9……CRT。
Claims (1)
- 1 水平走査信号及び垂直走査信号をデイジタル
変換して得たアドレスに基づき、表示すべき文字
に係る文字データを指定し、多数のドツトマトリ
クス状の文字パターンの中から指示された文字デ
ータに対応する文字パターンを選択し、前記垂直
走査信号をデイジタル変換して得た垂直番地信号
によつて送出すべき行の定められた文字パターン
信号を送出して陰極線管に供給して文字を表示す
る装置において、前記垂直番地信号は水平走査の
ブランキング期間中にのみ変化して文字パターン
の送出すべき行を指定するようにしたことを特徴
とする文字表示装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP57164421A JPS5953889A (ja) | 1982-09-21 | 1982-09-21 | 文字表示装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP57164421A JPS5953889A (ja) | 1982-09-21 | 1982-09-21 | 文字表示装置 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS5953889A JPS5953889A (ja) | 1984-03-28 |
JPS6355070B2 true JPS6355070B2 (ja) | 1988-11-01 |
Family
ID=15792821
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP57164421A Granted JPS5953889A (ja) | 1982-09-21 | 1982-09-21 | 文字表示装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS5953889A (ja) |
Families Citing this family (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS6410560A (en) * | 1987-07-03 | 1989-01-13 | Jeol Ltd | Crt display circuit for electron microscope |
-
1982
- 1982-09-21 JP JP57164421A patent/JPS5953889A/ja active Granted
Also Published As
Publication number | Publication date |
---|---|
JPS5953889A (ja) | 1984-03-28 |
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