JPS6343572A - インバ−タ制御装置 - Google Patents
インバ−タ制御装置Info
- Publication number
- JPS6343572A JPS6343572A JP61185711A JP18571186A JPS6343572A JP S6343572 A JPS6343572 A JP S6343572A JP 61185711 A JP61185711 A JP 61185711A JP 18571186 A JP18571186 A JP 18571186A JP S6343572 A JPS6343572 A JP S6343572A
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- JP
- Japan
- Prior art keywords
- circuit
- inverter
- signal
- short
- failure
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 239000004065 semiconductor Substances 0.000 claims abstract description 16
- 238000001514 detection method Methods 0.000 claims description 30
- 230000002401 inhibitory effect Effects 0.000 abstract 1
- 230000007274 generation of a signal involved in cell-cell signaling Effects 0.000 description 11
- 230000004913 activation Effects 0.000 description 4
- 238000010586 diagram Methods 0.000 description 4
Landscapes
- Inverter Devices (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
[産業上の利用分野コ
この発明は、電動機の速度制御に用いて好適なインバー
タ制御装置に関するものである。
タ制御装置に関するものである。
[従来の技術]
第2図は従来のインバータ制御装置を示す電気回路図で
あり、図において、1は直流電源、2はU相アーム、3
はV相アーム、4はW相アームで。
あり、図において、1は直流電源、2はU相アーム、3
はV相アーム、4はW相アームで。
各相アーム2〜4は2個のトランジスタと各トランジス
タに並列につながれた帰還用ダイオードとを有している
。
タに並列につながれた帰還用ダイオードとを有している
。
5はU、V、W相アーム2,3,4の各トランジスタへ
のON10 F F信号ライン、6は起動停止指令部、
7は故障検出回路、8は故障検出回路7をリセットする
故障リセット回路、9は起動停止指令部6からの指令と
故障検出回路7からの検出信号とによりON10 F
F信号ライン上の信号をII御するための信号を作成す
るゲート信号作成回路、1oはゲート信号作成回路9の
信号により0N10 F F信号ライン上の信号を制御
するゲート回路、11はこのインバータにより駆動され
る電動機である。
のON10 F F信号ライン、6は起動停止指令部、
7は故障検出回路、8は故障検出回路7をリセットする
故障リセット回路、9は起動停止指令部6からの指令と
故障検出回路7からの検出信号とによりON10 F
F信号ライン上の信号をII御するための信号を作成す
るゲート信号作成回路、1oはゲート信号作成回路9の
信号により0N10 F F信号ライン上の信号を制御
するゲート回路、11はこのインバータにより駆動され
る電動機である。
次に動作について説明する。起動停止指令部6からの指
令を起動指令にし、インバータに故障がない場合は、ゲ
ート信号作成回路9の信号により、ON / OF F
信号ライン5を通じて供給される各トランジスタの0N
10FF信号がゲート回路1゜を通り、U相アーム2.
V相アーム3およびW相アーム4の各トランジスタをス
イッチングさせ、直流電源1を可変電圧可変周波数の交
流に変換し、電動機11を駆動する。
令を起動指令にし、インバータに故障がない場合は、ゲ
ート信号作成回路9の信号により、ON / OF F
信号ライン5を通じて供給される各トランジスタの0N
10FF信号がゲート回路1゜を通り、U相アーム2.
V相アーム3およびW相アーム4の各トランジスタをス
イッチングさせ、直流電源1を可変電圧可変周波数の交
流に変換し、電動機11を駆動する。
また、インバータ運転中に過電流や過電圧等が発生した
場合は、故障検出回路7によりこの状態が検出される。
場合は、故障検出回路7によりこの状態が検出される。
そして、ゲート回路1oはゲート信号作成回路9からの
信号により0N10FF信号ラインを遮断し、インバー
タは停止する。
信号により0N10FF信号ラインを遮断し、インバー
タは停止する。
なお、゛再びインバータを運転する場合は、故障リセッ
ト回路8により故障検出回路7をリセットし、起動停止
指令部6からの指令を起動指令とすることが行なねれる
。
ト回路8により故障検出回路7をリセットし、起動停止
指令部6からの指令を起動指令とすることが行なねれる
。
[発明が解決しようとする問題点]
従来のインバータ制御装置は以上にように構成されてい
るので、故障が発生し、インバータを停止させた時、イ
ンバータを構成するスイッチング半導体素子が破壊して
短絡していても、故障リセットを行なうと、インバータ
の再起動が可能となり、その結果他の健全なスイッチン
グ半導体素子までも破壊してしまうという問題点があっ
た。
るので、故障が発生し、インバータを停止させた時、イ
ンバータを構成するスイッチング半導体素子が破壊して
短絡していても、故障リセットを行なうと、インバータ
の再起動が可能となり、その結果他の健全なスイッチン
グ半導体素子までも破壊してしまうという問題点があっ
た。
この発明は上記のような問題点を解消するためになされ
たもので、インバータに故障が発生し、これを停止させ
た時、そのスイッチング半導体素子が壊れて短絡してい
るかどうかを検出して、故障リセットを行なっても、上
記スイッチング半導体素子が短絡している場合は、イン
バータの再起動を阻止し、他の壊れていない健全なスイ
ッチング半導体素子を保護できるようにしたインバータ
制御装置を得ることを目的とする。
たもので、インバータに故障が発生し、これを停止させ
た時、そのスイッチング半導体素子が壊れて短絡してい
るかどうかを検出して、故障リセットを行なっても、上
記スイッチング半導体素子が短絡している場合は、イン
バータの再起動を阻止し、他の壊れていない健全なスイ
ッチング半導体素子を保護できるようにしたインバータ
制御装置を得ることを目的とする。
[問題点を解決するための手段]
この発明に係るインバータ制御装置は、複数のスイッチ
ング半導体素子から成り所望周波数の交流に変換するイ
ンバータをそなえ、上記スイッチング半導体素子が短絡
しているか否かを検出する短絡検出手段を設けるととも
に、同短絡検出手段からの検出結果に基づき上記インバ
ータが起動できるが否かを判別し起動できると判別した
場合は起動許容信号を上記インバータへ出力し起動でき
ないと判別した場合は起動禁止信号を上記インバータへ
出力する起動判別手段を設けたものである。
ング半導体素子から成り所望周波数の交流に変換するイ
ンバータをそなえ、上記スイッチング半導体素子が短絡
しているか否かを検出する短絡検出手段を設けるととも
に、同短絡検出手段からの検出結果に基づき上記インバ
ータが起動できるが否かを判別し起動できると判別した
場合は起動許容信号を上記インバータへ出力し起動でき
ないと判別した場合は起動禁止信号を上記インバータへ
出力する起動判別手段を設けたものである。
[作 用]
この発明におけるインバータ制御装置は、短絡検出手段
によってインバータのスイッチング半導体素手が短絡し
ていないことが検出されると、起動判別手段がインバー
タを起動できると判別して。
によってインバータのスイッチング半導体素手が短絡し
ていないことが検出されると、起動判別手段がインバー
タを起動できると判別して。
インバータへ起動許容信号を出力する。一方、短絡検出
手段によって、インバータのスイッチング半導体素子が
短絡されていることが検出されると、起動判別手段がイ
ンバータを起動することができないと判別して、インバ
ータへ起動禁止信号を出力する。
手段によって、インバータのスイッチング半導体素子が
短絡されていることが検出されると、起動判別手段がイ
ンバータを起動することができないと判別して、インバ
ータへ起動禁止信号を出力する。
[発明の実施例]
以下、この発明の一実施例を図について説明する。第1
図はこの発明の一実施例としてのインバータ制御装置を
示す電気回路図であり、この第1図において、1〜11
で示す部材は第2図に示したものと同一であるので、そ
の説明を省略する。
図はこの発明の一実施例としてのインバータ制御装置を
示す電気回路図であり、この第1図において、1〜11
で示す部材は第2図に示したものと同一であるので、そ
の説明を省略する。
また、12はU相トランジスタ短絡検出回路。
13はV相トランジスタ短絡検出回路、14はW相トラ
ンジスタ短絡検出回路であり、これらのトランジスタ短
絡検出回路12,13.14は抵抗分圧により短絡検出
を行なうものである。15は各トランジスタ短絡検出回
路12,13.14の信号によりインバータを起動可能
か不可能かを判別する起動判別回路で、更にこの起動判
別回路15は、インバータが起動できると判別した場合
は起動許容信号およびトランジスタ健全表示信号をそれ
ぞれインバータのゲート信号作成回路17および短絡故
障表示回路16へ出力し、インバータが起動できないと
判別した場合は起動禁止信号およびトランジスタ故障信
号をそれぞれインバータのゲート信号作成回路17およ
び短絡故障表示回路16へ出力するものである。
ンジスタ短絡検出回路であり、これらのトランジスタ短
絡検出回路12,13.14は抵抗分圧により短絡検出
を行なうものである。15は各トランジスタ短絡検出回
路12,13.14の信号によりインバータを起動可能
か不可能かを判別する起動判別回路で、更にこの起動判
別回路15は、インバータが起動できると判別した場合
は起動許容信号およびトランジスタ健全表示信号をそれ
ぞれインバータのゲート信号作成回路17および短絡故
障表示回路16へ出力し、インバータが起動できないと
判別した場合は起動禁止信号およびトランジスタ故障信
号をそれぞれインバータのゲート信号作成回路17およ
び短絡故障表示回路16へ出力するものである。
16は起動判別回路15からの信号によりトランジスタ
が短絡であるか否かを表示する短絡故障表示回路、17
は起動停止指令部6の信号と故障検出回路7の信号と起
動判別回路15の信号とによりON10 F F信号ラ
イン5の信号を制御するだめの信号を作成するゲート信
号作成回路である。
が短絡であるか否かを表示する短絡故障表示回路、17
は起動停止指令部6の信号と故障検出回路7の信号と起
動判別回路15の信号とによりON10 F F信号ラ
イン5の信号を制御するだめの信号を作成するゲート信
号作成回路である。
次に動作について説明する。起動停止指令部6の指令を
起動指令にし、インバータに故障がない場合、ゲート信
号作成回路17の信号により、各トランジスタの0N1
0FF信号がゲート回路10を通り、U相アーム2.V
相アーム3.W相アーム4の各トランジスタをスイッチ
ングさせ、直流電源1を可変電圧可変周波数の交流に変
換し電動機11を駆動する。
起動指令にし、インバータに故障がない場合、ゲート信
号作成回路17の信号により、各トランジスタの0N1
0FF信号がゲート回路10を通り、U相アーム2.V
相アーム3.W相アーム4の各トランジスタをスイッチ
ングさせ、直流電源1を可変電圧可変周波数の交流に変
換し電動機11を駆動する。
また、インバータ運転中に過電流や過電圧等が発生した
場合はこの状態が故障検出回路7により検出される。
場合はこの状態が故障検出回路7により検出される。
そしてゲート回路10はゲート信号作成回路17からの
信号によりON/○FF信号ライン5を遮断しインバー
タを停止する。
信号によりON/○FF信号ライン5を遮断しインバー
タを停止する。
この時、トランジスタのいずれかが短絡した場合は、U
、V、W各相のトランジスタ短絡検出回路12,13.
14により、この状態が検出され、起動判別回路15に
よって、ゲート信号作成回路17へ起動不可能という信
号を送り、故障りセット回路8により故障検出@路7を
リセットし、起動停止指令部6を起動指令としても起動
できない。
、V、W各相のトランジスタ短絡検出回路12,13.
14により、この状態が検出され、起動判別回路15に
よって、ゲート信号作成回路17へ起動不可能という信
号を送り、故障りセット回路8により故障検出@路7を
リセットし、起動停止指令部6を起動指令としても起動
できない。
またこのとき同時に短絡故障表示回路16に故障表示が
行なわれる。
行なわれる。
なお、故障検出回路7により故障を検出した時、短絡故
障表示回路16に故障表示がされていない場合は、故障
リセット回路8により故障後、“B回路7をリセットし
、起動停止指令部6の起動指令で再びインバータを運転
することができる。
障表示回路16に故障表示がされていない場合は、故障
リセット回路8により故障後、“B回路7をリセットし
、起動停止指令部6の起動指令で再びインバータを運転
することができる。
上記実施例で・は、トランジスタインバータについて説
明したが、スイッチング半導体素子として、サイリスタ
、GTOサイリスタ、FETを用いたインバータにも同
様にして本発明を適用することができ、いずれの素子を
用いても上記実施例と同様の効果を奏する。
明したが、スイッチング半導体素子として、サイリスタ
、GTOサイリスタ、FETを用いたインバータにも同
様にして本発明を適用することができ、いずれの素子を
用いても上記実施例と同様の効果を奏する。
また、上記実施例では、三相出力インバータについて説
明したが、単相出力インバータや他の多相出力インバー
タであってもよく、上記実施例と同様の効果を奏する。
明したが、単相出力インバータや他の多相出力インバー
タであってもよく、上記実施例と同様の効果を奏する。
さらに、上記実施例では、トランジスタの短絡検出を抵
抗分圧により行なうことを説明したが、抵抗と定電圧ダ
イオードとの組合せや絶縁アンプを用いたものであって
もよく、上記実施例と同様の効果を奏する。
抗分圧により行なうことを説明したが、抵抗と定電圧ダ
イオードとの組合せや絶縁アンプを用いたものであって
もよく、上記実施例と同様の効果を奏する。
[発明の効果]
以上のようにこの発明によれば、故障後の再起動時にス
イッチング半導体素子の短絡検出手段からの信号により
、再起動が可能か不可能かを決定するように構成したの
で、短絡したスイッチング半導体素子以外の健全なスイ
ッチング半導体素子を壊さないインバータ制御装置が得
られる効果がある。
イッチング半導体素子の短絡検出手段からの信号により
、再起動が可能か不可能かを決定するように構成したの
で、短絡したスイッチング半導体素子以外の健全なスイ
ッチング半導体素子を壊さないインバータ制御装置が得
られる効果がある。
第1図はこの発明の一実施例としてのインバータ制御装
置を示す電気回路図であり、第2図は従来のインバータ
制御装置を示す電気回路図である。 図において、1−直流電源、2−U相アーム、3−V相
アーム、4−W相アーム、5.−0N10FF信号ライ
ン、6−起動停止指令部、7−故障検出回路、8−故障
リセット回路、9−ゲート信号作成回路、10−ゲート
回路、11−電動機。 12−U相トランジスタ短絡検出回路、13・=−V相
トランジスタ短絡検出回路、14=W相トランジスタ短
絡検出回路、15−起動判別回路、16−・−短絡故障
表示回路、17−・−ゲート信号作成回路6なお、図中
、同一符号は同一、又は相当部分を示す。
置を示す電気回路図であり、第2図は従来のインバータ
制御装置を示す電気回路図である。 図において、1−直流電源、2−U相アーム、3−V相
アーム、4−W相アーム、5.−0N10FF信号ライ
ン、6−起動停止指令部、7−故障検出回路、8−故障
リセット回路、9−ゲート信号作成回路、10−ゲート
回路、11−電動機。 12−U相トランジスタ短絡検出回路、13・=−V相
トランジスタ短絡検出回路、14=W相トランジスタ短
絡検出回路、15−起動判別回路、16−・−短絡故障
表示回路、17−・−ゲート信号作成回路6なお、図中
、同一符号は同一、又は相当部分を示す。
Claims (1)
- 複数のスイッチング半導体素子から成り所望周波数の交
流に変換するインバータをそなえ、上記スイッチング半
導体素子が短絡しているか否かを検出する短絡検出手段
が設けられるとともに、同短絡検出手段からの検出結果
に基づき上記インバータが起動できるが否かを判別し起
動できると判別した場合は起動許容信号を上記インバー
タへ出力し起動できないと判別した場合は起動禁止信号
を上記インバータへ出力する起動判別手段が設けられた
ことを特徴とするインバータ制御装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP61185711A JPS6343572A (ja) | 1986-08-06 | 1986-08-06 | インバ−タ制御装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP61185711A JPS6343572A (ja) | 1986-08-06 | 1986-08-06 | インバ−タ制御装置 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS6343572A true JPS6343572A (ja) | 1988-02-24 |
Family
ID=16175519
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP61185711A Pending JPS6343572A (ja) | 1986-08-06 | 1986-08-06 | インバ−タ制御装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS6343572A (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
WO2013179357A1 (ja) * | 2012-05-31 | 2013-12-05 | 三洋電機株式会社 | 制御装置および配電システム |
-
1986
- 1986-08-06 JP JP61185711A patent/JPS6343572A/ja active Pending
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
WO2013179357A1 (ja) * | 2012-05-31 | 2013-12-05 | 三洋電機株式会社 | 制御装置および配電システム |
JPWO2013179357A1 (ja) * | 2012-05-31 | 2016-01-14 | パナソニックIpマネジメント株式会社 | 制御装置および配電システム |
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