JPS63138398A - メロデイ発生回路 - Google Patents
メロデイ発生回路Info
- Publication number
- JPS63138398A JPS63138398A JP61286485A JP28648586A JPS63138398A JP S63138398 A JPS63138398 A JP S63138398A JP 61286485 A JP61286485 A JP 61286485A JP 28648586 A JP28648586 A JP 28648586A JP S63138398 A JPS63138398 A JP S63138398A
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- circuit
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- Pending
Links
- 238000010586 diagram Methods 0.000 description 11
- 230000010355 oscillation Effects 0.000 description 6
- 230000000694 effects Effects 0.000 description 4
- 239000011295 pitch Substances 0.000 description 3
- 229910000831 Steel Inorganic materials 0.000 description 1
- 102220575564 Transmembrane protein 183A_R10M_mutation Human genes 0.000 description 1
- 239000013078 crystal Substances 0.000 description 1
- 230000003111 delayed effect Effects 0.000 description 1
- 239000010959 steel Substances 0.000 description 1
Landscapes
- Electrophonic Musical Instruments (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、メロディ発生回路のＲＯＭ構成に関する。
本発明は、メロディ発生回路のＲＯＭ構成において、デ
ィレィＲ百ＭをメインＲＯＭで制御することにより、主
旋律または、伴宿のみに、最小単位音符の整数分の１の
遅延を発生させることにより、より細かい音符の変化を
実行させて、一層の重みのある６重厚な音色を実現させ
るものである〔従来の技術〕 従来のメロディ発生回路のＲＯＭ構成は、前記ディレィ
Ｒ万Ｍを有していないので、最小単位音符の整数倍での
遅延のみ可能であった。
ィレィＲ百ＭをメインＲＯＭで制御することにより、主
旋律または、伴宿のみに、最小単位音符の整数分の１の
遅延を発生させることにより、より細かい音符の変化を
実行させて、一層の重みのある６重厚な音色を実現させ
るものである〔従来の技術〕 従来のメロディ発生回路のＲＯＭ構成は、前記ディレィ
Ｒ万Ｍを有していないので、最小単位音符の整数倍での
遅延のみ可能であった。
しかし、前述の従来技術では、最小単位音符の整数倍の
遅延のみ可能であるので、音色が単調となり、つねに主
旋律に対して、関連ある動作の伴奏しか実現できな−と
いう問題点を有する。
遅延のみ可能であるので、音色が単調となり、つねに主
旋律に対して、関連ある動作の伴奏しか実現できな−と
いう問題点を有する。
そこで本発明はこのような問題点を解決するもので、そ
の目的とするところは、最小単位音符の整数分の１の遅
延を、主旋律または、伴奏にもたせる回路を提供すると
ころにある。
の目的とするところは、最小単位音符の整数分の１の遅
延を、主旋律または、伴奏にもたせる回路を提供すると
ころにある。
本発明のメロディ発生回路は、発振回路、逓倍回路、分
周回路、複数のプログラマブルカウンタ、曲のテンポを
設定する、テンｅ、 ＲＥ Ｖ 、音符を設定する１つ
以上のノー）ＲＯＭ、曲の１部くり返しを設定する、１
つ以上のコントロールＲＯＭ、音程を設定する１つ以上
のスケールＲＯＭ、及び前記ノートＲ″ＯＭとスケール
Ｒ８Ｍのアドレスを設定する１つ以上のメインＲ″６Ｍ
を内蔵したメロディＩＣにおいて、主旋律または、伴奏
のみを、最小単位音符の整数分の１の遅延を設定するデ
ィレィＦ％ＯＭを装備したことを特徴とする。
周回路、複数のプログラマブルカウンタ、曲のテンポを
設定する、テンｅ、 ＲＥ Ｖ 、音符を設定する１つ
以上のノー）ＲＯＭ、曲の１部くり返しを設定する、１
つ以上のコントロールＲＯＭ、音程を設定する１つ以上
のスケールＲＯＭ、及び前記ノートＲ″ＯＭとスケール
Ｒ８Ｍのアドレスを設定する１つ以上のメインＲ″６Ｍ
を内蔵したメロディＩＣにおいて、主旋律または、伴奏
のみを、最小単位音符の整数分の１の遅延を設定するデ
ィレィＦ％ＯＭを装備したことを特徴とする。
本発明の上記の構成によれば、ディレィＲＯＭをメイン
ｐ、７５ｕで制御することにより、主旋律または、伴奏
のみに、最小単位音符のＩ！＆数分の１の遅延を発生さ
せることにより、より細かい音符の変化を実行させて、
一層の重みのある、重厚な音色を実現させることが可能
である。
ｐ、７５ｕで制御することにより、主旋律または、伴奏
のみに、最小単位音符のＩ！＆数分の１の遅延を発生さ
せることにより、より細かい音符の変化を実行させて、
一層の重みのある、重厚な音色を実現させることが可能
である。
第１図は、本発明の実施例におけるメロディ発生゛回路
のブロック図であって、１は、発振回路、２は、逓倍回
路、３は、分周回路、４は、テンポＲ百Ｍ、５は、テン
ポＲＯＭで分局比を変化させるプログラマブルカウンタ
、６は、分周回路、７は、ディレィＲ″’５Ｍ、８は、
ディレィＲＯＭで分周比を変化させる、６と同じピッ）
＆（（のプログラマブルカウンタ、９は、主旋律のノー
）ＲＯＭ％１１は、伴奏のノー）ＲＯＭ、１０と１２は
、それぞれのノートＲ″ＯＵで分周比を変化させるプロ
グラマブルカウンタ、１３は、主旋律のメインＲ７）Ｍ
、１７は、伴奏＋７）／インＲＯＭ、１４と１８は、そ
れぞれのメイ、ンＲＯＭのアドレスを設定スるプログラ
マブルカウンタ、１５と１９は、それぞれ主旋律と伴奏
のコントロールＲＯ″Ｍ１１６と２０は、それぞれ、１
５と１９のコントロールＲＯ″Ｍのアドレスを設定する
プログラマブルカウンタ、２１と２３は、それぞれ主旋
律と伴奏のスケールＲＯＭで分局比を変化させるプログ
ラマブルカウンタ、２５は出力端子である。１の発振部
でｃａｐ振または、水晶発振によって発生した発振周波
数は、２の逓倍回路で逓倍され、２２と２４のプログラ
マブルカウンタに入力される。一方、発振周波数は、３
０分周回路で適当な周波数に分周され、５のプログラマ
ブルカウンタに入る。
のブロック図であって、１は、発振回路、２は、逓倍回
路、３は、分周回路、４は、テンポＲ百Ｍ、５は、テン
ポＲＯＭで分局比を変化させるプログラマブルカウンタ
、６は、分周回路、７は、ディレィＲ″’５Ｍ、８は、
ディレィＲＯＭで分周比を変化させる、６と同じピッ）
＆（（のプログラマブルカウンタ、９は、主旋律のノー
）ＲＯＭ％１１は、伴奏のノー）ＲＯＭ、１０と１２は
、それぞれのノートＲ″ＯＵで分周比を変化させるプロ
グラマブルカウンタ、１３は、主旋律のメインＲ７）Ｍ
、１７は、伴奏＋７）／インＲＯＭ、１４と１８は、そ
れぞれのメイ、ンＲＯＭのアドレスを設定スるプログラ
マブルカウンタ、１５と１９は、それぞれ主旋律と伴奏
のコントロールＲＯ″Ｍ１１６と２０は、それぞれ、１
５と１９のコントロールＲＯ″Ｍのアドレスを設定する
プログラマブルカウンタ、２１と２３は、それぞれ主旋
律と伴奏のスケールＲＯＭで分局比を変化させるプログ
ラマブルカウンタ、２５は出力端子である。１の発振部
でｃａｐ振または、水晶発振によって発生した発振周波
数は、２の逓倍回路で逓倍され、２２と２４のプログラ
マブルカウンタに入力される。一方、発振周波数は、３
０分周回路で適当な周波数に分周され、５のプログラマ
ブルカウンタに入る。
１５のコントロールＲＯＭからのデータが４のテンポＲ
ＯＭのアドレスとなり、テンポＲＯＭのデータにより、
５０分局比が変化し曲のスピード（テンポ）が変化する
。５０カウンタを出た信号は、同じピッＦ数の６の分周
回路と８のカウンタに入力される。１７のメインａＯＵ
のデータが７のディレィａＯＵのアドレスとなり、ディ
レィＲＯＭのデータにより、８のカウンタの分周比が変
化し、伴奏のみ、次のノー）ＲＯＭで決定される所の最
小単位音符の整数分の１のδ延が実現される、６と８０
カウンタの出力は、１０と１２０カウンタに入力される
。１′３と１７のメインＲＯＭからのデータが、９と１
１のノー）ＲＯＭのアドレスとなり、ノートＲＯＭのデ
ータにより、１０と１２の分局比が変化し、音符の長さ
を決定する。
ＯＭのアドレスとなり、テンポＲＯＭのデータにより、
５０分局比が変化し曲のスピード（テンポ）が変化する
。５０カウンタを出た信号は、同じピッＦ数の６の分周
回路と８のカウンタに入力される。１７のメインａＯＵ
のデータが７のディレィａＯＵのアドレスとなり、ディ
レィＲＯＭのデータにより、８のカウンタの分周比が変
化し、伴奏のみ、次のノー）ＲＯＭで決定される所の最
小単位音符の整数分の１のδ延が実現される、６と８０
カウンタの出力は、１０と１２０カウンタに入力される
。１′３と１７のメインＲＯＭからのデータが、９と１
１のノー）ＲＯＭのアドレスとなり、ノートＲＯＭのデ
ータにより、１０と１２の分局比が変化し、音符の長さ
を決定する。
１０と１２０カウンタの出力は、１４と１８のカウンタ
に入力され、１４と１８のカウンタをカラン）Ｌ、１５
と１７のメインＲＯＭのアドレスを、インクリメントさ
せる。アドレスジャンプの場合は、１３と１７のメイン
ａＯＭのデータにより、１６と２００カウンタをカウン
トさせ、１５と１９のコントロールＲＯＭのアドレスを
、インクリメントさせることにより、データが変化し、
１４と１８０カウンタにセットまたはリセットをかけて
、１４と１８の出力により、１３と１７のメインＲＯＭ
のアドレスを、ジャンプさせる。
に入力され、１４と１８のカウンタをカラン）Ｌ、１５
と１７のメインＲＯＭのアドレスを、インクリメントさ
せる。アドレスジャンプの場合は、１３と１７のメイン
ａＯＭのデータにより、１６と２００カウンタをカウン
トさせ、１５と１９のコントロールＲＯＭのアドレスを
、インクリメントさせることにより、データが変化し、
１４と１８０カウンタにセットまたはリセットをかけて
、１４と１８の出力により、１３と１７のメインＲＯＭ
のアドレスを、ジャンプさせる。
１３と１７のメインＲＯＭのデータが２１と２５のスケ
ールＲＯＭのアドレスとなり、スケールＲＯＭのデータ
により、２２と２４のプログラマブルカウンタの分局比
を変化させ、目的の音程周波数を出力する。２２と２４
０カウンタの主旋律及び伴奏の出力は、混合されて、２
５の出力端子から出力される。
ールＲＯＭのアドレスとなり、スケールＲＯＭのデータ
により、２２と２４のプログラマブルカウンタの分局比
を変化させ、目的の音程周波数を出力する。２２と２４
０カウンタの主旋律及び伴奏の出力は、混合されて、２
５の出力端子から出力される。
第２図は、従来のメロディ発生回路のブロック図であっ
て、３１は、発振回路、３２は逓倍回路、３５と４６は
分周回路、３５，４０，４４゜５２．５４は、それぞれ
、テンポＲ″′１１５Ｍ１ノートＲＯＭ、メインＲＯＭ
、主旋律のスケールＲＯＭ、伴奏のスケールＲＯ″Ｍの
データにより分局比を変化するプログラマブルカウンタ
、３４は、テン１、主旋律のスケールＲＯＭ、５３は、
伴奏のスチールＲＯＭ、５５は、出力端子である。回路
の動作は、第１図とほぼ同じだが、従来のメロディ発生
回路では、ディレィＲＯＭかなく、メインＲＯＭが、１
コであったために、主旋律または伴奏を、最小単位音符
の整数倍の遅延しかできず、また、主旋律と伴奏との間
に、関連のある音符のインプットしかできなかった。
て、３１は、発振回路、３２は逓倍回路、３５と４６は
分周回路、３５，４０，４４゜５２．５４は、それぞれ
、テンポＲ″′１１５Ｍ１ノートＲＯＭ、メインＲＯＭ
、主旋律のスケールＲＯＭ、伴奏のスケールＲＯ″Ｍの
データにより分局比を変化するプログラマブルカウンタ
、３４は、テン１、主旋律のスケールＲＯＭ、５３は、
伴奏のスチールＲＯＭ、５５は、出力端子である。回路
の動作は、第１図とほぼ同じだが、従来のメロディ発生
回路では、ディレィＲＯＭかなく、メインＲＯＭが、１
コであったために、主旋律または伴奏を、最小単位音符
の整数倍の遅延しかできず、また、主旋律と伴奏との間
に、関連のある音符のインプットしかできなかった。
第３図は、本発明を使用した場合の主旋律と伴奏の音符
入力図であり、第３図は、従来のメロディ発生回路の音
符入力図である。１６分音符を最小単位音符とすると、
第３図の様に、従来の方式では、メインＲＯＭか１コで
あるために、ワード数を考慮すると、必ず、主旋律と伴
奏のトータルの音符と休符の長さを加えた値は一致しな
ければならない。また、ディレィＲＯＭかないために、
１６分音符の音符長より短い音符長をつくることができ
ない。本発明の様に複数のテンポＲ百Ｍ１メインＲＯＭ
、コントロールＲＯＭを所有すると、主旋律と伴奏のそ
れぞれのワード数で別個に考慮すれば良いので、自由な
音符入力ができる上、ディレィａＴｆＭがあるので、１
６分音符の整数分の１の音符長の遅延をつくることがで
きる。
入力図であり、第３図は、従来のメロディ発生回路の音
符入力図である。１６分音符を最小単位音符とすると、
第３図の様に、従来の方式では、メインＲＯＭか１コで
あるために、ワード数を考慮すると、必ず、主旋律と伴
奏のトータルの音符と休符の長さを加えた値は一致しな
ければならない。また、ディレィＲＯＭかないために、
１６分音符の音符長より短い音符長をつくることができ
ない。本発明の様に複数のテンポＲ百Ｍ１メインＲＯＭ
、コントロールＲＯＭを所有すると、主旋律と伴奏のそ
れぞれのワード数で別個に考慮すれば良いので、自由な
音符入力ができる上、ディレィａＴｆＭがあるので、１
６分音符の整数分の１の音符長の遅延をつくることがで
きる。
第５図は、第１図８のプログラマブルカウンタと７のデ
ィレィＲＯＭの１回路例でプログラマブルカウンタが３
ビツトの場合を示す。６１は、入力端子、６２，６５，
７７．７Ｂは、位相反転用インバータ、６３は、１／２
分周の７リツプフロツプ（以下ＩＰ′ＩＰという）、６
４は、ＮＡＮＤＡＮＤ回路、６７．６８は、セット付１
／２分周の１Ｆ？、６９は、データをローにしたセット
付ＩＦＦ、７０はＡＮＤ回路、７１，７２．７３は、高
抵抗７４．７５．７６は、高ＯＮ抵抗のＰ ｆ −？
ンネ／Ｉ／ＭＯ。
ィレィＲＯＭの１回路例でプログラマブルカウンタが３
ビツトの場合を示す。６１は、入力端子、６２，６５，
７７．７Ｂは、位相反転用インバータ、６３は、１／２
分周の７リツプフロツプ（以下ＩＰ′ＩＰという）、６
４は、ＮＡＮＤＡＮＤ回路、６７．６８は、セット付１
／２分周の１Ｆ？、６９は、データをローにしたセット
付ＩＦＦ、７０はＡＮＤ回路、７１，７２．７３は、高
抵抗７４．７５．７６は、高ＯＮ抵抗のＰ ｆ −？
ンネ／Ｉ／ＭＯ。
５ＦＦＸＴ、７９〜９５は、ＮチャンネルＭ ＯＳ １
ＦＥＴ、９４は、バッファ、９５と９６は、メインＲＯ
Ｍからの２ビツトのデータの入力端子、９７は出力端子
である。６１から入力されたクロック信号は、６３０Ｆ
？で分１にされ、６４のＮＡＮＤと７０のＡＮＤで、６
６〜６９までのＩＦ７にセットをかけるタイミングがつ
くられる。一方、メインＲＯＭからのハイ、ロー信号は
、９５と９６０端子から入力される。７９〜９０までの
ＮチャンネルＭ″６Ｓ］１ＰＥＴのＲＯＭ部のゲートは
適当に接続されており、９５と９６のＩＦ１号は、その
ゲートに加わり、ＭＯＳＦＥＴをτＮ、０ＩＦＩＩ’さ
せる。
ＦＥＴ、９４は、バッファ、９５と９６は、メインＲＯ
Ｍからの２ビツトのデータの入力端子、９７は出力端子
である。６１から入力されたクロック信号は、６３０Ｆ
？で分１にされ、６４のＮＡＮＤと７０のＡＮＤで、６
６〜６９までのＩＦ７にセットをかけるタイミングがつ
くられる。一方、メインＲＯＭからのハイ、ロー信号は
、９５と９６０端子から入力される。７９〜９０までの
ＮチャンネルＭ″６Ｓ］１ＰＥＴのＲＯＭ部のゲートは
適当に接続されており、９５と９６のＩＦ１号は、その
ゲートに加わり、ＭＯＳＦＥＴをτＮ、０ＩＦＩＩ’さ
せる。
ＭＯ５ＦＥＴ１７）ＯＮ 、ＯＦＦによｌ：）、６６〜
６８のＴ！Ｆに、セットがかかったり、かからなかった
りすることにより、プログラマブルにカウントされる。
６８のＴ！Ｆに、セットがかかったり、かからなかった
りすることにより、プログラマブルにカウントされる。
第６図は、６６〜６９のＩＰＩＰの動作を示したタイミ
ングチャートである。第６図の様に、１６分音符の±
１．１．１のタイミングが作ら゛れ、その分のディレィ
を発生させることができる〔光切の効果〕 以上述べたように本発明によれば、テンポＲＯＭ、メイ
ンＲ百Ｍ１コントロールＲＯＭを複数個持つ、ことによ
り、主旋律と伴奏がお互いに関連することなく自由な編
曲ができ、また、ディレィＲ百Ｍを持つことにより、最
小単位音符の整数分の１の遅延ができるため、よりきめ
細かい、重厚な音質を実現することができろという効果
を有するまた、従来のメロディエＣでは実現できなかっ
た装飾音や、エコーの効果を出すことができる。
ングチャートである。第６図の様に、１６分音符の±
１．１．１のタイミングが作ら゛れ、その分のディレィ
を発生させることができる〔光切の効果〕 以上述べたように本発明によれば、テンポＲＯＭ、メイ
ンＲ百Ｍ１コントロールＲＯＭを複数個持つ、ことによ
り、主旋律と伴奏がお互いに関連することなく自由な編
曲ができ、また、ディレィＲ百Ｍを持つことにより、最
小単位音符の整数分の１の遅延ができるため、よりきめ
細かい、重厚な音質を実現することができろという効果
を有するまた、従来のメロディエＣでは実現できなかっ
た装飾音や、エコーの効果を出すことができる。
第１図は、本発明のメロディ発生回路の一実施例を示す
ブロック図。 第２図は、従来のメロディ発生回路を示すブロック図。 第３図は、本発明のメロディ発生回路を実施した場合の
音符入力図。 第４図は、従来のメロディ発生回路の場合の音符入力図
。 第５図は、本発明のメロディ発生回路中のプログラマブ
ルカウンタ及び、ディレィＲ百Ｍの一実施例を示すロジ
ック図。 第６図は、第５図のロジック図の動作を示すタイミング
チャート図。 第１ス 饋４！Ｐ 月 ｐｊ □初β ｐ ｊ ｐ 第４図 第Ｓ図 ＦＦ６３Ｍ ○ＵＴ 第６図
ブロック図。 第２図は、従来のメロディ発生回路を示すブロック図。 第３図は、本発明のメロディ発生回路を実施した場合の
音符入力図。 第４図は、従来のメロディ発生回路の場合の音符入力図
。 第５図は、本発明のメロディ発生回路中のプログラマブ
ルカウンタ及び、ディレィＲ百Ｍの一実施例を示すロジ
ック図。 第６図は、第５図のロジック図の動作を示すタイミング
チャート図。 第１ス 饋４！Ｐ 月 ｐｊ □初β ｐ ｊ ｐ 第４図 第Ｓ図 ＦＦ６３Ｍ ○ＵＴ 第６図
Claims (1)
- 発振回路、逓倍回路、分周回路、複数のプログラマブル
カウンタ、曲のテンポを設定する、テンポＲ＠Ｏ＠Ｍ、
音符を設定する１つ以上のノートＲ＠Ｏ＠Ｍ、曲の１部
くり返しを設定する１つ以上のコントロールＲ＠Ｏ＠Ｍ
、音程を設定する１つ以上のスケールＲ＠Ｏ＠Ｍ）及び
前記ノートＲ＠Ｏ＠ＭとスケールＲ＠Ｏ＠Ｒのアドレス
を設定する１つ以上のメインＲ＠Ｏ＠Ｍを内蔵したメロ
ディＩＣにおいて、主旋律または伴奏のみを、最小単位
音符の整数分の１の遅延を設定するディレィＲ＠Ｏ＠Ｍ
を装備したことを特徴とするメロディ発生回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61286485A JPS63138398A (ja) | 1986-12-01 | 1986-12-01 | メロデイ発生回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61286485A JPS63138398A (ja) | 1986-12-01 | 1986-12-01 | メロデイ発生回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS63138398A true JPS63138398A (ja) | 1988-06-10 |
Family
ID=17705010
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP61286485A Pending JPS63138398A (ja) | 1986-12-01 | 1986-12-01 | メロデイ発生回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS63138398A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH01321481A (ja) * | 1988-06-23 | 1989-12-27 | Yamaha Corp | 自動演奏装置 |
| JPH03107200A (ja) * | 1989-09-20 | 1991-05-07 | Casio Comput Co Ltd | 自動演奏装置 |
-
1986
- 1986-12-01 JP JP61286485A patent/JPS63138398A/ja active Pending
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH01321481A (ja) * | 1988-06-23 | 1989-12-27 | Yamaha Corp | 自動演奏装置 |
| JPH03107200A (ja) * | 1989-09-20 | 1991-05-07 | Casio Comput Co Ltd | 自動演奏装置 |
| JP2808721B2 (ja) * | 1989-09-20 | 1998-10-08 | カシオ計算機株式会社 | 自動演奏装置 |
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