JPS62544B2 - - Google Patents
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- JPS62544B2 JPS62544B2 JP57233952A JP23395282A JPS62544B2 JP S62544 B2 JPS62544 B2 JP S62544B2 JP 57233952 A JP57233952 A JP 57233952A JP 23395282 A JP23395282 A JP 23395282A JP S62544 B2 JPS62544 B2 JP S62544B2
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- 230000005540 biological transmission Effects 0.000 claims description 10
- 230000007423 decrease Effects 0.000 claims description 2
- 230000003247 decreasing effect Effects 0.000 claims description 2
- 238000010586 diagram Methods 0.000 description 10
- 238000012790 confirmation Methods 0.000 description 3
- 230000000694 effects Effects 0.000 description 1
- 238000000034 method Methods 0.000 description 1
Classifications
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F3/00—Input arrangements for transferring data to be processed into a form capable of being handled by the computer; Output arrangements for transferring data from processing unit to output unit, e.g. interface arrangements
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- Engineering & Computer Science (AREA)
- Theoretical Computer Science (AREA)
- Human Computer Interaction (AREA)
- Physics & Mathematics (AREA)
- General Engineering & Computer Science (AREA)
- General Physics & Mathematics (AREA)
Description
【発明の詳細な説明】
〔概要〕
リード・アフタ・ライト・コマンドを新設し、
計算機と端末間のデータ転送を制御する制御装置
にリード・アフタ・ライト・コマンド制御手段を
設けたものである。リード・アフタ・ライト・コ
マンド制御手段は、コマンド・レジスタにリー
ド・アフタ・ライト・コマンドがセツトされる
と、ライト手段を動作させ、ライト手段からのラ
イト送信終了を受け取ると、リード手段を動作さ
せる。ライト手段は、起動されると、計算機のメ
モリに格納されているデータを端末へ送り、デー
タの送信が終了すると、ライト送信終了を出力す
る。リード手段は、端末から送られて来たデータ
を計算機のメモリに格納し、受信が終了すると、
リード受信終了を出力する。
計算機と端末間のデータ転送を制御する制御装置
にリード・アフタ・ライト・コマンド制御手段を
設けたものである。リード・アフタ・ライト・コ
マンド制御手段は、コマンド・レジスタにリー
ド・アフタ・ライト・コマンドがセツトされる
と、ライト手段を動作させ、ライト手段からのラ
イト送信終了を受け取ると、リード手段を動作さ
せる。ライト手段は、起動されると、計算機のメ
モリに格納されているデータを端末へ送り、デー
タの送信が終了すると、ライト送信終了を出力す
る。リード手段は、端末から送られて来たデータ
を計算機のメモリに格納し、受信が終了すると、
リード受信終了を出力する。
本発明は、計算機と、複数の端末と、上記計算
機と複数の端末との間のデータ転送を制御する制
御装置とを具備し、且つポーリング方式でデータ
転送を行うデータ転送システムにおいて、上記計
算機からのリード・アフタ・ライト・コマンドを
受信したとき、ライト動作を行つたあと直ちにリ
ード動作を行い得るように上記制御装置を構成し
たものである。
機と複数の端末との間のデータ転送を制御する制
御装置とを具備し、且つポーリング方式でデータ
転送を行うデータ転送システムにおいて、上記計
算機からのリード・アフタ・ライト・コマンドを
受信したとき、ライト動作を行つたあと直ちにリ
ード動作を行い得るように上記制御装置を構成し
たものである。
ポーリング方式のデータ転送システムにおいて
は、ホスト側がデータ要求信号ENQを端末に送
信し、端末はデータ要求信号ENQを受取ると、
送るべきデータが存在する場合にはデータをホス
ト側に送り、送るべきデータが存在しない場合に
は確認信号ACKをホスト側に送る。また、端末
は、ホスト側からのデータを受取ると、確認信号
ACKをホスト側に送る。ホスト側からみると、
信号ENQやデータの送信はライト（Write）動作
となり、確認信号やデータの受信はリード
（Read）動作となる。
は、ホスト側がデータ要求信号ENQを端末に送
信し、端末はデータ要求信号ENQを受取ると、
送るべきデータが存在する場合にはデータをホス
ト側に送り、送るべきデータが存在しない場合に
は確認信号ACKをホスト側に送る。また、端末
は、ホスト側からのデータを受取ると、確認信号
ACKをホスト側に送る。ホスト側からみると、
信号ENQやデータの送信はライト（Write）動作
となり、確認信号やデータの受信はリード
（Read）動作となる。
従来のこの種のデータ転送システムにおいて
は、計算機のソフトウエアは、ライト・コマンド
の送信終了を確認したら直ちにデータ又は確認信
号受信のためにリード・コマンドを発行する必要
があり、ソフトウエアの負荷が大きいという欠点
があつた。
は、計算機のソフトウエアは、ライト・コマンド
の送信終了を確認したら直ちにデータ又は確認信
号受信のためにリード・コマンドを発行する必要
があり、ソフトウエアの負荷が大きいという欠点
があつた。
本発明は、この点に鑑みて創作されたものであ
つて、ポーリング方式のデータ転送システムにお
いて、計算機のソフトウエアの負荷を軽減できる
ようにすることを目的としている。
つて、ポーリング方式のデータ転送システムにお
いて、計算機のソフトウエアの負荷を軽減できる
ようにすることを目的としている。
第１図は本発明の原理図である。尚、第１図
は、計算機と端末との間のデータ転送を制御する
制御装置内の要部構成を示すものである。本発明
においては、リード・アフタ・ライト・コマンド
が新設されている。コマンド・レジスタ４にリー
ド・アフタ・ライト・コマンドがセツトされる
と、リード・アフタ・ライト・コマンド制御手段
１５が動作する。動作を開始すると、リード・ア
フタ・ライト・コマンド制御手段１５は、ライト
回路８を起動し、ライト回路８がライト送信終了
を出力すると、リード回路９を起動し、リード回
路９がリード受信終了を出力すると、リード・ア
フタ・ライト・コマンドが終了したことを認識
し、この旨を計算機に報告する。ライト回路８
は、起動されると、メモリ・アドレス・レジスタ
５の値に従つて計算機の主メモリに格納されてい
るデータを単位量ずつ読出して端末へ送信すると
共に、読出しが行われる度にメモリ・アドレス・
レジスタ５の値を単位量だけ増加し、同時にバイ
ト・カウンタ６の値を単位量だけ減少し、そして
バイト・カウンタ６の値が零になると、ライト送
信終了を出力する。リード回路９は、起動される
と、端末から送られて来るデータをメモリ・アド
レス・レジスタ５の値に従つて単位量ずつ計算機
１のメモリに格納すると共に、格納が行われる度
にメモリ・アドレス・レジスタ５の値を単位量だ
け増加し、同時にバイト・カウンタ６の値を単位
量だけ減少し、バイト・カウンタ６の値が零にな
つた時にリード受信終了信号を出力する。
は、計算機と端末との間のデータ転送を制御する
制御装置内の要部構成を示すものである。本発明
においては、リード・アフタ・ライト・コマンド
が新設されている。コマンド・レジスタ４にリー
ド・アフタ・ライト・コマンドがセツトされる
と、リード・アフタ・ライト・コマンド制御手段
１５が動作する。動作を開始すると、リード・ア
フタ・ライト・コマンド制御手段１５は、ライト
回路８を起動し、ライト回路８がライト送信終了
を出力すると、リード回路９を起動し、リード回
路９がリード受信終了を出力すると、リード・ア
フタ・ライト・コマンドが終了したことを認識
し、この旨を計算機に報告する。ライト回路８
は、起動されると、メモリ・アドレス・レジスタ
５の値に従つて計算機の主メモリに格納されてい
るデータを単位量ずつ読出して端末へ送信すると
共に、読出しが行われる度にメモリ・アドレス・
レジスタ５の値を単位量だけ増加し、同時にバイ
ト・カウンタ６の値を単位量だけ減少し、そして
バイト・カウンタ６の値が零になると、ライト送
信終了を出力する。リード回路９は、起動される
と、端末から送られて来るデータをメモリ・アド
レス・レジスタ５の値に従つて単位量ずつ計算機
１のメモリに格納すると共に、格納が行われる度
にメモリ・アドレス・レジスタ５の値を単位量だ
け増加し、同時にバイト・カウンタ６の値を単位
量だけ減少し、バイト・カウンタ６の値が零にな
つた時にリード受信終了信号を出力する。
以下、本発明を図面を参照しつつ説明する。
第２図はデータ転送システムの１例を示す図、
第３図は本発明による制御装置の要部の１実施例
のブロツク図、第４図は本発明の動作を説明する
ための図である。
第３図は本発明による制御装置の要部の１実施例
のブロツク図、第４図は本発明の動作を説明する
ための図である。
第２図において、１は計算機、２は制御装置、
３−１ないし３−ｎは端末、４はコマンド・レジ
スタ、５はメモリ・アドレス・レジスタ、６はバ
イト・カウンタ、７はデータ・レシジスタ、８は
ライト回路、９はリード回路、１０はゲート回路
をそれぞれ示している。計算機１は、データなど
を端末へ送る場合、データが格納されている主メ
モリ上のアドレスをメモリ・アドレス・レジスタ
５にセツトし、データ長をバイト・カウンタ６に
セツトし、そしてリード・アフタ・ライト・コマ
ンドをコマンド・レジスタ４にセツトする。リー
ド・アフタ・ライト・コマンドがコマンド・レジ
スタ４にセツトされると、ライト回路８が動作
し、主メモリ（図示せず）からデータを取出し
て、これを計算機によつて指定された端末３−ｉ
（ｉ＝１，２，…，ｎ）に送る。１バイトのデー
タを主メモリから取出す度に、メモリ・アドレ
ス・レジスタ５の内容は＋１され、バイト・カウ
ンタ６の内容は−１される。全てのデーが端末３
−ｉに送られると、ライト回路８は動作を停止
し、リード回路９が動作する。端末３−ｉからデ
ータが送られて来ると、リード回路９はこれを主
メモリ（図示せず）に格納する。ライトの場合と
同様に、主メモリに１バイトのデータを書込む度
にメモリ・アドレス・レジスタ５の内容は＋１さ
れ、バイト・カウンタ６の内容は−１される。
３−１ないし３−ｎは端末、４はコマンド・レジ
スタ、５はメモリ・アドレス・レジスタ、６はバ
イト・カウンタ、７はデータ・レシジスタ、８は
ライト回路、９はリード回路、１０はゲート回路
をそれぞれ示している。計算機１は、データなど
を端末へ送る場合、データが格納されている主メ
モリ上のアドレスをメモリ・アドレス・レジスタ
５にセツトし、データ長をバイト・カウンタ６に
セツトし、そしてリード・アフタ・ライト・コマ
ンドをコマンド・レジスタ４にセツトする。リー
ド・アフタ・ライト・コマンドがコマンド・レジ
スタ４にセツトされると、ライト回路８が動作
し、主メモリ（図示せず）からデータを取出し
て、これを計算機によつて指定された端末３−ｉ
（ｉ＝１，２，…，ｎ）に送る。１バイトのデー
タを主メモリから取出す度に、メモリ・アドレ
ス・レジスタ５の内容は＋１され、バイト・カウ
ンタ６の内容は−１される。全てのデーが端末３
−ｉに送られると、ライト回路８は動作を停止
し、リード回路９が動作する。端末３−ｉからデ
ータが送られて来ると、リード回路９はこれを主
メモリ（図示せず）に格納する。ライトの場合と
同様に、主メモリに１バイトのデータを書込む度
にメモリ・アドレス・レジスタ５の内容は＋１さ
れ、バイト・カウンタ６の内容は−１される。
第３図は本発明による制御装置の要部の１実施
例のブロツク図である。第２図において、１１は
ライトFF、１２はリードFF、１３はAND回
路、１４はOR回路、１５はリード・アフタ・ラ
イト・コマンド制御手段をそれぞれ示している。
尚、FFはフリツプ・フロツプの略である。リー
ド・アフタ・ライト・コマンド制御手段１５は、
ライトFF１１、リードFF１２及びAND回路１
３を有している。コマンド・レジスタ４（第２
図）にリード・アフタ・ライト・コマンドがセツ
トされると、ライトFF１１がセツトされ、ライ
ト回路８が動作する。ライト回路８が動作する
と、主メモリからデータが取出され、この取出さ
れたデータが端末へ送られる。主メモリから１バ
イトの送信データが取出される度に、メモリ・ア
ドレス・レジスタ５の内容は＋１され、バイト・
カウンタ６の内容は−１される。バイト・カウン
タ６の内容が零になると、ライト回路８はライト
送信終了を出力する。ライト送信終了が出力され
ると、リードFF１２はセツトされ、ライトFF１
１はリセツトされる。リードFF１２がセツトさ
れると、リード回路９が起動される。端末からデ
ータが送られて来ると、リード回路９の動作によ
つて、受信データは主メモリ（図示せず）に格納
される。この際、１バイトのデータが主メモリに
格納される度にメモリ・アドレス・レジスタ５の
内容は＋１され、バイト・カウンタ６の内容は−
１される。バイト・カウンタ６の内容が零になる
と、リード回路９はリード受信終了を出力する。
リード受信終了が出力されると、リードFF１２
がリセツトされる。
例のブロツク図である。第２図において、１１は
ライトFF、１２はリードFF、１３はAND回
路、１４はOR回路、１５はリード・アフタ・ラ
イト・コマンド制御手段をそれぞれ示している。
尚、FFはフリツプ・フロツプの略である。リー
ド・アフタ・ライト・コマンド制御手段１５は、
ライトFF１１、リードFF１２及びAND回路１
３を有している。コマンド・レジスタ４（第２
図）にリード・アフタ・ライト・コマンドがセツ
トされると、ライトFF１１がセツトされ、ライ
ト回路８が動作する。ライト回路８が動作する
と、主メモリからデータが取出され、この取出さ
れたデータが端末へ送られる。主メモリから１バ
イトの送信データが取出される度に、メモリ・ア
ドレス・レジスタ５の内容は＋１され、バイト・
カウンタ６の内容は−１される。バイト・カウン
タ６の内容が零になると、ライト回路８はライト
送信終了を出力する。ライト送信終了が出力され
ると、リードFF１２はセツトされ、ライトFF１
１はリセツトされる。リードFF１２がセツトさ
れると、リード回路９が起動される。端末からデ
ータが送られて来ると、リード回路９の動作によ
つて、受信データは主メモリ（図示せず）に格納
される。この際、１バイトのデータが主メモリに
格納される度にメモリ・アドレス・レジスタ５の
内容は＋１され、バイト・カウンタ６の内容は−
１される。バイト・カウンタ６の内容が零になる
と、リード回路９はリード受信終了を出力する。
リード受信終了が出力されると、リードFF１２
がリセツトされる。
第４図は本発明の動作を説明する図である。第
４図において、MSは主メモリ、MARはメモリ・
アドレス・レジスタ、BCRはバイト・カウンタ
をそれぞれ示している。図示の例では、ライト・
データ・エリアに100バイトの大きさが、リー
ド・データ・エリアに101バイトの大きさが割当
てられており、メモリ・アドレス・レジスタの初
期値が1000、バイト・カウンタの初期値が100と
されている。なお、バイト・カウンタは、最大数
値100をもち、零から更に１を減ずると、最大数
値100に戻る。ライト・データ・エリアから100バ
イトのデータを取出して端末へ送ると、メモリ・
アドレス・レジスタの内容は1100となり、バイ
ト・カウンタの内容は０になる。端末から送られ
て来るデータは、リード・データ・エリア（1100
番地ないし1200番地）に格納される。101バイト
のデータがリード・データ・エリアに格納される
と、メモリ・アドレス・レジスタの内容は1201と
なり、バイト・カウンタの内容は０になる。
４図において、MSは主メモリ、MARはメモリ・
アドレス・レジスタ、BCRはバイト・カウンタ
をそれぞれ示している。図示の例では、ライト・
データ・エリアに100バイトの大きさが、リー
ド・データ・エリアに101バイトの大きさが割当
てられており、メモリ・アドレス・レジスタの初
期値が1000、バイト・カウンタの初期値が100と
されている。なお、バイト・カウンタは、最大数
値100をもち、零から更に１を減ずると、最大数
値100に戻る。ライト・データ・エリアから100バ
イトのデータを取出して端末へ送ると、メモリ・
アドレス・レジスタの内容は1100となり、バイ
ト・カウンタの内容は０になる。端末から送られ
て来るデータは、リード・データ・エリア（1100
番地ないし1200番地）に格納される。101バイト
のデータがリード・データ・エリアに格納される
と、メモリ・アドレス・レジスタの内容は1201と
なり、バイト・カウンタの内容は０になる。
以上の説明から明らかなように、本発明によれ
ば、端末にデータを送り終つた後、直ちにリー
ド・モードになるように制御装置を構成したの
で、計算機のソフトウエアの負荷を減少すること
が出来る。
ば、端末にデータを送り終つた後、直ちにリー
ド・モードになるように制御装置を構成したの
で、計算機のソフトウエアの負荷を減少すること
が出来る。
第１図は本発明の原理図、第２図はデータ転送
システムの１例を示す図、第３図は本発明による
制御装置の要部の１実施例のブロツク図、第４図
は本発明の動作を説明する図である。 １……計算機、２……制御装置、３−１ないし
３−ｎ……端末、４……コマンド・レジスタ、５
……メモリ・アドレス・レジスタ、６……バイ
ト・カウンタ、７……データ・レジスタ、８……
ライト回路、９……リード回路、１０……ゲート
回路、１１……ライトFF、１２……リードFF、
１３……AND回路、１４……OR回路、１５……
リード・アフタ・ライト・コマンド制御手段。
システムの１例を示す図、第３図は本発明による
制御装置の要部の１実施例のブロツク図、第４図
は本発明の動作を説明する図である。 １……計算機、２……制御装置、３−１ないし
３−ｎ……端末、４……コマンド・レジスタ、５
……メモリ・アドレス・レジスタ、６……バイ
ト・カウンタ、７……データ・レジスタ、８……
ライト回路、９……リード回路、１０……ゲート
回路、１１……ライトFF、１２……リードFF、
１３……AND回路、１４……OR回路、１５……
リード・アフタ・ライト・コマンド制御手段。
Claims (1)
- 【特許請求の範囲】 １ 計算機１と、制御装置２と、複数の端末（３
−１ないし３−ｎ）とを具備するボーリング方式
のデータ転送システムにおいて、 制御装置２は、コマンド・レジスタ４と、リー
ド・アフタ・ライト・コマンド制御手段１５と、
ライト手段８と、リード手段９と、メモリ・アド
レス・レジスタ５と、バイト・カウンタ６とを具
備し、 上記リード・アフタ・ライト・コマンド制御手
段１５は、コマンド・レジスタ４にリード・アフ
タ・ライト・コマンドがセツトされると、ライト
手段８を動作させ、ライト手段８からライト送信
終了信号が出力されると、リード手段９を動作さ
せるように構成され、 ライト手段８は、起動されると、メモリ・アド
レス・レジスタ５の値に従つて計算機１のメモリ
に格納されているデータを単位量ずつ読出して端
末へ送信すると共に、読出しが行われる度にメモ
リ・アドレス・レジスタ５の値を単位量だけ増加
し、同時にバイト・カウンタ６の値を単位量だけ
減少し、バイト・カウンタ６の値が零になつた時
に上記ライト送信終了信号を出力するように構成
され、 リード手段９は、起動されると、端末から送ら
れて来るデータをメモリ・アドレス・レジスタ５
の値に従つて単位量ずつ計算機１のメモリに格納
すると共に、格納が行われる度にメモリ・アドレ
ス・レジスタ５の値を単位量だけ増加し、同時に
バイト・カウンタ６の値を単位量だけ減少し、バ
イト・カウンタ６の値が零になつた時にリード受
信終了信号を出力するように構成されているこ
と、を特徴とするデータ転送システム。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP23395282A JPS59119428A (ja) | 1982-12-25 | 1982-12-25 | デ−タ転送システム |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP23395282A JPS59119428A (ja) | 1982-12-25 | 1982-12-25 | デ−タ転送システム |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS59119428A JPS59119428A (ja) | 1984-07-10 |
| JPS62544B2 true JPS62544B2 (ja) | 1987-01-08 |
Family
ID=16963191
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP23395282A Granted JPS59119428A (ja) | 1982-12-25 | 1982-12-25 | デ−タ転送システム |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS59119428A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0223365U (ja) * | 1988-08-01 | 1990-02-15 |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5469343A (en) * | 1977-11-14 | 1979-06-04 | Nec Corp | Transmission-reception control unit |
-
1982
- 1982-12-25 JP JP23395282A patent/JPS59119428A/ja active Granted
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5469343A (en) * | 1977-11-14 | 1979-06-04 | Nec Corp | Transmission-reception control unit |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0223365U (ja) * | 1988-08-01 | 1990-02-15 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS59119428A (ja) | 1984-07-10 |
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