JPS62290908A - 数値制御装置の接続制御装置 - Google Patents
数値制御装置の接続制御装置Info
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- JPS62290908A JPS62290908A JP61132840A JP13284086A JPS62290908A JP S62290908 A JPS62290908 A JP S62290908A JP 61132840 A JP61132840 A JP 61132840A JP 13284086 A JP13284086 A JP 13284086A JP S62290908 A JPS62290908 A JP S62290908A
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- 239000013256 coordination polymer Substances 0.000 claims description 10
- 230000006870 function Effects 0.000 claims description 4
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Classifications
-
- Y—GENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y02—TECHNOLOGIES OR APPLICATIONS FOR MITIGATION OR ADAPTATION AGAINST CLIMATE CHANGE
- Y02P—CLIMATE CHANGE MITIGATION TECHNOLOGIES IN THE PRODUCTION OR PROCESSING OF GOODS
- Y02P90/00—Enabling technologies with a potential contribution to greenhouse gas [GHG] emissions mitigation
- Y02P90/02—Total factory control, e.g. smart factories, flexible manufacturing systems [FMS] or integrated manufacturing systems [IMS]
Landscapes
- General Factory Administration (AREA)
- Control By Computers (AREA)
- Programmable Controllers (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
五 発明の詳細な説明
〔産業上の利用分野〕
この発明は、例えば工作機械を制御する数値制御装置の
接続制御装置、特に１台のプログラマブルロジックコン
トローラで複数台の数値制御装置の制御可能としたもの
に関する。
接続制御装置、特に１台のプログラマブルロジックコン
トローラで複数台の数値制御装置の制御可能としたもの
に関する。
第５図は従来の数値制御装置を示すブロック図であり、
図において（１）は数値制御装置、（２）はプログラミ
ングされたプログラムならびに加工情報を一時的に記憶
しておくメモリ、（３）はＣＰ［Ｊ、（４）は機械の軸
駆動装置（７）を制御するサーボコントロール、（５）
は機械（８）を制御するプログラマブルロジックコント
ローラ（以下、ＰＬＣという。）、（６）はＰ Ｌ Ｃ
（５）のプログラムが記憶されているシーケンスメモリ
である。
図において（１）は数値制御装置、（２）はプログラミ
ングされたプログラムならびに加工情報を一時的に記憶
しておくメモリ、（３）はＣＰ［Ｊ、（４）は機械の軸
駆動装置（７）を制御するサーボコントロール、（５）
は機械（８）を制御するプログラマブルロジックコント
ローラ（以下、ＰＬＣという。）、（６）はＰ Ｌ Ｃ
（５）のプログラムが記憶されているシーケンスメモリ
である。
（９）は表示部とキーボードからなる設定部とを有する
表示設定ボード、００は加工情報が記録されている紙テ
ープのテープリーダである。
表示設定ボード、００は加工情報が記録されている紙テ
ープのテープリーダである。
従来の数値制御装置は上記のように構成され、メモリ（
３）に複数の加ニブログラムが格納されており、ｌず設
定表示ボード（９）の操作により所定の加エフ”ログラ
ムを指定しＣＰＵ（３ｊＫよって指定された加ニブログ
ラムがメモリ（３）から選択される。
３）に複数の加ニブログラムが格納されており、ｌず設
定表示ボード（９）の操作により所定の加エフ”ログラ
ムを指定しＣＰＵ（３ｊＫよって指定された加ニブログ
ラムがメモリ（３）から選択される。
次に機械（８）に設けである機械操作パネルから加工起
動指令がＰＬＣ（５）Ｋ送られると、Ｐ Ｌ Ｃ（５）
からＣＰ Ｕ （３Ｊに対し加工指令として加ニブロッ
クデータの要求信号を出す。ＣＰ ＩＪ （３）は加ニ
ブロックデータの要求信号を受けろと選択されている加
ニブログラムの先頭ブロックから加ニブログラムの内容
を解読し、所定のフォーマットの加ニブロックデータを
作成し、サーボコントロール（４）とＰＬＣ（５）に転
送する。サーボコントロール（５）は機械（８） ノ機
械操作パネルに設定しである速度設定条件と加ニブロッ
クデータの速度指令をもとく実行速度を算出し、パルス
分配処理を行なった後に軸駆動装置（７）Ｋ移動パルス
を出力する。また加ニブロックデータが工具指令、主軸
指令または補助指令であればＰ Ｌ Ｃ（５）がシーケ
ンスメモリ（６）に格納されてイロフロクラムに基づき
所定の機械制御信号に変換して機械（８）に出力する。
動指令がＰＬＣ（５）Ｋ送られると、Ｐ Ｌ Ｃ（５）
からＣＰ Ｕ （３Ｊに対し加工指令として加ニブロッ
クデータの要求信号を出す。ＣＰ ＩＪ （３）は加ニ
ブロックデータの要求信号を受けろと選択されている加
ニブログラムの先頭ブロックから加ニブログラムの内容
を解読し、所定のフォーマットの加ニブロックデータを
作成し、サーボコントロール（４）とＰＬＣ（５）に転
送する。サーボコントロール（５）は機械（８） ノ機
械操作パネルに設定しである速度設定条件と加ニブロッ
クデータの速度指令をもとく実行速度を算出し、パルス
分配処理を行なった後に軸駆動装置（７）Ｋ移動パルス
を出力する。また加ニブロックデータが工具指令、主軸
指令または補助指令であればＰ Ｌ Ｃ（５）がシーケ
ンスメモリ（６）に格納されてイロフロクラムに基づき
所定の機械制御信号に変換して機械（８）に出力する。
以上の手順を加ニブログラムの順にくり返し処理するこ
とＫより所定の加工が行なわれる。
とＫより所定の加工が行なわれる。
上記のような従来の数値制御装置では、数値制御装置（
１ン内にＰ Ｌ Ｃ（５）が内蔵されているの℃、ＰＬ
（１台に対して複数台の数値制御装置を接続することが
できず、複数の機械群を１台のＰＬＣに結合し集中制御
することができないという問題点があった。
１ン内にＰ Ｌ Ｃ（５）が内蔵されているの℃、ＰＬ
（１台に対して複数台の数値制御装置を接続することが
できず、複数の機械群を１台のＰＬＣに結合し集中制御
することができないという問題点があった。
この発明は、かかる問題点−を解決するためになされた
ものであり、１台のＰＬＣに複数台の数値制御装置を接
続することがで唇る数値制御装置の接続制御装置を得ろ
ことを目的とするものである。
ものであり、１台のＰＬＣに複数台の数値制御装置を接
続することがで唇る数値制御装置の接続制御装置を得ろ
ことを目的とするものである。
この発明に係る数値制御装置の接続制御装置は、ＰＬＣ
に複数台の数値制御装置を個別のものとして認識できる
機能を備え、数値制御装置にはＰＬＣとの共有メモリを
有するデータ入・出力部を設け、このデータ人・出力部
を介して数値制御装置とＰＬＣを接続するようにしたも
のである。
に複数台の数値制御装置を個別のものとして認識できる
機能を備え、数値制御装置にはＰＬＣとの共有メモリを
有するデータ入・出力部を設け、このデータ人・出力部
を介して数値制御装置とＰＬＣを接続するようにしたも
のである。
こΩ発明においては、数値制御装置に設げた像側の共有
メモリを介して、数値制御装置とＰＬＣを接続するから
、１台のＰＬＣＫ５数台の数値制御装置を接阜売するこ
とができる。
メモリを介して、数値制御装置とＰＬＣを接続するから
、１台のＰＬＣＫ５数台の数値制御装置を接阜売するこ
とができる。
第１図はこの発明の一実施例を示すブロック図であり、
図において（２）〜（４）は上記第５図に示した従来装
ｊと全く同一のものである。（１ａ）〜（１ｎ））ま各
々独立した数値制御装置、（５月末複数の数値制＠装＃
１ｔ（Ｉａ）〜（ｉｎ）に接続され、各々の数値ｉＩ制
御伎１ （１１）〜（１ｎ）に対応する機械（８ａ）〜
（８ｎ）をｖｉａするＰＬＣであり、Ｐ Ｌ Ｃ（５）
は複数台の数値［制御装置ｔ （１ａ）〜（１ｎ）を個
別のものとして認識で宇る機能を有する。（６）はＰ
Ｌ Ｃ（５）のプログラムが１己（，１されているシー
ケンスメモリ、（７ａ）〜（７ｎ）：各数値制御装置（
１ａ）〜（１ｎ）のサーボコントロー ／’Ｌ （−Ｎ
ｉ（より？ｌ！１１御されろｔＪ株のｊ’ｊ（、’ｌ
＝Ｌ ’ＩＪ 製Ｊ 、（９ａ ）〜（９ｎ）は設定表
示ボード、（１０ａ）〜（１０ｎ）はテープリーダであ
る。
図において（２）〜（４）は上記第５図に示した従来装
ｊと全く同一のものである。（１ａ）〜（１ｎ））ま各
々独立した数値制御装置、（５月末複数の数値制＠装＃
１ｔ（Ｉａ）〜（ｉｎ）に接続され、各々の数値ｉＩ制
御伎１ （１１）〜（１ｎ）に対応する機械（８ａ）〜
（８ｎ）をｖｉａするＰＬＣであり、Ｐ Ｌ Ｃ（５）
は複数台の数値［制御装置ｔ （１ａ）〜（１ｎ）を個
別のものとして認識で宇る機能を有する。（６）はＰ
Ｌ Ｃ（５）のプログラムが１己（，１されているシー
ケンスメモリ、（７ａ）〜（７ｎ）：各数値制御装置（
１ａ）〜（１ｎ）のサーボコントロー ／’Ｌ （−Ｎ
ｉ（より？ｌ！１１御されろｔＪ株のｊ’ｊ（、’ｌ
＝Ｌ ’ＩＪ 製Ｊ 、（９ａ ）〜（９ｎ）は設定表
示ボード、（１０ａ）〜（１０ｎ）はテープリーダであ
る。
（１１ａ） 〜（１ｉｎ）は各数値制御装ｆｉ （１ａ
”）〜（’Ｉｎ）に設けられたデータ人・出力部であり
、データ人・出力部（１１ａ） 〜（１１ｎ）により各
数値制御装ｆｆ（１ａ）〜（１ｎ）のＣＰ ｔＪ （３
）と外部のＰＬＣ（５）が接続されている。
”）〜（’Ｉｎ）に設けられたデータ人・出力部であり
、データ人・出力部（１１ａ） 〜（１１ｎ）により各
数値制御装ｆｆ（１ａ）〜（１ｎ）のＣＰ ｔＪ （３
）と外部のＰＬＣ（５）が接続されている。
第２図はデータ人・出力部（１１ａ）を示すブロック図
であり、図においてＣ１２は共有メモリ、０３はマルチ
プレクサ、Ｑ４はゲート回路、ｏ５はゲート回路０４に
ゲートオープン信号を出力するセレクト回路、αＱはＰ
ＬＣ（５）がらゲート回路りを介して送られる割込要求
信号によりＣＰ Ｕ （３１に釣込みをかける割込発止
回路である。
であり、図においてＣ１２は共有メモリ、０３はマルチ
プレクサ、Ｑ４はゲート回路、ｏ５はゲート回路０４に
ゲートオープン信号を出力するセレクト回路、αＱはＰ
ＬＣ（５）がらゲート回路りを介して送られる割込要求
信号によりＣＰ Ｕ （３１に釣込みをかける割込発止
回路である。
次ＫＰＬＣ（５）が上記データ人・出力部（１１ａ）〜
（１１ｎ）を介して接続されたｒｖ数台の数値制御装置
Ａ（１ａ）〜（Ｉｎ）のＣＰ Ｕ （３）とデータな交
信するときのＩｈ作を説明する。
（１１ｎ）を介して接続されたｒｖ数台の数値制御装置
Ａ（１ａ）〜（Ｉｎ）のＣＰ Ｕ （３）とデータな交
信するときのＩｈ作を説明する。
ＰＬＣ（５）が１８の数値制御装置のＣＰ Ｌｌ （：
ｌとデータ交イｆｆをするときは、まずＰ Ｌ Ｃ（５
＋はデー・２人・出力部（１１Ｂ） 〜（１１ｎ）のセ
レクト回路０５ Ｋ ｆＪ数台の数値制御装置（１ａ）
〜（１ｎ）のうち、どの数値制御装置を選択するかを指
示するセレクト信号を送る。数値制御装！ （１ｇ）の
データ人・出力部（１１ａ）に設けられたセレクト回路
（ト）は、あらかじめ数値制御装ａ （１１）を選択す
る特定のセレクト信号が送られてきたときだけゲートオ
ープン信号を出力するように設定されており、この特定
のセレクト信号によりゲート回路負◆が開かれ、ＰＬＣ
（５）と数値制御装＠ （１ａ）のＣＰＵ（３）とのデ
ータ交信が可能となる。
ｌとデータ交イｆｆをするときは、まずＰ Ｌ Ｃ（５
＋はデー・２人・出力部（１１Ｂ） 〜（１１ｎ）のセ
レクト回路０５ Ｋ ｆＪ数台の数値制御装置（１ａ）
〜（１ｎ）のうち、どの数値制御装置を選択するかを指
示するセレクト信号を送る。数値制御装！ （１ｇ）の
データ人・出力部（１１ａ）に設けられたセレクト回路
（ト）は、あらかじめ数値制御装ａ （１１）を選択す
る特定のセレクト信号が送られてきたときだけゲートオ
ープン信号を出力するように設定されており、この特定
のセレクト信号によりゲート回路負◆が開かれ、ＰＬＣ
（５）と数値制御装＠ （１ａ）のＣＰＵ（３）とのデ
ータ交信が可能となる。
こ０ＰＬＣ（５）と数値制御装！（１ａ）のＣＰ Ｕ
（３）のデータ交信が可能な状態でＰ Ｌ Ｃ（５）が
共有メモリαつからデータを読出す場合を第３図ＣＤフ
ローチャートに基づいて説明する。
（３）のデータ交信が可能な状態でＰ Ｌ Ｃ（５）が
共有メモリαつからデータを読出す場合を第３図ＣＤフ
ローチャートに基づいて説明する。
Ｐ Ｌ Ｃ（５）から読出要求信号（ステップ２０）が
データ人・出力部（１１ａ）に送られると（ステップ２
１）、ゲート回路α橿から割込発生回路ａｑに割込要求
信号が送られＣＰｔＪ（３）に割込みをかける（ステッ
プ２２）。ｅ ｐ Ｕ （３）は、この割込信号を受げ
ると（ステップ２３）、共有メモリ（２）に読出しが完
了しているか否かを判断しくステップ２４）、読出しが
完了していないときはＣＰ ［１（３順；共有メモリＯ
ｐに新しい情報のデータを書込み（ステップ２５）、省
込みが完了すると共有メモリ（ハ）をＰＬＣ（５）にあ
け渡すためにマルチプレクサ（ト）をＰＬＣ（５）側に
切替え（ステップ２６）、ＣＰＵ（３）からＰＬＣ（５
）に準備完了すなわち割込要求受付信号を送る（ステッ
プ２７）。Ｐ Ｌ Ｃ（５）はＣＰ ［１（３）から準
備完了信号を受けると（ステップ２８）、共有メモリ（
至）の内容を読出しくステップ２９）、読出しが完了す
ると（ステップ３０）、再渡ＣＰ Ｕ （３）に割込発
生回路０Ｑを介して割込信号を送る（ステップ３１）と
共に読出し操作を完了しくステップ３２）新しい情報の
データに基づき機械（８ａ）を制御する。
データ人・出力部（１１ａ）に送られると（ステップ２
１）、ゲート回路α橿から割込発生回路ａｑに割込要求
信号が送られＣＰｔＪ（３）に割込みをかける（ステッ
プ２２）。ｅ ｐ Ｕ （３）は、この割込信号を受げ
ると（ステップ２３）、共有メモリ（２）に読出しが完
了しているか否かを判断しくステップ２４）、読出しが
完了していないときはＣＰ ［１（３順；共有メモリＯ
ｐに新しい情報のデータを書込み（ステップ２５）、省
込みが完了すると共有メモリ（ハ）をＰＬＣ（５）にあ
け渡すためにマルチプレクサ（ト）をＰＬＣ（５）側に
切替え（ステップ２６）、ＣＰＵ（３）からＰＬＣ（５
）に準備完了すなわち割込要求受付信号を送る（ステッ
プ２７）。Ｐ Ｌ Ｃ（５）はＣＰ ［１（３）から準
備完了信号を受けると（ステップ２８）、共有メモリ（
至）の内容を読出しくステップ２９）、読出しが完了す
ると（ステップ３０）、再渡ＣＰ Ｕ （３）に割込発
生回路０Ｑを介して割込信号を送る（ステップ３１）と
共に読出し操作を完了しくステップ３２）新しい情報の
データに基づき機械（８ａ）を制御する。
一方ＣＰ Ｕ （３）はＰ Ｌ Ｃ（５）からの読出完
了の割込信号を受けると（ステップ２４）、マルチプレ
クサ（２）をＣＰＵ（３）＠ｒｃ切替えて（ステップ３
３）、読出し処理を完了する（ステップ３４）。
了の割込信号を受けると（ステップ２４）、マルチプレ
クサ（２）をＣＰＵ（３）＠ｒｃ切替えて（ステップ３
３）、読出し処理を完了する（ステップ３４）。
次にＰ Ｌ Ｃ（５）が共有メモリ（ロ）にデータを書
き込む■込み処理について第４図のフローチャート［基
づき説明する。
き込む■込み処理について第４図のフローチャート［基
づき説明する。
Ｐ Ｌ Ｃ（５）から書込被水信号（ステップ４０）が
デニタ入・出力部（１１ａ）に送られると（ステップ４
１）、ゲート回路ＣＩ４を介して割込発生回路αＱに割
込要求信号が送られＣＰ Ｕ （３）に割込みをかける
（ステップ゛４２）。ＣＰ Ｕ （３）は、この割込要
求信号を受けると（ステップ４３）、共有メモリ（６）
をＰ Ｌ Ｃ（５ｉにあけ渡すためにマルチプレクサα
３をＰ Ｌ Ｃ（５，１側へ切替え（ステップ４５）、
Ｐ Ｌ Ｃ（５２に準備完了信号すなわち割込を水受付
信号を送る（ステップ４６）。ＰＬＣ（５）はＣＰ Ｌ
ｌ （３）からの昂儒完了信号を受けると（ステップ４
７）、共有メモリ←２に加工起動信号が送られてきたこ
とを書き込む（ステップ４８）、、ＰＬＣ（５）の共有
メモリα２の書き込みが完了すると（ステップ４９）、
再度Ｐ Ｌ Ｃ（５）からＣＰ Ｌｌ （３）に書込完
了のｔ１ｊ込信号を送り（ステップ５０）、同時にＰ
Ｌ Ｃ（５ｉの書込１）処理な完了￥ろ（２テ；ンブ５
１）。
デニタ入・出力部（１１ａ）に送られると（ステップ４
１）、ゲート回路ＣＩ４を介して割込発生回路αＱに割
込要求信号が送られＣＰ Ｕ （３）に割込みをかける
（ステップ゛４２）。ＣＰ Ｕ （３）は、この割込要
求信号を受けると（ステップ４３）、共有メモリ（６）
をＰ Ｌ Ｃ（５ｉにあけ渡すためにマルチプレクサα
３をＰ Ｌ Ｃ（５，１側へ切替え（ステップ４５）、
Ｐ Ｌ Ｃ（５２に準備完了信号すなわち割込を水受付
信号を送る（ステップ４６）。ＰＬＣ（５）はＣＰ Ｌ
ｌ （３）からの昂儒完了信号を受けると（ステップ４
７）、共有メモリ←２に加工起動信号が送られてきたこ
とを書き込む（ステップ４８）、、ＰＬＣ（５）の共有
メモリα２の書き込みが完了すると（ステップ４９）、
再度Ｐ Ｌ Ｃ（５）からＣＰ Ｌｌ （３）に書込完
了のｔ１ｊ込信号を送り（ステップ５０）、同時にＰ
Ｌ Ｃ（５ｉの書込１）処理な完了￥ろ（２テ；ンブ５
１）。
一方、ＣＰ ＩＪ （３）は裏込完了の割込イボ号を受
けＺ・と（ステップ４４）マルチプレクサ０３をＣＰ
ｔＪ （３）側に切替え（ステップ５２）、共有メモリ
（２）に書き込まれたデータなＣＰＵ（３）に読込み（
ステップ５３）、書込み処理を完了する（ステップ５４
）。
けＺ・と（ステップ４４）マルチプレクサ０３をＣＰ
ｔＪ （３）側に切替え（ステップ５２）、共有メモリ
（２）に書き込まれたデータなＣＰＵ（３）に読込み（
ステップ５３）、書込み処理を完了する（ステップ５４
）。
なお、上記説明では数値制御装置！（１ａ）の動作につ
いて説明したが、他の数値制御装置（１ｎ）の動作も上
記説明の動作と同様の動作を行なう。
いて説明したが、他の数値制御装置（１ｎ）の動作も上
記説明の動作と同様の動作を行なう。
この発明は以上説明したように、数値側０１装箭に設け
た共有メモリを有するデータ人・出力部を介して、数値
制御装置を複数台の数値制御装）を個別のものとし″′
Ｃ認識できる機能を備えたｌ’ Ｌ Ｃに接続するから
、１台のＰＬＣに複数台の数値ＩＬ：］御装置を接続す
ることができ、１台のＰＬＣで複数の数値制御装置な制
御、すなわち１数の機絨群の制御を行なうことができる
効果を有する。
た共有メモリを有するデータ人・出力部を介して、数値
制御装置を複数台の数値制御装）を個別のものとし″′
Ｃ認識できる機能を備えたｌ’ Ｌ Ｃに接続するから
、１台のＰＬＣに複数台の数値ＩＬ：］御装置を接続す
ることができ、１台のＰＬＣで複数の数値制御装置な制
御、すなわち１数の機絨群の制御を行なうことができる
効果を有する。
第１図はこの発明の実施例を示すブロック図・、第２図
は上記夾鵠例のデータ人・出力部を示すブロック図、第
６図は上記実施例によ７．）訣出しｌｊｌ、、 ：Ｉｊ
！を示す７０−チャー）、ｆｇｄ図は上記実施例による
書込み処理を示すフローチャート、ｖｇ５図は従来の数
値制御装置を示すブロック図である。 （１）、（ｉａ）、（Ｉｎ）・・・数値制御装置、（２
）・・・メモリ、（３）・・・ＣＰＵ、（４）・・・サ
ーボコントロール、（５）・・・ＰＬＣ。 （６）・・・シーケンスメモリ、（７） 、（７ａ）ｌ
（７ｎ）・・・軸駆動装置、（８） ＋（ａａ）＋（８
ｎ）・・・機械、（１１ａ）、（ｌｉｎ）・・・データ
人・出力部、（６）・・・共有メモリ、（至）・・・マ
ルチプレクサ、Ｑ４・・・ゲート回路、α９・・・セレ
クト回路、鵠・・・割込発生回路。 なお、各図中同一符号は同−又は相当部分を示す。 代理人 弁理士 佐 藤 正 年 ＋１０ 手続補正書（眩） １、事件の表示 特願昭６１−１：３２８４０号 ２、発明の名称 数値制御装置の接続制御装置 ３、補正をする者 事件との関係 特許出願人 住 所 東京都千代田区丸の内二丁目２番３号名
称 （ｌｌｉｏｌ）三菱電機株式会社代表者志岐守
哉 ４、代理人 住 所 東京都港区虎ノ門五丁目８番６号アミタビ
ル 明細書の「発明の詳細な説明」の欄及び図面。 ６、補正の内容 （１）明細書第３頁第２行の「メモリ（３）」を「メモ
リ（２）」と補正する。 （２）明細書第３頁第５行の「メモ１バ３ン」を「メモ
リ（２）」と補正する。 舖Ｔｒ：Ｍ 而 １１Ｕ １ ｄ ＋山
は上記夾鵠例のデータ人・出力部を示すブロック図、第
６図は上記実施例によ７．）訣出しｌｊｌ、、 ：Ｉｊ
！を示す７０−チャー）、ｆｇｄ図は上記実施例による
書込み処理を示すフローチャート、ｖｇ５図は従来の数
値制御装置を示すブロック図である。 （１）、（ｉａ）、（Ｉｎ）・・・数値制御装置、（２
）・・・メモリ、（３）・・・ＣＰＵ、（４）・・・サ
ーボコントロール、（５）・・・ＰＬＣ。 （６）・・・シーケンスメモリ、（７） 、（７ａ）ｌ
（７ｎ）・・・軸駆動装置、（８） ＋（ａａ）＋（８
ｎ）・・・機械、（１１ａ）、（ｌｉｎ）・・・データ
人・出力部、（６）・・・共有メモリ、（至）・・・マ
ルチプレクサ、Ｑ４・・・ゲート回路、α９・・・セレ
クト回路、鵠・・・割込発生回路。 なお、各図中同一符号は同−又は相当部分を示す。 代理人 弁理士 佐 藤 正 年 ＋１０ 手続補正書（眩） １、事件の表示 特願昭６１−１：３２８４０号 ２、発明の名称 数値制御装置の接続制御装置 ３、補正をする者 事件との関係 特許出願人 住 所 東京都千代田区丸の内二丁目２番３号名
称 （ｌｌｉｏｌ）三菱電機株式会社代表者志岐守
哉 ４、代理人 住 所 東京都港区虎ノ門五丁目８番６号アミタビ
ル 明細書の「発明の詳細な説明」の欄及び図面。 ６、補正の内容 （１）明細書第３頁第２行の「メモリ（３）」を「メモ
リ（２）」と補正する。 （２）明細書第３頁第５行の「メモ１バ３ン」を「メモ
リ（２）」と補正する。 舖Ｔｒ：Ｍ 而 １１Ｕ １ ｄ ＋山
Claims (2)
- （１）２台以上の数値制御装置を個別のものとして認識
できる機能を有するプログラマブルロジックコントロー
ラ（以下ＰＬＣという。）と、 該ＰＬＣとの共有メモリを有するデータ入・出力部を有
する数値制御装置とを有し、 １台の上記ＰＬＣに少なくとも２台以上の上記数値制御
装置を接合した数値制御装置の接続制御装置。 - （２）共有メモリを有する入・出力部がＰＬＣからのセ
レクト信号を選択するセレクト回路と、セレクト回路の
出力によりＰＬＣからの信号を送るゲート回路と、ゲー
ト回路を介したＰＬＣの信号により数値制御装置のＣＰ
Ｕに割込信号を発生する割込発生回路と、ＣＰＵからの
信号により共有メモリをＣＰＵ側又はＰＬＣ側に切替え
るマルチプレクサとを有する特許請求の範囲第１項記載
の数値制御装置の接続制御装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61132840A JPS62290908A (ja) | 1986-06-10 | 1986-06-10 | 数値制御装置の接続制御装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61132840A JPS62290908A (ja) | 1986-06-10 | 1986-06-10 | 数値制御装置の接続制御装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS62290908A true JPS62290908A (ja) | 1987-12-17 |
Family
ID=15090745
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP61132840A Pending JPS62290908A (ja) | 1986-06-10 | 1986-06-10 | 数値制御装置の接続制御装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS62290908A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0348304A (ja) * | 1989-02-17 | 1991-03-01 | Hughes Aircraft Co | 高速デジタル運動制御装置 |
| JPH04182805A (ja) * | 1990-11-19 | 1992-06-30 | Omron Corp | プログラマブル・コントローラ |
-
1986
- 1986-06-10 JP JP61132840A patent/JPS62290908A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0348304A (ja) * | 1989-02-17 | 1991-03-01 | Hughes Aircraft Co | 高速デジタル運動制御装置 |
| JPH04182805A (ja) * | 1990-11-19 | 1992-06-30 | Omron Corp | プログラマブル・コントローラ |
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