JPS62147746A - 集積回路構造 - Google Patents
集積回路構造Info
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- JPS62147746A JPS62147746A JP28883385A JP28883385A JPS62147746A JP S62147746 A JPS62147746 A JP S62147746A JP 28883385 A JP28883385 A JP 28883385A JP 28883385 A JP28883385 A JP 28883385A JP S62147746 A JPS62147746 A JP S62147746A
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- JP
- Japan
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- integrated circuit
- wafer
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- circuit
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- 239000002356 single layer Substances 0.000 claims description 2
- 239000010410 layer Substances 0.000 abstract description 7
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Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L27/00—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate
- H01L27/02—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers
- H01L27/0203—Particular design considerations for integrated circuits
- H01L27/0207—Geometrical layout of the components, e.g. computer aided design; custom LSI, semi-custom LSI, standard cell technique
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/0001—Technical content checked by a classifier
- H01L2924/0002—Not covered by any one of groups H01L24/00, H01L24/00 and H01L2224/00
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- Engineering & Computer Science (AREA)
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- Semiconductor Integrated Circuits (AREA)
- Design And Manufacture Of Integrated Circuits (AREA)
- Element Separation (AREA)
- Internal Circuitry In Semiconductor Integrated Circuit Devices (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
「産業上の利用分野〕
本発明は集積回路構造に関し、特に大規模論理横道を持
つシステムに使用される一ウェーハ集積回路構造に関す
る。
つシステムに使用される一ウェーハ集積回路構造に関す
る。
従来、例えば大規模論理構造システムに使用される集積
回路構造として接続点を減少し信頼性を向上し、近接配
線が可能になり高速化、高密度。
回路構造として接続点を減少し信頼性を向上し、近接配
線が可能になり高速化、高密度。
小型化を達成する方式として−ウェーハで一集積回路を
構成するというアイディアは出されているがいまだ実用
に供されていない。
構成するというアイディアは出されているがいまだ実用
に供されていない。
(発明が解決しようとする問題点:)
上述し、た従来の一ウェーハー集積回路という技術は、
−ウェーハ内に従来多数の集積回路チップとして構成し
た回路機能を一枚のウェーハに作り込んだものである。
−ウェーハ内に従来多数の集積回路チップとして構成し
た回路機能を一枚のウェーハに作り込んだものである。
従ってウェーハに内在する結晶欠陥の存在及び、集積回
路作り込みの段階での不具合の発生により、−ウェーハ
全体が良品になる確立が極めて低いという欠点があり、
実用が困難であった。
路作り込みの段階での不具合の発生により、−ウェーハ
全体が良品になる確立が極めて低いという欠点があり、
実用が困難であった。
本発明の目的は、従来の欠点を除去し、歩留りよく形成
でき、実用に供し得るーウェーハー集積回路の集積回路
構造を提供することにある。
でき、実用に供し得るーウェーハー集積回路の集積回路
構造を提供することにある。
本発明の集積回路構造は一枚のウェーハ内に、ウェーハ
上面から下面に貫通ずる穴を有し、該穴以外のウェーハ
内は外部端子をもつ独立した複数の集積回路群を有し、
前記穴部分には集積回路をはめ込んな一ウェーハ集積回
路群と、該−ウェーハ集積回路群の上面に形成した一ウ
ェーハ集積回路群中の各集積回路の外部端子同志を結ぶ
一層または多層の配線とを含んで構成される。
上面から下面に貫通ずる穴を有し、該穴以外のウェーハ
内は外部端子をもつ独立した複数の集積回路群を有し、
前記穴部分には集積回路をはめ込んな一ウェーハ集積回
路群と、該−ウェーハ集積回路群の上面に形成した一ウ
ェーハ集積回路群中の各集積回路の外部端子同志を結ぶ
一層または多層の配線とを含んで構成される。
次に、本発明の実施例について図面を参照して説明する
。第1図(a)、(b)乃至第3図(a>、(b)は、
本発明の一実施例の構造並びにその製造方法を説明する
なめに、工程順に示した平面図及びその断面図である。
。第1図(a)、(b)乃至第3図(a>、(b)は、
本発明の一実施例の構造並びにその製造方法を説明する
なめに、工程順に示した平面図及びその断面図である。
まず、第1図(a>、(b)に示すように、つ工−ハ1
上に、上面に外部J1匈子3を有する集積回路群A、B
、C,D、E、F、G、Hを形成し、各集積回路の特性
をチェ・ツクし良否を決める。本実施例ではその中で集
積回路りが不具合である為、集積回路り部分をウェーハ
1から切断し去った状態を示すもので、4はウェーハ上
面から下面に貫通する貫通穴である。なお、各集積回路
は独立した外部端子3が形成されている。また5は後の
工程で不良集積回路部分を除去するために予めダイシン
グソー等で形成した区画分離用溝である。
上に、上面に外部J1匈子3を有する集積回路群A、B
、C,D、E、F、G、Hを形成し、各集積回路の特性
をチェ・ツクし良否を決める。本実施例ではその中で集
積回路りが不具合である為、集積回路り部分をウェーハ
1から切断し去った状態を示すもので、4はウェーハ上
面から下面に貫通する貫通穴である。なお、各集積回路
は独立した外部端子3が形成されている。また5は後の
工程で不良集積回路部分を除去するために予めダイシン
グソー等で形成した区画分離用溝である。
次に、第2図(a)、(b)に示すように、ウェーハ1
の切断し去った集積回路り部分に集積回路D6をはめ込
む。ウェーハ1と集積回路D6の間は、導電性コンパウ
ンド7を充填し、固定する。
の切断し去った集積回路り部分に集積回路D6をはめ込
む。ウェーハ1と集積回路D6の間は、導電性コンパウ
ンド7を充填し、固定する。
次に、第3図(a>、(b)に示すように、第2図(a
)、(b)にて示したーウェーハー集積回路群の上面に
、層間絶縁膜11.第1層配線13、第2層配線14.
上下配線を結ぶスルーホール12.引き出し線9.電源
バス10.入出力バッド8が構成され、ウェーハ全体で
大規模回路を持つ集積回路を形成している。
)、(b)にて示したーウェーハー集積回路群の上面に
、層間絶縁膜11.第1層配線13、第2層配線14.
上下配線を結ぶスルーホール12.引き出し線9.電源
バス10.入出力バッド8が構成され、ウェーハ全体で
大規模回路を持つ集積回路を形成している。
以上説明したように本発明は、ウェーハ内に複数の集積
回路群を形成し、集積回路群のうち不具合が生じた集積
回路部分を、正常な集積回路と交換した後ウェーハ上面
に集積回路群を結ぶ配線を施す事により、−ウェーハ集
積回路を実現可能にできる効果がある。
回路群を形成し、集積回路群のうち不具合が生じた集積
回路部分を、正常な集積回路と交換した後ウェーハ上面
に集積回路群を結ぶ配線を施す事により、−ウェーハ集
積回路を実現可能にできる効果がある。
第1図(a>、(b)乃至第3図(a)、(b)は本発
明の一実施例の構造並びに製造法を説明するなめに工程
順に示した平面図及び模式的断面図である。 1・・・ウェーハ、2・・・独立集積回路、3・・・独
立集積回路上の外部端子、4・・・貫通穴、5・・・区
画分離用溝、6・・・はめ込まれた集積回路D、7・・
・導電性コンパウンド、8・・・入出力パッド、9・・
・引き出し線、10・・・電源バス、11・・・層間絶
縁膜、12・・・スルーホール、13・・・第1層配線
、14・・・第2層配線。 第 / 圀 $ 3 図
明の一実施例の構造並びに製造法を説明するなめに工程
順に示した平面図及び模式的断面図である。 1・・・ウェーハ、2・・・独立集積回路、3・・・独
立集積回路上の外部端子、4・・・貫通穴、5・・・区
画分離用溝、6・・・はめ込まれた集積回路D、7・・
・導電性コンパウンド、8・・・入出力パッド、9・・
・引き出し線、10・・・電源バス、11・・・層間絶
縁膜、12・・・スルーホール、13・・・第1層配線
、14・・・第2層配線。 第 / 圀 $ 3 図
Claims (1)
- 一枚のウェーハ内に、ウェーハ上面から下面に貫通する
穴を有し、該穴以外のウェーハ内は外部端子をもつ独立
した複数の集積回路群を有し、前記穴部分には集積回路
をはめ込んだ一ウェーハ集積回路群と、該一ウェーハ集
積回路群の上面に形成した一ウェーハ集積回路群中の各
集積回路の外部端子同志を結ぶ一層または多層の配線と
を含むことを特徴とする集積回路構造。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP28883385A JPS62147746A (ja) | 1985-12-20 | 1985-12-20 | 集積回路構造 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP28883385A JPS62147746A (ja) | 1985-12-20 | 1985-12-20 | 集積回路構造 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS62147746A true JPS62147746A (ja) | 1987-07-01 |
Family
ID=17735336
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP28883385A Pending JPS62147746A (ja) | 1985-12-20 | 1985-12-20 | 集積回路構造 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS62147746A (ja) |
Cited By (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5153700A (en) * | 1988-07-22 | 1992-10-06 | Nippondenso Co., Ltd. | Crystal-etched matching faces on semiconductor chip and supporting semiconductor substrate |
US5208178A (en) * | 1990-08-02 | 1993-05-04 | Hitachi, Ltd. | Manufacturing a semiconductor integrated circuit device having on chip logic correction |
US5909052A (en) * | 1986-03-12 | 1999-06-01 | Hitachi, Ltd. | Semiconductor device having plural chips with the sides of the chips in face-to-face contact with each other in the same crystal plane |
US5968150A (en) * | 1986-03-12 | 1999-10-19 | Hitachi, Ltd. | Processor element having a plurality of CPUs for use in a multiple processor system |
Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS6143435A (ja) * | 1984-08-08 | 1986-03-03 | Hitachi Ltd | 半導体装置およびその製造方法 |
-
1985
- 1985-12-20 JP JP28883385A patent/JPS62147746A/ja active Pending
Patent Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS6143435A (ja) * | 1984-08-08 | 1986-03-03 | Hitachi Ltd | 半導体装置およびその製造方法 |
Cited By (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5909052A (en) * | 1986-03-12 | 1999-06-01 | Hitachi, Ltd. | Semiconductor device having plural chips with the sides of the chips in face-to-face contact with each other in the same crystal plane |
US5968150A (en) * | 1986-03-12 | 1999-10-19 | Hitachi, Ltd. | Processor element having a plurality of CPUs for use in a multiple processor system |
US6379998B1 (en) * | 1986-03-12 | 2002-04-30 | Hitachi, Ltd. | Semiconductor device and method for fabricating the same |
US5153700A (en) * | 1988-07-22 | 1992-10-06 | Nippondenso Co., Ltd. | Crystal-etched matching faces on semiconductor chip and supporting semiconductor substrate |
US5208178A (en) * | 1990-08-02 | 1993-05-04 | Hitachi, Ltd. | Manufacturing a semiconductor integrated circuit device having on chip logic correction |
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