JPS6126383A - 走査線変換装置 - Google Patents
走査線変換装置Info
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- JPS6126383A JPS6126383A JP14775784A JP14775784A JPS6126383A JP S6126383 A JPS6126383 A JP S6126383A JP 14775784 A JP14775784 A JP 14775784A JP 14775784 A JP14775784 A JP 14775784A JP S6126383 A JPS6126383 A JP S6126383A
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
産業上の利用分野
本発明は、例えば走査線数１１２５本のいわゆる高精細
度テレビを、５２５本のＮＴＳＣ方式の装置で受像する
場合に使用される走査線変換装置に関する。
度テレビを、５２５本のＮＴＳＣ方式の装置で受像する
場合に使用される走査線変換装置に関する。
背景技術とその問題点
いわゆる高精細度テレビが提案されている。このテレビ
では走査線数が１１２５本と多く、また縦横比も３：５
と、従来のＮＴＳＣ等の方式と異なっている。このため
このようなテレビを受像するためには専用の新たな装置
が必要である。
では走査線数が１１２５本と多く、また縦横比も３：５
と、従来のＮＴＳＣ等の方式と異なっている。このため
このようなテレビを受像するためには専用の新たな装置
が必要である。
しかしながらこのような高精細度テレビを受像するため
の装置は極めて高価になることが予想される。そこで高
精細度テレビを、従来のＮＴＳＣ等の方式の装置で受像
できるように走査線を変換することが考えられた。この
ようにすれば、画面は高精細度ではなくなるが、番組を
鑑賞することはできる。
の装置は極めて高価になることが予想される。そこで高
精細度テレビを、従来のＮＴＳＣ等の方式の装置で受像
できるように走査線を変換することが考えられた。この
ようにすれば、画面は高精細度ではなくなるが、番組を
鑑賞することはできる。
すなわち、例えば高精細度テレビにおいて、１１２５本
の走査線中、映像信号は１０４５本である。一方ＮＴＳ
Ｃ方式では５２５本中４Ｂ５本である。そこで高精細度
テレビの走査線の内の例えば上下端の７５本を削除し、
残りを１／２の比率で変換すれば、（１０４５−７５）
全２＝４８５ となって、高精細度テレビの映像をＮＴＳＣ方式の装置
で見ることができる。
の走査線中、映像信号は１０４５本である。一方ＮＴＳ
Ｃ方式では５２５本中４Ｂ５本である。そこで高精細度
テレビの走査線の内の例えば上下端の７５本を削除し、
残りを１／２の比率で変換すれば、（１０４５−７５）
全２＝４８５ となって、高精細度テレビの映像をＮＴＳＣ方式の装置
で見ることができる。
その場合に、第４ｖｊ！Ｊに示すように、入力端子（４
１）に供給される映像信号を１水平期間の遅延回路（４
２）で遅延させ、この遅延信号と元の映像信号とをそれ
ぞれ１／２のレベル変換器（４３）（４４）を１ｉ１１
じて加算器（４５〉が加算する。
１）に供給される映像信号を１水平期間の遅延回路（４
２）で遅延させ、この遅延信号と元の映像信号とをそれ
ぞれ１／２のレベル変換器（４３）（４４）を１ｉ１１
じて加算器（４５〉が加算する。
これによれば、例えば奇数フィールドにおいて、第５図
に示すように第１走査線（５１ｏ）と第２走査線（５２
ｏ）とから、変換による第１走査線（５１ｏ’）が形成
され、第３走査線（５３ｏ）と第４走査線（５４ｏ）と
から、変換による第２走査線（５２ｏ’）が形成される
。
に示すように第１走査線（５１ｏ）と第２走査線（５２
ｏ）とから、変換による第１走査線（５１ｏ’）が形成
され、第３走査線（５３ｏ）と第４走査線（５４ｏ）と
から、変換による第２走査線（５２ｏ’）が形成される
。
これに対して偶数フィールドでは、奇数フィールドとの
間で１：２のインターレースによる走査線の配置を保つ
ためには、第２走査線（５２ｅ）と変換後の第１走査線
（５１ｅ’）とが等しくされ、第４走査線（５４ｅ ）
と変換後の第２走査線（５２ｅ’ ）とが等しくされる
。そこで第４図において、入力端子（４１）からの元の
信号と加算器（４５）からの加算信号とを、スイッチ（
４６）で１フイールドごとに切換えて出力端子（４７）
に取り出すことにより、例えば奇数フィールドでは２本
の走査線が１／２のレベルで加算された信号が出力端子
（４７）に取り出され、偶数フィールドでは対応する走
査線が直接出力端子（４７）に取り出されるようになる
。
間で１：２のインターレースによる走査線の配置を保つ
ためには、第２走査線（５２ｅ）と変換後の第１走査線
（５１ｅ’）とが等しくされ、第４走査線（５４ｅ ）
と変換後の第２走査線（５２ｅ’ ）とが等しくされる
。そこで第４図において、入力端子（４１）からの元の
信号と加算器（４５）からの加算信号とを、スイッチ（
４６）で１フイールドごとに切換えて出力端子（４７）
に取り出すことにより、例えば奇数フィールドでは２本
の走査線が１／２のレベルで加算された信号が出力端子
（４７）に取り出され、偶数フィールドでは対応する走
査線が直接出力端子（４７）に取り出されるようになる
。
ところがこの装置において、奇数フィールドと偶数フィ
ールドとで通過する回路構成が異なることになる。そし
てこのように異なる回路を通した場合には、レベル調整
等が困難であり、フリ・７カー等の画＝’＝化が生じ易
くなる。
ールドとで通過する回路構成が異なることになる。そし
てこのように異なる回路を通した場合には、レベル調整
等が困難であり、フリ・７カー等の画＝’＝化が生じ易
くなる。
また上述の１水平期間の遅延回路（４２）とレベル変換
器（４３） 、 （４４） 、加算器（４５）を組み
合せた構成は、いわゆるくし形フィルタの構成であり、
そのフィルタ特性は第６図の曲線（６１）に示すように
＋ｆｎ （ｆｎは水平周波数）を減衰極とするトラッ
プ特性となっている。ここで通禽の映像信号では、＋
、ｆ ｘの点には信号は存在しないが、特性曲線のいわ
ゆる肩の部分が問題であり、この部分にかかる映像信号
が劣化される。−そしてこのような劣化は例えば奇数フ
ィールドだけで発生されるので、これによってもフリッ
カ−等の画面劣化が生じるおそれがあった。
器（４３） 、 （４４） 、加算器（４５）を組み
合せた構成は、いわゆるくし形フィルタの構成であり、
そのフィルタ特性は第６図の曲線（６１）に示すように
＋ｆｎ （ｆｎは水平周波数）を減衰極とするトラッ
プ特性となっている。ここで通禽の映像信号では、＋
、ｆ ｘの点には信号は存在しないが、特性曲線のいわ
ゆる肩の部分が問題であり、この部分にかかる映像信号
が劣化される。−そしてこのような劣化は例えば奇数フ
ィールドだけで発生されるので、これによってもフリッ
カ−等の画面劣化が生じるおそれがあった。
発明の目的
本発明はこのような点にかんがみ、簡単な構成で走査線
の変換が行われるようにするものである。
の変換が行われるようにするものである。
発明の概要
本発明は、元信号と、この元信号を１水平期間遅延させ
た信号とを、−のフィールドでは１／４と３／４のレベ
ル比で加算し、他のフィールドでは３／４と１／４のレ
ベルで加算するようにして、走査線数を１／２に変換す
るようにした走査線変換装置であって、これによれば簡
単な構成で走査線の変換を行うことができる。
た信号とを、−のフィールドでは１／４と３／４のレベ
ル比で加算し、他のフィールドでは３／４と１／４のレ
ベルで加算するようにして、走査線数を１／２に変換す
るようにした走査線変換装置であって、これによれば簡
単な構成で走査線の変換を行うことができる。
実施例
第１図において、アンテナ（１）からの高精細度のテレ
ビ信号がチューナ（２）で受信され、コンポジットの信
号とされる。
ビ信号がチューナ（２）で受信され、コンポジットの信
号とされる。
この信号がセレクタ回路（３）の第１の入力端子に供給
される。さらにチューナ（２）からの信号が１水平期間
の遅延回路（４）に供給され、この遅延回路（４）から
の信号がセレクタ回路（３）の第２の入力端子に供給さ
れる。
される。さらにチューナ（２）からの信号が１水平期間
の遅延回路（４）に供給され、この遅延回路（４）から
の信号がセレクタ回路（３）の第２の入力端子に供給さ
れる。
またチューナ（２）からの信号が同期分離回路（５）に
供給されて同期信号が分離される。この分離された同期
信号がフィールド判別回路（６）に供給され、奇数・偶
数のツーイールドが判別されてこの判別信号がセレクタ
回路（３）の制御端子に供給される。
供給されて同期信号が分離される。この分離された同期
信号がフィールド判別回路（６）に供給され、奇数・偶
数のツーイールドが判別されてこの判別信号がセレクタ
回路（３）の制御端子に供給される。
そしてセレクタ回路（３）にて、判別信号に従って、例
えば奇数フィールドでは第１、第２の入力端子からの信
号が直接第１、第２の出力端子Ｇと取り出されると共に
、偶数フィールドでは逆転して取り出される。
えば奇数フィールドでは第１、第２の入力端子からの信
号が直接第１、第２の出力端子Ｇと取り出されると共に
、偶数フィールドでは逆転して取り出される。
このセレクタ回路（３）の第１の出力端子からの信号が
１／４のレベル変換器（７）に供給され、第２の出力端
子からの信号が３／４のレベル変換器（８）に供給され
る。さらにこれらのレベル変換器（７１（８１からの信
号が加算器＋９）で加算され、この加算信号が時間軸伸
長回路ＱＯＩに供給されて、後述する所定の比率の時間
軸伸長が行われる。この伸長回路α＠からの信号が加算
器（１１）を通して受像機（１２）に供給される。
１／４のレベル変換器（７）に供給され、第２の出力端
子からの信号が３／４のレベル変換器（８）に供給され
る。さらにこれらのレベル変換器（７１（８１からの信
号が加算器＋９）で加算され、この加算信号が時間軸伸
長回路ＱＯＩに供給されて、後述する所定の比率の時間
軸伸長が行われる。この伸長回路α＠からの信号が加算
器（１１）を通して受像機（１２）に供給される。
ここで加算器（９）からは、まず奇数フィールドにおい
て、前の走査線を３７４にレベル変換した信号と次の走
査線を１／４にレベル変換した信号とを加算した信号が
取り出され、また偶数フィールドにおいては、前の走査
線を１／４にレベル変換した信号と次の走査線を３／４
にレベル変換した信号とを加算した信号が取り出される
。そしてこの信号が、伸長回路ａので１本おきの走査線
が所定の時間軸伸長されて取り出される。
て、前の走査線を３７４にレベル変換した信号と次の走
査線を１／４にレベル変換した信号とを加算した信号が
取り出され、また偶数フィールドにおいては、前の走査
線を１／４にレベル変換した信号と次の走査線を３／４
にレベル変換した信号とを加算した信号が取り出される
。そしてこの信号が、伸長回路ａので１本おきの走査線
が所定の時間軸伸長されて取り出される。
従って伸長回路ＱＯ）からは、第２図の走査線（２１ｏ
）（２２ｏ ）・・・・（２１ｅ ） （２２ｅ ）
・・・・に対して破線（２１ｏ’ ） （２２ｏ’
）・・・・（２１ｅ’ ） （２２ｅ’ ）・・・・
で示す位置に相当する信号が形成されて取り出される。
）（２２ｏ ）・・・・（２１ｅ ） （２２ｅ ）
・・・・に対して破線（２１ｏ’ ） （２２ｏ’
）・・・・（２１ｅ’ ） （２２ｅ’ ）・・・・
で示す位置に相当する信号が形成されて取り出される。
なおこれらの位置は１：２のインターレースが保たれて
いる。また実際にはそれぞれ下側の走査線より後でなけ
れば信号は形成されないから、それぞれ例えば−走査期
間後の一点鎖線（２１ｏ” ） （２２ｏ” ）・・
・・（２１ｅ” ） （２２ｅ” ）・・・・の位置
に取り出される。
いる。また実際にはそれぞれ下側の走査線より後でなけ
れば信号は形成されないから、それぞれ例えば−走査期
間後の一点鎖線（２１ｏ” ） （２２ｏ” ）・・
・・（２１ｅ” ） （２２ｅ” ）・・・・の位置
に取り出される。
これによって走査線数が１／２になる。すなわち１０４
５−７５本が４８５本になると共に、それぞれ１：２の
インターレースの保たれた信号が形成される。
５−７５本が４８５本になると共に、それぞれ１：２の
インターレースの保たれた信号が形成される。
また水平周期は、高精細度テレビの約３０μｓｅｃが２
倍されて約６０μｓｅｃになる。一方ＮＴＳＣ方式では
約６３．５μｓｅｃである。従って水平同期信号の位置
が変化する。そこで図中に示すように分離された同期信
号を同期信号形成２回路（１３）に供給し、所望あ同期
信号を形成して加算器（１１）で出力信号に加算する。
倍されて約６０μｓｅｃになる。一方ＮＴＳＣ方式では
約６３．５μｓｅｃである。従って水平同期信号の位置
が変化する。そこで図中に示すように分離された同期信
号を同期信号形成２回路（１３）に供給し、所望あ同期
信号を形成して加算器（１１）で出力信号に加算する。
また受像機（１２）においては６０μｓｅｃ周期が引き
込めるように、水平走査発振の許容を若干広くする必要
があるが、一般に在来の受像機でもこの程度の許容範囲
はある。
込めるように、水平走査発振の許容を若干広くする必要
があるが、一般に在来の受像機でもこの程度の許容範囲
はある。
さらに高精細度テレビの画面の縦横比は３：５であり、
ＮＴＳＣ方式での３：４と異っている。
ＮＴＳＣ方式での３：４と異っている。
そこで上述の時間軸伸長回路ａＯ）においては、走査線
９７０本に対して３：４の比率になる水平走査時間約１
８．３６μｓｅｃが、走査線４８５本に対して３：４の
比率になる水平走査時間約５２．４６μｓｅｃになるよ
うに時間軸伸長を行うようにする。。
９７０本に対して３：４の比率になる水平走査時間約１
８．３６μｓｅｃが、走査線４８５本に対して３：４の
比率になる水平走査時間約５２．４６μｓｅｃになるよ
うに時間軸伸長を行うようにする。。
こうして走査線の変換が行われるわけであるが、この装
置によれば簡単な遅延回路とレベル変換器等を用いるの
みなので、全体を極めて安価に作ることができる。なお
レベル変換器はアナログ処理の場合、簡単なリニアアン
プで構成できる。
置によれば簡単な遅延回路とレベル変換器等を用いるの
みなので、全体を極めて安価に作ることができる。なお
レベル変換器はアナログ処理の場合、簡単なリニアアン
プで構成できる。
また奇数フィールド、偶数フィールドにおいて常に同じ
回路を信号が通過するので、画面の安定性が極めて良い
。
回路を信号が通過するので、画面の安定性が極めて良い
。
また上述の装置において、遅延回路（４）とレベル変換
器（７） 、 ＋８１、加算器（９）を組み合せたくし
形フィルタの特性は第６図に曲線（６２）で示すように
なっており、これによって生じる画面の劣化は極めて少
ない。
器（７） 、 ＋８１、加算器（９）を組み合せたくし
形フィルタの特性は第６図に曲線（６２）で示すように
なっており、これによって生じる画面の劣化は極めて少
ない。
さらに上述の装置において、チューナ（２）の出力をＡ
Ｄ変換してデジタルで処理を行うようにすることもでき
る。その場合には、例えば第３図のようにされる。図に
おいてデジタル信号のレベル変換は、例えばＩ／４にす
る場合には下位側の２ビツトを削除して残りビットを下
位へ２ビツトシフトすればよい。また３／４にする場合
には上述の１／４にした信号と同様の１ビツトシフトに
より１／２にした信号と加算すればよい。
Ｄ変換してデジタルで処理を行うようにすることもでき
る。その場合には、例えば第３図のようにされる。図に
おいてデジタル信号のレベル変換は、例えばＩ／４にす
る場合には下位側の２ビツトを削除して残りビットを下
位へ２ビツトシフトすればよい。また３／４にする場合
には上述の１／４にした信号と同様の１ビツトシフトに
より１／２にした信号と加算すればよい。
そこで上述のチューナ（２）からの信号がＡＤ変換器（
３１）に供給されて例えば８ビツトのデジタル信号とさ
れる。この信号がシフトレジスタあるいはメモリからな
る１水平期間の遅延回路（３２）に供給される。この遅
延回路（３２）の入力側及び出力側の信号がそれぞれ下
位２ビツトが削除され、８ビツト３人力の加算器（３３
）の第１、第２の入力のそれぞれ下位６ビツトに供給さ
れる。この第１、第２の入力の上位２ビツトにはそれぞ
れ“θ″が供給される。
３１）に供給されて例えば８ビツトのデジタル信号とさ
れる。この信号がシフトレジスタあるいはメモリからな
る１水平期間の遅延回路（３２）に供給される。この遅
延回路（３２）の入力側及び出力側の信号がそれぞれ下
位２ビツトが削除され、８ビツト３人力の加算器（３３
）の第１、第２の入力のそれぞれ下位６ビツトに供給さ
れる。この第１、第２の入力の上位２ビツトにはそれぞ
れ“θ″が供給される。
また遅延回路（３２）の入力側及び出力側の信号がそれ
ぞれ下位１ビツトが削除され、７ビソ、１２人力のセレ
クタ回路（３４）に供給される。そしてこのセレクタ回
路（３４）で選択された信号が加算器（３３）の第３の
入力の下位７ビツトに供給される。この第３の入力の上
位１ビツトには“θ″が供給される。
ぞれ下位１ビツトが削除され、７ビソ、１２人力のセレ
クタ回路（３４）に供給される。そしてこのセレクタ回
路（３４）で選択された信号が加算器（３３）の第３の
入力の下位７ビツトに供給される。この第３の入力の上
位１ビツトには“θ″が供給される。
これによってセレクタ（３４）を上側に切換えた場合に
は、前の走査線の３／４と次の走査線の１／４とが加算
され、下側に切換えた場合には、前の走査線の１／−４
と次の走査線の３／４とが加”算されるようになる。
は、前の走査線の３／４と次の走査線の１／４とが加算
され、下側に切換えた場合には、前の走査線の１／−４
と次の走査線の３／４とが加”算されるようになる。
そしてこの加算出力がシフトレジスタあるいはメモリか
らなる時間軸伸長回路（３５）を通じてＤ’Ａ変換器（
３６）に供給され、変換されたアナログ信号が加算器（
６）に供給される。
らなる時間軸伸長回路（３５）を通じてＤ’Ａ変換器（
３６）に供給され、変換されたアナログ信号が加算器（
６）に供給される。
これによっても、上述のアナログ処理の場合と同様の走
査線の変換を行うことができる。
査線の変換を行うことができる。
またこの装置は、多数の表示素子をマトリクス状に配置
して映像表示を行う装置において、走査線数を表示装置
のそれに合せる場合にも適用できる。
して映像表示を行う装置において、走査線数を表示装置
のそれに合せる場合にも適用できる。
発明の効果
本発明によれば、簡単な構成で走査線の変換を行うこと
ができるようになった。
ができるようになった。
第１図は本発明の一例の構成図、第２図はその説明のた
めの図、第３図は他の例の構成図、第４図〜第６図は従
来の装置の説明のための図である。 （３）はセレクタ回路、（４）は遅延回路、（６）はフ
ィールド判別回路、＋７１． （８１はレベル変換器、
（９）は加算器である。 第１図 第２図 ＳＴ番文フエ−ｒｔＦ イ風数フ
ィーＩしド。 第３図 第４図 第５図
めの図、第３図は他の例の構成図、第４図〜第６図は従
来の装置の説明のための図である。 （３）はセレクタ回路、（４）は遅延回路、（６）はフ
ィールド判別回路、＋７１． （８１はレベル変換器、
（９）は加算器である。 第１図 第２図 ＳＴ番文フエ−ｒｔＦ イ風数フ
ィーＩしド。 第３図 第４図 第５図
Claims (1)
- 元信号と、この元信号を１水平期間遅延させた信号とを
、一のフィールドでは１／４と３／４のレベル比で加算
し、他のフィールドでは３／４と１／４のレベルで加算
するようにして、走査線数を１／２に変換するようにし
た走査線変換装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14775784A JPS6126383A (ja) | 1984-07-17 | 1984-07-17 | 走査線変換装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14775784A JPS6126383A (ja) | 1984-07-17 | 1984-07-17 | 走査線変換装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6126383A true JPS6126383A (ja) | 1986-02-05 |
Family
ID=15437466
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP14775784A Pending JPS6126383A (ja) | 1984-07-17 | 1984-07-17 | 走査線変換装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6126383A (ja) |
Cited By (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US4989091A (en) * | 1988-11-16 | 1991-01-29 | Scientific-Atlanta, Inc. | Scan converter for a high definition television system |
| US5031040A (en) * | 1989-05-13 | 1991-07-09 | Sharp Kabushiki Kaisha | System converter device for converting a video signal having a certain number of scan lines to a video signal having a lesser number of scan lines |
| US5070395A (en) * | 1989-03-31 | 1991-12-03 | Victor Company Of Japan, Ltd. | Television signal system conversion apparatus |
| US5258749A (en) * | 1990-03-08 | 1993-11-02 | Sony Corporation | Non-interlace display device |
-
1984
- 1984-07-17 JP JP14775784A patent/JPS6126383A/ja active Pending
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|---|---|---|---|---|
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