JPS61120521A - トランジスタ駆動回路 - Google Patents
トランジスタ駆動回路Info
- Publication number
- JPS61120521A JPS61120521A JP59241709A JP24170984A JPS61120521A JP S61120521 A JPS61120521 A JP S61120521A JP 59241709 A JP59241709 A JP 59241709A JP 24170984 A JP24170984 A JP 24170984A JP S61120521 A JPS61120521 A JP S61120521A
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- JP
- Japan
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- transistor
- base
- bipolar
- bipolar transistor
- current
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- Pending
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-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03K—PULSE TECHNIQUE
- H03K17/00—Electronic switching or gating, i.e. not by contact-making and –breaking
- H03K17/04—Modifications for accelerating switching
- H03K17/041—Modifications for accelerating switching without feedback from the output circuit to the control circuit
- H03K17/0412—Modifications for accelerating switching without feedback from the output circuit to the control circuit by measures taken in the control circuit
- H03K17/04126—Modifications for accelerating switching without feedback from the output circuit to the control circuit by measures taken in the control circuit in bipolar transistor switches
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03K—PULSE TECHNIQUE
- H03K17/00—Electronic switching or gating, i.e. not by contact-making and –breaking
- H03K17/51—Electronic switching or gating, i.e. not by contact-making and –breaking characterised by the components used
- H03K17/56—Electronic switching or gating, i.e. not by contact-making and –breaking characterised by the components used by the use, as active elements, of semiconductor devices
- H03K17/567—Circuits characterised by the use of more than one type of semiconductor device, e.g. BIMOS, composite devices such as IGBT
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- Electronic Switches (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
【産業上の利用分野コ
この発明は、トランジスタ駆動回路に関し“、特に、バ
イポーラトランジスタを高速かつ低電力でスイッチング
駆動することができるトランジスタ駆動回路に関するも
のである。
イポーラトランジスタを高速かつ低電力でスイッチング
駆動することができるトランジスタ駆動回路に関するも
のである。
[従来の技術]
第2図は、従来のトランジスタ駆動回路を示す回路図で
ある。
ある。
まず、第2図に示した従来のトランジスタ駆動回路の構
成について説明する。第2図において、従来のトランジ
スタ駆動回路は、大きくは、ダーリントン接続された第
1のnpn トランジスタ1および第2のnpn トラ
ンジスタ2と、第1のnpnトランジスタ1をスイッチ
ング駆動するための制御信号を発生するIilJw回路
4とから構成されている。
成について説明する。第2図において、従来のトランジ
スタ駆動回路は、大きくは、ダーリントン接続された第
1のnpn トランジスタ1および第2のnpn トラ
ンジスタ2と、第1のnpnトランジスタ1をスイッチ
ング駆動するための制御信号を発生するIilJw回路
4とから構成されている。
より詳細に説明すると、トランジスタ1のコレクタとト
ランジスタ2のコレクタとは、共に定N5!課Cに接続
され、トランジスタ1のエミッタは接地される。さらに
、トランジスタ2のエミッタはトランジスタ1のベース
に接続され、トランジスタ2のベースは制御回路4に接
続される。さらに、トランジスタ2のベース・エミッタ
間にダイオード3が逆並列接続されている。
ランジスタ2のコレクタとは、共に定N5!課Cに接続
され、トランジスタ1のエミッタは接地される。さらに
、トランジスタ2のエミッタはトランジスタ1のベース
に接続され、トランジスタ2のベースは制御回路4に接
続される。さらに、トランジスタ2のベース・エミッタ
間にダイオード3が逆並列接続されている。
次に、第2図に示した従来のトランジスタ駆動回路の動
作について説明する。まず、トランジスタ1を非導通状
態から、導通状態ヘターンオンする場合の動作について
説明すると、最初に、制御回路4からトランジスタ2の
ベースにベース順電流(+Ia)が供給される。これに
応じて、トランジスタ2が導通し、そのエミッタ電流が
トランジスタ1のベースに供給される。そして、このエ
ミッタ電流に応じてトランジスタ1が導通する。次に、
トランジスタ1を導通状態から非導通状態ヘターンオフ
する場合の動作について説明すると、まず、制御回路4
によってトランジスタ2のベースが逆バイアスされる。
作について説明する。まず、トランジスタ1を非導通状
態から、導通状態ヘターンオンする場合の動作について
説明すると、最初に、制御回路4からトランジスタ2の
ベースにベース順電流(+Ia)が供給される。これに
応じて、トランジスタ2が導通し、そのエミッタ電流が
トランジスタ1のベースに供給される。そして、このエ
ミッタ電流に応じてトランジスタ1が導通する。次に、
トランジスタ1を導通状態から非導通状態ヘターンオフ
する場合の動作について説明すると、まず、制御回路4
によってトランジスタ2のベースが逆バイアスされる。
これによって、トランジスタ2から残留キャリアの吸出
しが行なわれ、ベース逆電流(−Ia)が流れる。トラ
ンジスタ2の残留キャリアの吸出しが完了すると、次に
、トランジスタ1からの残留キャリアの吸出しがダイオ
ード3を通じて行なわれ、同様にベース逆電流(−Il
l)が流れる。このようなベース逆電流が流れる時間は
数マイクロ秒ないし十数マイクロ秒に達する。
しが行なわれ、ベース逆電流(−Ia)が流れる。トラ
ンジスタ2の残留キャリアの吸出しが完了すると、次に
、トランジスタ1からの残留キャリアの吸出しがダイオ
ード3を通じて行なわれ、同様にベース逆電流(−Il
l)が流れる。このようなベース逆電流が流れる時間は
数マイクロ秒ないし十数マイクロ秒に達する。
[発明が解決しようとする問題点]
従来のトランジスタ駆動回路では、上述のように、被駆
動バイポーラトランジスタのベース駆動を、電流制御素
子である第2のバイポーラトランジスタを用いて行なっ
ていたため、第2のバイポーラトランジスタへのベース
順電流の供給のために電力が必要であるという問題があ
った。また、従来のトランジスタ駆動回路では、第2の
バイポーラトランジスタのコレクタ電流が小ざい場合に
第2のバイポーラトランジスタのベース電流で直接第1
のバイポーラトランジスタを駆動するため、第1のバイ
ポーラトランジスタは導通時に過飽和状態となって残留
キャリアが大きくなり、ターンオフに要する時間が長く
なって高速でのスイッチングが困難であり、ざらには、
ベース逆電流を吸出すのに大電流回路および電力が必要
になるという問題点があった。
動バイポーラトランジスタのベース駆動を、電流制御素
子である第2のバイポーラトランジスタを用いて行なっ
ていたため、第2のバイポーラトランジスタへのベース
順電流の供給のために電力が必要であるという問題があ
った。また、従来のトランジスタ駆動回路では、第2の
バイポーラトランジスタのコレクタ電流が小ざい場合に
第2のバイポーラトランジスタのベース電流で直接第1
のバイポーラトランジスタを駆動するため、第1のバイ
ポーラトランジスタは導通時に過飽和状態となって残留
キャリアが大きくなり、ターンオフに要する時間が長く
なって高速でのスイッチングが困難であり、ざらには、
ベース逆電流を吸出すのに大電流回路および電力が必要
になるという問題点があった。
それゆえに、この発明の主たる目的は、上述の問題点を
解消し、被駆動バイポーラトランジスタのベース駆動を
電圧1lIIII型素子である電界効果型トランジスタ
を用いて行なうことによって、高速かつ低電力でスイッ
チング駆動することができるトランジスタ駆動回路を提
供することである。
解消し、被駆動バイポーラトランジスタのベース駆動を
電圧1lIIII型素子である電界効果型トランジスタ
を用いて行なうことによって、高速かつ低電力でスイッ
チング駆動することができるトランジスタ駆動回路を提
供することである。
[問題点を解決するための手段]
この発明にかかうトランジスタ駆動回路は、被駆動バイ
ポーラトランジスタにダーリントン接続され、該被駆動
バイポーラトランジスタをベース駆動する電界効果型の
トランジスタと、被駆動バイポーラトランジスタのター
ンオフ時のベース逆ii流をバイパスするための第2の
バイポーラトランジスタとを備えるものである。
ポーラトランジスタにダーリントン接続され、該被駆動
バイポーラトランジスタをベース駆動する電界効果型の
トランジスタと、被駆動バイポーラトランジスタのター
ンオフ時のベース逆ii流をバイパスするための第2の
バイポーラトランジスタとを備えるものである。
[作用]
この発明においては、被駆動バイポーラトランジスタの
ベース駆動は、ダーリントン接続された電界効果型トラ
ンジスタの電圧1lIII御によって行なうことができ
、したがって、ターンオフ時の残留キャリアが少な(、
また、ターンオフ時のベース逆電流は第2のバイポーラ
トランジスタを介して吸出される。
ベース駆動は、ダーリントン接続された電界効果型トラ
ンジスタの電圧1lIII御によって行なうことができ
、したがって、ターンオフ時の残留キャリアが少な(、
また、ターンオフ時のベース逆電流は第2のバイポーラ
トランジスタを介して吸出される。
[実施例]
第1図はこの発明の一実施例であるトランジスタ駆動回
路を示す回路図である。
路を示す回路図である。
まず、第1図を参照して、この発明の一実施例の構成に
ついて説明する。第1図において、この発明の一実施例
であるトランジスタ駆動回路は、大きくは、ダーリント
ン接続されたnpn トランジスタ1およびnチャネル
MO3トランジスタ5と、バイポーラトランジスタ1の
ベース・エミッタ間に接続されたpnp トランジスタ
6と、バイポーラトランジスタ1をスイッチング駆動す
るための制御信号を発生する制御回路4とから構成され
ている。より詳細に説明すると、バイポーラトランジス
タ1のコレクタと、MOSトランジスタ5のドレインと
は共に定電流源Cに接続され、バイポーラトランジスタ
1のエミッタは接地される。ざらに、MOSトランジス
タ5のソースは、バイポーラトランジスタ1のベースと
バイポーラトランジスタ6のエミッタとに接続され、M
OSトランジスタ5のゲートは制御回路4に接続される
。また、MOSトランジスタ5のゲート・ソース間には
抵抗8が接続される。ざらに、バイポーラトランジスタ
6のコレクタは接地され、そのベースは抵抗7を介して
制御回路4とMOSトランジスタ5のゲートとに接続さ
れる。
ついて説明する。第1図において、この発明の一実施例
であるトランジスタ駆動回路は、大きくは、ダーリント
ン接続されたnpn トランジスタ1およびnチャネル
MO3トランジスタ5と、バイポーラトランジスタ1の
ベース・エミッタ間に接続されたpnp トランジスタ
6と、バイポーラトランジスタ1をスイッチング駆動す
るための制御信号を発生する制御回路4とから構成され
ている。より詳細に説明すると、バイポーラトランジス
タ1のコレクタと、MOSトランジスタ5のドレインと
は共に定電流源Cに接続され、バイポーラトランジスタ
1のエミッタは接地される。ざらに、MOSトランジス
タ5のソースは、バイポーラトランジスタ1のベースと
バイポーラトランジスタ6のエミッタとに接続され、M
OSトランジスタ5のゲートは制御回路4に接続される
。また、MOSトランジスタ5のゲート・ソース間には
抵抗8が接続される。ざらに、バイポーラトランジスタ
6のコレクタは接地され、そのベースは抵抗7を介して
制御回路4とMOSトランジスタ5のゲートとに接続さ
れる。
次に、第1図を参照して、この発明の一実施例の動作に
ついて説明する。
ついて説明する。
まず、バイポーラトランジスタ1を非導通状態から導通
状態ヘターンオンする場合の動作について説明すると、
最初に、制御回路4からMOSトランジスタ5のゲート
にハイレベルの電圧が印加される。これに応じて、MO
Sトランジスタ5は導通し、そのドレイン電流がMOS
トランジスタ5のドレインからソースを通ってバイポー
ラトランジスタ1のベースに供給される。そして、この
ドレイン電流に応じてバイポーラトランジスタ1が導通
する。
状態ヘターンオンする場合の動作について説明すると、
最初に、制御回路4からMOSトランジスタ5のゲート
にハイレベルの電圧が印加される。これに応じて、MO
Sトランジスタ5は導通し、そのドレイン電流がMOS
トランジスタ5のドレインからソースを通ってバイポー
ラトランジスタ1のベースに供給される。そして、この
ドレイン電流に応じてバイポーラトランジスタ1が導通
する。
ここで、MOSトランジスタ5のゲートは、絶縁ゲート
であるため、ゲート電流はほとんど流れない。したがっ
て、制御回路4は電圧源であればよく、極めて小さな駆
動電力でバイポ−ラトランジスタ1を駆動することが可
能である。また、第1図に示したトランジスタ駆動回路
では、ゲート電流が極めて小さいため、第2図に示した
従来のトランジスタ駆動回路のように、このゲート電流
が直接バイポーラトランジスタ1を導通させることはな
い。すなわち、MOSトランジスタ5が導通状態になっ
たときにのみ、バイポーラトランジスタ1のベースに電
流が供給され、このときには、MOSトランジスタ5の
オン電圧がバイポーラトランジスタ1のベース・コレク
タ接合を必ず逆バイアスするため、バイポーラトランジ
スタ1は導通時に準飽和状態となる。したがって、バイ
ポーラトランジスタ1の残留キャリアは、第2図に示し
た従来のトランジスタ駆動回路の場合と比較して、著し
く減少し、バイポーラトランジスタ1のターンオフ時の
蓄積時間すなわちスイッチング時關が短くなる。
であるため、ゲート電流はほとんど流れない。したがっ
て、制御回路4は電圧源であればよく、極めて小さな駆
動電力でバイポ−ラトランジスタ1を駆動することが可
能である。また、第1図に示したトランジスタ駆動回路
では、ゲート電流が極めて小さいため、第2図に示した
従来のトランジスタ駆動回路のように、このゲート電流
が直接バイポーラトランジスタ1を導通させることはな
い。すなわち、MOSトランジスタ5が導通状態になっ
たときにのみ、バイポーラトランジスタ1のベースに電
流が供給され、このときには、MOSトランジスタ5の
オン電圧がバイポーラトランジスタ1のベース・コレク
タ接合を必ず逆バイアスするため、バイポーラトランジ
スタ1は導通時に準飽和状態となる。したがって、バイ
ポーラトランジスタ1の残留キャリアは、第2図に示し
た従来のトランジスタ駆動回路の場合と比較して、著し
く減少し、バイポーラトランジスタ1のターンオフ時の
蓄積時間すなわちスイッチング時關が短くなる。
次に、バイポーラトランジスタ1を導通状態から非導通
状態ヘターンオフする場合の動作について説明する。最
初に、制御回路4の出力電圧をローレベルにすると、M
OSトランジスタ6は非導通状態となり、同時にpOp
トランジスタ6が導通状態になる。したがって、バイポ
ーラトランジスタ1へのベース順電流は遮断され、さら
にバイポーラトランジスタ1にわずかに残っている残留
キャリアは、ベース逆電流となって、pnp トランジ
スタ6を介してアース電位に流れる。この場合、ターン
オフに要する時間は、残留キャリアが少ないため、2な
いし3マイクロ秒程度である。
状態ヘターンオフする場合の動作について説明する。最
初に、制御回路4の出力電圧をローレベルにすると、M
OSトランジスタ6は非導通状態となり、同時にpOp
トランジスタ6が導通状態になる。したがって、バイポ
ーラトランジスタ1へのベース順電流は遮断され、さら
にバイポーラトランジスタ1にわずかに残っている残留
キャリアは、ベース逆電流となって、pnp トランジ
スタ6を介してアース電位に流れる。この場合、ターン
オフに要する時間は、残留キャリアが少ないため、2な
いし3マイクロ秒程度である。
また、上述の実施例では、ディスクリート構成のバイポ
ーラトランジスタ駆動回路について説明したが、この回
路構成は、1チツプのモノリシックICに構成したちで
あってもよく、ざらには、1つのパッケージに組入れら
れたパワーモジュールとして構成゛されてもよい。
ーラトランジスタ駆動回路について説明したが、この回
路構成は、1チツプのモノリシックICに構成したちで
あってもよく、ざらには、1つのパッケージに組入れら
れたパワーモジュールとして構成゛されてもよい。
[発明の効果]
以上のように、この発明によれば、被駆動用バイポーラ
トランジスタにダーリントン接続された、電圧制御素子
である電界効果型トランジスタによりて、該バイポーラ
トランジスタのベース駆動を行なうので、該電界効果型
トランジスタの駆動に要する電源は電圧源であればよく
、したがってバイポーラトランジスタのスイッチング駆
動に必要な電力を著しく小さくすることができる。ざら
に、被駆動バイポーラトランジスタの残留キャリアが非
常に少なくなるので、ターンオフに要する時間が短くな
り、数10KHzまでの高周波でのスイッチングが可能
となる。さらに、被駆動バイポーラトランジスタのター
ンオフ時にベース逆電流を吸出すための大電流回路およ
び電力が必要ではなくなり、全体としてトランジスタ駆
動回路の小形化および低価格化を達成することができる
。
トランジスタにダーリントン接続された、電圧制御素子
である電界効果型トランジスタによりて、該バイポーラ
トランジスタのベース駆動を行なうので、該電界効果型
トランジスタの駆動に要する電源は電圧源であればよく
、したがってバイポーラトランジスタのスイッチング駆
動に必要な電力を著しく小さくすることができる。ざら
に、被駆動バイポーラトランジスタの残留キャリアが非
常に少なくなるので、ターンオフに要する時間が短くな
り、数10KHzまでの高周波でのスイッチングが可能
となる。さらに、被駆動バイポーラトランジスタのター
ンオフ時にベース逆電流を吸出すための大電流回路およ
び電力が必要ではなくなり、全体としてトランジスタ駆
動回路の小形化および低価格化を達成することができる
。
第1図は、この発明の一実施例であるトランジスタ駆動
回路の回路図である。第2図は、従来のトランジスタ駆
動回路の回路図である。 図において、1.2はnpn トランジスタ、3はダイ
オード、4は制御回路、5はMOSトランジスタ、6は
pnp トランジスタ、7.8は抵抗を示す。 代理人 大 岩 増 雄 @2(2)
回路の回路図である。第2図は、従来のトランジスタ駆
動回路の回路図である。 図において、1.2はnpn トランジスタ、3はダイ
オード、4は制御回路、5はMOSトランジスタ、6は
pnp トランジスタ、7.8は抵抗を示す。 代理人 大 岩 増 雄 @2(2)
Claims (1)
- 【特許請求の範囲】 第1のバイポーラトランジスタと、 前記第1のバイポーラトランジスタのベース・コレクタ
間に接続された導通端子を有する電界効果型トランジス
タと、 前記第1のバイポーラトランジスタのベース・エミッタ
間に接続された導通端子を有する第2のバイポーラトラ
ンジスタと、 前記電界効果型トランジスタのゲートと前記第2のバイ
ポーラトランジスタのベースとに接続され、前記第1の
バイポーラトランジスタをスイツチング駆動するための
制御信号を発生する制御信号発生手段とを備えた、トラ
ンジスタ駆動回路。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP59241709A JPS61120521A (ja) | 1984-11-15 | 1984-11-15 | トランジスタ駆動回路 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP59241709A JPS61120521A (ja) | 1984-11-15 | 1984-11-15 | トランジスタ駆動回路 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS61120521A true JPS61120521A (ja) | 1986-06-07 |
Family
ID=17078365
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP59241709A Pending JPS61120521A (ja) | 1984-11-15 | 1984-11-15 | トランジスタ駆動回路 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS61120521A (ja) |
Cited By (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH07155416A (ja) * | 1993-12-09 | 1995-06-20 | Prod Otokogumi:Kk | ゴルフ練習用具 |
EP0685941A3 (en) * | 1994-06-03 | 1996-09-25 | At & T Corp | Self-elevation circuit. |
US20120086496A1 (en) * | 2010-10-07 | 2012-04-12 | Denso Corporation | Electronic device with switching element driven by control voltage |
JP2013004988A (ja) * | 2011-06-10 | 2013-01-07 | Sanken Electric Co Ltd | スイッチング回路 |
-
1984
- 1984-11-15 JP JP59241709A patent/JPS61120521A/ja active Pending
Cited By (6)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH07155416A (ja) * | 1993-12-09 | 1995-06-20 | Prod Otokogumi:Kk | ゴルフ練習用具 |
EP0685941A3 (en) * | 1994-06-03 | 1996-09-25 | At & T Corp | Self-elevation circuit. |
US5929666A (en) * | 1994-06-03 | 1999-07-27 | Lucent Technologies Inc. | Bootstrap circuit |
US20120086496A1 (en) * | 2010-10-07 | 2012-04-12 | Denso Corporation | Electronic device with switching element driven by control voltage |
US8610487B2 (en) * | 2010-10-07 | 2013-12-17 | Denso Corporation | Electronic device with switching element driven by control voltage |
JP2013004988A (ja) * | 2011-06-10 | 2013-01-07 | Sanken Electric Co Ltd | スイッチング回路 |
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