JPS61113241A - 電子部品の封止方法 - Google Patents

電子部品の封止方法

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Publication number
JPS61113241A
JPS61113241A JP23642284A JP23642284A JPS61113241A JP S61113241 A JPS61113241 A JP S61113241A JP 23642284 A JP23642284 A JP 23642284A JP 23642284 A JP23642284 A JP 23642284A JP S61113241 A JPS61113241 A JP S61113241A
Authority
JP
Japan
Prior art keywords
sealed part
molding
sealed
sealing
pps
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP23642284A
Other languages
English (en)
Inventor
Makoto Shimanuki
嶋貫 誠
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Mitsubishi Electric Corp
Original Assignee
Mitsubishi Electric Corp
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Filing date
Publication date
Application filed by Mitsubishi Electric Corp filed Critical Mitsubishi Electric Corp
Priority to JP23642284A priority Critical patent/JPS61113241A/ja
Publication of JPS61113241A publication Critical patent/JPS61113241A/ja
Pending legal-status Critical Current

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Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
    • H01L21/50Assembly of semiconductor devices using processes or apparatus not provided for in a single one of the subgroups H01L21/06 - H01L21/326, e.g. sealing of a cap to a base of a container
    • H01L21/56Encapsulations, e.g. encapsulation layers, coatings
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/0001Technical content checked by a classifier
    • H01L2924/0002Not covered by any one of groups H01L24/00, H01L24/00 and H01L2224/00

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  • Power Engineering (AREA)
  • Coils Or Transformers For Communication (AREA)
  • Non-Metallic Protective Coatings For Printed Circuits (AREA)
  • Encapsulation Of And Coatings For Semiconductor Or Solid State Devices (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 [産業上の利用分野] 本発明は電子部品の封止方法に関する。
[従来の技術] IC,)ランジスタ、ダイオード、抵抗、コンデンサー
、コイルおよびコネクターなどの種々の電子部品は、各
端子間の電気的絶縁、機械的強度の保持、湿度や浮遊不
純物などの外部環境からの内部保護がその性n維持のた
め必要不可欠である。
そのため基板上に取りつけられた電子部品を合成樹脂を
用いて密Mするいわゆる封止が一般に行なわれている。
その封止方法としては、熱硬化性樹脂を封止材料とする
方法と、熱可塑性樹脂を封止材料とする方法とがあり、
熱硬化性樹脂としてはエポキシ樹脂が、熱可塑性樹脂と
してはポリフェニレンサルファイドポリマーが一般に用
いられる。
本た封止手段には、生産性や寸法安定性などの点からト
ランスファー戒形士たは射出成形によるモールド法が採
用される。
[発明が解決しようとする問題点] 従来の封止方法において、エポキシ樹脂を用いたばあい
は、機械的強度が強い、気密性にすぐれるなどの長所が
あるが、その反面成形時間が長くかかる(1〜5分)、
熱によって金型内で樹脂が低粘度化するのでパリの発生
が多く成形後のパリ取り作業が困難となる、成形品とし
ては不用なランナなどが再生不可能なため材料コストが
高くなるなどの欠点がある。
一方、ポリフェニレンサルファイドポリマーを眉いる封
止方法では、耐熱性がすぐれている、パリの発生が少な
い、成形時間が短い、ランナなどの一部が再生可能など
の長所がある反面、熱可塑性樹脂の本質として熱架橋反
応がないため被打止物との接着力が弱(、気密性が充分
えられないという欠点がある。
以上のように従来はいずれの方法によっても一長一短で
あり、全ての要求条件を満足する封止方法はいまだに知
られていない。
そこで本発明は、エポキシ!MWを眉いた封止方法のも
つ長所とポリフェニレンサルファイドポリマーを用いた
封止方法のもつ長所とを併せ有し、゛いかなる欠点も有
しないbわめてすぐれた封止方法を提供することを目的
とする。
[問題点を解決するための手段1 本発明の電子部品の封止方法は、基板上に電子部品を取
りつけてなる被打止物にフッ素低分子処理剤に(表面コ
ーティングを行ない、ついで封止材料としてポリフェニ
レンサルファイドポリマー(以下、PPSという)を用
い、トランスファー成形または射出成形によるモールド
法によって電子部品を封止するようにしている。
[実施例] 本発明の封止方法を施すにあたっては、まず金属製フレ
ームなどの基板上にグイポンドやワイヤボンドなどの方
法でtCやトフンノスタその他の電子部品を取りつけて
おく。
その上)にして被打止物をえると、その被封上物の外表
面に77素系低分子処理剤をコーティングする。7ツ素
系低分子jJk理剤は撥水性を有するので、それによっ
て被打止物に撥水性の皮膜を形成することができる。
77素低分子処理剤のコーティング方法としては、スプ
レー塗布などを用いることができるが、前記フッ素系低
分子処理剤の溶液中に浸漬するのがもっとも簡単である
ため好ましい。
以上のようにして被打止物にフッ素系低分子処理剤がコ
ーティングさ胱ると、つぎにその被封止物をPPSで密
封する。それにはトランスファ成形または射出成形によ
る公知のモールド法が採用される。すなわちトランスフ
ァ成形によるばあ−1も、射出成形によるばあいも封止
材料としてのPPSを金型の上に設けられた可塑化室に
入れ、軟化温度まで加熱して可塑化し、これを前記被打
止物が挿入されでいる金型の中に圧入しで硬化させ、密
封成形を什なう。
[51!明の効果] 本発明方法によって被封上物に形成された7フ索系低分
子処理剤のコーティング層は撥水性にすぐれているので
、そのi膜によって電子部品への水分や湿気の浸透を効
果的に防止することができる。
しかも封止材料にはPPSが用いられているので、PP
Sを用いた封止方法の利点である成形時間が短(ですむ
(通常20〜40秒)、パリの発生が少なく封止後の仕
上げ作業が楽になる、ランナの一部の再利用が可能であ
るなどの点をその*ま活かすことができる。
そのため本発明の封止方法に上ると、性能的に充分満足
しうる電子部品の封止が低コストでうろことができるの
である。

Claims (1)

    【特許請求の範囲】
  1. (1)電子部品を合成樹脂で封止する方法であって、基
    板上に電子部品を取りつけてなる被封止物にフッ素系低
    分子処理剤にて表面コーティングを行ない、ついで封止
    材料としてポリフェニレンサルファイドポリマーを用い
    、トランスファー成形または射出成形によるモールド法
    によって電子部品を封止するようにしたことを特徴とす
    る電子部品の封止方法。
JP23642284A 1984-11-07 1984-11-07 電子部品の封止方法 Pending JPS61113241A (ja)

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
EP0390996A2 (en) * 1989-04-06 1990-10-10 Mitsubishi Denki Kabushiki Kaisha IC card module

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
EP0390996A2 (en) * 1989-04-06 1990-10-10 Mitsubishi Denki Kabushiki Kaisha IC card module
US5079673A (en) * 1989-04-06 1992-01-07 Mitsubishi Denki Kabushiki Kaisha Ic card module

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