JPS6059976A - Discharging circuit of inverter device - Google Patents
Discharging circuit of inverter deviceInfo
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- JPS6059976A JPS6059976A JP58157315A JP15731583A JPS6059976A JP S6059976 A JPS6059976 A JP S6059976A JP 58157315 A JP58157315 A JP 58157315A JP 15731583 A JP15731583 A JP 15731583A JP S6059976 A JPS6059976 A JP S6059976A
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- H02—GENERATION; CONVERSION OR DISTRIBUTION OF ELECTRIC POWER
- H02M—APPARATUS FOR CONVERSION BETWEEN AC AND AC, BETWEEN AC AND DC, OR BETWEEN DC AND DC, AND FOR USE WITH MAINS OR SIMILAR POWER SUPPLY SYSTEMS; CONVERSION OF DC OR AC INPUT POWER INTO SURGE OUTPUT POWER; CONTROL OR REGULATION THEREOF
- H02M7/00—Conversion of ac power input into dc power output; Conversion of dc power input into ac power output
- H02M7/42—Conversion of dc power input into ac power output without possibility of reversal
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Abstract
Description
【発明の詳細な説明】
〔発明の技術分野〕
本発明は、電動機の回転速度を所定値にするように制御
交流電力を電動機に供給するインバータ装置に関するも
ので、特に、電動機の減速時におけるブレーキ効果を高
めるべく付加された放電回路の保護に係わる。Detailed Description of the Invention [Technical Field of the Invention] The present invention relates to an inverter device that supplies controlled alternating current power to an electric motor so that the rotational speed of the electric motor is at a predetermined value. It is concerned with the protection of the discharge circuit added to increase its effectiveness.
従来、旋盤や研削盤等の工作機械用電動機として、速度
制御の容易さから専ら直流機が用いられてきたが、近年
の省エネルギのニーズと相俟って、インバータ装置によ
り駆動される誘導電動機が用いられるようになってきた
。Conventionally, DC motors have been used exclusively as motors for machine tools such as lathes and grinders due to their ease of speed control, but in conjunction with recent energy-saving needs, induction motors driven by inverter devices have been used. has come to be used.
かかる工作機械用の電動機においては、切削のために正
転、逆転が頻繁に行なわれ、その回転方向の変換に伴う
急激な加速、減速運転が必要であり、したがって、その
制御に用いられるインバータ装置も極めて過酷な運転条
件を負うことになる。In electric motors for such machine tools, forward and reverse rotations are frequently performed for cutting, and rapid acceleration and deceleration operations are required to change the direction of rotation. They are also subject to extremely harsh operating conditions.
このような用途に用いられた従来のインバータ装置、お
よび、その放電回路を第１図に示す。A conventional inverter device used for such applications and its discharge circuit are shown in FIG.
図において、（１）は交流電源、（２）は交流電源（１
）を整流して直流を得るコンバータブリッジ、（８）は
コンバータブリッジ（２）の直流出力を平滑にするコン
デンサ、（４）はコンバータブリッジ（２）の直流出力
を平滑コンデンサ（８）を介して受け新たな交流に変換
するインパータフリッジ、（５）はインバータブリッジ
（４）から交流電力の供給を受ける負荷たる誘導電動機
であり、交流電源（１）からの交流電力をコンバータブ
リッジ（２）および平滑コンデンサ（８）により平滑な
直流に変換し、再び、インバータブリッジ（４）によシ
所望の交流電力に変換して誘導電動機（５）に供給する
ように外されている。In the figure, (1) is an AC power supply, (2) is an AC power supply (1
) to obtain DC, (8) is a capacitor that smoothes the DC output of converter bridge (2), and (4) is a capacitor that smoothes the DC output of converter bridge (2) through smoothing capacitor (8). The inverter bridge (5) is a load that receives AC power from the inverter bridge (4) and converts it into new AC power, and converts the AC power from the AC power supply (1) to the converter bridge (2) and It is removed so that it is converted into smooth DC power by a smoothing capacitor (8), converted again into desired AC power by an inverter bridge (4), and supplied to an induction motor (5).
また、図において、（６）は抵抗、（７）はスイッチン
グ素子たるトランジスタで、これら抵抗（６）とトラン
ジスタ（γ）とで成る直列回路は上述の平滑コンデンサ
（８）に並列に、即ち、直流部側極間に接続されている
。さらに、（８）は直流部の電圧（コンデンサ（８）の
電圧）を検出する電圧検出器、（９）は該電圧検出器（
８）による検出電圧を基準電圧と比較する比較器であり
、電圧検出器（８）による検出電圧が基準電圧よシ大き
い場合に比較器（９）がトランジスタ（７）のベースに
信号を与えて上述の抵抗（６）とトランジスタ（７）と
で成る直列回路を導通させるようになっている。In the figure, (6) is a resistor, (7) is a transistor which is a switching element, and the series circuit consisting of these resistors (6) and transistors (γ) is connected in parallel to the above-mentioned smoothing capacitor (8), that is, Connected between the poles on the DC section side. Further, (8) is a voltage detector that detects the voltage of the DC section (voltage of the capacitor (8)), and (9) is the voltage detector (
This is a comparator that compares the voltage detected by the voltage detector (8) with a reference voltage, and when the voltage detected by the voltage detector (8) is larger than the reference voltage, the comparator (9) gives a signal to the base of the transistor (7). The series circuit made up of the above-mentioned resistor (6) and transistor (7) is made conductive.
次に、誘導電動機（５）の減速時における上述した構成
を有するインバータ装置の動作を説明する。Next, the operation of the inverter device having the above-described configuration during deceleration of the induction motor (5) will be described.
電動機（５）の減速時においては、電動機（５）の回転
子が同期速度より速く回転するため電動機（５）は誘導
発電機として作用し、その発電にかかるエネルギＯ一部
はインバータブリッジ（４）（このときは順変換器とし
て作用する）を介して平滑コンデンサ（８）に吸収され
る。この吸収された余剰エネルギのため、コンデンサ（
８）の電圧は著しく上昇する。When the electric motor (5) is decelerating, the rotor of the electric motor (5) rotates faster than the synchronous speed, so the electric motor (5) acts as an induction generator, and a portion of the energy generated by the electric motor (5) is transferred to the inverter bridge (4). ) (acting as a forward converter at this time) and is absorbed by the smoothing capacitor (8). Because of this absorbed excess energy, the capacitor (
8) The voltage increases significantly.
コンーデンサ（８）の電圧値は、電圧検出器（８）で常
時捉えられ、比較器（９）で基準電圧と比較されており
、上述のように電圧が上昇した場合には、比較器（９）
からはトランジスタ（７）をオンする出力信号が送出さ
れる。The voltage value of the capacitor (8) is always detected by the voltage detector (8) and compared with the reference voltage by the comparator (9). )
An output signal that turns on the transistor (7) is sent from the transistor (7).
このトランジスタ（７）の導通によりコンデンサ（８）
に吸収された余剰エネルギは放電抵抗（８）で消費され
、また、コンデンサ（３）の電圧上昇も所定値内に抑制
されることになる。そしてまた、このような速やかな余
剰エネルギの消費によシミ動機（５）のブレーキ効果が
高まる。Due to the conduction of this transistor (7), the capacitor (8)
The surplus energy absorbed by the discharge resistor (8) is consumed by the discharge resistor (8), and the voltage rise of the capacitor (3) is also suppressed within a predetermined value. Moreover, such rapid consumption of surplus energy increases the braking effect of the staining mechanism (5).
しかるに、従来の装置は、以上のように構成されている
ので、電動機の高速から低速への急減速運転が繰り返さ
れた場合、慣性が大きな負荷において減速を行なった場
合には、回生エネルギが多く放電抵抗により放電される
エネルギの量も多くなシ、シたがって、放電抵抗の使用
頻度が高く放電抵抗が高温になるという危険性があり、
また、放電抵抗に直列に接続されたスイッチング素子も
温度が上昇して劣化あるいは破壊されることがあるとい
う欠点があった。However, because the conventional device is configured as described above, when the motor repeatedly decelerates suddenly from high speed to low speed, or when decelerating a load with large inertia, a large amount of regenerated energy is used. The amount of energy discharged by the discharge resistor is also large, so the discharge resistor is used frequently and there is a risk that the discharge resistor will become hot.
Furthermore, there is a drawback that the switching element connected in series with the discharge resistor may also be deteriorated or destroyed due to the temperature rise.
本発明は、斜上の点を鑑みなされたもので、放電抵抗並
びにスイッチング素子の温度を直接検出することなくス
イッチング素子の使用頻度を監視することによシ、放電
抵抗が高温になること、並びに、スイッチング素子が劣
化することおよび破壊することを防止できるインバータ
装置の放電回路の提供を目的としている。The present invention was made in view of the above-mentioned problem, and by monitoring the usage frequency of the switching element without directly detecting the temperature of the discharge resistor and the switching element, it is possible to prevent the discharge resistor from becoming high temperature. The present invention aims to provide a discharge circuit for an inverter device that can prevent switching elements from deteriorating and being destroyed.
かかる目的を達成すべく、本発明のインバータ装置の放
電回路は、直流部の電圧レベルを検出する検出手段と、
スイッチング素子のオン・オフ期間に基づき放電抵抗と
スイッチング素子とで成る直列回路の温度状態を監視す
る監視手段とを備え、上記検出手段および該監視手段と
からの両川力信号に基づき上記スイッチング素子を導通
制御する構成を有する〇
〔発明の実施例〕
以下、本発明を第２図に示す実施例に基づいて説明する
。なお、第１図と同一または同効の部分は同一符号を附
して示し、説明は省略する。In order to achieve this object, the discharge circuit of the inverter device of the present invention includes a detection means for detecting the voltage level of the DC section;
monitoring means for monitoring a temperature state of a series circuit consisting of a discharge resistor and a switching element based on on/off periods of the switching element, and monitoring the switching element based on a power signal from the detection means and the monitoring means Embodiment of the Invention The present invention will be described below based on an embodiment shown in FIG. 2. Note that parts that are the same as or have the same effect as those in FIG. 1 are indicated with the same reference numerals, and explanations thereof will be omitted.
第２図において、α０）は放電抵抗（６）とトランジス
タ（γ）とで成る直列回路の発熱状況を監視するための
ものであってカウントが所定値を越えたときローレベル
出力を送出するアップダウンカウンタ、（１１）は上記
直列回路の導通時における発熱特性に応じた間隔を有す
るアップカウント用のクロックパルスを出力する第１の
発振器、（増は上記直列回路の非導通時における冷却特
性に応じた間隔を有するダウンカウント用のクロックパ
ルスを出力する第２の発振器、’ （１８）は比較器（
９）およびカウンタ（７）からの信号８０．Ｓ□。を受
けて第３′ｅに示す選択論理に従がう発振器を選択し、
そめ選択発振器の出力パルスをカウンタ（イ）に送出さ
せるセレクタ、０４）は比較器（９）およびカウンタα
りの出力信号８０．Ｓ工。に勘き第３図に示すようにト
ランジスタ（７）をオン・オフ制御するベース遮断回路
である。したがって、本実施例においては、カウンタα
ｏ）、第１、第２の発振器Ｃ１１１，（１２１およびセ
レクタ（１Ｂ）等で上述の監視手段を構成している。In Figure 2, α0) is used to monitor the heat generation status of a series circuit consisting of a discharge resistor (6) and a transistor (γ), and when the count exceeds a predetermined value, a low level output is sent out. A down counter, (11) is a first oscillator that outputs up-counting clock pulses having intervals corresponding to the heat generation characteristics when the series circuit is conductive; A second oscillator that outputs clock pulses for down-counting with corresponding intervals, ' (18) is a comparator (
9) and the signal 80 from the counter (7). S□. and selects an oscillator according to the selection logic shown in section 3'e,
The selector 04) that sends the output pulse of the some selection oscillator to the counter (a) is the comparator (9) and the counter α
output signal 80. S engineering. As shown in FIG. 3, this is a base cutoff circuit that controls on/off of the transistor (7). Therefore, in this embodiment, the counter α
o), the first and second oscillators C111, (121) and the selector (1B) constitute the above-mentioned monitoring means.
次に、本実施例回路の動作を第４図および第５図をも参
照して説明する。Next, the operation of the circuit of this embodiment will be explained with reference to FIGS. 4 and 5.
なお、第４図はカウンタσ０）のカウントと、出カ信号
Ｓ工。の関係を示す関係図であり、第５図（Ａ）。In addition, FIG. 4 shows the count of the counter σ0) and the output signal S. FIG. 5(A) is a relationship diagram showing the relationship between the following.
（Ｂ） 、 （Ｃ）はそれぞれ、カウンタα０）のカウ
ント、トランジスタ（７ンのオン・オフ状態、および両
信号ｓ９゜Ｓ工。の状態の経時変化を示す図である。(B) and (C) are diagrams respectively showing changes over time in the count of the counter α0), the on/off state of the transistor (7), and the state of both signals s9°S.
本実施例においても、インバータ装置自体の動作、並び
に、電圧検出器（８）と比較器（９）の動作は従来回路
と同様であるが、比較器（９）の出方は従来回路と異な
シ、ベース遮断回路０荀および監視手段の要素たるセレ
クタθＢ）に送出される。In this embodiment, the operation of the inverter itself and the operation of the voltage detector (8) and comparator (9) are the same as in the conventional circuit, but the way the comparator (9) is output is different from the conventional circuit. The signal is sent to the base cutoff circuit 0 and the selector θB) which is an element of the monitoring means.
先ず、監視手段の動作を説明する。First, the operation of the monitoring means will be explained.
セレクタ（１３）は、カウンタｃＬＯ）からの信号Ｓ□
。がハイレベルの間は、比較器（９）の出方信号ｓ９の
状態によシ、カウンタα０へ送出するクロックパルスを
選択する。すなわち、セレクタαＢ）は、信号ｓ９がハ
イレベルのときは第１の発振器０１）からのクロックパ
ルスを選択してカウンタ（ト）のアップカウント端子Ｕ
Ｐに与えさせ、信号Ｓ９がローレベルのときは第２の発
振器（惰からのクロックパルスを選択してカウンタα０
）のダウンカウント端子ＤＯに与えさせる。The selector (13) receives the signal S□ from the counter cLO).
. While at high level, the clock pulse to be sent to the counter α0 is selected depending on the state of the output signal s9 of the comparator (9). That is, when the signal s9 is at a high level, the selector αB) selects the clock pulse from the first oscillator 01) and outputs it to the up-count terminal U of the counter (G).
When the signal S9 is low level, the clock pulse from the second oscillator (inertia) is selected and the counter α0
) is applied to the down count terminal DO.
カウンタα０）は、第１の発振器Ｃ１１）からのり四ツ
クパルスによってはアップカウントを行ない、第２の発
振器（埒からのクロックパルスによってはダウンカウン
トを行なう。但し、ダウンカウントの下限はゼロである
。カウンタ←０）はカウントがオーバフローするまでは
ハイレベル出力を送出し続け、かつ、上述したアップま
たはダウン動作を繰シ返す（第４図直線ｉ間、および第
５図（Ａ）の時刻ｔ□以前参照）。The counter α0) counts up in response to clock pulses from the first oscillator C11), and counts down in response to clock pulses from the second oscillator C11). However, the lower limit of the downcount is zero. The counter ←0) continues to send out a high-level output until the count overflows, and repeats the up or down operation described above (between straight line i in Figure 4 and time t□ in Figure 5 (A)). (see earlier).
カウントが第５図に示す時刻ｔ工でオーバフローレベル
に達すると（第４図点α参照）、カウンタα０）は出力
信号Ｓ工。をローレベルに変換して（第４図点β参照）
セレクタθＢ）およびベース遮断回路Ｃ１４）に送出す
る。When the count reaches the overflow level at time t shown in FIG. 5 (see point α in FIG. 4), the counter α0) outputs the output signal S. Convert to low level (see point β in Figure 4)
selector θB) and base cutoff circuit C14).
セレクタ（坤は、ローレベルの信号８□。を入力すると
、比較器（９）からの信号Ｓ９の状態如何に拘らず、第
２の発振器（２）からのクロックパルスを選択してカウ
ンタ（１０）に送出させる。カウンタαＯ）は、とのク
ロックパルスによシダランカウントしく、第４図直線ｒ
間、および第４図点α参照）、所定時間Ｔ経過して値が
ａ□と力った第５図に示す時刻ｔ２で出力信号Ｓ□。の
状態を再びハイレベルにする（第４図直線γδ間参照）
。When a low level signal 8□ is input to the selector (Kon), the clock pulse from the second oscillator (2) is selected and the counter (10 ).The counter αO) performs a sida run count based on the clock pulse of .
(see point α in FIG. 4), and the output signal S□ at time t2 shown in FIG. Bring the state to high level again (see line γδ in Figure 4)
.
カウンタα０）の出力信号Ｓ□。がハイレベルとなった
ので、セレクタα匂は上述のように比較器（９）からの
信号Ｓ、の状態に基づきカウンタα０）に接続する発振
器を選択するようになり、上述した動作を行々うように
なる。Output signal S□ of counter α0). has become high level, the selector α selects the oscillator connected to the counter α0) based on the state of the signal S from the comparator (9) as described above, and performs the above-mentioned operation. It becomes like this.
次に、ベース遮断回路＋１４）の動作を説明する。Next, the operation of the base cutoff circuit +14) will be explained.
ベース遮断回路（１４）は比較器（９）の出力信号Ｓ、
およびカウンタα０）の出力信号Ｓ□。を入力しており
、第３図に示す論理に従がい、第５図（Ｂ） 、 （Ｃ
）に示すように、信号Ｓ□０がハイレベルのときは信号
８．の状態に応じたトランジスタ（γ）のオン・オフ信
号を送出するように、また、信号Ｓ□。がローレベルの
ときは信号Ｓ９の状態に拘らずにトランジスタ（７）を
オフとする信号を送出するよう動作する０トランジスタ
（γ）のオン争オフにより、コンデンサ（８）に吸収さ
れた余剰エネルギが放電抵抗（６）で間欠的に消費され
る。The base cutoff circuit (14) outputs the output signal S of the comparator (9),
and the output signal S□ of the counter α0). , and following the logic shown in Figure 3, Figure 5 (B), (C
), when the signal S□0 is at high level, the signal 8. Also, the signal S□ is sent out to send an on/off signal for the transistor (γ) according to the state of the transistor (γ). When the signal S9 is at a low level, the surplus energy absorbed by the capacitor (8) is generated due to the on/off of the zero transistor (γ), which operates to send out a signal to turn off the transistor (7) regardless of the state of the signal S9. is intermittently consumed by the discharge resistor (6).
ところで、第６図（または第５図）に示す工うに、トラ
ンジスタ（７）のオン・オフのタイミングと、カウンタ
α０）の値のアップ・ダウンのタイミングとは同一にと
っであるので、カウンタ（イ）の値はトランジスタ（７
）のオンのときは徐々に上昇し、オフのときは徐々に下
降する０それ故、前述したように、上昇用クロックパル
スの間隔を発熱特性に、また、下降用クロックパルスの
間隔を冷却特性に応するように採ると、カウンタαＱの
値は上述の直列回路のその時点での温度に対応し、した
がって、カウントの監視が直列回路の温度の監視となる
のである。そこで、カウントがオーバフローすると、所
定値（ａ□）まで強制的にカウントをダウンさせると共
に、出力Ｓ□。をローレベルに変換させ、ベース遮断回
路Ｃ１→を作動させて直列回路に強制的な冷却期間（第
５図に示す期間Ｔ）を設けさせることができるのである
。By the way, in the circuit shown in FIG. 6 (or FIG. 5), the on/off timing of the transistor (7) and the up/down timing of the value of the counter α0) are the same, so the counter ( The value of transistor (7) is
) when it is on, it gradually rises, and when it is off, it gradually falls 0 Therefore, as mentioned above, the interval between rising clock pulses has a heating characteristic, and the interval between falling clock pulses has a cooling characteristic. If the value of the counter αQ is taken as follows, the value of the counter αQ corresponds to the temperature of the above-mentioned series circuit at that point in time, and therefore, the monitoring of the count becomes the monitoring of the temperature of the series circuit. Therefore, when the count overflows, the count is forcibly down to a predetermined value (a□) and the output S□. is converted to a low level, the base cutoff circuit C1→ is activated, and a forced cooling period (period T shown in FIG. 5) can be provided in the series circuit.
以上のような回路を構成することによシ、放電抵抗（６
）及びスイッチング素子（７ンを能力以上に連続使用す
ることがなくなシ、これらの素子の著しい温度上昇やそ
れに伴う素子の劣化を防止することができる。By configuring the circuit as described above, the discharge resistance (6
) and switching elements (7) are not used continuously beyond their capacity, and a significant temperature rise in these elements and associated deterioration of the elements can be prevented.
なお、上記実施例では、カウンタ叫を用い、加熱冷却特
性にあわせてクロックパルスを選択使用して上述の直列
回路の温度を捉えるものについて説明したが、演算器を
用い加熱冷却特性にあわせて単位時間毎に加算あるいは
減算させて直列回路の温度を捉えるような構成のもので
あっても良い。In addition, in the above embodiment, the temperature of the above-mentioned series circuit is captured by using a counter signal and selecting clock pulses according to the heating and cooling characteristics. It may be configured such that the temperature of the series circuit is determined by adding or subtracting at each time.
以上のように、本発明によれば、放電抵抗及びスイッチ
ング素子の使用頻度を監視し使用過多になら々いように
制御を行左う監視手段を付加したので、放電抵抗及びス
イッチング素子の著しい温度上昇を防ぐことができ、素
子の劣化、破壊を防ぐことができるという効果を有する
。しかも、かかる効果、を生じさせる監視手段は、例え
ば、カウンタ等が中心であって安価かつ簡易に作成でき
る。As described above, according to the present invention, a monitoring means is added to monitor the frequency of use of the discharge resistor and the switching element and perform control to prevent excessive use. It has the effect of being able to prevent the increase in temperature and prevent deterioration and destruction of the element. Moreover, the monitoring means that produces such an effect is mainly a counter, for example, and can be produced easily and inexpensively.
涼１図は従来のインバータ装置の放電回路を示すブロッ
ク図、第２図は本発明の一実施例によるインバータ装置
の放電回路を示すブロック図、第３図は第２図回路のセ
レクタの選択論理およびトランジスタのオン・オフ論理
を示す説明図、第４図は第２図回路のカウンタの出力状
態とカウントとの関係を示す関係図、第５図（Ａ）へ（
Ｃ）は第２図回路に係るカウンタの値、トランジスタの
オン−オフ、並びに、比較器とカウンタの出力の経時変
化の一例を示す図である０
（１）・・交流電源
（２）・・コンバータブリッジ（順変換器）（８）・・
コンデンサ（平滑回路）
（４）・・インバータブリッジ（逆変換器）（５）・・
誘導電動機（負荷）
（６）・・放電抵抗
（７）・・トランジスタ（スイッチング素子）（８）・
φ電圧検出器 （９）・・比較器α０）・・カウンタ
（１１）、（Ｅ・９発振器０８）＃・セレクタ
ｑ→・・ベース遮断回路
なお、図中、同一符号は同−又は相当部分を示す０
代理人大岩増雄
第１図
第３図
第４図
ぐｌハ
手続補正書（自発）
１．事件の表示 特願昭 ５８−１５７３１５号２、発
明の名称
インバータ装置の放電回路
３、補正をする者
代表者片山仁へ部
（１）明細８第５頁第１０行の「放電抵抗（３）」 と
いう記載を「放電抵抗（６）」と補正する。
（２）明細書第７頁第１６行の−を選択発振器」という
記載を「選択した発振器」と補正する。
（３）明細書第９頁第１７行の「変換して」という記載
を「変更して」と補正する。
（４）図面中温２図と第３図をそれぞれ別紙の通り補正
する。
７、添伺書類の目録
図面 １ 通
量 −Ｊ−Figure 1 is a block diagram showing a discharge circuit of a conventional inverter device, Figure 2 is a block diagram showing a discharge circuit of an inverter device according to an embodiment of the present invention, and Figure 3 is a selection logic of the selector of the circuit shown in Figure 2. and an explanatory diagram showing the on/off logic of transistors, Figure 4 is a relational diagram showing the relationship between the output state of the counter of the circuit in Figure 2 and the count, and Figure 5 (A).
C) is a diagram showing an example of changes over time in the counter value, transistor on/off, and outputs of the comparator and counter related to the circuit in Figure 2. Converter bridge (forward converter) (8)...
Capacitor (smoothing circuit) (4)... Inverter bridge (inverse converter) (5)...
Induction motor (load) (6)...Discharge resistance (7)...Transistor (switching element) (8)...
φ voltage detector (9)... Comparator α0)... Counter
(11), (E・9 oscillator 08) #・Selector q→...Base cutoff circuit Note that in the figures, the same reference numerals indicate the same or corresponding parts 0 Agent Masuo Oiwa Figure 1 Figure 3 Figure 4 GLHA procedural amendment (voluntary) 1. Indication of the case: Japanese Patent Application No. 58-157315 2, Title of the invention: Discharge circuit for inverter device 3, Representative Hitoshi Katayama of the person making the amendment: (1) Specification 8, page 5, line 10, ``Discharge resistor (3)'' ” has been corrected to read “discharge resistance (6).” (2) On page 7, line 16 of the specification, the statement "-" selected oscillator" is corrected to read "selected oscillator." (3) The statement "by conversion" on page 9, line 17 of the specification is amended to "change". (4) Correct the drawings of medium temperature figures 2 and 3 as shown in the attached sheets. 7. Inventory drawing of accompanying documents 1 Quantity -J-
Claims (2)
、その直流を再び逆変換器によシ変換して新たな交流を
得るようにしたインバータ装置におけるその直流部２両
極間に、放電抵抗と該放電抵抗の通電を制御するスイッ
チング素子とで成る直列回路を接続したインバータ装置
の放電回路において、上記直流部の電圧レベルを検出す
る検出手段と、上記スイッチング素子のオン・オフ期間
に基づき上記直列回路の温度状態を監視する監視手段と
を備え、上記検出手段および該監視手段とからの百出力
信号に基づき上記スイッチング素子を導通制御する構成
としたことを特徴とするインバータ装置の放電回路。(1) In an inverter device in which AC power is converted to DC by a forward converter and a smoothing circuit, and the DC is converted again by an inverse converter to obtain new AC, between the two poles of the DC part. , a discharge circuit of an inverter device in which a series circuit consisting of a discharge resistor and a switching element for controlling energization of the discharge resistor is connected, a detection means for detecting the voltage level of the DC section, and an on/off period of the switching element. monitoring means for monitoring the temperature state of the series circuit based on the above, and conduction control of the switching element based on the output signal from the detection means and the monitoring means. discharge circuit.
た間隔を有するクロックパルスを発する第１の発振器と
、その直列回路の冷却特性に応じた間隔を有するクロッ
クパルスを発する第２の発振器、および、アップダウン
カウンタとを備えて成り、該カウンタは、前記スイッチ
ング素子のオン期間には上記第１の発振器の出力パルス
を受けてアップカウントし、他方、オン期間には第２の
発振器の出力パルスを受けてダウンカウントすると共に
、カウントが所定値を越えた場合に上記スイッチング素
子を強制的にオフにする信号を出力することを特徴とす
る特許請求の範囲第１項に記載のインバータ装置の放電
回路。(2) The monitoring means includes a first oscillator that emits clock pulses having intervals that correspond to the heating characteristics of the series circuit, and a second oscillator that emits clock pulses that have intervals that correspond to the cooling characteristics of the series circuit. , and an up/down counter, the counter receives the output pulse of the first oscillator and counts up during the on period of the switching element, while the counter receives the output pulse of the second oscillator during the on period of the switching element. The inverter device according to claim 1, wherein the inverter device counts down upon receiving the output pulse, and outputs a signal that forcibly turns off the switching element when the count exceeds a predetermined value. discharge circuit.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58157315A JPS6059976A (en) | 1983-08-29 | 1983-08-29 | Discharging circuit of inverter device |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58157315A JPS6059976A (en) | 1983-08-29 | 1983-08-29 | Discharging circuit of inverter device |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS6059976A true JPS6059976A (en) | 1985-04-06 |
| JPH0421436B2 JPH0421436B2 (en) | 1992-04-10 |
Family
ID=15646997
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP58157315A Granted JPS6059976A (en) | 1983-08-29 | 1983-08-29 | Discharging circuit of inverter device |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6059976A (en) |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS62260572A (en) * | 1986-05-02 | 1987-11-12 | Mitsubishi Electric Corp | Controller for ac elevator |
| JPS63140684A (en) * | 1986-12-01 | 1988-06-13 | Mitsubishi Electric Corp | Invertor device |
| JP2016135056A (en) * | 2015-01-22 | 2016-07-25 | 株式会社明電舎 | Brake resistance control apparatus and brake resistance control method |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS57160380A (en) * | 1981-03-27 | 1982-10-02 | Mitsubishi Electric Corp | Regenerative braking device for inverter |
-
1983
- 1983-08-29 JP JP58157315A patent/JPS6059976A/en active Granted
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS57160380A (en) * | 1981-03-27 | 1982-10-02 | Mitsubishi Electric Corp | Regenerative braking device for inverter |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS62260572A (en) * | 1986-05-02 | 1987-11-12 | Mitsubishi Electric Corp | Controller for ac elevator |
| JPS63140684A (en) * | 1986-12-01 | 1988-06-13 | Mitsubishi Electric Corp | Invertor device |
| JP2016135056A (en) * | 2015-01-22 | 2016-07-25 | 株式会社明電舎 | Brake resistance control apparatus and brake resistance control method |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0421436B2 (en) | 1992-04-10 |
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