JPS60207189A - Image signal processor - Google Patents
Image signal processorInfo
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- JPS60207189A JPS60207189A JP59063534A JP6353484A JPS60207189A JP S60207189 A JPS60207189 A JP S60207189A JP 59063534 A JP59063534 A JP 59063534A JP 6353484 A JP6353484 A JP 6353484A JP S60207189 A JPS60207189 A JP S60207189A
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。(57) [Summary] This bulletin contains application data before electronic filing, so abstract data is not recorded.
Description
【発明の詳細な説明】
〔発明の技術分野〕
本発明はカラー画像信号をカラー画像出力装置の特性に
合せて色変換処理して出力する画像信号処理装置に関す
る。DETAILED DESCRIPTION OF THE INVENTION [Technical Field of the Invention] The present invention relates to an image signal processing device that performs color conversion processing on a color image signal in accordance with the characteristics of a color image output device and outputs the resultant color image signal.
近時、ＣＲＴカラー・ディスプレイやカラー複写機、更
にはカラー・プリンタ等、各種のカラー画像出力装置が
実用化されている。このようなカラー画像出力装置を用
いてカラー画像を色再現性良く出力する場合、その出力
装置の特性に合せてカラー画像信号を適宜、色変換処理
することが必要である。この色変換処理は上記カラー画
像出力装置の画像処理方式に拘らず、一般にその画像の
１画素を表現する複数の画像データ（各色信号成分）を
並列に処理する必要があり、例えば第１図に示すように
上記各色成分に対応した画像信号処理系を並列的に設け
た構成を採用している。即ち、各画像信号処理系は、カ
ラー画像入力装置１が入力したカラー画像信号をカラー
画像出力装！２の出力特性に合せた色変換処理を各色成
分毎に行うもので、例えば入力された色信号をディジタ
ル化するＡ／Ｄ変換器３、このＡ／Ｄ変換器３の出力に
対して前記カラー画像入力装置１の特性に起因する上記
色信号のレベル差やシェーディングを補正する補正回路
４、前記カラー画像出力装置２の出力特性に応じて上記
色信号を色変換処理する色変換マトリックス回路５ （
この回路は、例えば入力系の加色混合系から出力系の減
色混合系への色変換を行う）、また前記カラー画像出力
装置２の出力特性に応じて前記色信号の濃度を制御する
濃度変換回路６、これらの変換処理された色信号をフィ
ルタリング処理するフィルタ回路７、そしてその出力を
２値化する２値化回路８により構成される。尚、上記２
値化回路８は、ディザ回路等からなり２値表現しかでき
ない前記カラー画像出力装置２により多階調のカラー画
像形成を可能とするものである。しかし、前記カラー画
像出力装置２が中間値表現可能なものである場合には上
記２値化回路８は省略され、前記フィルタ回路７の出力
が直接カラー画像出力装置２に与えられる。Recently, various color image output devices such as CRT color displays, color copying machines, and even color printers have been put into practical use. When outputting a color image with good color reproducibility using such a color image output device, it is necessary to appropriately perform color conversion processing on the color image signal in accordance with the characteristics of the output device. Regardless of the image processing method of the color image output device, this color conversion process generally requires parallel processing of multiple image data (each color signal component) representing one pixel of the image. As shown, a configuration is adopted in which image signal processing systems corresponding to each of the above color components are provided in parallel. That is, each image signal processing system converts the color image signal inputted by the color image input device 1 into the color image output device! For example, an A/D converter 3 that digitizes an input color signal, and a color conversion process tailored to the output characteristics of the A/D converter 3 for each color component. A correction circuit 4 corrects the level difference and shading of the color signal caused by the characteristics of the image input device 1, and a color conversion matrix circuit 5 that performs color conversion processing on the color signal according to the output characteristics of the color image output device 2.
This circuit performs color conversion, for example, from an additive color mixture system in the input system to a subtractive color mixture system in the output system), and density conversion to control the density of the color signal according to the output characteristics of the color image output device 2. It is composed of a circuit 6, a filter circuit 7 that filters these converted color signals, and a binarization circuit 8 that binarizes the output thereof. In addition, above 2
The value converting circuit 8 includes a dither circuit and the like, and enables the color image output device 2, which can only perform binary expression, to form a multi-gradation color image. However, when the color image output device 2 is capable of expressing intermediate values, the binarization circuit 8 is omitted and the output of the filter circuit 7 is directly given to the color image output device 2.
ところが、このようにして画像信号処理系を並列的和構
成した場合、その装置構成が複雑化し、大掛りな装置と
な゛って島価格なものとなることが否めない。However, when the image signal processing system is configured in parallel in this manner, the device configuration becomes complicated, and it is undeniable that the device becomes large-scale and expensive.
そこで、第２図に示すように画像信号処理系の前後に、
マルチプレクサ９およびデマルチプレクサ１０を設けて
前記カラー画像信号を各画素毎に時分割化し、この時分
割カラー画像信号を１一つの画像信号処理系にて時分割
処理することが考えられている。然し乍ら、第３図（ａ
）に並列出力される１画素の各色信号を、また同図（ｂ
、）にこれを時分割処理した画像信号を示すように、
時分割カラー画像信号の各色信号の入力間隔が速くなる
ので、これに伴って信号処理系の処理速度を高める必要
が生じる。特に前記色変換マトリックス回路５は前記各
色信号と色変換パラメータどの積和演算を１画素分の信
号転送時間内に実行しなければならず、その処理速度を
相当高くする必要が生じた。これ故、上記色変換マトリ
ックス回路５の実現が相当困難であった。Therefore, as shown in Figure 2, before and after the image signal processing system,
It has been considered to provide a multiplexer 9 and a demultiplexer 10 to time-divide the color image signal for each pixel, and to time-divisionally process this time-division color image signal in one image signal processing system. However, Fig. 3 (a)
), each color signal of one pixel is output in parallel to (b) in the same figure.
, ) shows the image signal obtained by time-division processing.
Since the input interval of each color signal of the time-division color image signal becomes faster, it becomes necessary to increase the processing speed of the signal processing system. In particular, the color conversion matrix circuit 5 has to perform the product-sum calculation of each color signal and the color conversion parameter within the signal transfer time for one pixel, making it necessary to increase the processing speed considerably. Therefore, it was quite difficult to realize the color conversion matrix circuit 5.
本発明はこのような事情を考慮してなされたもので、そ
の目的とするところは、時分割されたカラー画像信号を
簡易に、且つ効果的に色変換処理することのできる実用
性の高い画像信号処理装置を提供することにある。The present invention has been made in consideration of these circumstances, and its purpose is to provide a highly practical image that can easily and effectively perform color conversion processing on time-divided color image signals. An object of the present invention is to provide a signal processing device.
本発明はカラー画像の各画素の色成分を時分割に抽出し
た時分割カラー画像信号の１画素分の時分割色信号がシ
フトレジスタに格納される都度、このシフ１〜レジスタ
から上記１画素分の時分割色信号を一括入力してラッチ
し、このラッチされた上記１画素分の時分割色信号を積
和演算回路時分割に繰返し入力して色変換パラメータと
の間の積和演算を実行して色変換された色信号を）ｑる
ようにしたものである。In the present invention, each time a time-division color image signal for one pixel of a time-division color image signal obtained by time-divisionally extracting the color components of each pixel of a color image is stored in a shift register, the time-division color signal for one pixel is extracted from the shift register. The time-division color signals of 1 pixel are input and latched at once, and the latched time-division color signals for one pixel are repeatedly input to the time-division of the product-sum calculation circuit to perform the product-sum calculation with the color conversion parameters. The color signals that have been color-converted are
かくして本発明によれば、時分割カラー画像信号の１画
素分の各色信号がシフ１〜レジスタに格納される都度、
これをラッチして上記時分割カラー画像信号の１画素分
の転送期間内に亙って保持し、これを順次入力して色変
換パラメータとの間で積和演算を実行するので、簡易に
、且つ効率良くカラー画像の色変換処理を行うことが可
能となる。Thus, according to the present invention, each time each color signal for one pixel of the time-division color image signal is stored in the shift 1 register,
This is latched and held for the transfer period of one pixel of the above-mentioned time-division color image signal, and this is input sequentially to perform a product-sum operation with the color conversion parameter, so it is easy to Moreover, it becomes possible to efficiently perform color conversion processing on a color image.
しかも、色変換処理を１画素単位で実行するので、その
動作タイミングの設定が容易であり、処理速度の点でも
有利である。従って、その構成の簡略化を図り得る等の
実用上絶大なる効果が奏せられる。Moreover, since the color conversion process is executed pixel by pixel, the operation timing can be easily set, which is advantageous in terms of processing speed. Therefore, great practical effects such as simplification of the configuration can be achieved.
以下、図面を参照して本発明の一実施例につき説明する
。Hereinafter, one embodiment of the present invention will be described with reference to the drawings.
第４図は実施例装置の概略構成図で、例えば前記第２図
に示す画像信号処理系の色変換マトリツクス回路５とし
て用いられるものであり、前記マルチプレクサ９等によ
りカラー画像の各画素の色信号成分を時分割に選択抽出
してなる時分割化カラー画像信号を入力し、こめ時分゛
割カクー画像信号を色変換処理して出力するものである
。また第５図は、その動作タイミングを示している。FIG. 4 is a schematic configuration diagram of an embodiment device, which is used, for example, as the color conversion matrix circuit 5 of the image signal processing system shown in FIG. A time-divided color image signal obtained by selectively extracting components in a time-divided manner is input, and the time-divided color image signal is subjected to color conversion processing and output. Further, FIG. 5 shows the operation timing.
しかして上記時分割カラー画像信号は、クロックφ１に
より転送動作制御されるシフトレジスタ１１に入力され
、その時分割タイミングに同期してシフトレジスタ１１
内を転送される。前記カラー画像信号の１画素分の転送
周期に同期したクロックφ２を受けて動作するラッチ回
路１２は、前記シフトレジスタ１１に１画素分の色信号
が入力されたとき、この１画素分の色信号を一括入力し
てラッチして上記１画素分の転送周期の期間に亙って保
持する。セレクタ１３はクロックφ３を受けて動作し、
上記ラッチ回路１２にラッチされた上記各色信号を繰返
して選択して積和演算回路１４に出力しており、積和演
算回路１４は上記セレクタ１３を介して時分割で繰返し
選択された色信号とパラメータ回路１５から与えられる
色変換パラメータとの間の積和演算を実行して前記各色
信号の色変換処理を実行している。パラメータ回路１５
は色変換処理に必要なパラメータを前記クロックφ３に
同期して順に出力するものであり、この色変換パラメー
タを用いた積和演算は前記時分割カラー画像信号の１画
素分の転送周期内に行われるようになっている。The time-division color image signal is input to the shift register 11 whose transfer operation is controlled by the clock φ1, and the shift register 11 is transferred in synchronization with the time-division timing.
Transferred within. When the color signal for one pixel is input to the shift register 11, the latch circuit 12, which operates in response to a clock φ2 synchronized with the transfer cycle of one pixel of the color image signal, receives the color signal for one pixel. is input all at once, latched, and held for the period of the transfer cycle for one pixel. The selector 13 operates in response to the clock φ3,
The respective color signals latched in the latch circuit 12 are repeatedly selected and outputted to the product-sum calculation circuit 14, and the product-sum calculation circuit 14 selects the color signals repeatedly selected through the selector 13 in a time-sharing manner. A product-sum calculation is performed between the color conversion parameters given from the parameter circuit 15 to perform color conversion processing for each of the color signals. Parameter circuit 15
The parameters necessary for color conversion processing are output in sequence in synchronization with the clock φ3, and the product-sum operation using these color conversion parameters is performed within the transfer cycle of one pixel of the time-division color image signal. It is becoming more and more popular.
しかして今、前記カラー画像信号がイエローＹ′、グリ
ーンＧ′、シアンＣ′の３つの色成分からなり、これを
カラー画像出力装置２の出力特性に合せたマゼンタ間１
イエローＹ１シアンＣの色成分に色変換するものとする
。この場合、その色変換処理は色変換パラメータＡ （
ａｌｌ、 ａ１２゜ａ１３． ａ２１． ａ２２． ａ
２３． ａ３１． ａ３２． ａ３３）を用いて次のよ
うな積和演算を実行することによりめられる。Now, however, the color image signal is composed of three color components of yellow Y', green G', and cyan C', and the magenta and magenta signals are adjusted to suit the output characteristics of the color image output device 2.
It is assumed that color conversion is performed into yellow Y1 cyan C color components. In this case, the color conversion process is performed using the color conversion parameter A (
all, a12゜a13. a21. a22. a
23. a31. a32. a33) by executing the following product-sum operation.
前記シフトレジスタ１１はこの色変換処理に用いられる
１画素分の色信号（Ｙ’ 、Ｇ、Ｃ’ ）を一括して得
るべく３段のレジスタにより構成され、ランチ回路１２
は上記シフトレジスタ１１に上述した１画素分の色信号
（Ｙ′、ｄ、Ｃ′ ）が（１られる都度、これを並列に
一括入力してラッチしている。The shift register 11 is composed of three stages of registers to collectively obtain color signals (Y', G, C') for one pixel used in this color conversion process, and a launch circuit 12.
Each time the color signals (Y', d, C') for one pixel described above are input to the shift register 11 (1), they are input all at once in parallel and latched.
従って、ラッチ回路１２には前記１画素分の画像信号転
送周期毎に上記１画素分の色信号（Ｙ’ 、Ｇ。Therefore, the latch circuit 12 receives the color signal (Y', G) for one pixel at each image signal transfer period for one pixel.
Ｃ’ ）が同時に格納され、上記転送周期に亙って保持
されることになる。C') will be stored at the same time and retained over the above transfer period.
クロックφ３はこの１画素分の色信号の転送周期の間に
前記パラメータ回路１５からパラメータＡを順に読出す
べく、前記クロックφ１の３倍の周波数に設定されたも
ので、このクロックφ３によって前記セレクタ１３が巡
回的にセレクｈ動作−する。The clock φ3 is set to a frequency three times that of the clock φ1 in order to sequentially read out the parameter A from the parameter circuit 15 during the transfer period of the color signal for one pixel. 13 performs a cyclic select operation.
これによって前記積和演算回路１４に前記色変換処理に
必要な色信号および色変換パラメータが順に供給される
ことになる。この積和演算回路１４（よ、例えばＴＲＷ
社のＴＤＣｌｏｌｏＪ （形式番＠ン等により構成され
るもので、乗算器とその乗算出力を累積加算する加算器
とにより構成される。このような構成の積和演算回路１
４にて前述した積和演算が実行され、その色変換した信
号（Ｍ、Ｙ。As a result, the product-sum calculation circuit 14 is sequentially supplied with color signals and color conversion parameters necessary for the color conversion process. This product-sum calculation circuit 14 (for example, TRW
TDCloloJ (model number @n, etc.) of the company, and is composed of a multiplier and an adder that cumulatively adds the multiplication output. Product-sum operation circuit 1 with such a configuration
4, the product-sum operation described above is executed, and the color-converted signal (M, Y.
Ｃ）がめられて順に出力される。C) are read and output in order.
以上説明したように本発明によれば、時分割カラー画像
信号の各色信号を１画素単位で取扱って色変換処理する
ので、簡易に、且つ効率良く目的とする色変換処理を実
行することができる。しかも、その信号処理速度を徒に
速くする必要がなく、装置を簡易に構成することがてで
き、その実用的利点が絶大である。As explained above, according to the present invention, each color signal of a time-division color image signal is handled in units of one pixel and color conversion processing is performed, so that the desired color conversion processing can be executed easily and efficiently. . Moreover, there is no need to increase the signal processing speed unnecessarily, and the device can be configured simply, which has great practical advantages.
尚、本発明は上述した実施例に限定１されるものではな
い。例えば実施例では（Ｙ’ 、Ｇ、Ｃ’ ）からなる
色信号を（Ｙ、Ｍ、Ｃ）なる色信号に色変換したが、＜
Ｗ、Ｙ、ｃ＞からなる色信号を（Ｒ，Ｇ、Ｂ）に色変換
したり、また（Ｙ、Ｉ。Note that the present invention is not limited to the embodiments described above. For example, in the embodiment, a color signal consisting of (Y', G, C') was converted into a color signal consisting of (Y, M, C), but <
A color signal consisting of W, Y, c> is converted into (R, G, B), or (Y, I.
Ｑ）からなる色信号を（Ｙ−Ｒ，Ｙ−Ｇ、”ｙ”−８＞
なる色差信号に色変換するものであっても良い。Q) is a color signal consisting of (Y-R, Y-G, "y"-8>
It is also possible to convert the color into a color difference signal.
またカラー画像信号を表現する色信号の数も特に限定さ
れない。またラッチ回路１２として７１社の５Ｎ７４Ｓ
３７４ （形式番号）等の出力セレクト様能付きのもの
を用いれば、前記セレクタ１３を省略することができる
。要するに本発明は、その要旨を逸脱しない範囲で種々
変形して実流することができる。Further, the number of color signals representing a color image signal is not particularly limited. Also, as the latch circuit 12, 5N74S from 71 companies
The selector 13 can be omitted by using a device with an output selection function such as 374 (model number). In short, the present invention can be put into practical use with various modifications without departing from its gist.
第１図は従来装置の構成１図、第２図はカラー画像信号
を時分割処理する為の装置構成図、第３図は時分割処理
における問題点を示す為の動作タイミング図、第４図は
本発明の一実施例装置の概略構成図、第５図は実施例装
置の動作タイミングを示す図である。
５・・・色変換マトリックス回路、１１・・・シフトレ
ジスタ、１２・・・ラッチ回路、１３・・・セレクタ、
１４・・・積和演算回路、１５・・・パラメータ回路。
出願人代理人 弁理士 鈴江武彦
第１図
第７図
第３図
呻−ＩＬＬ脣テ゛−た− イFigure 1 is a configuration diagram of a conventional device, Figure 2 is a configuration diagram of a device for time-division processing of color image signals, Figure 3 is an operation timing diagram showing problems in time-division processing, and Figure 4 5 is a schematic configuration diagram of a device according to an embodiment of the present invention, and FIG. 5 is a diagram showing the operation timing of the device according to the embodiment. 5... Color conversion matrix circuit, 11... Shift register, 12... Latch circuit, 13... Selector,
14... Product-sum calculation circuit, 15... Parameter circuit. Applicant's Representative Patent Attorney Takehiko Suzue Figure 1 Figure 7 Figure 3 - ILL Part I
Claims (2)
た時分割カラー画像信号が供給されるシフ１ヘレジスタ
と、このシフトレジスタに１画素分の時分割色信号が格
納される都度、上記シフトレジスタから上記１画素分の
時分割色信号が一括供給されてラッチするランチ回路と
、このラッチ回路にラッチされた上記１画素分の時分割
色信号が時分割に繰返し供給されて色変換パラメータと
の間で積和演算を実行して色変換された色信号を得る積
和演算回路とを具備したことを特徴とする画像信号処理
装置。(1) A shift 1 register to which a time-division color image signal obtained by time-divisionally extracting the color components of each pixel of a color image is supplied, and each time a time-division color signal for one pixel is stored in this shift register, the above-mentioned There is a launch circuit to which the time-division color signal for one pixel is collectively supplied from the shift register and latched, and the time-division color signal for one pixel latched to this latch circuit is repeatedly supplied in a time-division manner to convert the color conversion parameters. 1. An image signal processing device comprising: a product-sum operation circuit that performs a product-sum operation between the two and obtains a color-converted color signal.
信号を時分割に繰返して積和演算回路に与える手段は、
上記ラッチ回路の出力段に設けられたセレクタからなる
ものであって、上記ラッチ回路に１画素分の時分割色信
号がラッチされている期間に前記積和演算回路に順次与
えられる色変換パラメータに同期して、上記１画素分の
時分割色信号を時分割に繰返し選択して前記積和演算回
路に与えるものである特許請求の範囲第１項記載の画像
信号処理装置。(2) The means for time-divisionally repeating the time-division color signal for one pixel latched in the latch circuit and applying it to the product-sum calculation circuit is as follows:
The selector includes a selector provided at the output stage of the latch circuit, and is configured to select color conversion parameters that are sequentially applied to the product-sum calculation circuit during a period when the time-division color signal for one pixel is latched in the latch circuit. 2. The image signal processing device according to claim 1, wherein the time-division color signal for one pixel is repeatedly selected in a time-division manner and applied to the product-sum calculation circuit in synchronization.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59063534A JPH0640255B2 (en) | 1984-03-31 | 1984-03-31 | Image signal processor |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59063534A JPH0640255B2 (en) | 1984-03-31 | 1984-03-31 | Image signal processor |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS60207189A true JPS60207189A (en) | 1985-10-18 |
| JPH0640255B2 JPH0640255B2 (en) | 1994-05-25 |
Family
ID=13231975
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP59063534A Expired - Lifetime JPH0640255B2 (en) | 1984-03-31 | 1984-03-31 | Image signal processor |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0640255B2 (en) |
Cited By (5)
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Also Published As
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|---|---|
| JPH0640255B2 (en) | 1994-05-25 |
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