JPS5999750A - Ic用リ−ドフレ−ムの製造方法 - Google Patents
Ic用リ−ドフレ−ムの製造方法Info
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- JPS5999750A JPS5999750A JP20865982A JP20865982A JPS5999750A JP S5999750 A JPS5999750 A JP S5999750A JP 20865982 A JP20865982 A JP 20865982A JP 20865982 A JP20865982 A JP 20865982A JP S5999750 A JPS5999750 A JP S5999750A
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Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/48—Manufacture or treatment of parts, e.g. containers, prior to assembly of the devices, using processes not provided for in a single one of the subgroups H01L21/06 - H01L21/326
- H01L21/4814—Conductive parts
- H01L21/4821—Flat leads, e.g. lead frames with or without insulating supports
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- Engineering & Computer Science (AREA)
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- Condensed Matter Physics & Semiconductors (AREA)
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- Manufacturing & Machinery (AREA)
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- Microelectronics & Electronic Packaging (AREA)
- Power Engineering (AREA)
- Lead Frames For Integrated Circuits (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明はIC用リードフレームの製造方法に関する。
半導体集積回路(IC)素子のパッケージ材料として、
例えば第1図に示すようなリードフレーム1が用いられ
ている。このリードフレーム1は樹月旨モールド形DI
P (Dual In1ine Pack・@geの略
)用のもので、多数のリード2の群とIC素子搭載部(
以下、「アイランド」という)3瀘複数組連続的に形成
されている。上記リードフレーム1は通常第2図に示す
ようにアイランド3及びリード2の内側先署部に金、銀
等の貴金属メッキが施されてIC素子のパッケージ(供
される。このようなリードフレーム1は、金属板又は金
属条をフォトエツチングまたはプレス打抜きによシリー
ド2及びアイランド3を)形成した%PJr4Jの部分
に貴金属をメッキ、するのが一般的である。所要の部分
にのみメッキする部分メッキ装置は、例えば特公昭49
72.47751号公報に記載のように、メッキすべき
部分全透孔としたマスク板と抑圧板とで被メッキ材を挾
持し、この透孔にメッキ液を噴射すると同時に被メッキ
材(陰極)と陽極との間に通電スるようになっている。
例えば第1図に示すようなリードフレーム1が用いられ
ている。このリードフレーム1は樹月旨モールド形DI
P (Dual In1ine Pack・@geの略
)用のもので、多数のリード2の群とIC素子搭載部(
以下、「アイランド」という)3瀘複数組連続的に形成
されている。上記リードフレーム1は通常第2図に示す
ようにアイランド3及びリード2の内側先署部に金、銀
等の貴金属メッキが施されてIC素子のパッケージ(供
される。このようなリードフレーム1は、金属板又は金
属条をフォトエツチングまたはプレス打抜きによシリー
ド2及びアイランド3を)形成した%PJr4Jの部分
に貴金属をメッキ、するのが一般的である。所要の部分
にのみメッキする部分メッキ装置は、例えば特公昭49
72.47751号公報に記載のように、メッキすべき
部分全透孔としたマスク板と抑圧板とで被メッキ材を挾
持し、この透孔にメッキ液を噴射すると同時に被メッキ
材(陰極)と陽極との間に通電スるようになっている。
ところが、このような部分メッキをリードフレーム1に
適用、した場合、リードフレームは通常0.25簡程−
の厚さがある生め抑圧板とマスイ板で、挾持さ些たリー
ド2の側面付近顛若干の間豐を生じ否ことが避けやれず
、この間隙にメッキ液が侵入する結果第3図に示すよう
にリード2の両側面に正常のメッキ境界線4からはみ出
したメッキ漏れ部5が生じてしまう。このメッキ漏れ部
5を有するリードフレームに第2図の破線6を外形とす
る樹脂モールドを施すと、上記メッキ漏れ部5は樹脂と
外界との境界付近に達することになり、外界の湿度の影
響でリード間にエレクトロマイグレーンヨンが起きて短
絡するに至る。このマイグレーションは銀の場合特に顕
著である。メッキ境界線4と樹脂モールド外形線6との
距離が光分離れていれば多少のメッキ湿れ部5の存在は
あまり問題Kfiらないが、IC素子の集積度向上に伴
なってアイランド3が太きCI、樹脂モールド外形を一
定限度に抑えようとすればこの距離は小さくなり、メッ
キ漏れ部5の存在は許容されなくなる。例えば、第2図
の破線6の長さ方向の寸法が6.35 mm、貴金属メ
ッキ領域の長さ方向の寸法が6躯であると、両側におけ
るギャップは9.175mの如く狭小のものとなる。
適用、した場合、リードフレームは通常0.25簡程−
の厚さがある生め抑圧板とマスイ板で、挾持さ些たリー
ド2の側面付近顛若干の間豐を生じ否ことが避けやれず
、この間隙にメッキ液が侵入する結果第3図に示すよう
にリード2の両側面に正常のメッキ境界線4からはみ出
したメッキ漏れ部5が生じてしまう。このメッキ漏れ部
5を有するリードフレームに第2図の破線6を外形とす
る樹脂モールドを施すと、上記メッキ漏れ部5は樹脂と
外界との境界付近に達することになり、外界の湿度の影
響でリード間にエレクトロマイグレーンヨンが起きて短
絡するに至る。このマイグレーションは銀の場合特に顕
著である。メッキ境界線4と樹脂モールド外形線6との
距離が光分離れていれば多少のメッキ湿れ部5の存在は
あまり問題Kfiらないが、IC素子の集積度向上に伴
なってアイランド3が太きCI、樹脂モールド外形を一
定限度に抑えようとすればこの距離は小さくなり、メッ
キ漏れ部5の存在は許容されなくなる。例えば、第2図
の破線6の長さ方向の寸法が6.35 mm、貴金属メ
ッキ領域の長さ方向の寸法が6躯であると、両側におけ
るギャップは9.175mの如く狭小のものとなる。
このようなメッキ漏れ部5を無くすにはり一ド2及びア
イランド3を形成する前に部分メッキを施せば良いと考
えられる。すなわち、第4図に示すように金属条7の両
縁部に位置決め用ビン孔8を設けておき、この金属条7
の中央部9に貴金属を部分メッキし、しかる後金携条7
をビン孔8を用いて位置決めしながらプレス打抜き加工
を施してリード2及びアイランド3を形成するのである
。
イランド3を形成する前に部分メッキを施せば良いと考
えられる。すなわち、第4図に示すように金属条7の両
縁部に位置決め用ビン孔8を設けておき、この金属条7
の中央部9に貴金属を部分メッキし、しかる後金携条7
をビン孔8を用いて位置決めしながらプレス打抜き加工
を施してリード2及びアイランド3を形成するのである
。
ところがこの方法では最終的にリードフレームを形成し
てみ々いとメッキ位置が正確であるかどうか容易に判別
できない欠点がある。メッキ位置はビン孔8を用いれば
成る程度正確にはなるが、部分メッキ装置をプレス金型
はど精密に絹み立てることは困難なため、メッキ位置決
めピンとビン孔8とのクリアランスを大きくせざるを得
す、従ってこのビン孔8のみで正確さを期することは事
実上不可能である。このため通常の部分メッキ装置は他
の手段でメッキ位置を調節できるようにしている。例え
ば金属条を間欠的に送pながら連続的に部分メッキする
装置では幅方向の調節はガイドローラーで、長手方向の
調節は金属条の駆動装置の微調整で行なうようにしてい
る。しかしながらこの調節もメッキ後直ちに位置ズレを
確認できなければ有効に活用できない。メッキ後プレス
打抜き加工した後で初めてメッキ位置ズレを発見してか
らフィードバックするのでは大量のメツキネ良品を発生
させてしまうことになる。
てみ々いとメッキ位置が正確であるかどうか容易に判別
できない欠点がある。メッキ位置はビン孔8を用いれば
成る程度正確にはなるが、部分メッキ装置をプレス金型
はど精密に絹み立てることは困難なため、メッキ位置決
めピンとビン孔8とのクリアランスを大きくせざるを得
す、従ってこのビン孔8のみで正確さを期することは事
実上不可能である。このため通常の部分メッキ装置は他
の手段でメッキ位置を調節できるようにしている。例え
ば金属条を間欠的に送pながら連続的に部分メッキする
装置では幅方向の調節はガイドローラーで、長手方向の
調節は金属条の駆動装置の微調整で行なうようにしてい
る。しかしながらこの調節もメッキ後直ちに位置ズレを
確認できなければ有効に活用できない。メッキ後プレス
打抜き加工した後で初めてメッキ位置ズレを発見してか
らフィードバックするのでは大量のメツキネ良品を発生
させてしまうことになる。
本発明は上記欠点を解消し、メッキ位置ズレをメッキ後
直ちに判別できるようにしたIC用リードフレームの製
造方法を提供するものである。この目的を達成するため
本発明は、金属条の両端部に位置決め用ビン孔と、上記
金属条の中央部にメッキ位置判別用貫通孔を形成し、上
記中央部に貴金属を部分メッキした後この金属条を上記
ビン孔を用いて位置合せしながらプレス打抜き加工を施
すことによシリードフレームを形成することを特徴とす
る。
直ちに判別できるようにしたIC用リードフレームの製
造方法を提供するものである。この目的を達成するため
本発明は、金属条の両端部に位置決め用ビン孔と、上記
金属条の中央部にメッキ位置判別用貫通孔を形成し、上
記中央部に貴金属を部分メッキした後この金属条を上記
ビン孔を用いて位置合せしながらプレス打抜き加工を施
すことによシリードフレームを形成することを特徴とす
る。
第5図は本発明の一実施例を説明するための図である。
第5図において金属条7には両端部に位置決め用ビン孔
8と、中央部にチャンネル状の貫通孔10.11が設け
られている。これら貫通孔io、itは第1図における
リード2とアイランド3の間隙と一致するようにしであ
る。このような金属条7に第4図と同様に中央部9に貴
金属メッキを施せば第2図におけるリード2の先端にな
る部分及びアイランド3がメッキされることになる。位
置決め用ビン孔8と貫通孔10.11の形成はフォトエ
ツチングまたはプレス打抜き加工例れでもできる。中央
部9への貴金属メッキは、金属条7が短尺の場合は特公
昭49−24775号公報に記載されているようなバッ
チ式の部分メッキ装置で、長尺の場合は米国特許第3,
788,963号明細書に記載のような連続部分メッキ
装置で行なうことができる。何れの場合でもメッキ後の
金属条7を見れば貫通孔io、i1とメッキ位置の関係
を直ちに判別できるので、位置ズレが有ればすぐに金属
条7の位置を修正することができ、メッキ位置ズレによ
る不良品の発生を最小限にすることができる。部分メッ
キを施した金属条7はプレス打抜き加工に供し、ビン孔
8を用いて位置させながらリードフレームを形成すれば
、リードフレームの1群は外見上第2図に示すようにな
9、り一ド2の先端は第6図に示すように上面と端面に
はメッキ層を有し、両側面には全く貴金属メッキ層を有
しないリードフレームを得ることができる。
8と、中央部にチャンネル状の貫通孔10.11が設け
られている。これら貫通孔io、itは第1図における
リード2とアイランド3の間隙と一致するようにしであ
る。このような金属条7に第4図と同様に中央部9に貴
金属メッキを施せば第2図におけるリード2の先端にな
る部分及びアイランド3がメッキされることになる。位
置決め用ビン孔8と貫通孔10.11の形成はフォトエ
ツチングまたはプレス打抜き加工例れでもできる。中央
部9への貴金属メッキは、金属条7が短尺の場合は特公
昭49−24775号公報に記載されているようなバッ
チ式の部分メッキ装置で、長尺の場合は米国特許第3,
788,963号明細書に記載のような連続部分メッキ
装置で行なうことができる。何れの場合でもメッキ後の
金属条7を見れば貫通孔io、i1とメッキ位置の関係
を直ちに判別できるので、位置ズレが有ればすぐに金属
条7の位置を修正することができ、メッキ位置ズレによ
る不良品の発生を最小限にすることができる。部分メッ
キを施した金属条7はプレス打抜き加工に供し、ビン孔
8を用いて位置させながらリードフレームを形成すれば
、リードフレームの1群は外見上第2図に示すようにな
9、り一ド2の先端は第6図に示すように上面と端面に
はメッキ層を有し、両側面には全く貴金属メッキ層を有
しないリードフレームを得ることができる。
メッキ位置判別用貫通孔の位置及び形状は第5図に示す
例に限定されるものではなく、リード2及びアイランド
3の形成に障害とならなければどのような位置及び形状
であ、ヤても差支えない。但し上記貫通孔の位置が中央
部のメッキ位置から離れ過ぎては位置ズレの判揃が困−
になるので、適当な位置にしなければならない。例えば
、幅方向詮よび/または長さ方向の中心線に対して線対
称の位置であっても良いし、メッキすべき領域の中心か
ら点対称の位置であっても良い。
例に限定されるものではなく、リード2及びアイランド
3の形成に障害とならなければどのような位置及び形状
であ、ヤても差支えない。但し上記貫通孔の位置が中央
部のメッキ位置から離れ過ぎては位置ズレの判揃が困−
になるので、適当な位置にしなければならない。例えば
、幅方向詮よび/または長さ方向の中心線に対して線対
称の位置であっても良いし、メッキすべき領域の中心か
ら点対称の位置であっても良い。
上記説明はアイランド3のあるリードフレームについて
行なったが、アイランドの無いリードフレームの製造に
も本発明法は適用できる。この場合はアイランド30部
分をビン孔8と共に開孔させれば上記貫通孔をメッキ位
置ズレ判別に用いることができる。1だ、アイランド3
のあるリードフレームにおいて、アイランド30部分に
貴金属メッキを施さない場合もあるが、そのような場合
も本発明法に含゛上れることはいうまでもない。
行なったが、アイランドの無いリードフレームの製造に
も本発明法は適用できる。この場合はアイランド30部
分をビン孔8と共に開孔させれば上記貫通孔をメッキ位
置ズレ判別に用いることができる。1だ、アイランド3
のあるリードフレームにおいて、アイランド30部分に
貴金属メッキを施さない場合もあるが、そのような場合
も本発明法に含゛上れることはいうまでもない。
本発明によれば、リード側面に貴金属メッキ層を有しな
いIC用リードフレームのメッキ位置を精度良く製造す
ることができ、材料歩留シを高めうると共にIC装置の
信頼性向上に大きく寄与することができる。
いIC用リードフレームのメッキ位置を精度良く製造す
ることができ、材料歩留シを高めうると共にIC装置の
信頼性向上に大きく寄与することができる。
第1図は一般的なI’C用リードフレームの平面図。
第2図は第1図のリードフレームに貴金属メッキが施さ
れた状態の拡大平面図。 第3図は従来技術によるリード先端部分のメッキ漏れ部
分を示す斜視図。 第4図および第5図はそれぞれ金属条に設けたビン孔と
メッキ位置の関係、および本発明によるメッキ位置判別
用貫通孔の位置関係の具体例を示す説明図。 第′6.図は本発明によって形成されたメッキ層を有す
るリード先端の斜視図である。 1・・・リニドフ□、レーム;2・・・リード;3づイ
ランド:7・・・金属条;8・・・位置決め用ビン孔;
9・・・中央部:10,11・・・貫通孔。 特許出願人: 住友金属鉱山株式会社 代理人:弁理士海津保三 同 : 弁理士 平 山 −幸
れた状態の拡大平面図。 第3図は従来技術によるリード先端部分のメッキ漏れ部
分を示す斜視図。 第4図および第5図はそれぞれ金属条に設けたビン孔と
メッキ位置の関係、および本発明によるメッキ位置判別
用貫通孔の位置関係の具体例を示す説明図。 第′6.図は本発明によって形成されたメッキ層を有す
るリード先端の斜視図である。 1・・・リニドフ□、レーム;2・・・リード;3づイ
ランド:7・・・金属条;8・・・位置決め用ビン孔;
9・・・中央部:10,11・・・貫通孔。 特許出願人: 住友金属鉱山株式会社 代理人:弁理士海津保三 同 : 弁理士 平 山 −幸
Claims (1)
- 金属条の両縁部に位置決め用ビン孔と、上記金属条の中
央部にメッキ位置判別用貫通孔を形成し、上記中央部に
貴金属を部分メッキした憐この金属条を上記ピン孔を用
いて位置合せしながらプレス打抜き加工を施してリード
フレームを群成することを特徴とするIC用リードフレ
ームの製造方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP20865982A JPS5999750A (ja) | 1982-11-30 | 1982-11-30 | Ic用リ−ドフレ−ムの製造方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP20865982A JPS5999750A (ja) | 1982-11-30 | 1982-11-30 | Ic用リ−ドフレ−ムの製造方法 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS5999750A true JPS5999750A (ja) | 1984-06-08 |
JPH0141034B2 JPH0141034B2 (ja) | 1989-09-01 |
Family
ID=16559912
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP20865982A Granted JPS5999750A (ja) | 1982-11-30 | 1982-11-30 | Ic用リ−ドフレ−ムの製造方法 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS5999750A (ja) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS59188952A (ja) * | 1983-04-11 | 1984-10-26 | Shinko Electric Ind Co Ltd | リ−ドフレ−ムの製造方法 |
US6047467A (en) * | 1995-10-12 | 2000-04-11 | Vlsi Technology, Inc. | Printed circuit board layout to minimize the clock delay caused by mismatch in length of metal lines and enhance the thermal performance of microelectronics packages via conduction through the package leads |
-
1982
- 1982-11-30 JP JP20865982A patent/JPS5999750A/ja active Granted
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS59188952A (ja) * | 1983-04-11 | 1984-10-26 | Shinko Electric Ind Co Ltd | リ−ドフレ−ムの製造方法 |
JPH0135503B2 (ja) * | 1983-04-11 | 1989-07-25 | Shinko Elec Ind | |
US6047467A (en) * | 1995-10-12 | 2000-04-11 | Vlsi Technology, Inc. | Printed circuit board layout to minimize the clock delay caused by mismatch in length of metal lines and enhance the thermal performance of microelectronics packages via conduction through the package leads |
Also Published As
Publication number | Publication date |
---|---|
JPH0141034B2 (ja) | 1989-09-01 |
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