JPS5987679A - ダブルカセツトテ−プレコ−ダ装置 - Google Patents
ダブルカセツトテ−プレコ−ダ装置Info
- Publication number
- JPS5987679A JPS5987679A JP57197462A JP19746282A JPS5987679A JP S5987679 A JPS5987679 A JP S5987679A JP 57197462 A JP57197462 A JP 57197462A JP 19746282 A JP19746282 A JP 19746282A JP S5987679 A JPS5987679 A JP S5987679A
- Authority
- JP
- Japan
- Prior art keywords
- dubbing
- switch
- tape recorder
- circuit
- play
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Classifications
-
- G—PHYSICS
- G11—INFORMATION STORAGE
- G11B—INFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
- G11B27/00—Editing; Indexing; Addressing; Timing or synchronising; Monitoring; Measuring tape travel
- G11B27/02—Editing, e.g. varying the order of information signals recorded on, or reproduced from, record carriers
- G11B27/022—Electronic editing of analogue information signals, e.g. audio or video signals
- G11B27/024—Electronic editing of analogue information signals, e.g. audio or video signals on tapes
Landscapes
- Engineering & Computer Science (AREA)
- Multimedia (AREA)
- Management Or Editing Of Information On Record Carriers (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔利用分野〕
本発明はダブルカセットテープレコーダのダビング動作
時に、第1のカセットテープレコータ゛ニよル選曲の頭
出しと、第2のカセットテープレコーダの頭出しとが連
動して目動的に行なえるようすることによシ操作性を向
上したダブルカセットテープレコーダ装買忙関する。
時に、第1のカセットテープレコータ゛ニよル選曲の頭
出しと、第2のカセットテープレコーダの頭出しとが連
動して目動的に行なえるようすることによシ操作性を向
上したダブルカセットテープレコーダ装買忙関する。
第1図は従来のダブルカセットテープレコーダの概略図
を示す。図において、1は第1のテープレコーダ操作回
路、2は第2のチーブレコータ゛操作回路、15はプレ
イスイッチ、4は巻戻し、早送シスイッチ、5は巻戻し
スイッチ、6はグレイスイップ〜、7は録音スイッチで
ある。
を示す。図において、1は第1のテープレコーダ操作回
路、2は第2のチーブレコータ゛操作回路、15はプレ
イスイッチ、4は巻戻し、早送シスイッチ、5は巻戻し
スイッチ、6はグレイスイップ〜、7は録音スイッチで
ある。
この従来装置では、第1のテープレコーダ操作回路のプ
レイスイッチ3をオンにして第1のテープレコーダを再
生にすると共に、第2のテープレコーダ操作回路2のプ
レイスイッチ6と録音スイッチ7を同時にオンにするこ
とによりダビングが行なわれている。
レイスイッチ3をオンにして第1のテープレコーダを再
生にすると共に、第2のテープレコーダ操作回路2のプ
レイスイッチ6と録音スイッチ7を同時にオンにするこ
とによりダビングが行なわれている。
一般にダブルカセットテープレコーダで而等をダビング
する場合、ダビングしようとしてbる多数の曲の中には
ダビングを削除したい曲がある場合がしばしばある。こ
のような場合、削除した一曲のダビングが始まってから
、削除しようとすることが起る。
する場合、ダビングしようとしてbる多数の曲の中には
ダビングを削除したい曲がある場合がしばしばある。こ
のような場合、削除した一曲のダビングが始まってから
、削除しようとすることが起る。
一旦ダピングか開始された曲を削除して、次の曲を頭か
らダビングするような時には、従来は、再生している第
1のカセットチープレコークと録音してbる第2のカセ
ットチープレコータ゛の操作キーを各々別々に操作する
。そして、第1のカセットテープレコーダではダビング
をカットする曲の次の曲の頭出しをし、一方第2のカセ
ットテープレコーダでは該ダビングをカットする曲の前
の曲の最後を見つりる。続−て両カセットテ〜プレコー
ダの再生キーと録音キーをそれぞれ操作をして、ダビン
グの修正を行っていた。
らダビングするような時には、従来は、再生している第
1のカセットチープレコークと録音してbる第2のカセ
ットチープレコータ゛の操作キーを各々別々に操作する
。そして、第1のカセットテープレコーダではダビング
をカットする曲の次の曲の頭出しをし、一方第2のカセ
ットテープレコーダでは該ダビングをカットする曲の前
の曲の最後を見つりる。続−て両カセットテ〜プレコー
ダの再生キーと録音キーをそれぞれ操作をして、ダビン
グの修正を行っていた。
このように゛、従来のダブルカセットテープレコーダで
は、ダビング時の修正と、編集に多数の操作を必要とし
、わずられしいという欠点があった。
は、ダビング時の修正と、編集に多数の操作を必要とし
、わずられしいという欠点があった。
本発明の目的は、ダビングの修正、編集が簡単に行なえ
るダブルカセットテープレコーダを提供することにある
。
るダブルカセットテープレコーダを提供することにある
。
本発明の特徴は、第1のチープレコータ゛のプレイスイ
ッチと巻戻し、早送りスイッチが同時にオンにされた時
選曲動作に入る選曲回路、該両スイッチが同時にオン忙
された時第2のテープレコーダの巻戻しスイップ・をオ
ンにする手段、第2のテープレコーダに設けられた巻戻
し量を制御する手段、前記選曲回路如よって曲間が検出
された時第1のテープレコーダをプレイ動作にすると共
に第2のテープレコーダのプレイスイッチと録音スイッ
チ−をオンにする手段を具備し、現在ダビング中の曲を
飛ばして次の曲の頭からのダビングが自fill的に行
なえるようにした点にある。
ッチと巻戻し、早送りスイッチが同時にオンにされた時
選曲動作に入る選曲回路、該両スイッチが同時にオン忙
された時第2のテープレコーダの巻戻しスイップ・をオ
ンにする手段、第2のテープレコーダに設けられた巻戻
し量を制御する手段、前記選曲回路如よって曲間が検出
された時第1のテープレコーダをプレイ動作にすると共
に第2のテープレコーダのプレイスイッチと録音スイッ
チ−をオンにする手段を具備し、現在ダビング中の曲を
飛ばして次の曲の頭からのダビングが自fill的に行
なえるようにした点にある。
第2図は本発明の一実施例を示す。図に卦(ハて、点線
よシ左側のブロックは第1のテープレコーダ、右側のブ
ロックは第2のテープレコーダを示す。
よシ左側のブロックは第1のテープレコーダ、右側のブ
ロックは第2のテープレコーダを示す。
図釦おいて、11と21はメカ部、12と22はメカ駆
動回路、13と23はCPU、14と24は入力回路を
示す。また、15はプレイスイッチ。
動回路、13と23はCPU、14と24は入力回路を
示す。また、15はプレイスイッチ。
16は巻戻し、早送タスイッテ、17は選曲回路、1日
は再生アンプである。
は再生アンプである。
また、25はパルス発生回路、26はメモリ回路、27
は巻戻しスイッチ、28はプレイスイッチ、29は録音
スイッチである。さら忙、30はノア回路、51,32
.33はトランジスターである。
は巻戻しスイッチ、28はプレイスイッチ、29は録音
スイッチである。さら忙、30はノア回路、51,32
.33はトランジスターである。
このような回路忙おいて、第1のテープレコーダでは、
プレイスイッチ15、巻戻し、早送シスイッテ1乙の信
号は入力回路14に入力される。
プレイスイッチ15、巻戻し、早送シスイッテ1乙の信
号は入力回路14に入力される。
入力回路14の出力信号はCP U 13 &’C入力
され、CPU1.3で信号処理される。CPU13の出
力はメカ駆動回路12を介してメカ部11に入シ、メカ
部11の動作を制御する。また、再生アンプ18および
選曲間Al817の出力は入力回路14に入力する。
され、CPU1.3で信号処理される。CPU13の出
力はメカ駆動回路12を介してメカ部11に入シ、メカ
部11の動作を制御する。また、再生アンプ18および
選曲間Al817の出力は入力回路14に入力する。
一方、第2のテープレコーダでは、巻戻しスイップー2
7、プレイスイッ″f−28および舜音スイッチ29の
信号が入力回路24に入力する。この入力回路24をへ
た信号はCP U23JC入シ、信号処理される。また
、パルス発生回路25Fiメモリ回路26に接続され、
メモリ回路26dCPU25に連結されている。CPU
23はメカ駆動回路22を介してメカ部211/C入り
、メカ部11の動作を制御する。
7、プレイスイッ″f−28および舜音スイッチ29の
信号が入力回路24に入力する。この入力回路24をへ
た信号はCP U23JC入シ、信号処理される。また
、パルス発生回路25Fiメモリ回路26に接続され、
メモリ回路26dCPU25に連結されている。CPU
23はメカ駆動回路22を介してメカ部211/C入り
、メカ部11の動作を制御する。
また、第1のテープレコーダのプレイスイッチー15と
巻戻し、早送勺スイッチ16とはノア回路30に接続さ
れ、その出力は第2のテープレコーダの巻戻しスイッチ
27に接続されたトランジスタ31を制御する。また、
第1のテープレコーダのcrtzgはトランジスタ52
.33を介して、第2のテープレコーダの入力回*24
m入力する信号を制御している。
巻戻し、早送勺スイッチ16とはノア回路30に接続さ
れ、その出力は第2のテープレコーダの巻戻しスイッチ
27に接続されたトランジスタ31を制御する。また、
第1のテープレコーダのcrtzgはトランジスタ52
.33を介して、第2のテープレコーダの入力回*24
m入力する信号を制御している。
本実施例において、第1のテープレコーダのプレイスイ
ッチ15をオンにすると、第1のテープレコーダは再生
になる。さらに、第2のテープレコーダのプレイスイッ
チ28および録音スイッチ28および録音スイッチ29
を同時にオンにすると、ダビング状態が形成される。こ
れは従来装置と同じである。
ッチ15をオンにすると、第1のテープレコーダは再生
になる。さらに、第2のテープレコーダのプレイスイッ
チ28および録音スイッチ28および録音スイッチ29
を同時にオンにすると、ダビング状態が形成される。こ
れは従来装置と同じである。
次忙、ダビング状態におりて、現在ダビングしている曲
のダビングをやめ、この曲を飛ばして次の曲をダビング
する時の本実施例の動作を説明する。
のダビングをやめ、この曲を飛ばして次の曲をダビング
する時の本実施例の動作を説明する。
この場合には、第1のテープレコーダのプレイスイッチ
−15および巻戻し、早送りスイッチ16を同時姥オン
にする。そうすると、第1のテープレコーダ忙備見られ
ている再生アンプ1日の出力が選曲回路17を介して入
力回路14に入力され、第1のテープレコーダは選曲動
作となる。そして、選曲回路17が、その入力が°゛H
″H″レベルI L nレベルになると曲間とみなし、
選曲動作を解除し、同時にプレイ動作となる。
−15および巻戻し、早送りスイッチ16を同時姥オン
にする。そうすると、第1のテープレコーダ忙備見られ
ている再生アンプ1日の出力が選曲回路17を介して入
力回路14に入力され、第1のテープレコーダは選曲動
作となる。そして、選曲回路17が、その入力が°゛H
″H″レベルI L nレベルになると曲間とみなし、
選曲動作を解除し、同時にプレイ動作となる。
一方、第2のテープレコーダでは、第1のテープレコー
ダのプレイスイッチ15を巻戻し1.早送夛スイッチ1
6が前述のよう忙四時忙オンされると、ノア回路30の
出力が°′H″レベルの電位となるため、スイッチング
トランジスタ31がオンになる。これによって、第2の
テープレコーダは、録音を解除し、巻戻し状態となる。
ダのプレイスイッチ15を巻戻し1.早送夛スイッチ1
6が前述のよう忙四時忙オンされると、ノア回路30の
出力が°′H″レベルの電位となるため、スイッチング
トランジスタ31がオンになる。これによって、第2の
テープレコーダは、録音を解除し、巻戻し状態となる。
巻戻し景は、パルス発生回路25妃より発生したパルス
をメモリ回路26にて記憶させ、記録開始時点まで第2
のテープレコーダのCPU23によシ巻戻される。
をメモリ回路26にて記憶させ、記録開始時点まで第2
のテープレコーダのCPU23によシ巻戻される。
選曲回路17のレベルが6L”になると、CPU13は
第1のテープレコーダをプレイ動作にすると同時に、第
2のテープレコーダのトランジスタ32.lj$をオン
にする。これによって、第2のテープレコーダのプレイ
スイッチ・28および録音スイッ′f29が同時忙オン
になったことと等価になシ、ダビングが再スタートする
。
第1のテープレコーダをプレイ動作にすると同時に、第
2のテープレコーダのトランジスタ32.lj$をオン
にする。これによって、第2のテープレコーダのプレイ
スイッチ・28および録音スイッ′f29が同時忙オン
になったことと等価になシ、ダビングが再スタートする
。
本発明によれば、上記の説明から明かなように、ダビン
グ中である曲のダビングをやめて、次の曲をダビングす
るような時に、単に第1のテープレコーダのプレイスイ
ッチと巻戻し、早送シスイッチの両方を同時にオン忙す
るだけでよいので、ダビング時の修正および編集を簡単
釦行なうことができ、操作性の向上を計ることができる
。
グ中である曲のダビングをやめて、次の曲をダビングす
るような時に、単に第1のテープレコーダのプレイスイ
ッチと巻戻し、早送シスイッチの両方を同時にオン忙す
るだけでよいので、ダビング時の修正および編集を簡単
釦行なうことができ、操作性の向上を計ることができる
。
第1図は、従来のダブルカセットテープレコーダの一部
の概略図、第2図は、本発明の一実施例のブロック図を
示す。 1・・・第1のテープレコーダ操作回路、2“・・第2
のテープレコーダ操作回路、11.21・・・メカ部、
12.22・・・メカ駆動回路、15.25・・・CP
U。 14.24・・・入力回路、15・・・プレイスイッチ
、16°・・巻戻し、早送9スイツチ、17・・・選曲
回路。 18・・・再生アンプ、25・・・パルス発生回路、2
6・・・メモリ回路、27・・・巻戻しスイッチ、28
・・・プレイスイッチ、29・・・録音スイップー、3
o・・・ノア回路 ゴ壜′ ノ Gミ1
の概略図、第2図は、本発明の一実施例のブロック図を
示す。 1・・・第1のテープレコーダ操作回路、2“・・第2
のテープレコーダ操作回路、11.21・・・メカ部、
12.22・・・メカ駆動回路、15.25・・・CP
U。 14.24・・・入力回路、15・・・プレイスイッチ
、16°・・巻戻し、早送9スイツチ、17・・・選曲
回路。 18・・・再生アンプ、25・・・パルス発生回路、2
6・・・メモリ回路、27・・・巻戻しスイッチ、28
・・・プレイスイッチ、29・・・録音スイップー、3
o・・・ノア回路 ゴ壜′ ノ Gミ1
Claims (1)
- (1)ljFHのテープレコーダではプレイスイッチを
オンにし、第2のテープレコーダではプレイスイッチお
よび録音スイッチを同時にオンにする仁とによってダビ
ングが行なわれるよう釦したダブルカセットテープレコ
ーダにおいて、第1のテープレコーダのプレイスイッチ
と巻戻し、早送りスイップーが同時にオンにされた時、
選曲動作に入る選曲回路、前記両スイップーが同時釦オ
ンにされた時第2のテープレコーダの巻戻しスイッチを
オンにする手段、第2のテープレコーダに設けられた巻
戻し量を制御する手段、前記選曲回路によって曲間が検
出された時第1のテープレコーダをプレイ動作釦すると
共忙、第2のテープレコーダのプレイスイッチと録音ス
イッチをオンにする信号を発する手段を具備し、ダビン
グ中の曲を飛ばして次の曲の頭からのダビングが自動的
忙行なえるようにしたことを特徴とするダブルカセット
テープレコーダ装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP57197462A JPS5987679A (ja) | 1982-11-12 | 1982-11-12 | ダブルカセツトテ−プレコ−ダ装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP57197462A JPS5987679A (ja) | 1982-11-12 | 1982-11-12 | ダブルカセツトテ−プレコ−ダ装置 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS5987679A true JPS5987679A (ja) | 1984-05-21 |
Family
ID=16374898
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP57197462A Pending JPS5987679A (ja) | 1982-11-12 | 1982-11-12 | ダブルカセツトテ−プレコ−ダ装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS5987679A (ja) |
Cited By (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS6150271A (ja) * | 1984-08-20 | 1986-03-12 | Sansui Electric Co | 磁気記録再生装置 |
JPS61230694A (ja) * | 1985-04-05 | 1986-10-14 | Hitachi Ltd | テ−プレコ−ダの選曲装置 |
JPS61237284A (ja) * | 1985-04-12 | 1986-10-22 | Sony Corp | 編集装置 |
JPS6226615U (ja) * | 1985-07-31 | 1987-02-18 |
-
1982
- 1982-11-12 JP JP57197462A patent/JPS5987679A/ja active Pending
Cited By (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS6150271A (ja) * | 1984-08-20 | 1986-03-12 | Sansui Electric Co | 磁気記録再生装置 |
JPS61230694A (ja) * | 1985-04-05 | 1986-10-14 | Hitachi Ltd | テ−プレコ−ダの選曲装置 |
JPS61237284A (ja) * | 1985-04-12 | 1986-10-22 | Sony Corp | 編集装置 |
JPH0756745B2 (ja) * | 1985-04-12 | 1995-06-14 | ソニー株式会社 | 編集装置 |
JPS6226615U (ja) * | 1985-07-31 | 1987-02-18 |
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