JPS5968394U - フラツシング装置 - Google Patents
フラツシング装置Info
- Publication number
- JPS5968394U JPS5968394U JP16509682U JP16509682U JPS5968394U JP S5968394 U JPS5968394 U JP S5968394U JP 16509682 U JP16509682 U JP 16509682U JP 16509682 U JP16509682 U JP 16509682U JP S5968394 U JPS5968394 U JP S5968394U
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- JP
- Japan
- Prior art keywords
- signal
- register
- output
- display
- brightness
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
第1図は、本考案の一実施例の構成図、第2図は、第1
図の実施例のタイムチャートである。 1・・・・・・信号発生器、2・・・・・・アンドゲー
ト、3X。 3A、 3B、 3G、 3D・・・・・・レジ
スタ、4・・・・・・セレクタ回路、5・・・・・・デ
ジタルアナログ変換器、6・・・・・・陰極線管、7・
・・・・・パターンメモリ。
図の実施例のタイムチャートである。 1・・・・・・信号発生器、2・・・・・・アンドゲー
ト、3X。 3A、 3B、 3G、 3D・・・・・・レジ
スタ、4・・・・・・セレクタ回路、5・・・・・・デ
ジタルアナログ変換器、6・・・・・・陰極線管、7・
・・・・・パターンメモリ。
Claims (1)
- 【実用新案登録請求の範囲】 電子計算機のディスプレイ装置に第1の表示をする第1
の輝度と、フラッシング指定情報が出力される第1のレ
ジスタと、 第2の表示をする第2の輝度信号が出力される第2のレ
ジスタと、該第1のレジスタを順次選択し、該第1の輝
度信号とフラッシング指定情報が出力される該第1のレ
ジスタを選択するパターンメモリと、 所定周期のパルス信号を発生する信号発生器と、該信号
発生器と、該パターンメモリによって選択された第1の
レジスタのフラッシング指定信号が入力され、論理積信
号が出力されるアンドゲートと、該アンドゲートから入
力される信号が所定値のとき該第2の輝度信号が該ディ
スプレイ装置に出力されるように該第1と第2の輝度信
号を切換える手段とを備えたフラッシング装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP16509682U JPS5968394U (ja) | 1982-10-30 | 1982-10-30 | フラツシング装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP16509682U JPS5968394U (ja) | 1982-10-30 | 1982-10-30 | フラツシング装置 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS5968394U true JPS5968394U (ja) | 1984-05-09 |
Family
ID=30361781
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP16509682U Pending JPS5968394U (ja) | 1982-10-30 | 1982-10-30 | フラツシング装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS5968394U (ja) |
-
1982
- 1982-10-30 JP JP16509682U patent/JPS5968394U/ja active Pending
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