JPS5951623A - ディジタル入力回路 - Google Patents
ディジタル入力回路Info
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- JPS5951623A JPS5951623A JP57162604A JP16260482A JPS5951623A JP S5951623 A JPS5951623 A JP S5951623A JP 57162604 A JP57162604 A JP 57162604A JP 16260482 A JP16260482 A JP 16260482A JP S5951623 A JPS5951623 A JP S5951623A
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- JP
- Japan
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- full
- signal
- input circuit
- circuit
- power supply
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- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03M—CODING; DECODING; CODE CONVERSION IN GENERAL
- H03M11/00—Coding in connection with keyboards or like devices, i.e. coding of the position of operated keys
- H03M11/22—Static coding
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F17/00—Digital computing or data processing equipment or methods, specially adapted for specific functions
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03K—PULSE TECHNIQUE
- H03K17/00—Electronic switching or gating, i.e. not by contact-making and –breaking
- H03K17/002—Switching arrangements with several input- or output terminals
-
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- H03K—PULSE TECHNIQUE
- H03K17/00—Electronic switching or gating, i.e. not by contact-making and –breaking
- H03K17/51—Electronic switching or gating, i.e. not by contact-making and –breaking characterised by the components used
- H03K17/56—Electronic switching or gating, i.e. not by contact-making and –breaking characterised by the components used by the use, as active elements, of semiconductor devices
- H03K17/60—Electronic switching or gating, i.e. not by contact-making and –breaking characterised by the components used by the use, as active elements, of semiconductor devices the devices being bipolar transistors
- H03K17/62—Switching arrangements with several input- output-terminals, e.g. multiplexers, distributors
- H03K17/6221—Switching arrangements with several input- output-terminals, e.g. multiplexers, distributors combined with selecting means
-
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- H03—ELECTRONIC CIRCUITRY
- H03K—PULSE TECHNIQUE
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- H03K17/51—Electronic switching or gating, i.e. not by contact-making and –breaking characterised by the components used
- H03K17/78—Electronic switching or gating, i.e. not by contact-making and –breaking characterised by the components used using opto-electronic devices, i.e. light-emitting and photoelectric devices electrically- or optically-coupled
- H03K17/795—Electronic switching or gating, i.e. not by contact-making and –breaking characterised by the components used using opto-electronic devices, i.e. light-emitting and photoelectric devices electrically- or optically-coupled controlling bipolar transistors
- H03K17/7955—Electronic switching or gating, i.e. not by contact-making and –breaking characterised by the components used using opto-electronic devices, i.e. light-emitting and photoelectric devices electrically- or optically-coupled controlling bipolar transistors using phototransistors
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
この発明は、プロゲラ1プルコントローラ制御用コンピ
ユータ等に使用するマトリックス方式ディジタル入力回
路に関するものである。
ユータ等に使用するマトリックス方式ディジタル入力回
路に関するものである。
従来この種の回路として第1図に示すものがあった。図
においてHlは0N10FF情報を取込。
においてHlは0N10FF情報を取込。
もうとするJlit;電圧接点、(2)は回り回路防止
用夕゛イオード、3)は抵抗、141t/iフオトカグ
ラ、(5)はトランジスタ、(61はツェナーダイオー
ド、(7)は直流電源、DO〜D?、 WO〜W3.
XO5−X3は1言号名である。第2図はWO〜W3の
タイミンク図である。
用夕゛イオード、3)は抵抗、141t/iフオトカグ
ラ、(5)はトランジスタ、(61はツェナーダイオー
ド、(7)は直流電源、DO〜D?、 WO〜W3.
XO5−X3は1言号名である。第2図はWO〜W3の
タイミンク図である。
次に動作について説明する。第1図において信号WOの
みがlOwで、Wl −W3がhigh の場合、WO
につながるフォトカプラの一次側に電流力;流れ、xO
のトランジスタのみがONシ、x1〜x3のトランジス
タはOFFになる。従ってXOにつながる接点の0N1
0FF情報のみがフォトカプラを経由して信号DO%
D7に取込筐れる。このときり゛イオードは電流の回り
込みを防止している。
みがlOwで、Wl −W3がhigh の場合、WO
につながるフォトカプラの一次側に電流力;流れ、xO
のトランジスタのみがONシ、x1〜x3のトランジス
タはOFFになる。従ってXOにつながる接点の0N1
0FF情報のみがフォトカプラを経由して信号DO%
D7に取込筐れる。このときり゛イオードは電流の回り
込みを防止している。
勤〜W3信号が第2図に示すように1幀次eOWになっ
ていき、1回りして、8X4=32点の接点情報を入力
することになる。
ていき、1回りして、8X4=32点の接点情報を入力
することになる。
従来の回路では以上のように、接点に加える電源として
直流電源を使用していた。
直流電源を使用していた。
この発明は、コスト上から見て直流電源をなくすことを
目的として、交流電源で動作するマトリックス方式入力
回路を提供する。
目的として、交流電源で動作するマトリックス方式入力
回路を提供する。
以下、この花明の一実施例を図について説明する。第3
において第1図と同符号は同一のものを示し、第1図は
、直・麓電源のlわりに交流′電源(8)を出力をダイ
オードブリッジから成る整流回路で全波整流し、その出
力をフォトカブラ14)に入力している点で相見する。
において第1図と同符号は同一のものを示し、第1図は
、直・麓電源のlわりに交流′電源(8)を出力をダイ
オードブリッジから成る整流回路で全波整流し、その出
力をフォトカブラ14)に入力している点で相見する。
なお、DO〜D7. WO〜W3. Xi 〜X3.
Toは信号名である。
Toは信号名である。
第4図は1d号TOとWO〜W3のタイミングを示した
ものである。
ものである。
次に動作について説明する。信号WOのみが1ovtの
場合従来のものと同様にXOのトランジスタのみがON
L、XOにつながる0N10FF漬報が信り・DO−
D’7’/(収り込まれる。このとき、接点に印加され
る電圧は単4’iJ A O電源の余波整流であるので
、低電圧時に収り込めば信号Do〜D7は’n igh
の方に誤動作する心配があるかのように見えるが、hc
の金波整流電圧から作ったTO藺号で同期をとることに
より防止できることは明らかである。
場合従来のものと同様にXOのトランジスタのみがON
L、XOにつながる0N10FF漬報が信り・DO−
D’7’/(収り込まれる。このとき、接点に印加され
る電圧は単4’iJ A O電源の余波整流であるので
、低電圧時に収り込めば信号Do〜D7は’n igh
の方に誤動作する心配があるかのように見えるが、hc
の金波整流電圧から作ったTO藺号で同期をとることに
より防止できることは明らかである。
なお、上記実施例でフォトカブラとトランジスタを使っ
た場合金示したが他の素子を使ったものでもよく、また
入力数についても8×4以外の16X4,16X2等神
々のものに使用可能である。
た場合金示したが他の素子を使ったものでもよく、また
入力数についても8×4以外の16X4,16X2等神
々のものに使用可能である。
以上のように、この発明によれば交流′電源を全波整流
し、その犠流と同期させて0N10FF情報を取り込む
ように構成しだので、直流電源なしのマトリックス方式
入力回路が得られる効果を有する。
し、その犠流と同期させて0N10FF情報を取り込む
ように構成しだので、直流電源なしのマトリックス方式
入力回路が得られる効果を有する。
第1図は従来のマトリックス式ディジタル入力回路図、
第2図は第1図の1nJJ作を説明するだめのタイミン
グ図、第3図はこの発明の一夾施汐月を示す回路接続図
、第4図は第3図の111)3作を説明するだめのタイ
ミング図である。 il+ −−一無電圧接点、+2)−御一同り回路防止
用ダイオード、+31−−一抵抗、+41−−−フォト
カブラ、+51−−−1−ランジスタ、+6] −−−
ツェナーダイオード、(81−−一交流電源。 なお、図中、同−宿号は同−又は相当部分を示す。 代理人 葛 野 信 − 第2図 第4図 XI XOXI X2
x3 x。
第2図は第1図の1nJJ作を説明するだめのタイミン
グ図、第3図はこの発明の一夾施汐月を示す回路接続図
、第4図は第3図の111)3作を説明するだめのタイ
ミング図である。 il+ −−一無電圧接点、+2)−御一同り回路防止
用ダイオード、+31−−一抵抗、+41−−−フォト
カブラ、+51−−−1−ランジスタ、+6] −−−
ツェナーダイオード、(81−−一交流電源。 なお、図中、同−宿号は同−又は相当部分を示す。 代理人 葛 野 信 − 第2図 第4図 XI XOXI X2
x3 x。
Claims (1)
- 並列接続された複数個の接点、この各接点に直列接続さ
れ入力信号に基づき動作するゲート素子、上記接点およ
びゲート素子を含む回路に接続された出力素子を何し、
上記接点とゲート素子とを7祖合せ、上記接点に得えら
れる0Vovv債報を上記出力素子ケ介して取込むよう
にしたディジタル入力回路において、交流を全波整流し
たものを上記接点の回路に供給し、且つ上記出力端子の
出力全上記余波整流の脈流に同期させたことを特徴とす
るディジタル入力回路0
Priority Applications (3)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP57162604A JPS5951623A (ja) | 1982-09-17 | 1982-09-17 | ディジタル入力回路 |
KR1019830002735A KR870001709B1 (ko) | 1982-09-17 | 1983-06-18 | 디지탈(digital) 입력 회로 |
US06/532,971 US4596984A (en) | 1982-09-17 | 1983-09-16 | Digital data input circuit |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP57162604A JPS5951623A (ja) | 1982-09-17 | 1982-09-17 | ディジタル入力回路 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS5951623A true JPS5951623A (ja) | 1984-03-26 |
JPH0430206B2 JPH0430206B2 (ja) | 1992-05-21 |
Family
ID=15757745
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP57162604A Granted JPS5951623A (ja) | 1982-09-17 | 1982-09-17 | ディジタル入力回路 |
Country Status (3)
Country | Link |
---|---|
US (1) | US4596984A (ja) |
JP (1) | JPS5951623A (ja) |
KR (1) | KR870001709B1 (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS60167456U (ja) * | 1984-04-11 | 1985-11-07 | 株式会社明電舎 | 入出力制御装置 |
Families Citing this family (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
DE3213527A1 (de) * | 1982-04-10 | 1983-10-20 | Heidelberger Druckmaschinen Ag, 6900 Heidelberg | Datenuebertragungssystem |
EP0165386B1 (de) * | 1984-04-26 | 1989-11-29 | Heidelberger Druckmaschinen Aktiengesellschaft | Verfahren und Speichersystem zum Speichern von Einstellwerten für Stellvorrichtungen an Druckmaschinen |
US6072402A (en) * | 1992-01-09 | 2000-06-06 | Slc Technologies, Inc. | Secure entry system with radio communications |
US5555421A (en) * | 1993-11-23 | 1996-09-10 | Kistler Instrument Company | Bidirectional interface for interconnecting two devices and the interface having first optical isolator and second optical isolator being powered by first and second device ports |
US10557884B2 (en) | 2017-05-11 | 2020-02-11 | Texas Instruments Incorporated | Wire break detection in digital input receivers |
Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS57168337U (ja) * | 1981-04-17 | 1982-10-23 |
Family Cites Families (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US3818451A (en) * | 1972-03-15 | 1974-06-18 | Motorola Inc | Light-emitting and light-receiving logic array |
US4310754A (en) * | 1976-07-14 | 1982-01-12 | Pitney Bowes Inc. | Communication means with transducer physically spaced from interior wall of secure housing |
CH625072A5 (ja) * | 1978-03-08 | 1981-08-31 | Landis & Gyr Ag | |
JPS5657127A (en) * | 1979-10-15 | 1981-05-19 | Toshiba Corp | Digital input/output circuit |
US4320388A (en) * | 1980-07-15 | 1982-03-16 | Westinghouse Electric Corp. | Two wire optical data communication system |
-
1982
- 1982-09-17 JP JP57162604A patent/JPS5951623A/ja active Granted
-
1983
- 1983-06-18 KR KR1019830002735A patent/KR870001709B1/ko not_active IP Right Cessation
- 1983-09-16 US US06/532,971 patent/US4596984A/en not_active Expired - Fee Related
Patent Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS57168337U (ja) * | 1981-04-17 | 1982-10-23 |
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JPS60167456U (ja) * | 1984-04-11 | 1985-11-07 | 株式会社明電舎 | 入出力制御装置 |
Also Published As
Publication number | Publication date |
---|---|
KR840006110A (ko) | 1984-11-21 |
JPH0430206B2 (ja) | 1992-05-21 |
US4596984A (en) | 1986-06-24 |
KR870001709B1 (ko) | 1987-09-24 |
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