JPS59110241A - デイジタル通信装置 - Google Patents

デイジタル通信装置

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JPS59110241A
JPS59110241A JP57222251A JP22225182A JPS59110241A JP S59110241 A JPS59110241 A JP S59110241A JP 57222251 A JP57222251 A JP 57222251A JP 22225182 A JP22225182 A JP 22225182A JP S59110241 A JPS59110241 A JP S59110241A
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JP
Japan
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low
speed pseudo
speed
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JP57222251A
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Masahiko Murakami
雅彦 村上
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Mitsubishi Electric Corp
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Mitsubishi Electric Corp
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Publication date
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    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04LTRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
    • H04L7/00Arrangements for synchronising receiver with transmitter
    • H04L7/04Speed or phase control by synchronisation signals
    • H04L7/041Speed or phase control by synchronisation signals using special codes as synchronising signal
    • H04L7/043Pseudo-noise [PN] codes variable during transmission

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  • Engineering & Computer Science (AREA)
  • Computer Networks & Wireless Communication (AREA)
  • Signal Processing (AREA)
  • Synchronisation In Digital Transmission Systems (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 この発明は、多数決判定を行なう周波数ホッピングディ
ジタル通信装置に関するものである。
従来の周波数ホッピング通信装置の一般的構成を%1図
に示す。図において、Illは送信装置、(2)は受信
装置、(3)はホッピングクロック生成回路、(4)は
分周回路、(5)は符号系列発生器、(6)はラッチ、
(’71 Fi加算器、(8)は周波数シンセナイザ、
(9)は伝送路、111はミキナ、1ulJ#′j検波
器、(1りは同期制御回路。
fJ311′i多数決判定回路である。
また第2図は第1図の符号系列発生器(5)の詳細な構
成を示し、図において(5a) I/′iホッピングク
ロックCを受けて使用開始時に設定した同期状態を使用
期間中独立に許容誤差内に維持できる程度に低速度の擬
似ランダム符号を発生する低速度擬似ランダム符号発生
器、(5b) I/iホッピングクロックeを受けるこ
とによって低速度の擬似ランダム符号発生器(5a)に
定期的に開始位置を制御される高速度の擬似ランダム符
号を発生する高速度擬似ランダム符号発生器、(5C)
は低速度擬似ランダム符号の周期を抽出する周期抽出回
路、gはその抽出された周期を示す出力、(5d)は上
記低速度及び高速度擬似ランダム符号発生器(5a)(
5b)の出力を外部よりの制御信号Cに応じて切換え出
力するスイッチ回路であり、上記制御信号Cけ同期確立
期間およびデータ伝送期間のタイミングを与える信号で
あり、上記スイッチ回路(5d)は同期確立期間は端子
A側に、データ伝送期間は端子B側に切換えられ、その
共通端子から擬似ランダム符号fを出力する。
次に動作について説明する。送信装置は)に入力された
データは、ホッピングクロック生成口dlr t31に
よシ生1視されたホッピングクロックCを分周回路(4
)で分周して得られたデータクロックbにより、データ
ランチ(6)において整形される。該データはさらに符
号系列発生器+51からの擬似ランダム符号fと加算器
(7)でスクランブルされ、周波数シンセナイデ(8)
にて送信される。
次いで、受信装置(2)では同期制御回路d2によシ受
信信号に同期せられた周波数シンセナイザ(8)の出力
と受信信号がミキナtllでIF帯域に窓とされ、検波
器u11により復調される。さらに受信データは加算器
(7)にてスクランブルを解除され、多数決判定回路u
3)を経て分周回路(4)からのデータクロックbによ
りデータラッチ(6)に8いて整形され、データ出力d
が出力される。
ここで、符号系列発生器(5)により生成される擬似ラ
ンダム符号fは、通信開始時は低速度擬似ランダム符号
発生器(5a)から出力される低速度の符号であり、同
期捕捉用信号が終rし、同期が確立した後は、スイッチ
回路(5d)により、高速度擬似ランダム符号発生器(
5b)から出力される高速度の擬似ランダム符号に切換
えられる。なお第2図の低速度擬似ランダム符号発生器
(5a)の出力から周期を抽出する周期抽出回w!r(
5C)の出力gけ本第1図の回路では使用されていない
従来の周波数ホッピング通信装置は以上のように構成さ
れているので、データクロックをホッピングクロックか
ら分周して生成しなければならず、分周回路が必要であ
るという欠点があった。
この発明は上記のような従来のものの欠点を除去するた
めになされたもので、データクロックの周期を、低速度
の擬似ランダム符号の周期と一致させることにより、従
来の分周回路を省略できるディジタル通信装置を提供す
るこ′とを目的としている。
6参≠通信装置を示し、本装置においては、符号系列発
生器(5)の周期抽出回#@(5C)により抽出した低
速度擬似ランダム符号の符号周期のタロツクgをデータ
クロックbとして用いている。
周波数ホッピング通信装置では、ホッピングを制御する
符号系列の同期をとる過程において、その低速度の擬似
ランダム符号の周期を抽出する回路(5C)を必要とす
る。従来は、同期捕捉用信号の送出中のみに有効であっ
た上記擬似ランダム符号の周期を抽出する回路(5c)
を、高速度の擬似ランダム符号による制御に切換わりだ
、後も、データクロック生成回路として用いれば、従来
必要とされた分周回路が省略できる。
f竹、データクロックの周期と低速度の擬似ランダム符
号の周期との対応は必ずしも1対1である必要はない。
以上のように、この発明によれば、データクロックを、
低速度擬似ランダム符号の周期と対応づけて生成するよ
うに構成したので、データクロック生成のための分周回
路を省略できる効果がある。
ム符号発生器入 (5a)・・・低速度擬似ランダム符
号発生器、(5b)・・・高速度擬似ランダム符号発生
器、(5C)・・・周期抽出回路。
なお図中、同一符号は同−又は相当部分を示す。
代  理  人       葛  野  信  −手
続補正書(方式) 特許庁長官殿 1、事件の表示   特願昭57−222251号2、
発明の名相二 ディジタル通信装置 3、補正をする者 代表者片山仁へ部 5、補正命令の日付 昭和58年3月9日 6、補正の対象 明細書の図面の簡単な説明の欄 7、補正の内容 Tl)  明細書第6頁第14行の「第2図は」を「第
2図は第1図の符号系列発生器(5)の詳細な構成図、
第3図は」に訂正する。
以    上 昭和  年  月  日 特許庁長官殿 1、事件の表示   特願昭57−222251  号
2、発明の名称 ディジタル通信装置 3、補正をする者 代表者片111仁八部

Claims (1)

    【特許請求の範囲】
  1. (1)同期捕捉のための低速度の擬似ランダム符号を発
    生する低速度擬似ランダム符号発生器と、上記低速度の
    擬似ランダム符号に定期的に開始位置を制御される高速
    度の擬似ランダム符号を発生する高速度擬似ランダム符
    号発生器と、この2つの擬似ランダム符号発生器の出力
    を制御信号に応信号送信時および受信待受状態時は、あ
    らかじめ同期状態に維持された上記低速度の擬似ランダ
    ム符号に制御された通信を行ない、同期捕捉用信号が終
    rし同期が確立された後は、上記高速度擬似ランダム符
    号に制御された通信を行なう周波数ホッピング通信装置
    に2いて、上記低速度の擬似ランダム符号発生器の出力
    からその周期を抽出する周期抽出回路を上記擬似ランダ
    ム符号発生器に備え、該周期抽出回路の出二枦ナータク
    ロックとしてデータ伝送を行なうことを特徴とするディ
    ジタル通信装置。
JP57222251A 1982-12-15 1982-12-15 デイジタル通信装置 Granted JPS59110241A (ja)

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JP57222251A JPS59110241A (ja) 1982-12-15 1982-12-15 デイジタル通信装置

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JP57222251A JPS59110241A (ja) 1982-12-15 1982-12-15 デイジタル通信装置

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JPS59110241A true JPS59110241A (ja) 1984-06-26
JPH0151102B2 JPH0151102B2 (ja) 1989-11-01

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