JPS5875283A - プリンタのキヤラクタ・ジエネレ−タ - Google Patents
プリンタのキヤラクタ・ジエネレ−タInfo
- Publication number
- JPS5875283A JPS5875283A JP56173400A JP17340081A JPS5875283A JP S5875283 A JPS5875283 A JP S5875283A JP 56173400 A JP56173400 A JP 56173400A JP 17340081 A JP17340081 A JP 17340081A JP S5875283 A JPS5875283 A JP S5875283A
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- Japan
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- data
- bit
- printer
- character generator
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- Pending
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-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06K—GRAPHICAL DATA READING; PRESENTATION OF DATA; RECORD CARRIERS; HANDLING RECORD CARRIERS
- G06K15/00—Arrangements for producing a permanent visual presentation of the output data, e.g. computer output printers
- G06K15/02—Arrangements for producing a permanent visual presentation of the output data, e.g. computer output printers using printers
- G06K15/10—Arrangements for producing a permanent visual presentation of the output data, e.g. computer output printers using printers by matrix printers
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- Physics & Mathematics (AREA)
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- General Physics & Mathematics (AREA)
- Theoretical Computer Science (AREA)
- Dot-Matrix Printers And Others (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
（１）発明の技術分野
本発明はワイヤー・ドツト・プリンタを制御するための
データを格納するキャラクタ・ジェネレータに関する。
データを格納するキャラクタ・ジェネレータに関する。
（２）従来技術
従来、９ワイヤーのドツト・プリンタのキャラクタ・ジ
ェネレータは矛１図に示す８ビツトのリード・オンリ・
メモリ（以下ＲＯＭという）のｌバイトと、１１２図に
示す４ビツトのＲＯＭの１ピツトとを、例えば、８ビツ
トのＲＯＭのアドレスＡ１、Ａ２、Ａ３、Ａ４、Ａ５、
Ａ６、Ａ７の各１バイトと、４ビツトのＲＯＭのアドレ
スＢ１の０ビツト目、ｌビット目、２ビツト目、３ビツ
ト目、アドレスＢ２のθビット目、１ビツト目、２ビツ
ト目というように順次組合わせて９ビツトのデータとし
、ドツト・プリンタの各ワイヤーを制御するようになっ
ている。
ェネレータは矛１図に示す８ビツトのリード・オンリ・
メモリ（以下ＲＯＭという）のｌバイトと、１１２図に
示す４ビツトのＲＯＭの１ピツトとを、例えば、８ビツ
トのＲＯＭのアドレスＡ１、Ａ２、Ａ３、Ａ４、Ａ５、
Ａ６、Ａ７の各１バイトと、４ビツトのＲＯＭのアドレ
スＢ１の０ビツト目、ｌビット目、２ビツト目、３ビツ
ト目、アドレスＢ２のθビット目、１ビツト目、２ビツ
ト目というように順次組合わせて９ビツトのデータとし
、ドツト・プリンタの各ワイヤーを制御するようになっ
ている。
（３） 従来技術の問題点
このため、２つのＲＯＭを必要とし高価になるという欠
点がある。
点がある。
また、２つのＲＯＭにて形成されているため、印字する
文字に対応するドツト・データの呼出しのソフトウェア
も１つのＲＯＭにてすべてのドラト・データを記憶でき
るワイヤー・ドツト・プリンタを使用する場合と異なる
ため、例えば、電子キャッシュレジスタなζにおいて、
プリンタを９ワイヤー・ドツト・プリンタから７ワイヤ
ー・ドツト・プリンタに、またこの逆に変更する場合、
キャラクタ・ジェネレータだけでなく、このキャラクタ
・ジェネレータに合わせて印字制御のソフトウェアも変
更しなければならず、簡単に変更できないという欠点が
あった。
文字に対応するドツト・データの呼出しのソフトウェア
も１つのＲＯＭにてすべてのドラト・データを記憶でき
るワイヤー・ドツト・プリンタを使用する場合と異なる
ため、例えば、電子キャッシュレジスタなζにおいて、
プリンタを９ワイヤー・ドツト・プリンタから７ワイヤ
ー・ドツト・プリンタに、またこの逆に変更する場合、
キャラクタ・ジェネレータだけでなく、このキャラクタ
・ジェネレータに合わせて印字制御のソフトウェアも変
更しなければならず、簡単に変更できないという欠点が
あった。
（４）発明の目的
本発明は上記欠点に鑑みなされたもので、９ワイヤーの
ドツト・プリンタのキャラクタ・ジェネレータを１つの
ＲＯＭにて構成するとともに、印字制御のソフトウェア
を７ワイヤーのドツト・プリンタにも共通に使用できる
ようにすることを目的とするものである。
ドツト・プリンタのキャラクタ・ジェネレータを１つの
ＲＯＭにて構成するとともに、印字制御のソフトウェア
を７ワイヤーのドツト・プリンタにも共通に使用できる
ようにすることを目的とするものである。
（５） 発明の構成
本発明は９ワイヤー・ドツト・プリンタのキャラクタ・
ジェネレータにおいて、９ワイヤー中の８ワイヤーを制
御するデータを１バイトとし、残りの１ワイヤーを制御
するデータを１字分まとめて１バイトとし同一の８ビツ
ト・ストレイジ・メモリに格納したことを特徴とするプ
リンタのキャラクタ・ジェネレータを提供するものであ
る。
ジェネレータにおいて、９ワイヤー中の８ワイヤーを制
御するデータを１バイトとし、残りの１ワイヤーを制御
するデータを１字分まとめて１バイトとし同一の８ビツ
ト・ストレイジ・メモリに格納したことを特徴とするプ
リンタのキャラクタ・ジェネレータを提供するものであ
る。
（６）発明の実施例
次に本発明の一実施例を牙８図乃至牙５図に基づいて説
明する。
明する。
牙３図はドツト・プリンタの構成を示すブロック図であ
る。この図において、（ＩＩｌは９ワイヤー・ドツト・
プリンタ用のキャラクタ・ジェネレータで、８ビツトの
ストレイシ・メモリすなわちＲＯＭにて形成されている
。このＲＯＭには８バイト単位で７行９列のドツト・マ
トリクスにて印字する各文字のデータが記憶されている
。
る。この図において、（ＩＩｌは９ワイヤー・ドツト・
プリンタ用のキャラクタ・ジェネレータで、８ビツトの
ストレイシ・メモリすなわちＲＯＭにて形成されている
。このＲＯＭには８バイト単位で７行９列のドツト・マ
トリクスにて印字する各文字のデータが記憶されている
。
この記憶状態を、１−４図に示す。なお、この図は文字
ｒＡＪについてで、ある。
ｒＡＪについてで、ある。
アドレスＡ１〜Ａ）には１バイトごとに後述するドツト
・ヘッド（１３１の１番目〜４番目および６番目〜９番
目のワイヤー０４を制御するデータが、またＡ８には１
ピツトごとに前記ドツト・ヘッド峙の５番目のワイヤー
（（４）を制御するデータが格納されている。なお、こ
のデータはｌの場合にドツト印刷されるものとする。ま
た、ＲＯＭデータとは１バイトのデータな０ビツト目〜
４ビツト目、５ビツト目〜８ビツト目と４ビツトずつ分
割して１６進データとして表わしたものである。
・ヘッド（１３１の１番目〜４番目および６番目〜９番
目のワイヤー０４を制御するデータが、またＡ８には１
ピツトごとに前記ドツト・ヘッド峙の５番目のワイヤー
（（４）を制御するデータが格納されている。なお、こ
のデータはｌの場合にドツト印刷されるものとする。ま
た、ＲＯＭデータとは１バイトのデータな０ビツト目〜
４ビツト目、５ビツト目〜８ビツト目と４ビツトずつ分
割して１６進データとして表わしたものである。
（１５１は電子式キャッシュレジスタなどのドツト・プ
リンタが設けられた装置の中央処理装置（以下ＣＰＵと
いう）で、演算結果などを印字する場合、この印字する
情報に対応するドツト・デ、７タをキャラクタ・ジェネ
レータ旧）から読み出す。
リンタが設けられた装置の中央処理装置（以下ＣＰＵと
いう）で、演算結果などを印字する場合、この印字する
情報に対応するドツト・デ、７タをキャラクタ・ジェネ
レータ旧）から読み出す。
［１６１はドライバーで、ＣＰＵＱ５１が読み出したド
ツト・データに基づいてドツト・ヘッドａりを制御し、
プリント動作させる。
ツト・データに基づいてドツト・ヘッドａりを制御し、
プリント動作させる。
なお、ドツト・ヘッドＵ〜にて制御されるワイヤ−（１
４１は文字の上部より下部に向って順に１番目、２番目
−−−−−９番目となっている。
４１は文字の上部より下部に向って順に１番目、２番目
−−−−−９番目となっている。
次にこの実施例の動作を牙５図に示すフローチャートに
清って説明する。
清って説明する。
まず、＋２１１でＣＰＵＱ５１へ印字すべき情報が入力
されたか否か判断する。そして、入力されていない場合
は入力されるまで待つ。また、入力されている場合は、
（２７ＪでＣＰＵ（＋５１にて印字すべき情報に対応す
るドツト・データが記憶されているキャラクタ・ジェネ
レータ圓を構成するＲＯＭのアドレスがセットされる。
されたか否か判断する。そして、入力されていない場合
は入力されるまで待つ。また、入力されている場合は、
（２７ＪでＣＰＵ（＋５１にて印字すべき情報に対応す
るドツト・データが記憶されているキャラクタ・ジェネ
レータ圓を構成するＲＯＭのアドレスがセットされる。
例えば、印字すべき情報がｒＡＪである場合は、まずア
ドレスＡ１とＡ８がセットされる。
ドレスＡ１とＡ８がセットされる。
の
次に（ハ）でＣＰＵＱ５１はアドレスＡ１の１パイ「デ
ータと、アドレスＡ８の０ビツト目に記憶されているデ
ータを読、み取る。
ータと、アドレスＡ８の０ビツト目に記憶されているデ
ータを読、み取る。
次に（２）でＣＰＵＱ５）はアドレスＡｌのθビット目
〜８ビット目に記憶されているデータに基づいて１番目
から４番目のワイヤー（１４１を制御するドライバーｔ
ｔ６１を、またアドレスＡ８の０ビツト目に記憶されて
いるデータに基づいて５番目のワイヤーＩを制御するド
ライバー（１６）を、さらにアドレスＡ１の４ビツト目
〜７ビツト目に記憶されているデータに基づいて６番目
から９番目のワイヤー■を制御するドライバー〇６１ヲ
セットする。
〜８ビット目に記憶されているデータに基づいて１番目
から４番目のワイヤー（１４１を制御するドライバーｔ
ｔ６１を、またアドレスＡ８の０ビツト目に記憶されて
いるデータに基づいて５番目のワイヤーＩを制御するド
ライバー（１６）を、さらにアドレスＡ１の４ビツト目
〜７ビツト目に記憶されているデータに基づいて６番目
から９番目のワイヤー■を制御するドライバー〇６１ヲ
セットする。
次にＱ５１でセットされたドライバー（１６１からドツ
ト・ヘッド（１３１へ信号を出力し、９つのワイヤー（
１４１を動作させてプリントする。
ト・ヘッド（１３１へ信号を出力し、９つのワイヤー（
１４１を動作させてプリントする。
次に（至）でＣＰＵＱωにはＱυで入力された情報を印
□字するために次に必賛とするデータが入力され
ているアドレス、すなわちＡ２とＡ８とがセットされる
。
□字するために次に必賛とするデータが入力され
ているアドレス、すなわちＡ２とＡ８とがセットされる
。
次に罰で１文字分のプリントが終了したか否か判断する
。すなわち、ドライバー化からドツト・ヘッドα漕への
信号の出力が７回あったか否かを判断する。そして、１
文字分のプリントが終了していない場合は再度ｃ２３）
へもどり、これを繰返す。そして、アドレスＡフとＡ８
の６ビツト目までについて前記ｃ！四から（ハ）の動作
を行うと、１文字分のプリントが終了するため、（２刀
で１文字分のプリントが終了したと判断される。すると
、ｃ２１１へもどり、ＣＰＵＱ５１へ新たな印字すべき
情報が入力されるのを待つことになる。
。すなわち、ドライバー化からドツト・ヘッドα漕への
信号の出力が７回あったか否かを判断する。そして、１
文字分のプリントが終了していない場合は再度ｃ２３）
へもどり、これを繰返す。そして、アドレスＡフとＡ８
の６ビツト目までについて前記ｃ！四から（ハ）の動作
を行うと、１文字分のプリントが終了するため、（２刀
で１文字分のプリントが終了したと判断される。すると
、ｃ２１１へもどり、ＣＰＵＱ５１へ新たな印字すべき
情報が入力されるのを待つことになる。
なお、（５）で１文字の印字を完了したか否かの判断の
ためのデータとしては、ドライバーＯｅのセットされた
回数をカウンタにて計数する方法、または、ＣＰＵ（１
５）にアドレスがセットされた回数を計数するなど方法
は種々ある。
ためのデータとしては、ドライバーＯｅのセットされた
回数をカウンタにて計数する方法、または、ＣＰＵ（１
５）にアドレスがセットされた回数を計数するなど方法
は種々ある。
このように９ワイヤー・ドツト・プリンタのキャラクタ
・ジェネレータを８ビツトのＲＯＭ１つにて構成するこ
とができ、安価に製造できる。
・ジェネレータを８ビツトのＲＯＭ１つにて構成するこ
とができ、安価に製造できる。
次に本発明の構成を７ワイヤー・ドツト・プリンタのキ
ャラクタ・ジェネレータに応用した場合を説明する。
ャラクタ・ジェネレータに応用した場合を説明する。
牙６図は７ワイヤー・ドツト・プリンタ用のキャラクタ
・ジェネレータを構成するストレイジ・メモリとしての
ＲＯＭの記憶状態の一部を示す図で、アドレスＡ１〜Ａ
７には０ビツト目と７ビツト目を除く６ビツトにドツト
・ヘッド（１３Ｊの１番目夕が、またＡ８にはｌビット
ごとに前記ドツト・いる。なお、アドレスＡＮ〜Ａ７０
０ビット目と７ビツト目には文字Ｋかかわらす０を入力
しておく。
・ジェネレータを構成するストレイジ・メモリとしての
ＲＯＭの記憶状態の一部を示す図で、アドレスＡ１〜Ａ
７には０ビツト目と７ビツト目を除く６ビツトにドツト
・ヘッド（１３Ｊの１番目夕が、またＡ８にはｌビット
ごとに前記ドツト・いる。なお、アドレスＡＮ〜Ａ７０
０ビット目と７ビツト目には文字Ｋかかわらす０を入力
しておく。
このように構成されたキャラクタ・ジェネレータを用い
れば、前記実施例の場合と同様のソフトウェアにて牙５
図のフローチャートに治って印字動作を行うことができ
るものである。
れば、前記実施例の場合と同様のソフトウェアにて牙５
図のフローチャートに治って印字動作を行うことができ
るものである。
すなわち、（ハ）でＣＰＵＱ５１は９ビツトのデータな
断み取るが、ＲＯＭのアドレスＡ１〜Ａ７のθビット目
と１ビツト目に記イ意されているデータはすべて０であ
るため、■力でこのデータに基づいて制御するドライバ
ー０句をセットする場合は、０ビツト目と１ビツト目の
データはｃｐＵａ５１ｖｃ読み出されなかったのと同じ
になり、実際はＡ１〜Ａ７の各アドレスの１ビツト目〜
６ビツト目のデータとアドレスＡ８の各ピットごとのデ
ータとの計１ビットのデータに基づいてドライバーをセ
ットすることになるためである。
断み取るが、ＲＯＭのアドレスＡ１〜Ａ７のθビット目
と１ビツト目に記イ意されているデータはすべて０であ
るため、■力でこのデータに基づいて制御するドライバ
ー０句をセットする場合は、０ビツト目と１ビツト目の
データはｃｐＵａ５１ｖｃ読み出されなかったのと同じ
になり、実際はＡ１〜Ａ７の各アドレスの１ビツト目〜
６ビツト目のデータとアドレスＡ８の各ピットごとのデ
ータとの計１ビットのデータに基づいてドライバーをセ
ットすることになるためである。
このように７ワイヤー・ドツト・プリンタと９ワイヤー
・ドツト・プリンタとが同一のソフトウェアにて制御で
錬るため、電子式キャッシュレジスタなどにおいてプリ
ンタを９ワイヤー・ドツト・プリンタから７ワイヤー・
ドツト・プリンタに変更する場合、または、この逆の場
合、ドツト・プリンタとキャラクタ・ジェネレータのみ
を交換するだけでよく、変更を簡単に行うことができ、
作業性および経済性を向上できる。
・ドツト・プリンタとが同一のソフトウェアにて制御で
錬るため、電子式キャッシュレジスタなどにおいてプリ
ンタを９ワイヤー・ドツト・プリンタから７ワイヤー・
ドツト・プリンタに変更する場合、または、この逆の場
合、ドツト・プリンタとキャラクタ・ジェネレータのみ
を交換するだけでよく、変更を簡単に行うことができ、
作業性および経済性を向上できる。
（７） 発明の効果
本発明によれば、９ワイヤー・ドツト・プリンタのキャ
ラクタ・ジェネレータを８ビツトのＲＯＭ１つにて形成
することができ、安価に製造できるものである。
ラクタ・ジェネレータを８ビツトのＲＯＭ１つにて形成
することができ、安価に製造できるものである。
また、９ワイヤー・ドツト・プリンタのキャラクタ・ジ
ェネレータを８ビツトのＲＯＭ １つにて形成したため
、７ワイヤー・ドツト・プリンタと同一のソフトウェア
で制御できる構成とでき、プリンタを９ワイヤー・ドツ
ト・プリンタから７ワイヤー・ドツト・プリンタに変更
する場合、または、その逆の場合もドツト・プリンタと
キャラクタ・ジェネレータのみを変換するだけでよく、
プリンタの変更が容易にでき、かつソフトウェアを変更
する必９がないため経済的で、変更作業の作業性も向上
できるものである。
ェネレータを８ビツトのＲＯＭ １つにて形成したため
、７ワイヤー・ドツト・プリンタと同一のソフトウェア
で制御できる構成とでき、プリンタを９ワイヤー・ドツ
ト・プリンタから７ワイヤー・ドツト・プリンタに変更
する場合、または、その逆の場合もドツト・プリンタと
キャラクタ・ジェネレータのみを変換するだけでよく、
プリンタの変更が容易にでき、かつソフトウェアを変更
する必９がないため経済的で、変更作業の作業性も向上
できるものである。
牙１図および牙２図は従来の９ワイヤー・ドツト・プリ
ンタのキャラクタ・ジェネレータの説明図、牙３図は本
発明のプリンタを示すブロック図、牙４・図は同上９ワ
イヤー・ドツト・プリンタのキャラクタ・ジェネレータ
の説明図、牙５図は同上プリンタの動作説明図、牙６図
は本発明の７ワイヤー・ドツト・プリンタのキャラクタ
・ジェネレータの説明図である。 ａｌ）−・キャラクタ・ジェネレータ、α３Ｊψ・ドツ
ト・ヘッド、圓・・ワイヤー。
ンタのキャラクタ・ジェネレータの説明図、牙３図は本
発明のプリンタを示すブロック図、牙４・図は同上９ワ
イヤー・ドツト・プリンタのキャラクタ・ジェネレータ
の説明図、牙５図は同上プリンタの動作説明図、牙６図
は本発明の７ワイヤー・ドツト・プリンタのキャラクタ
・ジェネレータの説明図である。 ａｌ）−・キャラクタ・ジェネレータ、α３Ｊψ・ドツ
ト・ヘッド、圓・・ワイヤー。
Claims (1)
- （１）９ワイヤー・ドツト・プリンタのキャラクタ・ジ
ェネレータにおいて、９ワイヤー中の８ワイヤーを制御
するデータを１バイトとし、残りの１ワイヤーのデータ
を１字分まとめて１バイトとし同一の８ビツトのストレ
イジ・メモリに格納したことを特徴とするプリンタのキ
ャラクタ・ジェネレータ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56173400A JPS5875283A (ja) | 1981-10-29 | 1981-10-29 | プリンタのキヤラクタ・ジエネレ−タ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56173400A JPS5875283A (ja) | 1981-10-29 | 1981-10-29 | プリンタのキヤラクタ・ジエネレ−タ |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS5875283A true JPS5875283A (ja) | 1983-05-06 |
Family
ID=15959706
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP56173400A Pending JPS5875283A (ja) | 1981-10-29 | 1981-10-29 | プリンタのキヤラクタ・ジエネレ−タ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5875283A (ja) |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5492414A (en) * | 1977-12-28 | 1979-07-21 | Gen Corp | Letter printing control system of dot printer |
-
1981
- 1981-10-29 JP JP56173400A patent/JPS5875283A/ja active Pending
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5492414A (en) * | 1977-12-28 | 1979-07-21 | Gen Corp | Letter printing control system of dot printer |
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